JPH053997Y2 - - Google Patents
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- JPH053997Y2 JPH053997Y2 JP1988029580U JP2958088U JPH053997Y2 JP H053997 Y2 JPH053997 Y2 JP H053997Y2 JP 1988029580 U JP1988029580 U JP 1988029580U JP 2958088 U JP2958088 U JP 2958088U JP H053997 Y2 JPH053997 Y2 JP H053997Y2
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Description
【考案の詳細な説明】
（産業上の利用分野）
本考案は音声認識によりアラーム報知を停止す
る時計に関する。[Detailed Description of the Invention] (Industrial Application Field) The present invention relates to a watch that stops alarm notification by voice recognition.
（従来技術）
従来において音声認識によりアラーム報知を停
止するものとしては、特開昭62−145188号公報に
記載されているものがある。これは音声認識回路
を用いて、予め登録された音声データとマイク等
を含む外部音検知回路から出力される音声信号と
が同一であると認識した時に特定の認識信号を出
力し、この信号を用いてアラーム報知を停止する
ものである。(Prior Art) As a conventional method for stopping alarm notification by voice recognition, there is a method described in Japanese Patent Application Laid-open No. 145188/1988. This uses a voice recognition circuit to output a specific recognition signal when it recognizes that pre-registered voice data and the voice signal output from an external sound detection circuit including a microphone etc. are the same. This is used to stop alarm notification.
（考案が解決しようとする問題点）
しかしながら上記従来技術においては、時計本
体から報知されるアラーム音も外部音検知回路に
よつて検知されてしまい、使用者から発せられる
音声を認識することは不可能であつた。(Problem to be solved by the invention) However, in the above conventional technology, the alarm sound notified from the watch body is also detected by the external sound detection circuit, and it is impossible to recognize the sound emitted by the user. It was possible.
（問題点を解決するための手段）
本考案は上記問題点を解決するために、アラー
ム報知期間は所定時間だけ交互に音声認識動作と
アラーム報知動作を禁止することを特徴とする。(Means for Solving the Problems) In order to solve the above problems, the present invention is characterized in that the voice recognition operation and the alarm notification operation are alternately prohibited for a predetermined period of time during the alarm notification period.
（実施例） 以下図面に基いて本考案を詳細に説明する。(Example) The present invention will be explained in detail below based on the drawings.
第１図は本考案を適用した音声認識アラーム時
計の実施例である。 FIG. 1 shows an embodiment of a voice recognition alarm clock to which the present invention is applied.
時計回路２は周知の発振回路４、分周回路６、
波形整形回路８及び駆動回路１０から成り、発振
回路４から出力される基準信号を0.5Hzまで分周
し、時計用のモータ１４を駆動する信号を出力す
る。 The clock circuit 2 includes a well-known oscillation circuit 4, a frequency dividing circuit 6,
It consists of a waveform shaping circuit 8 and a drive circuit 10, and divides the frequency of the reference signal output from the oscillation circuit 4 down to 0.5Hz, and outputs a signal for driving the watch motor 14.
時刻表示部１２も周知の構成から成り、モータ
１４の回転を輪列１６で適宜に減速し、指針１８
の指示により時刻を表示する。 The time display unit 12 also has a well-known configuration, and the rotation of the motor 14 is appropriately decelerated by the wheel train 16,
Display the time according to the instructions.
本実施例では指針式アナログ表示時計の構成を
示したが、電子式デジタル表示時計で構成しても
良く、例えば時計回路２には時刻信号を形成する
計時カウンタを設け、時刻表示部１２には時刻を
所定の数字により表示するLCD等の表示素子と、
時刻信号を表示信号に変換して表示素子を駆動す
るデコーダ・ドライバとを設ける。 Although the configuration of a pointer-type analog display clock is shown in this embodiment, it may also be configured with an electronic digital display clock. For example, the clock circuit 2 is provided with a time counter that generates a time signal, and the time display section 12 is provided with a time counter that generates a time signal. A display element such as an LCD that displays the time using predetermined numbers;
A decoder/driver is provided that converts a time signal into a display signal and drives a display element.
外部音検知回路２０はマイク等から成り、入力
される外部音を音声信号に変換し、これを認識信
号発生回路２２に供給する。 The external sound detection circuit 20 is composed of a microphone, etc., converts input external sound into an audio signal, and supplies this to the recognition signal generation circuit 22.
そして認識信号発生回路２２は音声認識回路２
４、ノアゲート２６及び登録スイツチ２８から成
り、登録された音声データと外部音検知回路２０
からの音声信号が同一であると認識した時に指令
信号を出力する。すなわち音声認識回路２４の音
声入力端子MIには外部音検知回路２０からの音
声信号が入力され、これが登録済の音声データと
同一であると認識すると出力端子W1，W2，W3，
W4にそれぞれ「Ｈ」，「Ｌ」，「Ｌ」，「Ｌ」を出力
する。従つて出力端子W1〜W4の信号を入力する
ノアゲート２６は、上記の場合のみに「Ｈ」とな
る認識信号を出力する。また登録イネーブル端子
Ｋ，Ｓには登録スイツチ２８が接続され、このス
イツチ２８が操作されると登録可能状態となり、
外部音検知回路２０からの音声信号を音声データ
として内部に記憶する。またスタンバイ端子ST
は音声認識回路２４の動作を制御するものであ
り、「Ｌ」が入力されると動作可能、「Ｈ」が入力
されると動作不能となる。 The recognition signal generation circuit 22 is the voice recognition circuit 2.
4. Consists of Noah gate 26 and registration switch 28, which detects registered audio data and external sound detection circuit 20
It outputs a command signal when it recognizes that the audio signals from the two are the same. That is, the audio signal from the external sound detection circuit 20 is input to the audio input terminal MI of the audio recognition circuit 24, and when it is recognized that this is the same as the registered audio data, the output terminals W 1 , W 2 , W 3 ,
Output "H", "L", "L", and "L" to W4 , respectively. Therefore, the NOR gate 26, which receives the signals from the output terminals W1 to W4 , outputs a recognition signal that becomes "H" only in the above case. In addition, a registration switch 28 is connected to the registration enable terminals K and S, and when this switch 28 is operated, it becomes possible to register.
The audio signal from the external sound detection circuit 20 is stored internally as audio data. Also standby terminal ST
Controls the operation of the voice recognition circuit 24, and when "L" is input, it is enabled to operate, and when "H" is input, it is disabled.
アラーム回路３０は目安接点３２、インバータ
３４、微分回路３６、ナンドゲート３８、FF４
０及びアンドゲート４２から成り、時刻表示部１
２が設定時刻を指示した時から前述の認識信号が
出力されるまでアラーム動作信号を出力する。目
安接点３２は輪列１２に組込まれる目安機構（図
示せず）の変位に応動し、設定時刻から20〜40分
程度閉成する。そしてこの目安接点３２の出力信
号はインバータ３４で反転され、微分回路３６及
びナンドゲート３８を介してFF４０のリセツト
端子に供給しており、またナンドゲート３８の
他入力端子には後述するアラームセツト信号が入
力されている。このためアラームセツト信号が
「Ｈ」の状態でかつ目安接点３２が閉成させると
FF４０がリセツトされ、その出力から「Ｈ」
となるアラーム動作信号が出力される。 The alarm circuit 30 includes a reference contact 32, an inverter 34, a differential circuit 36, a NAND gate 38, and an FF4.
0 and an AND gate 42, the time display section 1
2 outputs an alarm operation signal from the time when the set time is specified until the above-mentioned recognition signal is output. The guide contact 32 responds to the displacement of a guide mechanism (not shown) incorporated in the wheel train 12 and closes for about 20 to 40 minutes from the set time. The output signal of this reference contact 32 is inverted by an inverter 34 and supplied to the reset terminal of the FF 40 via a differentiating circuit 36 and a NAND gate 38, and an alarm set signal, which will be described later, is input to other input terminals of the NAND gate 38. has been done. Therefore, if the alarm set signal is in the "H" state and the reference contact 32 is closed,
FF40 is reset and its output becomes “H”
An alarm operation signal is output.
一方FF４０のクロツク端子φには認識信号及
びアラームセツト信号を入力するアンドゲート４
２の出力が供給される。よつてアラームセツト信
号が「Ｈ」の状態で認識信号が出力されるとアン
ドゲート４２の出力に応じてFF４０の出力は
「Ｌ」となり、アラーム動作信号の出力が停止さ
れる。 On the other hand, the AND gate 4 inputs the recognition signal and alarm set signal to the clock terminal φ of the FF40.
2 outputs are provided. Therefore, when the recognition signal is output while the alarm set signal is in the "H" state, the output of the FF 40 becomes "L" in accordance with the output of the AND gate 42, and the output of the alarm operation signal is stopped.
報知回路４４はアラーム信号形成回路４６、発
音体４８及びトランジスタ５０から成り、前述の
アラーム動作信号の出力に応答してアラーム音を
報知する。すなわちアラーム動作信号が出力され
ると、アラーム信号形成回路４６は第２図Ｂに示
す様な断続可聴周波数信号を出力するため、これ
に応じてトランジスタ５０がオン、オフされる。
従つて発音体４８には駆動電圧が継続可聴周波数
信号に対応して印加されることになり、この結果
所定周波数の継続音がアラーム音として報知され
る。 The notification circuit 44 includes an alarm signal forming circuit 46, a sounding element 48, and a transistor 50, and reports an alarm sound in response to the output of the above-mentioned alarm operation signal. That is, when the alarm operation signal is output, the alarm signal forming circuit 46 outputs an intermittent audio frequency signal as shown in FIG. 2B, and the transistor 50 is turned on and off accordingly.
Therefore, a driving voltage is applied to the sounding body 48 in accordance with the continuous audible frequency signal, and as a result, a continuous sound of a predetermined frequency is notified as an alarm sound.
スイツチ回路５２はモードスイツチ５４及びデ
コーダ５６から成り、アラーム報知動作を可能と
するアラームセツトモード、アラーム報知動作を
禁止するアラームオフモード及び認識する言葉を
登録する登録モードのうちの何れか１つを選択す
る。デコーダ５６はモードスイツチ５４の出力に
応じて、アラームセツトモードではアラームセツ
ト信号のみを「Ｈ」、アラームオフモードではア
ラームオフ信号のみを「Ｈ」とし、さらに登録モ
ードでは両信号を共に「Ｌ」とする。 The switch circuit 52 consists of a mode switch 54 and a decoder 56, and is configured to select one of an alarm set mode that enables an alarm notification operation, an alarm off mode that prohibits an alarm notification operation, and a registration mode that registers words to be recognized. select. According to the output of the mode switch 54, the decoder 56 sets only the alarm set signal to "H" in the alarm set mode, sets only the alarm off signal to "H" in the alarm off mode, and sets both signals to "L" in the registration mode. shall be.
そして制御信号発生回路５８は抵抗器６０、ト
ランジスタ６２、タイマ回路６４及びインバータ
６６から成り、時計回路２におけるモータ駆動信
号Ａの出力の応答して所定時間幅の制御信号Ｃを
出力する。すなわちモータ駆動信号Ａは抵抗器６
０を介してトランジスタ６２のベースに供給され
ており、このトランジスタ６２の出力がタイマ回
路６４に供給されている。よつてタイマ回路６４
はモータ駆動信号Ａの立ち下りに応答して所定時
間、例えば1.5秒間「Ｈ」となる信号を出力し、
これがインバータ６６により反転されて、制御信
号Ｃとして出力される。 The control signal generation circuit 58 includes a resistor 60, a transistor 62, a timer circuit 64, and an inverter 66, and outputs a control signal C having a predetermined time width in response to the output of the motor drive signal A from the clock circuit 2. In other words, the motor drive signal A is connected to the resistor 6.
0 to the base of a transistor 62, and the output of this transistor 62 is supplied to a timer circuit 64. Yotsute timer circuit 64
outputs a signal that is “H” for a predetermined period of time, for example, 1.5 seconds in response to the falling of the motor drive signal A,
This is inverted by an inverter 66 and output as a control signal C.
認識制御回路６８はインバータ７０、オアゲー
ト７２，７６及びアンドゲート７４から成り、認
識信号発生回路２２の認識動作を各モード毎に制
御する。すなわち登録モードでは常時動作可能、
アラームオフモードでは常時認識動作禁止とし、
さらにアラームセツトモードでは、アラーム動作
信号の非出力時は常時認識動作を禁止し、出力時
は制御信号の出力時のみ認識動作を可能とする。
そして音声認識回路２４のスタンバイ端子STに
オアゲート７０の出力を供給し、このオアゲート
７０にはデコーダ５６からのアラームオフ信号
と、アンドゲート７２の出力とを供給する。また
アンドゲート７２にはデコーダ５６からのアラー
ムセツト信号と、オアゲート７４の出力とを供給
し、さらにこのオアゲート７４にはインバータ７
６を介したFF４０からのアラーム動作信号と、
インバータ６６からの制御信号とを供給する。そ
してオアゲート７０の出力が「Ｈ」となれば音声
認識回路２４は動作不可能となる。 The recognition control circuit 68 includes an inverter 70, OR gates 72 and 76, and an AND gate 74, and controls the recognition operation of the recognition signal generation circuit 22 for each mode. In other words, it can always operate in registration mode,
In alarm off mode, recognition operation is always prohibited.
Further, in the alarm set mode, the recognition operation is always prohibited when the alarm operation signal is not output, and the recognition operation is enabled only when the control signal is output.
The output of the OR gate 70 is supplied to the standby terminal ST of the voice recognition circuit 24, and the alarm off signal from the decoder 56 and the output of the AND gate 72 are supplied to the OR gate 70. Further, the AND gate 72 is supplied with the alarm set signal from the decoder 56 and the output of the OR gate 74, and the OR gate 74 is further supplied with the inverter 7.
an alarm operation signal from FF40 via 6;
A control signal from an inverter 66 is supplied. Then, when the output of the OR gate 70 becomes "H", the voice recognition circuit 24 becomes inoperable.
報知制御回路７８はトランジスタ８０、抵抗器
８２及びアンドゲート８４から成り、制御信号の
出力に基いてアラーム報知動作を制御する。すな
わちトランジスタ８０は発音体４８とアースとの
間に挿入され、そのベースには抵抗器８２を介し
てアンドゲート８４の出力が供給されている。よ
つてアンドゲート８４の出力を「Ｌ」にすればト
ランジスタ８０がオフとなるため、発音体４８に
は駆動電圧が印加されず、この結果アラーム音が
報知されなくなる。そしてアンドゲート８４には
デコーダ５６からのアラーム動作信号と、インバ
ータ６６からの制御信号とを供給している。 The notification control circuit 78 includes a transistor 80, a resistor 82, and an AND gate 84, and controls the alarm notification operation based on the output of the control signal. That is, the transistor 80 is inserted between the sounding body 48 and the ground, and the output of the AND gate 84 is supplied to the base of the transistor 80 via the resistor 82. Therefore, when the output of the AND gate 84 is set to "L", the transistor 80 is turned off, so that no drive voltage is applied to the sounding element 48, and as a result, the alarm sound is no longer reported. The AND gate 84 is supplied with an alarm operation signal from the decoder 56 and a control signal from the inverter 66.
本実施例は上述の様に構成されており、以下に
その動作を説明する。 This embodiment is configured as described above, and its operation will be explained below.
まず、モードスイツチ５４の操作により登録モ
ードにした場合を説明する。このモードにおいて
はデコーダ５６から出力される両信号が共に
「Ｌ」であるため、オアゲート７０から出力され
る認識制御信号も「Ｌ」となり、音声認識回路２
４は動作可能となつている。ここで登録スイツチ
２８を操作すると登録待ち状態となり、外部音検
知回路２０から音声信号、例えば「オハヨウ」が
入力されると、それを認識する言葉として登録す
る。またこの状態において設定時刻が到来した場
合には、アラームセツト信号が「Ｌ」であるた
め、目安接点３２が閉成しても微分回路３６から
出力される単パルスはナンドゲート３８を通過せ
ず、これによつてアラーム動作信号の出力を禁止
している。すなわち登録モードにおいてはアラー
ム報知動作が禁止されるのである。 First, the case where the registration mode is set by operating the mode switch 54 will be described. In this mode, since both signals output from the decoder 56 are "L", the recognition control signal output from the OR gate 70 is also "L", and the speech recognition circuit 2
4 is operational. If the registration switch 28 is operated here, the system enters a registration waiting state, and when a voice signal, for example "Ohayo" is input from the external sound detection circuit 20, it is registered as a recognized word. Furthermore, when the set time arrives in this state, the alarm set signal is "L", so even if the reference contact 32 closes, the single pulse output from the differentiating circuit 36 will not pass through the NAND gate 38. This prohibits the output of the alarm operation signal. That is, the alarm notification operation is prohibited in the registration mode.
次にアラームオフモードについて説明する。こ
のモードにおいてはデコーダ５６から出力される
アラームセツト信号が「Ｌ」であり、従つて登録
モードと同様に、目安接点が閉成しても微分回路
３６から出力される単パルスはナンドゲート３８
を通過することがなく、従つてアラーム報知動作
は常時禁止される。一方デコーダ５６から出力さ
れるアラームオフ信号は「Ｈ」であり、これに伴
つてオアゲート７０から出力される認識制御信号
は常時「Ｈ」となる。従つて音声認識回路２４は
常時認識動作不可能となり、これによつてアラー
ムオフモードでは必要のない認識動作を禁止し
て、無駄な電流消費を削減する。 Next, the alarm off mode will be explained. In this mode, the alarm set signal output from the decoder 56 is "L", and therefore, as in the registration mode, even if the reference contact is closed, the single pulse output from the differentiating circuit 36 will be output from the NAND gate 38.
Therefore, the alarm notification operation is always prohibited. On the other hand, the alarm off signal outputted from the decoder 56 is "H", and in conjunction with this, the recognition control signal outputted from the OR gate 70 is always "H". Therefore, the voice recognition circuit 24 is always incapable of performing recognition operations, thereby prohibiting unnecessary recognition operations in the alarm off mode, thereby reducing wasteful current consumption.
そしてアラームセツトモードにおいてはデコー
ダ５６から出力されるアラームオフ信号が「Ｌ」、
アラームセツト信号が「Ｈ」であり、ここではナ
ンドゲート３８及びアンドゲート４２，７２，８
４がそれぞれ開状態になり、オアゲート７０から
の認識制御信号はアンドゲート７２の出力に応じ
て出力されることになる。 In the alarm set mode, the alarm off signal output from the decoder 56 is "L",
The alarm set signal is "H", and here the NAND gate 38 and the AND gates 42, 72, 8
4 are in the open state, and the recognition control signal from the OR gate 70 is output in accordance with the output of the AND gate 72.
まず設定時刻の到来前においてはFF４０から
出力されるアラーム動作信号が「Ｌ」であるから
無論アラーム報知動作は行われず、また同信号は
インバータ７６により反転され、さらにオアゲー
ト７４を介してアンドゲート７２に供給されるた
め、アンドゲート７２の出力は「Ｈ」となる。よ
つてオアゲート７０から出力される認識制御信号
は「Ｈ」となり、この状態においてもアラームオ
フモードと同様に、認識動作を禁止して無駄な電
流消費を削減する。 First, before the set time arrives, the alarm operation signal output from the FF 40 is "L", so of course no alarm notification operation is performed, and the signal is inverted by the inverter 76 and further passed through the OR gate 74 to the AND gate 72. Therefore, the output of the AND gate 72 becomes "H". Therefore, the recognition control signal output from the OR gate 70 becomes "H", and even in this state, similarly to the alarm off mode, the recognition operation is prohibited to reduce wasteful current consumption.
そして設定時刻が到来して目安接点３２が閉成
すると、微分回路３６から単パルスが出力され、
これがナンドゲート３８を介してFF４０をリセ
ツトする。よつてFF４０から出力されるアラー
ム動作信号は「Ｈ」となり、報知回路４４の動作
によりアラーム音を報知し、また音声認識回路２
４の認識動作を可能として音声認識によるアラー
ム音の報知停止機能を能動とする。と共に本実施
例においては、制御信号発生回路５８から出力さ
れる制御信号に基いて交互に音声認識動作とアラ
ーム報知動作を禁止する。 When the set time arrives and the reference contact 32 closes, a single pulse is output from the differentiating circuit 36.
This resets FF 40 via NAND gate 38. Therefore, the alarm operation signal output from the FF 40 becomes "H", and the alarm sound is notified by the operation of the notification circuit 44, and the voice recognition circuit 2
The recognition operation of 4 is enabled, and the alarm sound notification stop function by voice recognition is activated. Additionally, in this embodiment, the voice recognition operation and the alarm notification operation are alternately prohibited based on the control signal output from the control signal generation circuit 58.
すなわちオアゲート７０から出力される認識制
御信号は、インバータ６６から出力される制御信
号と同相の信号となり、第２図に示す期間Paだ
け「Ｈ」となる。よつて音声認識回路２４は期間
Piにおいてのみ認識動作を行ない、期間Paにお
いてはその動作が禁止されることになる。 That is, the recognition control signal output from the OR gate 70 becomes a signal in phase with the control signal output from the inverter 66, and becomes "H" only during the period Pa shown in FIG. Therefore, the speech recognition circuit 24
The recognition operation is performed only in Pi, and that operation is prohibited during period Pa.
またアンドゲート８４の出力もインバータ６６
から出力される制御信号と同相の信号となり、ト
ランジスタ８０は第２図に示す期間Paのみオン
状態となる。よつてアラーム報知動作は期間Pa
においてのみ行なわれ、期間Piにおいてはその動
作が禁止される。 In addition, the output of the AND gate 84 is also connected to the inverter 66.
The signal is in phase with the control signal output from the transistor 80, and the transistor 80 is turned on only during the period Pa shown in FIG. Therefore, the alarm notification operation is for period Pa
This operation is only performed during the period Pi, and its operation is prohibited during the period Pi.
従つて期間Piにおいて、予め録音された音声、
例えば「オハヨウ」を発声すれば、この時はアラ
ーム音が報知されていないため、発声した音声の
みが外部音検知回路２０を介して音声認識回路２
４に供給されることになる。そして登録した音声
と同一であると認識すればノアゲート２６から認
識信号が出力され、これがアンドゲート４２を介
してFF４０に供給される。よつてこれに応答し
てFF４０はアラーム動作信号の出力を停止する
ため、アラーム報知動作が停止されることにな
る。 Therefore, in period Pi, the pre-recorded audio,
For example, if you utter "Ohayo", the alarm sound is not being sounded at this time, so only the uttered voice is transmitted to the voice recognition circuit 2 via the external sound detection circuit 20.
4 will be supplied. If it is recognized that the voice is the same as the registered voice, a recognition signal is output from the NOR gate 26, and this is supplied to the FF 40 via the AND gate 42. Therefore, in response to this, the FF 40 stops outputting the alarm operation signal, so the alarm notification operation is stopped.
（考案の効果）
以上の説明の様に本考案によれば、音声認識に
よりアラーム報知動作を停止する場合では、アラ
ーム報知期間において所定時間だけ交互に音声認
識動作とアラーム報知動作を禁止する構成とした
ため、アラーム音の混在した音声ではなく、使用
者の発声音のみを認識の対象とすることができ、
この結果容易に音声認識によるアラーム報知動作
の停止が可能になつた。(Effect of the invention) As described above, according to the invention, when stopping the alarm notification operation by voice recognition, the voice recognition operation and the alarm notification operation are alternately prohibited for a predetermined time during the alarm notification period. As a result, only the user's voice can be recognized, rather than the voice mixed with the alarm sound.
As a result, it has become possible to easily stop the alarm notification operation using voice recognition.
第１図は本考案に係る音声認識アラーム時計の
実施例を示すブロツク回路図。第２図は第１図の
動作を示すタイムチヤート。
２……時計回路、１２……時刻表示部、２０…
…外部音検知回路、２２……認識信号発生回路、
３０……アラーム回路、４６……報知回路、５２
……スイツチ回路、５８……制御信号発生回路、
６８……認識制御回路、７８……報知制御回路。
FIG. 1 is a block circuit diagram showing an embodiment of the voice recognition alarm clock according to the present invention. FIG. 2 is a time chart showing the operation of FIG. 1. 2... Clock circuit, 12... Time display section, 20...
...External sound detection circuit, 22...Recognition signal generation circuit,
30...Alarm circuit, 46...Notification circuit, 52
...Switch circuit, 58...Control signal generation circuit,
68...Recognition control circuit, 78...Notification control circuit.
Claims (1)
と、 該時計回路からの信号に基いて時刻を表示する
時刻表示部と、 外部音を検知してそれに対応する音声信号を出
力する外部音検知回路と、 予め登録された音声データと前記外部音検知回
路から出力された音声信号とが同一であると認識
した時に認識信号を出力する認識信号発生回路
と、 前記時刻表示部が任意設定時刻を指示した時か
ら前記認識信号が出力されるまでアラーム動作信
号を出力するアラーム回路と、 前記アラーム動作信号の出力に応答してアラー
ム音を報知する報知回路と、 を有する時計において、 前記時計回路から出力される一定周期信号に応
答して所定時間幅の制御信号を出力する制御信号
発生回路と、 前記アラーム動作信号の出力を条件とし、前記
制御信号の第１出力状態において前記認識信号発
生回路の認識動作を禁止する認識制御回路と、 前記制御信号の第２出力状態において前記報知
回路の報知動作を禁止する報知制御回路と、 を設けたことを特徴とする音声認識アラーム時
計。[Claims for Utility Model Registration] A clock circuit that divides a reference signal to a specific frequency, a time display section that displays the time based on the signal from the clock circuit, and a sound that detects external sounds and responds to them. an external sound detection circuit that outputs a signal; a recognition signal generation circuit that outputs a recognition signal when it recognizes that pre-registered audio data and the audio signal output from the external sound detection circuit are the same; and the time. an alarm circuit that outputs an alarm operation signal from the time when the display section indicates an arbitrary setting time until the recognition signal is output; and a notification circuit that notifies an alarm sound in response to the output of the alarm operation signal. In a timepiece, a control signal generation circuit outputs a control signal of a predetermined time width in response to a constant periodic signal output from the timepiece circuit; and a first output state of the control signal, with the output of the alarm operation signal as a condition. A recognition control circuit that prohibits the recognition operation of the recognition signal generation circuit in the second output state of the control signal; and an notification control circuit that prohibits the notification operation of the notification circuit in the second output state of the control signal. alarm clock.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1988029580U JPH053997Y2 (en) | 1988-03-03 | 1988-03-03 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1988029580U JPH053997Y2 (en) | 1988-03-03 | 1988-03-03 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01135396U JPH01135396U (en) | 1989-09-18 |
| JPH053997Y2 true JPH053997Y2 (en) | 1993-01-29 |
Family
ID=31253919
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1988029580U Expired - Lifetime JPH053997Y2 (en) | 1988-03-03 | 1988-03-03 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH053997Y2 (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH10179941A (en) * | 1996-10-21 | 1998-07-07 | Junji Kuwabara | Voice recognition and generation apparatuses, toy with the apparatus, and recording medium having voice recognition and generation control program recorded therein |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5126071A (en) * | 1974-08-28 | 1976-03-03 | Citizen Watch Co Ltd | Denshidokei no jikokushuseihoshiki |
| JPS6025487A (en) * | 1983-07-22 | 1985-02-08 | Rhythm Watch Co Ltd | Voice timepiece with snooze function |
-
1988
- 1988-03-03 JP JP1988029580U patent/JPH053997Y2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5126071A (en) * | 1974-08-28 | 1976-03-03 | Citizen Watch Co Ltd | Denshidokei no jikokushuseihoshiki |
| JPS6025487A (en) * | 1983-07-22 | 1985-02-08 | Rhythm Watch Co Ltd | Voice timepiece with snooze function |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH10179941A (en) * | 1996-10-21 | 1998-07-07 | Junji Kuwabara | Voice recognition and generation apparatuses, toy with the apparatus, and recording medium having voice recognition and generation control program recorded therein |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01135396U (en) | 1989-09-18 |
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