JPH0522680A - Picture processor - Google Patents

Picture processor

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Publication number
JPH0522680A
JPH0522680A JP3198625A JP19862591A JPH0522680A JP H0522680 A JPH0522680 A JP H0522680A JP 3198625 A JP3198625 A JP 3198625A JP 19862591 A JP19862591 A JP 19862591A JP H0522680 A JPH0522680 A JP H0522680A
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JP
Japan
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data
line
memory
vertical
image
Prior art date
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Pending
Application number
JP3198625A
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Japanese (ja)
Inventor
Yasutada Aoyama
泰忠 青山
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Brother Industries Ltd
Original Assignee
Brother Industries Ltd
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Publication date
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Publication of JPH0522680A publication Critical patent/JPH0522680A/en
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  • Transforming Electric Information Into Light Information (AREA)
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  • Controls And Circuits For Display Device (AREA)

Abstract

PURPOSE:To provide the picture processor capable of display with a memory capacity half of the memory capacity required for constituting one frame without remarkable deterioration of picture quality when a natural still picture is displayed. CONSTITUTION:The picture processor constituting one screen with two vertical scannings by jumping scanning display stores natural still picture in a video memory (a) 10 from an external storage device 2, displays the contents of a video memory (a) 10 in the first vertical scanning, and stores the picture element data adjacent in the vertical direction in line memories (a) 12 and (b) 13 in the next vertical scanning. The result of the comparison calculation in an arithmetic circuit 15 is successively stored in a video memory (b) 16 for each picture element, displayed as the interpolation data in the horizontal direction in the next vertical scanning.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、デジタル記録された自
然静止画等の映像を、NTSC方式等の飛び越し走査方
式に対応したモニターに出力する画像処理装置に関す
る。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an image processing apparatus for outputting a digitally recorded image such as a natural still image to a monitor compatible with an interlaced scanning system such as the NTSC system.

【0002】[0002]

【従来の技術】従来の、この種の画像処理装置について
図面を参照して説明する。図5は、本装置において、映
像情報をNTSC方式等の飛び越し走査方式に対応する
モニターに表示出力する時の走査方法を示す。同図にお
いて、使用されるモニターの表示サイズはNTSC信号
について考えると、通常、TVモニター上での表示解像
度は水平方向は600本から700本、垂直方向は52
5本である。図5に示すように、本装置は1フィールド
の走査期間中に実線部分を走査し、2回目のフィールド
で点線部分を走査して、2フィールドで1フレーム、つ
まり1画面を構成する。また、自然静止画等の映像をイ
メージスキャナ等によりデジタル信号に変換して記録す
る場合、該自然画データを夫々光の三原色である赤、
緑、青の各色に光学的に分解して記録すると、1画素に
つき約6ビットから8ビット、つまりトータルで18ビ
ット/画素から24ビット/画素の分解能が必要とな
る。
2. Description of the Related Art A conventional image processing apparatus of this type will be described with reference to the drawings. FIG. 5 shows a scanning method when the image information is displayed and output to the monitor corresponding to the interlaced scanning method such as the NTSC method in this apparatus. In the figure, when considering the display size of the monitor used for the NTSC signal, the display resolution on the TV monitor is usually 600 to 700 in the horizontal direction and 52 in the vertical direction.
It is five. As shown in FIG. 5, the present apparatus scans the solid line portion during the scanning period of one field, scans the dotted line portion in the second field, and configures one frame, that is, one screen in two fields. Further, when a video such as a natural still image is converted into a digital signal by an image scanner or the like and recorded, the natural image data is red, which is the three primary colors of light,
When optically separated into green and blue colors and recorded, a resolution of about 6 to 8 bits per pixel, that is, a total of 18 to 24 bits / pixel is required.

【0003】上述した画像処理装置において、使用する
モニターの解像度を水平方向640ドット、垂直方向4
80ラインと定義し、例えば、上述した自然画データを
取込んでデジタル記録する場合、18ビット/画素の分
解能を持つ画像処理装置では自然画1枚につき655キ
ロバイト、また、24ビット/画素の分解能の画像処理
装置では900キロバイトという大量の記憶メモリ容量
が必要となる。
In the above image processing apparatus, the resolution of the monitor used is 640 dots in the horizontal direction and 4 in the vertical direction.
For example, when 80 lines are defined and the above-mentioned natural image data is captured and digitally recorded, an image processing device having a resolution of 18 bits / pixel has a resolution of 655 kilobytes per one natural image and a resolution of 24 bits / pixel. This image processing device requires a large storage memory capacity of 900 kilobytes.

【0004】[0004]

【発明が解決しようとする課題】ところで、自然静止画
データを記憶する画像処理装置においては、データを何
画面分持つことができるかは該装置の記憶メモリ容量に
大きく依存する。そのため、小容量の記憶メモリしか持
たない画像処理装置においては、自然画データの記憶枚
数に限りがあり、また、数多くの自然画データを取込ん
でデジタル記録する場合には大容量の記憶メモリが必要
となり、装置が高価となる。本発明は、上述した問題点
を解決するもので、記録された映像情報を飛び越し走査
方式によりモニターに表示出力する際に、1回目の垂直
走査期間中に1画面の表示に必要な奇数、或いは偶数ラ
インのみのデータを記憶し、2回目の垂直走査では、記
憶した前記データに基づき、垂直方向に隣合うラインの
データを順次比較演算してライン間のデータを補間生成
することにより、1画面の表示を構成するようにして、
必要であったメモリ容量に対して半分のメモリ容量で済
み、かつ、画質の大幅な劣下を生ずることなく表示出力
することを可能とした画像処理装置を提供することを目
的とする。
By the way, in an image processing apparatus for storing natural still image data, how many screens the data can have depends largely on the storage memory capacity of the apparatus. Therefore, in an image processing apparatus having only a small-capacity storage memory, the number of stored natural image data is limited, and when a large amount of natural image data is captured and digitally recorded, a large-capacity storage memory is required. This is necessary and the device becomes expensive. The present invention solves the above-mentioned problems, and when the recorded video information is displayed and output on a monitor by the interlaced scanning method, an odd number required for displaying one screen during the first vertical scanning period, or Data of only even lines is stored, and in the second vertical scanning, data of adjacent lines in the vertical direction are sequentially compared and calculated based on the stored data to interpolate and generate data between lines, thereby forming one screen. To configure the display of
It is an object of the present invention to provide an image processing device which can occupy only half the required memory capacity and can perform display output without causing a significant deterioration in image quality.

【0005】[0005]

【課題を解決するための手段】上記目的を達成するため
に本発明は、1回目の垂直走査期間中に水平方向の奇数
ラインのみを走査し、次の垂直走査期間では偶数ライン
のみを走査することを繰り返し、交互に飛び越し走査を
行うことにより2回の垂直走査で1画面を構成するモニ
ターに映像情報を表示出力する画像処理装置において、
1画面の表示に必要な奇数ラインまたは偶数ラインのみ
のデータを記憶する記憶手段と、垂直方向に隣合うライ
ンのデータを順次比較演算し、ライン間のデータを補間
生成する制御手段とからなり、2回の垂直走査で上記記
憶手段に記憶されたデータと上記制御手段により生成さ
れた補間データとを交互に表示出力するようにしたもの
である。
In order to achieve the above object, the present invention scans only odd lines in the horizontal direction during the first vertical scanning period and only even lines during the next vertical scanning period. In an image processing device that displays and outputs video information on a monitor that forms one screen by performing two vertical scans by alternately repeating the above steps,
It comprises a storage means for storing data of only odd lines or even lines necessary for displaying one screen, and a control means for sequentially comparing and calculating data of vertically adjacent lines to interpolate and generate data between lines. The data stored in the storage means and the interpolation data generated by the control means are alternately displayed and output by two vertical scans.

【0006】[0006]

【作用】上記の構成によれば、1画面の表示に必要な映
像データの奇数ラインあるいは偶数ラインのみの情報を
記憶手段より読み出し、制御手段により、この情報に基
づいて飛び越し走査線の垂直方向に隣り合うデータ、つ
まりNライン目のデータと(N+2)ライン目のデータ
を逐次比較演算し、その結果を(N+1)ライン目のデ
ータとして、すなわち、Nライン目と(N+2)目の間
のデータとして次の垂直走査期間にモニターに出力し画
像を表示出力する。
According to the above construction, the information of only the odd line or the even line of the video data necessary for displaying one screen is read from the storage means, and the control means operates in the vertical direction of the interlaced scanning line based on this information. The adjacent data, that is, the data of the Nth line and the data of the (N + 2) th line are sequentially compared and calculated, and the result is used as the data of the (N + 1) th line, that is, the data between the Nth line and the (N + 2) th line. In the next vertical scanning period, the image is output to the monitor and the image is displayed and output.

【0007】[0007]

【実施例】以下、本発明の一実施例による画像処理装置
について図面を参照して説明する。図1は本装置の機能
ブロック構成を示し、図2の(a),(b),(c)は
本装置にデジタル記録される映像赤成分、映像緑成分、
映像青成分の夫々のメモリ構成を示す。これらの図にお
いて、装置本体1は、自然静止画等の映像をデジタル記
憶した外部記憶装置2と、これらの映像データを表示出
力するためのモニター3を有している。この外部記憶装
置2は自然画データを夫々赤、緑、青という光の三原色
に分けて1色に8ビットの分解能を持たせ、トータルで
24ビット(1677万色)の分解能でデジタル記録し
ている。この色データは、図2の(a),(b),
(c)に示すように各色毎に分割され、後述するビデオ
メモリに格納され、8ビット毎に1画素が定義されてい
る。また、モニター3はNTSC方式等の飛び越し走査
方式に対応したものが用いられる。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS An image processing apparatus according to an embodiment of the present invention will be described below with reference to the drawings. FIG. 1 shows a functional block configuration of this apparatus, and (a), (b), and (c) of FIG. 2 show image red component, image green component digitally recorded in this apparatus,
The memory structure of each image blue component is shown. In these figures, the apparatus main body 1 has an external storage device 2 in which images such as natural still images are digitally stored, and a monitor 3 for displaying and outputting these image data. The external storage device 2 divides the natural image data into three primary colors of light of red, green, and blue, and gives each color an 8-bit resolution, and digitally records it with a total resolution of 24 bits (16.77 million colors). There is. This color data is (a), (b),
As shown in (c), each color is divided and stored in a video memory described later, and one pixel is defined for every 8 bits. The monitor 3 is compatible with the interlaced scanning system such as the NTSC system.

【0008】また、装置本体1は、外部記憶装置2に記
憶された赤、緑、青色の各成分データを処理するための
赤成分機能ブロック4、緑成分機能ブロック5、及び青
成分機能ブロック6を有している。さらに、これら各ブ
ロックにより得られるデジタルRGB信号をアナログR
GB信号に変換するためのデジタル/アナログコンバー
タ7と、このアナログRGB信号をNTSC信号(また
はPAL信号)等のいわゆるビデオ信号に変換するRG
Bエンコーダ8と、各機能ブロックに対し同期信号を出
力する同期信号発生回路9を有している。
Further, the apparatus main body 1 has a red component function block 4, a green component function block 5 and a blue component function block 6 for processing the respective red, green and blue component data stored in the external storage device 2. have. Further, the digital RGB signals obtained by these blocks are converted into analog R
A digital / analog converter 7 for converting into a GB signal, and an RG for converting this analog RGB signal into a so-called video signal such as an NTSC signal (or PAL signal).
It has a B encoder 8 and a sync signal generation circuit 9 that outputs a sync signal to each functional block.

【0009】また、各機能ブロックには夫々各色データ
を格納するためのビデオメモリ(a)10と、奇数ライ
ンと偶数ラインの各色データを交互に出力するセレクタ
11と、ビデオメモリ(a)10のmライン目及び(m
+2)ライン目の1水平走査分の色データを夫々格納す
るラインメモリ(a)12及びラインメモリ(b)13
を有している。さらに、各機能ブロックにはラインメモ
リ(a)12及びラインメモリ(b)13に対する書き
込み制御を行う書き込み切替えスイッチ14と、ライン
メモリ(a)12及びラインメモリ(b)13のデータ
より、後述する(m+1)ライン目の補間データを演算
するための演算回路15と、この演算回路15により得
られるデータを格納するビデオメモリ(b)16を有し
ている。図2はビデオメモリ(a)12及びビデオメモ
リ(b)16のメモリ構成を示す。図3は画素データの
モニター3上での表示位置を示している。
Each functional block includes a video memory (a) 10 for storing color data, a selector 11 for alternately outputting color data of odd lines and even lines, and a video memory (a) 10. m line and (m
+2) A line memory (a) 12 and a line memory (b) 13 that store color data for one horizontal scan of the line
have. Further, in each functional block, a write selection switch 14 for performing write control on the line memory (a) 12 and the line memory (b) 13 and data of the line memory (a) 12 and the line memory (b) 13 will be described later. It has a calculation circuit 15 for calculating the interpolation data of the (m + 1) th line, and a video memory (b) 16 for storing the data obtained by this calculation circuit 15. FIG. 2 shows the memory configurations of the video memory (a) 12 and the video memory (b) 16. FIG. 3 shows the display position of the pixel data on the monitor 3.

【0010】次に、上記構成の画像処理装置による画像
出力の動作について説明する。図5に示したように、イ
ンターレーススキャン方式では2回の垂直走査(実線と
点線)すなわち、2フィールドで1画面を構成すること
から、夫々のフィールドについて説明する。まず、実線
で示す走査に対応する最初のフィールドでは、外部記憶
メモリ1より、デジタル記録された1枚の自然静止画デ
ータの赤成分が読み出され、ビデオメモリ(a)10に
転送し格納される。格納されたデータは同期信号発生回
路9によって出力される映像の垂直同期信号16aを開
始点として、水平同期信号16bに同期して読み出さ
れ、セレクタ11を介して映像の赤成分信号15aが出
力される。
Next, the operation of image output by the image processing apparatus having the above configuration will be described. As shown in FIG. 5, in the interlaced scan method, two vertical scans (solid line and dotted line), that is, two fields make up one screen, and therefore each field will be described. First, in the first field corresponding to the scanning indicated by the solid line, the red component of one digitally recorded natural still image data is read from the external storage memory 1, transferred to the video memory (a) 10 and stored therein. It The stored data is read in synchronization with the horizontal synchronizing signal 16b starting from the vertical synchronizing signal 16a of the image output by the synchronizing signal generating circuit 9, and the red component signal 15a of the image is output via the selector 11. To be done.

【0011】機能ブロック5及び6に於いても外部記憶
メモリ2より映像の緑成分及び青成分が夫々のブロック
のビデオメモリ(a)10に転送され、赤成分と同様の
処理が行われる。その結果、映像の緑成分信号15bが
機能ブロック5より、また映像の青成分15cが機能ブ
ロック6より夫々赤成分信号15aに同期して出力され
る。その後、各映像信号15a,15b,15cはデジ
タル/アナログコンバータ7によってアナログRGB信
号に変換され、複合同期信号16cとともにRGBエン
コーダ8に入力されるとNTSC信号(またはPAL信
号)等のいわゆるビデオ信号に変換されモニター3に出
力され、視覚映像を得ることができる。
Also in the functional blocks 5 and 6, the green component and the blue component of the image are transferred from the external storage memory 2 to the video memory (a) 10 of each block, and the same processing as the red component is performed. As a result, the green component signal 15b of the image is output from the function block 5, and the blue component 15c of the image is output from the function block 6 in synchronization with the red component signal 15a. After that, each of the video signals 15a, 15b, 15c is converted into an analog RGB signal by the digital / analog converter 7, and when input to the RGB encoder 8 together with the composite sync signal 16c, it becomes a so-called video signal such as an NTSC signal (or PAL signal). It is converted and output to the monitor 3, and a visual image can be obtained.

【0012】次に、点線で示す走査に対応する次フィー
ルドの動作を図1、図3、図4を参照して説明する。ビ
デオメモリ(a)10に格納された自然画データはセレ
クタ11に出力されるのと同時にラインメモリ(a)1
2及びラインメモリ(b)13にも1水平走査分のデー
タが転送される。これら2つのラインメモリに対する書
き込み制御は書き込み切り替えスイッチ14によって行
われ、フィールドの最初の一水平ライン分のデータはラ
インメモリ(a)12に書き込み、次の一水平ライン分
のデータはラインメモリ(b)13に書き込み、これを
フィールドの最後まで繰り返す。そして、2つのライン
メモリにデータが書き込まれると、ラインメモリ(a)
12とラインメモリ(b)13のデータを同一のタイミ
ングで1画素単位に読み出して演算回路15に入力す
る。
Next, the operation of the next field corresponding to the scanning indicated by the dotted line will be described with reference to FIGS. 1, 3 and 4. The natural image data stored in the video memory (a) 10 is output to the selector 11 and at the same time as the line memory (a) 1
The data for one horizontal scan is also transferred to the 2 and the line memory (b) 13. Write control for these two line memories is performed by a write change-over switch 14, data of the first one horizontal line of the field is written to the line memory (a) 12, and data of the next one horizontal line is written to the line memory (b). ) 13 and repeat until the end of the field. When data is written in the two line memories, the line memories (a)
12 and the data of the line memory (b) 13 are read in pixel units at the same timing and input to the arithmetic circuit 15.

【0013】演算回路15では図4に示した演算ルール
に従って演算処理を行い、結果を出力する。図3、図4
において、画素データは、各色8ビットの分解能を割り
付けてあることから、デジタルデータは0から255の
値をとり、大きくなるに従って色濃度が濃くなるものと
する。例えば、ラインメモリ(a)12からの入力デー
タ、つまりmライン目のある画素pが“3”で、ライン
メモリ(b)13からの入力データ、つまり(m+2)
ライン目の画素rが“3”と同一であった場合は、m、
(m+1)、(m+2)の3ラインにわたって同一デー
タであるとみなし、演算結果を“3”とし、これを画素
qのデータとする。また、mライン目のデータが“15
2”で(m+2)ライン目のデータが“86”であった
場合、両者を比較してm>(m+2)であるので、垂直
方向に色が薄くなるものとみなし、両データの差分を2
で割った値をmライン目のデータから減じ、演算結果を
“119”とする。逆にm<(m+2)である場合に
は、両データの差分を2で割った値をmライン目のデー
タに加え、これを演算結果とする。
The arithmetic circuit 15 performs arithmetic processing according to the arithmetic rules shown in FIG. 4 and outputs the result. 3 and 4
In the above, since the pixel data is assigned a resolution of 8 bits for each color, the digital data takes a value from 0 to 255, and the color density increases as it increases. For example, the input data from the line memory (a) 12, that is, the pixel p having the m-th line is “3”, and the input data from the line memory (b) 13, that is, (m + 2)
If the pixel r of the line is the same as “3”, m,
It is considered that the same data is applied to three lines (m + 1) and (m + 2), the operation result is set to "3", and this is set as the data of the pixel q. In addition, the data of the m-th line is “15
If the data of the (m + 2) th line is “86” in 2 ”, the two are compared and m> (m + 2). Therefore, it is considered that the color becomes light in the vertical direction, and the difference between the two data is 2
The value obtained by dividing by is subtracted from the data on the m-th line, and the calculation result is set to "119". On the other hand, when m <(m + 2), the value obtained by dividing the difference between both data by 2 is added to the data on the m-th line, and this is used as the calculation result.

【0014】このように、演算回路15により、1画素
単位に演算し、得られたデータは(m+1)ライン目の
データとしてビデオメモリ(b)16に格納される。上
記動作を一回目の最初のフィールドの走査の間に繰り返
すことにより、1フィールド分の映像データが演算によ
り生成され、ビデオメモリ(b)16に格納される。2
回目の次フィールドの走査時にはビデオメモリ(b)1
6の出力がセレクタ11から出力され、前フィールドと
同様の経路でビデオ信号に変換されてモニター3に出力
され、視覚的な映像を得ることができる。以上説明した
次フィールドでの動作は、機能ブロック5及び6でも同
等な動作が行われる。こうして2つのフィールド動作を
繰り返すことにより、外部記憶装置2に記憶された1枚
の自然静止画をモニター3上に表示することができる。
As described above, the arithmetic circuit 15 performs arithmetic operation on a pixel-by-pixel basis, and the obtained data is stored in the video memory (b) 16 as the data of the (m + 1) th line. By repeating the above operation during the first scanning of the first field, video data for one field is generated by calculation and stored in the video memory (b) 16. Two
Video memory (b) 1 at the time of the next scanning of the next field
The output of 6 is output from the selector 11, converted into a video signal in the same path as in the previous field and output to the monitor 3, and a visual image can be obtained. The same operation is performed in the functional blocks 5 and 6 as the operation in the next field described above. By repeating the two field operations in this manner, one natural still image stored in the external storage device 2 can be displayed on the monitor 3.

【0015】[0015]

【発明の効果】以上のように本発明によれば、記録され
た映像情報を飛び越し走査方式によりモニターに表示出
力する際に、1回目の垂直走査期間中に1画面の表示に
必要な奇数、或いは偶数ラインのみのデータを記憶し、
2回目の垂直走査では、この記憶したデータに基づき、
垂直方向に隣合うラインのデータを順次比較演算して得
られるデータを用いて画像処理を行うので、従来、デジ
タル記録された1枚の自然静止画等をビデオ信号に変換
して表示する際に必要な記憶容量の半分の容量でデータ
を記憶しておくことができ、記憶手段の低コスト化が図
れる。また、外部記憶装置内における映像データの占有
領域を半減させることができ、多くの画像データを持つ
ことができる。
As described above, according to the present invention, when the recorded video information is displayed and output to the monitor by the interlaced scanning method, an odd number necessary for displaying one screen during the first vertical scanning period, Or store the data of only even lines,
In the second vertical scan, based on this stored data,
Since image processing is performed using data obtained by sequentially comparing and calculating data of lines that are adjacent to each other in the vertical direction, conventionally, when one digitally recorded natural still image or the like is converted into a video signal and displayed, Data can be stored with a capacity half the required storage capacity, and the cost of the storage means can be reduced. Further, the area occupied by the video data in the external storage device can be halved, and a large amount of image data can be stored.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の一実施例による画像処理装置の機能ブ
ロック構成図である。
FIG. 1 is a functional block configuration diagram of an image processing apparatus according to an embodiment of the present invention.

【図2】ビデオメモリ(a)及びビデオメモリ(b)の
データフォーマットを示す図である。
FIG. 2 is a diagram showing a data format of a video memory (a) and a video memory (b).

【図3】モニター画面上での各画素の位置関係を示す図
である。
FIG. 3 is a diagram showing a positional relationship of each pixel on a monitor screen.

【図4】演算回路での演算ルールの一例を示す図であ
る。
FIG. 4 is a diagram showing an example of a calculation rule in a calculation circuit.

【図5】モニター画面と飛び越し走査線との対応を示す
図である。
FIG. 5 is a diagram showing a correspondence between a monitor screen and interlaced scanning lines.

【符号の説明】[Explanation of symbols]

1 画像処理装置本体 2 外部記憶装置 3 モニター 10,16 ビデオメモリ 12,13 ラインメモリ 15 演算回路 1 Image Processing Device Main Body 2 External Storage Device 3 Monitor 10, 16 Video Memory 12, 13 Line Memory 15 Arithmetic Circuit

───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.5 識別記号 庁内整理番号 FI 技術表示箇所 H04N 5/92 Z 8324−5C ─────────────────────────────────────────────────── ───Continued from the front page (51) Int.Cl. 5 Identification code Office reference number FI technical display location H04N 5/92 Z 8324-5C

Claims (1)

【特許請求の範囲】 【請求項1】 1回目の垂直走査期間中に水平方向の奇
数ラインのみを走査し、次の垂直走査期間では偶数ライ
ンのみを走査することを繰り返し、交互に飛び越し走査
を行うことにより2回の垂直走査で1画面を構成するモ
ニターに映像情報を表示出力する画像処理装置におい
て、1画面の表示に必要な奇数ラインまたは偶数ライン
のみのデータを記憶する記憶手段と、垂直方向に隣合う
ラインのデータを順次比較演算し、ライン間のデータを
補間生成する制御手段とからなり、2回の垂直走査で上
記記憶手段に記憶されたデータと上記制御手段により生
成された補間データとを交互に表示出力するようにした
ことを特徴とする画像処理装置。
Claim: What is claimed is: 1. In the first vertical scanning period, only odd-numbered lines in the horizontal direction are scanned, and in the next vertical scanning period, only even-numbered lines are repeatedly scanned, and interlaced scanning is alternately performed. In the image processing apparatus for displaying and outputting the video information on the monitor forming one screen by performing the vertical scanning twice, the storage unit for storing the data of only the odd line or the even line necessary for displaying the one screen and the vertical Control means for sequentially comparing and calculating data of lines adjacent to each other and interpolating and generating data between the lines. The data stored in the storage means and the interpolation generated by the control means in two vertical scans. An image processing device characterized in that data and data are alternately displayed and output.
JP3198625A 1991-07-12 1991-07-12 Picture processor Pending JPH0522680A (en)

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JP3198625A JPH0522680A (en) 1991-07-12 1991-07-12 Picture processor

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JP3198625A JPH0522680A (en) 1991-07-12 1991-07-12 Picture processor

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JP3198625A Pending JPH0522680A (en) 1991-07-12 1991-07-12 Picture processor

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JP (1) JPH0522680A (en)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100224682B1 (en) * 1997-01-10 1999-10-15 윤종용 Line memory sharing method
US6819328B1 (en) 1999-11-05 2004-11-16 Renesas Technology Corp. Graphic accelerator with interpolate function

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