JPH05219755A - Malfunction detector for inverter main circuit - Google Patents

Malfunction detector for inverter main circuit

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JPH05219755A
JPH05219755A JP4056855A JP5685592A JPH05219755A JP H05219755 A JPH05219755 A JP H05219755A JP 4056855 A JP4056855 A JP 4056855A JP 5685592 A JP5685592 A JP 5685592A JP H05219755 A JPH05219755 A JP H05219755A
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inverter
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Abstract

PURPOSE:To prevent damage on an inverter element by detecting a malfunction of the element to be switched at a high speed by comparing whether a potential difference between the elements such as power semiconductor elements, etc., to be switched in phase in parallel with its rated value or more or not. CONSTITUTION:Voltages of potential points A1, A2, B1 and B2 of pairs of inverter elements to be switched in phase and connected in parallel are voltage-divided by resistors R1 and R2, R3 and R4, R5 and R6, and R7 and R8, These divided voltages and a reference voltage V1 are input to comparators C1, C2, C3 and C4. If a potential difference of its rated value or more is detected, it is compared with a reference potential V2 by a comparator C5 or C6, and then a malfunction signal is output from a photodiode 15. An AND clamper 13 inputs the same pulse signal as that for driving the elements is input to comparators C7, C8. The divided voltages are clamped to a low potential during OFF time of the pulse signal, and an erroneous defection due to a quasi-potential is prevented.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】本発明は、インバータ主回路の異
常検出回路に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an abnormality detecting circuit for an inverter main circuit.

【0002】[0002]

【従来の技術】一般に、インバータに使用される(電力
用半導体素子等の)インバータ素子は過電流や過電圧の
耐量が小さいため、インバータ素子の動作不良や破損を
防止するのに、従来、ヒューズ等による異常検出保護が
行われていた。
2. Description of the Related Art Generally, an inverter element (such as a power semiconductor element) used in an inverter has a small tolerance against an overcurrent and an overvoltage. Therefore, a fuse or the like has been conventionally used to prevent malfunction or damage of the inverter element. Anomaly detection was protected by.

【0003】[0003]

【発明が解決しようとする課題】しかし、高速でスイッ
チングするインバータ素子では、異常を検出して保護す
るスピード(例えば、ヒューズの溶断スピード)がスイ
ッチング速度よりも遅いため、上記異常検出保護では対
応できず、インバータ素子の破損を防ぐことが困難であ
った。
However, in the case of an inverter element that switches at high speed, the speed at which an abnormality is detected and protected (for example, the fuse blowing speed) is slower than the switching speed. Therefore, it is difficult to prevent damage to the inverter element.

【0004】特に、並列接続した多数のインバータ素子
を同相でスイッチングさせるインバータの運転におい
て、そのインバータ素子が一つでも故障すれば、系全体
がアンバランスとなって他のインバータ素子の作動に悪
影響を及ぼす問題があった。
Particularly, in the operation of an inverter in which a large number of inverter elements connected in parallel are switched in the same phase, if any one of the inverter elements fails, the entire system becomes unbalanced and the operation of other inverter elements is adversely affected. There was a problem to exert.

【0005】そこで、本発明は、従来のこのような問題
点を解決するインバータ主回路の異常検出回路を提供す
ることを目的とする。
SUMMARY OF THE INVENTION Therefore, an object of the present invention is to provide an abnormality detecting circuit for an inverter main circuit which solves the above-mentioned conventional problems.

【0006】[0006]

【課題を解決するための手段】上記目的を達成するため
に、インバータ主回路の異常検出回路は、並列接続され
同相にてスイッチングされるインバータ素子からなるイ
ンバータ主回路の該インバータ素子間の電位差により、
異常を検出する比較器を備えたものである。
In order to achieve the above-mentioned object, an abnormality detection circuit of an inverter main circuit is provided with a potential difference between the inverter elements of an inverter main circuit composed of inverter elements connected in parallel and switched in the same phase. ,
It is provided with a comparator for detecting an abnormality.

【0007】また、電圧形インバータのインバータ素子
の転流の際に生ずる疑似電位によって比較器が誤作動す
るのを防止するアンドクランプ回路を付加したものであ
る。
Further, an AND-and-clamp circuit is added to prevent the comparator from malfunctioning due to a pseudo potential generated when commutation of the inverter element of the voltage source inverter.

【0008】[0008]

【作用】並列同相にてスイッチングされるインバータ素
子間の電位差が、規定値以上か否かを比較器にて比較す
ることにより、インバータ主回路の異常が検出される。
電気信号にて異常検出がされるので、高速でスイッチン
グするインバータ素子でも、確実に異常を検出してイン
バータ素子の破損を防ぐことができる。
The comparator main circuit detects an abnormality in the inverter main circuit by comparing whether or not the potential difference between the inverter elements switched in parallel and in phase is equal to or greater than a specified value.
Since the abnormality is detected by the electric signal, it is possible to reliably detect the abnormality and prevent the inverter element from being damaged even with the inverter element switching at high speed.

【0009】アンドクランプ回路によって、インバータ
素子を駆動するパルス信号のオンタイム間のみ比較器は
作動可能となり、オフタイム間に疑似電位の電位差を比
較器が誤検出するのを防止できる。
The AND clamp circuit enables the comparator to operate only during the on-time of the pulse signal for driving the inverter element, and prevents the comparator from erroneously detecting the potential difference of the pseudo potential during the off-time.

【0010】[0010]

【実施例】以下、図示の実施例に基づき本発明を詳説す
る。
The present invention will be described in detail below with reference to the illustrated embodiments.

【0011】図1において、1は、コンバータ回路2,
平滑回路3及びインバータ回路4からなるインバータで
あって、インバータ回路4で発生する誤動作等の異常を
異常検出回路5で検出して異常信号を出力し、インバー
タ1を停止するように構成される。
In FIG. 1, 1 is a converter circuit 2,
An inverter including a smoothing circuit 3 and an inverter circuit 4 configured to detect an abnormality such as a malfunction occurring in the inverter circuit 4 by an abnormality detection circuit 5 and output an abnormality signal to stop the inverter 1.

【0012】図2は、電圧形のインバータ1の回路図の
一例を示しており、コンバータ回路2の端子2a…に、
図外の三相交流電源より供給された交流電力は、三相ブ
リッジ結線した整流ダイオード6…で直流電源に変換さ
れ、平滑回路3のコンデンサ7により平滑される。
FIG. 2 shows an example of a circuit diagram of the voltage-type inverter 1. The converter circuit 2 has terminals 2a ...
AC power supplied from a three-phase AC power supply (not shown) is converted into a DC power supply by the rectifying diodes 6 ... Connected to the three-phase bridge and smoothed by the capacitor 7 of the smoothing circuit 3.

【0013】さらに、平滑された直流電源は、フルブリ
ッジ2並列のインバータ回路4で交流電源に変換され、
並列バランス用コンデンサ8…と負荷コイル9の直列共
振回路を流れる。
Further, the smoothed DC power supply is converted into an AC power supply by the inverter circuit 4 in parallel with the full bridge 2,
It flows through the series resonance circuit of the parallel balancing capacitors 8 ... And the load coil 9.

【0014】インバータ回路4は、バイポーラトランジ
スタ等のインバータ素子Q1 ,Q2,Q3 ,Q4
5 ,Q6 ,Q7 ,Q8 からなるインバータ主回路10を
備えている。11…はインバータ素子と逆並列接続された
フリーホイールダイオードである。
The inverter circuit 4 includes inverter elements Q 1 , Q 2 , Q 3 , Q 4 , such as bipolar transistors.
An inverter main circuit 10 including Q 5 , Q 6 , Q 7 , and Q 8 is provided. 11 ... is a freewheel diode connected in anti-parallel with the inverter element.

【0015】インバータ素子Q1 ,Q2 ,Q3 ,Q4
インバータ素子Q5 ,Q6 ,Q7 ,Q8 とは、180 °の
位相差をもつパルス信号により、交互にスイッチングさ
れ、平滑回路3により平滑された直流電源が、2相の交
流電源に変換される。
The inverter elements Q 1 , Q 2 , Q 3 , Q 4 and the inverter elements Q 5 , Q 6 , Q 7 , Q 8 are alternately switched and smoothed by a pulse signal having a phase difference of 180 °. The DC power source smoothed by the circuit 3 is converted into a two-phase AC power source.

【0016】A1 ,A2 は、並列接続され同相にてスイ
ッチングされるインバータ素子Q1,Q2 (又はインバ
ータ素子Q7 ,Q8 )の電位点で、この電位点A1 ,A
2 から得られた電圧は、抵抗R1 ,R2 及び抵抗R3
4 にて分圧される。
[0016] A 1, A 2 is a potential point of the inverter element Q 1, Q 2 that is switched by being connected in parallel in phase (or inverter element Q 7, Q 8), the potential point A 1, A
The voltage obtained from 2 is the resistance R 1 , R 2 and the resistance R 3 ,
It is divided by R 4 .

【0017】B1 ,B2 も、並列同相にてスイッチング
されるインバータ素子Q3 ,Q4 (又はインバータ素子
5 ,Q6 )の電位点で、電位点B1 ,B2 から得られ
た電圧は、抵抗R5 ,R6 及び抵抗R7 ,R8 にて分圧
される。
B 1 and B 2 are also potential points of the inverter elements Q 3 and Q 4 (or inverter elements Q 5 and Q 6 ) that are switched in parallel and in phase, and are obtained from the potential points B 1 and B 2 . The voltage is divided by resistors R 5 , R 6 and resistors R 7 , R 8 .

【0018】図3は異常検出回路5を示しており、この
異常検出回路5は、抵抗R1 ,R2間、抵抗R3 ,R4
間、抵抗R5 ,R6 間及び抵抗R7 ,R8 間に接続され
る比較回路12とアンドクランプ回路13を備えている。
FIG. 3 shows an abnormality detecting circuit 5. This abnormality detecting circuit 5 includes resistors R 1 and R 2 and resistors R 3 and R 4.
The comparator circuit 12 and the AND clamp circuit 13 are connected between the resistors R 5 and R 6 and between the resistors R 7 and R 8 .

【0019】比較回路12は、抵抗、ダイオード、コンデ
ンサ、比較器C1 ,C2 ,C3 ,C4 ,C5 ,C6 、可
変抵抗14及びホトダイオード15から構成される。
The comparison circuit 12 comprises resistors, diodes, capacitors, comparators C 1 , C 2 , C 3 , C 4 , C 5 , C 6 , a variable resistor 14 and a photodiode 15.

【0020】また、アンドクランプ回路13は、抵抗、ダ
イオード、コンデンサ、ホトダイオード、ホトトランジ
スタ及び比較器C7 ,C8 から構成される。さらに、各
々の端子K…には図外の電圧源が夫々接続される。
The AND-clamp circuit 13 is composed of a resistor, a diode, a capacitor, a photodiode, a phototransistor and comparators C 7 and C 8 . Further, a voltage source (not shown) is connected to each terminal K ...

【0021】そして、図2と図3に示すように、インバ
ータ素子Q1 ,Q2 又はインバータ素子Q7 ,Q8 の内
の何れかの素子の動作に不具合が発生した場合、インバ
ータ素子Q1 ,Q2 間又はインバータ素子Q7 ,Q8
に(即ち電位点A1 ,A2 に)インバータ素子Q1 ,Q
2 ,Q7 ,Q8 の特性のバラツキ以上の電位差が生じる
のを利用して、異常検出回路5はインバータ主回路10の
異常を検出している。
Then, as shown in FIGS. 2 and 3, when a malfunction occurs in any one of the inverter elements Q 1 and Q 2 or the inverter elements Q 7 and Q 8 , the inverter element Q 1 , Q 2 or between the inverter elements Q 7 , Q 8 (that is, at the potential points A 1 , A 2 ), the inverter elements Q 1 , Q
The abnormality detection circuit 5 detects an abnormality in the inverter main circuit 10 by utilizing the fact that a potential difference larger than the variation in the characteristics of 2 , Q 7 , and Q 8 occurs.

【0022】即ち、上述の如く、抵抗R1 ,R2 及び抵
抗R3 ,R4 にて分圧された(電位点A1 ,A2 の)電
圧と、可変抵抗14を介して得られた基準電圧V1 とが比
較器C1 ,C2 に入力され、この比較器C1 ,C2
て、夫々の分圧された電圧に対して(上記インバータ素
子Q1 ,Q2 ,Q7 ,Q8 の特性のバラツキを含めた)
規定値以上の電位差が検出された場合は、比較器C5
よって基準電圧V2 と比較された後、ホトダイオード15
から異常信号が出力され、インバータ主回路10の異常が
検出される。
That is, as described above, the voltage (at the potential points A 1 and A 2 ) divided by the resistors R 1 and R 2 and the resistors R 3 and R 4 is obtained via the variable resistor 14. the reference voltages V 1 is input to the comparator C 1, C 2, at the comparator C 1, C 2, (the inverter device for each of the divided voltage Q 1, Q 2, Q 7 , including variations in the characteristics of Q 8)
When a potential difference of a specified value or more is detected, it is compared with the reference voltage V 2 by the comparator C 5 , and then the photodiode 15
An abnormality signal is output from the inverter, and the abnormality of the inverter main circuit 10 is detected.

【0023】そして、ホトダイオード15からの異常信号
を、図外の回路にてラッチさせ、その異常出力信号にて
インバータ1(図1参照)を即座に停止させる。なお、
ノイズ除去用のホトダイオード15を使用せずに比較器C
5 と上記保持回路を直接接続させてもよい。
An abnormal signal from the photodiode 15 is latched by a circuit (not shown), and the abnormal output signal immediately stops the inverter 1 (see FIG. 1). In addition,
Comparator C without using the photodiode 15 for noise removal
5 and the holding circuit may be directly connected.

【0024】基準電圧V1 はインバータ素子Q1 ,Q2
…の特性のバラツキに対応して可変抵抗14にて調整でき
るので、この特性のバラツキによって比較器C1 ,C2
が誤動作するのを防止できる。
The reference voltage V 1 is the inverter elements Q 1 and Q 2.
Since the variable resistor 14 can be adjusted in accordance with the variation in the characteristics of ..., Due to the variation in the characteristics, the comparators C 1 , C 2
Can be prevented from malfunctioning.

【0025】また、抵抗R5 ,R6 及び抵抗R7 ,R8
にて分圧された(電位点B1 ,B2の)電圧も、上述と
同様にして、比較器C3 ,C4 にてコンパレートされ、
インバータ主回路10のインバータ素子Q3 ,Q4
5 ,Q6 の異常検出ができる。
Further, the resistors R 5 , R 6 and the resistors R 7 , R 8
The voltage divided at (potential points B 1 and B 2 ) is also compared by the comparators C 3 and C 4 in the same manner as described above.
Inverter elements Q 3 , Q 4 of the inverter main circuit 10,
Q 5, it is the abnormality detection of Q 6.

【0026】アンドクランプ回路13は、電圧形インバー
タの場合において、インバータ素子Q1 ,Q2 …を駆動
するパルス信号のオフタイムに、インバータ素子Q1
2…の転流等によって(即ちフリーホイールダイオー
ド11に流れる電流によって)電位点A1 ,A2 ,B1
2 に発生する疑似電位の電位差を、比較器C1
2 ,C3 ,C4 が誤検出するのを防止する。
[0026] AND clamp circuit 13, in the case of the voltage source inverter, the off-time of the inverter element Q 1, Q 2 ... pulse signal for driving the inverter element Q 1,
Potential points A 1 , A 2 , B 1 , due to commutation of Q 2 ... (that is, due to the current flowing through the freewheel diode 11)
The potential difference of the pseudo potential generated in B 2 is calculated by the comparator C 1 ,
Prevents C 2 , C 3 and C 4 from being erroneously detected.

【0027】具体的には、インバータ素子Q1 ,Q2
を駆動するパルス信号と同一のパルス信号が端子H,J
から比較器C7 ,C8 に入力されて、基準電圧V2 と比
較され、パルス信号のオフタイム間のみ、抵抗R1 ,R
2 ,R3 ,R4 ,R5 ,R6,R7 ,R8 にて分圧され
た電圧は低電位にクランプされ、比較器C1 ,C2 ,C
3 ,C4 が作動しないようになっている。
Specifically, the inverter elements Q 1 , Q 2 ...
Pulse signal that is the same as the pulse signal that drives the terminals H, J
Is input from the comparators C 7 and C 8 to the reference voltage V 2 and compared with the resistors R 1 and R only during the off time of the pulse signal.
2, R 3, R 4, R 5, divided voltage at R 6, R 7, R 8 is clamped to a low potential, the comparator C 1, C 2, C
3 and C 4 are not activated.

【0028】従って、パルス信号のオンタイム間のみ、
比較器C1 ,C2 ,C3 ,C4 は作動可能となり、オフ
タイム間に電位点A1 ,A2 ,B1 ,B2 の疑似電位の
電位差を、比較器C1 ,C2 ,C3 ,C4 が誤検出する
のを防止できる。
Therefore, only during the on-time of the pulse signal,
The comparators C 1 , C 2 , C 3 , C 4 become operable, and the potential difference of the pseudo potentials of the potential points A 1 , A 2 , B 1 , B 2 is calculated during the off time by the comparators C 1 , C 2 , It is possible to prevent erroneous detection of C 3 and C 4 .

【0029】なお、本発明は上述の実施例に限定され
ず、本発明の要旨を逸脱しない範囲で設計変更自由であ
る。例えば、インバータ1が電流形であっても異常検出
回路5を適用でき、又、インバータ回路4が2並列以上
のものであっても異常検出回路5を適用できるのは勿論
であり、三相ブリッジ接続のものにも適用可能である。
The present invention is not limited to the above-mentioned embodiments, and the design can be freely changed without departing from the gist of the present invention. For example, the abnormality detection circuit 5 can be applied even if the inverter 1 is a current type, and the abnormality detection circuit 5 can be applied even if the inverter circuit 4 has two or more parallel circuits. It is also applicable to connected ones.

【0030】さらに、インバータ素子Q1 ,Q2 …とし
て、バイポーラトランジスタ以外に、IGBT(絶縁ゲート
バイポーラモードトランジスタ)、MOSFET(金属酸化物
半導体電界効果トランジスタ)、SIT (静電誘導トラン
ジスタ)等あらゆる電力用半導体素子を用いたインバー
タ主回路10に、異常検出回路5は適用可能である。
Further, as the inverter elements Q 1 , Q 2, ..., In addition to bipolar transistors, IGBTs (insulated gate bipolar mode transistors), MOSFETs (metal oxide semiconductor field effect transistors), SITs (static induction transistors), and other various power sources are used. The abnormality detection circuit 5 can be applied to the inverter main circuit 10 using the semiconductor device for use.

【0031】[0031]

【発明の効果】本発明は上述の如く構成されているの
で、次に記載するような著大な効果を奏する。
Since the present invention is constructed as described above, it has the following great effects.

【0032】高速でスイッチングするインバータ素子を
使用する場合でも、早期に各インバータ素子の異常動作
及び故障を、疑似電位等に影響されることなく確実に検
出でき、インバータ主回路10を保護できる。特に、フル
ブリッジ並列インバータの運転において、異常検出保護
効果に優れ、極めて有用なものとなる。
Even when an inverter element that switches at high speed is used, the abnormal operation and failure of each inverter element can be surely detected early without being affected by the pseudo potential and the inverter main circuit 10 can be protected. In particular, in the operation of the full-bridge parallel inverter, it is extremely useful because it has an excellent effect of detecting abnormality.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の一実施例を示すブロック図である。FIG. 1 is a block diagram showing an embodiment of the present invention.

【図2】インバータの回路図である。FIG. 2 is a circuit diagram of an inverter.

【図3】異常検出回路の回路図である。FIG. 3 is a circuit diagram of an abnormality detection circuit.

【符号の説明】[Explanation of symbols]

10 インバータ主回路 13 アンドクランプ回路 C 比較器 10 Inverter main circuit 13 And clamp circuit C comparator

Claims (2)

【特許請求の範囲】[Claims] 【請求項1】 並列接続され同相にてスイッチングされ
るインバータ素子からなるインバータ主回路10の該イン
バータ素子間の電位差により、異常を検出する比較器を
備えたことを特徴とするインバータ主回路の異常検出回
路。
1. An abnormality of an inverter main circuit, comprising a comparator for detecting an abnormality based on a potential difference between the inverter elements of an inverter main circuit 10 formed of inverter elements connected in parallel and switched in the same phase. Detection circuit.
【請求項2】 電圧形インバータのインバータ素子の転
流の際に生ずる疑似電位によって比較器が作動するのを
防止するアンドクランプ回路13を付加した請求項1記載
のインバータ主回路の異常検出回路。
2. An abnormality detection circuit for an inverter main circuit according to claim 1, further comprising an AND clamp circuit 13 for preventing the comparator from operating due to a pseudo-potential generated when commutating the inverter element of the voltage source inverter.
JP4056855A 1992-02-06 1992-02-06 Inverter main circuit abnormality detection circuit Expired - Lifetime JPH07112351B2 (en)

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JPH05219755A true JPH05219755A (en) 1993-08-27
JPH07112351B2 JPH07112351B2 (en) 1995-11-29

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5251400A (en) * 1975-10-22 1977-04-25 Mitsubishi Chem Ind Ltd Preparation of 6,13-dihydroquinacridones

Patent Citations (1)

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Publication number Priority date Publication date Assignee Title
JPS5251400A (en) * 1975-10-22 1977-04-25 Mitsubishi Chem Ind Ltd Preparation of 6,13-dihydroquinacridones

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