JPH0474351U - - Google Patents

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JPH0474351U
JPH0474351U JP11631790U JP11631790U JPH0474351U JP H0474351 U JPH0474351 U JP H0474351U JP 11631790 U JP11631790 U JP 11631790U JP 11631790 U JP11631790 U JP 11631790U JP H0474351 U JPH0474351 U JP H0474351U
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【図面の簡単な説明】
第１図は本考案の第１の実施例のブロツク図、
第２図は本考案の第２の実施例のブロツク図、第
３図は従来の計算機システムにおける入出力制御
装置の一例のブロツク図である。 １……主記憶装置、２……外部記憶装置、３…
…入出力制御装置、４……補助記憶装置、５……
データ制御装置、６……アプリケーシヨンプログ
ラム、７……外部入出力装置、ｎ０〜ｎ５……デ
ータ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の外部記憶装置及び主記憶装置に対するデ
    ータの書込みと読み出しの制御を行う入出力制御
    装置において、前記外部記憶装置からロードされ
    たデータ並びに前記主記憶装置から退避されたデ
    ータを非常駐的に保持する補助記憶装置と、前記
    外部記憶装置及び前記主記憶装置に対するデータ
    の書込み・読み出し時に前記補助記憶装置の保持
    するデータのロツド・退避制御を行うデータ制御
    装置とを有することを特徴とする入出力制御装置
    。
JP11631790U 1990-11-06 1990-11-06 Pending JPH0474351U (ja)

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JP11631790U JPH0474351U (ja) 1990-11-06 1990-11-06

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JP11631790U JPH0474351U (ja) 1990-11-06 1990-11-06

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JPH0474351U true JPH0474351U (ja) 1992-06-29

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