JPH0474341U - - Google Patents
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- Publication number
- JPH0474341U JPH0474341U JP11685090U JP11685090U JPH0474341U JP H0474341 U JPH0474341 U JP H0474341U JP 11685090 U JP11685090 U JP 11685090U JP 11685090 U JP11685090 U JP 11685090U JP H0474341 U JPH0474341 U JP H0474341U
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- JP
- Japan
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- connector
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- Pending
Links
- 238000001514 detection method Methods 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Techniques For Improving Reliability Of Storages (AREA)
- Detection And Correction Of Errors (AREA)
Description
第１図は本考案の一実施例のブロツク図である
。 １……記憶制御部、２……主記憶部、３……共
通バス、４……コネクタ、５……パリテイ記憶部
、６……パリテイデータ生成部、７……パリテイ
エラー検出部。
。 １……記憶制御部、２……主記憶部、３……共
通バス、４……コネクタ、５……パリテイ記憶部
、６……パリテイデータ生成部、７……パリテイ
エラー検出部。
Claims (1)
- データバスを含む共通バスに接続された記憶制
御部と主記憶部とを有する端末装置において、共
通バスに接続されたコネクタと、このコネクタを
介して与えられるデータバス上のデータからパリ
テイデータを生成するパリテイデータ生成部と、
主記憶部への書込信号を前記コネクタを介して受
けたとき前記パリテイデータ生成部で生成した第
１のパリテイデータを前記コネクタを介して与え
られるアドレスに記憶するパリテイ記憶部と、主
記憶部への読取信号を前記コネクタを介して受け
たとき、前記パリテイ記憶部の前記コネクタを介
して与えられアドレスから読出した前記第１のパ
リテイデータと前記コネクタを介して与えられる
主記憶部の読出しデータから前記パリテイデータ
生成部により生成した第２のパリテイデータとを
照合して一致または不一致の出力を前記コネクタ
の特定の端子に出力するパリテイエラー検出部と
、前記コネクタが使用されているとき前記特定の
端子からの出力を受信する記憶制御部とを有する
ことを特徴とする端末装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11685090U JPH0474341U (ja) | 1990-11-07 | 1990-11-07 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11685090U JPH0474341U (ja) | 1990-11-07 | 1990-11-07 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0474341U true JPH0474341U (ja) | 1992-06-29 |
Family
ID=31864696
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11685090U Pending JPH0474341U (ja) | 1990-11-07 | 1990-11-07 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0474341U (ja) |
-
1990
- 1990-11-07 JP JP11685090U patent/JPH0474341U/ja active Pending
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