JPH0435948B2 - - Google Patents

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JPH0435948B2
JPH0435948B2 JP61308225A JP30822586A JPH0435948B2 JP H0435948 B2 JPH0435948 B2 JP H0435948B2 JP 61308225 A JP61308225 A JP 61308225A JP 30822586 A JP30822586 A JP 30822586A JP H0435948 B2 JPH0435948 B2 JP H0435948B2
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JP
Japan
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data
bit
mask
register
pattern
Prior art date
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JP61308225A
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Japanese (ja)
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JPS63164569A (en
Inventor
Ryoichi Takahashi
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Shaken Co Ltd
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Shaken Co Ltd
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Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、文字・画像等の二値のパターンデー
タの縮小を行う画像処理方法に関するものであ
り、特に1バイト単位で縮小を行う画像処理方法
に関するものである。
[Detailed Description of the Invention] [Industrial Application Field] The present invention relates to an image processing method for reducing binary pattern data such as characters and images, and particularly relates to an image processing method for reducing binary pattern data in 1-byte units. It is about the method.

[従来の技術] 一般に、文字・画像等の原パターンから、所望
の大きさのパターンデータを得るために縮小処理
を行うには、原パターンデータの黒画素の位置
を、縮小後の位置座標に置き変える処理を行う必
要がある。
[Prior Art] Generally, in order to perform a reduction process to obtain pattern data of a desired size from an original pattern such as a character or image, the position of a black pixel in the original pattern data is set to the position coordinates after reduction. It is necessary to perform a process to replace it.

従来この処理は、例えば特開昭52−68326号公
報に開示されているような走査部8(第2図)を
シフトレジスタ等で構成し、全てのビツト位置の
情報を論理回路部9へ供給する方法により行われ
ていた。
Conventionally, this process has been carried out by constructing a scanning section 8 (FIG. 2) with a shift register, etc., as disclosed in, for example, Japanese Patent Application Laid-Open No. 52-68326, and supplying information on all bit positions to a logic circuit section 9. It was done using a method.

[発明が解決しようとする問題点] 上記従来方法では、原パターンの黒画素だけで
なく白画素をも含むすべての画素について縮小後
の位置を求める処理を行つていた。
[Problems to be Solved by the Invention] In the above-mentioned conventional method, a process is performed to obtain the positions after reduction of all pixels including not only black pixels but also white pixels of the original pattern.

従つて、上記従来方法による縮小処理は極めて
時間がかかるものであり、より高速に縮小処理で
きる画像処理方法が待たれていた。
Therefore, the reduction processing by the above-mentioned conventional method takes an extremely long time, and an image processing method that can perform reduction processing at a higher speed has been awaited.

[問題点を解決するための手段] 本発明は以上の点から成したものであり、より
高速にパターンデータの縮小処理を行える画像処
理方法を提供することを目的とし、その特徴とす
るところは、注目黒画素の位置データに所定の演
算をすることによつて画像の大きさを変化させる
画像処理方法において、処理済みのビツト位置ま
での情報をマスクするのに必要なマスクデータを
記憶したマスクデータテーブルと、該マスクデー
タテーブルから続出されたマスクデータと原パタ
ーンデータとの論理積に基づいて、マスクを通過
した未処理データに含まれているビツト“1”の
うち最上位にあるビツト“1”の位置を検出する
と共に、ビツト“1”が存在しない場合には黒画
素が無いことを検出するプライオリテイエンコー
ダとを具備し、該プライオリテイエンコーダの出
力を、前記演算に供する注目黒画素の位置データ
とすると共に、前記マスクデータテーブルに対す
る読出しアドレスデータとしたことである。
[Means for Solving the Problems] The present invention has been made based on the above points, and an object of the present invention is to provide an image processing method that can perform pattern data reduction processing at higher speed, and its characteristics are as follows. , in an image processing method that changes the size of an image by performing a predetermined calculation on the position data of a black pixel of interest, a mask that stores mask data necessary to mask information up to the processed bit position. Based on the logical product of the data table, the mask data successively output from the mask data table, and the original pattern data, the most significant bit "1" included in the unprocessed data that has passed through the mask is determined. and a priority encoder that detects the position of the bit "1" and detects that there is no black pixel if the bit "1" does not exist, and the output of the priority encoder is used as the black pixel of interest for use in the calculation. In addition to the position data, the data is used as read address data for the mask data table.

[作用] 本発明では、原パターンデータを1バイト単位
で縮小処理を行うに際し、プライオリテイエンコ
ーダで、マスクを通過した未処理データに含まれ
ている黒画素のうち最上位にある黒画素の位置、
即ち、未処理データに含まれているビツト“1”
のうち最上位にあるビツト“1”の位置を検出
し、その位置についてのみ縮小後の位置を求める
よう処理を行い、高速化を計つたものである。
[Operation] In the present invention, when reducing the original pattern data in units of bytes, the priority encoder determines the position of the highest black pixel among the black pixels included in the unprocessed data that has passed through the mask. ,
In other words, the bit “1” contained in the unprocessed data
The position of the most significant bit "1" is detected, and processing is performed to obtain the reduced position only for that position, thereby increasing speed.

[実施例] 第1図は本発明の一実施例に係る画像処理シス
テムの構成を示すブロツク図である。
[Embodiment] FIG. 1 is a block diagram showing the configuration of an image processing system according to an embodiment of the present invention.

1はレジスタであり、1ライン分(1バイト)
の原パターンデータを保持するものである。
1 is a register, 1 line (1 byte)
It holds the original pattern data.

2はANDゲートであり、レジスタ1の出力と
後述するマスクテーブル3からの出力との論理積
を取る。
2 is an AND gate, which takes the AND of the output of register 1 and the output from mask table 3, which will be described later.

3はマスクデータテーブルであり、レジスタ1
に保持されている1ライン分(1バイト)の原パ
ターンデータを既に処理した位置まで順次マスク
するためのデータをテーブルとして保有しかつ後
述するレジスタ5の出力に応じてマスクデータを
出力するものである。
3 is a mask data table, register 1
It holds data as a table for sequentially masking one line (one byte) of original pattern data held in the memory up to the already processed position, and outputs mask data in accordance with the output of register 5, which will be described later. be.

4はプライオリテイエンコーダであり、AND
ゲート2にてレジスタ1の1ライン分(1バイ
ト)の原パターンデータとマスクデータテーブル
3の所定のマスクデータとの論理積をとつた結果
より、黒画素に対応するビツト“1”の中の最上
位の“1”のビツト位置を検出し、その位置に対
応する位置コードを出力するものである。
4 is the priority encoder, AND
At gate 2, based on the result of ANDing the original pattern data for one line (one byte) in register 1 and the predetermined mask data in mask data table 3, the bit "1" corresponding to the black pixel is The most significant bit position of "1" is detected and a position code corresponding to that position is output.

5はレジスタであり、前記プライオリテイエン
コーダ4から出力された最上位の“1”ビツトの
位置を示す位置コードを保持するものである。
A register 5 holds a position code indicating the position of the most significant "1" bit output from the priority encoder 4.

6はマルチプライヤであり、レジスタ5に保持
されている位置コードと、予め入力されている縮
小率とを掛算し、その結果を後述するビツトデー
タテーブル7のアドレスとして出力するものであ
る。
A multiplier 6 multiplies the position code held in the register 5 by a reduction rate input in advance, and outputs the result as an address of a bit data table 7, which will be described later.

7はビツトデータテーブルであり、マルチプラ
イヤ6の出力により指定されたアドレスに対応し
て縮小後の所定のビツト位置にビツト“1”を出
力するためのデータテーブルを保有するものであ
る。
Reference numeral 7 denotes a bit data table, which holds a data table for outputting a bit "1" to a predetermined bit position after reduction, corresponding to the address specified by the output of the multiplier 6.

8はORゲートであり、ビツトデータテーブル
7が出力するデータと後述するレジスタ9の保持
内容との論理和を取るためのものである。
Reference numeral 8 denotes an OR gate, which is used to logically OR the data output from the bit data table 7 and the contents held in the register 9, which will be described later.

9はレジスタであり、ORゲート8の出力デー
タを保持し、1ライン分の処理が終了した後、縮
小後のパターンデータとして出力するものであ
る。
A register 9 holds the output data of the OR gate 8 and outputs it as reduced pattern data after processing for one line is completed.

次に、上記構成からなる画像処理システムのデ
ータ処理動作を説明することにより本発明の実施
例に係る画像処理方法を説明する。尚、以下の説
明では、第3図1に示す1バイト(8ビツト)の
原パターンデータを1/2に縮小して第3図2に示
すパターンに変換した場合について説明する。ま
た1バイト(8ビツト)の原パターンデータを対
象とする場合には、第1図に示すマククデータテ
ーブル3とビツトデータテーブル7の内容は、第
2図1,2に示すような状態に設定されている。
Next, an image processing method according to an embodiment of the present invention will be explained by explaining the data processing operation of the image processing system having the above configuration. In the following explanation, a case will be explained in which the original pattern data of 1 byte (8 bits) shown in FIG. 3 is reduced to 1/2 and converted into the pattern shown in FIG. 3. In addition, when the target is 1 byte (8 bits) of original pattern data, the contents of the mask data table 3 and bit data table 7 shown in Fig. 1 are changed to the states shown in Fig. 2, 1 and 2. It is set.

(最初の動作サイクル) はじめに、レジスタ1に供給される原パターン
データのうち第3図1に示す1バイトのデータ
『01110011』がレジスタ1に保持される。マスク
データテーブル3は、初期状態においてそのアド
レス8のデータ『11111111』を出力する状態にな
つており、このデータとレジスタ1が保持するデ
ータとがANDゲート2に印加される。
(First Operation Cycle) First, among the original pattern data supplied to the register 1, 1-byte data "01110011" shown in FIG. 3 is held in the register 1. In the initial state, the mask data table 3 is in a state where it outputs data "11111111" at address 8, and this data and the data held by the register 1 are applied to the AND gate 2.

このANDゲート2は、レジスタ1とマスクデ
ータテーブル3からのデータの論理積、即ちこの
場合『01110011』を出力し、プライオリテイエン
コーダ4に印加する。プライオリテイエンコーダ
4は、入力したデータの最上位の“1”ビツトの
位置を検出し、その位置コードを出力する。本実
施例においては、第3図に示すように、ビツト6
の“1”が最上位であるため、プライオリテイエ
ンコーダ4は位置コード“6”を出力する。この
プライオリテイエンコーダ4から出力された位置
コード“6”は、レジスタ5に印加され、ここで
保持される。このレジスタ5に保持された位置コ
ード“6”は、マスクデータテーブル3のマルチ
プライヤ6に印加される。
The AND gate 2 outputs the AND of the data from the register 1 and the mask data table 3, ie, "01110011" in this case, and applies it to the priority encoder 4. The priority encoder 4 detects the position of the most significant "1" bit of the input data and outputs its position code. In this embodiment, as shown in FIG.
Since "1" is the highest position, the priority encoder 4 outputs the position code "6". The position code "6" output from the priority encoder 4 is applied to the register 5 and held there. The position code “6” held in this register 5 is applied to the multiplier 6 of the mask data table 3.

このマルチプライヤ6は、レジスタ5からの位
置コード“6”を入力すると、この“6”に指定
された縮小率の1/2を乗算する。この結果、縮小
された位置コード“3”がビツトデータテーブル
7のアドレスとして出力される。ビツトデータテ
ーブル7は、マルチプライヤ6からの出力を入力
すると、指定されたアドレス“3”のデータ
『00001000』を読み出し、ORゲート8に印加す
る。このデータ『00001000』は、ORゲート8に
てレジスタ9に格納されているデータと論理和が
取られた後、レジスタ9に印加されている。この
場合、第1回目の処理であり、初期状態において
レジスタ9内にはデータ『00000000』が格納され
ているため、ORゲート8が出力するデータは
『00001000』となり、これがレジスタ9に保持さ
れる。
When this multiplier 6 receives the position code "6" from the register 5, it multiplies this "6" by 1/2 of the specified reduction rate. As a result, the reduced position code "3" is output as the address of the bit data table 7. When the bit data table 7 receives the output from the multiplier 6, it reads out the data "00001000" at the designated address "3" and applies it to the OR gate 8. This data "00001000" is applied to the register 9 after being logically summed with the data stored in the register 9 by the OR gate 8. In this case, this is the first processing, and since data "00000000" is stored in register 9 in the initial state, the data output by OR gate 8 is "00001000", which is held in register 9. .

このレジスタ9が保持するデータ『00001000』
が黒画素の最上位の位置データ『01000000』を1/
2に縮小した時の黒画素の位置データとなる。
Data held by this register 9 “00001000”
is the top position data of black pixel “01000000” by 1/
This is the position data of the black pixel when reduced to 2.

(2回目の動作サイクル) このときに、マスクデータテーブル3は、レジ
スタ5から印加されている最上位の位置データ
“6”を入力したことにより、これ対応するアド
レス6のデータ『00111111』を出力する状態にな
つている。従つて、このデータを入力するAND
ゲート2にて、びマスクデータテーブル3の出力
データ『00111111』とレジスタ1の出力データ
『01110011』との論理積が取られると、今度はそ
の結果が『00110011』となり、このデータ
『00110011』がプライオリテイエンコーダ4に印
加される。その後、前述した処理と同様にして、
このデータ『00110011』の最上位のビツト“1”
の位置を検出し、最上位の位置コード“5”をレ
ジスタ5へ印加する。その後、レジスタ5が保持
するコード“5”はマルチプライヤ6に印加され
て縮小率が乗算され、その縮小後の位置コード
“2”(又は“3”でも良い)を算出する。ビツト
データテーブル7は、前述した処理と同様に、こ
のマルチプライヤ6の出力する位置コード“2”
に対応するアドレス2のデータ『00000100』を出
力し、これを入力するORゲート8にてレジスタ
9が保持するデータ『00001000』との論理和が取
られる。その結果、レジスタ9には位置データ
『00001100』が保持されることになる。
(Second operation cycle) At this time, the mask data table 3 receives the highest position data "6" applied from the register 5, and outputs data "00111111" at the corresponding address 6. I'm in a state where I can. Therefore, input this data AND
At gate 2, when the output data "00111111" of mask data table 3 and the output data "01110011" of register 1 are ANDed, the result becomes "00110011", and this data "00110011" is It is applied to the priority encoder 4. Then, in the same way as above,
The most significant bit of this data “00110011” is “1”
, and applies the highest position code "5" to the register 5. Thereafter, the code "5" held by the register 5 is applied to the multiplier 6 and multiplied by the reduction rate to calculate the reduced position code "2" (or "3"). The bit data table 7 contains the position code "2" output from the multiplier 6, similar to the process described above.
The data "00000100" of address 2 corresponding to is output, and the OR gate 8 which inputs this data is logically summed with the data "00001000" held by the register 9. As a result, the position data "00001100" is held in the register 9.

(3回目以降の動作サイクル) 以下同様にして処理されるが、原パターンデー
タのビツト位置3及び2の情報は“0”であるの
で、ビツト位置4〜7の情報をマスクすると、プ
ライオリテイエンコーダ4から出力される情報は
「4」から「1」に飛び、これらビツト位置3及
び2に係る動作サイクルは省略される。
(Third and subsequent operation cycles) Processing is performed in the same manner from now on, but since the information at bit positions 3 and 2 of the original pattern data is "0", if the information at bit positions 4 to 7 is masked, the priority encoder The information output from bit position 4 jumps from ``4'' to ``1'', and the operating cycles associated with these bit positions 3 and 2 are omitted.

このような処理動作をプライオリテイエンコー
ダ4が「黒画素なし」を検出するまでに行うこと
により第3図1に示す原パターンのデータ
『01110011』から第3図2に示す1/2に縮小した場
合の位置データ『00001101』を得ることができる
ものである。
By performing such a processing operation until the priority encoder 4 detects "no black pixel", the original pattern data "01110011" shown in FIG. 3 1 is reduced to 1/2 as shown in FIG. 3 2. It is possible to obtain the position data "00001101" for the case.

第4図1は8×8ドツトの画像パターンを示す
図であり、第4図2は第4図1に示す像パターン
をX方向についてのみ1/2に縮小処理した場合の
縮小後の画像パターンを示す図である。
FIG. 4 1 is a diagram showing an 8×8 dot image pattern, and FIG. 4 2 is an image pattern after reduction when the image pattern shown in FIG. 4 1 is reduced to 1/2 only in the X direction. FIG.

本実施例においては、1バイト分、即ち図中1
〜8の各ライン毎に前記処理を行うことにより、
X方向へ1/2縮小したときの画像パターンを得て
いる。
In this embodiment, 1 byte, that is, 1 in the figure.
By performing the above processing for each line of ~8,
An image pattern obtained when the image is reduced by 1/2 in the X direction is obtained.

一般に2次元パターンにおいては同一の1バイ
ト分のパターンが複数回繰り返すことが多い。第
4図1に示すパターンもライン1〜5及びライン
6〜8がそれぞれ同一のパターンから構成されて
いる。従つて、パターンデータを第5図に示すよ
うに1バイト分のパターンデータとそのリピート
回数の情報として持つように設定すれば、各ライ
ン毎の縮小後のデータを求めることなく同一のパ
ターンデータをリピートすることにより画像処理
を行うことができる。
Generally, in two-dimensional patterns, the same one-byte pattern is often repeated multiple times. In the pattern shown in FIG. 4, lines 1 to 5 and lines 6 to 8 are each composed of the same pattern. Therefore, if the pattern data is set to have one byte of pattern data and information on its repeat count as shown in Figure 5, it is possible to use the same pattern data without having to obtain the reduced data for each line. Image processing can be performed by repeating.

特に、このように1バイト分のパターンデータ
とそのリピート回数のデータによりパターンデー
タを構成すると、第6図に示すように1バイト分
のパターンデータが3回リピートされることによ
り構成されている画像のパターンの場合、1つの
1バイト分のパターンデータのX方向への縮小後
のパターンデータを前述した画像処理により求
め、さらに各縮小後のパターンのリピート回数に
同一縮小率を乗じて3回及び2回に削減すればY
方向への縮小も行うことができる。
In particular, when pattern data is composed of 1 byte of pattern data and data about the number of times it is repeated, an image is created by repeating 1 byte of pattern data three times, as shown in Figure 6. In the case of a pattern, the pattern data after reducing one byte of pattern data in the If you reduce it to 2 times, Y
A reduction in the direction can also be performed.

尚、本発明は縮小についてのものであるが、拡
大処理についても同様に行うことができる。ま
た、上記実施例は1バイト単位で縮小処理を行つ
ているが本発明は1バイトで処理することに限定
されない。
Note that although the present invention relates to reduction, the same can be applied to enlargement processing. Further, although the above embodiment performs reduction processing in units of 1 byte, the present invention is not limited to processing in 1 byte.

[発明の効果] 本発明によれば、原パターンの黒画素について
のみ縮小処理を行つているので、従来白画素も含
むすべての画素について縮小処理を行つていたの
に比べ、大幅に処理時間を短縮することができ
る。
[Effects of the Invention] According to the present invention, since reduction processing is performed only on black pixels of the original pattern, processing time is significantly reduced compared to conventional reduction processing performed on all pixels including white pixels. can be shortened.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例に係る画像処理シス
テムの構成を示すブロツク図、第2図1,2はそ
れぞれ第1図に示すマスクデータテーブルとビツ
トデータテーブルの内容を示す図、第3図1,2
はそれぞれ1バイト8ビツトの原パターンデータ
とそれを1/2に縮小した場合のデータを示す図、
第4図1,2はそれぞれ8×8ドツトのパターン
とそれをX方向に1/2に縮小したパターンを示す
図、第5図は1バイトのパターンデータとリピー
ト回数とからなるパターンデータを図形化した
図、第6図は原パターンをX−Y方向に1/2に縮
小した状態を示す図である。 1,5,9……レジスタ、2……ANDゲート、
3……マスクデータテーブル、4……プライオリ
テイエンコーダ、6……マルチプライヤ、7……
ビツトデータテーブル、8……ORゲート。
FIG. 1 is a block diagram showing the configuration of an image processing system according to an embodiment of the present invention. FIGS. 2 and 2 are diagrams showing the contents of the mask data table and bit data table shown in FIG. 1, respectively. Figures 1 and 2
are diagrams showing the original pattern data of 1 byte and 8 bits and the data when it is reduced to 1/2, respectively.
Figures 4 1 and 2 are diagrams showing an 8 x 8 dot pattern and a pattern reduced to 1/2 in the X direction, respectively. Figure 5 is a diagram showing pattern data consisting of 1 byte of pattern data and the number of repeats. FIG. 6 is a diagram showing the original pattern reduced to 1/2 in the X-Y direction. 1, 5, 9...Register, 2...AND gate,
3...Mask data table, 4...Priority encoder, 6...Multiplier, 7...
Bit data table, 8...OR gate.

Claims (1)

【特許請求の範囲】 1 注目黒画素の位置データに所定の演算を施す
ことによつて画像の大きさを変化させる画像処理
方法において、 処理済みのビツト位置までの情報をマスクする
のに必要なマスクデータを記憶したマスクデータ
テーブルと、 該マスクデータテーブルから続出されたマスク
データと原パターンデータとの論理積に基づい
て、マスクを通過した未処理データに含まれてい
るビツト“1”のうち最上位にあるビツト“1”
の位置を検出すると共に、ビツト“1”が存在し
ない場合には黒画素が無いことを検出するプライ
オリテイエンコーダとを具備し、 該プライオリテイエンコーダの出力を、前記演
算に供する注目黒画素の位置データとすると共
に、前記マスクデータテーブルに対する読出しア
ドレスデータとしたことを特徴とする画像処理方
法。
[Claims] 1. In an image processing method that changes the size of an image by performing a predetermined operation on the position data of a black pixel of interest, Based on the logical product of the mask data table storing the mask data and the mask data and original pattern data successively extracted from the mask data table, bits "1" included in the unprocessed data that have passed through the mask are determined. Bit “1” at the top
and a priority encoder that detects the position of the target black pixel and detects that there is no black pixel if the bit "1" does not exist, and the output of the priority encoder is used as the position of the black pixel of interest to be subjected to the calculation. An image processing method characterized in that the data is read address data for the mask data table.
JP61308225A 1986-12-26 1986-12-26 Image processing method Granted JPS63164569A (en)

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JPS63164569A JPS63164569A (en) 1988-07-07
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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5268326A (en) * 1975-12-05 1977-06-07 Nippon Telegr & Teleph Corp <Ntt> Character pattern generation system

Patent Citations (1)

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JPS5268326A (en) * 1975-12-05 1977-06-07 Nippon Telegr & Teleph Corp <Ntt> Character pattern generation system

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