JPH0422310Y2 - - Google Patents

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JPH0422310Y2
JPH0422310Y2 JP1985204026U JP20402685U JPH0422310Y2 JP H0422310 Y2 JPH0422310 Y2 JP H0422310Y2 JP 1985204026 U JP1985204026 U JP 1985204026U JP 20402685 U JP20402685 U JP 20402685U JP H0422310 Y2 JPH0422310 Y2 JP H0422310Y2
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diode
detected element
level
circuit
power supply
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Description

【考案の詳細な説明】 技術分野 本考案は、コイルおよび抵抗などの断線などを
検知するための断線などの検知回路に関する。
[Detailed Description of the Invention] Technical Field The present invention relates to a disconnection detection circuit for detecting disconnection of a coil, a resistor, etc.

背景技術 第3図は、典型的な先行技術の電気回路図であ
る。マイクロコンピユータなどによつて実現され
る処理回路1の出力端子a,b,c,……,nの
うちの1つからは順次的にローレベルの信号が導
出され、残余の端子からはハイレベルの信号が導
出されたままである。たとえば出力端子aからロ
ーレベルの信号が導出されたときトランジスタ
Qaは遮断し、残余の出力端子b,c,……,n
からはハイレベルの信号が導出されており、トラ
ンジスタQb,Qc,……,Qnは導通している。ト
ランジスタQaに対応する負荷であるコイルLaが
断線していなくて導通しているときには、トラン
ジスタQaのコレクタはハイレベルであり、した
がつてダイオードD11を介してトランジスタQ
のベースにはハイレベルの信号が与えられる。こ
れによつてトランジスタQが導通し、入力端子p
はローレベルとなる。もしも負荷Laが断線して
いるときには、遮断しているトランジスタQaの
コレクタはローレベルであり、トランジスタQは
遮断し、入力端子pはハイレベルとなる。以下同
様にしてコイルLb,Lcおよび負荷である抵抗R
の断線を検出することができる。
Background Art FIG. 3 is a typical prior art electrical circuit diagram. A low-level signal is sequentially derived from one of the output terminals a, b, c, ..., n of a processing circuit 1 realized by a microcomputer, etc., and a high-level signal is derived from the remaining terminals. signals remain derived. For example, when a low level signal is derived from output terminal a, the transistor
Qa is cut off, and the remaining output terminals b, c, ..., n
A high level signal is derived from , and transistors Qb, Qc, ..., Qn are conductive. When the coil La, which is the load corresponding to the transistor Qa, is not disconnected and is conducting, the collector of the transistor Qa is at a high level, and therefore the collector of the transistor Qa is connected to the transistor Q through the diode D11.
A high level signal is applied to the base of the . This makes transistor Q conductive and input terminal p
becomes low level. If the load La is disconnected, the collector of the disconnected transistor Qa is at a low level, the transistor Q is disconnected, and the input terminal p is at a high level. Similarly, the coils Lb, Lc and the load resistance R
wire breakage can be detected.

考案が解決すべき問題点 このような先行技術では、負荷であるコイル
La,Lb,Lcのサージ吸収のためにもう1つのダ
イオードD21,D22,D23を必要とする。
したがつて部品点数が増加するという問題があ
る。
Problems to be solved by the invention In such prior art, the coil which is the load
Other diodes D21, D22, and D23 are required to absorb surges of La, Lb, and Lc.
Therefore, there is a problem that the number of parts increases.

本考案の目的は、部品点数を低下することがで
きるようにした断線などの検知回路を提供するこ
とである。
An object of the present invention is to provide a circuit for detecting disconnection, etc., which can reduce the number of parts.

問題点を解決するための手段 本考案は、誘導性の被検出素子の一方端を第1
電源ラインへ共通に接続し、他方端を個別的に設
けられたスイツチング素子を介して第2電源ライ
ンへ接続するとともに、 スイツチング素子の1つを順次的に遮断しかつ
残余のスイツチング素子を導通する制御手段と、
前記被検出素子の他方端のレベルを弁別するレベ
ル弁別回路とを具備し、 前記レベル弁別回路の弁別結果に基づいて前記
被検出素子の断線等を検知する回路において、 前記被検出素子の他方端と第1電源ラインとの
間に、各被検出素子に個別的に配置される第1ダ
イオードと各被検出素子に共通に設けられる第2
ダイオードとを、前記被検出素子から発生するサ
ージ電流に対して順方向になるように直列接続す
るとともに、 前記レベル弁別回路は前記第1ダイオードを介
して前記被検出素子の他方端のレベルを弁別する
ようにしてなることを特徴とする断線等の検知回
路である。
Means for Solving the Problems The present invention connects one end of the inductive detected element to the first
Commonly connected to the power supply line, the other end is connected to the second power supply line via individually provided switching elements, one of the switching elements is sequentially cut off, and the remaining switching elements are made conductive. control means;
a level discrimination circuit that discriminates the level at the other end of the detected element, and detects a disconnection or the like of the detected element based on the discrimination result of the level discrimination circuit, the circuit comprising: and the first power supply line, a first diode is arranged individually for each detected element, and a second diode is provided commonly for each detected element.
and a diode are connected in series so as to be in a forward direction with respect to the surge current generated from the detected element, and the level discrimination circuit discriminates the level at the other end of the detected element via the first diode. This is a circuit for detecting wire breakage, etc., which is characterized in that it is configured to do so.

作 用 本考案に従えば、複数のコイルなどの誘導性の
被検出素子は、その一方端が第1電源ラインへ共
通に接続されており、また他方端が個別的に設け
られたスイツチング素子を介して第2電源ライン
へ接続されている。前記スイツチング素子は、制
御手段によつて個別的に導通/遮断制御される。
したがつて、制御手段がスイツチング素子を導通
すると、そのスイツチング素子に対応する被検出
素子へは駆動電流が流れて、該被検出素子は負荷
として作用する。
Effect According to the present invention, one end of each inductive detected element such as a plurality of coils is commonly connected to the first power supply line, and the other end is connected to an individually provided switching element. The second power supply line is connected to the second power supply line via the second power supply line. The switching elements are individually controlled to be turned on/off by a control means.
Therefore, when the control means conducts a switching element, a drive current flows to the detected element corresponding to the switching element, and the detected element acts as a load.

前記被検出素子の他方端すなわちスイツチング
素子との接続点は、それぞれ第1ダイオードを介
してレベル弁別回路に接続されている。前記制御
手段は前記スイツチング素子の1つを順次的に遮
断し、かつ残余のスイツチング素子を導通してゆ
き、各スイツチング状態におけるレベル弁別回路
の弁別結果に基づいて、被検出素子の断線や短絡
などが検出される。
The other end of the detected element, that is, the connection point with the switching element is connected to a level discrimination circuit via a first diode. The control means sequentially shuts off one of the switching elements and conducts the remaining switching elements, and detects disconnection or short circuit of the detected element based on the discrimination result of the level discrimination circuit in each switching state. is detected.

また、前記被検出素子の他方端と第1電源ライ
ンとの間には、前記第1ダイオードに共通に第2
ダイオードが設けられており、この第2ダイオー
ドは被検出素子の電流遮断時に発生するサージ電
流と順方向になるように各第1ダイオードと前記
第1電源ラインとの間に介在されている。したが
つて、サージ吸収用の第2ダイオードを各被検出
素子に共用して、部品点数を削減することができ
る。
Further, a second diode common to the first diode is connected between the other end of the detected element and the first power supply line.
A diode is provided, and this second diode is interposed between each first diode and the first power supply line so as to be in the forward direction of the surge current generated when the current of the detected element is cut off. Therefore, the number of components can be reduced by using the second diode for surge absorption in common for each detected element.

実施例 第1図は、本考案の一実施例の電気回路図であ
る。負荷である被検出素子は参照符La,Lb,Lc
で表されるようにコイルである。このコイルLa,
Lb,Lcおよびさらに他の負荷である抵抗Rの一
方端は、ライン2に共通に接続される。コイル
La,Lb,Lcおよび抵抗Rの他方端はラインla,
lb,lc,……,lnを個別的に介してスイツチング
素子であるトランジスタQa,Qb,Qc,……,
Qnのコレクタにそれぞれ接続される。これらの
トランジスタQa,Qb,Qc,……,Qnのベース
には、マイクロコンピユータなどによつて実現さ
れる処理回路1の出力端子a,b,c,……,n
から制御信号が与えられる。コイルLa,Lb,Lc
および抵抗Rの前記他方端には、順方向にダイオ
ードD31,D32,D33,……,D3nの一
方端であるアノードが接続される。これらの第1
ダイオードD31,D32,D33,……,D3
nの他方端であるカソードは、ライン3に共通に
接続される。このライン3は抵抗R1,R2に接
続される。抵抗R1,R2の接続点4はレベル弁
別のためのトランジスタQのベースに接続され
る。トランジスタQのコレクタは抵抗R3によつ
てプルアツプされ、その出力は処理回路1の入力
端子pに与えられる。第1ダイオードD31,D
32,D33,……,D3nが共通に接続されて
いるライン3と、コイルLa,Lb,Lc、および抵
抗Rが共通に接続されているライン2には、サー
ジ吸収のために第2ダイオードD30が接続され
る。
Embodiment FIG. 1 is an electrical circuit diagram of an embodiment of the present invention. The detected elements as loads are referenced La, Lb, Lc.
It is a coil as shown in . This coil La,
Lb, Lc and one end of a resistor R, which is another load, are commonly connected to line 2. coil
The other end of La, Lb, Lc and resistor R is line la,
Transistors Qa, Qb, Qc, ..., which are switching elements, are connected individually through lb, lc, ..., ln.
Each is connected to a Qn collector. The bases of these transistors Qa, Qb, Qc, ..., Qn are connected to output terminals a, b, c, ..., n of a processing circuit 1 realized by a microcomputer or the like.
A control signal is given from Coil La, Lb, Lc
The other end of the resistor R is connected in the forward direction to the anode, which is one end of the diodes D31, D32, D33, . . . , D3n. The first of these
Diodes D31, D32, D33, ..., D3
The other end of n, the cathode, is commonly connected to line 3. This line 3 is connected to resistors R1 and R2. A connection point 4 between resistors R1 and R2 is connected to the base of a transistor Q for level discrimination. The collector of the transistor Q is pulled up by a resistor R3, and its output is applied to the input terminal p of the processing circuit 1. First diode D31,D
A second diode D30 is connected to the line 3 to which 32, D33, ..., D3n are commonly connected, and to the line 2 to which the coils La, Lb, Lc and resistor R are commonly connected for surge absorption. is connected.

処理回路1は、出力端子a,b,c,nに第2
図1〜第2図4で示される制御信号を与える。た
とえば出力端子aにローレベルの信号が与えられ
ているとき、残余の出力端子b,c,……,nに
はハイレベルの信号が与えられる。このようにし
てローレベルの信号は、出力端子a〜nに順次的
に与えられ、残余の出力端子はハイレベルに保た
れる。たとえば出力端子aからローレベルの信号
が与えられているときトランジスタQaは遮断し
ており、残余のトランジスタQb,Qc,……,Qn
は導通している。コイルLaが断線しておらず導
通しているときには、第1ダイオードD31を介
してライン31にはハイレベルの信号が与えられ
る。なお残余のトランジスタQb,Qc,……,Qn
は導通しており、このとき残余の第1ダイオード
D32,D33,……,D3nがオフ状態になる
ので、ライン3は前述のように第1ダイオードD
31の働きによつてハイレベルのままである。し
たがつてトランジスタQは導通し、出力端子pは
抵抗R3の働きに拘わらずローレベルとなる。コ
イルLa,Lb,Lcおよび抵抗Rが断線していない
状態では入力端子pへは第2図5で示される信号
が入力される。このようにして処理回路1はコイ
ルLa,Lb,Lcおよび抵抗Rが断線していないこ
とを検出することができる。
The processing circuit 1 has second output terminals a, b, c, and n.
The control signals shown in FIGS. 1-2 and 4 are provided. For example, when a low level signal is applied to output terminal a, high level signals are applied to the remaining output terminals b, c, . . . , n. In this way, low level signals are sequentially applied to output terminals a to n, and the remaining output terminals are kept at high level. For example, when a low level signal is applied from output terminal a, transistor Qa is cut off, and the remaining transistors Qb, Qc, ..., Qn
is conducting. When the coil La is not disconnected and conductive, a high level signal is applied to the line 31 via the first diode D31. Note that the remaining transistors Qb, Qc, ..., Qn
is conductive, and at this time, the remaining first diodes D32, D33, ..., D3n are turned off, so line 3 is connected to the first diode D as described above.
It remains at a high level due to the function of 31. Therefore, the transistor Q becomes conductive, and the output terminal p becomes a low level regardless of the action of the resistor R3. When the coils La, Lb, Lc and the resistor R are not disconnected, the signal shown in FIG. 2 is input to the input terminal p. In this way, the processing circuit 1 can detect that the coils La, Lb, Lc and the resistor R are not disconnected.

コイルLaが断線しているときを想定する。こ
のときには出力端子aのみがローレベルであつて
も、ライン3はハイレベルとならず、したがつて
トランジスタQは遮断する。これによつて入力端
子pは抵抗R3の働きによつてハイレベルに保た
れる。残余のコイルLb,Lcおよび抵抗Rが断線
していないとき、入力端子pには第2図6で示さ
れる信号が与えられる。このようにしてコイル
Laが断線していることを検出することができる。
Assume that coil La is disconnected. At this time, even if only the output terminal a is at low level, line 3 does not go to high level, so transistor Q is cut off. As a result, the input terminal p is kept at a high level by the action of the resistor R3. When the remaining coils Lb, Lc and resistor R are not disconnected, the signal shown in FIG. 26 is applied to the input terminal p. In this way the coil
It is possible to detect that La is disconnected.

ラインlaが接地していることもまた検出するこ
とができる。たとえば出力端子aがローレベルで
あり、このときラインlaが接地しているときに
は、ライン3はハイレベルとならず、トランジス
タQが遮断したままであり、入力端子pはハイレ
ベルである。したがつて出力端子aがローレベル
である期間中において、入力端子pがハイレベル
であることによつて、コイルLaの断線またはラ
インlaの接地を検出することが可能となる。
It can also be detected that line la is grounded. For example, when the output terminal a is at a low level and the line la is grounded, the line 3 does not go to a high level, the transistor Q remains cut off, and the input terminal p is at a high level. Therefore, when the input terminal p is at a high level while the output terminal a is at a low level, it is possible to detect a disconnection of the coil La or a grounding of the line la.

コイルLa,Lb,Lcに代えて抵抗であつてもよ
い。また抵抗Rに代えてコイルであつてもよい。
抵抗R1,R2およびトランジスタQによつて構
成されるレベル弁別手段に代えて、他の構成を有
するレベル弁別手段が設けられてもよい。
Resistors may be used instead of the coils La, Lb, and Lc. Further, the resistor R may be replaced with a coil.
In place of the level discrimination means constituted by the resistors R1, R2 and the transistor Q, level discrimination means having another structure may be provided.

効 果 以上のように本考案によれば、可及的に部品点
数を低減して被検出素子の断線さらには接地など
を検出することが可能となる。
Effects As described above, according to the present invention, it is possible to reduce the number of parts as much as possible and detect disconnection or grounding of the detected element.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本考案の一実施例の電気回路図、第2
図は第1図に示された実施例の動作を説明するた
めの波形図、第3図は先行技術の電気回路図であ
る。 1……処理回路、La,Lb,Lc……コイル、R
……抵抗、Qa,Qb,Qc,……,Qn……スイツ
チングトランジスタ、Q……レベル弁別用トラン
ジスタ、D31,D32,D33,……,D3n
……第1ダイオード、D30……第2ダイオー
ド。
Fig. 1 is an electrical circuit diagram of one embodiment of the present invention;
The figure is a waveform diagram for explaining the operation of the embodiment shown in FIG. 1, and FIG. 3 is an electric circuit diagram of the prior art. 1... Processing circuit, La, Lb, Lc... Coil, R
...Resistor, Qa, Qb, Qc, ..., Qn ... Switching transistor, Q ... Level discrimination transistor, D31, D32, D33, ..., D3n
...First diode, D30...Second diode.

Claims (1)

【実用新案登録請求の範囲】 誘導性の被検出素子の一方端を第1電源ライン
へ共通に接続し、他方端を個別的に設けられたス
イツチング素子を介して第2電源ラインへ接続す
るとともに、 スイツチング素子の1つを順次的に遮断しかつ
残余のスイツチング素子を導通する制御手段と、
前記被検出素子の他方端のレベルを弁別するレベ
ル弁別回路とを具備し、 前記レベル弁別回路の弁別結果に基づいて前記
被検出素子の断線等を検知する回路において、 前記被検出素子の他方端と第1電源ラインとの
間に、各被検出素子に個別的に配置される第1ダ
イオードと各被検出素子に共通に設けられる第2
ダイオードとを、前記被検出素子から発生するサ
ージ電流に対して順方向になるように直列接続す
るとともに、 前記レベル弁別回路は前記第1ダイオードを介
して前記被検出素子の他方端のレベルを弁別する
ようにしてなることを特徴とする断線等の検知回
路。
[Claims for Utility Model Registration] One end of an inductive detected element is commonly connected to a first power supply line, and the other end is connected to a second power supply line via an individually provided switching element. , control means for sequentially shutting off one of the switching elements and conducting the remaining switching elements;
a level discrimination circuit that discriminates the level at the other end of the detected element, and detects a disconnection or the like of the detected element based on the discrimination result of the level discrimination circuit, the circuit comprising: and the first power supply line, a first diode is arranged individually for each detected element, and a second diode is provided commonly for each detected element.
and a diode are connected in series so as to be in a forward direction with respect to the surge current generated from the detected element, and the level discrimination circuit discriminates the level at the other end of the detected element via the first diode. A detection circuit for detecting disconnection, etc., characterized in that the circuit operates as follows.
JP1985204026U 1985-12-31 1985-12-31 Expired JPH0422310Y2 (en)

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