JPH04140716A - Liquid crystal display device - Google Patents
Liquid crystal display deviceInfo
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Abstract
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、カラーテレビジョン画像の表示等に用いられ
るアクティブマトリクス方式の液晶表示装置に関する。DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to an active matrix liquid crystal display device used for displaying color television images and the like.
（従来の技術）
ＮＴＳＣ等のカラーテレビジョン方式では、１画面（フ
レーム）の走査を奇数フィールドと偶数フィールドとに
分け、それぞれのフィールドにおいて走査線を１本ずつ
飛び越して走査を行うインターレース方式が採用されて
いる。そして、液晶表示装置において、このような映像
信号をインターレース方式に準拠した高解像度で表示し
ようとする場合、２本同時走査方式が用いられる。(Prior art) Color television systems such as NTSC use an interlaced system in which the scanning of one screen (frame) is divided into odd and even fields, and scanning is performed by skipping one scanning line in each field. has been done. In a liquid crystal display device, when such a video signal is to be displayed at a high resolution conforming to the interlaced method, a two-line simultaneous scanning method is used.
ここで、液晶表示装置におけるＴＰＴアクティブマトリ
クス基板の構成を第７図に示す。このＴＰＴアクティブ
マトリクス基板は、基板１１上に多数の走査信号線１３
とデータ信号線１４とを形成すると共に、これらにＴＰ
Ｔ （薄膜トランジスタ）１５を介して画素電極１２を
それぞれマトリクス状に接続したものである。また、こ
のＴＰＴアクティブマトリクス基板の対向面には、図示
しない共通の対向電極が液晶層を介して配置されている
。この構成により、各走査信号線１３に走査信号が印加
されると、導通したＴＦＴＩ５を介して当該走査信号線
１３に接続された画素電極１２に各データ信号線１４の
データ信号が送り込まれることになる。そして、走査信
号の印加が終了しＴＦＴ １５が遮断した後も、各画素
電極１２には、液晶層の容量等によってデータ信号の電
位が保持され、この電位が走査信号の印加の度に更新さ
れるようになる。従って、走査信号線に走査信号を順に
印加するマトリクス方式であっても、各画素電極１２で
は、常時データ信号の電位を保持し液晶層に印加するこ
とができる。Here, the structure of a TPT active matrix substrate in a liquid crystal display device is shown in FIG. This TPT active matrix substrate has a large number of scanning signal lines 13 on a substrate 11.
and the data signal line 14, and also provide a TP to these lines.
The pixel electrodes 12 are connected in a matrix through T (thin film transistors) 15. Furthermore, a common counter electrode (not shown) is arranged on the opposing surface of this TPT active matrix substrate with a liquid crystal layer interposed therebetween. With this configuration, when a scanning signal is applied to each scanning signal line 13, the data signal of each data signal line 14 is sent to the pixel electrode 12 connected to the scanning signal line 13 through the conductive TFTI 5. Become. Even after the application of the scanning signal is finished and the TFT 15 is cut off, the potential of the data signal is held in each pixel electrode 12 by the capacitance of the liquid crystal layer, etc., and this potential is updated every time the scanning signal is applied. Become so. Therefore, even in the matrix method in which scanning signals are sequentially applied to the scanning signal lines, each pixel electrode 12 can always hold the potential of the data signal and apply it to the liquid crystal layer.
上記２本同時走査方式は、このような液晶表示装置にお
いて、隣接する２本の走査信号線１３に同時に走査信号
を印加するようにしたものである。The two-line simultaneous scanning method is such that scanning signals are simultaneously applied to two adjacent scanning signal lines 13 in such a liquid crystal display device.
即ち、例えば第８図に示すように、奇数フィールドの走
査においては、まず１本目と２本目の走査信号線１３に
同時に走査信号を印加し、次に１水平走査期間遅れて３
本目と４本目の走査信号線１３に同時に走査信号を印加
するというように、奇数本目の走査信号線１３とこの次
に位置する偶数木目の走査信号線１３に同時に走査信号
を順次印加するようにし、偶数フィールドの走査におい
ては、まず１本目の走査信号線１３に走査信号を印加し
、次に１水平走査期間遅れて２本目と３本目の走査信号
線１３に同時に走査信号を印加し、さらに４本目と５本
目の走査信号線１３というように、奇数フィールドの走
査時とは組み合わせの異なる隣接した２本の走査信号線
１３に同時に走査信号を印加するようにしている。従っ
て、これまでの走査信号線１３に１本ずつ走査信号を印
加する単純走査方式の場合に比べ、約倍の走査信号線１
３や画素電極１２が必要にはなるが、インターレース方
式に準拠した高解像度の画像を得ることができるように
なる。That is, as shown in FIG. 8, for example, in scanning an odd field, a scanning signal is first applied to the first and second scanning signal lines 13 at the same time, and then, after a delay of one horizontal scanning period, a scanning signal is applied to the first and second scanning signal lines 13.
The scanning signal is sequentially applied simultaneously to the odd-numbered scanning signal line 13 and the next even-numbered scanning signal line 13, such as applying the scanning signal to the main and fourth scanning signal lines 13 at the same time. In scanning an even field, a scanning signal is first applied to the first scanning signal line 13, then a scanning signal is simultaneously applied to the second and third scanning signal lines 13 after a delay of one horizontal scanning period, and then Scanning signals are simultaneously applied to two adjacent scanning signal lines 13, such as the fourth and fifth scanning signal lines 13, which are in a different combination than when scanning an odd field. Therefore, compared to the conventional simple scanning method in which scanning signals are applied to the scanning signal lines 13 one by one, the number of scanning signal lines 13 is approximately twice as large.
3 and pixel electrodes 12 are required, but it becomes possible to obtain a high-resolution image conforming to the interlaced method.
（発明が解決しようとする課題）
ところで、上記の走査信号線１３に走査信号を印加した
場合、これに接続された画素電極１２の電位は、走査信
号の印加終了時にＴＦＴＩ ５におけるゲート−ドレイ
ン間の寄生容ｆｉ Ｃｇｄの影響を受けてデータ信号の
電位よりも低下することになる。即ち、単純走査方式の
場合には、ＴＦＴＩ５における導通時と遮断時のゲート
電圧をそれぞれＶＧＨｌＶＧＬとし、画素電極１２にお
ける液晶層の容量をＣＬＣとすると、おおよそ次式（１
）で示される電位ΔＶだけデータ信号の電位よりも低下
することになる。(Problem to be Solved by the Invention) By the way, when a scanning signal is applied to the scanning signal line 13 described above, the potential of the pixel electrode 12 connected thereto is the same as that between the gate and drain of the TFTI 5 at the end of application of the scanning signal. Under the influence of the parasitic capacitance fi Cgd, the potential becomes lower than that of the data signal. That is, in the case of the simple scanning method, if the gate voltages of the TFTI 5 during conduction and cutoff are respectively VGHlVGL, and the capacitance of the liquid crystal layer in the pixel electrode 12 is CLC, then approximately the following equation (1
) is lower than the potential of the data signal by a potential ΔV.
ΔＶ＝ （ＶＧ）ｌ−ＶＧＬ） Ｘ
Ｃｇｄ／ （ＣＬＣ＋ Ｃｇｄ）・・・（１）もっとも
、単純走査方式の場合には、このような電位低下は全画
素電極１２について共通である。ΔV=(VG)l−VGL)
このため、対向電極に印加する対向電圧を低下電位ΔＶ
だけシフトすれば、交流駆動によって液晶層に印加され
る電圧のＤＣバランスを０に維持することは容易である
。Therefore, the counter voltage applied to the counter electrode is reduced to a potential ΔV
It is easy to maintain the DC balance of the voltage applied to the liquid crystal layer at 0 by AC driving by shifting the voltage by 0.
しかしながら、上記２本同時走査方式の場合には、第９
図に示すように、寄生容ｊｌｃｇｄの他に、画素電極１
２とこの画素電極１２には接続されない側に隣接する走
査信号線１３との間の浮遊容量ＣＩ）ｇの影響も考慮し
なければならない。即ち、図示の走査信号線１３ａ、１
．３ ｂに走査信号Ｓａ、ｓｂを印加した場合、これら
の走査信号線１３ａ、１３ｂ間に位置する画素電極１２
ａについては、接続されない側に隣接する走査信号線１
３ｂも走査信号ｓｂによって電位の変化が生じるため、
走査信号Ｓａの印加終了時における低下電位△Ｖは次式
（２）で示されるものとなる。However, in the case of the above-mentioned two-line simultaneous scanning method, the ninth
As shown in the figure, in addition to the parasitic capacitance jlcgd, the pixel electrode 1
The influence of the stray capacitance CI)g between the pixel electrode 2 and the adjacent scanning signal line 13 on the side not connected to the pixel electrode 12 must also be considered. That is, the illustrated scanning signal lines 13a, 1
．． 3b, when the scanning signals Sa and sb are applied to the pixel electrode 12 located between these scanning signal lines 13a and 13b.
Regarding a, scanning signal line 1 adjacent to the unconnected side
3b also causes a change in potential due to the scanning signal sb, so
The reduced potential ΔV at the end of application of the scanning signal Sa is expressed by the following equation (2).
ΔＶ１＝ （ＶＧＨ−ＶＧＬ） Ｘ
（Ｃｇｄ＋ Ｃｐｇ） ／
（ＣＬＣ＋ Ｃｇｄ＋ Ｃｐｇ） ・・・く２）
ところが、他方の画素電極１２ｔｌについては、接続さ
れない側に隣接する走査信号線１３ｃにはまだ走査信号
が印加されていないために電位の変化がないので、低下
電位Δ■は次式（３）で示されるようになる。ΔV1= (VGH-VGL) X (Cgd+ Cpg) / (CLC+ Cgd+ Cpg) 2)
However, for the other pixel electrode 12tl, there is no change in potential because no scanning signal has been applied to the scanning signal line 13c adjacent to the unconnected side, so the reduced potential Δ■ is expressed by the following equation (3). will be shown.
ΔＶ２＝ （ＶＧＨ−ＶＧＬ） Ｘ
Ｃｇｄ／ （ＣＬＣ＋ Ｃｇｄ＋ Ｃｐｇ）・・・（３
）このため、画素電極１２ａと画素電極１２ｂとは、同
じデータ信号線１４に接続され同じデータ信号電圧が与
えられているにもかかわらず、走査信号の印加終了時の
低下電位にΔＶｌとΔＶ２との差が生じ、その後の保持
電位は画素電極１２ｂの方が高電位となる。ΔV2= (VGH-VGL) X Cgd/ (CLC+ Cgd+ Cpg)...(3
) Therefore, even though the pixel electrode 12a and the pixel electrode 12b are connected to the same data signal line 14 and given the same data signal voltage, the lowered potentials at the end of application of the scanning signal have ΔVl and ΔV2. A difference occurs, and the pixel electrode 12b holds a higher potential thereafter.
従って、従来の液晶表示装置では、同時に複数の走査信
号線に走査信号を印加した場合、同じデータ信号線上で
隣接する画素の明るさに差が生じ、画像品質が低下する
という問題が生じていた。Therefore, in conventional liquid crystal display devices, when scanning signals are applied to multiple scanning signal lines at the same time, a difference occurs in the brightness of adjacent pixels on the same data signal line, causing a problem in which image quality deteriorates. .
本発明は、上記峯情に鑑み、２本の走査信号線における
走査信号の印加終了時期をずらして、それぞれの画素電
極が同じ条件で電位を保持できるようにすることにより
、同時に複数の走査信号線に走査信号を印加する駆動方
式においても画素の明るさにムラの生じることのない液
晶表示装置を提供することを目的としている。In view of the above-mentioned circumstances, the present invention staggers the timing at which the application of scanning signals to two scanning signal lines ends so that each pixel electrode can maintain a potential under the same conditions, thereby simultaneously receiving a plurality of scanning signals. It is an object of the present invention to provide a liquid crystal display device that does not cause unevenness in the brightness of pixels even when using a driving method in which a scanning signal is applied to a line.
（課題を解決するための手段）
本発明の液晶表示装置は、走査信号線によってスイッチ
ングが制御されるスイッチング素子を介して画素電極が
データ信号線に接続された液晶パネルを備え、隣接する
複数本の走査信号線に同時に走査信号を印加する走査信
号線駆動回路が設けられたアクティブマトリクス方式の
液晶表示装置であって、走査信号が同時に印加される隣
接した２本の走査信号線について、これらの走査信号線
にそれぞれスイッチング素子を介して接続された２列の
画素電極の間に位置する走査信号線の側に印加した走査
信号を他方の走査信号線に印加した走査信号よりも早い
タイミングで印加を終了させる走査信号タイミング制御
回路を備えており、そのことにより上記目的が達成され
る。(Means for Solving the Problems) A liquid crystal display device of the present invention includes a liquid crystal panel in which a pixel electrode is connected to a data signal line through a switching element whose switching is controlled by a scanning signal line. An active matrix type liquid crystal display device is provided with a scanning signal line drive circuit that simultaneously applies scanning signals to two scanning signal lines. The scanning signal applied to the side of the scanning signal line located between two rows of pixel electrodes connected to the scanning signal line via switching elements is applied at a timing earlier than the scanning signal applied to the other scanning signal line. A scanning signal timing control circuit is provided for terminating the scan signal timing control circuit, thereby achieving the above object.
（作用）
上記構成により、第１図に示す走査信号線１３ａ、１３
ｂに同時に走査信号５ａｓＳｂを印加した場合、まずこ
れらの走査信号線１３Ｂ、１３ｔ）に接続された画素電
極１２ａ、１２ｂ間に位置する走査信号線１３ｂの走査
信号ｓｂが時刻ｔ１において先に印加を終了する。そし
て、この際の画素電極１２ｂにおける低下電位Δ■は、
従来の場合と同様に走査信号線１３ｃ１．ニー電位の変
化がないため、上記式（３）と同じ次式で示されるもの
となる。(Function) With the above configuration, the scanning signal lines 13a, 13 shown in FIG.
When the scanning signal 5asSb is simultaneously applied to the scanning signal line 5asSb at the time t1, the scanning signal sb of the scanning signal line 13b located between the pixel electrodes 12a and 12b connected to the scanning signal lines 13B and 13t is first applied at time t1. finish. Then, the reduced potential Δ■ at the pixel electrode 12b at this time is
As in the conventional case, the scanning signal lines 13c1. Since there is no change in the knee potential, the following equation, which is the same as equation (3) above, is obtained.
ΔＶ＝ （ＶＧＨ−ＶＧＬ）ｘ
Ｃｇｄ／ （ＣＬＣ＋ Ｃｇｄ十Ｃｐｇ）・・・（４）
また、このように走査信号線１３ｂの走査信号Ｓｂが先
に印加を終了すると、浮遊容量Ｃ１）ｇを介して隣接す
る画素電極１２ａの電位も影響を受けて一旦低下する。ΔV= (VGH - VGL) x Cgd/ (CLC + Cgd + Cpg)... (4)
Further, when the application of the scanning signal Sb to the scanning signal line 13b is finished first, the potential of the adjacent pixel electrode 12a is also affected via the stray capacitance C1)g and temporarily decreases.
しかし、この場合には、まだＴＦＴ１５が導通状態であ
り画素電極１２ａがデータ信号線１４に接続されている
ため、直ちに充電が行われ再びデータ信号の電位に復帰
する。そして、この後の時刻ｔ２に走査信号線１３ａの
走査信号Ｓａが遅れて印加を終了すると、既に隣接する
走査信号線１３ｂの電位が変化を終了しているために画
素電極１２１）の場合と同じ条件となり、低下電位Δ■
も上記式（４）と同じ値となる。However, in this case, since the TFT 15 is still in a conductive state and the pixel electrode 12a is connected to the data signal line 14, charging is immediately performed and the voltage returns to the data signal potential again. Then, when the application of the scanning signal Sa to the scanning signal line 13a ends later at time t2, the potential of the adjacent scanning signal line 13b has already finished changing, so it is the same as in the case of the pixel electrode 121). The condition is that the potential drop Δ■
also has the same value as the above equation (4).
この結果、本発明の液晶表示装置によれば、２本の走査
信号線に同時に走査信号を印加した場合＼
にも、この走査信号の印加終了時における電位低下が同
じものとなるので、各画素電極が保持する電位が等しく
なり均一な表示画像を得ることができるようになる。As a result, according to the liquid crystal display device of the present invention, even when a scanning signal is applied to two scanning signal lines at the same time, the potential drop at the end of application of the scanning signal is the same, so that each pixel The potentials held by the electrodes become equal, making it possible to obtain a uniform display image.
なお、各走査信号線への走査信号の印加時間を均一にす
るために、走査信号の印加開始のタイミングも、この終
了のタイミングに合わせてシフトするようにしてもよい
。また、３本以上の走査信号線に同時に走査信号を印加
するような場合にも、隣接する２本ずつの走査信号線間
で順に走査信号の印加終了のタイミングをずらすことに
より、同様に実施可能である。Note that in order to equalize the application time of the scanning signal to each scanning signal line, the timing at which the application of the scanning signal starts may also be shifted in accordance with the timing at which the application of the scanning signal ends. Furthermore, even when applying scanning signals to three or more scanning signal lines at the same time, the same method can be implemented by sequentially shifting the timing at which the application of scanning signals ends between two adjacent scanning signal lines. It is.
（実施例） 本発明を実施例について以下に説明する。(Example) The invention will now be described with reference to examples.
第２図乃至第６図は本発明の一実施例を示すものであっ
て、第２図は液晶表示装置のブロック図、第３図は走査
信号線駆動回路のブロック図、第４図は走査信号線駆動
回路の動作を示すタイムチャート、第５図は液晶表示装
置における奇数フィールド走査時の動作を示すタイムチ
ャート、第６図は液晶表示装置における偶数フィールド
走査時の動作を示すタイムチャートである。なお、第７
図乃至第９図に示した従来例と同様の機能を有する構成
要素には同じ符号を付する。2 to 6 show an embodiment of the present invention, in which FIG. 2 is a block diagram of a liquid crystal display device, FIG. 3 is a block diagram of a scanning signal line drive circuit, and FIG. 4 is a block diagram of a scanning signal line drive circuit. FIG. 5 is a time chart showing the operation of the signal line drive circuit; FIG. 5 is a time chart showing the operation during odd field scanning in a liquid crystal display device; FIG. 6 is a time chart showing the operation during even field scanning in the liquid crystal display device. . In addition, the seventh
Components having the same functions as those of the conventional example shown in FIGS. 9 to 9 are denoted by the same reference numerals.
本実施例は、ＮＴＳＣ方式のカラーテレビジョンの画像
を液晶パネルに表示するための液晶表示装置である。This embodiment is a liquid crystal display device for displaying an NTSC color television image on a liquid crystal panel.
液晶表示装置における液晶パネル１のＴＰＴアクティブ
マトリクス基板は、前記第７図に示すように、基板上に
多数の画素電極１２と走査信号線１３とデータ信号線１
４とＴＦＴ１５とを形成したものである。そして、各画
素電極１２は、第１図に示すように、ＴＦＴ１５のソー
ス−ドレイン端子間を介して隣接するデータ信号線１４
に接続されている。また、この各ＴＦＴ１５は、ゲート
端子が隣接する走査信号線１３に接続され、この走査信
号線１３に高レベル電圧の走査信号が印加されると、ソ
ース−ドレイン端子間を導通するようになっている。As shown in FIG. 7, the TPT active matrix substrate of the liquid crystal panel 1 in the liquid crystal display device has a large number of pixel electrodes 12, scanning signal lines 13, and data signal lines 1 on the substrate.
4 and a TFT 15. As shown in FIG.
It is connected to the. Further, each TFT 15 has a gate terminal connected to an adjacent scanning signal line 13, and when a high-level voltage scanning signal is applied to this scanning signal line 13, conduction is established between the source and drain terminals. There is.
上記液晶パネル１のＴＰＴアクティブマトリクス基板は
、第２図に示すように、各走査信号線１３が１本おきの
偶数木目と奇数本目とを左右に振り分けて引き出されて
いる。そして、この奇数本目の各走査信号線１３は、走
査信号線駆動回路２に接続され、偶数木目の各走査信号
線１３は、走査信号線駆動回路３に接続されている。こ
れらの走査信号線駆動回路２．３は、第３図に示すよう
に、クロック信号に従ってスタート信号を順次シフトさ
せるシフトレジスタ回路２ａ、３ａと、このシフトレジ
スタ回路２ａ、３ａの出力をＴＦＴ１５の駆動に必要な
レベルに引き上げるレベルシフタ回路２ｂ、３ｔ＋と、
このレベルシフタ回路２ｂ、３ｂの出力を保持し各走査
信号線１３に出力する出力バッファ２ｃ、３ｃからなる
。また、この走査信号線駆動回路２．３のシフトレジス
タ回路２ａｓ３ａには、第２図に示すように、タイミン
グ制御回路４からそれぞれ走査信号の基礎となるスター
ト信号と水平走査期間周期のクロック信号が入力される
ようになっている。従って、これらの走査信号線駆動回
路２．３に接続された各走査信号線１３には、第４図に
示すように、スタート信号を順次シフトさせた走査信号
が水平走査期間ずつ遅れて出力されることになる。なお
、この場合、各走査信号は、先のクロック信号の立ち下
かりに同期して印加が開始され、後のクロック信号の立
ち上がりに同期して印加が終了する。As shown in FIG. 2, in the TPT active matrix substrate of the liquid crystal panel 1, each scanning signal line 13 is drawn out so that every other even-numbered line and odd-numbered line are distributed to the left and right. Each of the odd-numbered scanning signal lines 13 is connected to the scanning signal line driving circuit 2, and each of the even-numbered scanning signal lines 13 is connected to the scanning signal line driving circuit 3. These scanning signal line drive circuits 2.3, as shown in FIG. level shifter circuits 2b and 3t+ that raise the level to the level required for
It consists of output buffers 2c and 3c that hold the outputs of the level shifter circuits 2b and 3b and output them to each scanning signal line 13. Further, as shown in FIG. 2, the shift register circuit 2as3a of the scanning signal line drive circuit 2.3 receives a start signal and a clock signal of the horizontal scanning period, which are the basis of the scanning signal, from the timing control circuit 4. It is now entered. Therefore, as shown in FIG. 4, scanning signals obtained by sequentially shifting the start signal are output to each scanning signal line 13 connected to these scanning signal line drive circuits 2.3 with a delay of one horizontal scanning period. That will happen. In this case, application of each scanning signal is started in synchronization with the falling edge of the previous clock signal, and application is finished in synchronization with the rising edge of the subsequent clock signal.
上記タイミング制御回路４は、映像信号から分離した同
期信号に基づいてスタート信号とクロック信号とを出力
するようになっている。即ち、スタート信号については
、垂直同期信号に同期して、奇数フィールドの走査時に
は走査信号線駆動回路２．３に同時に出力し、偶数フィ
ールドの走査時には走査信号線駆動回路３へのスタート
信号を走査信号線駆動回路２よりも１水平走査期間だけ
遅らせて出力する。また、クロック信号は、奇数フィー
ルドの走査時に走査信号線駆動回路２よりも走査信号線
駆動回路３側の位相を僅かに進ませ、偶数フィールドの
走査時に走査信号線駆動回路２よりも走査信号線駆動回
路３側の位相を僅かに遅らせて出力するようになってい
る。The timing control circuit 4 is configured to output a start signal and a clock signal based on a synchronization signal separated from the video signal. That is, in synchronization with the vertical synchronizing signal, the start signal is simultaneously output to the scanning signal line drive circuit 2.3 when scanning an odd field, and the start signal is output to the scanning signal line drive circuit 3 when scanning an even field. The output is delayed by one horizontal scanning period from the signal line drive circuit 2. Further, the clock signal slightly advances the phase of the scanning signal line driving circuit 3 side than the scanning signal line driving circuit 2 when scanning an odd field, and slightly advances the phase of the scanning signal line driving circuit 3 side than the scanning signal line driving circuit 2 side when scanning an even field. The phase of the drive circuit 3 side is slightly delayed and outputted.
上記構成の液晶表示装置の動作を第５図及び第６図に基
づいて説明する。The operation of the liquid crystal display device having the above structure will be explained based on FIGS. 5 and 6.
インターレース方式により奇数フィールドの走査が行わ
れる場合には、タイミング制御回路４からのスタート信
号が走査信号線駆動回路２．３に同時に出力されるので
、まず１本目と２本目の走査信号線１３に同時に走査信
号が印加され、次に水平走査期間だけ遅れて３本目と４
本目の走査信号線１３に同時に走査信号が印加され、以
降同様に奇数本目とこれに続く偶数木目との２本の走査
信号線１３に順次走査信号が印加されることになる。ま
た、偶数フィールドの走査が行われる場合には、タイミ
ング制御回路４から走査信号線駆動回路２に先にスター
ト信号が出力され、走査信号線駆動回路３にはｌ水平走
査期間だけ遅れてスタート信号が出力される。このため
、まず１本目の走査信号線１３に走査信号が印加される
と、次に水平走査期間だけ遅れて２本目と３本目の走査
信号線１３に同時に走査信号が印加され、以降偶数木目
とこれに続く奇数本目との２本の走査信号線１３に順次
走査信号が印加されることになる。この結果、液晶パネ
ル１の各画素は、奇数フィールドで奇数本目とこれに続
く偶数木目の走査線の表示が行われ、偶数フィールドで
は偶数木目とこれに続く奇数本目の走査線の表示が行わ
れることになり、これによってインターレース方式に準
じた２本同時走査方式による高解像度の画像を表示する
ことができるようになる。When odd-numbered fields are scanned using the interlace method, the start signal from the timing control circuit 4 is simultaneously output to the scanning signal line drive circuit 2.3, so first the first and second scanning signal lines 13 are A scanning signal is applied at the same time, and then the third and fourth signals are applied with a delay of the horizontal scanning period.
A scanning signal is simultaneously applied to the main scanning signal line 13, and subsequently a scanning signal is sequentially applied to the two scanning signal lines 13 of the odd-numbered line and the even-numbered line that follows it. When scanning an even field, the timing control circuit 4 outputs a start signal to the scanning signal line drive circuit 2 first, and the start signal is output to the scanning signal line drive circuit 3 after l horizontal scanning period. is output. Therefore, first, when a scanning signal is applied to the first scanning signal line 13, scanning signals are applied to the second and third scanning signal lines 13 at the same time with a delay of the horizontal scanning period, and from then on, even-numbered wood grains and Scanning signals are sequentially applied to the following two odd-numbered scanning signal lines 13. As a result, each pixel on the liquid crystal panel 1 displays an odd-numbered scan line and the following even-numbered grain in an odd-numbered field, and displays an even-numbered grain and the following odd-numbered scanning line in an even field. This makes it possible to display high-resolution images using a two-line simultaneous scanning method similar to the interlaced method.
また、上記奇数フィールドにおいては、タイミング制御
回路４が走査信号線駆動回路３へのクロック信号の位相
を僅かに進めるために、同時に印加される走査信号は、
実際には、奇数本目の走査信号線１３よりも偶数木目の
走査信号線１３の方が僅かに早く印加を開始し、印加終
了時期も早くなる。従って、この奇数フィールドの走査
においては、第１図に示した走査信号線１３ａが奇数本
目の走査信号線１３に対応し、走査信号線１３ｂが偶数
木目の走査信号線１３対応することになる。In addition, in the odd field, the timing control circuit 4 slightly advances the phase of the clock signal to the scanning signal line drive circuit 3, so that the scanning signals applied at the same time are
In reality, the even-numbered scanning signal lines 13 start application slightly earlier than the odd-numbered scanning signal lines 13, and the application ends earlier. Therefore, in scanning this odd field, the scanning signal line 13a shown in FIG. 1 corresponds to the odd-numbered scanning signal line 13, and the scanning signal line 13b corresponds to the even-numbered scanning signal line 13.
このため、先に走査信号の印加が終了する偶数木目の走
査信号線１３（１３ｂ）に接続された画素電極１２（１
２ｆｉ）に保持される電位は、隣接する接続されない走
査信号線１３（１３Ｃ）の電位が変化しないことから、
データ信号の電位より前記式（４）で示した低下電位Δ
■だけ低い値となる。そして、これより遅れて走査信号
の印加が終了する奇数本目の走査信号線１３（１３ａ）
に接続された画素電極１２（１２ａ）に保持される電位
も、隣接する接続されない先の走査信号線１３（１３ｂ
）が既に電位を変化し終えているため、上記と同じ低下
電位ΔＶだけ低い値となる。Therefore, the pixel electrode 12 (1
2fi) because the potential of the adjacent unconnected scanning signal line 13 (13C) does not change.
From the potential of the data signal, the decreased potential Δ shown in the above formula (4)
The value is lower by ■. Then, the odd-numbered scanning signal line 13 (13a) ends the application of the scanning signal later than this.
The potential held in the pixel electrode 12 (12a) connected to the adjacent scanning signal line 13 (13b)
) has already finished changing its potential, the value becomes lower by the same lowered potential ΔV as above.
さらに、上記偶数フィールドにおいては、タイミング制
御回路４が走査信号線駆動回路３へのクロック信号の位
相を僅かに遅らせるために、同時に印加される走査信号
は、実際には、偶数木目の走査信号線１３よりも奇数本
目の走査信号線１３の方が僅かに早く印加を開始し、印
加終了時期も早くなる。従って、この偶数フィールドの
走査においては、第１図に示した走査信号線１３ａが偶
数木目の走査信号線１３に対応し、走査信号線１３ｂが
奇数本目の走査信号線１３に対応することになる。この
ため、先に走査信号の印加が終了する奇数本目の走査信
号線１３（１３ｂ）に接続された画素電極１２（１２ｂ
）に保持される電位は、隣接する接続されない走査信号
線１３（１３Ｃ）の電位が変化しないことから、データ
信号の電位より上記と同じ低下電位△■だけ低い値とな
る。Furthermore, in the even field, the timing control circuit 4 slightly delays the phase of the clock signal to the scanning signal line drive circuit 3, so that the simultaneously applied scanning signals are actually applied to the even-numbered scanning signal lines. The odd-numbered scanning signal lines 13 start applying the voltage slightly earlier than the scanning signal lines 13, and the application ends earlier. Therefore, in scanning this even field, the scanning signal line 13a shown in FIG. 1 corresponds to the even-numbered scanning signal line 13, and the scanning signal line 13b corresponds to the odd-numbered scanning signal line 13. . Therefore, the pixel electrode 12 (12b) connected to the odd-numbered scanning signal line 13 (13b) to which the application of the scanning signal ends first
) is a value lower than the potential of the data signal by the same reduced potential Δ■ as described above, since the potential of the adjacent unconnected scanning signal line 13 (13C) does not change.
そして、これより遅れて走査信号の印加が終了する偶数
木目の走査信号線１３ （１３ａ）に接続された画素電
極１２（１２ａ）に保持される電位も、隣接する接続さ
れない先の走査信号線１３（１３ｂ）が既に電位を変化
し終えているため、上記と同じ低下電位ΔＶだけ低い値
となる。Then, the potential held in the pixel electrode 12 (12a) connected to the even-grained scanning signal line 13 (13a) to which the application of the scanning signal ends later than this also applies to the adjacent unconnected scanning signal line 13 (13a). (13b) has already finished changing its potential, so it becomes a lower value by the same reduced potential ΔV as above.
以上の結果、本実施例の液晶表示装置によれば、インタ
ーレース方式に準じた２本同時走査方式によって２本の
走査信号線１３に同時に走査信号を印加した場合にも、
この走査信号の印加終了時における条件が各走査線ごと
に同一となり、各画素電極１２が保持する電位が等しく
なるので、均一な表示画面を得ることができる。As a result of the above, according to the liquid crystal display device of this embodiment, even when scanning signals are simultaneously applied to two scanning signal lines 13 using a two-line simultaneous scanning method similar to an interlace method,
The conditions at the end of application of the scanning signal are the same for each scanning line, and the potential held by each pixel electrode 12 is equal, so that a uniform display screen can be obtained.
（発明の効果）
以上の説明から明らかなように、本発明の液晶表示装置
によれば、隣接する複数の走査信号線に同時に走査信号
を印加した場合にも、これらの走査信号の印加終了時に
おける電位低下を同じものとすることができるので、各
画素電極が保持する電位が等しくなり均一な表示画像を
得ることができるようになる。(Effects of the Invention) As is clear from the above description, according to the liquid crystal display device of the present invention, even when scanning signals are simultaneously applied to a plurality of adjacent scanning signal lines, when the application of these scanning signals ends, Since the potential drop in the pixel electrodes can be made the same, the potential held by each pixel electrode becomes equal, and a uniform display image can be obtained.
４、 の。単な説■
第１図は本発明の詳細な説明するためのアクティブマト
リクス基板上の回路図、第２図乃至第６図は本発明の一
実施例を示すものであって、第２図は液晶表示装置のブ
ロック図、第３図は走査信号線駆動回路のブロック図、
第４図は走査信号線駆動回路の動作を示すタイムチャー
ト、第５図は液晶表示装置における奇数フィールド走査
時の動作を示すタイムチャート、第６図は液晶表示装置
における偶数フィールド走査時の動作を示すタイムチャ
ート、第７図乃至第９図は従来例を示すものであって、
第７図はＴＰＴアクティブマトリクス基板の部分拡大平
面図、第８図は２本同時走査方式の動作を説明するため
のタイムチャート、第９図はアクティブマトリクス基板
上の回路図である。4. of. Mere Explanation - Fig. 1 is a circuit diagram on an active matrix board for explaining the present invention in detail, and Figs. 2 to 6 show an embodiment of the present invention. A block diagram of the liquid crystal display device, Figure 3 is a block diagram of the scanning signal line drive circuit,
Figure 4 is a time chart showing the operation of the scanning signal line drive circuit, Figure 5 is a time chart showing the operation during odd field scanning in a liquid crystal display device, and Figure 6 is a time chart showing the operation in even field scanning in a liquid crystal display device. The time charts shown in FIGS. 7 to 9 show conventional examples,
FIG. 7 is a partially enlarged plan view of the TPT active matrix substrate, FIG. 8 is a time chart for explaining the operation of the two-line simultaneous scanning method, and FIG. 9 is a circuit diagram on the active matrix substrate.
１・・・液晶パネル、２．３・・・走査信号線駆動回路
、４・・・タイミング制御回路、１２・・・画素電極、
１３・・・走査信号線、１４・・・データ信号線、１５
・・・ＴＰＴ（スイッチング素子）。DESCRIPTION OF SYMBOLS 1...Liquid crystal panel, 2.3...Scanning signal line drive circuit, 4...Timing control circuit, 12...Pixel electrode,
13...Scanning signal line, 14...Data signal line, 15
...TPT (switching element).
以 上that's all
Claims (1)
ッチング素子を介して画素電極がデータ信号線に接続さ
れた液晶パネルを備え、隣接する複数本の走査信号線に
同時に走査信号を印加する走査信号線駆動回路が設けら
れたアクティブマトリクス方式の液晶表示装置であって
、 走査信号が同時に印加される隣接した２本の走査信号線
について、これらの走査信号線にそれぞれスイッチング
素子を介して接続された２列の画素電極の間に位置する
走査信号線の側に印加した走査信号を他方の走査信号線
に印加した走査信号よりも早いタイミングで印加を終了
させる走査信号タイミング制御回路を備えている液晶表
示装置。[Claims] 1. A liquid crystal panel having a pixel electrode connected to a data signal line through a switching element whose switching is controlled by a scanning signal line, and scanning signals simultaneously applied to a plurality of adjacent scanning signal lines. This is an active matrix type liquid crystal display device equipped with a scanning signal line drive circuit for applying scanning signals, and for two adjacent scanning signal lines to which scanning signals are simultaneously applied, a switching element is connected to each of these scanning signal lines. a scanning signal timing control circuit that terminates application of a scanning signal applied to a scanning signal line located between two rows of pixel electrodes connected to each other at a timing earlier than that of a scanning signal applied to the other scanning signal line; Equipped with a liquid crystal display device.
Priority Applications (5)
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| JP2264578A JP2625248B2 (en) | 1990-10-01 | 1990-10-01 | Liquid crystal display |
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Applications Claiming Priority (1)
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Publications (2)
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|---|---|
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Family
ID=17405237
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
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| Country | Link |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000163015A (en) * | 1998-11-25 | 2000-06-16 | Lucent Technol Inc | Display device with systematic smart pixel |
| JP2005003988A (en) * | 2003-06-12 | 2005-01-06 | Seiko Epson Corp | Electrooptical device and electronic apparatus |
| US7034795B2 (en) | 2001-08-07 | 2006-04-25 | Sharp Kabushiki Kaisha | Matrix image display device |
| CN105679225A (en) * | 2014-12-04 | 2016-06-15 | 三星显示有限公司 | Method of driving display panel and display apparatus for performing same |
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|---|---|---|---|---|
| US20130314618A1 (en) * | 2011-02-08 | 2013-11-28 | Sharp Kabushiki Kaisha | Method of driving display device, driving device of display device, and television device |
-
1990
- 1990-10-01 JP JP2264578A patent/JP2625248B2/en not_active Expired - Lifetime
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|---|---|
| JP2625248B2 (en) | 1997-07-02 |
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