JPH0374061U - - Google Patents
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- Publication number
- JPH0374061U JPH0374061U JP13485989U JP13485989U JPH0374061U JP H0374061 U JPH0374061 U JP H0374061U JP 13485989 U JP13485989 U JP 13485989U JP 13485989 U JP13485989 U JP 13485989U JP H0374061 U JPH0374061 U JP H0374061U
- Authority
- JP
- Japan
- Prior art keywords
- data
- counter
- adder
- input
- bit
- Prior art date
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- Pending
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- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Complex Calculations (AREA)
- Processing Of Color Television Signals (AREA)
Description
第1図はこの考案の一実施例の回路構成を示す
ブロツク図、第2図は従来の演算回路の構成を示
すブロツク図である。 11,21……第1のラツチ回路、12,22
……加算器、13,23……第2のラツチ回路、
14……除算器、24……アンド回路、25……
第1のカウンタ、26……第2のカウンタ、27
……第3のラツチ回路。
ブロツク図、第2図は従来の演算回路の構成を示
すブロツク図である。 11,21……第1のラツチ回路、12,22
……加算器、13,23……第2のラツチ回路、
14……除算器、24……アンド回路、25……
第1のカウンタ、26……第2のカウンタ、27
……第3のラツチ回路。
Claims (1)
- 【実用新案登録請求の範囲】 mビツトの入力データをラツチする第1のラツ
チ回路と、 この第1のラツチ回路の出力を第1の入力とし
、第2の入力と加算してmビツトの和データを出
力すると共に、桁上り信号を出力する加算器と、 この加算器の出力する和データをラツチすると
共に該ラツチデータを上記加算器の第2の入力と
して出力する第2のラツチ回路と、 上記加算器の出力する桁上り信号をカウントす
るnビツト(n〉m)の第1のカウンタと、 最上位ビツトデータによつて上記第1のカウン
タをリセツトするnビツトの第2のカウンタと、 その第2のカウンタの最上位ビツトデータによ
つて上記第1のカウンタの上位mビツトをラツチ
して出力する第3のラツチ回路と を具備したことを特徴とする演算回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13485989U JPH0374061U (ja) | 1989-11-22 | 1989-11-22 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13485989U JPH0374061U (ja) | 1989-11-22 | 1989-11-22 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0374061U true JPH0374061U (ja) | 1991-07-25 |
Family
ID=31682163
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP13485989U Pending JPH0374061U (ja) | 1989-11-22 | 1989-11-22 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0374061U (ja) |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6016248B2 (ja) * | 1978-12-26 | 1985-04-24 | サイモン・ララツク | 心エコ−図診断装置 |
JPS62241028A (ja) * | 1986-04-11 | 1987-10-21 | Nec Corp | 加算装置 |
JPS63259767A (ja) * | 1987-04-17 | 1988-10-26 | Canon Electronics Inc | 平均値回路 |
-
1989
- 1989-11-22 JP JP13485989U patent/JPH0374061U/ja active Pending
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6016248B2 (ja) * | 1978-12-26 | 1985-04-24 | サイモン・ララツク | 心エコ−図診断装置 |
JPS62241028A (ja) * | 1986-04-11 | 1987-10-21 | Nec Corp | 加算装置 |
JPS63259767A (ja) * | 1987-04-17 | 1988-10-26 | Canon Electronics Inc | 平均値回路 |
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