JPH0358150A - メモリ制御装置 - Google Patents

メモリ制御装置

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Publication number
JPH0358150A
JPH0358150A JP19361189A JP19361189A JPH0358150A JP H0358150 A JPH0358150 A JP H0358150A JP 19361189 A JP19361189 A JP 19361189A JP 19361189 A JP19361189 A JP 19361189A JP H0358150 A JPH0358150 A JP H0358150A
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JP
Japan
Prior art keywords
request
request information
bank
access
storage means
Prior art date
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Pending
Application number
JP19361189A
Other languages
English (en)
Inventor
Isao Hasegawa
功 長谷川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP19361189A priority Critical patent/JPH0358150A/ja
Publication of JPH0358150A publication Critical patent/JPH0358150A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 技術分野 本発明はメモリ制御装置に関し、特に複数のバンクを有
する記憶手段と、リクエスト情報に応じて前記記憶手段
の各バンクに対してアクセスをするアクセス手段とを含
むメモリ制御装置に関する。
従来技術 従来、この種のメモリ制御装置は、アクセスすべきバン
ク情報を含むリクエスト情報がセットされ、そのバンク
情報が順次シフトされて行く複数のレジスタと、そのバ
ンクの状態を表示する表示手段と、この表示手段からの
バンク情報情報と各レジスタの内容とから各レジスタ内
のリクエスト情報によるアクセスが可能かどうかを11
1定する手段とを有していた。そして、各レジスタ内の
リクエスト情報によるアクセスに競合が生じた場合、よ
り後段位置にあるレジスタ内のリクエスト情報によるア
クセスを優先するという方式の制御が行われていた。
しかし、上述した従来のメモリ制1卸装置における制御
方式では、複数のレジスタに格納されたリクエストin
報によるアクセス要求の夫々に対して同時にバンク状態
表示手段を基にアクセスの可否をfl+定しなければな
らなかった。また、複数のアクセス要求についてアクセ
ス可能と判定された場合には、競合処理が必要となるた
め、ハードウェア量が大きくなるとともに制御が複雑と
なり、制御信号のディレイタイムも大きくなるという欠
点があった。
発明の目的 本発明は上述した従来の欠点を解決するためになされた
ものであり、アクセスを効率良く行うことができるメモ
リ制御装置の提供を目的とする。
発明の構或 本発明によるメモリ制御装置は、曖数のバンクを有する
記憶手段と、リクエスト情報に応じて前記記憶手段の各
バンクに対してアクセスをするアクセス手段とを含むメ
モリ制御装置であって、前記記憶手段の複数のバンクの
夫々がビジー状態であるか否かを示すバンク状態表示手
段と、外部からのリクエスト情報を受付けるリクエスト
受付け手段と、前記リクエスト受付け手段からのリクエ
スト情報に応じてアクセスしようとするバンクがビジー
状態である旨を前記バンク状態表示手段が示したとき、
該リクエスト情報を格納する格納手段と、前記リクエス
ト受付け手段又は前記格納手段からのリクエスト情報を
前記バンク状態表示手段の表示情報に応じて択一的に前
記アクセス手段に送出する手段とを有することを特徴と
する。
実施例 以下、図面を用いて本発明の実施例を説明する。
第l図は本発明によるメモリ制御装置の一実施例の構成
を示すブロック図である。図において、本発明の一実施
例によるメモリ制御装置は、演算処理装置や入出力処理
装置等を含む図示せぬ処理装置と接続されており、複数
のバンクから構成される主記憶装置100を有している
。なお、図中においては各制御線は省略されている。
20はリクエスト受付手段であり、処理装置からのリク
エスト情報を受付けるものである。ここで、処理装置、
すなわち要求元からのリクエスト情報とはリクエストア
ドレス、書込み、読出しなどの動作指定を示すリクエス
トコード、ストアデータ等をさす。
30は選択手段であり、リクエスト受付け手段20から
送出されるリクエスト情報とリクエスト格納手段60か
ら送出されるリクエスト情報とのどちらか一方を後述す
る方法に応じて選択して出力するものである。
50は判定手段であり、バンク状態表示手段80の内容
に基づき、選択手段30から送出されるリクエスト情報
にかかる主記憶装置のバンクがアクセス可能か否かを判
定するものである。この判定手段50によって主記憶装
置内のバンクへのアクセスが不可能と判定されたリクエ
スト情報はリクエスト格納手段60側に送出されて格納
される。
これに対し、主記憶装置内のバンクへのアクセスが可能
と判定されたリクエスト情報は主記憶アクセス手段90
側に送出される。
60はリクエスト格納手段であり、”I’l+定手段5
0の出力を格納してそのリクエスト情報の処理を後回し
にするために設けられている。その出力は選択手段30
に入力させる。
80はバンク状態表示手段であり、主記憶装置100の
各バンクの夫々に対応するフリップフロップ(F/F)
を有し、主記憶装置l00の各バンクに対するアクセス
が可能かどうかを示すものである。例えば、F/Fがセ
ット状態になっているとき、そのF/Fに対応するバン
クはビジー状態、すなわちアクセス不可能を示す等と予
め規定されているものとする。
90は主記憶アクセス手段であり、判定手段50から送
出されるリクエスト情報を受付け、主記憶装置100に
対するアクセス要求を生成し、主記憶装置l00に出力
するものである。さらに、この主記憶アクセス手段90
はそのアクセス要求に対する主記憶装置lOOからのり
プライデー夕を受取り、リプライデータ格納手段110
に送出する。
100は主記憶装置であり、主記憶アクセス手段90か
ら送出されるアクセス要求を受付けこれに対するリブラ
イデータを主記憶アクセス手段90に送出するものであ
る。
110はリブライデータ格納手段であり、リクエストに
対する主記憶装置からのりプライデー夕を格納し、図示
せぬ処理装置へ送出するものである。
かかる構威において、選択手段30は通常、リクエスト
受付手段20内にリクエスト情報があるときにはリクエ
スト受付手段20から送出されるリクエスト情報を選択
し、リクエスト受付け手段20内にリクエスト情報がな
いときには、リクエスト格納手段60から送出されるリ
クエスト情報を選択する。しかし、リクエスト格納手段
60内がリクエスト情報で一杯になっているときには、
リクエスト受付け手段20内のリクエスト情報の有無に
かかわらず、リクエスト格納手段60から送出されるリ
クエスト情報を選択する。なお、リクエスト格納手段6
0の保持容量は図示せぬ処理装置からのリクエスト発生
頻度、さらには主記憶装置のアクセスタイム、バンク数
等をもとに決定すれば良い。
次に、本実施例のメモリ制御装置の動作について第2図
を用いて説明する。第2図は第1図の動作を示すフロー
チャートである。
まず最初に、リクエスト格納手段6o内のリクエスト情
報は一杯か否かを判断する(ステップ1)一杯でなけれ
ば続いてリクエスト受付け手段20内にリクエスト情報
があるか否かを111断する(ステップ2)。
リクエスト受付け手段2o内にリクエスト情報があれば
、選択手段30によってリクエスト受付け手段20から
のリクエスト情報を選択する(ステップ2→3)。さら
に、そのリクエスト情報にかかるバンクはリクエスト可
か否か、すなわちビジー状態か否かをバンク状態表示手
段8oの内容に基づいて↑り断ずる。そして、ビジー状
態でなければそのバンクへのアクセスを実行し(ステッ
プ4→5)、ビジー状態であればそのリクエスト情報を
リクエスト格納手段60に格納する(ステップ4→8)
一方、リクエスト受付け手段20内にリクエスト情報が
なければ、今度はリクエスト格納手段60内にリクエス
ト情報があるか否かを刊断する(ステップ2→6)。
リクエスト格納手段6o内にリクエスト情報があれば、
選択手段によってリクエスト格納手段60からのリクエ
スト情報を選択する(ステップ6→7)。さらに、その
リクエスト情報にかかるバンクはビジー状態か否かを判
断し、以下は上述と同様の処理を行う。(ステップ7−
4−・・・)。
トコろで、リクエスト格納手段6o内のリクエスト情報
が一杯であった場合には、リクエスト受付け手段20内
のリクエスト情報の有無にかかわらず、選択手段30に
よってリクエスト格納手段60からのリクエスト情報を
選択し、以下同様の処理を行う(ステップ1→7→4→
・・・)。
つまり、本実施例ではバンク状態表示手段によって示さ
れるビジー状態か否かについての情報をもとにアクセス
又はリクエスト情報の後回しを行っているので結果とし
てアクセスを効率良《行うことができることになるので
ある。また、ハードウエア量も増加せず、制御も複雑に
ならないとともに制御信号のディレイタイムも増加しな
いのである。
発明の効果 以上説明したように、本発明によればハードウエア量の
増加、制御の複雑化、ディレイタイムの増加を招くこと
なく、バンクの状態に応じてアクセスする順序を前後さ
せることにより、主記憶装置へのアクセスの効率を高め
、高速アクセスを可能にすることができるという効果が
ある。
【図面の簡単な説明】
第1図は本発明の実施例によるメモリ制御装置の構成を
示すブロック図、第2図は第1図の動作を示すフローチ
ャートである。 主要部分の符号の説明 20・・・・・・リクエスト受付け手段60・・・・・
・リクエスト格納手段 3o・・・・・・遭択手段80
・・・・・・バンク状態表示手段 5o・・・・・・’
f’l+定手段出廓人 日本電気株式会社

Claims (1)

    【特許請求の範囲】
  1. (1)複数のバンクを有する記憶手段と、リクエスト情
    報に応じて前記記憶手段の各バンクに対してアクセスを
    するアクセス手段とを含むメモリ制御装置であって、前
    記記憶手段の複数のバンクの夫々がビジー状態であるか
    否かを示すバンク状態表示手段と、外部からのリクエス
    ト情報を受付けるリクエスト受付け手段と、前記リクエ
    スト受付け手段からのリクエスト情報に応じてアクセス
    しようとするバンクがビジー状態である旨を前記バンク
    状態表示手段が示したとき、該リクエスト情報を格納す
    る格納手段と、前記リクエスト受付け手段又は前記格納
    手段からのリクエスト情報を前記バンク状態表示手段の
    表示情報に応じて択一的に前記アクセス手段に送出する
    手段とを有することを特徴とするメモリ制御装置。
JP19361189A 1989-07-26 1989-07-26 メモリ制御装置 Pending JPH0358150A (ja)

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JP (1) JPH0358150A (ja)

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