JPH0331564Y2 - - Google Patents

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JPH0331564Y2
JPH0331564Y2 JP7241580U JP7241580U JPH0331564Y2 JP H0331564 Y2 JPH0331564 Y2 JP H0331564Y2 JP 7241580 U JP7241580 U JP 7241580U JP 7241580 U JP7241580 U JP 7241580U JP H0331564 Y2 JPH0331564 Y2 JP H0331564Y2
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shift register
thermal head
heating elements
group
drive circuit
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Description

【考案の詳細な説明】 本考案はサーマルヘツドの駆動回路さらに詳し
くはサーマルヘツド高速駆動回路に関するもので
ある。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a thermal head driving circuit, and more particularly to a thermal head high speed driving circuit.

一般に複数個の発熱素子たとえば1280個のドツ
ト発熱素子を一列に配列しこれらのドツト発熱素
子を選択的に発熱させることによつて記録紙に書
込みを行ない、ついでドツト発熱素子と前記記録
紙との相対位置をずらせて同様に記録紙に書込み
を行ない、かくしてデータを記録紙に書込むサー
マルヘツドは従来サーマルプリンタ方式の1つと
して広く採用されている。かゝる従来のサーマル
プリンタ方式においては1280個のごとく多数一列
に配列されたドツト発熱素子を数個のブロツクに
分割して各ブロツクごとにそれに属するドツト発
熱素子を選択的に発熱していた。しかしかゝる従
来のサーマルヘツドの駆動回路はドツト発熱素子
をブロツクに分割していたため処理すべきデータ
もそのブロツク毎にしか処理できずかえつてサー
マルヘツドの発熱のために長時間を必要とした。
さらにシフトレジスタを有するサーマルヘツドに
おいてはデータ入力が1箇所であるためにすべて
のドツトを入力するまでサーマルヘツドを駆動す
ることができずデータ入力においても時間がかゝ
つていた。
In general, writing is performed on recording paper by arranging a plurality of heating elements, for example 1280 dot heating elements, in a line and selectively generating heat from these dot heating elements, and then by connecting the dot heating elements and the recording paper. Thermal heads, which similarly write data on recording paper by shifting their relative positions, have been widely used as one of the conventional thermal printer systems. In such a conventional thermal printer system, a large number of 1280 dot heating elements arranged in a line are divided into several blocks, and the dot heating elements belonging to each block selectively generate heat. However, since the conventional thermal head drive circuit divided the dot heating element into blocks, the data to be processed could only be processed for each block, and it took a long time for the thermal head to generate heat. .
Furthermore, in a thermal head having a shift register, data input is only in one place, so the thermal head cannot be driven until all dots have been input, and data input takes time.

本考案の目的はかゝるシフトレジスタを有する
サーマルヘツドを高速にて駆動しうるサーマルヘ
ツドの駆動回路を提供することにある。
An object of the present invention is to provide a thermal head drive circuit that can drive a thermal head having such a shift register at high speed.

本考案によれば一列に配置した複数個の発熱素
子と、該発熱素子のそれぞれに対応したシフトレ
ジスタとを具備し、該シフトレジスタに入力され
たデータに基づいて、該発熱素子を発熱させて記
録を行なうサーマルヘツド駆動回路において、複
数のブロツクに分割した第2シフトレジスタ群
と、該第2のシフトレジスタ群のそれぞれのレジ
スタに対応して設けられ、且つデータ入力に対し
て直列に接続され、該第2シフトレジスタ群より
高速にて駆動される複数のシフトレジスタより成
る第1シフトレジスタ群と、該第1シフトレジス
タ群の各シフトレジスタ出力を該第2シフトレジ
スタ群の各シフトレジスタに並列に入力させるゲ
ートコントロール信号をあたえるゲート回路群を
設けたことを特徴とするサーマルヘツド駆動回路
が堤案される。
According to the present invention, a plurality of heating elements arranged in a line and a shift register corresponding to each of the heating elements are provided, and the heating element is caused to generate heat based on data input to the shift register. In a thermal head drive circuit that performs recording, there is a second shift register group divided into a plurality of blocks, and a second shift register group provided corresponding to each register of the second shift register group and connected in series to a data input. , a first shift register group consisting of a plurality of shift registers driven at a higher speed than the second shift register group, and an output of each shift register of the first shift register group to each shift register of the second shift register group. A thermal head drive circuit is proposed which is characterized by providing a group of gate circuits to which gate control signals are input in parallel.

以下本考案にかゝるサーマルヘツドの駆動回路
の実施例について図面により詳細に説明する。
Embodiments of the thermal head drive circuit according to the present invention will be described in detail below with reference to the drawings.

第1図に従来のサーマルヘツドの駆動回路の1
例を示す。第1図において入力データはシフトレ
ジスタ1に印加されシフトレジスタ1にデータの
入力が終つた時点でそのデータはサーマルヘツド
ブロツク2の各ドツト発熱素子2a,2b,…2
nに流されて発熱が行なわれその発熱によつて記
録紙に書込みが行なわれている。なおサーマルヘ
ツドブロツク2はそれに共通に接続されるトラン
ジスタ3をストローブパルスによりストローブす
ることにより選択されて書込みが行なわれるもの
である。第1図に示すごとき回路おいてはシフト
レジスタ1は一般にCMOS集積回路により形成
されるが、ドツト発熱素子2a,2b,…,2n
には発熱するために充分な電流を必要とすること
からトランジスタが使用されている。
Figure 1 shows a conventional thermal head drive circuit.
Give an example. In FIG. 1, input data is applied to a shift register 1, and when the input of data to the shift register 1 is completed, the data is transferred to each dot heating element 2a, 2b, . . . 2 of a thermal headblock 2.
Heat is generated by flowing through the n, and writing is performed on the recording paper by the heat generated. The thermal head block 2 is selected and written to by strobing the transistor 3 commonly connected thereto with a strobe pulse. In the circuit shown in FIG. 1, the shift register 1 is generally formed by a CMOS integrated circuit, but the shift register 1 is formed by dot heating elements 2a, 2b, . . . , 2n.
Transistors are used because they require sufficient current to generate heat.

第1図のごとく形成されたサーマルヘツドの駆
動回路は入力データが1ケ所のためすべてのデー
タを入力するまでサーマルヘツドを駆動すること
ができず、さらにドツト発熱素子の発熱に長時間
を要していた。これを解消するための本考案に
かゝるサーマルヘツドの駆動回路を第2図に示
す。
Since the thermal head drive circuit formed as shown in Figure 1 inputs data to only one place, the thermal head cannot be driven until all data is input, and furthermore, it takes a long time for the dot heating elements to generate heat. was. FIG. 2 shows a thermal head drive circuit according to the present invention to solve this problem.

第2図は本考案にかゝるサーマルヘツドの駆動
回路であつて同図に示すごとくサーマルヘツドお
よびシフトレジスタを分割したものであつて、サ
ーマルヘツド11a,11b,…,11nと第1
シフトレジスタ群12のシフトレジスタ12a,
12b,…,12nと第2シフトレジスタ群13
のシフトレジスタ13a,13b,…,13n
と、第1シフトレジスタ群と第2のシフトレジス
タ群との間に接続されたゲート回路14a,14
b,…,14nよりなるゲート回路群14により
構成される。第2図において第1のシフトレジス
タ群のレジスタ12a,12b,…,12nは高
速シフトレジスタであつてそれぞれデータ入力に
対して直列接続されており、その各レジスタ12
a,12b,…,12nの各出力はそれぞれゲー
ト回路14a,14b,…,14nの第1の入力
端子に印加されその第2の入力端子にはゲートコ
ントロール信号すなわちスタート信号が印加され
る。これによりゲート回路14a,14b,…,
14nの出力はそれぞれシフトレジスタ13a,
13b,……,13nの最下位桁から最上位桁に
向けて順次入力される。しかる後ストローブ信号
がトランジスタ15に与えられ各シフトレジスタ
13a,13b,…,13nの出力はそれぞれサ
ーマルヘツド11a,11b,…,11nにそれ
ぞれあたえられ、各ドツト発熱素子2a〜2nを
発熱させ印字する。すなわち印字終予後サーマル
ヘツドの冷却期間中にシフトレジスタ12a〜1
2dを介してシフトレジスタ13a〜13dにデ
ータを予めセツトしておくことになる。
FIG. 2 shows a driving circuit for a thermal head according to the present invention, in which the thermal head and shift register are divided as shown in the figure.
Shift register 12a of shift register group 12,
12b,..., 12n and the second shift register group 13
shift registers 13a, 13b,..., 13n
and gate circuits 14a, 14 connected between the first shift register group and the second shift register group.
It is constituted by a gate circuit group 14 consisting of gate circuits b, . . . , 14n. In FIG. 2, registers 12a, 12b, .
The respective outputs of gate circuits 14a, 14b, . . . , 12n are applied to first input terminals of gate circuits 14a, 14b, . As a result, the gate circuits 14a, 14b,...,
The outputs of 14n are sent to shift registers 13a and 14n, respectively.
13b, . . . , 13n are sequentially input from the least significant digit to the most significant digit. Thereafter, a strobe signal is applied to the transistor 15, and the outputs of the shift registers 13a, 13b, . . . , 13n are applied to the thermal heads 11a, 11b, . . In other words, the shift registers 12a to 12a-1 are
Data is previously set in the shift registers 13a to 13d via the register 2d.

第2図の駆動回路の動作を第3図の波形図によ
り説明する。まずシフトレジスタ12a,12
b,…,12nは高速シフトレジスタを使用して
いるため、入力データ例えば1280ドツトの入力デ
ータは高速たとえば20μS程度の時間内にシフト
レジスタ12a,12b,…,12n内に収容さ
れる。この時間を第3図aにて示す。第2図のご
とくサーマルヘツドを4分割してある場合には
1280ドツトの入力データは各シフトレジスタ12
a,12b,…,12nに320ドツトづゝ収容さ
れる。各第1のシフトレジスタ12a,12b,
…,12nにデータの収容が終ると第3図fに示
すゲートコントロール信号によりそれらの出力は
それぞれゲート回路14a,14b,…,14n
を介して第2のシフトレジスタ群の各シフトレジ
スタ13a,13b,…,13nに並列に送られ
る。シフトレジスタ13a,13b,…,13n
は普通サーマルヘツドのドツト発熱素子に発熱電
流を供給する出力トランジスタであつてて、低速
駆動されることが許容された第3図b,c,d,
eに示すデータは第3図gに示すストローブ信号
によりごく低速例えば4000μs程度の時間内におい
て印字処理される。
The operation of the drive circuit shown in FIG. 2 will be explained with reference to the waveform diagram shown in FIG. First, shift registers 12a, 12
Since high-speed shift registers are used in the shift registers 12a, 12b, . This time is shown in Figure 3a. If the thermal head is divided into four parts as shown in Figure 2,
The input data of 1280 dots is sent to each shift register 12.
320 dots are accommodated in a, 12b, ..., 12n. Each first shift register 12a, 12b,
..., 12n, the outputs of the gate circuits 14a, 14b, ..., 14n are controlled by the gate control signal shown in FIG.
are sent in parallel to each shift register 13a, 13b, . . . , 13n of the second shift register group. Shift registers 13a, 13b,..., 13n
are normally output transistors that supply heating current to the dot heating elements of a thermal head, and are allowed to be driven at low speed.
The data shown in e is printed at a very low speed, for example within about 4000 .mu.s, by the strobe signal shown in FIG. 3g.

以上詳細に説明したように本考案においてはサ
ーマルヘツドをn分割し、分割したサーマルヘツ
ドのドツト発熱素子毎にそのデータを保持するバ
ツフアをシフトレジスタにより構成し、このシフ
トレジスタもサーマルヘツドの分割数nと同じ数
n分割し、このシフトレジスタに対し直列に接続
された高速シフトレジスタ群より並列にデータを
入力させることにより従来のサーマルヘツドの駆
動回路のn倍の高速でデータの書込みを行なうこ
とができるので高速駆動において本考案にかゝる
効果は頗る大である。
As explained in detail above, in the present invention, the thermal head is divided into n parts, and a buffer for holding the data for each dot heating element of the divided thermal head is configured by a shift register, and this shift register is also divided into n parts. Data is written at a speed n times faster than a conventional thermal head drive circuit by dividing the data into n parts, the same number as n, and inputting data in parallel from a group of high-speed shift registers connected in series to this shift register. Therefore, the effect of the present invention is extremely large in high-speed driving.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来のサーマルヘツドの駆動回路の1
例、第2図は本考案にかゝるサーマルヘツドの駆
動回路の1実施例、第3図は第2図の回路の動作
タイムチヤートを示す。 第2図において、11a,11b,…,11n
がサーマルヘツド群、12a,12b,…,12
nが高速シフトレジスタ、13a,13b,…,
13nが低速シフトレジスタである。
Figure 1 shows a conventional thermal head drive circuit.
For example, FIG. 2 shows an embodiment of a thermal head drive circuit according to the present invention, and FIG. 3 shows an operation time chart of the circuit shown in FIG. In FIG. 2, 11a, 11b,..., 11n
are thermal head groups, 12a, 12b,..., 12
n is a high-speed shift register, 13a, 13b,...,
13n is a low-speed shift register.

Claims (1)

【実用新案登録請求の範囲】[Scope of utility model registration request] 一列に配置した複数個の発熱素子と、該発熱素
子のそれぞれに対応したシフトレジスタとを具備
し、該シフトレジスタに入力されたデータに基づ
いて、該発熱素子を発熱させて記録を行なうサー
マルヘツド駆動回路において、複数のブロツクに
分割した第2シフトレジスタ群13と、該第2の
シフトレジスタ群13のそれぞれのレジスタに対
応して設けられ、且つデータ入力に対して直列に
接続され、該第2のシフトレジスタ群13より高
速にて駆動される複数のシフトレジスタより成る
第1シフトレジスタ群12と、該第1シフトレジ
スタ群12の各シフトレジスタ出力を該第2シフ
トレジスタ群13の各シフトレジスタに並列に入
力させるゲートコントロール信号をあたえるゲー
ト回路群14とを設けたことを特徴とするサーマ
ルヘツド駆動回路。
A thermal head that includes a plurality of heating elements arranged in a line and a shift register corresponding to each of the heating elements, and performs recording by causing the heating elements to generate heat based on data input to the shift register. In the drive circuit, a second shift register group 13 divided into a plurality of blocks is provided corresponding to each register of the second shift register group 13, and is connected in series with the data input, and the second shift register group 13 is divided into a plurality of blocks. A first shift register group 12 consisting of a plurality of shift registers driven at a higher speed than the second shift register group 13; 1. A thermal head drive circuit comprising a gate circuit group 14 for applying gate control signals to be input in parallel to a register.
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