JPH03257684A - Microcomputer - Google Patents
MicrocomputerInfo
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- JPH03257684A JPH03257684A JP2057130A JP5713090A JPH03257684A JP H03257684 A JPH03257684 A JP H03257684A JP 2057130 A JP2057130 A JP 2057130A JP 5713090 A JP5713090 A JP 5713090A JP H03257684 A JPH03257684 A JP H03257684A
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- eprom
- data
- cpu
- chip
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Landscapes
- Detection And Correction Of Errors (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
- Test And Diagnosis Of Digital Computers (AREA)
- Microcomputers (AREA)
Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、チップ上にメモリを内蔵したマイクロコンピ
ュータに関するものである。DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a microcomputer with a built-in memory on a chip.
従来の技術
近年、1チップマイクロコンピユータのユーザープログ
ラム開発期間短縮の要望が高まるにつれて、EPROM
内蔵形マイクロコンピュータの需要が高まってきている
。Conventional technology In recent years, as the demand for shortening the user program development period for one-chip microcomputers has increased, EPROM
Demand for built-in microcomputers is increasing.
従来、この種のEPROM内蔵マイクロコンピュータは
第2図に示すような構成であった。第2図において、1
はCPU、2はEPROM、3はデータバス、4はi
/ oボートである。Conventionally, this type of microcomputer with a built-in EPROM has had a configuration as shown in FIG. In Figure 2, 1
is CPU, 2 is EPROM, 3 is data bus, 4 is i
/ It is an o-boat.
以上のように構成されたマイクロコンピュータによって
処理を行う方法を以下、説明する。まずi / 。A method for performing processing using the microcomputer configured as described above will be described below. First of all, i/.
ポート4からデータバス3を通してEPROM2にプロ
グラムを格納する。次にEPROM2からデータバス3
を通してCPUIにプログラムを取り込むことによって
処理を行う。A program is stored in the EPROM 2 from the port 4 through the data bus 3. Next, from EPROM2 to data bus 3
Processing is performed by importing programs into the CPUI through the CPU.
発明が解決しようとする課題
しかしながら上記のような構成では以下に述べるような
問題が生じる。つまり、EPROM2に格納されたデー
タは経時変化を生じる可能性が通常のマスクROMより
も高いが、EPROM内蔵のマイクロコンピュータが誤
動作した場合、その原因がEPROM2のデータの経時
変化によるものであるか否かを判断するためには、EP
ROM2に格納されたデータをチップの外部に出力して
チエツクする必要があった。Problems to be Solved by the Invention However, the above configuration causes the following problems. In other words, the data stored in EPROM2 is more likely to change over time than in a normal mask ROM, but if a microcomputer with a built-in EPROM malfunctions, it is difficult to determine whether the cause is due to changes in the data in EPROM2 over time. In order to determine whether
It was necessary to output the data stored in the ROM 2 to the outside of the chip and check it.
本発明はかかる点に鑑み、EPROMに格納されたデー
タをチップの外部に出力することなくEPROMに格納
されているデータのチエツクを可能にすることを目的と
する。In view of this, an object of the present invention is to make it possible to check the data stored in the EPROM without outputting the data to the outside of the chip.
課題を解決するための手段
この課題を実現するために本発明ではEPROMに格納
されたデータに対してチエツクサムをとる手段を有して
いる。Means for Solving the Problem In order to achieve this object, the present invention has means for taking a checksum of data stored in an EPROM.
作用
この構成により、EPROMに格納されたデータをチッ
プ外部に出力することなくチエツクすることが可能にな
る。Operation: This configuration makes it possible to check the data stored in the EPROM without outputting it to the outside of the chip.
実施例
本発明の一実施例構成を第1図に示す。第1図において
、1はCPU、2はEPROM、3はデータバス、4は
i / oポート、5はチエツクサム用EPROMであ
る。Embodiment FIG. 1 shows the configuration of an embodiment of the present invention. In FIG. 1, 1 is a CPU, 2 is an EPROM, 3 is a data bus, 4 is an I/O port, and 5 is a checksum EPROM.
以上のように構成された本実施例について、以下その動
作を説明する。The operation of this embodiment configured as above will be described below.
まず、EPROM2からデータバス3を通じてCPUI
に順次mワードのデータをとり込み、CPU3でmワー
ドのチエツクサムを計算する。First, from EPROM2 to data bus 3, CPU
m words of data are sequentially taken in, and the CPU 3 calculates a checksum of the m words.
次にチエツクサム用EPROM5から、あらかしめ格納
されていたチエツクサムをデータバス3を通じてCPU
Iに取り込むことにより、CPUIにおいてサムチエツ
クを行う。Next, the previously stored checksum is transferred from the checksum EPROM 5 to the CPU via the data bus 3.
By importing the data into I, a thumb check is performed on the CPUI.
このチエツクの結果に問題がなければ通常の処理を行う
。すなわちEPROM2からデータバス3を通じてCP
UIにプログラムを取り込むことによって処理を行う。If there is no problem with the result of this check, normal processing is performed. That is, from EPROM2 to CP via data bus 3.
Processing is performed by loading the program into the UI.
前記チエツクの結果に問題があった場合は通常の処理を
行わずに、例えばチエツクサムに異常があった旨の情報
をチップ外部に出力する。If there is a problem with the result of the check, normal processing is not performed, and information indicating that there is an abnormality in the checksum is output to the outside of the chip.
発明の効果
本発明は、EPROM内蔵1チップマイクロコンピユー
タにおいて、EPROMのデータをチップ外部に出力す
ることなくチエツクすることを可能にするものである。Effects of the Invention The present invention enables a one-chip microcomputer with a built-in EPROM to check data in the EPROM without outputting it to the outside of the chip.
第1図は本発明の一実施例におけるマイクロコンピュー
タのブロック図、第2図は従来のマイクロコンピュータ
のブロック図である。
1・・・・・・CPU、2・・・・・・EPROM、3
・・・・・・データバス、4・・・・・・i / oボ
ート、5・・・・・・チエツクサム用EPROM。FIG. 1 is a block diagram of a microcomputer according to an embodiment of the present invention, and FIG. 2 is a block diagram of a conventional microcomputer. 1...CPU, 2...EPROM, 3
...Data bus, 4...I/O boat, 5...EPROM for checksum.
Claims (1)
、前記nビット長のデータのmワードから一意的に定ま
るデータを格納するメモリと、前記nビット長のデータ
mワードから一意的に定まるデータを算出する手段を備
えたマイクロコンピュータ。On one chip, a memory for storing n-bit length data, a memory for storing data uniquely determined from m words of the n-bit length data, and a memory uniquely determined from the m words of the n-bit length data. A microcomputer equipped with a means to calculate data.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2057130A JPH03257684A (en) | 1990-03-08 | 1990-03-08 | Microcomputer |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2057130A JPH03257684A (en) | 1990-03-08 | 1990-03-08 | Microcomputer |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH03257684A true JPH03257684A (en) | 1991-11-18 |
Family
ID=13046979
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2057130A Pending JPH03257684A (en) | 1990-03-08 | 1990-03-08 | Microcomputer |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH03257684A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08235014A (en) * | 1994-10-07 | 1996-09-13 | Lg Semicon Co Ltd | Apparatus and method for test of program memory part of one-chip microcomputer |
JPH1027035A (en) * | 1996-07-12 | 1998-01-27 | Fujitsu Ltd | Information processor |
-
1990
- 1990-03-08 JP JP2057130A patent/JPH03257684A/en active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08235014A (en) * | 1994-10-07 | 1996-09-13 | Lg Semicon Co Ltd | Apparatus and method for test of program memory part of one-chip microcomputer |
JPH1027035A (en) * | 1996-07-12 | 1998-01-27 | Fujitsu Ltd | Information processor |
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