JPH03249882A - Digital video switching device - Google Patents
Digital video switching deviceInfo
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- JPH03249882A JPH03249882A JP4764290A JP4764290A JPH03249882A JP H03249882 A JPH03249882 A JP H03249882A JP 4764290 A JP4764290 A JP 4764290A JP 4764290 A JP4764290 A JP 4764290A JP H03249882 A JPH03249882 A JP H03249882A
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Abstract
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はデジタル映像切替装置に関し、特にデジタル化
されたテレビジョン映像信号を切り替えるデジタル映像
切替装置に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a digital video switching device, and more particularly to a digital video switching device for switching digitized television video signals.
デジタル化したテレビジョン映像信号の切り替えを行な
うデジタル映像切替装置はよく知られている。Digital video switching devices that switch digitized television video signals are well known.
従来、この種のデジタル映像切替装置は、第2゛図に示
すように、M個の第1のデジタル映像信号入力〜第M個
のデジタル映像信号入力を受けたM入力2N出力映像切
替回路が2N個の映像信号を出力し、これら出力は2N
個のトオー°マット変換回路5−1.5−2.・・・第
2N−1のフォーマット変換回路5− (2N−1)、
5−2Nに供給される。2N個の映像信号は、2個ずつ
の組としてN個の第1の映像混合増幅回路3−1〜3−
Nで合成されるが、この合成のために映像信号のペデス
タルレベルをゼロレベル変換するフォーマット変換を前
述した2個1組ずつの第1フオーマツト変換回路5−1
.第2のフォーマット変換回路5−2〜第2N−1のフ
ォーマット変換回路5−(2N−1)、第2Nのフォー
マット変換回路5−2Nで行なっている。映像混合して
合成を行なったあとのN個の第1の映像混合増幅回路3
−1〜第Nの映像混合増幅回路3−Nの出力はそれぞれ
、N個の第1の出力フォーマット変換回路4−1〜第N
の出力フォーマット変換回路4−Nに供給され、ペデス
タルレベルの再生を行なって、それぞれ第1のデジタル
映像信号出力〜第Nのデジタル映像出力として出力され
る。Conventionally, this type of digital video switching device has an M input 2N output video switching circuit that receives M first to M digital video signal inputs, as shown in FIG. Outputs 2N video signals, these outputs are 2N
format conversion circuit 5-1.5-2. ... 2N-1 format conversion circuit 5- (2N-1),
5-2N. The 2N video signals are sent to N first video mixing amplification circuits 3-1 to 3- in groups of two.
For this synthesis, the first format conversion circuits 5-1 each have a set of two format conversion circuits that convert the pedestal level of the video signal to zero level.
.. This is performed by the second format conversion circuit 5-2 to the 2N-1 format conversion circuit 5-(2N-1) and the 2N-th format conversion circuit 5-2N. N first video mixing amplification circuits 3 after video mixing and synthesis
-1 to N-th video mixing amplification circuits 3-N respectively output from N first output format conversion circuits 4-1 to N-th video mixing amplification circuits 3-N.
The signals are supplied to the output format conversion circuit 4-N, where they are reproduced at a pedestal level and output as first to Nth digital video signal outputs, respectively.
上述した従来のデジタル映像切替装置は、映像信号入力
数Mが、映像切替回路から出力され合成すべき映像信号
の数2Nよりも少ない場合には、合成のためペデスタル
レベルを変換スるフォーマット変換回路の数が多くなっ
てしまうという欠点がある。The conventional digital video switching device described above uses a format conversion circuit that converts the pedestal level for combining when the number M of video signal inputs is smaller than the number 2N of video signals output from the video switching circuit and to be combined. The disadvantage is that the number of .
本発明のデジタル映像切替Mlは、デジタル化されたM
個の映像信号入力を受けペデスタルレベルをゼロとする
変換を行なうM個の入力フォーマット変換回路と、前記
M個の入力フォーマット変換回路の出力を受けて2N個
のデジタル映像信号を出力するM入力2N出力映像切替
回路と、前記M入力2N出力映像切替回路の出力する2
N個のデジタル映像信号を順次2個ずつ受け所定の効果
を含んで合成し出力するN個の映像混合増幅回路と、前
記N個の映像混合増幅回路の出力に対して前記M個の入
力フォーマット変換回路で失なったペデスタルレベルの
再生を施しN個のデジタル映像信号出力を送出するN個
の出力フォーマット変換回路とを備えて構成される。The digital video switching Ml of the present invention is a digitized M
M input format conversion circuits that receive input video signals and convert the pedestal level to zero; and M input 2N input format conversion circuits that receive outputs from the M input format conversion circuits and output 2N digital video signals. An output video switching circuit and 2 outputs from the M input 2N output video switching circuit.
N video mixing amplification circuits that sequentially receive N digital video signals two by two and synthesize and output the composite including a predetermined effect; and the M input formats for the outputs of the N video mixing amplification circuits. It is configured to include N output format conversion circuits that reproduce the pedestal level lost in the conversion circuit and send out N digital video signal outputs.
次に、図面を参照して本発明を説明する。 Next, the present invention will be explained with reference to the drawings.
第1図は本発明のデジタル映像切替禁粛の一実旅例の構
成図である。第1図に示す実施例は、M個の第1の入力
フォーマット変換回路1−1〜第Mの入カフオーマット
変換回路1−M、M入力2N出力映像切替回路2.N個
の第1の映像混合増幅回路3−1〜第Nの映像混合増幅
回路3−N。FIG. 1 is a diagram illustrating an example of a practical example of prohibiting digital video switching according to the present invention. The embodiment shown in FIG. 1 includes M first input format conversion circuits 1-1 to M-th input format conversion circuits 1-M, M input 2N output video switching circuits 2. N first video mixing amplification circuits 3-1 to Nth video mixing amplification circuits 3-N.
N個の第1の出力フォーマット変換回路3−1〜第Nの
出力フォーマド変換回路4−Nを備えて構成される。It is configured to include N first output format conversion circuits 3-1 to N-th output format conversion circuits 4-N.
次に、第1図の実施例の動作について説明する。Next, the operation of the embodiment shown in FIG. 1 will be explained.
M個の第1の入力フォーマット変換回路1−1〜第Mの
入力フォーマット変換回路1−Mに入力された第1〜第
Mのデジタル映像信号入力は、ペデスタルレベルをゼロ
レベルとしてM入力2N出力映像切替回路2に供給され
る。M入力2N出力映像切替回路2は、フォーマット変
換しゼロペデスタルレベルとした映像信号の切替を行な
って2N個のデジタル映像信号を出力する。これら2N
個のデジタル映像信号は順次2個ずつN個の第1の映像
混合増幅回路3−1〜第Nの映像混合増幅回路、3−N
に供給される。2つずつのデジタル映像信号は、これら
映像混合増幅回路でペデスタルレベルをゼロとしてゲイ
ン制御が行われ合成される。この合成出力は、まだペデ
スタルレベルがゼロなので、たとえば第1の出力フォー
マット変換回路4−1ではペデスタルレベルを再生し、
入力と同じフォーマットに変換している。同様のことが
他の映像混合増幅回路と出力フォーマット変換回路でも
おこなわれる。第1のデジタル映像信号出力〜第Nのデ
ジタル映像信号出力が得られる。The first to M-th digital video signal inputs input to the M first input format conversion circuits 1-1 to M-th input format conversion circuits 1-M are M input 2N outputs with the pedestal level as zero level. The signal is supplied to the video switching circuit 2. The M-input 2N-output video switching circuit 2 converts the format of the video signal and switches the video signal to zero pedestal level, and outputs 2N digital video signals. These 2N
The digital video signals are sequentially transmitted two by two to N first video mixing amplification circuits 3-1 to Nth video mixing amplification circuits 3-N.
is supplied to Two digital video signals are synthesized by these video mixing amplification circuits under gain control with the pedestal level set to zero. Since this composite output still has a pedestal level of zero, for example, the first output format conversion circuit 4-1 reproduces the pedestal level,
Converting to the same format as the input. Similar operations are performed in other video mixing amplification circuits and output format conversion circuits. A first digital video signal output to an Nth digital video signal output are obtained.
このようにして、デジタル映像信号入力の数Mと出力フ
ォーマット変換回路とを対応させてデジタル映像の切替
を行なうことができる。In this way, digital video can be switched by making the number M of digital video signal inputs correspond to the output format conversion circuit.
以上説明したように本発明は、ペデスタルレベル変換の
ための入力フォーマット変換回路を映像切換回路の前に
配設することにより、映像信号の入力数Mが、合成すべ
き映像信号の数2Nより少ないときでも、これに対応し
て入力フォーマット変換回路の数を少なくする事ができ
るという効果がある。As explained above, in the present invention, the number M of input video signals is smaller than the number 2N of video signals to be combined by arranging the input format conversion circuit for pedestal level conversion before the video switching circuit. Even when the present invention is used, there is an effect that the number of input format conversion circuits can be correspondingly reduced.
第1図は本発明のデジタル映像切替GM、の−実流側の
構成図、第2図は従来のデジタル映像切替M厘の構成図
である。
1−1〜1−M・・・・・・第1の入カフオーマット変
換回路〜第Mの入力フォーマット変換回路、2・・・・
・・M入力2N出力映像切替回路、3−1〜3−N・・
・・・・第1の映像混合増幅回路〜第Nの映像混合増幅
回路、4−1〜4−N・・・・・・第1の出カフオーマ
ット変換回路〜第Nの出力フォーマット変換回路、5−
1〜5−2N・・・・・・第1のフォーマット変換回路
〜第2のフォーマット変換回路。FIG. 1 is a block diagram of the actual flow side of a digital video switching GM of the present invention, and FIG. 2 is a block diagram of a conventional digital video switching M. 1-1 to 1-M...first input format conversion circuit to M-th input format conversion circuit, 2...
・・M input 2N output video switching circuit, 3-1 to 3-N・・
. . . 1st video mixing amplifier circuit to Nth video mixing amplifier circuit, 4-1 to 4-N . . . 1st output format conversion circuit to Nth output format conversion circuit, 5-
1 to 5-2N...first format conversion circuit to second format conversion circuit.
Claims (1)
レベルをゼロとする変換を行なうM個の入力フォーマッ
ト変換回路と、前記M個の入力フォーマット変換回路の
出力を受けて2N個のデジタル映像信号を出力するM入
力2N出力映像切替回路と、前記M入力2N出力映像切
替回路の出力する2N個のデジタル映像信号を順次2個
ずつ受け所定の効果を含んで合成し出力するN個の映像
混合増幅回路と、前記N個の映像混合増幅回路の出力に
対して前記M個の入力フォーマツト変換回路で失なった
ペデスタルレベルの再生を施しN個のデジタル映像信号
出力を送出するN個の出力フォーマット変換回路とを備
えて成ることを特徴とするデジタル映像切替装置。M input format conversion circuits that receive M digitized video signal inputs and convert the pedestal level to zero, and receive outputs from the M input format conversion circuits to convert 2N digital video signals. an M-input 2N-output video switching circuit that outputs, and N video mixing amplification that sequentially receives two 2N digital video signals outputted from the M-input 2N-output video switching circuit and synthesizes them with a predetermined effect. circuit, and N output format conversions for regenerating the pedestal level lost in the M input format conversion circuits for the outputs of the N video mixing amplification circuits and sending out N digital video signal outputs. A digital video switching device comprising a circuit.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4764290A JPH03249882A (en) | 1990-02-27 | 1990-02-27 | Digital video switching device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4764290A JPH03249882A (en) | 1990-02-27 | 1990-02-27 | Digital video switching device |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH03249882A true JPH03249882A (en) | 1991-11-07 |
Family
ID=12780898
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4764290A Pending JPH03249882A (en) | 1990-02-27 | 1990-02-27 | Digital video switching device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH03249882A (en) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61137481A (en) * | 1984-12-07 | 1986-06-25 | Sony Corp | Digital processing device of video signal |
-
1990
- 1990-02-27 JP JP4764290A patent/JPH03249882A/en active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61137481A (en) * | 1984-12-07 | 1986-06-25 | Sony Corp | Digital processing device of video signal |
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