JPH032469U - - Google Patents

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JPH032469U
JPH032469U JP5956889U JP5956889U JPH032469U JP H032469 U JPH032469 U JP H032469U JP 5956889 U JP5956889 U JP 5956889U JP 5956889 U JP5956889 U JP 5956889U JP H032469 U JPH032469 U JP H032469U
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signal
attenuator
delay circuit
passed
input signal
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  • Signal Processing For Digital Recording And Reproducing (AREA)
  • Digital Magnetic Recording (AREA)

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【図面の簡単な説明】
第1図は本考案装置に用いる波形等化回路の回
路図、第2図は本考案装置におけるピークシフト
の補正態様を示す説明図、第3図は一般的な波形
等化法によるピークシフトの補正態様を示す説明
図、第4図は一般的な書込み補償法によるピーク
シフトの補正態様を示す説明図、第5図は従来の
波形等化回路を示す回路図、第6図は第5図に示
す回路によるピークシフトの補正態様を示す波形
図、第7,8図は従来装置を用いる場合の不都合
の例を示す説明図である。 2……遅延線、3……減衰器、3a……第1の
減衰抵抗、3b……第2の減衰抵抗、3c……ス
イツチ、4……差動増幅器。なお、図中、同一符
号は同一、又は相当部分を示す。

Claims (1)

  1. 【実用新案登録請求の範囲】 入力信号を一定時間遅延させる遅延回路と、該
    遅延回路の反射波と入力信号との重畳信号を減衰
    させる減衰器と、遅延回路を通過した信号と減衰
    器を通過した信号との差を出力する差動増幅器と
    を有する波形等化回路を備えたデイスク装置にお
    いて、 前記減衰器はその減衰率を切換え可能としたこ
    とを特徴とするデイスク装置。
JP5956889U 1989-05-23 1989-05-23 Pending JPH032469U (ja)

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JP5956889U JPH032469U (ja) 1989-05-23 1989-05-23

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JPH032469U true JPH032469U (ja) 1991-01-11

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JP5956889U Pending JPH032469U (ja) 1989-05-23 1989-05-23

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