JPH03196916A - 放電加工装置 - Google Patents
放電加工装置Info
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- JPH03196916A JPH03196916A JP33592089A JP33592089A JPH03196916A JP H03196916 A JPH03196916 A JP H03196916A JP 33592089 A JP33592089 A JP 33592089A JP 33592089 A JP33592089 A JP 33592089A JP H03196916 A JPH03196916 A JP H03196916A
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- 238000003754 machining Methods 0.000 claims description 14
- 230000015572 biosynthetic process Effects 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 5
- 238000009760 electrical discharge machining Methods 0.000 description 3
- 238000010891 electric arc Methods 0.000 description 2
- 239000012530 fluid Substances 0.000 description 2
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- 238000002242 deionisation method Methods 0.000 description 1
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Landscapes
- Electrical Discharge Machining, Electrochemical Machining, And Combined Machining (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、放電加工機における極性切換装置に関する。
［従来の技術］
従来の放電加工機において、ワイヤカー、ト放電加工、
特に超硬材料の放電加工では、電源の極性を同一にして
放電加工を進めると、ギャップ内の消イオン化がしに〈
〈なり、局部的に比抵抗値が非常に低くなる。この状態
では、加工表面に電解電流が多量に流れ、特にコバルト
等の電解しゃすい物質が流出し、変質層を形成すること
が知られている。このような変質層の多い金型はその寿
命が短いという問題がある。
特に超硬材料の放電加工では、電源の極性を同一にして
放電加工を進めると、ギャップ内の消イオン化がしに〈
〈なり、局部的に比抵抗値が非常に低くなる。この状態
では、加工表面に電解電流が多量に流れ、特にコバルト
等の電解しゃすい物質が流出し、変質層を形成すること
が知られている。このような変質層の多い金型はその寿
命が短いという問題がある。
また、型彫放電加工機において、水をベースとした高分
子を含む加工液等を使って放電加工する場合、ギャップ
にタールが生成しやすく、このタールは導電性があり、
ギャップのインピーダンスが局部的に下がることがある
。この部分に電解電流かアーク電流かが流れるので、加
工速度が低下するとともに加工表面が変質するという問
題がある。
子を含む加工液等を使って放電加工する場合、ギャップ
にタールが生成しやすく、このタールは導電性があり、
ギャップのインピーダンスが局部的に下がることがある
。この部分に電解電流かアーク電流かが流れるので、加
工速度が低下するとともに加工表面が変質するという問
題がある。
また、仕上領域では、加工が進行しなくなり、仕上面を
得ることができないという問題が発生する。
得ることができないという問題が発生する。
一方、灯油系の加工液においても、やはり、タールの生
成が進行し、これによって、ギャップは消イオンしにく
い状態になり、アーク放電に移行しやすく、また加工表
面には、アーク放電によるクラック等が発生することが
ある。このような金型では、寿命が極端に短くなるとい
う問題がある。
成が進行し、これによって、ギャップは消イオンしにく
い状態になり、アーク放電に移行しやすく、また加工表
面には、アーク放電によるクラック等が発生することが
ある。このような金型では、寿命が極端に短くなるとい
う問題がある。
そこで、電極とワークとのギャップに所定電源から電圧
を印加する場合、そのギャップに対して電源を正極性、
逆極性で交互に切換えて印加することとし、たとえば第
６図に示すようにリレー４１．４２．４３．４４を設け
たものが知られている。
を印加する場合、そのギャップに対して電源を正極性、
逆極性で交互に切換えて印加することとし、たとえば第
６図に示すようにリレー４１．４２．４３．４４を設け
たものが知られている。
［発明が解決しようとする課題］
しかし、第６図に示すようにリレーを使用して極性を切
換えていたのでは、変質層の発生を確実に防止すること
ができず、不要−タール分の生成を確実に防止すること
ができず、加工速度が遅いという問題がある。
換えていたのでは、変質層の発生を確実に防止すること
ができず、不要−タール分の生成を確実に防止すること
ができず、加工速度が遅いという問題がある。
本発明は、変質層ができにくく、不要タール分の生成を
確実に防止することができ、加工速度を速くすることが
できる放電加工機における極性切換装置を提供すること
を目的とするものである。
確実に防止することができ、加工速度を速くすることが
できる放電加工機における極性切換装置を提供すること
を目的とするものである。
［課題を解決する手段］
本発明は、電源を正極性でギャップに印加して加工する
時間の長さと、電源を逆極性でギャップに印加して加工
する時間の長さとを、放電パルスの数に応じて設定する
ものである。
時間の長さと、電源を逆極性でギャップに印加して加工
する時間の長さとを、放電パルスの数に応じて設定する
ものである。
［作用］
本発明は、電源を正極性でギャップに印加して加工する
時間の長さと、電源を逆極性でギャップに印加して加工
する時間の長さとを、放電パルスの数に応じて設定する
ので、変質層ができにくく、不要タール分の生成を確実
に防止することができ、加工速度が速い。
時間の長さと、電源を逆極性でギャップに印加して加工
する時間の長さとを、放電パルスの数に応じて設定する
ので、変質層ができにくく、不要タール分の生成を確実
に防止することができ、加工速度が速い。
［実施例］
第１図は１本発明の一実施例を示す回路図である。
この実施例では、電流制限抵抗３１とスイッチングトラ
ンジスタＴと直列に極性切換回路ｌＯが設けられ、電極
ＥとワークＷとのギャップＧが、極性切換回路ｌＯを介
して電源３０と接続されている。また、電流制限抵抗３
１の代りに、抵抗値が小さな定電流電源を設けてもよい
。
ンジスタＴと直列に極性切換回路ｌＯが設けられ、電極
ＥとワークＷとのギャップＧが、極性切換回路ｌＯを介
して電源３０と接続されている。また、電流制限抵抗３
１の代りに、抵抗値が小さな定電流電源を設けてもよい
。
極性切換回路１０は、正極性用トランジスタＴＮＩ、Ｔ
Ｎ２と、逆極性用トランジスタＴＲ１，ＴＲ２とがブリ
ッジ形式で接続されたものでアリ、トランジスタＴＲ１
，ＴＮ２の接続点と、トランジスタＴＮＩ、ＴＲ２の接
続点との間に、電極ＥとワークＷが接続され、電極Ｅと
ワークＷとの間にギャップＧが形成されている。
Ｎ２と、逆極性用トランジスタＴＲ１，ＴＲ２とがブリ
ッジ形式で接続されたものでアリ、トランジスタＴＲ１
，ＴＮ２の接続点と、トランジスタＴＮＩ、ＴＲ２の接
続点との間に、電極ＥとワークＷが接続され、電極Ｅと
ワークＷとの間にギャップＧが形成されている。
制御部２０は、ゲート信号とＲ数の設定値とＮ数の設定
値とを入力し、正極性用トランジスタＴＮ１．ＴＮ２を
制御するＮ信号と、逆極性用トランジスタＴＲＩ、ＴＲ
２を制御するＲ信号とを出力するものである。なお、上
記Ｒ数は、電源３０を逆極性でギャップＧに印加したい
時間に対応する（換算した）放電パルス数であり、上記
Ｎ数は、電源３０を正極性でギャップＧに印加したい時
間に対応する（換算した）放電パルス数である。
値とを入力し、正極性用トランジスタＴＮ１．ＴＮ２を
制御するＮ信号と、逆極性用トランジスタＴＲＩ、ＴＲ
２を制御するＲ信号とを出力するものである。なお、上
記Ｒ数は、電源３０を逆極性でギャップＧに印加したい
時間に対応する（換算した）放電パルス数であり、上記
Ｎ数は、電源３０を正極性でギャップＧに印加したい時
間に対応する（換算した）放電パルス数である。
次に、上記実施例の動作について説明する。
第２図は、上記実施例の動作を示すタイムチャートであ
る。
る。
まず、ゲート信号Ｓ１．Ｓ２、Ｓ３、Ｓ４．・・・・・
・が発生する度に、ギャップＧに電圧ＶＧが発生し、こ
のギャップ電圧ＶＧの発生に伴って、ギャツブＧに放電
電流ＩＧが流れる。一方、制御部２０において、Ｎ数設
定値、Ｎ数設定値に基づいて、信号処理することによっ
て、Ｎ信号、Ｎ信号が発生し、Ｎ信号が立上っていると
きに、トランジスタＴＲ１，ＴＲ２のみがオンし、ギャ
ップＧに逆極性の電源３０が印加され、Ｎ信号が立上っ
ているときに、トランジスタＴＮ１．ＴＮ２がオンし、
ギャップＧに正極性の電源３０が印加され電流が流れる
。すなわち、ゲート信号Ｓ１、Ｓ２、Ｓ４が発生してい
るときと、ゲート信号Ｓ３が発生しているときとでは、
ギヤー７ブ電圧ＶＧ、ギャップ逆電流ＩＧの方向が異る
。
・が発生する度に、ギャップＧに電圧ＶＧが発生し、こ
のギャップ電圧ＶＧの発生に伴って、ギャツブＧに放電
電流ＩＧが流れる。一方、制御部２０において、Ｎ数設
定値、Ｎ数設定値に基づいて、信号処理することによっ
て、Ｎ信号、Ｎ信号が発生し、Ｎ信号が立上っていると
きに、トランジスタＴＲ１，ＴＲ２のみがオンし、ギャ
ップＧに逆極性の電源３０が印加され、Ｎ信号が立上っ
ているときに、トランジスタＴＮ１．ＴＮ２がオンし、
ギャップＧに正極性の電源３０が印加され電流が流れる
。すなわち、ゲート信号Ｓ１、Ｓ２、Ｓ４が発生してい
るときと、ゲート信号Ｓ３が発生しているときとでは、
ギヤー７ブ電圧ＶＧ、ギャップ逆電流ＩＧの方向が異る
。
なお、Ｎ信号が立下ってからＮ信号が立上るまでの時間
ｔｄ、 Ｎ信号が立下ってからＮ信号が立上るまでの時
間ｔｄは、トランジスタＴＲＩ、ＴＲ２、ＴＮＩ、ＴＮ
２が破損されることを防止するための遅延時間である。
ｔｄ、 Ｎ信号が立下ってからＮ信号が立上るまでの時
間ｔｄは、トランジスタＴＲＩ、ＴＲ２、ＴＮＩ、ＴＮ
２が破損されることを防止するための遅延時間である。
つまり、上記実施例においては、電源３０を正極性でギ
ャップＧに印加させる正極性用スイッチング回路と、電
源３０を逆極性でギャップＧに印加させる逆極性用スイ
ッチング回路とを有し、正極性用スイッチング回路と逆
極性用スイッチング回路とをともに所定時間だけオフす
るようにしている。また、クロック２の周波数を変える
ことによって、上記遅延時間ｔｄを変更することができ
る。
ャップＧに印加させる正極性用スイッチング回路と、電
源３０を逆極性でギャップＧに印加させる逆極性用スイ
ッチング回路とを有し、正極性用スイッチング回路と逆
極性用スイッチング回路とをともに所定時間だけオフす
るようにしている。また、クロック２の周波数を変える
ことによって、上記遅延時間ｔｄを変更することができ
る。
第３図は、上記実施例における制御部２ｏの具体例を示
すブロック図である。
すブロック図である。
この制御部２０は、Ｎ数設定値とＮ数設定値とを入力し
、セレクト信号によって出方を切換えるセレクタ２１と
、ゲート信号の数をカウントするカウンタ２２と、カウ
ンタ２２からのカウント値Ｂとセレクタ２１からの出力
値Ａとが一致したときに一致信号を出力するコンパレー
タ２３と、コンパレータ２３からの一致信号を入力する
トグル０フリフプ７０ツブ２４と、ラッチ２５と。
、セレクト信号によって出方を切換えるセレクタ２１と
、ゲート信号の数をカウントするカウンタ２２と、カウ
ンタ２２からのカウント値Ｂとセレクタ２１からの出力
値Ａとが一致したときに一致信号を出力するコンパレー
タ２３と、コンパレータ２３からの一致信号を入力する
トグル０フリフプ７０ツブ２４と、ラッチ２５と。
ＡＮＤ回路２６．２９Ｒ１２９Ｎと、Ｄラッチ２７．２
８とを有する。
８とを有する。
次に、制御部２０の動作について説明する。
第４図は、Ｎ数設定値を「２」とし、Ｎ数設定値をｒｌ
Ｊとした場合の制Ｗ部２ｏの動作を示すタイムチャート
である。
Ｊとした場合の制Ｗ部２ｏの動作を示すタイムチャート
である。
まず、図示しないＣＰＵまたはラッチからＮ数設定値と
して「２」がセレクタ２１に入力され、同様にＮ設定値
としてｒｌＪがセレクタ２１に入力されている。そして
１時点ｔｏにおいて、ゲート信号が立上り、ギャップ電
圧ＶＧが発生し、ゲート信号が立下がるたびにカウンタ
２２がゲート信号の数をカウントする。
して「２」がセレクタ２１に入力され、同様にＮ設定値
としてｒｌＪがセレクタ２１に入力されている。そして
１時点ｔｏにおいて、ゲート信号が立上り、ギャップ電
圧ＶＧが発生し、ゲート信号が立下がるたびにカウンタ
２２がゲート信号の数をカウントする。
一方、セレクタ２１は、時点ｔｏにおいてＱ出力として
「２」を出力し、時点ｔ１でカウンタ２２がゲート信号
を２つカウントし、コンパレータ２３がＡ＝Ｂであるこ
と示す一致信号をＴ−フリップフロップ２４に出力する
。このときに上記一致信号がカウンタ２２のリセット信
号として使用されるので、カウンタ２２かリセットされ
る。
「２」を出力し、時点ｔ１でカウンタ２２がゲート信号
を２つカウントし、コンパレータ２３がＡ＝Ｂであるこ
と示す一致信号をＴ−フリップフロップ２４に出力する
。このときに上記一致信号がカウンタ２２のリセット信
号として使用されるので、カウンタ２２かリセットされ
る。
そして、時点ｔ２において、ゲート信号が立下り、クロ
ックｌが立上がるのでＡＮＤ回路２６がｒｌＪを出力し
、ラッチ２５がＮ信号として「０」を出力する。なお、
このときに、Ｔ−フリップフロップ２４が「０」を出力
するので、セレクタ２１の出力ＱがＮ数設定値であるｒ
ｌＪを出力する。
ックｌが立上がるのでＡＮＤ回路２６がｒｌＪを出力し
、ラッチ２５がＮ信号として「０」を出力する。なお、
このときに、Ｔ−フリップフロップ２４が「０」を出力
するので、セレクタ２１の出力ＱがＮ数設定値であるｒ
ｌＪを出力する。
したがって１時点ｔ３において１次のゲート信号の立下
がりをカウンタ２２がカウントし、コンパレータ２３が
一致信号を出力し、Ｔ−フリップフロップ２４の出力が
「１」になり、カウンタ２２かリセットされる。そして
、次のクロックｌの立上がり時点ｔ４においてＮ信号が
立上る。
がりをカウンタ２２がカウントし、コンパレータ２３が
一致信号を出力し、Ｔ−フリップフロップ２４の出力が
「１」になり、カウンタ２２かリセットされる。そして
、次のクロックｌの立上がり時点ｔ４においてＮ信号が
立上る。
その後、コンパレータ２２がＮ数設定値である「２」を
カウントし、次にＮ数設定値であるｒｌＪをカウントす
る。なお、第５図に示すように、Ｎ信号が立下ってから
、クロック２の２つ分だけ遅れて、Ｎ信号が立上がり、
Ｎ信号が立下がってからクロック２の２つ分だけ遅れて
Ｎ信号が立上がる。
カウントし、次にＮ数設定値であるｒｌＪをカウントす
る。なお、第５図に示すように、Ｎ信号が立下ってから
、クロック２の２つ分だけ遅れて、Ｎ信号が立上がり、
Ｎ信号が立下がってからクロック２の２つ分だけ遅れて
Ｎ信号が立上がる。
このように、高速で極性切換を行なって電源３０の電圧
をＧに印加することによって、不要なタール生成を防止
することができ、したがって、加工速度が遅くなること
を防止でき、さらに変質層が生成されることを防止でき
る。
をＧに印加することによって、不要なタール生成を防止
することができ、したがって、加工速度が遅くなること
を防止でき、さらに変質層が生成されることを防止でき
る。
なお、上記実施例においては、電源３０の正極性と逆極
性との切換動作を、放電パルスのオフタイムに実行して
いる。また、クロックｌとクロック２として共通のクロ
ックを使用してもよい。
性との切換動作を、放電パルスのオフタイムに実行して
いる。また、クロックｌとクロック２として共通のクロ
ックを使用してもよい。
上記実施例においては、逆極性でギャップＧに電圧３０
を印加する時間と正極性で電極３０をギャップＧに印加
する時間との比を２：１にしであるが、逆極性で電極３
０をギャップＧに印加する時間ｌに対して、正極性でギ
ャップＧに電圧３０を印加する時間を１〜２５５にして
もよい（なお、逆極性で電極３０をギャップＧに印加す
る時間ｌは、放電パルス数１〜２５５の時間である。）
、また、正極性で電極３０をギャップＧに印加する時間
１に対して、逆極性でギャップＧに電圧３０を印加する
時間を１〜２５５にしてもよい（なお、正極性で電極３
０をギャップＧに印加する時間ｌは、放電パルス数１〜
２５５の時間である。）。
を印加する時間と正極性で電極３０をギャップＧに印加
する時間との比を２：１にしであるが、逆極性で電極３
０をギャップＧに印加する時間ｌに対して、正極性でギ
ャップＧに電圧３０を印加する時間を１〜２５５にして
もよい（なお、逆極性で電極３０をギャップＧに印加す
る時間ｌは、放電パルス数１〜２５５の時間である。）
、また、正極性で電極３０をギャップＧに印加する時間
１に対して、逆極性でギャップＧに電圧３０を印加する
時間を１〜２５５にしてもよい（なお、正極性で電極３
０をギャップＧに印加する時間ｌは、放電パルス数１〜
２５５の時間である。）。
上記実施例は、放電加工機についてのものであるが、上
記実施例を電解加工機に適用することができる。また、
ギャップＧに印加する時間を調整する場合、カウンタの
ビット数を変更すればよく、この変更は困難なことでは
ない。
記実施例を電解加工機に適用することができる。また、
ギャップＧに印加する時間を調整する場合、カウンタの
ビット数を変更すればよく、この変更は困難なことでは
ない。
［発明の効果］
本発明によれば、変質層ができにくく、不要タール分の
生成を確実に防止することができ、加工速度が速いとい
う効果を奏する。
生成を確実に防止することができ、加工速度が速いとい
う効果を奏する。
第１図は、本発明の一実施例を示す回路図である。
第２図は、上記実施例における動作を示すタイムチャー
トである。 第３図は、上記実施例における制御部２０を具体的に示
すブロック図である。 第４図、第５図は、制御部２０の動作を示すタイムチャ
ートである。 第６図は、従来例を示す回路図である。 ０・・・・・・極性切換回路、 ０・・・・・・制御部、 １・・・・・・セレクタ、 ２・・・・・・カウント、 ３・・・・・・コンパレータ。 第２図
トである。 第３図は、上記実施例における制御部２０を具体的に示
すブロック図である。 第４図、第５図は、制御部２０の動作を示すタイムチャ
ートである。 第６図は、従来例を示す回路図である。 ０・・・・・・極性切換回路、 ０・・・・・・制御部、 １・・・・・・セレクタ、 ２・・・・・・カウント、 ３・・・・・・コンパレータ。 第２図
Claims (3)
- （１）電極とワークとのギャップに所定電源から電圧を
印加する放電加工機において、 上記電源を正極性で上記ギャップに印加して加工する時
間の長さと、上記電源を逆極性で上記ギャップに印加し
て加工する時間の長さとを、放電パルスの数に応じて設
定することを特徴とする放電加工機における極性切換装
置。 - （２）請求項（１）において、 上記電源の正極性と逆極性との切換動作を、上記放電パ
ルスのオフタイムに実行することを特徴とする放電加工
機における極性切換装置。 - （３）請求項（１）において、 上記電源を上記正極性で上記ギャップに印加させる正極
性用スイッチング回路と、上記電源を上記逆極性で上記
ギャップに印加させる逆極性用スイッチング回路とを有
し、上記正極性用スイッチング回路と上記逆極性用スイ
ッチング回路とをともに所定時間だけオフすることを特
徴とする放電加工機における極性切換装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33592089A JP2869545B2 (ja) | 1989-12-25 | 1989-12-25 | 放電加工装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP33592089A JP2869545B2 (ja) | 1989-12-25 | 1989-12-25 | 放電加工装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03196916A true JPH03196916A (ja) | 1991-08-28 |
| JP2869545B2 JP2869545B2 (ja) | 1999-03-10 |
Family
ID=18293840
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP33592089A Expired - Lifetime JP2869545B2 (ja) | 1989-12-25 | 1989-12-25 | 放電加工装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2869545B2 (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5254826A (en) * | 1990-03-28 | 1993-10-19 | Mitsubishi Denki Kabushiki Kaisha | Contact detecting device for positioning relatively movable elements |
| US5345053A (en) * | 1992-08-25 | 1994-09-06 | Sodick Co., Ltd. | Method and apparatus for supplying power for electric discharge machining |
| DE4422967A1 (de) * | 1993-06-30 | 1995-01-12 | Mitsubishi Electric Corp | Funkenerodiermaschine |
| JP2007204098A (ja) * | 2006-01-31 | 2007-08-16 | Japan Crown Cork Co Ltd | 容器体とキャップとの組合せ |
| US7572997B2 (en) * | 2007-02-28 | 2009-08-11 | Caterpillar Inc. | EDM process for manufacturing reverse tapered holes |
-
1989
- 1989-12-25 JP JP33592089A patent/JP2869545B2/ja not_active Expired - Lifetime
Cited By (14)
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