JPH0316657B2 - - Google Patents
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- JPH0316657B2 JPH0316657B2 JP23932283A JP23932283A JPH0316657B2 JP H0316657 B2 JPH0316657 B2 JP H0316657B2 JP 23932283 A JP23932283 A JP 23932283A JP 23932283 A JP23932283 A JP 23932283A JP H0316657 B2 JPH0316657 B2 JP H0316657B2
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- Japan
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- output
- address space
- address
- command
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- Expired
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- 238000000034 method Methods 0.000 claims description 6
- 238000012545 processing Methods 0.000 claims description 6
- 238000004886 process control Methods 0.000 description 5
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- 238000011161 development Methods 0.000 description 2
- 238000012360 testing method Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/10—Program control for peripheral devices
Description
【発明の詳細な説明】
〔発明の属する技術分野〕
本発明は、データ処理装置における入出力制御
方式に関する。DETAILED DESCRIPTION OF THE INVENTION [Technical field to which the invention pertains] The present invention relates to an input/output control method in a data processing device.
従来のデータ処理装置は、チヤンネルプログラ
ムのコマンド語でチヤンネルプログラムの動作す
るアドレス空間を指示していた。したがつて、オ
ペレーテイングシステムがチヤンネルプログラム
に介入しチヤンネルプログラムの中でアドレス空
間を切替える制御が必要となり、オペーレーテイ
ングシステムに与える影響やチヤンネルプログラ
ムの中でアドレス空間を切替えるチヤンネルプロ
グラムの複雑さを生じる欠点があつた。
In conventional data processing devices, the command word of the channel program indicates the address space in which the channel program operates. Therefore, it is necessary for the operating system to intervene in the channel program and control the address space switching within the channel program, which reduces the impact on the operating system and the complexity of the channel program that switches the address space within the channel program. There were some drawbacks.
本発明は、前記の欠点を除去し、チヤンネルプ
ログラムの途中でアドレス空間を切替える必要が
なく、チヤンネルプログラムの開始から終了まで
を一つのアドレス空間で動作できる入出力制御方
式を提供することを目的とする。
SUMMARY OF THE INVENTION An object of the present invention is to provide an input/output control method that eliminates the above-mentioned drawbacks and can operate in one address space from the start to the end of a channel program without the need to switch address spaces in the middle of a channel program. do.
本発明は、入出力命令で与えるオペランドでチ
ヤンネルプログラムで動作するアドレス空間を指
定できるようにすることを特徴とする。
The present invention is characterized in that an address space in which a channel program operates can be specified by an operand given in an input/output instruction.
すなわち、入出力装置の入出力動作を規定する
一連の入出力動作指令群とこれらの入出力動作指
令群を起動する入出力命令とを記憶する主記憶手
段を備えたデータ処理装置の入出力制御方式にお
いて、前記主記憶手段の前記入出力命令の発行さ
れたアドレス空間内にあらたに前記入出力命令オ
ペランドとして与えられ、前記入出力指令群が動
作可能なアドレス空間を指定するアドレス空間指
定手段と、前記入出力動作指令群の最初の指令の
前記アドレス空間指定手段で指定されたアドレス
空間内の位置を示す入出力動作指令群位置表示手
段と、前記入出力命令が中央処理装置において起
動されたときに、前記アドレス空間指定手段で指
定されたアドレス空間内の、前記入出力動作指令
群位置表示手段で示された入出力動作指令群を実
行する制御手段とを備えたことを特徴とする。 That is, input/output control of a data processing device that includes a main memory means for storing a series of input/output operation commands that define the input/output operations of the input/output device and input/output commands that activate these input/output operation commands. an address space specifying means for specifying an address space that is newly given as an operand of the input/output command in the address space in the main storage means in which the input/output command has been issued and in which the input/output command group can operate; , an input/output operation command group position display means for indicating the position of the first command of the input/output operation command group in the address space designated by the address space designation means; In some cases, the apparatus is characterized by comprising a control means for executing the input/output operation command group indicated by the input/output operation command group position display means within the address space designated by the address space designation means.
次に、本発明の実施例について図面を参照して
説明する。第１図は本発明一実施例入出力命令、
チヤンネルプログラムポインタおよびチヤンネル
コマンド語の関連を示す図である。第２図は指定
されたアドレス空間における論理アドレスの展開
を示す図である。第１図および第２図により本発
明入出力装置の動作を説明する。中央処理装置が
入出力命令１を検知すると、検知された命令のオ
ペランドアドレス部９が指定しているオペランド
であるチヤンネルプログラムポインタ２を主記憶
装置から読出す。チヤンネルプログラムポインタ
２は起動するチヤンネルプログラムを指定するポ
インタであり、そのチヤンネルプログラムが動作
するアドレス空間を指定するアドレス空間指定部
１０およびチヤンネルプログラムの先頭のチヤン
ネルコマンド語を指示する論理アドレスで書かれ
たアドレス部１１から構成されている。
Next, embodiments of the present invention will be described with reference to the drawings. FIG. 1 shows input/output instructions according to an embodiment of the present invention.
FIG. 3 is a diagram showing the relationship between a channel program pointer and a channel command word. FIG. 2 is a diagram showing the development of logical addresses in a designated address space. The operation of the input/output device of the present invention will be explained with reference to FIGS. 1 and 2. When the central processing unit detects the input/output instruction 1, it reads the channel program pointer 2, which is the operand specified by the operand address field 9 of the detected instruction, from the main memory. The channel program pointer 2 is a pointer that specifies the channel program to be started, and is written with an address space specifying section 10 that specifies the address space in which the channel program operates, and a logical address that specifies the channel command word at the beginning of the channel program. It consists of an address section 11.
以後、チヤンネルプログラム内の論理アドレス
で書かれたアドレス情報は、アドレス空間指定部
１０で指定されたアドレス空間で論理アドレスを
実アドレスに変換されて行く。チヤンネルプログ
ラムポインタ２で指示される先頭のチヤンネルコ
マンド語３のコマンド部１２は必ずチヤンネルプ
ログラムヘツダが指定され、起動するチヤンネル
の番号を指示するチヤンネル指示部１５などを有
する。以後、中央処理装置は入出力制御を入出力
制御装置へ移管する。 Thereafter, address information written using logical addresses in the channel program is converted from logical addresses to real addresses in the address space specified by the address space specifying section 10. The command section 12 of the first channel command word 3 indicated by the channel program pointer 2 always specifies a channel program header, and has a channel instruction section 15 for indicating the number of the channel to be activated. Thereafter, the central processing unit transfers input/output control to the input/output control device.
入出力制御装置は、以後前記チヤンネルコマン
ド語３を起点に動作を続行する。入出力制御装置
はチヤンネルコマンド語３の次のアドレスからチ
ヤンネルコマンド語４を読出す。このチヤンネル
コマンド語４は入出力動作を指示するコマンド部
１３およびデータバツフアの先頭アトレスを指定
する論理アドレスで書かれたアドレス部１６など
を有する。前記コマンド部１３が、たとえば出力
動作を指示している場合は、アドレス部１６で指
定されたデータバツフア７からデータを入出力装
置へ転送する。このコマンドが終了すれば同様に
チヤンネルコマンド語４の番地からチヤンネルコ
マンド語を読出す。コマンド部１４が無条件分岐
コマンドである場合は、アドレス部１７は次のチ
ヤンネルコマンド語を指定するアドレスである。 The input/output control device thereafter continues its operation starting from the channel command word 3. The input/output controller reads channel command word 4 from the address following channel command word 3. This channel command word 4 has a command section 13 for instructing input/output operations, an address section 16 written with a logical address specifying the start address of the data buffer, and the like. For example, when the command section 13 instructs an output operation, data is transferred from the data buffer 7 designated by the address section 16 to the input/output device. When this command is completed, the channel command word is read out from the address of channel command word 4 in the same way. When the command section 14 is an unconditional branch command, the address section 17 is an address specifying the next channel command word.
以後同様にして、チヤンネルプログラムを実行
するが、このようにチヤンネルコマンド語のコマ
ンド部で指示される動作が入力動作または出力動
作指示の場合は、データを書込むアドレスあるい
は読出すアドレスを示し、また分岐コマンドの場
合は、次のチヤンネルコマンド語の格納されるア
ドレスを示し、試験設定コマンドの場合は、ロツ
クバイトのアドレスを示す。いずれの場合もアド
レスは論理アドレスで示される。 Thereafter, the channel program will be executed in the same way, but if the operation instructed by the command part of the channel command word is an input operation or an output operation instruction, it will indicate the address to write or read data, and In the case of a branch command, it indicates the address where the next channel command word is stored, and in the case of a test setting command, it indicates the address of the lock byte. In either case, the address is indicated by a logical address.
以上のように、チヤンネルプログラムの実行の
際に使用するアドレス情報は、全てチヤンネルプ
ログラムポインタ２で指定されたアドレス空間内
で論理アドレスを実アドレスに変換して行われ
る。 As described above, all address information used when executing a channel program is obtained by converting a logical address into a real address within the address space specified by the channel program pointer 2.
次に、第２図に示す指定されたアドレス空間内
における論理アドレスの展開について説明する。
第１図で示したチヤンネルプログラムポインタ２
の構成を第２図に示すが、第２図のようにアドレ
ス空間指定部１０は、Ｊ部と、Ｐ部とからなり、
Ｊ部とＰ部とによりプロセス制御ブロツク１０３
が得られる。Ｊ部は主記憶装置内の所定の番地に
格納されているＪ表１０１内のＰ表１０２の格納
位置を表す情報のＪ表１０１内の位置を示す。Ｐ
部はＪ部から得られたＰ表１０２内のプロセス制
御ブロツク１０３の格納位置を表す情報のＰ表内
の位置を示す。 Next, the development of logical addresses within the specified address space shown in FIG. 2 will be explained.
Channel program pointer 2 shown in Figure 1
The configuration of is shown in FIG. 2, and as shown in FIG. 2, the address space specifying section 10 consists of a J section and a P section.
Process control block 103 by J part and P part
is obtained. The J section indicates the position in the J table 101 of information representing the storage position of the P table 102 in the J table 101 stored at a predetermined address in the main memory. P
The section indicates the position in the P table of information representing the storage position of the process control block 103 in the P table 102 obtained from the J section.
以上のようにして得られたプロセス制御ブロツ
ク１０３はこのチヤンネルプログラムが動作する
プロセスの制御テーブルである。このプロセス制
御ブロツク１０３の所定の位置にこのプロセスが
動作し得るセグメントの一覧を示す。セグメント
表表示語配列１０４が格納される位置を示す情報
を有する。このようにしてこのチヤンネルプログ
ラムが動作し得るアドレス空間を指定される。 The process control block 103 obtained as described above is a control table for the process in which this channel program operates. A list of segments in which this process can operate is shown in a predetermined position of this process control block 103. It has information indicating the location where the segment table display word array 104 is stored. In this way, the address space in which this channel program can operate is designated.
第２図にはこのようにして指定されたアドレス
空間内でどのようにして所望の実アドレスが得ら
れるかも示してある。第２図の場合は、チヤンネ
ルプログラムポインタ２からチヤンネルプログラ
ムの先頭を得る場合について示すが、その他のア
ドレス情報も同様にして実アドレスに変換され
る。 FIG. 2 also shows how a desired real address can be obtained within the address space thus designated. Although FIG. 2 shows the case where the head of the channel program is obtained from the channel program pointer 2, other address information is similarly converted to real addresses.
本発明は、以上説明したように、入出力命令の
オペランドによりチヤンネルプログラムの動作す
るアドレス空間を指定できるようにすることによ
り、チヤンネルプログラム内でアドレス空間を切
替える必要がなく、ソフトウエアのオペレーテイ
ングシステムがチヤンネルプログラム内に介入す
る必要がないなどソフトウエアの入出力制御が容
易になる優れた効果がある。
As explained above, the present invention enables the address space in which a channel program operates to be specified by the operand of an input/output instruction, thereby eliminating the need to switch address spaces within the channel program and allowing the software operating system to This has the advantage of simplifying software input/output control, such as eliminating the need to intervene in the channel program.
第１図は本発明一実施例入出力命令、チヤンネ
ルプログラムポインタおよびチヤンネルコマンド
語の関連を示す図。第２図は指定されたアドレス
空間内における論理アドレスの展開を示す図。
１……入出力命令、２……チヤンネルプログラ
ムポインタ、３〜６……チヤンネルコマンド語、
７……入出力データバツフア、８……オペコー
ド、９……オペランドアドレス部、１０……アド
レス空間指定部、１１……アドレス部、１２〜１
４，１８……コマンド部、１０１……Ｊ表、１０
２……Ｐ表、１０３……プロセス制御ブロツク、
１０４……セグメント表表示語配列、１０５……
セグメント表、１０６……ページ表、１０７……
ページ。
FIG. 1 is a diagram showing the relationship among input/output instructions, channel program pointers, and channel command words according to an embodiment of the present invention. FIG. 2 is a diagram showing the expansion of logical addresses within a designated address space. 1...I/O command, 2...Channel program pointer, 3-6...Channel command word,
7...I/O data buffer, 8...Operation code, 9...Operand address section, 10...Address space specification section, 11...Address section, 12-1
4, 18... Command section, 101... J table, 10
2...P table, 103...process control block,
104... Segment table display word array, 105...
Segment table, 106... Page table, 107...
page.
Claims (1)
出力動作指令群とこれらの入出力動作指令群を起
動する入出力命令とを記憶する主記憶手段を備え
たデータ処理装置の入出力制御方式において、 前記主記憶手段の前記入出力命令の発行された
アドレス空間内にあらたに前記入出力命令オペラ
ンドとして与えられ、前記入出力指令群が動作可
能なアドレス空間を指定するアドレス空間指定手
段と、 前記入出力動作指令群の最初の指令の前記アド
レス空間指定手段で指定されたアドレス空間内の
位置を示す入出力動作指令群位置表示手段と、 前記入出力命令が中央処理装置において起動さ
れたときに、前記アドレス空間指定手段で指定さ
れたアドレス空間内の、前記入出力動作指令群位
置表示手段で示された入出力動作指令群を実行す
る制御手段と を備えたことを特徴とする入出力制御方式。[Scope of Claims] 1. A data processing device that includes a main storage means for storing a series of input/output operation commands that define input/output operations of an input/output device and input/output commands that activate these input/output operation commands. In the input/output control method of the device, the input/output command group is newly given as an operand of the input/output command in the address space where the input/output command has been issued in the main storage means, and specifies an address space in which the input/output command group can operate. address space designation means; input/output operation command group position display means for indicating a position within the address space designated by the address space designation means of the first command of the input/output operation command group; and the input/output command group is centrally processed. and control means for executing the input/output operation command group indicated by the input/output operation command group position display means within the address space specified by the address space designation means when activated in the apparatus. An input/output control method featuring:
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23932283A JPS60129863A (en) | 1983-12-19 | 1983-12-19 | Input and output control system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23932283A JPS60129863A (en) | 1983-12-19 | 1983-12-19 | Input and output control system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60129863A JPS60129863A (en) | 1985-07-11 |
| JPH0316657B2 true JPH0316657B2 (en) | 1991-03-06 |
Family
ID=17042990
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23932283A Granted JPS60129863A (en) | 1983-12-19 | 1983-12-19 | Input and output control system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60129863A (en) |
-
1983
- 1983-12-19 JP JP23932283A patent/JPS60129863A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60129863A (en) | 1985-07-11 |
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Legal Events
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