JPH03113997A - 時分割交換システム - Google Patents

時分割交換システム

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JPH03113997A
JPH03113997A JP11004390A JP11004390A JPH03113997A JP H03113997 A JPH03113997 A JP H03113997A JP 11004390 A JP11004390 A JP 11004390A JP 11004390 A JP11004390 A JP 11004390A JP H03113997 A JPH03113997 A JP H03113997A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、音声、データ等の時分割交換をする時分割交
換システムに係り、特に、その制御系。
通話路系ともに完全分散構成として信頼性、経済性を得
るようにした時分割交換システムに関するものである。
〔従来の技術〕
以前から、時分割交換機の制御系として処理能力の高い
大規模なシングルプロセッサが用いられてきたが、この
ようなシングルプロセッサは、信頼性上から2重化して
おく必要があるので、大きな実装面積を必要とするばか
りでなく、極めて高価なものであった。
近年、LSI技術の発展によって優れた安全なマイクロ
プロセッサが出現するに及んで、複数のマイクロプロセ
ッサで構成したマルチプロセッサを時分割交換機の制御
系として使用するものが主流となってきた。
しかしながら、従来のマルチプロセッサ方式は、例えば
、通話路系とは独立に、単に大処理容量の1個のプロセ
ッサーの機能を複数のマイクロプロセッサで実現すると
いうものであったり、または通話路系のビルディングブ
ロック構成に合わせてマイクロプロセッサを増減すると
いうものであった。
このような従来例では、通話路系が密結合となっている
ので、各マイクロプロセッサ間も密な結合となっている
。従って、マルチプロセッサを機能分散または負荷分散
とした場合でも、各マルチプロセッサ間の通信量が増大
し、スループット。
処理能力に多大な影響を与えているばかりでなく、−旦
、障害が発生すると、そのモードによってはシステムの
信頼性に重大な影響を与えかねないというおそれがあっ
た。更に、通話路管理のためのメモリは、一般に各プロ
セッサに対して共通に置かれるので、特に大局において
は、信頼性の上から、この部分がネックとなっていた。
〔発明の目的〕
本発明の目的は、上記した従来技術の欠点をなくし、制
御系1通話路系ともに完全分散構成として信頼性、経済
性を得ることができる時分割交換システムを提供するこ
とにある。
〔発明の概要〕
本発明に係る時分割交換システムの構成は、外部の回線
とのインタツース部、それらを時分割多重化ハイウェイ
により収容する時間スイッチおよびこれらを制御する制
御装置よりなる独立の交換機能を有した第1の交換ユニ
ットと、時間スイッチとこれを制御する制御装置よりな
る第2の交換ユニットを設け、第1の交換ユニットの時
間スイッチには2以上の第2の交換ユニットの時間スイ
ッチと接続するためのハイウェイを収容する端子を設け
、前記第2の交換ユニットの時間スイッチは2以上の前
記第1の交換ユニットと接続するためのハイウェイを収
容可能にし、2以上の該第1の交換ユニットと1以上の
該第2の交換ユニットを相互のみに時分割多重化ハイウ
ェイで接続して第1の交換ユニット相互間には直接的な
接続ハイウェイを持たないようにしたものである。
要するに、各種の回線とインターフェースする各独立し
たローカル交換ユニットと、各独立した中継交換ユニッ
トと、これら各ユニット間を接続するジャンフタハイウ
ェイとで完全群交換システムを構成し、ジャンフタハイ
ウェイ上の特定の制御用チャネルにより、情報の授受が
可能となるようにし、各ユニット間の結合を疎にするも
のである。
〔発明の実施例〕
以下、本発明の実施例を図に基づいて説明する。
第1図は、本発明に係る時分割交換システムの一実施例
の中継方式図、第2図は、そのハイウェイのチャネル割
付けのフォーマット図、第3図は、同ポーリングチャネ
ルパターンのフォーマット図、第4図は、同ジャンクタ
ハイウエイのチャネル割付けのフォーマット図、第5図
は、同出接続の通信シーケンス図である。
ここで、10はローカル交換ユニット(U#1〜#p)
、11は、その端末回路であって、アナログまたはディ
ジタルの加入者線、中継線、サービス回線等の各種の回
路りが終端されるもの、12は同じく複数の上記端末回
路11に対応するインターフェース回路(各群ごとに#
1〜#Q)、13は同じく更に所定数(Qのインターフ
ェース回路12を多重化して時間スイッチ14に収容す
るハイウェイ(HW# 1〜#m)、15は同ボーリン
グ制御回路、16は同バス、17は同処理装置、20は
中継交換ユニット(T#1〜#q)、21は、その時間
スイッチ、22は同処理装置、3oは各ローカル交換ユ
ニット10.中継交換ユニツト20間を接続するジャン
フタハイウェイ(JHW)、40はメモリと処理装置を
含む通常のネットワーク管理ユニットであって、任意の
1つのローカル交換ユニット10の時間スイッチ14に
収容される。
まず、回11Lにおける状態変化(例えば加入者発呼2
着信2番号送受信2課金パルス送出、復旧等であって、
以下、イベントの発生という)の検出を行うポーリング
動作について説明する。
ポーリング制御回路15は、例えば第3図に示すように
、あらかじめ定められた特定ハイウェイ13(例えば#
1)の特定インターフェース回路12(例えば1)の識
別情報(例えば番号)を8ms周期で当該フレーム#o
、チャネル#0に書き込む。
その書込みが行われたチャネル#0は、ハイウエイ13
(#1)に乗って時間スイッチ14でタイムスロット交
換をされた後、例えば第2図に示すように、ハイウェイ
13(#1)の下りのチャネル#1に乗せられる。
インターフェース回路12(#1)は、その番号#1を
前もって記憶しているので、それと上記チャネル#1に
書き込まれている内容(番号)とを照合し、一致すれば
自己に対するポーリングであると識別する。
そのインターフェース回路12(#1)でイベントが発
生しているときは、自己の番号(#1)と処理装置17
への通信要求とをポーリング応答として、第2図に示す
ようにハイウェイ13(#1)の上りのチャネル#1に
乗せる。
そのハイウェイ13(#1)の上りは5時間スイッチ1
4で交換された後、該当するハイウェイ13を通してポ
ーリング制御回路15へ接続される。
ポーリング制御回路15は、その応答内容について、第
3図に示すようなチャネルパターンでマルチフレームを
組むか、または先入れ先出しメモリに蓄積して処理する
ことにより、ハイウェイ13 (#1)に係るインター
フェース回路12(#1)から処理袋W117への通信
要求があったことを識別し、その旨をバス16経由で処
理装置17へ連絡する。
処理装置17は1例えば第2図に示すように。
チャネル#64〜67を使用して当該インターフェース
回路12(#l)との通信を行う。
以上のような動作シーケンスにより、端末回路11が受
信したサービス要求をインターフェース回路12経出で
処理装置17へ伝達し、当該イベントに対応した処理を
実施させることができる。
なお、上述のポーリング用のチャネルは、必要に応じて
複数としてもよい。
次に、ローカル交換ユニット10.中継交換ユニット2
0間の通信について説明する。
ローカル交換ユニット10(例えば#1)の処理装置1
7が他の同ユニット(例えば#p)へ呼を伝送する必要
があると判断した場合は、ローカル交換ユニット10 
(#1)、中継交換ユニット20(例えば#1)間のジ
ャンフタハイウェイ30を使用し、そのチャネルを特定
(サービス用の通信チャネルの設定)するとともに1例
えば第4図に示すようにチャネル#64〜67により、
行先のローカル交換ユニット10(#p)の識別情報(
例えば番号P)およびルート番号情報を中継交換ユニッ
ト20(#1)へ送信する。
この場合、既述のように各ローカル交換ユニット1oと
中継交換ユニット20間の接続は完全群交換システムで
あるため、いずれの中継交換ユニット20を選択するか
は任意でよい。
その処理装置22は、上記情報に基づき、時間スイッチ
21の交換制御をするとともに、行先のローカル交換ユ
ニット10(#p)に対し、ジャンフタハイウェイ30
経由でルート番号等を送信し、その処理を委ねる。
ここで、上記の時間スイッチ21は、完全群であって、
かつノンブロックとなるように構成されているので、ジ
ャンフタハイウェイ3oの出入間のタイムスロットに対
応関係がなく、従って入側のタイムスロットと独立の出
側タイムスロットに交換することができる。このことは
、ローカル交換ユニット1oについても同様である。
更に、出接続の動作について説明する。
ローカル交換ユニット10(例えば#1)自身内での発
呼が出接続(例えばルート#1)の場合には、各ローカ
ル交換ユニット10(#1〜#p)からアクセスが可能
なネットワーク管理ユニット40(第1図では、−例と
して#10−カル交換ユニット10のハイウェイ13を
通して時間スイッチ14に収容されている)に対し、ジ
ャンフタハイウェイ30.上記ハイウェイ13の特定チ
ャネルにより、ローカル交換ユニット10(#l)から
出接続情報(例えば被呼番号)が送信される。
それにより、第5図(a)に示すように、ネットワーク
管理ユニット40は、受信した被呼番号からルート#1
を識別するとともに、別途、各ローカル交換ユニット1
0からルートごとの全話中情報、空き発生情報を受信・
蓄積しであるので、これを用いてルート#1の空の出ト
ラックを収容しているローカル交換ユニット10(例え
ば#P)を選択し、その番号を識別する。
ルート#1に空きがなければ(全話中であれば)、必要
に応じて迂回処理を行い、別のルート番号を抽出して上
記と同様にローカル交換ユニット10を特定する。
ネットワーク管理ユニット40は、ローカル交換ユニッ
ト10(#1)へルート#1に関する所要情報および同
ユニット#pへの接続情報を送信する。
ローカル交換ユニット10(91)は、先に説明したロ
ーカル交換ユニット10.中継交換ユニット20との情
報の送受方法に従い、中継交換ユニット20に対し、ロ
ーカル交換ユニット10(#p)への接続情報、ルート
情報(#1)を送信する。
これにより、中継交換ユニット20は、ローカル交換ユ
ニット10 (#p)への接続を行うとともにルート#
1の情報を送信する。
ローカル交換ユニット10 (#p)は、そのルート#
1の情報に基づいて所望の出接続を行う。
前後したが、ネットワーク管理ユニット4oは、システ
ムに対して1装置だけ設置されており、各ローカル交換
ユニットの処理装置17とは固定チャネルが割り当てら
れている。
ネットワーク管理ユニット40が障害等で使用できない
場合には、第5図(b)に示すように、ローカル交換ユ
ニット10(#1)は、その旨を識別すると、各ルート
の各ローカル交換ユニット10への収容状況を示すテー
ブルにより、ルート#1の出トランクを収容しているロ
ーカル交換ユニット10 (#p)の選択・識別をし、
これへの接続および情報の送受について中継ユニット2
0へ伝達する。以上のシーケンスによって所望の出接続
が実現される。
この場合、各ルートの空き、または全話中状況を各ロー
カル交換ユニット10で把握しえないばかりでなく、迂
回処理を行うことができないので、出トランクの決定後
に話中に遭遇すると、再試行または呼損となる。しかし
、ネットワーク管理ユニットの障害というような特殊条
件は従来システムにおけるシステムダウンにも相当する
ものであるのに対して、若干のサービスの低下は免れな
いとしても呼の疎通は図ることができるということは極
めて有効なことである。
最後に、ポーリング制御回路17.インターフェース回
路12について更に詳細に説明する。
第6図は1本発明に係る時分割交換システムのボーリン
グ制御回路の一実施例のブロック図であって、その(a
)はポーリング送出部の主要部に対するもの、同(b)
はポーリング応答受信部の主要部に対するもの、第7図
は、同じくインターフェース回路の一実施例のブロック
図であって、ポーリング送受に関する主要部に対するも
のである。
第6図(、)において、外部からクロック、フレームパ
ルスを受信したクロック分周部100は、多層クロック
を作成して各部へ分配する。
カウンタ101は、上記のクロックを受けてカウントし
1時分割多重のハイウェイのフレーム番号、チャネル番
号を展開・デコードするデコーダ103、ポーリング用
チャネル内へ挿入するデータを作成するデータ作成回路
104およびパリティビットを付加するパリティシネレ
ータ106へビット情報を送る。
外部からの情報、例えば動作モード(常用/予備または
稼動/停止など)の情報は、後述する先入れ先出しメモ
リ119から外部情報レジタ102に書き込まれる。
フレームの先頭の同期パータンは、同期パターン発生回
路105で作成され、バッファ107でバッファリング
される。また、ポーリング用情報と端末へのモード指定
情報とは、バッファ108へバッファリングされる。
それらは、送出チャネルのタイミングに間に合うように
並直列変換回路109へ送られ、シリアルデータとして
ハイウェイ13(HW)に乗せられる。
次に第6図(b)について説明する。
インターフェース回路12から送出されたデータに同期
パターンが付加されたハイウェイ13(HW )上には
、時間スイッチ14でポーリング制御回路17が収容さ
れるハイウェイ13にスイッチングされる。
そのハイウェイ13からは、図示されていない装置によ
り、ポーリング制御回路17に対してクロック、フレー
ムパルス、シリアルデータが入力される。
クロック分周回路100(前述)は、クロック。
フレームパルスから多層クロックを作成し、必要な各部
へ分配する。
受信ハイウェイのシリアルデータを直並列変換回路11
0Aでパラレルデータに変換し、同期パターンを同期識
別回路113で識別する。同期確立後は、別の直並列変
換回路110Bでポーリング応答のデータをデータチエ
ツク回路116.パリティジェネレータ117.エンコ
ーダ118へ送る。
データのチエツク後、正しいデータであれば。
それを先入れ先出しメモリ119にライトする。
ソフトウェアは、バス16経由で上記メモリ119の内
容を定期的に読み出すことにより、どのインターフェー
ス回路12が通信を要求しているかを知る。
更に、第7図において、ポーリング制御回路15から送
出されたデータは、時間スイッチ14で、該当するイン
ターフェース回路12が収容されるハイウェイ13ヘス
イツチングされて到来するが、フレームの先頭の同期パ
ターンは、図示されていないが、インターフェース回路
12への入力前に識別され、当該インターフェース回路
12へはクロック、フレームパルス、ハイウェイシリア
ルデータが入力される。また、送出ハイウェイの同期パ
ターンも図示されていない別装置で付加する9クロック
分周回路121は、クロック、フレームパルスから当該
インターフェース回路12内で必要な多層クロックを作
成し1図示していないが各部へ分配する。
直並列変換回路122は、受信したシリアルデータ中、
動作モードに関するデコードをデコーダ124に行わせ
、例えば一般運用モード(オンライン状態)、試験モー
ド、保守運用モードの識別が行われる。また、デコーダ
125は、ポーリング情報の展開を行い、自己の番号で
あるか否か(自インターフェース回路12が処理装置1
7と通信を必要とするか否か)を識別する。
処理装置17との通信を要する場合は、その旨がプロセ
ッサ120からポーリング応答情報用のレジスタ126
へ書き込まれているので、一般運、用モード時には、バ
ッファ128Aへバッファリングする。また、試験モー
ド時には、例えば試験に対しては固定パターンを返すと
すると、バッファ128Bへバッファリングされている
当該パターンは、試験モード時にハイウェイ13に送出
される。保守・運用モードでは、例えばメイテナンスス
キャン的な情報が外部からレジスタ127へ書き込まれ
ていれば、その内容がバッファ128Cヘバツフアリン
グされる。
バッファ128A、128I3,128Cにバッファリ
ングされた内容は、送出のタイミングに間に合うように
並直列変換回路129へ送られ、シリアルデータとして
ハイウェイ13に乗せられる。
ここで、受信時の同期パターンの識別、クロック、フレ
ームパルスの抽出、送信時の同期パターンの付加および
クロック、フレームパルスの重畳は、図示されていない
装置で実施するものとしたが、インターフェース回路1
2内で行ったとしても本質的な差はない。
以上、各実施例について説明の便宜上、各側を想定した
が、これは本発明の一般性を妨げるものではないことは
明らかである。また、自局的接続。
着信接続等周知技術と同一部分については説明を省略し
たが、これも同様に本発明を限定するものではない。
〔発明の効果〕
以上、詳細に説明したように、本発明によれば、制御系
2通話路系ともに完全分散構成とするとともに、その相
互間=1疎な結合としうるので1時分割交換システムの
信頼性、経済性の向上に顕著な4 効果が得られる。
【図面の簡単な説明】
第1図は、本発明に係る時分割交換システムの一実施例
の中継方式図、第2図は、そのハイウェイのチャネル割
付のフォーマット図、第3図は、同ポーリングチャネル
パターンのフォーマット図、第4図は、同ジャンクタハ
イウエイのチャネル割付けのフォーマット図、第5図は
、同出接続の通信シーケンス図、第6図は、同ポーリン
グ制御回路の一実施例のブロック図、第7図は、同イン
ターフェース回路の一実施例のブロック図である。 10・・・ローカル交換ユニット、 11・・・端末回路、 12・・・インターフェース回路、 13・・・ハイウェイ、   14・・・時間スイッチ
、15・・・ポーリング制御回路、 16・・・バス、     17・・・処理装置、20
・・・中継交換ユニット、 21・・・時間スイッチ、  22・・・処理装置、3
o・・・ジャンフタハイウェイ、 40・・・ネットワーク管理ユニット。 第 図 纂 図 集 図 纂 苓 図 稟 5 図 (a−) 纂 5 図 (b)

Claims (1)

  1. 【特許請求の範囲】 1、外部の回線とのインタフェース部、それらを時分割
    多重化ハイウェイにより収容する時間スイッチおよびこ
    れらを制御する制御装置よりなる独立の交換機能を有し
    た第1の交換ユニットと、時間スイッチとこれを制御す
    る制御装置よりなる第2の交換ユニットを設け、第1の
    交換ユニットの時間スイッチには2以上の第2の交換ユ
    ニットの時間スイッチと接続するためのハイウェイを収
    容する端子を設け、前記第2の交換ユニットの時間スイ
    ッチは2以上の前記第1の交換ユニットと接続するため
    のハイウェイを収納可能にし、2以上の該第1の交換ユ
    ニットと1以上の該第2の交換ユニットを相互のみに時
    分割多重化ハイウェイで接続して第1の交換ユニット相
    互間には直接的な接続ハイウェイを持たないことを特徴
    とする時分割交換システム。 2、前記第1の交換ユニットは全ての前記第2の交換ユ
    ニットと、前記第2の交換ユニットは全ての前記第1の
    交換ユニットと前記時分割多重化ハイウェイにより接続
    したことを特徴とする特許請求の範囲第1項記載の時分
    割交換システム。 3、前記第1および第2の両交換ユニットは、前記制御
    装置間で通信を行い、呼設定時、第2の交換ユニットは
    、発側の第1の交換ユニットから受信する着側の第1の
    交換ユニット番号により該第1の交換ユニットとの相互
    接続時分割ハイウェイの空きタイムスロットを選択し、
    同じく該発側の第1の交換ユニットから指定される着側
    の第1の交換ユニットとの間の相互接続ハイウェイのタ
    イムスロットとスイッチを制御して接続するとともに、
    同時に該発側の第1の交換ユニットから受信している該
    着側の第1の交換ユニットでの交換動作に必要な補助情
    報を該着側の第1の交換ユニットに転送し、呼終了時は
    発側または着側の指令によりスイッチを切断し、その他
    の発側と着側の相互通信については信号を転送するのみ
    としたことを特徴とする特許請求の範囲第1項記載の時
    分割交換システム。 4、前記第1及び第2の両交換ユニット間の通信路は前
    記相互接続ハイウェイ上の1以上のタイムスロットを固
    定的に用いることを特徴とする特許請求の範囲第3項記
    載の時分割交換システム。 5、任意の前記第1の交換ユニットは、複数の前記第1
    の交換ユニットに収容されている他局への回線に関する
    リソースの状態と迂回ルーチングを管理するネットワー
    ク管理機能を有し、他局への出接続呼を扱う発側の第1
    の交換ユニットは呼設定に際し該ネットワーク管理機能
    を持った第1の交換ユニットに任意の第2の交換ユニッ
    ト経由アクセスして必要情報を伝達し、該ネットワーク
    管理機能を持った第1の交換ユニットは該情報に基づい
    て空き回線を有する第1の交換ユニット番号を決定し、
    発側の第1の交換ユニットは返送された該番号により呼
    設定動作を開始するようにしたことを特徴とする特許請
    求の範囲第3項記載の時分割交換システム。 6、前記ネットワーク管理機能を有する第1の交換ユニ
    ットは、外部との回線インタフェースおよび交換機能を
    持たないことを特徴とする特許請求の範囲第5項記載の
    時分割交換システム。 7、前記各第1の交換ユニットは自ユニットに収容する
    各出方路の空き話中状態またはそれに準する状態の発生
    に応じて前記ネットワーク管理機能を有する第1の交換
    ユニットに任意の第2の交換ユニット経由連絡し、ネッ
    トワーク管理機能を有する第1の交換ユニットでは該情
    報に基づき各第1の交換ユニット毎かつ出方路毎の情報
    表示テーブルを設け、これにより空き回線のある第1の
    交換ユニットを決定することを特徴とする特許請求の範
    囲第5項記載の時分割交換システム。 8、前記各第1の交換ユニットには第1の交換ユニット
    毎の他局への出方路収容状況を記憶させておき、前記ネ
    ットワーク管理機能を有する第1の交換ユニットが使用
    不能時該収容情報をもとに着側の第1の交換ユニットを
    決定し呼設定動作にはいり、該着側の第1の交換ユニッ
    トで所望方路の全話中に遭遇時その情報を前記第2の交
    換ユニット経由受信し前呼設定動作をクリアするととも
    に上記の出方路収容状況により他の着側第1の交換ユニ
    ットを決定し再試行を行うことを特徴とする特許請求の
    範囲第7項記載の時分割交換システム。 9、前記第1及び第2の交換ユニットの時間スイッチを
    ノンブロック構成とし、発側相互接続ハイウェイのタイ
    ムスロット選択を着側の前記相互接続ハイウェイのタイ
    ムスロットの空き話中と独立に行うことを特徴とする特
    許請求の範囲第1の記載の時分割交換システム。
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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS55156494A (en) * 1979-05-24 1980-12-05 Kokusai Denshin Denwa Co Ltd <Kdd> Alternation system between exchange unit
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