JPH0292122A - 光受信装置 - Google Patents
光受信装置Info
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- JPH0292122A JPH0292122A JP63245771A JP24577188A JPH0292122A JP H0292122 A JPH0292122 A JP H0292122A JP 63245771 A JP63245771 A JP 63245771A JP 24577188 A JP24577188 A JP 24577188A JP H0292122 A JPH0292122 A JP H0292122A
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- 230000003111 delayed effect Effects 0.000 claims description 10
- 230000001934 delay Effects 0.000 claims 1
- 230000001172 regenerating effect Effects 0.000 claims 1
- 238000006243 chemical reaction Methods 0.000 abstract description 21
- 230000005540 biological transmission Effects 0.000 description 8
- 238000010586 diagram Methods 0.000 description 4
- 230000002457 bidirectional effect Effects 0.000 description 2
- 239000013307 optical fiber Substances 0.000 description 2
- 108010076504 Protein Sorting Signals Proteins 0.000 description 1
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- 238000000034 method Methods 0.000 description 1
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- Optical Communication System (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の目的］
本発明は光パルス信号を受信して、異なる符号形式の電
圧パルス信号に変換する光受信装置に関するものである
。
圧パルス信号に変換する光受信装置に関するものである
。
（従来の技術〉
ディジタル光伝送系では光フアイバ伝送が用いられ、光
の強度を用いた符号伝送が一般的である。このため、連
続信号で平均値が一定のＣＭ Ｉ （ｃｏｄｅ
ｍａｒｋ １ｎｖｅｒｓｉｏｎ ） やＤＭＩ
（ｄｉｆｆｅｒｅｎｔｉａｌ ｍａｒｋ １ｎｖｅｒｅ
ｓｉｏｎ）などの符号形式が用いられることか多い。し
かしながら、電気回路においては、ディジタル原信号の
“′１″、′“０１７にそれぞれ占有率１００％の“１
Ｉ＋ １１０ Ｉ＋を対応させたＮＲＺ符号形式の
電圧パルス列を使用するため、これら間の符合形式の変
換を光受信装置で行っている。
の強度を用いた符号伝送が一般的である。このため、連
続信号で平均値が一定のＣＭ Ｉ （ｃｏｄｅ
ｍａｒｋ １ｎｖｅｒｓｉｏｎ ） やＤＭＩ
（ｄｉｆｆｅｒｅｎｔｉａｌ ｍａｒｋ １ｎｖｅｒｅ
ｓｉｏｎ）などの符号形式が用いられることか多い。し
かしながら、電気回路においては、ディジタル原信号の
“′１″、′“０１７にそれぞれ占有率１００％の“１
Ｉ＋ １１０ Ｉ＋を対応させたＮＲＺ符号形式の
電圧パルス列を使用するため、これら間の符合形式の変
換を光受信装置で行っている。
第３図は従来の装置を示すもので、光電変挽回路２０、
インバータ２２とＮＡＮＤ回路２３で構成される遅延論
理ゲート２４、フリップフロップ２５、リタイミング回
路２６および遅延回路２７で構成される。
インバータ２２とＮＡＮＤ回路２３で構成される遅延論
理ゲート２４、フリップフロップ２５、リタイミング回
路２６および遅延回路２７で構成される。
この装置の動作を第４図を用いて説明する。図において
３Ａは原信号列を示し、図では１００１１１０の例を示
している。３Ｂは光信号パルス列で原信号３ＡをＣＭＩ
符号形式に符号変換したもので、光伝送の送信側で強度
変調することによって得られる。この光信号が光電変換
回路２０の受光素子２１で受光されて、１７２ビツト遅
延した電圧パルス３Ｃに変換される。パルス３Ｃは遅延
論理ゲート２４内で２分され、一方は直接ＮＡＮＤ回路
２３へ、他方はインバータ２２を経て１／２ビツト遅延
逆相パルス３Ｄとなり、ＮＡＮＤ回路２３へ入力される
。
３Ａは原信号列を示し、図では１００１１１０の例を示
している。３Ｂは光信号パルス列で原信号３ＡをＣＭＩ
符号形式に符号変換したもので、光伝送の送信側で強度
変調することによって得られる。この光信号が光電変換
回路２０の受光素子２１で受光されて、１７２ビツト遅
延した電圧パルス３Ｃに変換される。パルス３Ｃは遅延
論理ゲート２４内で２分され、一方は直接ＮＡＮＤ回路
２３へ、他方はインバータ２２を経て１／２ビツト遅延
逆相パルス３Ｄとなり、ＮＡＮＤ回路２３へ入力される
。
従って、ＮＡＮＤ回路２３の出力は１７２ビツト遅延し
た信号３Ｆで示す擬似Ｒ７信号となる。この信＠３Ｆは
フリップフロップ２５に入力される。一方、光電変換回
路２１からリタイミング回路２６を介してクロックパル
スが再生され、遅延回路２７により、遅延されてフリッ
プフロップ２５を駆動する。３Ｆは遅延回路２７の出力
パルスを示す。フリップフロップ２７からは１ビット期
間内で高レベルが“′１″に、低レベルが１１０ Ｉ＋
に対応した１００１１１０のＮＲＺ電気パルス符号列３
Ｇが出力される。図中ｔｓはノリツブフロップ２７のセ
ットアツプタイムを示す。
た信号３Ｆで示す擬似Ｒ７信号となる。この信＠３Ｆは
フリップフロップ２５に入力される。一方、光電変換回
路２１からリタイミング回路２６を介してクロックパル
スが再生され、遅延回路２７により、遅延されてフリッ
プフロップ２５を駆動する。３Ｆは遅延回路２７の出力
パルスを示す。フリップフロップ２７からは１ビット期
間内で高レベルが“′１″に、低レベルが１１０ Ｉ＋
に対応した１００１１１０のＮＲＺ電気パルス符号列３
Ｇが出力される。図中ｔｓはノリツブフロップ２７のセ
ットアツプタイムを示す。
以上のような符号変換の過程で、ＣＭＩ光パルス列が入
射してからＮＲＺ電圧パルス列が出力されるまでの最小
遅延時間は″光電変換回路の遅延時間”＋２ｘ”ゲート
遅延時間Ｎ ＋ｌｌフリップフロップのセットアツプタ
イムを含む遅延時間″となる。ここにｆを伝送ピッ１ヘ
レイトとすると、ゲート遅延時間ユ１／２ｆである。
射してからＮＲＺ電圧パルス列が出力されるまでの最小
遅延時間は″光電変換回路の遅延時間”＋２ｘ”ゲート
遅延時間Ｎ ＋ｌｌフリップフロップのセットアツプタ
イムを含む遅延時間″となる。ここにｆを伝送ピッ１ヘ
レイトとすると、ゲート遅延時間ユ１／２ｆである。
〈発明が解決しようとする課題〉
しかしながら、データの両方向伝送を含め、情報処理の
遅延が少ないことが望まれ、−層遅延の少ない符号変換
の達成ならびに装置の動作の簡素化が要請されている。
遅延が少ないことが望まれ、−層遅延の少ない符号変換
の達成ならびに装置の動作の簡素化が要請されている。
本発明は遅延の少ない符号形式の変換を達成ししかも動
作を簡素化して信頼性を高めた光受信装置を得るもので
ある。
作を簡素化して信頼性を高めた光受信装置を得るもので
ある。
［発明の構成］
（課題を解決するための手段〉
本発明は、原信号を一つの符号形式で伝送する光パルス
信号を受光素子で受光し、他の符号形式の電圧パルス信
号に変換する光受信装置において、前記原信号を担い所
定のビット速度を有する光パルス信号を受光し第１の電
流パルス出力に変換する第１の受光素子と、前記第１の
電流パルス出力を電圧変換して、実質的に前記ビット速
度の２倍の逆数に等しい遅延時間で遅延した逆相電圧パ
ルス出力を出力する第１の電圧増幅器と、前記光パルス
信号を受光し第２の電流パルス出力に変換する第２の受
光素子と、前記逆相電圧パルス出力で前記第２の受光素
子のバイアスを制御し論理演算を行う手段と、前記第２
の電流パルス出力を電圧変換して実質的に前記ビット速
度の２倍の逆数に等しい遅延時間で遅延した電圧パルス
出力を出力する第２の電圧増幅器と、第１の電圧増幅器
の出力からクロックパルスを再生する手段と、前記電圧
パルス出力と前記クロックパルスとから光パルス信号と
は異なる符号形式の電圧パルスを得る手段とを具備する
ことを特徴とする光受信装置にある。
信号を受光素子で受光し、他の符号形式の電圧パルス信
号に変換する光受信装置において、前記原信号を担い所
定のビット速度を有する光パルス信号を受光し第１の電
流パルス出力に変換する第１の受光素子と、前記第１の
電流パルス出力を電圧変換して、実質的に前記ビット速
度の２倍の逆数に等しい遅延時間で遅延した逆相電圧パ
ルス出力を出力する第１の電圧増幅器と、前記光パルス
信号を受光し第２の電流パルス出力に変換する第２の受
光素子と、前記逆相電圧パルス出力で前記第２の受光素
子のバイアスを制御し論理演算を行う手段と、前記第２
の電流パルス出力を電圧変換して実質的に前記ビット速
度の２倍の逆数に等しい遅延時間で遅延した電圧パルス
出力を出力する第２の電圧増幅器と、第１の電圧増幅器
の出力からクロックパルスを再生する手段と、前記電圧
パルス出力と前記クロックパルスとから光パルス信号と
は異なる符号形式の電圧パルスを得る手段とを具備する
ことを特徴とする光受信装置にある。
（作 用）
光パルス信号を２個の受光素子で受光し、一方の出力で
他方の受光素子のバイアスを制御するようにして、符号
形式の変換を受光素子の光電変換部分に論理演算機能を
もたせて行うので、符号形式変換、復帰化を、遅延時間
を最少限にして達成できる。
他方の受光素子のバイアスを制御するようにして、符号
形式の変換を受光素子の光電変換部分に論理演算機能を
もたせて行うので、符号形式変換、復帰化を、遅延時間
を最少限にして達成できる。
（実施例）
第１図は本発明の一実施例の光受信装置を示し、光ファ
イバによって伝送されてきた光パルス１９が光電変換回
路１０に導入される。この光パルス１９は送信側で原信
号をＣ１ｌ符号形式に変調したものである。ＣＭ Ｉ
（ｃｏｄｅ ｍａｒｋ １ｎｖｅｒｓｉｏｎ ）は原信
号の“ＯｌＦには占有率５０％の１（１Ｉ＋を対応ら させ、原信号の１１１１＋には占有率１００％の１１１
１＋と“○″を交互に対応させたもので、例えば、１ビ
ット期間内で高又は低レベル一定の場合を１１１ ｕ、
前半低レベル、後半高レベルの場合を１１０ ＩＴとす
る符号形式である。
イバによって伝送されてきた光パルス１９が光電変換回
路１０に導入される。この光パルス１９は送信側で原信
号をＣ１ｌ符号形式に変調したものである。ＣＭ Ｉ
（ｃｏｄｅ ｍａｒｋ １ｎｖｅｒｓｉｏｎ ）は原信
号の“ＯｌＦには占有率５０％の１（１Ｉ＋を対応ら させ、原信号の１１１１＋には占有率１００％の１１１
１＋と“○″を交互に対応させたもので、例えば、１ビ
ット期間内で高又は低レベル一定の場合を１１１ ｕ、
前半低レベル、後半高レベルの場合を１１０ ＩＴとす
る符号形式である。
第２図は原信号を１００１１１０とした場合の本実施例
の動作を説明するもので、１Ａが原信号、１ＢがＣＭＩ
光パルス信号である。光電変換回路１０は２組の受光素
子１１．１３を有しており、各受光素子１１．１３はほ
ぼ等しいパワーの同じ光パルス信号を受光する。これら
受光素子にはアバランシェフォトダイオードやｐｌｎフ
ォトダイオードが用いられ、光を受けたときに光電変換
して電流が流れるようにバイアス電圧が付与される。第
１の受光素子１１は光パルス信号１Ｂを受光すると、電
流パルス出力に変換するが、この出力は第１の電圧増幅
器１２に入力され、電圧パルス出力として取り出される
。但し、この出力は光パルスに対して１７２ビツト遅延
され、かつ逆相の電圧パルス出力（第２図１０）となる
。すなわち、この遅延時間は実質的に光パルス信号のビ
ット速度の２倍の逆数に等しい。同出力は第１の電圧増
幅器１２の逆相出力端子１２ａに接続された第２の受光
素子１３の制御端子１３ａに印加されて、第２の受光素
子のバイアスを制御する。
の動作を説明するもので、１Ａが原信号、１ＢがＣＭＩ
光パルス信号である。光電変換回路１０は２組の受光素
子１１．１３を有しており、各受光素子１１．１３はほ
ぼ等しいパワーの同じ光パルス信号を受光する。これら
受光素子にはアバランシェフォトダイオードやｐｌｎフ
ォトダイオードが用いられ、光を受けたときに光電変換
して電流が流れるようにバイアス電圧が付与される。第
１の受光素子１１は光パルス信号１Ｂを受光すると、電
流パルス出力に変換するが、この出力は第１の電圧増幅
器１２に入力され、電圧パルス出力として取り出される
。但し、この出力は光パルスに対して１７２ビツト遅延
され、かつ逆相の電圧パルス出力（第２図１０）となる
。すなわち、この遅延時間は実質的に光パルス信号のビ
ット速度の２倍の逆数に等しい。同出力は第１の電圧増
幅器１２の逆相出力端子１２ａに接続された第２の受光
素子１３の制御端子１３ａに印加されて、第２の受光素
子のバイアスを制御する。
第２の受光素子１３は光パルス信号を受光すると光電変
換して電流パルス出力に変換する。この電流パルス出力
は第２の電圧増幅器１４に入力されるが、この電流パル
ス自体が、バイアス制御により、逆相パルス出力によっ
て変調される。すなわち、第２の受光素子１３の電流パ
ルスは光パルス信号１Ｂと逆相電圧パルス出力１Ｃの論
理演算処理の出力である。この電流パルスにもとずき、
第２の電圧増幅器１４の逆相出力端子１４ａに、１／２
ビツト遅延した逆相の電圧パルス出力１Ｄが出力する。
換して電流パルス出力に変換する。この電流パルス出力
は第２の電圧増幅器１４に入力されるが、この電流パル
ス自体が、バイアス制御により、逆相パルス出力によっ
て変調される。すなわち、第２の受光素子１３の電流パ
ルスは光パルス信号１Ｂと逆相電圧パルス出力１Ｃの論
理演算処理の出力である。この電流パルスにもとずき、
第２の電圧増幅器１４の逆相出力端子１４ａに、１／２
ビツト遅延した逆相の電圧パルス出力１Ｄが出力する。
この場合、第１の電圧増幅器１２の電圧出力１Ｃが低レ
ベル電圧のとき、第２の電圧増幅器１４の出力は高レベ
ル電圧となる。高レベルのとき、第１の電圧増幅器１２
と同じ変換時間後、逆相出力端子１４ａにＣＭＩ電圧パ
ルス列の逆相で遅延された電圧パフ ルスを生じる。この遅延時間は入射光パルスを基準にす
ると、第１の電圧増幅器１２の逆相電圧パルス出力の遅
延にさらに実質的に同じ遅延時間を加えたものである。
ベル電圧のとき、第２の電圧増幅器１４の出力は高レベ
ル電圧となる。高レベルのとき、第１の電圧増幅器１２
と同じ変換時間後、逆相出力端子１４ａにＣＭＩ電圧パ
ルス列の逆相で遅延された電圧パフ ルスを生じる。この遅延時間は入射光パルスを基準にす
ると、第１の電圧増幅器１２の逆相電圧パルス出力の遅
延にさらに実質的に同じ遅延時間を加えたものである。
一方、第１の電圧増幅器１２の出力の一部からりタイミ
ング回路１６および遅延回路１７により、再生クロック
パルス１Ｅが再生され、先の電圧パルス出力１Ｄととも
にノリツブフロップ１５に入力される。すなわち、電圧
出力パルス１Ｄはクロックパルス１Ｆにより検波されて
、ＮＲＺ電圧パルス信＠１Ｆが得られる。この場合、Ｃ
ＭＩ光パルス信号が入射してからＮＲＺ電圧パルス信号
が出力されるまでの最小遅延時間は、２×″光電光電変
路遅延時間！！ ＋１１フリツプフロツプのセットアツ
プタイムｔｓを含む遅延時間″となる。ここに、ｆを伝
送ビットレイトとすると、光電変換回路遅延時間＝１／
２ｆである。
ング回路１６および遅延回路１７により、再生クロック
パルス１Ｅが再生され、先の電圧パルス出力１Ｄととも
にノリツブフロップ１５に入力される。すなわち、電圧
出力パルス１Ｄはクロックパルス１Ｆにより検波されて
、ＮＲＺ電圧パルス信＠１Ｆが得られる。この場合、Ｃ
ＭＩ光パルス信号が入射してからＮＲＺ電圧パルス信号
が出力されるまでの最小遅延時間は、２×″光電光電変
路遅延時間！！ ＋１１フリツプフロツプのセットアツ
プタイムｔｓを含む遅延時間″となる。ここに、ｆを伝
送ビットレイトとすると、光電変換回路遅延時間＝１／
２ｆである。
従って、従来装置の遅延時間よりも出力までの遅延時間
が短縮される。
が短縮される。
以上の実施例ではＣＭＩ光パルスのＮＲＺ電圧パルスへ
の変換について説明したが、その他の符月形式たとえば
、ＤＭＩ形式の光パルスから他の形式の電圧パルスに変
換する場合にも適用できるものである。
の変換について説明したが、その他の符月形式たとえば
、ＤＭＩ形式の光パルスから他の形式の電圧パルスに変
換する場合にも適用できるものである。
［発明の効果］
本発明によれば、符号形式の変換に要する遅延時間を短
縮できるため、両方向伝送など応答時間の短縮が要求さ
れる用途に、より適した光受信装置を得ることができる
。また受光素子のバイアスを直接制御して論理演算する
機能を有するため、従来必要であった演算ゲートが省略
できて簡素な回路構成を得ることができる。
縮できるため、両方向伝送など応答時間の短縮が要求さ
れる用途に、より適した光受信装置を得ることができる
。また受光素子のバイアスを直接制御して論理演算する
機能を有するため、従来必要であった演算ゲートが省略
できて簡素な回路構成を得ることができる。
第１図は本発明の一実施例を示すブロック図、第２図は
第１図の実施例の動作を説明するための波形図、第３図
は従来の光受信装置を示すブロック図、第４図は第３図
を説明する波形図である。 １０・・・光電変換回路、 １１・・・第１の受光素子、 １２・・・第１の電圧増幅器、 １２ａ・・・逆相出力端子、 １３・・・第２の受光素子、 １４・・・第２の電圧増幅器、 １５・・・フリップフロップ、 １６・・・リタイミング回路、 １７・・・遅延回路。
第１図の実施例の動作を説明するための波形図、第３図
は従来の光受信装置を示すブロック図、第４図は第３図
を説明する波形図である。 １０・・・光電変換回路、 １１・・・第１の受光素子、 １２・・・第１の電圧増幅器、 １２ａ・・・逆相出力端子、 １３・・・第２の受光素子、 １４・・・第２の電圧増幅器、 １５・・・フリップフロップ、 １６・・・リタイミング回路、 １７・・・遅延回路。
Claims (1)
- 原信号を一つの符号形式で伝送する光パルス信号を受光
素子で受光し、他の符号形式の電圧パルス信号に変換す
る光受信装置において、前記原信号を担い所定のビット
速度を有する光パルス信号を受光し第１の電流パルス出
力に変換する第１の受光素子と、前記第１の電流パルス
出力を電圧変換して、実質的に前記ビット速度の２倍の
逆数に等しい遅延時間で遅延した逆相電圧パルス出力を
出力する第１の電圧増幅器と、前記光パルス信号を受光
し第２の電流パルス出力に変換する第２の受光素子と、
前記逆相電圧パルス出力で前記第２の受光素子のバイア
スを制御して論理演算を行う手段と、前記第２の電流パ
ルス出力を電圧変換して実質的に前記ビット速度の２倍
の逆数に等しい遅延時間で遅延した電圧パルス出力を出
力する第２の電圧増幅器と、第１の電圧増幅器の出力か
らクロックパルスを再生する手段と、前記電圧パルス出
力と前記クロックパルスとから光パルス信号とは異なる
符号形式の電圧パルスを得る手段とを具備することを特
徴とする光受信装置
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63245771A JPH0292122A (ja) | 1988-09-29 | 1988-09-29 | 光受信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63245771A JPH0292122A (ja) | 1988-09-29 | 1988-09-29 | 光受信装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0292122A true JPH0292122A (ja) | 1990-03-30 |
Family
ID=17138569
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63245771A Pending JPH0292122A (ja) | 1988-09-29 | 1988-09-29 | 光受信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0292122A (ja) |
-
1988
- 1988-09-29 JP JP63245771A patent/JPH0292122A/ja active Pending
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