JPH02272612A - 静止形無効電力補償装置のゲートパルス発生方法 - Google Patents
静止形無効電力補償装置のゲートパルス発生方法Info
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- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
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- H03K17/08—Modifications for protecting switching circuit against overcurrent or overvoltage
- H03K17/081—Modifications for protecting switching circuit against overcurrent or overvoltage without feedback from the output circuit to the control circuit
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- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の目的〕
(産業上の利用分野)
本発明は、静止形無効電力補償装置、特にサイリスタス
イッチドキャパシタ(以下TSCと略す)に係り、電力
系統・配電系統の無効電力補償あるいは、電圧変動抑制
等に用いられる静止形無効電力補償装置のゲートパルス
発生方法に関する。
イッチドキャパシタ(以下TSCと略す)に係り、電力
系統・配電系統の無効電力補償あるいは、電圧変動抑制
等に用いられる静止形無効電力補償装置のゲートパルス
発生方法に関する。
(従来の技術)
複数のサイリスタの逆並列から成るサイリスクスイッチ
、このサイリスタスイッチによりオン・オフ制御される
コンデンサ、このコンデンサの直列リアクトルからなる
静止形無動電力補償用のTSCの一構成例を第3図に示
す。
、このサイリスタスイッチによりオン・オフ制御される
コンデンサ、このコンデンサの直列リアクトルからなる
静止形無動電力補償用のTSCの一構成例を第3図に示
す。
第3図において、1は変圧器、2はコンデンサ、3はサ
イリスタスイッチ、4は直列リアクトル、5はサイリス
タスイッチ3の電圧検出回路である。
イリスタスイッチ、4は直列リアクトル、5はサイリス
タスイッチ3の電圧検出回路である。
U及びXはサイリスタスイッチを構成する各々順方向サ
イリスタ及び逆方向サイリスタである。
イリスタ及び逆方向サイリスタである。
FVU、 FVxは各々順、逆電圧信号である。vsは
変圧器1の2次側の回路電圧である。
変圧器1の2次側の回路電圧である。
第4図は、第3図の変圧器1の2次側の回路電圧Vs、
サイリスタスイッチ3の極間電圧VAK、 コンデンサ
の電圧、電流Vc、Ic、順、逆電圧信号FVυ。
サイリスタスイッチ3の極間電圧VAK、 コンデンサ
の電圧、電流Vc、Ic、順、逆電圧信号FVυ。
FVx、位相信号PHU、PHx、通電期間信号Pt1
Su 、PH3X、ゲートパルス信号GPυ、 GPx
及びTSCオン信号ONの概略を示したものである。こ
こで示されるように、TSCオン信号ONが“1”とな
った以後、サイリスタスイッチが導通を開始し、コンデ
ンサに電流が通電される。
Su 、PH3X、ゲートパルス信号GPυ、 GPx
及びTSCオン信号ONの概略を示したものである。こ
こで示されるように、TSCオン信号ONが“1”とな
った以後、サイリスタスイッチが導通を開始し、コンデ
ンサに電流が通電される。
第5図に第4図の動作を行う従来のTSCゲート回路の
一例を示す。6はフリップフロップ回路であり、TSC
の回路電圧に対し所定の位相差、所定の幅を有する位相
信号U相に対してはpHυ、X相に対してはPIIxで
セットされ、その逆相の位相信号即ちU相に対してはP
HX、 X相に対してはp++u信号でリセットされる
。7は上記フリップフロップの出力として得られた通電
期間信号PH5υ又はPH3x、電圧信号FVU又はF
Vx、ON信号ONの論理積をとるAND回路、8はワ
ンショッ1〜回路である。
一例を示す。6はフリップフロップ回路であり、TSC
の回路電圧に対し所定の位相差、所定の幅を有する位相
信号U相に対してはpHυ、X相に対してはPIIxで
セットされ、その逆相の位相信号即ちU相に対してはP
HX、 X相に対してはp++u信号でリセットされる
。7は上記フリップフロップの出力として得られた通電
期間信号PH5υ又はPH3x、電圧信号FVU又はF
Vx、ON信号ONの論理積をとるAND回路、8はワ
ンショッ1〜回路である。
位相信号用IUの立−ヒリ時点は定常状態においてコン
デンサ電流が正方向(U相すイリスタ)に通電開始する
時点となるように設定され、電力系統及びTSC回路の
抵抗分が小さい場合には、TSC回路電圧Vaと位相信
号用1sυどの位相差αは、II@90゜である。位相
信号用1xは、位相信号PHυと位相が180° 反転
することを除いて同様に設定されるので、通電期間信号
同1sU、PIISXはパルス幅略180°の互いに反
転した信号となる。
デンサ電流が正方向(U相すイリスタ)に通電開始する
時点となるように設定され、電力系統及びTSC回路の
抵抗分が小さい場合には、TSC回路電圧Vaと位相信
号用1sυどの位相差αは、II@90゜である。位相
信号用1xは、位相信号PHυと位相が180° 反転
することを除いて同様に設定されるので、通電期間信号
同1sU、PIISXはパルス幅略180°の互いに反
転した信号となる。
(発明が解決しようとする課り
上記の従来のゲートパルス発生方法においては逆相の通
電期間信号即ちU相の場合はPH9x、 X相の場合は
円ISυ信号の立上りと共に(図中A点又はB点)該当
相の通電期間信号同ISυあるいは円ISxがOとなり
、グー1〜パルスが発生されなくなるが、この時点はα
=90°即ち素子に逆圧のかかり始める時点である。従
って回路電圧に歪みがあった場合などには電圧がOVを
はさんで振動し、充分な逆圧がかからないために直列に
接続した複数の素子のうち一部が消弧し、一部が消弧せ
ず通電状態のままとなる部分ブロッキングの状態となる
ことがあった。部分ブロッキングの状態は消弧した素子
にのみ回路電圧がかかるので素子の耐圧を越え素子を破
損させる恐れがある。
電期間信号即ちU相の場合はPH9x、 X相の場合は
円ISυ信号の立上りと共に(図中A点又はB点)該当
相の通電期間信号同ISυあるいは円ISxがOとなり
、グー1〜パルスが発生されなくなるが、この時点はα
=90°即ち素子に逆圧のかかり始める時点である。従
って回路電圧に歪みがあった場合などには電圧がOVを
はさんで振動し、充分な逆圧がかからないために直列に
接続した複数の素子のうち一部が消弧し、一部が消弧せ
ず通電状態のままとなる部分ブロッキングの状態となる
ことがあった。部分ブロッキングの状態は消弧した素子
にのみ回路電圧がかかるので素子の耐圧を越え素子を破
損させる恐れがある。
本発明の目的は上記のような不具合を除き、部分ブロッ
キングからサイリスタ素子を保護し、サイリスタバルブ
の破損を防止するゲートパルス発生装置を堤供すること
にある。
キングからサイリスタ素子を保護し、サイリスタバルブ
の破損を防止するゲートパルス発生装置を堤供すること
にある。
(課題を解決するための手段)
上記目的を達成する為に本発明においては第1図に示す
ように位相信号pHとTSCON信号ONとの論理積を
とるAND回路9と所定幅を有する通電期間信号PII
S を発生させるフリップフロップ回路10と、このフ
リップフロップ回路10からの通電期間信号とサイリス
タスイッチの電圧信号FVと1゛SCのON信号ONと
の論理積をとるAND回路11、ワンショク1〜回路1
21位相信号PHに所定の幅を持たせるワンショット回
路13、このワンショッ1〜回路13の出力と電圧信号
FVの反転信号との論理積をとるAND回路14、この
AND回路14の出力が所定期間以上rr 1 uとな
った時点から10″となるまで“1”を出力する遅延回
路15とから構成される。
ように位相信号pHとTSCON信号ONとの論理積を
とるAND回路9と所定幅を有する通電期間信号PII
S を発生させるフリップフロップ回路10と、このフ
リップフロップ回路10からの通電期間信号とサイリス
タスイッチの電圧信号FVと1゛SCのON信号ONと
の論理積をとるAND回路11、ワンショク1〜回路1
21位相信号PHに所定の幅を持たせるワンショット回
路13、このワンショッ1〜回路13の出力と電圧信号
FVの反転信号との論理積をとるAND回路14、この
AND回路14の出力が所定期間以上rr 1 uとな
った時点から10″となるまで“1”を出力する遅延回
路15とから構成される。
(作用)
第1図の構成において通電期間円(Suは位相信号pH
uの立上りでフリップフロップ9をセットして1′″と
なり、逆相の位相信号PHXが′“1”となってから所
定の期間(5〜10 ms )中にU相、X相両相の電
圧信号FVが0″となる状態が所定の期間続いたらフリ
ップフロップ9をリセットしII OIIとなる。
uの立上りでフリップフロップ9をセットして1′″と
なり、逆相の位相信号PHXが′“1”となってから所
定の期間(5〜10 ms )中にU相、X相両相の電
圧信号FVが0″となる状態が所定の期間続いたらフリ
ップフロップ9をリセットしII OIIとなる。
(実施例)
本発明の一実施例を第1図と第2図を用いて説明する。
9は位相信号PHとTSCのON信号ONとの論理積を
とるAND回路lOは通電期間信号同Isを発生させる
フリップフロップ回路、11は上記フリップフロップ回
路10からの通電期間信号同+S、 サイリスタスイ
ッチの電圧信号FV、TSCのON信号ONとの論理積
をとるAND回路、 12.13はワンシヨツト回路、
14はワンショット回路13の出力と電圧信号FVの反
転信号との論理積をとるAND回路、15はAND回路
13の出力が所定期間以上# I I+となった時から
“0”となるまで“1”′を出力する遅延回路15であ
る。
とるAND回路lOは通電期間信号同Isを発生させる
フリップフロップ回路、11は上記フリップフロップ回
路10からの通電期間信号同+S、 サイリスタスイ
ッチの電圧信号FV、TSCのON信号ONとの論理積
をとるAND回路、 12.13はワンシヨツト回路、
14はワンショット回路13の出力と電圧信号FVの反
転信号との論理積をとるAND回路、15はAND回路
13の出力が所定期間以上# I I+となった時から
“0”となるまで“1”′を出力する遅延回路15であ
る。
第2図にTSCの回路電圧Vs、コンデンサ電圧Vc、
位相信号円lu、PHx、順、逆電圧信号FVυ、 F
Vx、ゲートパルス信号GP、、GPx、 ワンショッ
ト回路13の出力a−U、a−X、フリップフロップl
Oのリセット信号b−u、b−x、通電区間信号PH5
υ、 PH5xの関係を示す。通電期間信号PH3Uの
リセットは、逆相のサイリスタの通電を確認して後、即
ち逆相の通電区間となりpHxが““1”となってから
電圧検出信号FVu、FVx共に所定期間以上ii O
toとなったことを確認して後に行われる。従ってX相
の通電期間となった直後、例えば回路電圧の撹乱により
コンデンサ電圧Vcが振動しU相の複数の直列接続され
た素子のうち一部の素子が消弧しても再びゲートパルス
を発生させ点弧させる。つまり、逆並列の相の通電が所
定期間、例えば2IL1以上継続しU相の直列に接続さ
れた複数のサイリスタ素子のすべてが、消弧できる状態
となった時点で、 Plus、信号を“0”にするので
部分ブロッキングを防止できる。
位相信号円lu、PHx、順、逆電圧信号FVυ、 F
Vx、ゲートパルス信号GP、、GPx、 ワンショッ
ト回路13の出力a−U、a−X、フリップフロップl
Oのリセット信号b−u、b−x、通電区間信号PH5
υ、 PH5xの関係を示す。通電期間信号PH3Uの
リセットは、逆相のサイリスタの通電を確認して後、即
ち逆相の通電区間となりpHxが““1”となってから
電圧検出信号FVu、FVx共に所定期間以上ii O
toとなったことを確認して後に行われる。従ってX相
の通電期間となった直後、例えば回路電圧の撹乱により
コンデンサ電圧Vcが振動しU相の複数の直列接続され
た素子のうち一部の素子が消弧しても再びゲートパルス
を発生させ点弧させる。つまり、逆並列の相の通電が所
定期間、例えば2IL1以上継続しU相の直列に接続さ
れた複数のサイリスタ素子のすべてが、消弧できる状態
となった時点で、 Plus、信号を“0”にするので
部分ブロッキングを防止できる。
又、X相の通電のチエツクはX相の位相信号の立上りか
ら所定期間(例えば5〜10 as )のみ行う。
ら所定期間(例えば5〜10 as )のみ行う。
X相の通電期間PIISXについても180′反転する
ことを除いてU相と同様に設定する。
ことを除いてU相と同様に設定する。
又、単相において説明したが3相のTSCについても同
様である。
様である。
本発明によれば、逆相の通電が所定期間継続し、自相の
直列に接続されたすべてのサイリスタが消弧できる状態
になった時点まで通電期間PH3が継続し、ゲートパル
ス信号を発生させることができるので、複数の逆並列接
続されたサイリスタを直列接続して構成されたTSC装
置において部分ブロッキングからサイリスタ素子を保護
し、サイリスタバルブの破損を防止できるという著しい
効果がある。
直列に接続されたすべてのサイリスタが消弧できる状態
になった時点まで通電期間PH3が継続し、ゲートパル
ス信号を発生させることができるので、複数の逆並列接
続されたサイリスタを直列接続して構成されたTSC装
置において部分ブロッキングからサイリスタ素子を保護
し、サイリスタバルブの破損を防止できるという著しい
効果がある。
第1図は本発明のゲートパルス発生回路図、第2図は本
発明のゲートパルス発生方法を示す図。 第3図はTSCの一構成例を示す図、第4図は従来のゲ
ートパルス発生方法を示す図、第5図は従来のゲートパ
ルス発生回路図である。 1・・・変圧器 2・・・コンデンサ3・・・サ
イリスタスイッチ 4・・・直列リアク1−ル5・・・
電圧検出回路 6・・・フリップフロップ回路7・・・
AND回路 8・・・ワンショット回路9・・・フリ
ップフロップ回路 10・・・アンド回路11・・・
ワンショット回路 12・・ワン2321〜回路13・
・・AND回路 14・・・遅延回路代理人 弁
理士 則 近 憲 佑 同 第子丸 健 第1図 第 図 第 図 第 図 第 図 2゜ 3゜ 4゜ 干 続 補 正 」(自発) 事件の表示 特願平1−93090号 発明の名称 静止形無動電力補償装置 のゲートパルス発生方法 補正をする者 事イ1との関係 特許出願人 (307)株式会社 東芝
発明のゲートパルス発生方法を示す図。 第3図はTSCの一構成例を示す図、第4図は従来のゲ
ートパルス発生方法を示す図、第5図は従来のゲートパ
ルス発生回路図である。 1・・・変圧器 2・・・コンデンサ3・・・サ
イリスタスイッチ 4・・・直列リアク1−ル5・・・
電圧検出回路 6・・・フリップフロップ回路7・・・
AND回路 8・・・ワンショット回路9・・・フリ
ップフロップ回路 10・・・アンド回路11・・・
ワンショット回路 12・・ワン2321〜回路13・
・・AND回路 14・・・遅延回路代理人 弁
理士 則 近 憲 佑 同 第子丸 健 第1図 第 図 第 図 第 図 第 図 2゜ 3゜ 4゜ 干 続 補 正 」(自発) 事件の表示 特願平1−93090号 発明の名称 静止形無動電力補償装置 のゲートパルス発生方法 補正をする者 事イ1との関係 特許出願人 (307)株式会社 東芝
Claims (1)
- (1)複数の逆並列接続されたサイリスタを直列接続し
てなるサイリスタスイッチ、このサイリスタスイッチに
よりオン・オフ制御されるコンデンサ、このコンデンサ
の直列リアクトルとからなる静止形無効電力補償装置に
おいて、この静止形無効電力補償装置に印加する電圧に
対し所定の位相差を有する第1の位相信号によりセット
され、当該位相信号とは逆位相で発生する第2の位相信
号から始まる所定期間中だけ動作するサイリスタの通電
検出回路の出力信号によりリセットされるフリップフロ
ップの出力信号と、上記サイリスタスイッチに印加する
電圧を検出する手段からの電圧信号との理論積が“1”
となった時、上記サイリスタスイッチを構成するサイリ
スタに所定幅のゲートパルスを与えることを特徴とする
静止形無効電力補償装置のゲートパルス発生方法。
Priority Applications (7)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1093090A JPH02272612A (ja) | 1989-04-14 | 1989-04-14 | 静止形無効電力補償装置のゲートパルス発生方法 |
CA002014313A CA2014313C (en) | 1989-04-14 | 1990-04-10 | Gate pulse generator for static var compensator |
EP90106844A EP0392458B1 (en) | 1989-04-14 | 1990-04-10 | Improvements in gate pulse generator for static var compensator |
DE69012870T DE69012870T2 (de) | 1989-04-14 | 1990-04-10 | Gateelektrodenimpulsgenerator zur statischen Var-Kompensation. |
AU53190/90A AU612541B2 (en) | 1989-04-14 | 1990-04-11 | Improvements in gate pulse generator for static var compensator |
US07/507,491 US5093630A (en) | 1989-04-14 | 1990-04-11 | Overvoltage protection in series thyristor string for static var compensator |
CN90102097A CN1018785B (zh) | 1989-04-14 | 1990-04-14 | 用于静态可变补偿器的门脉冲发生器的改进 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1093090A JPH02272612A (ja) | 1989-04-14 | 1989-04-14 | 静止形無効電力補償装置のゲートパルス発生方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02272612A true JPH02272612A (ja) | 1990-11-07 |
Family
ID=14072825
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1093090A Pending JPH02272612A (ja) | 1989-04-14 | 1989-04-14 | 静止形無効電力補償装置のゲートパルス発生方法 |
Country Status (7)
Country | Link |
---|---|
US (1) | US5093630A (ja) |
EP (1) | EP0392458B1 (ja) |
JP (1) | JPH02272612A (ja) |
CN (1) | CN1018785B (ja) |
AU (1) | AU612541B2 (ja) |
CA (1) | CA2014313C (ja) |
DE (1) | DE69012870T2 (ja) |
Families Citing this family (14)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2786717B2 (ja) * | 1990-04-12 | 1998-08-13 | 株式会社東芝 | 無効電力補償装置のゲートパルス発生装置 |
US5402058A (en) * | 1992-12-09 | 1995-03-28 | General Electric Co. | Method and apparatus for controlling discharge of a thyristor-switched capacitor |
US5907234A (en) * | 1995-08-04 | 1999-05-25 | Siemens Aktiengesellschaft | Thyristor-switched capacitor bank |
GB2307803B (en) * | 1995-11-28 | 2000-05-31 | Gec Alsthom Ltd | Three-phase static var compensator arrangement |
US5712587A (en) * | 1996-04-08 | 1998-01-27 | Electric Power Research Institute, Inc. | Apparatus and method for simultaneously deactivating series-connected switching devices |
WO2006127844A2 (en) * | 2005-05-24 | 2006-11-30 | Satcon Technology Corporation | Device, system, and method for providing a low-voltage fault ride-through for a wind generator farm |
JP4575272B2 (ja) * | 2005-10-27 | 2010-11-04 | 株式会社日立製作所 | 分散型電源システム及び系統安定化方法 |
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