JPH02242344A - In-circuit emulator device - Google Patents
In-circuit emulator deviceInfo
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- Test And Diagnosis Of Digital Computers (AREA)
Abstract
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は、プログラムを実行する中央処理装置が実行し
ている途中の中央処理装置の各種信号を記憶することの
できるインサーキットエミュレータ装置に関するもので
ある。[Detailed Description of the Invention] [Industrial Application Field] The present invention relates to an in-circuit emulator device that is capable of storing various signals of a central processing unit that executes a program while the central processing unit is executing the program. It is.
[従来の技術]
近年、多くの種類の中央処理装置が存在しているが、こ
れらの中央処理装置を利用して、電子機器を設計する際
に、ソフトウェアとハードウェアを開発するための手段
の一例として、インサーキットエミュレータ装置が一般
に使用されている。[Prior Art] In recent years, many types of central processing units have come into existence, but when designing electronic devices using these central processing units, it is important to know how to develop software and hardware. As an example, in-circuit emulator devices are commonly used.
このインザーキッl−エミュレータ装置の重要な機能と
して、中央処理装置が、実行中のプログラム処理の過程
を逐一記憶し、必要な時点で、記憶された内容を、取板
者の理解てきるような形式で表示するトレース機能があ
る。An important function of this Inzerkit emulator device is that the central processing unit memorizes the process of the program being executed step by step, and the memorized contents can be made available to the interviewer at any necessary time. There is a trace function that can be displayed in .
一般のインサーキットエミュレータ装置では、外部回路
から中央処理装置に対して入力される各種信号と、中央
処理装置から外部回路に対して出力される各種信号とを
、中央処理装置の動作基準タイミング毎に記憶する機能
を有している。この記憶した中央処理装置の各種信号状
態を、有りのままに何の手も加えずに表示したのでは、
プログラムがどのような過程で、実行されているのかを
理解することは非常に困難なことである。そこで、一般
のインサーキットエミュレータ装置には、この記憶した
中央処理装置の各種信号状態を、中央処理装置が処理し
た順序と信号の種類によって分類、解析し、命令である
場合は、理解し易い形式のアセンブラ命令に変換し、命
令の実行である場合は、どこに対するどのような実行で
どのようなデータが処理されたか、に変換し、表示する
プログラムが用意されている。In a general in-circuit emulator device, various signals input from an external circuit to the central processing unit and various signals output from the central processing unit to the external circuit are transmitted at each operation reference timing of the central processing unit. It has a memory function. The various signal states of the central processing unit that have been memorized are displayed as they are without any modification.
It is extremely difficult to understand the process by which a program is executed. Therefore, general in-circuit emulator devices classify and analyze the stored various signal states of the central processing unit according to the order in which they were processed by the central processing unit and the type of signal. A program is available that converts the instructions into assembler instructions and, if the instruction is executed, converts it to what kind of data was processed and where it was executed.
[発明が解決しようとする課題]
最近の多くの中央処理装置は、処理能力を増加させる目
的で、中央処理装置の動作周波数を上げる一方、中央処
理装置が一度に扱える情報量を増すためにバス幅を増加
させたり、処理する命令の取込み、解析、実行をパイプ
ライン化して並列処理したり、外部記憶装置が遅い場合
における処理能力低下を防ぐ目的で命令およびデータの
キャッシュを中央処理装置内部にもつなど多くの処理能
力を上げるための手法が取られている。しかし、その反
面、中央処理装置のプログラムを実行する順序が入れ換
ったり、中央処理装置が取り込んだ命令が実行されない
場合がある等、従来の方法によって記録された情報だけ
で、中央処理装置の動作を解析することは非常に困難に
なっている。[Problems to be Solved by the Invention] Many recent central processing units have increased the operating frequency of the central processing unit in order to increase processing capacity, while also increasing the amount of information that the central processing unit can handle at one time. Cache instructions and data inside the central processing unit for the purpose of increasing processing width, parallel processing by pipelines for fetching, parsing, and execution of instructions to be processed, and preventing reduction in processing performance when external storage devices are slow. Many methods are being used to increase processing power, such as motsu. However, on the other hand, the order in which programs are executed in the central processing unit may be changed, or instructions taken by the central processing unit may not be executed. Analyzing behavior has become extremely difficult.
そこで、本発明では、このような命令の取込み、解析、
実行の処理順序が一定していなく、命令の先頭をいつ取
込んでいるのか、わからないが、実行している命令の先
頭番地が中央処理装置から信号として出力されるような
機能を有している中央処理装置(その−例として、ナシ
ョナルセミコンダクター社のシリーズ32000フアミ
リを挙げることができる)がプログラムを実行している
時の中央処理装置の各種信号の記憶に加えて、実行して
いる命令の先頭番地も同時に記憶し、この二つの記憶結
果を参照、比較することによって、プログラムの実行過
程を解析し、理解し易い形式に変換した結果を表示でき
るインサーキットエミュレータ装置を提供することを目
的としている。Therefore, in the present invention, such instructions are taken in, analyzed,
Although the processing order of execution is not constant and it is not known when the beginning of the instruction is taken in, it has a function in which the beginning address of the instruction being executed is output as a signal from the central processing unit. In addition to storing various signals of the central processing unit (an example of which is National Semiconductor's Series 32000 family) when the central processing unit is executing a program, it also stores the beginning of the instruction being executed. The purpose of the present invention is to provide an in-circuit emulator device that simultaneously stores addresses, references and compares these two storage results, analyzes the program execution process, and displays the converted results in an easy-to-understand format. .
[課題を解決するための手段]
上記の目的を達成するなめに、本発明によるインサーキ
ットエミュレータ装置は、中央処理装置へデータが取り
込まれるか、中央処理装置がらデータが出力された状態
を検出し、中央処理装置の各種信号の記憶指令タイミン
グ信号を発生する回路と、上記記憶指令タイミング信号
発生回路からの記憶指令タイミング信号に連動して、中
央処理装置の各種信号を記憶するトレース記憶回路と、
中央処理装置が実行中の命令の先頭番地が中央処理装置
から出力されるタイミングに連動して、中央処理装置が
実行中の命令の先頭番地を記憶するプログラムカウンタ
トレース記・障回路とを有していることを特徴としてい
る。[Means for Solving the Problems] In order to achieve the above object, an in-circuit emulator device according to the present invention detects a state in which data is taken into the central processing unit or data is output from the central processing unit. , a circuit that generates a storage command timing signal for various signals of the central processing unit, and a trace storage circuit that stores various signals of the central processing unit in conjunction with the storage command timing signal from the storage command timing signal generation circuit;
It has a program counter trace memory/failure circuit that stores the starting address of the instruction being executed by the central processing unit in conjunction with the timing at which the starting address of the instruction being executed by the central processing unit is output from the central processing unit. It is characterized by
また、本発明によるインサーキットエミュレータ装置の
別の特徴によれば、上記の構成に加えて、トレース記憶
回路およびプログラムヵウンタトレ−ス記憶回路に記憶
された情報を比較し、解析するトレース結果解析プログ
ラムと、トレース結果解析プログラムの解析結果を表示
するトレース結果表示プログラムとが設けられる。According to another feature of the in-circuit emulator device according to the present invention, in addition to the above configuration, a trace result analysis that compares and analyzes information stored in the trace storage circuit and the program counter trace storage circuit is provided. program, and a trace result display program that displays the analysis results of the trace result analysis program.
[作 用]
このように構成した本発明のインサーキットエミュレー
タ装置においては、中央処理装置の各種信号の状態をの
記憶と同時に中央処理装置の実行している命令が配置さ
れているメモリの先頭番地が記憶され、この両方の記憶
結果は参照、比較されて、それにより中央処理装置の複
雑な動作過程は取扱者に容易に理解できる簡単な形式に
変換され、表示され得る。[Function] In the in-circuit emulator device of the present invention configured as described above, the states of various signals of the central processing unit are stored, and at the same time, the starting address of the memory where the instruction being executed by the central processing unit is located is stored. are stored, and the results of both storages are referenced and compared, so that the complex operating processes of the central processing unit can be converted and displayed in a simple format that can be easily understood by the operator.
[実 施 例コ
以下、添付図面を参照して本発明の実施例について説明
する。[Embodiments] Hereinafter, embodiments of the present invention will be described with reference to the accompanying drawings.
第1図には、本発明のインサーキットエミュレータ装置
の構成をブロック図で示し、1は開発しようとするター
ゲットシステムの中央処理装置の代りに動作する、イン
サーキットエミュレータ装置によって用意されている中
央処理装置であり、この代換用の中央処理装置1からの
各種信号は、中央処理装置1が外部とデータの入出力を
行う状態を検出し、中央処理装置1の各種信号を記憶す
る指令タイミング信号を発生する記憶指令タイミング信
号発生回路2に供給され、またこの各種信号を記憶する
トレース記憶回路3に供給される。FIG. 1 shows a block diagram of the configuration of the in-circuit emulator device of the present invention, in which 1 is a central processing unit prepared by the in-circuit emulator device that operates in place of the central processing unit of the target system to be developed. Various signals from this replacement central processing unit 1 are command timing signals that detect the state in which the central processing unit 1 performs data input/output with the outside, and store various signals of the central processing unit 1. The signals are supplied to a storage command timing signal generation circuit 2 which generates the signals, and are also supplied to a trace storage circuit 3 which stores these various signals.
また、中央処理装置1から出力される中央処理装置の実
行中の命令の先頭番地は、プログラムカウンタトレース
記憶回路4に供給され、そこに記憶される。記憶指令タ
イミング信号発生回路2は、中央処理装置1の各種信号
を解析し、中央処理装置の動作状態から、各種信号と、
中央処理装置の実行中の命令の先頭番地を記憶するタイ
ミング信号を発生させる。記憶指令タイミング信号発生
回路2によって発生されたタイミング信号に同期して、
トレース記憶回路3及びプログラムカウンタトレース記
憶回路4は、各々、記憶すべき信号を順次記憶するよう
にされている。Further, the starting address of the instruction being executed by the central processing unit outputted from the central processing unit 1 is supplied to the program counter trace storage circuit 4 and stored therein. The storage command timing signal generation circuit 2 analyzes various signals of the central processing unit 1, and based on the operating status of the central processing unit, outputs various signals and
A timing signal is generated to store the start address of the instruction being executed by the central processing unit. In synchronization with the timing signal generated by the storage command timing signal generation circuit 2,
The trace storage circuit 3 and the program counter trace storage circuit 4 are each configured to sequentially store signals to be stored.
トレース記憶回路3及びプログラムカウンタトレース記
憶回路4に記憶された情報は、必要となった時点で、イ
ンサーキットエミュレータ装置内部に用意されているト
レース結果解析プログラム5によって、比較・解析され
、その解析結果は、トレース結果表示プログラム6によ
って出力装置7に出力される。The information stored in the trace storage circuit 3 and the program counter trace storage circuit 4 is compared and analyzed by a trace result analysis program 5 prepared inside the in-circuit emulator device when necessary, and the analysis results are is output to the output device 7 by the trace result display program 6.
次に、簡単なプログラム例を使用して、本発明を使用し
た時と、使用しない時について、中央処理装置がプログ
ラムを実行処理した過程が、どのように表示されるかに
ついて説明する。Next, using a simple program example, a description will be given of how the process of executing a program by the central processing unit is displayed when the present invention is used and when it is not used.
例えば第2図のようなプログラムが中央処理装置によっ
て実行されたと仮定すると、従来の方法によって実施さ
れているトレース記憶回路に記憶されている情報は、第
3図のようになる。For example, assuming that a program as shown in FIG. 2 is executed by a central processing unit, the information stored in a trace storage circuit implemented in a conventional manner would be as shown in FIG.
このトレース記憶回路に記憶されている情報を、従来の
ように、中央処理装置の実行中の命令の先頭番地と比較
せずに解析し、表示すると、第6図のようになり、実際
には中央処理装置によって実行されていないものまで表
示してしまう、その結果、第2図に示したプログラムを
実行しているかどうかを確認することは非常に困難であ
る。If the information stored in this trace storage circuit is analyzed and displayed without comparing it with the starting address of the instruction being executed by the central processing unit, as in the past, it will look like Figure 6, which is actually Even programs that are not being executed by the central processing unit are displayed, and as a result, it is very difficult to confirm whether the program shown in FIG. 2 is being executed.
ここで、プログラムカウンタトレース記憶回路4に記憶
されている情報を、トレース記憶回路3に記憶されてい
る情報と結合させると、第4図のような情報が得られる
。第4図に示す情報を解析し、実際に中央処理装置1に
よって実行された部分のみを取り出して表示すると、第
5図示すような表示結果を得ることができ、第2図に示
したプログラムを実行していることを容易に確認するこ
とができることになる。Here, when the information stored in the program counter trace storage circuit 4 is combined with the information stored in the trace storage circuit 3, information as shown in FIG. 4 is obtained. By analyzing the information shown in FIG. 4 and extracting and displaying only the part actually executed by the central processing unit 1, a display result as shown in FIG. 5 can be obtained, and the program shown in FIG. This allows you to easily check what is being executed.
[発明の効果]
以上説明してきたように、本発明によるインサーキット
エミュレータ装置においては、中央処理装置がプログラ
ムを実行処理する過程で、中央処理装置の各種信号の状
態を中央処理装置の実行タイミングに合わせて記憶する
回路に加えて、中央処理装置が実行している命令が配置
されている記憶装置の先頭番地も同時に記憶する回路を
組み合わせたことにより、従来、中央処理装置がプログ
ラムを実行処理した過程を、その順番のままトレ−ス結
果として表示していたものに比較して、プログラムが実
行処理された過程を、より正確に必要な情報のみを、表
示することが可能となり、プログラムが実行処理された
過程を容易に理解することができるようになる。[Effects of the Invention] As explained above, in the in-circuit emulator device according to the present invention, the states of various signals of the central processing unit are adjusted to the execution timing of the central processing unit during the process in which the central processing unit executes a program. By combining a circuit that simultaneously stores the starting address of the storage device where the instruction being executed by the central processing unit is located, in addition to the circuit that stores the instructions being executed by the central processing unit, the central processing unit is now able to execute and process programs. Compared to the process that was displayed as a trace result in the same order, it is now possible to display only the necessary information more accurately about the process of program execution. The process can be easily understood.
また、従来の技術によるインサーキットエミュレータ装
置では、中央処理装置が実行している命令が配置されて
いる記憶装置の先頭番地が同時に記憶されていないので
、プログラムが実行処理された過程を、インサーキット
エミュレータ使用者に理解し易く表示するためにインサ
ーキットエミュレータ装置内部に非常に複雑な解析プロ
グラムを用意する必要があったが、本発明によるインサ
ーキットエミュレータ装置では、中央処理装置が確実に
実行した命令が記憶されるので、正確に必要な情報のみ
を表示するためのインサーキットエミュレータ装置内部
の解析プログラムを容易に作成することができるように
なる。In addition, in the conventional in-circuit emulator device, the starting address of the storage device where the instructions being executed by the central processing unit are located is not stored at the same time. It was necessary to prepare a very complicated analysis program inside the in-circuit emulator device in order to display the information in an easy-to-understand manner for emulator users. is stored, it becomes possible to easily create an analysis program inside the in-circuit emulator device to accurately display only necessary information.
第1図は本発明のインサーキットエミュレータ装置の構
成を示すブロック線図、第2図はプログラム例を示す図
、第3図はトレース記憶回路に記・障される情報例を示
す図、第4図はプログラムカウンタトレース記憶回路に
記憶されている情報とトレース記憶回路に記憶されてい
る情報との結合例を示す図、第5図は本発明に従って記
憶された・[青報を解析し、表示した例を示す図、第6
図はトレース記憶回路に記憶された・情報を従来の方法
で解析し、表示した例を示す図である。
図 中、
に中央処理装置
2:記憶指令タイミング信号発生回路
3ニドレース記憶回路
4ニブログラム力ウンタトレース記憶回路5ニドレース
結果解析プログラム
6;トレース結果表示グログラム
7:出力装置
第1図
第2図
1000 test : movb o(ro)、r
11003 movdき20. r11006
bra testプログラムカウンタ)へ
レー
スメモリ回路に記憶された
情報
00001000000000 test:n+ovb
0(rO)、rloooooooo ******O
Odread00001003000000 n
ovd @20.r100000000 ******
00 dread(1(100100600(10br
a testoooolooo 000000 te
st:rmovb 0(ro)、rloooooooo
車**m00 dread0000100300
0000 novd @20.r1000000
00 ******00 dread00001006
0000 bra testooooloo
o 000000 test:n+ovb 0(ro)
、rloooooooo ******00 drea
d00001003000000 n+ovd
@20.r100000000 ******OOdr
eadooool(1060000bra test
oooolooo 000000
ooooioos o。
0000100A 00
ooooiooc o。
0000100ε00
0000100F 00
test:novb 0(ro)、rlraovd @
20.r1
bra test
oooooooo *寧軸**00
oooooooo −””率*00
00000000 ネ零*傘傘璋00read
dread
dread
dread
dread
readFIG. 1 is a block diagram showing the configuration of an in-circuit emulator device of the present invention, FIG. 2 is a diagram showing an example of a program, FIG. The figure shows an example of the combination of the information stored in the program counter trace storage circuit and the information stored in the trace storage circuit. Figure 6 shows an example of
The figure shows an example in which information stored in a trace storage circuit is analyzed and displayed using a conventional method. In the figure, central processing unit 2: storage command timing signal generation circuit 3 Nidrace storage circuit 4 Nitrogram force countertrace storage circuit 5 Nidrace result analysis program 6; trace result display program 7: output device Figure 1 Figure 2 1000 test: movb o(ro), r
11003 movd 20. r11006
bra test program counter) information stored in the race memory circuit 00001000000000 test:n+ovb
0 (rO), rlooooooooo ******O
Odread00001003000000 n
ovd @20. r100000000 ******
00 dread(1(100100600(10br
a testooooloooo 000000te
st:rmovb 0(ro), rlooooooooo
Car**m00 dread0000100300
0000 novd @20. r1000000
00 ******00 dread00001006
0000 bra testooooloo
o 000000 test:n+ovb 0(ro)
,rloooooooo ******00 drea
d00001003000000 n+ovd
@20. r100000000 ******OOdr
eadooool(1060000bra test
ooooooooo 000000 oooooioos o. 0000100A 00 ooooiooc o. 0000100ε00 0000100F 00 test:novb 0(ro), rlraovd @
20. r1 bra test ooooooooo *Ningjiku**00 ooooooooo -””rate*00 00000000 ne zero * umbrella umbrella 00read dread dread dread drread dread read
Claims (1)
中央処理装置の各種信号の状態を、中央処理装置の実行
タイミングに合わせて記憶できるようにしたインサーキ
ットエミュレータ装置において、中央処理装置へデータ
が取り込まれるか、中央処理装置からデータが出力され
た状態を検出して、中央処理装置の各種信号の記憶指令
タイミング信号を発生する回路と、上記記憶指令タイミ
ング信号発生回路からの記憶指令タイミング信号に連動
して、中央処理装置の各種信号を記録するトレース記憶
回路と、中央処理装置が実行中の命令の先頭番地が中央
処理装置から出力されるタイミングに連動して、中央処
理装置が実行中の命令の先頭番地を記憶するプログラム
カウンタトレース記憶回路とを有することを特徴とする
インサーキットエミュレータ装置。 2、中央処理装置によるプログラムの実行処理過程で、
中央処理装置の各種信号の状態を、中央処理装置の実行
タイミングに合わせて記憶できるようにしたインサーキ
ットエミュレータ装置において、中央処理装置へデータ
が取り込まれるか、中央処理装置からデータが出力され
た状態を検出して、中央処理装置の各種信号の記憶指令
タイミング信号を発生する回路と、上記記憶指令タイミ
ング信号発生回路からの記憶指令タイミング信号に連動
して、中央処理装置の各種信号を記録するトレース記憶
回路と、中央処理装置が実行中の命令の先頭番地が中央
処理装置から出力されるタイミングに連動して、中央処
理装置が実行中の命令の先頭番地を記憶するプログラム
カウンタトレース記憶回路と、上記トレース記憶回路お
よびプログラムカウンタトレース記憶回路に記録された
情報を比較し、解析するトレース結果解析プログラムと
、トレース結果解析プログラムの解析結果を表示するト
レース結果表示プログラムとを有することを特徴するイ
ンサーキットエミュレータ装置。[Claims] 1. In the program execution process by the central processing unit,
In an in-circuit emulator device that is capable of storing the states of various signals of the central processing unit in accordance with the execution timing of the central processing unit, the state in which data is taken into the central processing unit or data is output from the central processing unit a circuit that detects and generates a storage command timing signal for various signals of the central processing unit; and a trace that records various signals of the central processing unit in conjunction with the storage command timing signal from the storage command timing signal generation circuit. a storage circuit; and a program counter trace storage circuit that stores the starting address of an instruction being executed by the central processing unit in synchronization with the timing at which the starting address of the instruction being executed by the central processing unit is output from the central processing unit. An in-circuit emulator device comprising: 2. During the program execution process by the central processing unit,
In an in-circuit emulator device that is capable of storing the states of various signals of the central processing unit in accordance with the execution timing of the central processing unit, the state in which data is taken into the central processing unit or data is output from the central processing unit a circuit that detects and generates a storage command timing signal for various signals of the central processing unit; and a trace that records various signals of the central processing unit in conjunction with the storage command timing signal from the storage command timing signal generation circuit. a storage circuit; a program counter trace storage circuit that stores a starting address of an instruction being executed by the central processing unit in conjunction with a timing at which the starting address of the instruction being executed by the central processing unit is output from the central processing unit; An in-circuit characterized by having a trace result analysis program that compares and analyzes information recorded in the trace storage circuit and the program counter trace storage circuit, and a trace result display program that displays the analysis results of the trace result analysis program. emulator device.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1062065A JPH02242344A (en) | 1989-03-16 | 1989-03-16 | In-circuit emulator device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1062065A JPH02242344A (en) | 1989-03-16 | 1989-03-16 | In-circuit emulator device |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02242344A true JPH02242344A (en) | 1990-09-26 |
Family
ID=13189334
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1062065A Pending JPH02242344A (en) | 1989-03-16 | 1989-03-16 | In-circuit emulator device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02242344A (en) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63106840A (en) * | 1986-10-24 | 1988-05-11 | Hitachi Ltd | Data processor unit |
JPS6421546A (en) * | 1987-07-16 | 1989-01-24 | Nec Corp | Device for collecting program execution history |
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1989
- 1989-03-16 JP JP1062065A patent/JPH02242344A/en active Pending
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