JPH02241382A - Controller for motor - Google Patents

Controller for motor

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JPH02241382A
JPH02241382A JP1059909A JP5990989A JPH02241382A JP H02241382 A JPH02241382 A JP H02241382A JP 1059909 A JP1059909 A JP 1059909A JP 5990989 A JP5990989 A JP 5990989A JP H02241382 A JPH02241382 A JP H02241382A
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JP
Japan
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circuit
output
signal
outputs
motor
Prior art date
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Pending
Application number
JP1059909A
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Japanese (ja)
Inventor
Yasuhito Fukui
康仁 福井
Koji Wakiyama
脇山 浩二
Kazuo Arai
荒井 和男
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Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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  • Control Of Electric Motors In General (AREA)

Abstract

PURPOSE:To shorten a time until an integrated value of an integrator becomes a steady value by setting an initial value most adapted to effectively form the integrator with an initial value setter at the time of transient response of a motor. CONSTITUTION:A rotating period of a motor 1 is converted to a period signal proportional to a rotating period by a rotation detector 2, and a period error signal becomes an error between the rotating period of the motor 1 and a target period. An integrator 5 integrates the period error signal, outputs its result, and an initial value setter 4 sets an initial value most adapted for effectively operating the integrator 5 in a transient state at the time of change of a target period if the target period is varied or variation in a disturbance upon target period change is predicted. Thus, since the time until the integrated value becomes a steady value is almost eliminated, responding characteristic can be improved without altering the steady characteristic of the motor 1.

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、ビデオテープレコーダ(以下VTRと略す)
やディジタルオーディオテープレコーダ(以下DATと
略す)等に使用されるモータの制御装置に関するもので
ある。
[Detailed Description of the Invention] Industrial Application Field The present invention relates to a video tape recorder (hereinafter abbreviated as VTR).
The present invention relates to a motor control device used in a digital audio tape recorder (hereinafter abbreviated as DAT) and the like.

従来の技術 近年、VTRやDATに使用されているモータの制御回
路では、負荷変動によって発生するワウフラッタを改善
するため、フィードバックループに積分回路を挿入して
低周波領域でのフィードバックゲインを大きくする方法
が取られている。 (例えば、サーボ機器の実際 木村
信敏編 産報出版 135ページ〜145ページ)。
Conventional technology In recent years, in motor control circuits used in VTRs and DATs, in order to improve wow and flutter caused by load fluctuations, an integrator circuit is inserted into the feedback loop to increase the feedback gain in the low frequency region. has been taken. (For example, Actual Use of Servo Equipment, edited by Nobutoshi Kimura, Sanpo Publishing, pages 135-145).

発明が解決しようとする課題 しかしながら上記のような構成ではモータの定常特性は
改善できても、モータの過渡応答時には積分効果が悪影
響を及ぼし、積分後のデータが定常値となるまでの時間
が比較的長いため、モータの目標速度に達する時間が遅
くなるという問題点を有していた。
Problems to be Solved by the Invention However, although the steady-state characteristics of the motor can be improved with the above configuration, the integration effect has a negative effect during transient response of the motor, and the time it takes for the data after integration to reach a steady value is difficult to compare. Since the target speed is long, there is a problem in that the time required for the motor to reach the target speed is delayed.

本発明は、上記問題点に鑑み、積分補償を施したモータ
の制御特性を劣化させることなく、目標速度に達するま
でに必要な時間を短縮するモータの制御装置を提供する
ものである。
In view of the above problems, the present invention provides a motor control device that shortens the time required to reach a target speed without deteriorating the control characteristics of a motor subjected to integral compensation.

課題を解決するための手段 上記問題点を解決するために本発明のモータの制御装置
は、モータと、モータの回転周期に比例した周期信号を
出力する回転検出器と、周期信号と目標周期との誤差を
周期誤差信号として出力する速度誤差検出回路と、周期
誤差信号を積分する初期値が設定可能な積分回路と、積
分回路の初期値を設定する初期値設定回路と、周期信号
と積分回路の出力とを加算して出力する加算回路、加算
回路の出力に応じてモータを駆動する駆動回路を具備す
るものである。
Means for Solving the Problems In order to solve the above problems, a motor control device of the present invention includes a motor, a rotation detector that outputs a period signal proportional to the rotation period of the motor, and a period signal and a target period. A speed error detection circuit that outputs the error as a periodic error signal, an integrating circuit that can set an initial value for integrating the periodic error signal, an initial value setting circuit that sets the initial value of the integrating circuit, and a periodic signal and integrating circuit. The adder circuit includes an adder circuit that adds the output of the adder and outputs the resultant output, and a drive circuit that drives the motor in accordance with the output of the adder circuit.

作用 本発明は上記した構成によって、モータの過渡応答時に
おいて積分回路が有効に作用するために最も適した初期
値を初期値設定回路によって設定することによって、積
分回路の持つ積分値が定常値になるまでの時間を短縮で
き、モータの過渡応答時における積分回路の悪影響を無
<シ、目標速度到達までに必要な時間を短縮しモータの
応答特性が改善される。
Effect of the Invention With the above-described configuration, the present invention allows the integral value of the integral circuit to become a steady value by setting the most suitable initial value for the integral circuit to function effectively during a transient response of the motor by using the initial value setting circuit. The time required to reach the target speed can be shortened, the time required to reach the target speed can be shortened, and the response characteristics of the motor can be improved.

実施例 以下、本発明の一実施例のモータの制御装置について図
面を参照しながら説明する。第1図は本発明の一実施例
のモータの制御装置のブロック図である。第1図におい
て、1はモータ、2は回転検出器、3は速度誤差検出回
路、4は初期値設定回路、5は積分回路、6は加算回路
、7は駆動回路である。
Embodiment Hereinafter, a motor control device according to an embodiment of the present invention will be described with reference to the drawings. FIG. 1 is a block diagram of a motor control device according to an embodiment of the present invention. In FIG. 1, 1 is a motor, 2 is a rotation detector, 3 is a speed error detection circuit, 4 is an initial value setting circuit, 5 is an integration circuit, 6 is an addition circuit, and 7 is a drive circuit.

以上のように構成されたモータの制御回路について、次
に第1図を用いてその動作を説明する。
The operation of the motor control circuit configured as described above will now be described with reference to FIG.

モータ1の回転周期は回転検出器2によって回転周期に
比例した周期信号に変換される。速度誤差検出回路3は
、回転検出器2の出力である周期信号の周期と予め定め
られた周期との誤差を検出し、周期誤差信号として出力
する。したがって周期誤差信号は、モータ1の回転周期
と目標周期との誤差となる。積分回路5は周期誤差信号
を積分し、その結果を出力する。初期値設定回路4は、
目標周期の変化や、それに伴なう外乱の変化が予測され
る場合、目標周期の変化が起こる時に、過渡状態におい
て積分回路が有効に作用するために最も適した初期値を
積分回路に設定する。加算回路6は、周期誤差信号と積
分回路の出力とを加算し出力する。駆動回路7は、加算
回路6の出力を受け、その出力に応じてモータ1を駆動
する。
The rotation period of the motor 1 is converted by a rotation detector 2 into a period signal proportional to the rotation period. The speed error detection circuit 3 detects an error between the period of the periodic signal output from the rotation detector 2 and a predetermined period, and outputs it as a periodic error signal. Therefore, the period error signal is the error between the rotation period of the motor 1 and the target period. Integrating circuit 5 integrates the periodic error signal and outputs the result. The initial value setting circuit 4 is
If a change in the target period or a change in the disturbance associated with it is predicted, set the most suitable initial value for the integrator circuit so that it will work effectively in the transient state when the change in the target period occurs. . The adding circuit 6 adds the periodic error signal and the output of the integrating circuit and outputs the sum. The drive circuit 7 receives the output of the adder circuit 6 and drives the motor 1 according to the output.

このように、初期値設定回路4によってモータ1の目標
周期の変化に応じた積分回路5の初期値を設定すること
により、従来例の課題であった積分値が定常値となるま
での時間がほとんどなくなるため、モータ1の定常特性
を変えることな(応答特性を改善することができる。
In this way, by setting the initial value of the integrating circuit 5 according to the change in the target cycle of the motor 1 using the initial value setting circuit 4, the time required for the integral value to reach a steady value, which was a problem in the conventional example, can be reduced. Since this phenomenon is almost eliminated, the steady-state characteristics of the motor 1 are not changed (response characteristics can be improved).

第2図は、第2の実施例におけるブロック図である。第
1図と同じ働きをする部分には、同じ番号を付し説明を
省略する。
FIG. 2 is a block diagram in the second embodiment. Components having the same functions as those in FIG. 1 are given the same numbers and their explanations will be omitted.

31は基準信号発生回路、32は基準信号発生回路31
の出力を受けて周期信号よりタイミング信号を発生する
タイミング信号発生回路、33は周期信号の目標値を出
力する目標値発生回路、34はタイミング信号発生回路
32の出力を受けて目標値発生回路33の出力をロード
し、基準信号発生回路31の出力で計数動作を行なうカ
ウンタ回路、35はタイミング信号発生回路32の出力
を受けてカウンタ回路34の出力をラッチする誤差信号
ラッチ回路である。
31 is a reference signal generation circuit, 32 is a reference signal generation circuit 31
33 is a target value generation circuit that outputs a target value of the periodic signal; 34 is a target value generation circuit 33 that receives the output of the timing signal generation circuit 32; 35 is an error signal latch circuit that receives the output of the timing signal generation circuit 32 and latches the output of the counter circuit 34.

速度誤差検出回路3は、基準信号発生回路31゜タイミ
ング信号発生回路32.目標値発生回路33、カウンタ
回路34.誤差信号ラッチ回路35から構成される。
The speed error detection circuit 3 includes a reference signal generation circuit 31°, a timing signal generation circuit 32. Target value generation circuit 33, counter circuit 34. It is composed of an error signal latch circuit 35.

51は加算回路、53は加算回路51の出力をラッチす
る積分値ラッチ回路、52は積分値ラッチ回路53のラ
ッチのタイミング信号を出力する積分時間発生回路、5
4は、初期値設定回路4の出力と積分値ラッチ回路53
の出力のどちらか一方を選択し出力する選択回路、55
は乗算回路である。選択回路54の出力は加算回路51
に帰還し、誤差信号ラッチ回路35の出力と加算する閉
ループ構成とする。
51 is an adder circuit; 53 is an integral value latch circuit that latches the output of the adder circuit 51; 52 is an integral time generator circuit that outputs a latch timing signal of the integral value latch circuit 53;
4 is the output of the initial value setting circuit 4 and the integral value latch circuit 53
a selection circuit that selects and outputs either one of the outputs; 55;
is a multiplication circuit. The output of the selection circuit 54 is sent to the addition circuit 51
The signal is fed back to the error signal latch circuit 35 and added to the output of the error signal latch circuit 35 to form a closed loop configuration.

積分回路5は、加算回路51.積分時間発生回路52.
積分値ラッチ回路539選択回路54゜乗算回路55か
ら構成される。
The integrating circuit 5 includes an adding circuit 51 . Integral time generation circuit 52.
It is composed of an integral value latch circuit 539, a selection circuit 54, and a multiplication circuit 55.

第3図は、第2図の速度誤差検出回路3の動作を示した
動作波形図である。第3図において、横軸は時間、縦軸
は信号の大きさを示し、波形り。
FIG. 3 is an operation waveform diagram showing the operation of the speed error detection circuit 3 of FIG. 2. In Fig. 3, the horizontal axis shows time and the vertical axis shows the magnitude of the signal, and the waveform.

Eはディジタル量をアナログ量に変換したかたちで示し
ている。以下、第3図を使用しながら、第2図の実施例
の動作を説明する。
E shows a digital quantity converted into an analog quantity. Hereinafter, the operation of the embodiment shown in FIG. 2 will be explained using FIG. 3.

モータ1の回転周期は、回転検出器2で検出され、回転
周期に比例した周期信号として出力される。周期信号を
第3図のAに示す。周期信号を受けたタイミング信号発
生回路32は、基準信号発生回路31の出力をもとに第
3図のB、  Cに示すタイミング信号を出力する。誤
差信号ラッチ回路35はタイミング信号発生回路32の
出力(第3図のB)を受けてカウンタ回路34の計数値
をラッチし、周期誤差信号として出力する。周期誤差信
号を第3図のEに示す。カウンタ回路34は、基準信号
発生回路31の出力を受けて計数動作を行ない、誤差信
号ラッチ回路の出力後、タイミング信号発生回路32の
出力(第3図のC)を受けて目標値発生回路33の出力
をロードする。カウンタ回路34の計数動作の様子を第
3図のDに示す。
The rotation period of the motor 1 is detected by a rotation detector 2 and output as a periodic signal proportional to the rotation period. The periodic signal is shown at A in FIG. The timing signal generation circuit 32 that has received the periodic signal outputs the timing signals shown in B and C in FIG. 3 based on the output of the reference signal generation circuit 31. The error signal latch circuit 35 receives the output of the timing signal generation circuit 32 (B in FIG. 3), latches the count value of the counter circuit 34, and outputs it as a periodic error signal. The periodic error signal is shown at E in FIG. The counter circuit 34 performs a counting operation upon receiving the output of the reference signal generation circuit 31, and after receiving the output of the error signal latch circuit, the target value generation circuit 33 receives the output of the timing signal generation circuit 32 (C in FIG. 3). Load the output of . The counting operation of the counter circuit 34 is shown in FIG. 3D.

積分回路5では、加算回路51で速度誤差検出回路3の
出力である周期誤差信号と選択回路54の出力とが加算
され積分値ラッチ回路53へ出力される。積分値ラッチ
回路53は、積分時間発生回路52で出力される一定周
期のラッチ信号を受は加算回路51の演算結果を出力す
る。選択回路54は通常、積分値ラッチ回路53の出力
を出力しているが、モータ1の目標回転速度の変更時に
は、初期値設定回路4から目標回転周期の変化に応じた
値を初期値として積分回路5に取り込むために初期値設
定回路4の出力を選択し出力する。
In the integrating circuit 5, the periodic error signal which is the output of the speed error detection circuit 3 and the output of the selection circuit 54 are added together in the adding circuit 51 and outputted to the integral value latch circuit 53. The integral value latch circuit 53 receives a constant cycle latch signal output from the integral time generating circuit 52 and outputs the calculation result of the adder circuit 51. The selection circuit 54 normally outputs the output of the integral value latch circuit 53, but when changing the target rotation speed of the motor 1, the selection circuit 54 integrates the value corresponding to the change in the target rotation period from the initial value setting circuit 4 as an initial value. The output of the initial value setting circuit 4 is selected and output in order to be taken into the circuit 5.

乗算回路55は、選択回路54の出力を定数倍し、積分
回路5の出力として出力する。
The multiplication circuit 55 multiplies the output of the selection circuit 54 by a constant and outputs the result as the output of the integration circuit 5.

このように、目標周期の変化や、それに伴なう外乱の変
化が予測される場合、目標周期の変化が起こる時に、過
渡状態において積分回路5が有効に作用するために最も
適した初期値を初期値設定回路4で設定する。
In this way, when a change in the target period and an accompanying change in disturbance are predicted, the most suitable initial value for the integration circuit 5 to function effectively in the transient state when the change in the target period occurs is determined. Set by the initial value setting circuit 4.

周期誤差信号Eと積分回路5の出力は、加算回路6で加
算され、駆動回路7へ伝えられる。駆動回路7は、入力
信号に応じてモータ1を駆動する。
The periodic error signal E and the output of the integrating circuit 5 are added together by an adding circuit 6 and transmitted to a driving circuit 7. The drive circuit 7 drives the motor 1 according to the input signal.

以上のように、初期値設定回路4.積分回路5を設ける
ことにより、モータ1の過渡状態に適した積分回路5の
初期値を設定することが可能になリ、積分回路5の持つ
積分値が定常値になるまでの時間をほとんど無くするこ
とができるので、モータ1の目標回転速度に到達するま
での時間が短縮され、定常特性を変えることなくモータ
1の過渡特性が改善される。
As described above, the initial value setting circuit 4. By providing the integrating circuit 5, it is possible to set the initial value of the integrating circuit 5 suitable for the transient state of the motor 1, and there is almost no time required for the integral value of the integrating circuit 5 to reach a steady value. Therefore, the time required for the motor 1 to reach the target rotational speed is shortened, and the transient characteristics of the motor 1 are improved without changing the steady-state characteristics.

尚、初期値設定回路4.積分回路5.加算回路6はマイ
クロコンピュータを用いても実現可能であり、発明の効
果に変わりはない。
Note that the initial value setting circuit 4. Integral circuit 5. The adder circuit 6 can also be implemented using a microcomputer, and the effects of the invention will remain the same.

また、速度誤差検出回路3は、基準の周期信号を用いて
回転検出器の出力を計数し、目標値との差を取る方法な
ども考えられ、実施例に留まるものではない。また、積
分回路5において、積分値ラッチ回路53と選択回路5
4の順番を逆にしても、また、加算回路51の前にラッ
チ回路を置き、積分時間発生回路52のラッチ信号を受
けて周期誤差信号Eをラッチしても同様の効果が得られ
る。
Furthermore, the speed error detection circuit 3 may be configured to count the output of the rotation detector using a reference periodic signal and calculate the difference from the target value, and is not limited to the embodiment. In addition, in the integrating circuit 5, an integral value latch circuit 53 and a selection circuit 5
The same effect can be obtained even if the order of 4 is reversed, or even if a latch circuit is placed before the adder circuit 51 and the periodic error signal E is latched in response to the latch signal from the integral time generating circuit 52.

更に、乗算回路55は、ビットシフトによっても実現可
能であり、発明の効果に変わりはない。
Furthermore, the multiplication circuit 55 can also be realized by bit shifting, and the effect of the invention remains unchanged.

発明の効果 以上のように本発明は、モータと、モータの回転周期に
比例した周期信号を出力する回転検出器と、周期信号と
目標周期との誤差を周期誤差信号として出力する速度誤
差検出回路と、周期誤差信号を積分する積分回路と、積
分回路の初期値を設定する初期値設定回路と、周期誤差
信号と積分回路の出力を加算する加算回路と、モータを
駆動する駆動回路とを設けることにより、目標回転速度
が変化する時に、目標回転速度の変化に応じて、積分回
路の初期値を設定することによって、積分値が定常値と
なるまでの時間を短縮でき、モータの制御特性を劣化さ
せることなく目標回転速度に達するまでに必要な時間を
短縮することが可能になる。
Effects of the Invention As described above, the present invention provides a motor, a rotation detector that outputs a periodic signal proportional to the rotation period of the motor, and a speed error detection circuit that outputs an error between the periodic signal and a target period as a periodic error signal. and an integrator circuit that integrates the periodic error signal, an initial value setting circuit that sets the initial value of the integrator circuit, an adder circuit that adds the periodic error signal and the output of the integrator circuit, and a drive circuit that drives the motor. By setting the initial value of the integrating circuit according to the change in target rotational speed when the target rotational speed changes, the time until the integral value reaches a steady value can be shortened, and the control characteristics of the motor can be improved. It becomes possible to shorten the time required to reach the target rotation speed without causing deterioration.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の第1の実施例におけるモータの制御装
置のブロック図、第2図は本発明の第2の実施例を具体
的に示したモータの制御装置のブロック図、第3図は第
2図の動作を説明するための動作波形図である。 1・・・モータ、  2・・・回転検出器、  3・・
・速度誤差検出回路、  4・・・初期値設定回路、 
 5・・・積分回路、  6・・・加算回路、  7・
・・駆動回路。 代理人の氏名 弁理士 粟野 重孝 ほか18第 1 
図 第 図 2−回転橡土泳 y−fjA、鉄烹九邑4 第 図 □特開
FIG. 1 is a block diagram of a motor control device according to a first embodiment of the present invention, FIG. 2 is a block diagram of a motor control device specifically showing a second embodiment of the present invention, and FIG. 2 is an operation waveform diagram for explaining the operation of FIG. 2. FIG. 1...Motor, 2...Rotation detector, 3...
・Speed error detection circuit, 4...Initial value setting circuit,
5... Integrating circuit, 6... Adding circuit, 7.
...Drive circuit. Name of agent: Patent attorney Shigetaka Awano et al. 18th
Fig. Fig. 2 - Rotating skating y-fjA, Teppou Kuebu 4 Fig. □ Unexamined Japanese Patent Application

Claims (3)

【特許請求の範囲】[Claims] (1)モータと、 前記モータの回転速度に応じた周期信号を出力する回転
検出器と、 前記回転検出器の出力の周期と前記回転検出器の目標の
周期との誤差を周期誤差信号として出力する速度誤差検
出回路と、 前記速度誤差検出回路の出力である周期誤差信号を積分
し出力する初期値が設定可能な積分回路と、 前記積分回路の初期値を設定する初期値設定回路と、 前記速度誤差検出回路の出力である周期誤差信号と前記
積分回路の出力とを加算して出力する加算回路と、 前記加算回路の出力に応じて前記モータを駆動する駆動
回路とを具備したことを特徴とするモータの制御装置。
(1) A motor, a rotation detector that outputs a periodic signal according to the rotational speed of the motor, and outputs an error between an output period of the rotation detector and a target period of the rotation detector as a periodic error signal. a speed error detection circuit that integrates and outputs a periodic error signal that is an output of the speed error detection circuit, and is capable of setting an initial value; and an initial value setting circuit that sets the initial value of the integration circuit; It is characterized by comprising an adding circuit that adds and outputs a periodic error signal that is an output of a speed error detection circuit and an output of the integrating circuit, and a drive circuit that drives the motor according to the output of the adding circuit. A control device for a motor.
(2)速度誤差検出回路は、一定の周期信号を発生する
基準周期信号発生回路と、 回転検出器の出力を受けてタイミング信号を出力するタ
イミング信号発生回路と、 モータの目標回転速度に応じた値を出力する目標値発生
回路と、 前記タイミング信号発生回路の出力を受けて速度誤差検
出回路の出力である周期誤差信号を出力する誤差信号ラ
ッチ回路と、 前記誤差信号ラッチ回路が周期誤差信号を出力した後、
前記タイミング信号発生回路の出力信号を受けて前記目
標値発生回路の出力を入力し、前記基準周期信号発生回
路の出力を計数し前記誤差信号ラッチ回路へ出力するカ
ウンタ回路とから構成したことを特徴とする請求項1記
載のモータの制御装置。
(2) The speed error detection circuit consists of a reference periodic signal generation circuit that generates a constant periodic signal, a timing signal generation circuit that outputs a timing signal in response to the output of the rotation detector, and a timing signal generation circuit that generates a timing signal according to the target rotational speed of the motor. a target value generation circuit that outputs a value; an error signal latch circuit that receives the output of the timing signal generation circuit and outputs a periodic error signal that is an output of the speed error detection circuit; and the error signal latch circuit that outputs the periodic error signal that is the output of the speed error detection circuit. After outputting,
A counter circuit receives the output signal of the timing signal generation circuit, inputs the output of the target value generation circuit, counts the output of the reference period signal generation circuit, and outputs the result to the error signal latch circuit. 2. The motor control device according to claim 1.
(3)積分回路は、一定の周期信号を発生する積分時間
発生回路と、 前記積分時間発生回路の周期信号を受けて入力された信
号を出力する積分値ラッチ回路と、前記積分値ラッチ回
路の出力と初期値設定回路の出力のいずれか一方を選択
し出力する選択回路と、 前記選択回路の出力と周期誤差信号を加算し前記積分値
ラッチ回路へ出力する加算回路と、前記選択回路の出力
を定数倍し出力する乗算回路とから構成したことを特徴
とする請求項1記載のモータの制御装置。
(3) The integration circuit includes an integration time generation circuit that generates a constant periodic signal, an integration value latch circuit that receives the periodic signal of the integration time generation circuit and outputs the input signal, and an integration value latch circuit that outputs the input signal after receiving the periodic signal of the integration time generation circuit. a selection circuit that selects and outputs either the output of the output or the output of the initial value setting circuit; an addition circuit that adds the output of the selection circuit and the periodic error signal and outputs the result to the integral value latch circuit; and an output of the selection circuit. 2. The motor control device according to claim 1, further comprising a multiplier circuit which multiplies the result by a constant and outputs the result.
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