JPH02143627U - - Google Patents
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- Publication number
- JPH02143627U JPH02143627U JP4967489U JP4967489U JPH02143627U JP H02143627 U JPH02143627 U JP H02143627U JP 4967489 U JP4967489 U JP 4967489U JP 4967489 U JP4967489 U JP 4967489U JP H02143627 U JPH02143627 U JP H02143627U
- Authority
- JP
- Japan
- Prior art keywords
- switch
- controls
- circuit
- semiconductor memory
- memory element
- Prior art date
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- Pending
Links
- 239000004065 semiconductor Substances 0.000 claims 2
- 230000000717 retained effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Power Sources (AREA)
Description
第１図はバツクアツプ用回路図、第２図は第１
図における電源とＲＡＭの電源電圧の関係を示し
た図、第３図は本考案の一実施例におけるメモリ
バツクアツプスイツチの構成図である。 １，７……バツクアツプ用スイツチ、２……バ
ツクアツプ用電池、３，４……ダイオード、５…
…ＲＡＭ、６……電源（ＶＤ）ＯＮ／ＯＦＦスイ
ツチ、８……ＯＮ／ＯＦＦ用スイツチのつまみ。
図における電源とＲＡＭの電源電圧の関係を示し
た図、第３図は本考案の一実施例におけるメモリ
バツクアツプスイツチの構成図である。 １，７……バツクアツプ用スイツチ、２……バ
ツクアツプ用電池、３，４……ダイオード、５…
…ＲＡＭ、６……電源（ＶＤ）ＯＮ／ＯＦＦスイ
ツチ、８……ＯＮ／ＯＦＦ用スイツチのつまみ。
Claims (1)
- 書き替え可能な半導体記憶素子を有し、前記半
導体記憶素子の内容が常に保持されるような回路
と電池と前記回路の動作を制御するスイツチとを
備え、前記回路の動作を制御するスイツチが、装
置の電源を制御するスイツチと一方向だけ連動す
るようにしたことを特徴とするメモリバツクアツ
プスイツチ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4967489U JPH02143627U (ja) | 1989-04-28 | 1989-04-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4967489U JPH02143627U (ja) | 1989-04-28 | 1989-04-28 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02143627U true JPH02143627U (ja) | 1990-12-05 |
Family
ID=31567571
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4967489U Pending JPH02143627U (ja) | 1989-04-28 | 1989-04-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02143627U (ja) |
-
1989
- 1989-04-28 JP JP4967489U patent/JPH02143627U/ja active Pending