JPH02105081A - アナログ試験装置 - Google Patents
アナログ試験装置Info
- Publication number
- JPH02105081A JPH02105081A JP63257247A JP25724788A JPH02105081A JP H02105081 A JPH02105081 A JP H02105081A JP 63257247 A JP63257247 A JP 63257247A JP 25724788 A JP25724788 A JP 25724788A JP H02105081 A JPH02105081 A JP H02105081A
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- JP
- Japan
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- analog
- test signal
- variable resistor
- digital
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- Pending
Links
- 238000012360 testing method Methods 0.000 title claims abstract description 55
- 238000010586 diagram Methods 0.000 description 5
- 238000005259 measurement Methods 0.000 description 5
- 239000013256 coordination polymer Substances 0.000 description 2
- 230000006870 function Effects 0.000 description 1
- 230000004044 response Effects 0.000 description 1
Landscapes
- Testing Or Calibration Of Command Recording Devices (AREA)
- Tests Of Electronic Circuits (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
Ｃ産業上の利用分野〕
この発明は、計測制御装置等のアナログ機器づ被試験装
置として試験を行う場合に用いて好適ぬアナログ試験装
置に関するものである。
置として試験を行う場合に用いて好適ぬアナログ試験装
置に関するものである。
（従来の技術〕
第３図は従来のアナログ試験装置を示すプロ・；り図で
あり、■はアナログ試験装置、２はアナ［グ試験装置１
により試験される被試験装置であイアナログ試験装置１
において、３はＣＰＵ、４４；プログラム、データ等を
格納するメモリ、５はシ験結果等を表示する表示部、６
はアナログ試験信号を出力するアナログ出力部で、Ｄ／
Ａ変換器を含む。７は被試験装置２から出力されるアナ
ログ測定信号が入力されるアナログ入力部、８はＣＰ］
ｔＪ３と各部とを接続するパスライン、９は抵
抗値Ｌ 出力のアナログ試験信号を得るための可変抵
抗器″ から成るアナログ設定器である。
あり、■はアナログ試験装置、２はアナ［グ試験装置１
により試験される被試験装置であイアナログ試験装置１
において、３はＣＰＵ、４４；プログラム、データ等を
格納するメモリ、５はシ験結果等を表示する表示部、６
はアナログ試験信号を出力するアナログ出力部で、Ｄ／
Ａ変換器を含む。７は被試験装置２から出力されるアナ
ログ測定信号が入力されるアナログ入力部、８はＣＰ］
ｔＪ３と各部とを接続するパスライン、９は抵
抗値Ｌ 出力のアナログ試験信号を得るための可変抵
抗器″ から成るアナログ設定器である。
■ 次に動作について説明する。ＣＰＵ３はメモリ
４のプログラムに基づいて試験信号をアナログ出力部６
に送り、ここで試験信号はＤ／Ａ変換器でアナログ試験
信号に変換されて電流出力又は電圧−出力として出力さ
れ、被試験装置に人力される。
４のプログラムに基づいて試験信号をアナログ出力部６
に送り、ここで試験信号はＤ／Ａ変換器でアナログ試験
信号に変換されて電流出力又は電圧−出力として出力さ
れ、被試験装置に人力される。
【 被試験装置２からその動作状態に応して出力され
たアナログ測定信号はアナログ入力部７に入力される。
たアナログ測定信号はアナログ入力部７に入力される。
アナログ入力部７から得られる測定データはＣＰ ［Ｊ
３で分析され、その分析結果が表示部５］ で表
示される。また抵抗値出力としてのアナログ５、 試
験信号を必要とする場合は、アナログ設定器９１
を手動で操作して、所望の抵抗値出力としてのアＫ
ナログ試験信号を得る。
３で分析され、その分析結果が表示部５］ で表
示される。また抵抗値出力としてのアナログ５、 試
験信号を必要とする場合は、アナログ設定器９１
を手動で操作して、所望の抵抗値出力としてのアＫ
ナログ試験信号を得る。
従来のアナログ試験装置〃は以上のように構成されてい
るので、コンピュータｉｌ＋ ？卸とするためには、Ｄ
／Ａ変換器を含むアナログ出力部６を必要個数だけ用意
しなければならず、その必要個数によっては非常に高価
となり、また抵抗値出力によるアナログ試験信号を得る
ためには、アナログ設定器を別途設ける必要があり、し
かもこのアナログ設定器は手動操作によるので、そのた
めの人員を必要とし、試験費用が高くつく等の問題点が
あった。
るので、コンピュータｉｌ＋ ？卸とするためには、Ｄ
／Ａ変換器を含むアナログ出力部６を必要個数だけ用意
しなければならず、その必要個数によっては非常に高価
となり、また抵抗値出力によるアナログ試験信号を得る
ためには、アナログ設定器を別途設ける必要があり、し
かもこのアナログ設定器は手動操作によるので、そのた
めの人員を必要とし、試験費用が高くつく等の問題点が
あった。
この発明は以上のような課題を解決するためになされた
もので、アナログ出力回路を安価に構成すると共に、抵
抗値出力を得ることのできるアナログ試験装置を得るこ
とを目的とする。
もので、アナログ出力回路を安価に構成すると共に、抵
抗値出力を得ることのできるアナログ試験装置を得るこ
とを目的とする。
（課題を解決するための手段〕
この発明に係るアナログ試験装置は、ディジタル出力に
基づいてモータを駆動し、このモータにより可変抵抗器
を制御するようにしたものである。
基づいてモータを駆動し、このモータにより可変抵抗器
を制御するようにしたものである。
［作 用］
この発明におけるアナログ試験装置は、モータにより可
変抵抗器の抵抗値が制御されて、電流出力、電圧出力、
抵抗値出力としてのアナログ試験信号が得られる。
変抵抗器の抵抗値が制御されて、電流出力、電圧出力、
抵抗値出力としてのアナログ試験信号が得られる。
以下、この発明の一実施例を図について説明する。第１
図においては第３図と対応部分には同一符号を付して説
明を省略する。ＩＯはＣＰＵ３で演算された試験信号を
ディジタル信号のまま出力するディジタル出力部、１１
はディジタル出力部１０から得られるディジタル試験信
号で駆動されるリレー、１２はリレー１１の接点で、Ａ
Ｃ電源をＯＮ、 ＯＦＦする。１３は接点１２からのＡ
Ｃ電源で駆動されるモータ、１４．１５はモータ１３の
回転に応じてその抵抗値を可変とされる可変抵抗器、１
６は可変抵抗器１５から得られるアナログ信号が入力さ
れるアナログ人力部である。
図においては第３図と対応部分には同一符号を付して説
明を省略する。ＩＯはＣＰＵ３で演算された試験信号を
ディジタル信号のまま出力するディジタル出力部、１１
はディジタル出力部１０から得られるディジタル試験信
号で駆動されるリレー、１２はリレー１１の接点で、Ａ
Ｃ電源をＯＮ、 ＯＦＦする。１３は接点１２からのＡ
Ｃ電源で駆動されるモータ、１４．１５はモータ１３の
回転に応じてその抵抗値を可変とされる可変抵抗器、１
６は可変抵抗器１５から得られるアナログ信号が入力さ
れるアナログ人力部である。
次に動作について説明する。ディジタル出力部１０から
出力されるディジタル試験信号に応じて、接点１２がＡ
Ｃ電源をＯＮ、 ＯＦＦ Ｌ、このＡＣ電源はモータ１
３をディジタル試験信号に応じた喰だけ駆動する。これ
によって可変抵抗器１４．１５の抵抗値が制御され、ｏ
Ｔ変低抵抗器１４発生した信号はアナログ試験信号とし
て被試験装置２に人力される。また可変抵抗器１５に発
生したアナログ試験信号に応じたアナログ信号はアナロ
グ入力部１６に加えられる。ＣＰＵ３はアナログ入力部
１６からの入力データにより、現在の試験信号を知りな
がらプログラム制御を行う。また被試験装置２からアナ
ログ人力部７を介して得られる測定データが分析されて
その結果が表示部５で表示される。
出力されるディジタル試験信号に応じて、接点１２がＡ
Ｃ電源をＯＮ、 ＯＦＦ Ｌ、このＡＣ電源はモータ１
３をディジタル試験信号に応じた喰だけ駆動する。これ
によって可変抵抗器１４．１５の抵抗値が制御され、ｏ
Ｔ変低抵抗器１４発生した信号はアナログ試験信号とし
て被試験装置２に人力される。また可変抵抗器１５に発
生したアナログ試験信号に応じたアナログ信号はアナロ
グ入力部１６に加えられる。ＣＰＵ３はアナログ入力部
１６からの入力データにより、現在の試験信号を知りな
がらプログラム制御を行う。また被試験装置２からアナ
ログ人力部７を介して得られる測定データが分析されて
その結果が表示部５で表示される。
なお、上記実施例では、ｌＯ〜１６で構成される部分を
１組設けているが、この部分を複数組設けてもよい。
１組設けているが、この部分を複数組設けてもよい。
また、第２図に示すように、モータ１３及び可変抵抗器
１４．１５で構成される部分を複数個設け、これらの部
分を、別に設けたディジタル出力部１７から出力される
選択信号により、複数個のリレー１８及びその接点１９
を切替えることにより、選択的に動作させるようにして
もよい。また被試験装置に合わせてディジタル入出力回
路を設けてもよい。
１４．１５で構成される部分を複数個設け、これらの部
分を、別に設けたディジタル出力部１７から出力される
選択信号により、複数個のリレー１８及びその接点１９
を切替えることにより、選択的に動作させるようにして
もよい。また被試験装置に合わせてディジタル入出力回
路を設けてもよい。
［発明の効果］
以上のように、この発明によれば、ディジタル試験信号
をモータ、可変抵抗器を介してアナログ試験信号に変換
するように構成したので、従来用いられていた高価なア
ナログ出力部を必要とせず、汎用のパーソナルコンピュ
ータを用いて安価に製作することができ、また可変抵抗
器からアナログ試験信号を得ているので、電流出力、電
圧出力。
をモータ、可変抵抗器を介してアナログ試験信号に変換
するように構成したので、従来用いられていた高価なア
ナログ出力部を必要とせず、汎用のパーソナルコンピュ
ータを用いて安価に製作することができ、また可変抵抗
器からアナログ試験信号を得ているので、電流出力、電
圧出力。
抵抗値出力を得ることができ、従来の手動によるアナロ
グ設定器を省略することができる等の効果が得られる。
グ設定器を省略することができる等の効果が得られる。
第１図はこの発明の一実施例によるアナログ試験装置を
示すブロック図、第２図はこの発明の他の実施例による
アナログ試験装置を示すブロック図、第３図は従来のア
ナログ試験装置を示すブロック図である。 ■はアナログ試験装置、１０はディジタル出力部、ＩＩ
はリレー、１２は接点、Ｉ３はモータ、１４．１５は可
変抵抗器。 なお、図中、同一・符号は同一、または相当部分を示す
。 特許出願人 三菱電機株式会社
示すブロック図、第２図はこの発明の他の実施例による
アナログ試験装置を示すブロック図、第３図は従来のア
ナログ試験装置を示すブロック図である。 ■はアナログ試験装置、１０はディジタル出力部、ＩＩ
はリレー、１２は接点、Ｉ３はモータ、１４．１５は可
変抵抗器。 なお、図中、同一・符号は同一、または相当部分を示す
。 特許出願人 三菱電機株式会社
Claims (1)
- ディジタル試験信号を出力するディジタル出力部と、上
記ディジタル試験信号に応じて駆動されるモータと、上
記モータにより抵抗値を可変とされその抵抗値に応じた
アナログ信号を発生する可変抵抗器とを備えたアナログ
試験装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63257247A JPH02105081A (ja) | 1988-10-14 | 1988-10-14 | アナログ試験装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63257247A JPH02105081A (ja) | 1988-10-14 | 1988-10-14 | アナログ試験装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02105081A true JPH02105081A (ja) | 1990-04-17 |
Family
ID=17303736
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63257247A Pending JPH02105081A (ja) | 1988-10-14 | 1988-10-14 | アナログ試験装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02105081A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7576080B2 (en) | 2004-12-23 | 2009-08-18 | Memory Pharmaceuticals Corporation | Certain thienopyrimidine derivatives as phosphodiesterase 10 inhibitors |
-
1988
- 1988-10-14 JP JP63257247A patent/JPH02105081A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7576080B2 (en) | 2004-12-23 | 2009-08-18 | Memory Pharmaceuticals Corporation | Certain thienopyrimidine derivatives as phosphodiesterase 10 inhibitors |
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