JPH0191958U - - Google Patents
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- Publication number
- JPH0191958U JPH0191958U JP18638987U JP18638987U JPH0191958U JP H0191958 U JPH0191958 U JP H0191958U JP 18638987 U JP18638987 U JP 18638987U JP 18638987 U JP18638987 U JP 18638987U JP H0191958 U JPH0191958 U JP H0191958U
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- JP
- Japan
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- 238000010586 diagram Methods 0.000 description 1
Description
第１図はこの考案の一実施例の回路構成を示す
ブロツク図、第２図は同実施例の動作を説明する
ためのフローチヤートである。 １……キー入力部、２……制御部、４……表示
部、５……アドレス制御部、６……フアイル管理
部、７……指定フアイルアドレス記憶部、８……
ソースプログラム記憶部、９……オブジエクトプ
ログラム記憶部。
ブロツク図、第２図は同実施例の動作を説明する
ためのフローチヤートである。 １……キー入力部、２……制御部、４……表示
部、５……アドレス制御部、６……フアイル管理
部、７……指定フアイルアドレス記憶部、８……
ソースプログラム記憶部、９……オブジエクトプ
ログラム記憶部。
Claims (1)
- プログラムデータを入力する入力手段と、この
入力手段より入力されたプログラムを記憶する記
憶手段と、この記憶手段に記憶されたプログラム
をフアイル単位で管理するフアイル管理手段と、
編集モードで指定されたフアイルアドレスを記憶
する指定フアイルアドレス記憶手段と、編集モー
ド中に実行モードが指定されると上記指定フアイ
ルアドレス記憶手段に記憶されたアドレスのフア
イルを読出し実行させる制御手段とを具備したこ
とを特徴とする小型電子式計算機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18638987U JPH0191958U (ja) | 1987-12-09 | 1987-12-09 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18638987U JPH0191958U (ja) | 1987-12-09 | 1987-12-09 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0191958U true JPH0191958U (ja) | 1989-06-16 |
Family
ID=31477617
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18638987U Pending JPH0191958U (ja) | 1987-12-09 | 1987-12-09 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0191958U (ja) |
-
1987
- 1987-12-09 JP JP18638987U patent/JPH0191958U/ja active Pending
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