JPH018021Y2 - - Google Patents

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JPH018021Y2
JPH018021Y2 JP1981167169U JP16716981U JPH018021Y2 JP H018021 Y2 JPH018021 Y2 JP H018021Y2 JP 1981167169 U JP1981167169 U JP 1981167169U JP 16716981 U JP16716981 U JP 16716981U JP H018021 Y2 JPH018021 Y2 JP H018021Y2
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JP
Japan
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channel
output
terminal
counter
circuit
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  • Channel Selection Circuits, Automatic Tuning Circuits (AREA)

Description

【考案の詳細な説明】 本考案は所定数カウントする毎にリセツトされ
る如くなされたカウンタの出力信号によりチヤン
ネルを選択するようにしたテレビジヨン受像機の
チヤンネル選択装置に関し、特に今視聴している
チヤンネル以外のチヤンネルで何を放送している
かを試見しようとする場合に煩わしい操作を必要
とせずに今視聴しているチヤンネル以外のチヤン
ネルを試見することができるようにしたものであ
る。
[Detailed Description of the Invention] The present invention relates to a channel selection device for a television receiver that selects a channel based on the output signal of a counter that is reset every time a predetermined number of channels are counted. When trying to preview what is being broadcast on a channel other than the channel, the user can preview a channel other than the one currently being viewed without requiring any troublesome operations.

従来第1図に示す如きテレビジヨン受像機のチ
ヤンネル選択装置としてカウンタの出力信号に応
じたチヤンネル選択用電圧を得、このチヤンネル
選択用電圧により受信チヤンネルを決定する様に
したものが提案されている。即ち、第1図に於い
て、1はテレビジヨン受像機の電子同調部を示
し、この電子同調部1は供給電圧により容量値が
変化する可変容量ダイオードを用いたものであ
る。この第1図に於いては、この電子同調部1は
抵抗器2の両端に得られる電圧を可変容量ダイオ
ードに供給して受信チヤンネルを決定するように
なされている。又、3はチヤンネル順次選択用の
押釦スイツチを示し、この押釦スイツチ3は一端
を正の直流電圧が供給される電源端子4に接続
し、この他端を一定周期例えば0.7秒でパルスを
出力するパルス発生回路5の電源端子に接続され
ている。そしてこのパルス発生回路5の出力端子
はカウンタ6の入力端子に接続されている。この
カウンタ6は入力端子に供給されるパルスを12個
計数する毎にリセツトされる如くなされこの計数
内容が4個の出力端子に2進コードよりなる4ビ
ツトの並列信号として出力される様になされたも
のである。そしてこのカウンタ6の4個の出力端
子はデコーダ7の4個の入力端子に接続されてい
る。このデコーダ7は12個の出力端子を有し、こ
の4個の入力端子に供給される4ビツトの並列信
号により12個の出力端子のうちの1つを接地する
様になされたものである。そしてこのデコーダ7
の12個の出力端子7a,7b…7lには受信チヤ
ンネル表示用のネオンランプ8a,8b…8lの
一端及びチヤンネル選択用電圧決定用の可変抵抗
器9a,9b…9lの一端が夫々接続され、そし
てこれらのネオンランプ8a,8b…8lの夫々
の他端は電源端子4に接続され、可変抵抗器9
a,9b…9lの夫々の他端は正の直流電圧が供
給される電源端子11に夫々接続され、又、可変
抵抗器9a,9b…9lの可動子には逆流防止用
のダイオード10a,10b…10lのカソード
が夫々接続され、そしてこれらのダイオード10
a,10b…10lのアノードは共通に接続され
てエミツタホロワ回路を構成するNPN形のトラ
ンジスタ12のベースに接続される。更にこのト
ランジスタ12のベースは抵抗器13を介して電
源端子11に接続され、このエミツタは抵抗器2
を介して接地され、このコレクタは電源端子11
に接続されている。
Conventionally, a channel selection device for a television receiver as shown in FIG. 1 has been proposed in which a channel selection voltage is obtained in accordance with the output signal of a counter, and the reception channel is determined by this channel selection voltage. . That is, in FIG. 1, numeral 1 indicates an electronic tuning section of a television receiver, and this electronic tuning section 1 uses a variable capacitance diode whose capacitance value changes depending on the supplied voltage. In FIG. 1, the electronic tuning section 1 supplies a voltage obtained across a resistor 2 to a variable capacitance diode to determine a reception channel. Further, 3 indicates a push button switch for sequential channel selection, one end of which is connected to a power supply terminal 4 to which a positive DC voltage is supplied, and the other end of which outputs pulses at a fixed period, for example, 0.7 seconds. It is connected to the power supply terminal of the pulse generation circuit 5. The output terminal of this pulse generating circuit 5 is connected to the input terminal of a counter 6. This counter 6 is configured to be reset every time it counts 12 pulses supplied to the input terminal, and the count contents are outputted to the four output terminals as a 4-bit parallel signal consisting of a binary code. It is something that The four output terminals of the counter 6 are connected to the four input terminals of the decoder 7. This decoder 7 has 12 output terminals, and one of the 12 output terminals is grounded by a 4-bit parallel signal supplied to these 4 input terminals. And this decoder 7
One end of a neon lamp 8a, 8b...8l for displaying a reception channel and one end of a variable resistor 9a, 9b...9l for determining a channel selection voltage are connected to the twelve output terminals 7a, 7b...7l, respectively. The other ends of each of these neon lamps 8a, 8b...8l are connected to the power supply terminal 4, and are connected to the variable resistor 9.
The other ends of each of the variable resistors 9a, 9b, . ...10l cathodes are connected respectively, and these diodes 10
The anodes of a, 10b, . . . , 10l are connected in common and connected to the base of an NPN type transistor 12 constituting an emitter follower circuit. Furthermore, the base of this transistor 12 is connected to the power supply terminal 11 via a resistor 13, and the emitter of this transistor 12 is connected to the power supply terminal 11 via a resistor 13.
This collector is grounded via the power supply terminal 11.
It is connected to the.

斯る第1図に示す如きテレビジヨン受像機のチ
ヤンネル選択装置によりチヤンネル選択する場
合、チヤンネル順次選択用の押釦スイツチ3をオ
ンとする。このとき、この押釦スイツチ3を介し
てパルス発生回路5に電源が供給され、このパル
ス発生回路5が動作し0.7秒周期でパルスを出力
する。このパルスはカウンタ6に供給され、この
カウンタ6がこのパルスを計数し、この計数内容
が4ビツトの並列信号として次段のデコーダ7に
供給され、このデコーダ7に於いてパルスがカウ
ンタ6に供給される毎に順次所定の1つの出力端
子が接地される。この場合、出力端子7a,7b
…7lの接地に対応して受信チヤンネル表示用の
ネオンランプ8a,8b…8lが点灯し、現在選
局されているチヤンネルを表示する。例えば第2
チヤンネルが選局されたときに押釦スイツチ3を
オフとする。このとき、第2チヤンネルにプリセ
ツトされた可変抵抗器9bに電源端子11から電
流が流れる為に、このプリセツトされた可変抵抗
器9bにて設定される電圧がトランジスタ12を
介して抵抗器2の両端に得られる。この様にして
電子同調部1にチヤンネル選択用の電圧が供給さ
れ、所望の例えば第2チヤンネルの選択がなされ
る。
When selecting a channel using the channel selection device of the television receiver as shown in FIG. 1, the push button switch 3 for sequential channel selection is turned on. At this time, power is supplied to the pulse generation circuit 5 through the push button switch 3, and the pulse generation circuit 5 operates to output pulses at a period of 0.7 seconds. This pulse is supplied to the counter 6, this counter 6 counts this pulse, and the content of this count is supplied as a 4-bit parallel signal to the next stage decoder 7, and in this decoder 7, the pulse is supplied to the counter 6. One predetermined output terminal is grounded each time the output terminal is connected. In this case, output terminals 7a, 7b
. . 7l is grounded, neon lamps 8a, 8b, . For example, the second
When a channel is selected, the push button switch 3 is turned off. At this time, since current flows from the power supply terminal 11 to the variable resistor 9b preset in the second channel, the voltage set in the preset variable resistor 9b is applied to both ends of the resistor 2 via the transistor 12. can be obtained. In this manner, a voltage for channel selection is supplied to the electronic tuning section 1, and a desired selection of, for example, the second channel is made.

斯かる第1図に示す如き従来のテレビジヨン受
像機のチヤンネル選択装置に於いては、押釦スイ
ツチ3をオン・オフするだけでチヤンネルを選択
できるため、フエザータツチ式のチヤンネル選択
装置を提供できる。然し乍ら、この様なチヤンネ
ル選択装置に於いて、今視聴しているチヤンネル
以外のチヤンネルで何を放送しているかを試見し
ようとする場合には、押釦スイツチ3を押し続け
ていなければならず、然も、元の視聴していたチ
ヤンネルを再び視聴しようとするとその都度元の
チヤンネルを記憶していなければならないという
煩わしさがあつた。
In the conventional channel selection device for a television receiver as shown in FIG. 1, a channel can be selected by simply turning on and off the push button switch 3, so that a feather touch type channel selection device can be provided. However, with such a channel selection device, if you want to preview what is being broadcast on a channel other than the channel you are currently watching, you must keep pressing push button switch 3. However, there was the annoyance of having to remember the original channel each time I tried to watch it again.

本考案は斯かる点に鑑み今視聴しているチヤン
ネル以外のチヤンネルで何を放送しているかを試
見しようとする場合に煩わしい操作を必要とせ
ず、簡単な操作で今視聴しているチヤンネル以外
のチヤンネルを試見することができるようにした
ものである。
In view of this, this invention does not require any troublesome operations when trying to preview what is being broadcast on a channel other than the channel you are currently watching, and allows you to easily view what is being broadcast on a channel other than the channel you are currently watching. This allows you to preview the channel.

以下、第2図を参照して本考案テレビジヨン受
像機のチヤンネル選択装置の一実施例について説
明しよう。この第2図に於いて第1図と対応する
部分には同一符号を付し、その詳細な説明は省略
する。
Hereinafter, an embodiment of the channel selection device for the television receiver of the present invention will be described with reference to FIG. In FIG. 2, parts corresponding to those in FIG. 1 are designated by the same reference numerals, and detailed explanation thereof will be omitted.

第2図に於いて、14はチヤンネル選択の補助
の押釦スイツチより成るチヤンネル一周送りスイ
ツチを示し、このチヤンネル一周送りスイツチ1
4の一端を電源端子4に接続し、この他端をR−
Sフリツプフロツプ15のセツト端子S、第1の
Tフリツプフロツプ16のリセツト端子R1およ
び第2のTフリツプフロツプ17のリセツト端子
R2に夫々接続する。このR−Sフリツプフロツ
プ15はセツト端子Sに電源端子4よりの電源電
圧が供給されるとその立ち上がり時にセツトさ
れ、この出力端子Q及びから夫々ハイレベル信
号及びローレベル信号が得られ、又リセツト端子
Rに、リセツト信号が入力されるとその信号の立
ち上がりに同期して出力端子Q及びから夫々ロ
ーレベル信号及びハイレベル信号が得られるもの
である。又、第1及び第2のTフリツプフロツプ
16及び17はリセツト端子R1及びR2にリセツ
ト信号としてのハイレベル信号が入力されるとそ
の信号の立ち上がりに同期して出力端子Q1及び
Q2から夫々ローレベル信号、出力端子1からハ
イレベル信号が出力される。又、トリガ端子T1
及びT2にトリガ信号としてのハイレベル信号が
繰り返し入力されると、その夫々の信号の立ち上
がりに同期して出力端子Q1及びQ2からハイレベ
ル信号及びローレベル信号が交互に出力される。
一方、出力端子1は出力端子Q1とはハイレベル
信号及びローレベル信号の出力が逆の関係にあ
る。このR−Sフリツプフロツプ15の出力端子
Qをパルス発生回路18の入力端子に接続する。
このパルス発生回路18は入力端子に電源電圧で
あるハイレベル信号が入力されると、そのハイレ
ベル信号が入力されている期間に於いて、一定周
期例えば3秒で1個のパルスを発生するものであ
り、このパルス発生回路18の出力端子をカウン
タ6の入力端子に接続する。又、カウンタ6の4
個の出力端子をラツチ回路20の4個の入力端子
に接続する。このラツチ回路20はラツチ電圧が
供給される期間このラツチ電圧の供給される直前
の入力信号を記憶し、読み出し用電圧が供給され
る期間記憶した信号を出力するようになされたも
のである。このラツチ回路20のラツチ電圧供給
用の端子をR−Sフリツプフロツプ15の出力端
子に接続する。読み出し用電圧の供給用の端子
にはR−Sフリツプフロツプ15の出力端子Qに
得られる信号が抵抗器19及びコンデンサ21よ
り構成される遅延回路を介して供給される。更に
このラツチ回路20の4個の出力端子を夫々エク
スクルーシイブノア回路22,23,24,25
の一方の入力端子に接続する。一方、カウンタ6
の4個の出力端子をこれらエクスクルーシイブノ
ア回路22,23,24,25の他方の入力端子
に夫々接続する。この夫々のエクスクルーシイブ
ノア回路22,23,24,25は入力信号相互
の一致を検出するものであり、入力信号が一致し
たときにこれらのエクスクルーシイブノア回路2
2,23,24,25の出力端子からハイレベル
信号が出力される。このエクスクルーシイブノア
回路22,23,24,25の出力端子をアンド
回路26の4個の入力端子に夫々接続し、このア
ンド回路26の出力端子を第1のTフリツプフロ
ツプ16のトリガ端子T1に接続する。この第1
のTフリツプフロツプ16の出力端子Q1を切換
スイツチ27の固定接点b及びアンド回路28の
一方の入力端子に接続し、又、出力端子1を第
2のTフリツプフロツプ17のトリガ端子T2
接続する。そしてこの第2のTフリツプフロツプ
17の出力端子Q2を切換スイツチ27の固定接
点c及びアンド回路28の他方の入力端子に接続
する。これら第1のTフリツプフロツプ16、第
2のTフリツプフロツプ17及びアンド回路28
はアンド回路26から出力される信号の数を計数
するように構成したものである。そしてアンド回
路28の出力端子を切換スイツチ27の固定接点
dに接続する。切換スイツチ27の可動接点aを
R−Sフリツプフロツプ15のリセツト端子Rに
接続する。この切換スイツチ27はチヤンネルを
何回り試見するかを決定するもので、固定接点
b,c及びdは夫々1回り、2回り及び3回りに
対応するものである。
In FIG. 2, reference numeral 14 indicates a channel one-round feed switch consisting of a push button switch for assisting channel selection.
Connect one end of 4 to power supply terminal 4, and connect the other end to R-
Set terminal S of the S flip-flop 15, reset terminal R1 of the first T flip-flop 16 and reset terminal of the second T flip-flop 17.
Connect to R 2 respectively. When the power supply voltage from the power supply terminal 4 is supplied to the set terminal S, this R-S flip-flop 15 is set at the rising time, and a high level signal and a low level signal are obtained from the output terminals Q and 4, respectively, and the reset terminal When a reset signal is input to R, a low level signal and a high level signal are obtained from the output terminals Q and Q, respectively, in synchronization with the rising edge of the signal. Furthermore, when a high level signal as a reset signal is input to the reset terminals R1 and R2, the first and second T flip-flops 16 and 17 output the output terminals Q1 and R2 in synchronization with the rising edge of the signal.
A low level signal is output from Q2 , and a high level signal is output from output terminal 1 . Also, trigger terminal T 1
When a high level signal as a trigger signal is repeatedly input to T2 and T2 , a high level signal and a low level signal are alternately output from the output terminals Q1 and Q2 in synchronization with the rise of each signal.
On the other hand, the output terminal 1 has a reverse relationship with respect to the output terminal Q 1 in terms of output of high level signals and low level signals. The output terminal Q of this R-S flip-flop 15 is connected to the input terminal of a pulse generating circuit 18.
When a high level signal, which is a power supply voltage, is input to the input terminal, this pulse generating circuit 18 generates one pulse at a fixed period, for example, 3 seconds, during the period during which the high level signal is input. The output terminal of this pulse generating circuit 18 is connected to the input terminal of the counter 6. Also, counter 6-4
The four output terminals are connected to the four input terminals of the latch circuit 20. This latch circuit 20 stores the input signal immediately before the latch voltage is supplied while the latch voltage is supplied, and outputs the stored signal while the read voltage is supplied. The latch voltage supply terminal of the latch circuit 20 is connected to the output terminal of the R-S flip-flop 15. A signal obtained at the output terminal Q of the R-S flip-flop 15 is supplied to the read voltage supply terminal via a delay circuit composed of a resistor 19 and a capacitor 21. Furthermore, the four output terminals of this latch circuit 20 are connected to exclusive NOR circuits 22, 23, 24, 25, respectively.
Connect to one input terminal of the On the other hand, counter 6
The four output terminals are connected to the other input terminals of these exclusive NOR circuits 22, 23, 24, and 25, respectively. These exclusive NOR circuits 22, 23, 24, and 25 detect whether the input signals match each other, and when the input signals match, these exclusive NOR circuits 2
High level signals are output from output terminals 2, 23, 24, and 25. The output terminals of the exclusive NOR circuits 22, 23, 24, and 25 are respectively connected to four input terminals of an AND circuit 26, and the output terminal of the AND circuit 26 is connected to the trigger terminal T1 of the first T flip-flop 16. Connect to. This first
The output terminal Q 1 of the T flip-flop 16 is connected to the fixed contact b of the changeover switch 27 and one input terminal of the AND circuit 28, and the output terminal 1 is connected to the trigger terminal T 2 of the second T flip-flop 17. . The output terminal Q 2 of the second T flip-flop 17 is connected to the fixed contact c of the changeover switch 27 and the other input terminal of the AND circuit 28 . These first T flip-flop 16, second T flip-flop 17 and AND circuit 28
is configured to count the number of signals output from the AND circuit 26. Then, the output terminal of the AND circuit 28 is connected to the fixed contact d of the changeover switch 27. The movable contact a of the changeover switch 27 is connected to the reset terminal R of the R-S flip-flop 15. This changeover switch 27 determines how many times the channel is sampled, and fixed contacts b, c, and d correspond to 1st, 2nd, and 3rd turns, respectively.

以上述べた如く構成されたテレビジヨン受像機
のチヤンネル選択装置に於いて、今第2チヤンネ
ルが選択してあつたとする。このとき、今視聴し
ている第2チヤンネル以外のチヤンネルで何を放
送しているか1回りチヤンネルを選択して試見す
る場合について説明する。
Assume that the second channel has now been selected in the channel selection device of the television receiver configured as described above. At this time, a case will be described in which the user selects one channel and previews what is being broadcast on a channel other than the second channel that is currently being viewed.

今時刻t0で開始スイツチであるチヤンネル一周
送りスイツチ14をオンすると電源電圧の立上り
に対応した第3図Aに示す様なパルスがR−Sフ
リツプフロツプ15のセツト端子S、第1のTフ
リツプフロツプ16のリセツト端子R1及び第2
のTフリツプフロツプ17のリセツト端子R2
供給される。すると、第1及び第2のTフリツプ
フロツプ16及び17がリセツトされると共に、
R−Sフリツプフロツプ15がセツトされる。そ
してこのR−Sフリツプフロツプ15の出力端子
Qから電源電圧であるハイレベル信号がパルス発
生回路18の入力端子に供給され(第3図B参
照)、出力端子からローレベル信号がラツチ電
圧としてラツチ回路20に供給される(第3図C
参照)。このとき、ラツチ回路20はカウンタ6
の出力端子に得られている信号即ち、第2チヤン
ネルを選択する信号〔0010〕を記憶する。
When the channel one-round feed switch 14, which is the start switch, is turned on at current time t0 , a pulse as shown in FIG. reset terminal R1 and second
is supplied to the reset terminal R2 of the T flip-flop 17. Then, the first and second T flip-flops 16 and 17 are reset, and
R-S flip-flop 15 is set. A high level signal, which is the power supply voltage, is supplied from the output terminal Q of the R-S flip-flop 15 to the input terminal of the pulse generation circuit 18 (see FIG. 3B), and a low level signal is output from the output terminal as a latch voltage to the latch circuit. 20 (Fig. 3C)
reference). At this time, the latch circuit 20
The signal obtained at the output terminal of , ie, the signal [0010] for selecting the second channel, is stored.

又、R−Sフリツプフロツプ15の出力端子Q
からのハイレベル信号がパルス発生回路18を駆
動し、3秒周期でパルスがカウンタ6に供給され
る(第3図D参照)と共に抵抗器19及びコンデ
ンサ21より成る遅延回路を介して得られる第3
図Eに示す如き(t1−t0)遅延された信号がラツ
チ回路20の読み出し用電圧供給端子に供給さ
れ、読み出しが可能となる。このとき、パルス発
生回路18から出力される3秒周期のパルスによ
りチヤンネルが選択されていく、即ち、視聴者は
3秒間づつ順次12個のチヤンネルを試見すること
になる。
Also, the output terminal Q of the R-S flip-flop 15
A high-level signal from the pulse generating circuit 18 drives the pulse generating circuit 18, and pulses are supplied to the counter 6 at a period of 3 seconds (see FIG. 3D). 3
A signal delayed by (t 1 -t 0 ) as shown in FIG. E is supplied to the read voltage supply terminal of the latch circuit 20, and reading becomes possible. At this time, channels are selected by pulses with a period of 3 seconds outputted from the pulse generating circuit 18, that is, the viewer previews 12 channels in sequence for 3 seconds each.

そして、ラツチ回路20が記憶している信号を
エクスクルーシイブノア回路22,23,24,
25に出力し(第3図F参照)、このときエクス
クルーシイブノア回路22,23,24,25及
びアンド回路26は、3秒周期で変化しているカ
ウンタ6の出力信号とラツチ回路20の出力信号
とを比較し、一致するまで第1のTフリツプフロ
ツプ16のトリガ端子T1にローレベル信号を供
給し続ける。そしてカウンタ6の出力信号とラツ
チ回路20の出力信号とが一致したとき、即ち、
時刻t2のとき、エクスクルーシイブノア回路2
2,23,24,25及びアンド回路26の出力
がハイレベル信号となる(第3図G参照)。する
と第1のTフリツプフロツプ16の出力端子Q1
及び1が夫々ハイレベル信号(第3図H参照)
及びローレベル信号となる。そしてこの第1のフ
リツプフロツプ16の出力端子Q1からのハイレ
ベル信号が切換スイツチ27を介してR−Sフリ
ツプフロツプ15のリセツト端子Rに供給され、
このとき、このR−Sフリツプフロツプ15はリ
セツトされ、その出力端子Q及びから夫々ロー
レベル信号及びハイレベル信号を出力する。この
R−Sフリツプフロツプ15の出力端子Qからロ
ーレベル信号を出力することにより、パルス発生
回路18が不動作状態(第3図D参照)となされ
ると共にコンデンサ21が放電し(第3図E参
照)、ラツチ回路20が出力しなくなる。又、R
−Sフリツプフロツプ回路15の出力端子から
ハイレベル信号が出力されることにより、ラツチ
回路20はラツチすることなく、その内容の書き
換えが自由になる。この様にして、チヤンネルが
3秒間隔で1回り選択されて再び元の視聴してい
たチヤンネルが選択される。
Then, the signal stored in the latch circuit 20 is transferred to the exclusive NOR circuits 22, 23, 24,
25 (see FIG. 3F), and at this time, exclusive NOR circuits 22, 23, 24, 25 and AND circuit 26 output the output signal of counter 6, which is changing at a cycle of 3 seconds, and the latch circuit 20. The low level signal is continued to be supplied to the trigger terminal T1 of the first T flip-flop 16 until they match. When the output signal of the counter 6 and the output signal of the latch circuit 20 match, that is,
At time t 2 , exclusive Noah circuit 2
2, 23, 24, 25 and the outputs of the AND circuit 26 become high level signals (see FIG. 3G). Then, the output terminal Q 1 of the first T flip-flop 16
and 1 are high level signals (see Figure 3 H)
and becomes a low level signal. A high level signal from the output terminal Q1 of the first flip-flop 16 is supplied to the reset terminal R of the R-S flip-flop 15 via the changeover switch 27.
At this time, the R-S flip-flop 15 is reset and outputs a low level signal and a high level signal from its output terminals Q and Q, respectively. By outputting a low level signal from the output terminal Q of the R-S flip-flop 15, the pulse generating circuit 18 is rendered inactive (see FIG. 3D), and the capacitor 21 is discharged (see FIG. 3E). ), the latch circuit 20 stops outputting. Also, R
By outputting a high level signal from the output terminal of the -S flip-flop circuit 15, the latch circuit 20 can freely rewrite its contents without latching. In this way, the channel is selected once at 3 second intervals, and the original channel being viewed is selected again.

そして、視聴者が他に視聴したいチヤンネルを
見つけたときは、従来と同様にチヤンネル順次選
択用の押釦スイツチ3を操作して所望のチヤンネ
ルを選局すればよい。
When the viewer finds another channel that he/she wishes to view, he/she may select the desired channel by operating the push button switch 3 for channel sequential selection, as in the past.

又、チヤンネルを1回りだけでなく2回り若し
くは3回り試見しようとする場合は切換スイツチ
27の可動接点aを夫々固定接点c若しくはdに
切り換えればよい。この場合、固定接点c及びd
はアンド回路26から2回及び3回ハイレベル信
号が供給されたときにハイレベル信号が得られる
ものである。
Furthermore, when trying to test the channel not only once but also twice or three times, the movable contact a of the changeover switch 27 may be switched to the fixed contact c or d, respectively. In this case, fixed contacts c and d
A high level signal is obtained when a high level signal is supplied from the AND circuit 26 twice and three times.

以上述べた如く本考案に依れば、テレビジヨン
受像機に於いて、今視聴しているチヤンネル以外
のチヤンネルで何を放送しているかを試見しよう
とする場合に、チヤンネル一周送りスイツチ14
を操作することにより自動的に順次受信チヤンネ
ルが所定時間例えば3秒毎に変わつていき全チヤ
ンネル例えば12チヤンネルを順次試見することが
できる。従つて、今視聴しているチヤンネル以外
のチヤンネルで何を放送しているかを試見しよう
とする場合に、第1図の様に押釦スイツチ3等を
操作し続けるという煩わしい操作を必要とせず、
簡単な操作で今視聴している以外のチヤンネルを
試見することができる。又、本考案に依れば、チ
ヤンネル一周送りスイツチ14を操作する前の受
信チヤンネルを選局する4ビツトの信号をラツチ
回路に記憶し、その後、そのラツチ回路の出力と
カウンタの出力とを比較し、このラツチ回路の出
力とカウンタの出力とが一致したときに選局動作
を停止する様にしたので、元の視聴していたチヤ
ンネルを再び視聴しようとするとその都度元のチ
ヤンネルを記憶している必要がなく非常に便利で
ある。
As described above, according to the present invention, when trying to preview what is being broadcast on a channel other than the channel currently being viewed on a television receiver, the channel forward switch 14
By operating , the reception channels automatically change sequentially at predetermined intervals, for example every 3 seconds, and all channels, for example 12 channels, can be previewed in sequence. Therefore, when trying to preview what is being broadcast on a channel other than the one currently being watched, there is no need for the troublesome operation of continuously operating the push button switch 3, etc. as shown in Figure 1.
With a simple operation, you can preview channels other than the one you are currently watching. Further, according to the present invention, a 4-bit signal for selecting a reception channel before operating the channel round feed switch 14 is stored in a latch circuit, and then the output of the latch circuit and the output of the counter are compared. However, when the output of this latch circuit and the output of the counter match, the channel selection operation is stopped, so when you try to watch the channel you were originally watching again, the original channel is memorized and saved. It's very convenient as you don't have to be there.

尚、本考案は上述実施例に限らず本考案の要旨
を逸脱することなくその他種々の構成が取り得る
ことは勿論である。
It goes without saying that the present invention is not limited to the above-described embodiments, and that various other configurations may be adopted without departing from the gist of the present invention.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来のテレビジヨン受像機のチヤンネ
ル選択装置の例を示す構成図、第2図は本考案テ
レビジヨン受像機のチヤンネル選択装置の一実施
例を示す構成図、第3図は第2図の動作説明に供
する線図である。 6はカウンタ、7はデコーダ、14はチヤンネ
ル一周送りスイツチ、15はR−Sフリツプフロ
ツプ、16及び17は夫夫第1及び第2のTフリ
ツプフロツプ、18はパルス発生回路、19は抵
抗器、20はラツチ回路、21はコンデンサ、2
2,23,24及び25はエクスクルーシイブノ
ア回路、26はアンド回路、27は切換スイツ
チ、28はアンド回路である。
FIG. 1 is a block diagram showing an example of a conventional channel selection device for a television receiver, FIG. 2 is a block diagram showing an embodiment of a channel selection device for a television receiver according to the present invention, and FIG. FIG. 4 is a diagram for explaining the operation of the figure. 6 is a counter, 7 is a decoder, 14 is a channel one-round feed switch, 15 is an R-S flip-flop, 16 and 17 are first and second T flip-flops, 18 is a pulse generation circuit, 19 is a resistor, 20 is a latch circuit, 21 is a capacitor, 2
2, 23, 24 and 25 are exclusive NOR circuits, 26 is an AND circuit, 27 is a changeover switch, and 28 is an AND circuit.

Claims (1)

【実用新案登録請求の範囲】 所定数カウントする毎にリセツトされる如くな
されたカウンタの出力によりチヤンネルを決定す
るようにしたテレビジヨン受像機のチヤンネル選
択装置において、 チヤンネルを一周送らせるためのチヤンネル一
周送りスイツチを操作することによりパルス発生
回路を動作させて該パルス発生回路よりのパルス
を上記カウンタに供給すると共に、上記カウンタ
の上記チヤンネル一周送りスイツチを操作した時
点の値をラツチ回路に記憶し、その後該ラツチ回
路の出力と上記カウンタの出力とを比較し、該ラ
ツチ回路の出力と上記カウンタの出力とが一致し
たときに上記パルス発生回路の動作を停止するよ
うにしたことを特徴とするテレビジヨン受像機の
チヤンネル選択装置。
[Claims for Utility Model Registration] In a channel selection device for a television receiver that determines a channel based on the output of a counter that is reset every time a predetermined number of counts are counted, By operating a feed switch, a pulse generation circuit is operated to supply pulses from the pulse generation circuit to the counter, and a value at the time when the channel one-round feed switch of the counter is operated is stored in a latch circuit; Thereafter, the output of the latch circuit and the output of the counter are compared, and when the output of the latch circuit and the output of the counter match, the operation of the pulse generation circuit is stopped. Channel selection device for digital receiver.
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