JPH0176154U - - Google Patents
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- Publication number
- JPH0176154U JPH0176154U JP1987169073U JP16907387U JPH0176154U JP H0176154 U JPH0176154 U JP H0176154U JP 1987169073 U JP1987169073 U JP 1987169073U JP 16907387 U JP16907387 U JP 16907387U JP H0176154 U JPH0176154 U JP H0176154U
- Authority
- JP
- Japan
- Prior art keywords
- power source
- storage battery
- parallel
- load
- diode
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Stand-By Power Supply Arrangements (AREA)
Description
第１図は本考案の一実施例のメモリバツクアツ
プ回路図。第２図は従来のメモリバツクアツプ回
路図である。 １，２…入力端子、３…ＤＣ電源、４…蓄電池
、６，７…出力端子、８…負荷、９…ダイオード
、１０…可変抵抗、１１…トランジスタ、１２ａ
…コイル、１２ｂ…接点、１３ａ…コイル、１３
ｂ…接点。
プ回路図。第２図は従来のメモリバツクアツプ回
路図である。 １，２…入力端子、３…ＤＣ電源、４…蓄電池
、６，７…出力端子、８…負荷、９…ダイオード
、１０…可変抵抗、１１…トランジスタ、１２ａ
…コイル、１２ｂ…接点、１３ａ…コイル、１３
ｂ…接点。
Claims (1)
- 電源が印加される入力端子に接続されたＤＣ電
源と、このＤＣ電源の出力端子にダイオードを通
じて直列に接続されたメモリを含む負荷と、ＤＣ
電源と負荷との間に負荷と並列に接続された蓄電
池を含む充電回路及び蓄電池の放電を制御する制
御回路からなるメモリバツクアツプ回路において
、入力端子とＤＣ電源との間にＤＣ電源と並列に
接続されたコイルと、ＤＣ電源の出力端子と蓄電
池との間に直列に且つダイオードと並列に接続さ
れた接点とを備えたリレーを設けたことを特徴と
するメモリバツクアツプ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1987169073U JPH0176154U (ja) | 1987-11-06 | 1987-11-06 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1987169073U JPH0176154U (ja) | 1987-11-06 | 1987-11-06 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0176154U true JPH0176154U (ja) | 1989-05-23 |
Family
ID=31458815
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1987169073U Pending JPH0176154U (ja) | 1987-11-06 | 1987-11-06 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0176154U (ja) |
-
1987
- 1987-11-06 JP JP1987169073U patent/JPH0176154U/ja active Pending