JPH0150994B2 - - Google Patents

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JPH0150994B2
JPH0150994B2 JP3034182A JP3034182A JPH0150994B2 JP H0150994 B2 JPH0150994 B2 JP H0150994B2 JP 3034182 A JP3034182 A JP 3034182A JP 3034182 A JP3034182 A JP 3034182A JP H0150994 B2 JPH0150994 B2 JP H0150994B2
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JP
Japan
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signal
comparator
reference value
detection circuit
output
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JP3034182A
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Japanese (ja)
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JPS58147814A (en
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Kazutoshi Kusano
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NEC Home Electronics Ltd
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NEC Home Electronics Ltd
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Publication date
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    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B20/00Signal processing not specific to the method of recording or reproducing; Circuits therefor
    • G11B20/10Digital recording or reproducing
    • G11B20/10009Improvement or modification of read or write signals

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  • Engineering & Computer Science (AREA)
  • Signal Processing (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)
  • Optical Recording Or Reproduction (AREA)

Description

【発明の詳細な説明】 本発明はデータ信号検出回路に関し、特にデイ
ジタル・オーデイオデイスクプレーヤ等のように
シリアルなデイジタル値として供給されるデータ
信号の“1”,“0”を確実に検出するためのデー
タ信号検出回路に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a data signal detection circuit, and particularly to a data signal detection circuit for reliably detecting "1" and "0" of a data signal supplied as a serial digital value such as in a digital audio disc player. The present invention relates to a data signal detection circuit.

デイジタルオーデイオデイスクは、オーデイオ
信号および同期信号をデイジタル化してデイスク
の表面に線速度一定として光学的に高密度で記録
したものであり、デイスク上に記録される信号フ
オーマツトは例えば第1図に示すように定められ
ている。つまり、この方式に於いては、1フレー
ムを一定数のビツト(例えば588ビツト)によつ
て構成し、このフレームを連続させて同一デイス
ク上に線速度一定として記録されている。そし
て、この各フレームの信号フオーマツトは、同期
部Aと情報部Bとに区分されており、同期部Aは
各フレームの冒頭部分に位置ずけられている。同
期部Aは第1図に示すように22ビツトによつて構
成されており、最初の11ビツトが連続して“0”
の場合には続く11ビツトが連続して“1”とな
り、最初の11ビツトが連続して“1”の場合には
続く11ビツトが連続して“0”となるように設定
されている。そしてこの場合、最初の11ビツトは
その前のフレームの末尾ビツトに対して逆になる
ように設定されており、このようにして予め定め
られた単位ビツト(11ビツト)で“0”または
“1”が連なるフオートマツトは1フレーム中に
於いてこの同期部Aのみに限定されている。すな
わち、情報部Bはいかなる場合であつても11ビツ
ト単位の“0”または“1”が連らなるフオーマ
ツトが生じないように構成されている。また、情
報部Bは無信号時に於ける直流化を防止するため
に、常に3ビツト以上にわたつて“1”信号また
は“0”信号が連続する信号となつている。つま
り、情報部Bは2<B<11ビツトの範囲にわたつ
てのみ連続する信号として表わされることにな
る。
A digital audio disk is a device in which audio signals and synchronization signals are digitized and optically recorded at high density on the surface of the disk at a constant linear velocity.The signal format recorded on the disk is, for example, as shown in Figure 1. It is stipulated in That is, in this method, one frame is made up of a fixed number of bits (for example, 588 bits), and these frames are consecutively recorded on the same disk at a constant linear velocity. The signal format of each frame is divided into a synchronization section A and an information section B, and the synchronization section A is positioned at the beginning of each frame. As shown in Fig. 1, the synchronization part A is composed of 22 bits, and the first 11 bits are "0" continuously.
In this case, the following 11 bits are set as "1" continuously, and when the first 11 bits are continuously "1", the following 11 bits are set as "0" continuously. In this case, the first 11 bits are set to be the opposite of the last bit of the previous frame, and in this way, a predetermined unit bit (11 bits) is set to be "0" or "1". The format with a series of "" is limited to only this synchronization part A in one frame. That is, the information section B is configured so that a format in which 11 bits of "0" or "1" are consecutive does not occur under any circumstances. In addition, the information part B is a signal in which "1" or "0" signals are always continuous over 3 bits or more in order to prevent conversion to direct current when there is no signal. In other words, the information part B is represented as a continuous signal only over the range of 2<B<11 bits.

このように構成されたデイジタル・オーデイオ
デイスクは、線速度一定としてデイスク上のデイ
ジタル情報を光学的に読み取つて復調することに
より、高忠実度のオーデイオ信号が容易に得られ
るものである。
With a digital audio disk constructed in this manner, a high-fidelity audio signal can be easily obtained by optically reading and demodulating digital information on the disk at a constant linear velocity.

そして、忠実度再生を行なう上で最も重要な事
は、デイスクの表面に記録されている情報を再生
したデータ信号の“1”、“0”を正確に判別する
ことである。
The most important thing in performing fidelity reproduction is to accurately distinguish between "1" and "0" of the data signal reproduced from the information recorded on the surface of the disk.

この場合、従来一般に用いられるデータ信号検
出回路に於いては、デイスクの記録情報を再生す
る光学ピツクアツプから供給されるデータ信号を
基準値VRと比較することにより、“1”、“0”の
判別信号を検出データとして送出するように構成
されている。
In this case, conventional data signal detection circuits detect "1" and "0" by comparing the data signal supplied from the optical pickup that reproduces the recorded information on the disc with the reference value VR . It is configured to send out the discrimination signal as detection data.

しかしながら、このように基準値が一定値に固
定されている場合には、デイスクの製作時に於け
るバラツキによつてデイスクの基準レベルが変動
するために、検出データに誤りが生ずる問題を有
している。つまり、デイジタル・オーデイオデイ
スクに於いては、狭帯域PCM方式が用いられて
おり、記録されているパルスの幅によつてピツク
アツプの出力レベルが大きく変化し、3〜10ビツ
トの記録に対する再生信号のオシロスコープ波形
は例えば第2図に波形a〜hに示すようになる。
そして、この波形に於ける情報ビツトは、基準レ
ベルVrを中心とする斜線で示すひし形の部分で
あり、このひし形部分の基準値Vrのクロス点が
ビツトの境界となる。そして、デイスクにはその
製作上の観点から基準レベルVrが上下に±20%
にわたつて変動することが規格上から許容されて
いる。このため、基準レベルVrを中心として全
体の1/5程度の範囲にしか存在しない情報が±20
%範囲にわたつて変動することになり、基準値
VRを固定して検出を行なおうとすると、デイス
クの製作時に於けるバラツキによつて信号の検出
が行なえなくなる場合が生ずる問題を有してい
る。
However, when the reference value is fixed to a constant value in this way, there is a problem that errors occur in the detected data because the reference level of the disk fluctuates due to variations in the manufacturing process of the disk. There is. In other words, digital audio disks use the narrowband PCM method, and the output level of the pickup changes greatly depending on the width of the recorded pulse. The oscilloscope waveforms are as shown in waveforms a to h in FIG. 2, for example.
The information bit in this waveform is a diamond-shaped portion shown by diagonal lines centered at the reference level Vr, and the cross point of the reference value Vr in this diamond-shaped portion is the boundary of the bit. From the manufacturing point of view, the disc has a reference level Vr of ±20% above and below.
The standard allows for variations over a period of time. Therefore, information that exists only in a range of about 1/5 of the total around the reference level Vr is ±20
% range, and the reference value
If an attempt is made to perform detection with V R fixed, there is a problem in that signal detection may not be possible due to variations in disk manufacturing.

従つて、本発明による目的は、ピツクアツプか
ら供給される再生信号から“1”、“0”のデータ
信号を正確に検出することが出来るデータ信号検
出回路を提供することである。
Therefore, an object of the present invention is to provide a data signal detection circuit that can accurately detect data signals of "1" and "0" from a reproduced signal supplied from a pickup.

このような目的を達成するために本発明による
データ信号検出回路は、デイスク再生信号の基準
レベルVrの変動に対応して再生信号を比較して
データ信号を取り出すコンパレータの基準値VR
を変化させるものである。以下、図面を用いて本
発明によるデータ信号検出回路を詳細に説明す
る。
In order to achieve such an object, the data signal detection circuit according to the present invention has a reference value V R of a comparator that compares the reproduced signal and extracts the data signal in response to fluctuations in the reference level Vr of the disc reproduced signal.
It changes the Hereinafter, a data signal detection circuit according to the present invention will be explained in detail using the drawings.

第3図は本発明によるデータ信号検出回路の一
実施例を示す回路図である。同図に於いて1は入
力端子2に供給されるデイスクの再生信号HFと
基準値VRとを比較してデータ信号DSを出力する
コンパレータ、3はコンパレータ1の出力を入力
とする正極検波回路であつて、カツプリングコン
デンサ4、正極検波用のダイオード5、抵抗6,
7およびコンデンサ8とによつて構成されてい
る。9はコンパレータ1の出力を入力とする負極
検波回路であつて、正極検波回路3と同様にカツ
プリングコンデンサ4′、検波用ダイオード5に
対して逆向きに接続された負極検波用のダイオー
ド5′抵抗6,7およびコンデンサ8′によつて構
成されている。10は正極検波回路3の出力と負
極検波回路9の出力を互いに加算して出力する加
算回路であつて、加算用の抵抗11,12とバイ
アス用の抵抗13とによつて構成されている。1
4は加算回路10から供給される加算出力に含ま
れる直流分のみを取り出すループフイルタであつ
て、コンデンサ15,16と抵抗17とによつて
構成されて時定数が十分に大きく設定されてい
る。18はループフイルタ14の出力を零レベル
と比較し、その差分を出力するサーボアンプとし
ての演算増幅器、19は電圧リミツター回路であ
つて、演算増幅器18の出力端とコンパレータ1
の基準電圧入力端との間に介在されて、コンパレ
ータ1に供給される基準電圧VRを一定範囲に制
限することによつて初期動作時に於ける基準電圧
VRの過大変動を防止して判定を確実化するため
に設けられている。そして、この電圧リミツター
回路19は抵抗20,21とコンデンサ22によ
る一般に周知の回路によつて構成されている。
FIG. 3 is a circuit diagram showing one embodiment of a data signal detection circuit according to the present invention. In the figure, 1 is a comparator that compares the disc playback signal HF supplied to input terminal 2 with a reference value V R and outputs a data signal DS, and 3 is a positive detection circuit that receives the output of comparator 1 as input. , a coupling capacitor 4, a diode 5 for positive detection, a resistor 6,
7 and a capacitor 8. Reference numeral 9 denotes a negative detection circuit which receives the output of the comparator 1 as an input, and, like the positive detection circuit 3, includes a coupling capacitor 4' and a negative detection diode 5' connected in the opposite direction to the detection diode 5. It is composed of resistors 6, 7 and a capacitor 8'. Reference numeral 10 denotes an adding circuit that adds the output of the positive polarity detection circuit 3 and the output of the negative polarity detection circuit 9 to each other and outputs the result, and is constituted by resistors 11 and 12 for addition and a resistor 13 for bias. 1
A loop filter 4 extracts only the DC component included in the addition output supplied from the addition circuit 10, and is composed of capacitors 15 and 16 and a resistor 17, and has a sufficiently large time constant. 18 is an operational amplifier as a servo amplifier that compares the output of the loop filter 14 with the zero level and outputs the difference; 19 is a voltage limiter circuit that connects the output terminal of the operational amplifier 18 and the comparator 1;
By limiting the reference voltage V R supplied to the comparator 1 to a certain range, the reference voltage at the initial operation can be adjusted between the reference voltage input terminal of the
This is provided to prevent excessive fluctuations in VR and ensure reliable judgment. This voltage limiter circuit 19 is constituted by a generally known circuit including resistors 20 and 21 and a capacitor 22.

このように構成されたデータ信号判別回路に於
いて、図示しない光学ピツクアツプより、デイジ
タル・オーデイオデイスクの再生信号HFが入力
端子2に供給されると、コンパレータ1は基準電
圧VRを基準として再生信号HFの判別を行なつて
“H”、“L”のデータ信号DSを発生する。そし
て、このコンパレータ1から発生されるデータ信
号DSは、正極検波回路3および負極検波回路9
に設けられているダイオード5,5′によつて検
波されることにより、正極分と負極分がそれぞれ
取り出されることになる。そして、この正極検波
回路3および負極検波回路9の出力は、抵抗1
1,12によつて構成される加算回路10に於い
て互いに加算されるとともに、抵抗13によつて
所定レベルにバイアスされて出力される。
In the data signal discriminating circuit configured as described above, when the reproduced signal HF of the digital audio disk is supplied to the input terminal 2 from the optical pickup (not shown), the comparator 1 detects the reproduced signal based on the reference voltage VR . HF is determined and a data signal DS of "H" and "L" is generated. The data signal DS generated from this comparator 1 is transmitted to a positive polarity detection circuit 3 and a negative polarity detection circuit 9.
By being detected by the diodes 5 and 5' provided in the diodes 5 and 5', the positive polarity and the negative polarity are respectively extracted. The outputs of the positive detection circuit 3 and the negative detection circuit 9 are connected to the resistor 1.
1 and 12, they are added to each other in an adder circuit 10, and are biased to a predetermined level by a resistor 13 and output.

この場合、デイジタルオーデイオデイスクに対
する記録信号のフオーマツトは、第1図で述たよ
うに17ビツトを1シンボルとしており、17ビツト
内の14ビツトを情報ビツトとしかつ残り3ビツト
を冗長分としている。そして、この冗長分は3ビ
ツト以上11ビツト以下の範囲内に於いてのみ同一
信号が連続する条件を満足し、さらに数シンボル
前からの“H”、“L”信号の比が最も小さくなつ
て直流分が少なくなるように定められている。従
つて、コンパレータ1に於ける基準値VRが再生
信号HFの第2図に示す基準値Vrに一致している
場合には、加算回路10の出力を平均化するルー
プフイルタ14の出力は抵抗13によるバイアス
レベルに一定化される。そして、コンパレータ1
の基準値VRが再生信号HFの基準値Vrに対して
正極方向にずれている場合には、データ信号DS
の“L”部分に対するパルス幅が広げられてルー
プフイルタ14の出力が、そのずれ量に対応した
レベルだけバイアスレベルから低下する。また、
コンパレータ1の基準値VRが再生信号HFの基準
値Vrに対して負極方向にずれている場合には、
コンパレータ1から出力されるデータ信号DSの
“H”部分に対するパルス幅が広げられてループ
フイルタ14の出力が、そのずれ量に対応したレ
ベルだけバイアスレベルから上昇することにな
る。
In this case, the format of the recording signal for the digital audio disk is such that one symbol consists of 17 bits as described in FIG. 1, 14 bits of the 17 bits are information bits, and the remaining 3 bits are redundant bits. This redundant portion satisfies the condition that the same signal continues only within the range of 3 bits or more and 11 bits or less, and furthermore, the ratio of "H" and "L" signals from several symbols before becomes the smallest. It is set so that the DC component is reduced. Therefore, when the reference value V R of the comparator 1 matches the reference value Vr of the reproduced signal HF shown in FIG. The bias level is fixed at a bias level of 13. And comparator 1
If the reference value V R of the playback signal HF deviates in the positive direction from the reference value Vr of the reproduced signal HF, the data signal DS
The pulse width for the "L" portion is widened, and the output of the loop filter 14 is lowered from the bias level by a level corresponding to the amount of deviation. Also,
If the reference value V R of comparator 1 deviates in the negative direction with respect to the reference value Vr of the reproduced signal HF,
The pulse width for the "H" portion of the data signal DS output from the comparator 1 is widened, and the output of the loop filter 14 rises from the bias level by a level corresponding to the amount of deviation.

このようにして検出された再生入力信号HFの
基準値Vrとコンパレータ1の基準値VRとの差に
対応するループフイルタ14の出力信号は、演算
増幅器18に於いて零レベルとの差分が検出され
て出力する。そして、この演算増幅器18の出力
信号は、電圧リミツター回路19を介してコンパ
レータ1に基準値VRとしてフイードバツクされ
る。従つて、コンパレータ1の基準値VRは入力
される再生信号の変動に対応して変化されること
になり、これに伴つて常に正確なデータ信号を取
り出すことが出来る。
The output signal of the loop filter 14 corresponding to the difference between the reference value Vr of the reproduced input signal HF detected in this way and the reference value V R of the comparator 1 is detected by the operational amplifier 18 as the difference from the zero level. output. The output signal of the operational amplifier 18 is fed back to the comparator 1 as a reference value V R via the voltage limiter circuit 19. Therefore, the reference value V R of the comparator 1 is changed in response to fluctuations in the input reproduced signal, and accordingly, accurate data signals can always be extracted.

なお、電圧リミツター回路19は、初期動作時
に演算増幅器18の出力が大きく変動することに
よつて生ずる誤動作を防止するために設けられた
ものであり、かかる問題を他の構成で解決するこ
とが出来るならば必ずしも必要とするものではな
い。
Note that the voltage limiter circuit 19 is provided to prevent malfunctions caused by large fluctuations in the output of the operational amplifier 18 during initial operation, and this problem can be solved with other configurations. If so, it's not necessarily necessary.

以上説明したように、本発明によるデータ信号
検出回路は、入力される再生信号の直流分が小さ
くなるように設定されていることに着目し、検出
されたデータ信号の正、負検波信号の加算出力を
時定数の大きなループフイルタと介して取り出す
ことによつて再生信号の基準値と再生信号からデ
ータ信号を取り出すコンパレータの基準値との差
を検出し、この差分に対応してコンパレータの基
準値を変化させるものである。よつて、入力され
る再生信号の基準レベル変動に対応したコンパレ
ータの基準レベルが可変されるために、常にデー
タ信号を確実に検出することが出来る優れた効果
を有する。
As explained above, the data signal detection circuit according to the present invention focuses on the fact that the DC component of the input reproduced signal is set to be small, and adds the positive and negative detection signals of the detected data signal. By extracting the output through a loop filter with a large time constant, the difference between the reference value of the reproduced signal and the reference value of the comparator which extracts the data signal from the reproduced signal is detected, and the reference value of the comparator is adjusted according to this difference. It changes the Therefore, since the reference level of the comparator is varied in response to variations in the reference level of the input reproduced signal, there is an excellent effect that the data signal can always be detected reliably.

【図面の簡単な説明】[Brief explanation of drawings]

第1図はデイジタル・オーデイオデイスクに記
録されるデイジタル情報の信号フオーマツトの一
例を示す図、第2図はデイジタル・オーデイオデ
イスクの再生信号波形図、第3図は本発明による
データ信号検出回路の一実施例を示す回路図であ
る。 1…コンパレータ、3…正極検波回路、9…負
極検波回路、10…加算回路、14…ループフイ
ルタ、18…演算増幅器、19…電圧リミツタ回
路。
FIG. 1 is a diagram showing an example of the signal format of digital information recorded on a digital audio disk, FIG. 2 is a waveform diagram of a reproduced signal of the digital audio disk, and FIG. 3 is an example of a data signal detection circuit according to the present invention. FIG. 2 is a circuit diagram showing an example. DESCRIPTION OF SYMBOLS 1... Comparator, 3... Positive polarity detection circuit, 9... Negative polarity detection circuit, 10... Addition circuit, 14... Loop filter, 18... Operational amplifier, 19... Voltage limiter circuit.

Claims (1)

【特許請求の範囲】[Claims] 1 直流分が少なくなるように定められた信号フ
オーマツトで時分割記録されている情報を再生す
るピツクアツプから供給された再生信号と基準値
とを比較して“H”、“L”のデータ信号を取り出
すコンパレータと、このコンパレータの出力信号
を入力とする正および負極検波回路と、この正お
よび負極検波回路の出力を互いに加算する加算回
路と、この加算回路の出力信号を平均化するルー
プフイルタと、このループフイルタの出力と前記
基準値との差分に対応して前記コンパレータの基
準値を負帰還制御することにより、前記再生信号
の基準レベルの変動に連動して前記コンパレータ
の基準値を変化する演算増幅器とを備えたことを
特徴とするデータ信号検出回路。
1 Compare the reproduction signal supplied from the pickup that reproduces information recorded in time division in a signal format determined to reduce the DC component with a reference value, and determine the "H" and "L" data signals. a comparator to extract, a positive and negative polarity detection circuit that inputs the output signal of this comparator, an addition circuit that adds the outputs of the positive and negative polarity detection circuits to each other, and a loop filter that averages the output signal of this addition circuit; An operation that changes the reference value of the comparator in conjunction with fluctuations in the reference level of the reproduced signal by performing negative feedback control on the reference value of the comparator in accordance with the difference between the output of the loop filter and the reference value. A data signal detection circuit comprising an amplifier.
JP3034182A 1982-02-26 1982-02-26 Data signal detecting circuit Granted JPS58147814A (en)

Priority Applications (1)

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JP2534988B2 (en) * 1986-04-30 1996-09-18 株式会社リコー Information signal reproduction method
JP2695834B2 (en) * 1988-04-27 1998-01-14 株式会社東芝 Information playback device

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