JPH01219943A - 情報処理装置 - Google Patents

情報処理装置

Info

Publication number
JPH01219943A
JPH01219943A JP4618888A JP4618888A JPH01219943A JP H01219943 A JPH01219943 A JP H01219943A JP 4618888 A JP4618888 A JP 4618888A JP 4618888 A JP4618888 A JP 4618888A JP H01219943 A JPH01219943 A JP H01219943A
Authority
JP
Japan
Prior art keywords
bus
data
signal
size
transfer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP4618888A
Other languages
English (en)
Inventor
Takahiro Watanabe
隆弘 渡辺
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP4618888A priority Critical patent/JPH01219943A/ja
Publication of JPH01219943A publication Critical patent/JPH01219943A/ja
Pending legal-status Critical Current

Links

Landscapes

  • Information Transfer Systems (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、異なるポートサイズを持つ複数のバススレー
ブとの間でデータの転送が可能なバスマスタを持つ情報
処理装置に関するものである。
従来の技術 従来の情報処理装置としては、例えば特表昭61−60
2565号公報に示されている。
第5図はこの従来の情報処理装置の構成図を示すもので
あυ、13oはバスマスタ、140idバススレーブ、
131はデータバス、132[アドレスバス、133は
、アドレスストローフ信号、134はデータストローブ
信号、136はリード/ライト信号、136,137は
、データ運送要求サイズ、141,142はアクセスさ
れたバススレーブよシ返され、データ転送要求に対する
肯定応答と、バススレーブの持つポートのサイズを伝え
るだめのアクノリッジ信号である。
以上のように構成された従来の情報処理装置においてハ
、バスマスタ130がバススレーブ140との間でデー
タ転送を行なう場合、まずアクセスするアドレスがアド
レスバス132により出力されるとともに、アドレスス
トローブ信号133、データストローブ134、データ
の転送方向を示すリード/ライト信号136およびデー
タのサイズを示すサイズ信号136 、137が出力さ
れ、データ転送サイクルが起動される。書込みサイクル
の場合は、データバス131上へデータカバスマスタ1
30によシ出力される。このときデータは、バススレー
ブがいずれのサイズのポートを持つ場合でも1バイト以
上のデータの転送が可能となるようにデータをアライメ
ントし出力する。
バススレーブ140は、データバス131上のポートサ
イズに基づいて決められたバイト位置に接続されており
、アドレスバス132とデータサイズ信号136,13
7により肯定された位置のデータバス131との間でデ
ータの転送を行ない、バススレーブ140のポートのサ
イズを転送要求に対する肯定応答信号として、アクノリ
ッジ信号141.142を出力する。
バスマスタ130では、アクノリッジ信号141゜14
2を受けつけると、実行中のバスサイクルを終了させる
とともに、書込み処理であれば、バススレーブが何バイ
トのデータを取得したか、読出し処理であれば、何バイ
トのデータが読出されたかを計算し、要求した全データ
の転送が終了したかを確認し、未終了の場合は、未転送
分のデータの転送を行なうために、新たなバスサイクル
を実行する。この時、転送されるデータは、そのサイズ
とバイト位置により、第6図のようにアライメントされ
出力される。
発明が解決しようとする課題 しかしながら上記のような構成では、アクノリッジ信号
141,142が返されるまで、次のサイクルで転送す
るデータを決定することができないという問題点を有し
ていた。
本発明はかかる点に鑑み、アクセスするバススレーブの
持つポートのサイズとは無関係に先行的に次バスサイク
ルで転送を行なうデータの決定がアクノリッジ信号が返
される以前に可能な情報処理装置を提供することを目的
とする。
課題を解決するための手段 本発明は、バススレーブよりバスマスタに対して対象と
なるポートサイズを変更し、再度データの転送要求を行
なう再送要求信号と、この再送要求信号を受けつけると
、バスの最大サイズがiバイトの時に、21− jバイ
トのポートサイズに変更、または、同一のサイズでの転
送を2j−1回繰り返すバスマスタを備えた情報処理装
置である。
作  用 本発明は前記した構成により、バスマスタは、対象とす
るポートのサイズを2i バイトから始めて、2°バイ
トまで連続で変更し、同一のポートサイズでの転送を2
  回縁シ返すことが事前に分っているため、再送要求
信号が直されるまでに、次サイクルで必要となるデータ
の準備を可能とする。
実施例 第1図は本発明の情報処理装置の構成図を示すものであ
る。第1図において、1oはバス制御部、3oはバスス
レーブ、4oは演算処理部、50はアドレス出力バッフ
ァ(以下AOBと記す)、66はアドレス出力用トライ
ステートバッファ、60はデータ出力バッファ(以下D
OBと記す)、66はデータの出力用トライステートバ
ッファ、70はデータ′出力用アライナ(以下ALNO
と記す)、80はデータ入力用アライナ(以下ALNI
と記す)、9oはライトバッフ1(以下WBと記す)、
100はデータ入力用バッファ(以下DIRと記す)。
11はアドレスストローブ信号(以下Asと記す)、1
2はバスサイズインク用のサイクルかどうかを示す信号
(以下BSと記す)、13は、データバス上の有効なデ
ータのバイト位置を示すバイトイネーブル信号(以下B
Eと記す)、31はバスサイクルの終了を示すレディ信
号(以下RDYと記す)、32は、バスサイズインク要
求信号(以下BJ(と記す)、66は、アドレスバス、
66はデータバスである。
以上のように構成されたこの実施例の情報処理装置につ
いて、以下その動作を説明する。
演算装置40は、バススレーブ3oとの間でデータ転送
を行なう場合、まずデータ転送要求信号41によりバス
制御部10に対して要求を行なうとともに、信号42を
用いてリード、ライトいずれの転送の要求かを示すとと
もに、内部アドレスバス44によりアクセスするアドレ
スを出力し、内部バイトイネーブル信号43により、ア
クセスするデータのデータバス上の有効バイト位置を示
す。また、要求アクセスが書込みの場合は、ライトデー
タバス45により書込みデータを出力する。
バス制御部1oは、データ転送要求信号41により行な
われた要求を受けつけると、DABs。
へアクセスアドレスを格納させると同時に、トライステ
ートバッファ55を通してアドレスバス56ヘアトレス
ヲ出カシ、バススレーブ3oヘアドレスを伝える。また
、アドレスを出力すると同時に、As信号11、BE信
号13を有効にし、バススレーブ30に対して、バスサ
イクルが開始された事を通知する。この時BS信号12
は、その時開始されるバスサイクルがバスサイスイング
を行なうだめのサイクルでない場合は有効とならない0
データに関しては、書込みと読出しの場合で異なり、以
下の手順で処理される0 (1)書込み時、ライトデータバス45よりデータをW
B9oへ格納し、ALNO70を通じて、データのアラ
イメントを行なった後、DOB60へ格納され、トライ
ステートバッフ765を通じて、データバス66へ出力
される。
(2)読込み時、データバス66上のデータは、ALN
I 8oを通り、有効なバイト位置ヘアライメントされ
、DIBlooへ格納され、データバス101を通して
、演算装置40へ伝えられる0 マタ、バススレーブ30は、バスサイクルを終了させる
ためにRDY信号31を出力するとともに、BE信号1
3により示されたデータの転送が完了していない場合は
、データサイズに比べ、ポートのサイズが十分でないと
きBR信号32により、バスサイズイング要求を行なう
0ただしこのBR信号32は、第2図の表の条件に従っ
て出力される(第2図では、バスの最大幅が4バイトの
場合を示している・)O BR倍信号入力されると、第3図のフローチャートに基
づいてデータの転送を行なう。従って、バススレーブか
らBR倍信号返されない場合、または全てのデータの転
送が完了するまで継続される。なお第3図においては最
初のデータ転送サイク/L/(バスサイスイングによる
サイクルではないサイク/L/ )から開始し、完全に
データの転送が終了するまでを示しである。
第3図において、バスのサイズは2i バイトによって
示される◇従って、バスのサイズが4バイトの場合は、
i=2となる。
また、各転送サイクルにおける転送データを、転送デー
タのサイズ毎に第4図に示す0なお、(1)はデータの
サイズが4バイト、(2)は3バイト、(3)は2バイ
ト4は1バイトの時を示しである。各データサイズに、
転送されるデータは上から下へと変化する。
第4図に、4バイトの幅のバスを用いたデータ転送シー
ケンスを、データ転送サイズ毎に示す。
以上のように、この実施例によれば、データの再転送要
求信号と、アクセス対象のポートのサイズを再転送要求
信号を入力することで固定的に決定することにより、異
なるサイズのポートを持つバススレーブとの間でデータ
転送が可能となる。
発明の詳細 な説明したように、本発明によれば、バススレーブから
再送要求信号のみを受けとることで、動的にバスサイス
イングが行なえ、また、再送要求信号が返されるまでに
、次サイクルのデータの準備をすることが可能となり高
速なバヌ転送をすることができ、その実用的効果は大き
い。
【図面の簡単な説明】
第1図は本発明の一実施例における情報処理装置の構成
図、第2図は同実施例において再転送要本信号を生成す
る条件を示す対応図、第3図は同実施例における転送制
御を示すフローチャート、第4図はデータのアライメン
トのフローを示すアライメント図、第6図は従来の情報
処理装置の構成図、第6図は従来の装置におけるアライ
メント方法を示すアライメント図である。 1o・・・・・・バス制?lJ 部、30・・山・バス
スレーブ、40・・・・・・演算装置、60・・・・・
・AOB、60・・・・・・DOB、70.−・−AI
、No、a o−・−A L N I、90・・・・・
・WB、100・・・・・・DIBlll・・・・・・
AS信号、12・・・・・・BS信号、13・・・・・
・BE倍信号31・・・・・・RDY信号、32・・・
・・・BR倍信号代理人の氏名 弁理士 中 尾 敏 
男 ほか1名第 2 図 ン示T 第 3 図 第4図 (1)4バイト    (2)3バイトロコ]] 巨口]囚

Claims (1)

    【特許請求の範囲】
  1. 2^iバイト(iは自然数)の大きさのデータバスと、
    これと異なるサイズのポートを持ち、各々のポートサイ
    ズに従って決められた前記データバス上の位置に接続さ
    れた複数のバススレーブと、前記バススレーブが一回の
    バスサイクルではポートのサイズが小さく全てのデータ
    の転送が終了しない際に対象とするポートのサイズを変
    更し、データの再転送要求を行なうための再送要求信号
    と、前記バススレーブに対してデータの転送要求を行な
    うとともに、前記データバスに接続されており、データ
    転送の第1サイクルで、バススレーブが2^iバイトの
    バスに接続されていると想定しデータの転送を行ない、
    前記再送要求信号が入力されると、2^i^−^jバイ
    ト(jは1≦j≦nの自然数)のポートサイズにサイズ
    を変更し、そのサイズにおいて再送要求がある場合は2
    ^j^−^1回転送を繰り返し、その後i−jの値が0
    となるまで、jの値に1を加えながらポートのサイズを
    変化させ再送するバスマスタとを備えたことを特徴とす
    る情報処理装置。
JP4618888A 1988-02-29 1988-02-29 情報処理装置 Pending JPH01219943A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP4618888A JPH01219943A (ja) 1988-02-29 1988-02-29 情報処理装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP4618888A JPH01219943A (ja) 1988-02-29 1988-02-29 情報処理装置

Publications (1)

Publication Number Publication Date
JPH01219943A true JPH01219943A (ja) 1989-09-01

Family

ID=12740072

Family Applications (1)

Application Number Title Priority Date Filing Date
JP4618888A Pending JPH01219943A (ja) 1988-02-29 1988-02-29 情報処理装置

Country Status (1)

Country Link
JP (1) JPH01219943A (ja)

Similar Documents

Publication Publication Date Title
US20080183928A1 (en) Addressable Serial Peripheral Interface
US5828865A (en) Dual mode bus bridge for interfacing a host bus and a personal computer interface bus
US20020194418A1 (en) System for multisized bus coupling in a packet-switched computer system
EP1237090A1 (en) Serial peripheral interface master device, a serial peripheral interface slave device and a serial peripheral interface
US6182267B1 (en) Ensuring accurate data checksum
JP2005353041A (ja) データ処理システム内のバス・トランザクション管理
US5634007A (en) Independent computer storage addressing in input/output transfers
US20110145469A1 (en) Apparatus for processing peripheral component interconnect express protocol
US6539444B1 (en) Information processing apparatus having a bus using the protocol of the acknowledge type in the source clock synchronous system
US7707347B2 (en) Data path master/slave data processing device apparatus
JP4669113B2 (ja) 集積回路における相互接続モジュール用の接続ポート
US6584536B1 (en) Bus transaction accelerator for multi-clock systems
US7346072B2 (en) Arbitration mechanism for packet transmission
JPH01219943A (ja) 情報処理装置
JPH08505726A (ja) インタフェース装置
JPH0337221B2 (ja)
US6374282B1 (en) Method and apparatus for tracking multi-threaded system area network (SAN) traffic
CN116685959A (zh) 支持pcie 6.0、cxl 3.0和upi 3.0协议的逻辑物理层接口规范
JPS597987B2 (ja) 演算制御素子間のデ−タ伝送制御方式
JP2505298B2 (ja) スプリットバスにおける可変バス幅指定方式及び可変バス幅情報受信方式
JP2583586B2 (ja) バス制御方法
JP2763009B2 (ja) データ通信用半導体集積回路装置
JPH0241535A (ja) データ処理装置
JPH07210471A (ja) 情報処理装置
JPS59105159A (ja) デ−タ転送制御方式