JPH01152954A - 制御回路 - Google Patents
制御回路Info
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- JPH01152954A JPH01152954A JP63276331A JP27633188A JPH01152954A JP H01152954 A JPH01152954 A JP H01152954A JP 63276331 A JP63276331 A JP 63276331A JP 27633188 A JP27633188 A JP 27633188A JP H01152954 A JPH01152954 A JP H01152954A
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- capacitor
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- 239000003990 capacitor Substances 0.000 claims abstract description 34
- 238000004519 manufacturing process Methods 0.000 abstract description 11
- 230000002411 adverse Effects 0.000 abstract description 3
- 230000000694 effects Effects 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 5
- 238000009966 trimming Methods 0.000 description 5
- 238000000034 method Methods 0.000 description 4
- 230000015556 catabolic process Effects 0.000 description 3
- 230000007423 decrease Effects 0.000 description 3
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/28—Modifications for introducing a time delay before switching
- H03K17/292—Modifications for introducing a time delay before switching in thyristor, unijunction transistor or programmable unijunction transistor switches
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02P—CONTROL OR REGULATION OF ELECTRIC MOTORS, ELECTRIC GENERATORS OR DYNAMO-ELECTRIC CONVERTERS; CONTROLLING TRANSFORMERS, REACTORS OR CHOKE COILS
- H02P25/00—Arrangements or methods for the control of AC motors characterised by the kind of AC motor or by structural details
- H02P25/02—Arrangements or methods for the control of AC motors characterised by the kind of AC motor or by structural details characterised by the kind of motor
- H02P25/10—Commutator motors, e.g. repulsion motors
- H02P25/14—Universal motors
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M1/00—Details of apparatus for conversion
- H02M1/08—Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters
- H02M1/083—Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters for the ignition at the zero crossing of the voltage or the current
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Power Conversion In General (AREA)
- Control Of Ac Motors In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、一端が第１電源端子に接続されている負荷を
流れる交流電流を制御する制御回路であって、この制御
回路は動作中前記の負荷の他方の端子と第２電源端子と
の間に接続されるものであり、またこの制御回路は、前
記の負荷の前記の他方の端子と前記の第２電源端子との
間に接続された抵抗区分およびキャパシタ区分の直列回
路と、前記の負荷の前記の他方の端子と前記の第２電源
端子との間に接続された制御整流器とを具えておリ、こ
の制御整流器に対する制御電流は前記の抵抗区分および
キャパシタ区分間の相互接続点からダイアックを経て取
出すようになっている当該制御回路に関するものである
。
流れる交流電流を制御する制御回路であって、この制御
回路は動作中前記の負荷の他方の端子と第２電源端子と
の間に接続されるものであり、またこの制御回路は、前
記の負荷の前記の他方の端子と前記の第２電源端子との
間に接続された抵抗区分およびキャパシタ区分の直列回
路と、前記の負荷の前記の他方の端子と前記の第２電源
端子との間に接続された制御整流器とを具えておリ、こ
の制御整流器に対する制御電流は前記の抵抗区分および
キャパシタ区分間の相互接続点からダイアックを経て取
出すようになっている当該制御回路に関するものである
。
この種類の制御回路は既知であり、例えばオランダ国特
許出願第７００３８４２号明細書に記載されている。こ
のような比較的簡単な回路を例えばモータ等の制御に用
いる場合には、電気的な仕様で比較的大きな製造誤差を
有する電子素子が一般に使用されている。その結果、制
御整流器の位相制御の最小位相角を所望値に調整するの
に少くとも１つの調整素子、例えばポテンショメータが
必要となる。この調整・素子は調整処理段階で正しい値
に調整する必要があり、このことは特に上述した制御回
路を多数個連続して製造する場合に重大な欠点となると
みなされている。
許出願第７００３８４２号明細書に記載されている。こ
のような比較的簡単な回路を例えばモータ等の制御に用
いる場合には、電気的な仕様で比較的大きな製造誤差を
有する電子素子が一般に使用されている。その結果、制
御整流器の位相制御の最小位相角を所望値に調整するの
に少くとも１つの調整素子、例えばポテンショメータが
必要となる。この調整・素子は調整処理段階で正しい値
に調整する必要があり、このことは特に上述した制御回
路を多数個連続して製造する場合に重大な欠点となると
みなされている。
本発明の目的は、調整素子を用いずに、使用する電気素
子の比較的大きな製造誤差が制御回路の動作に悪影響を
及ぼさないように制御回路を構成しうる方法を提供せん
とするにある。
子の比較的大きな製造誤差が制御回路の動作に悪影響を
及ぼさないように制御回路を構成しうる方法を提供せん
とするにある。
本発明は、一端が第１電源端子に接続されている負荷を
流れる交流電流を制御する制御回路であって、この制御
回路は動作中前記の負荷の他方の端子と第２電源端子と
の間に接続されるものであり、またこの制御回路は、前
記の負荷の前記の他方の端子と前記の第２電源端子との
間に接続された抵抗区分およびキャパシタ区分の直列回
路と、前記の負荷の前記の他方の端子と前記の第２電源
端子との間に接続された制御整流器とを具えており、こ
の制御整流器に対する制御電流は前記の抵抗区分および
キャパシタ区分間の相互接続点からダイアックを経て取
出すようになっている当該制御回路において、前記の制
御整流器の制御端子と前記の相互接続点との間に他の制
御整流器が接続され、前記のダイアックは前記の相互接
続点と前記の他の制御整流器の制御端子との間に接続さ
れていることを特徴とする。
流れる交流電流を制御する制御回路であって、この制御
回路は動作中前記の負荷の他方の端子と第２電源端子と
の間に接続されるものであり、またこの制御回路は、前
記の負荷の前記の他方の端子と前記の第２電源端子との
間に接続された抵抗区分およびキャパシタ区分の直列回
路と、前記の負荷の前記の他方の端子と前記の第２電源
端子との間に接続された制御整流器とを具えており、こ
の制御整流器に対する制御電流は前記の抵抗区分および
キャパシタ区分間の相互接続点からダイアックを経て取
出すようになっている当該制御回路において、前記の制
御整流器の制御端子と前記の相互接続点との間に他の制
御整流器が接続され、前記のダイアックは前記の相互接
続点と前記の他の制御整流器の制御端子との間に接続さ
れていることを特徴とする。
以下図面につき説明する。
第１図は、この場合モータとして構成した負荷を制御す
る既知の回路配置を示す。モータ３に対する交流電源、
例えば主（商用）電源電圧が電源端子１および２に与え
られる。モータの一方の端子は電源端子ｌに接続され、
モータの他方の端子は制御整流回路、この場合トライア
ック（ＴＲＴＡＣ：商品名）７に且つトリミングポテン
シジメータ４および制御ポテンショメータ５を有する抵
抗区分に接続されている。これら２つのポテンショメー
タは互いに並列に配置されている。この並列回路と直列
にキャパシタ６が接続され、このキャパシタの、前記の
並列回路側とは反対側の端子は電源端子２に接続されて
いる。ポテンショメータ（抵抗）４および５の並列回路
とキャパシタ６との相互接続点には、電流制限抵抗９を
経てトライアック７の制御入力端に制御電流を供給する
ダイアック（ＤＩＡＣ：商品名）８が接続されている。
る既知の回路配置を示す。モータ３に対する交流電源、
例えば主（商用）電源電圧が電源端子１および２に与え
られる。モータの一方の端子は電源端子ｌに接続され、
モータの他方の端子は制御整流回路、この場合トライア
ック（ＴＲＴＡＣ：商品名）７に且つトリミングポテン
シジメータ４および制御ポテンショメータ５を有する抵
抗区分に接続されている。これら２つのポテンショメー
タは互いに並列に配置されている。この並列回路と直列
にキャパシタ６が接続され、このキャパシタの、前記の
並列回路側とは反対側の端子は電源端子２に接続されて
いる。ポテンショメータ（抵抗）４および５の並列回路
とキャパシタ６との相互接続点には、電流制限抵抗９を
経てトライアック７の制御入力端に制御電流を供給する
ダイアック（ＤＩＡＣ：商品名）８が接続されている。
第１図の回路の動作を、この回路における電流および電
圧の種々の電流および電圧波形を示している第２図を用
いて以下に簡単に説明する。特に第２図ａは端子１およ
び２における電源電圧Ｕ、、ａｔの波形を示し、第２図
すはキャパシタ６の両端間の電圧Ｕｃを示し、第２図Ｃ
はモータを流れる電流１．の波形（破線）およびモータ
の両端間の電圧Ｕ、 （実線）を示している。
圧の種々の電流および電圧波形を示している第２図を用
いて以下に簡単に説明する。特に第２図ａは端子１およ
び２における電源電圧Ｕ、、ａｔの波形を示し、第２図
すはキャパシタ６の両端間の電圧Ｕｃを示し、第２図Ｃ
はモータを流れる電流１．の波形（破線）およびモータ
の両端間の電圧Ｕ、 （実線）を示している。
第２図から明らかなように、主電源の正の期間中で且つ
トライアック７がまだ導通していない限り、キャパシタ
６がダイアック８の降服電圧に達するまで抵抗４および
５の並列回路を経て充電される。従って、キャパシタ電
圧Ｕｃが徐々に増大する。モータ３を流れる電流は無視
することができ、また抵抗４および５に比べてほんのわ
ずかのインピーダンスを呈するモータの両端間の電圧は
ほぼ零に等しい。
トライアック７がまだ導通していない限り、キャパシタ
６がダイアック８の降服電圧に達するまで抵抗４および
５の並列回路を経て充電される。従って、キャパシタ電
圧Ｕｃが徐々に増大する。モータ３を流れる電流は無視
することができ、また抵抗４および５に比べてほんのわ
ずかのインピーダンスを呈するモータの両端間の電圧は
ほぼ零に等しい。
ダイアック８が降服する瞬時にはこのダイアックの両端
間に電圧降下ｖ９が生じる。この電圧降下は通常の型の
ダイアックに対しては一般に５ｖおよび１５Ｖ間で変化
する値を有する。この電圧降下ｖＩ、の為に、キャパシ
タ６と２つの抵抗４および５との間の相互接続点におけ
る電圧はｖｐだけ減少し、このり、を第２図すにおける
キャパシタ６の両端間の電圧Ｕｃの波形に示しである。
間に電圧降下ｖ９が生じる。この電圧降下は通常の型の
ダイアックに対しては一般に５ｖおよび１５Ｖ間で変化
する値を有する。この電圧降下ｖＩ、の為に、キャパシ
タ６と２つの抵抗４および５との間の相互接続点におけ
る電圧はｖｐだけ減少し、このり、を第２図すにおける
キャパシタ６の両端間の電圧Ｕｃの波形に示しである。
すなわち、瞬時ｔｌにこのキャパシタ電圧がｖｐだけ段
階状に減少する。
階状に減少する。
瞬時１．にはダイアック８が降服する為、電流がトライ
アック７の制御入力端に流れ始め、これによりトライア
ック７が導通する。これにより導通したトライアック７
の抵抗値はほぼ無視することができ、その結果電気的に
見て、キャパシタ６が抵抗４および５の並列回路の両端
間に配置され、これらの抵抗を経て放電される。
アック７の制御入力端に流れ始め、これによりトライア
ック７が導通する。これにより導通したトライアック７
の抵抗値はほぼ無視することができ、その結果電気的に
見て、キャパシタ６が抵抗４および５の並列回路の両端
間に配置され、これらの抵抗を経て放電される。
従って、キャパシタ６の両端間の電圧はｅのべきに応じ
て減少し、 υｃ２υ、 （１、−ｔ／ＲＣ） となる。ここにＵｔｌは瞬時ｔ、におけるキャパシタの
両端間の電圧であり、Ｃはキャパシタ６のキャパシタン
スであり、Ｒは並列抵抗４および５の抵抗値である。
て減少し、 υｃ２υ、 （１、−ｔ／ＲＣ） となる。ここにＵｔｌは瞬時ｔ、におけるキャパシタの
両端間の電圧であり、Ｃはキャパシタ６のキャパシタン
スであり、Ｒは並列抵抗４および５の抵抗値である。
第２図Ｃから明らかなように、瞬時１．にはトライアッ
ク７が導通する為にモータ３の両端間に瞬時的な主電源
電圧が完全に存在する。従って、第２図Ｃにも示すよう
に電流Ｉイがモータ３を流れる。モータ電流Ｉ、、が零
となり従ってトライアック７が非導通となる瞬時ｔ３で
は一般にキャパシタ６の両端間の電圧はまだ零に等しく
ならない。
ク７が導通する為にモータ３の両端間に瞬時的な主電源
電圧が完全に存在する。従って、第２図Ｃにも示すよう
に電流Ｉイがモータ３を流れる。モータ電流Ｉ、、が零
となり従ってトライアック７が非導通となる瞬時ｔ３で
は一般にキャパシタ６の両端間の電圧はまだ零に等しく
ならない。
上述したところから明らかなように、瞬時ｔ３における
この残留電圧はＶ９の値と、キャパシタ６のキャパシタ
ンスと、抵抗４および５の抵抗値とに依存する。しかし
、この残留電圧はキャパシタの次の充電期間に対する開
始条件を構成するものであり、従ってトライアック７を
再び導通させる瞬時をも決定する。ダイアック８の両端
間の電圧Ｖｐは構成素子に依存する広い範囲内で変化す
るおそれがあり、また通常の構成素子の場合の制御ポテ
ンショメータ５の製造誤差も比較的大きい（±１２％）
である為、このような回路配置を連続して製造する場合
にトライアック７が導通する瞬時に可成りの広がりが生
ずる。従って、連続して製造する異なる上述した回路に
おける上述した広がりを少くとも著しく減少させるよう
にトリミングポテンショメータ４により調整を行なう必
要がある。しかし、このよ−うな調整処理を行なうこと
は欠点とみなされる。製造誤差が小さな極めて正確な構
成素子を用いることもできるが、このようにすると一般
に装置の価格が可成り増大し、従ってこのようにするこ
とは実際的に上述した問題に対する解決策を与えるもの
ではない。
この残留電圧はＶ９の値と、キャパシタ６のキャパシタ
ンスと、抵抗４および５の抵抗値とに依存する。しかし
、この残留電圧はキャパシタの次の充電期間に対する開
始条件を構成するものであり、従ってトライアック７を
再び導通させる瞬時をも決定する。ダイアック８の両端
間の電圧Ｖｐは構成素子に依存する広い範囲内で変化す
るおそれがあり、また通常の構成素子の場合の制御ポテ
ンショメータ５の製造誤差も比較的大きい（±１２％）
である為、このような回路配置を連続して製造する場合
にトライアック７が導通する瞬時に可成りの広がりが生
ずる。従って、連続して製造する異なる上述した回路に
おける上述した広がりを少くとも著しく減少させるよう
にトリミングポテンショメータ４により調整を行なう必
要がある。しかし、このよ−うな調整処理を行なうこと
は欠点とみなされる。製造誤差が小さな極めて正確な構
成素子を用いることもできるが、このようにすると一般
に装置の価格が可成り増大し、従ってこのようにするこ
とは実際的に上述した問題に対する解決策を与えるもの
ではない。
第３図はいかなる調整をも必要としない本発明による回
路配置を示す。この第３図では第１図の回路配置にも存
在する素子に第１図と同じ符号を付した。この第３図の
回路配置では、トライアック７に対する点弧電流はダイ
アック８および抵抗９を経て供給されるものではなく、
他のトライアック１０を経て供給されるものであり、こ
のトライアック１０の制御端子にはダイアック８により
給電される。この場合、このトライアック１０が電流制
限抵抗９を介してトライアック７の制御端子を制御する
。後に説明するように、この回路配置では第１図のトリ
ミングポテンショメータ４が固定抵抗１４と置きかえら
れている。
路配置を示す。この第３図では第１図の回路配置にも存
在する素子に第１図と同じ符号を付した。この第３図の
回路配置では、トライアック７に対する点弧電流はダイ
アック８および抵抗９を経て供給されるものではなく、
他のトライアック１０を経て供給されるものであり、こ
のトライアック１０の制御端子にはダイアック８により
給電される。この場合、このトライアック１０が電流制
限抵抗９を介してトライアック７の制御端子を制御する
。後に説明するように、この回路配置では第１図のトリ
ミングポテンショメータ４が固定抵抗１４と置きかえら
れている。
次に第３図の回路配置の動作を第４図の波形図を用いて
説明する。第４図ａは電源電圧Ｕ１□の波形を示す。第
４図すはキャパシタ６の両端間の電圧Ｕｃの波形を示す
。第４図Ｃはモータ３を流れる電流Ｉイとモータ３の両
端間の電圧ｕ６とを示す。
説明する。第４図ａは電源電圧Ｕ１□の波形を示す。第
４図すはキャパシタ６の両端間の電圧Ｕｃの波形を示す
。第４図Ｃはモータ３を流れる電流Ｉイとモータ３の両
端間の電圧ｕ６とを示す。
キャパシタ６は瞬時ｔ４でダイアック８の降服電圧に達
するまで並列抵抗５および１４を経て充電される。この
瞬時ｔ４でダイアック８が導通ずるため、トライアック
１０が導通せしめられ、このトライアック１０がトライ
アック７を導通せしめる制御電流を抵抗９を介して供給
する。
するまで並列抵抗５および１４を経て充電される。この
瞬時ｔ４でダイアック８が導通ずるため、トライアック
１０が導通せしめられ、このトライアック１０がトライ
アック７を導通せしめる制御電流を抵抗９を介して供給
する。
トライアックｌＯは導通している為、この導通中のトラ
イアック１０と、極めて低い値のオーム抵抗９と、トラ
イアック７の制御端子とを通る極めて低いオーム抵抗値
の放電通路がキャパシタ６に対して与えられる。従って
、第４図すからも明らかなようにキャパシタ６が極めて
急速に放電する。
イアック１０と、極めて低い値のオーム抵抗９と、トラ
イアック７の制御端子とを通る極めて低いオーム抵抗値
の放電通路がキャパシタ６に対して与えられる。従って
、第４図すからも明らかなようにキャパシタ６が極めて
急速に放電する。
瞬時ｔ４で瞬時的な電源電圧がモータ３の両端間に印加
され、電流１．が第４図Ｃに示すようにモータを流れ始
める。モータ電流が零となる瞬時ｔ５ではキャパシタ６
が完全に放電されている。
され、電流１．が第４図Ｃに示すようにモータを流れ始
める。モータ電流が零となる瞬時ｔ５ではキャパシタ６
が完全に放電されている。
従ってキャパシタの充電は常にＯボルトの同じ初期開始
電圧から開始し、ダイアック８の両端間の電圧ＶｐＯ値
や抵抗区分における抵抗の値に依存しなくなる。
電圧から開始し、ダイアック８の両端間の電圧ＶｐＯ値
や抵抗区分における抵抗の値に依存しなくなる。
妨害パルスによってトライアック１０があまりにも早期
に導通するのを防止するためには、トライアック１０の
制御入力端子と電源端子２との間に抵抗１１を配置する
のが好ましい。この抵抗は第３図では破線で示しである
。
に導通するのを防止するためには、トライアック１０の
制御入力端子と電源端子２との間に抵抗１１を配置する
のが好ましい。この抵抗は第３図では破線で示しである
。
キャパシタ６のキャパシタンスおよび抵抗５゜１４の抵
抗値における製造誤差はキャパシタ６を充電する際に依
然として影響を及ぼし、これによりダイアック８の降服
電圧に達する瞬時に影響を及ぼすこと明らかである。し
かしこの影響は第１図による既知の回路配置におけるよ
りも可成り小さくなり、個別の処理で微調整する必要の
あるトリミングポテンショメータは最早や用いないでよ
い。
抗値における製造誤差はキャパシタ６を充電する際に依
然として影響を及ぼし、これによりダイアック８の降服
電圧に達する瞬時に影響を及ぼすこと明らかである。し
かしこの影響は第１図による既知の回路配置におけるよ
りも可成り小さくなり、個別の処理で微調整する必要の
あるトリミングポテンショメータは最早や用いないでよ
い。
第３図の回路配置を実際に公称出力が１１０−の２２０
Ｖ、 ５０Ｈｚ交流モータで試験してみた。±２％の製
造誤差を有するキャパシタ６と±１２％の製造誤差を有
する制御ポテンショメータと、±２％の製造誤差を有す
る抵抗４，１１とを用いた場合、最小位相角の誤差は０
．２ ミリ秒に等しく、このことはモータの公称出力に
関して±５０匈の出力制御誤差を意味するということを
確かめた。多くの分野、例えば家庭用機器ではこのよう
な誤差は何の問題もなく許容しうるちのでる。
Ｖ、 ５０Ｈｚ交流モータで試験してみた。±２％の製
造誤差を有するキャパシタ６と±１２％の製造誤差を有
する制御ポテンショメータと、±２％の製造誤差を有す
る抵抗４，１１とを用いた場合、最小位相角の誤差は０
．２ ミリ秒に等しく、このことはモータの公称出力に
関して±５０匈の出力制御誤差を意味するということを
確かめた。多くの分野、例えば家庭用機器ではこのよう
な誤差は何の問題もなく許容しうるちのでる。
第３図の回路配置では制御整流器７および１０に対しト
ライアックを用いたが、制御整流器７および１０として
サイリスクを用いた回路配置においても本発明の原理を
用いることができる。
ライアックを用いたが、制御整流器７および１０として
サイリスクを用いた回路配置においても本発明の原理を
用いることができる。
抵抗９は本発明の回路配置において本質的な役割を奏せ
ず、多（の場合何の問題もなく省略することができるこ
とに注意すべきである。
ず、多（の場合何の問題もなく省略することができるこ
とに注意すべきである。
第１図は、既知の回路配置の欠点を説明するための既知
の制御回路を示す線図、 第２図は、第１図の回路に生じる電圧および電流を示す
波形図、 第３図は、本発明の原理による制御回路を示す線図、 第４図は、第３図の回路に生じる電圧および電流を示す
波形図である。 １．２・・・電源端子 ３・・・モータ ４・・・トリミングポテンショメータ ５・・・制御ポテンショメータ ６・・・キャパシタ ７．１０・・・トライアック（制御整流器）８・・・ダ
イアック ９・・・電流制限抵抗 １１・・・抵抗 １４・・・固定抵抗 ｃｏ 、ＯＵ 鴫−ｍ−喝−一−４−
の制御回路を示す線図、 第２図は、第１図の回路に生じる電圧および電流を示す
波形図、 第３図は、本発明の原理による制御回路を示す線図、 第４図は、第３図の回路に生じる電圧および電流を示す
波形図である。 １．２・・・電源端子 ３・・・モータ ４・・・トリミングポテンショメータ ５・・・制御ポテンショメータ ６・・・キャパシタ ７．１０・・・トライアック（制御整流器）８・・・ダ
イアック ９・・・電流制限抵抗 １１・・・抵抗 １４・・・固定抵抗 ｃｏ 、ＯＵ 鴫−ｍ−喝−一−４−
Claims (1)
- 【特許請求の範囲】 １、一端が第１電源端子に接続されている負荷を流れる
交流電流を制御する制御回路であって、この制御回路は
動作中前記の負荷の他方の端子と第２電源端子との間に
接続されるものであり、またこの制御回路は、前記の負
荷の前記の他方の端子と前記の第２電源端子との間に接
続された抵抗区分およびキャパシタ区分の直列回路と、
前記の負荷の前記の他方の端子と前記の第２電源端子と
の間に接続された制御整流器とを具えており、この制御
整流器に対する制御電流は前記の抵抗区分およびキャパ
シタ区分間の相互接続点からダイアックを経て取出すよ
うになっている当該制御回路において、前記の制御整流
器の制御端子と前記の相互接続点との間に他の制御整流
器が接続され、前記のダイアックは前記の相互接続点と
前記の他の制御整流器の制御端子との間に接続されてい
ることを特徴とする制御回路。 ２、請求項１に記載の制御回路において、前記の他方の
制御整流器の制御端子は抵抗を経て前記の第２電源端子
に接続されていることを特徴とする制御回路。 ３、請求項１または２に記載の制御回路において、前記
の双方の制御整流器がトライアックを以って構成されて
いることを特徴とする制御回路。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| NL8702645 | 1987-11-05 | ||
| NL8702645 | 1987-11-05 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01152954A true JPH01152954A (ja) | 1989-06-15 |
Family
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