JPH01107547A - 化合物半導体基板 - Google Patents
化合物半導体基板Info
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- JPH01107547A JPH01107547A JP26490887A JP26490887A JPH01107547A JP H01107547 A JPH01107547 A JP H01107547A JP 26490887 A JP26490887 A JP 26490887A JP 26490887 A JP26490887 A JP 26490887A JP H01107547 A JPH01107547 A JP H01107547A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は、化合物半導体基板、特にその絶縁薄膜に関す
るものである。
るものである。
[従来の技術]
例えばガリウム・ヒ素(GaAs)等の化合物半導体は
高速性及び低消費電力特性等、その優れた特性より電界
効果トランジスタ(F[ET)や高速ダイオードその他
各種IC′:rf、広く用いられている。
高速性及び低消費電力特性等、その優れた特性より電界
効果トランジスタ(F[ET)や高速ダイオードその他
各種IC′:rf、広く用いられている。
GaASの基板を作製する場合は、半絶縁性GaASの
基板に直接不純物イオンを注入し、その後熱処理(アニ
ール)してイオン注入層を活性化することが行われてい
る。
基板に直接不純物イオンを注入し、その後熱処理(アニ
ール)してイオン注入層を活性化することが行われてい
る。
このアニール処理によりイオン注入層は活性化されるが
、これは又同時に基板表面を変質させる場合を生ずるの
で、これを防ぐためアニール処理を行う前にGaASの
基板上に酸化シリコン(Sin2)や窒化シリコン(S
i3N4)等の絶縁膜を形成する、いわゆるキャップア
ニール方式や、又は蒸気圧を制御してその雰囲気中でア
ニールする方式等、各種の表面安定化技術が用いられて
いる。
、これは又同時に基板表面を変質させる場合を生ずるの
で、これを防ぐためアニール処理を行う前にGaASの
基板上に酸化シリコン(Sin2)や窒化シリコン(S
i3N4)等の絶縁膜を形成する、いわゆるキャップア
ニール方式や、又は蒸気圧を制御してその雰囲気中でア
ニールする方式等、各種の表面安定化技術が用いられて
いる。
[発明が解決しようとする問題点]
上述したように、表面安定化技術の一方式として基板表
面に例えばS i 02!Iや或いはSi3N4膜等の
保護膜を形成させる方式が用いられている。
面に例えばS i 02!Iや或いはSi3N4膜等の
保護膜を形成させる方式が用いられている。
これらの保護膜は熱酸化方式或いはプラズマ酸化方式等
を用いて形成することができるが、この場合、形成され
た5in2膜についてテストした結果、水蒸気に対する
気密性が十分でなく、素子に組立てた場合特性が劣化し
たりバラツキを生ずる現象がみられた。813N4Pa
の場合は水蒸気に対する気密性は十分であるが、膜形成
時の残留ストレスの影響があることと熱膨張率がGaA
S基板と大きく異なること等の特性により、熱処理中に
クランクが生じ易く性能が不安定になる傾向がみられた
。
を用いて形成することができるが、この場合、形成され
た5in2膜についてテストした結果、水蒸気に対する
気密性が十分でなく、素子に組立てた場合特性が劣化し
たりバラツキを生ずる現象がみられた。813N4Pa
の場合は水蒸気に対する気密性は十分であるが、膜形成
時の残留ストレスの影響があることと熱膨張率がGaA
S基板と大きく異なること等の特性により、熱処理中に
クランクが生じ易く性能が不安定になる傾向がみられた
。
又、例えばASの蒸気圧の中でアニールするいわゆるキ
ャップレスアニールの場合は、活性化特性にバラツキを
生じて保W!膜を形成した場合に特性が大きく変化する
嫌いがあった。
ャップレスアニールの場合は、活性化特性にバラツキを
生じて保W!膜を形成した場合に特性が大きく変化する
嫌いがあった。
本発明の目的は、耐湿性に優れ、安定な特性を有する化
合物半導体基板を提供することにある。
合物半導体基板を提供することにある。
[問題点を解決するための手段]
本発明は、半導体基板の表面に絶縁性の薄膜を形成して
表面の保護及び安定化を行う化合物半導体基板において
、前記基板表面と接する境界面にシリコンと酸素との混
合になる第1の絶縁薄膜を有し、その上層にシリコンと
酸素と窒素との混合になる第2の絶縁WIII!Jを具
え、さらにその上層に前記第2の絶縁膜と同成分で窒素
の濃度を異にする第3の絶縁薄膜が配してあることを特
徴とし、高安定性能の表面を有する基板が得られるよう
にして目的の達成を計ったものである。
表面の保護及び安定化を行う化合物半導体基板において
、前記基板表面と接する境界面にシリコンと酸素との混
合になる第1の絶縁薄膜を有し、その上層にシリコンと
酸素と窒素との混合になる第2の絶縁WIII!Jを具
え、さらにその上層に前記第2の絶縁膜と同成分で窒素
の濃度を異にする第3の絶縁薄膜が配してあることを特
徴とし、高安定性能の表面を有する基板が得られるよう
にして目的の達成を計ったものである。
[作 用]
本発明の化合物半導体基板では、絶縁1111111を
形成する場合、例えばプラズマCVD1J膜形成装置を
用いてこれにモノシラン(S ! H4)ガスと亜酸化
窒素(N20)ガスとを流しその雰囲気中で基板を処理
する場合に両ガスの流量パターンを変化させることによ
って高性能が得られるようにしたもので、基板表面には
酸化シリコン(St02)の絶縁膜と、窒素の混入した
(SiON)絶縁膜と、窒素濃度を上背させた5iON
の絶縁膜とによる三層の絶縁薄膜が形成されているので
、耐湿性に優れ高安定な基板を得ることができる。
形成する場合、例えばプラズマCVD1J膜形成装置を
用いてこれにモノシラン(S ! H4)ガスと亜酸化
窒素(N20)ガスとを流しその雰囲気中で基板を処理
する場合に両ガスの流量パターンを変化させることによ
って高性能が得られるようにしたもので、基板表面には
酸化シリコン(St02)の絶縁膜と、窒素の混入した
(SiON)絶縁膜と、窒素濃度を上背させた5iON
の絶縁膜とによる三層の絶縁薄膜が形成されているので
、耐湿性に優れ高安定な基板を得ることができる。
[実 施 例1
以下、本発明の一実施例についてGaASI板を対象と
して説明する。
して説明する。
このGaAS基板はLEC法(液体封止法)を用いて作
製されたアンドープ状の半絶縁性基板(ウェハ)で、φ
2″のウェハに鏡面研磨しさらに1μm化学的エツチン
グを行い、十分に水洗、乾燥した後イオン注入装置によ
り加速電圧40kevにおいて3×1011012Cの
28Si+を注入したものである。
製されたアンドープ状の半絶縁性基板(ウェハ)で、φ
2″のウェハに鏡面研磨しさらに1μm化学的エツチン
グを行い、十分に水洗、乾燥した後イオン注入装置によ
り加速電圧40kevにおいて3×1011012Cの
28Si+を注入したものである。
薄膜作成装置には平行の平板電極を有し基板温度を調節
できるプラズマCVD肋膜形成装置を用いた。
できるプラズマCVD肋膜形成装置を用いた。
ウェハに絶縁薄膜を形成する場合は、上記のウェハをセ
ットし、ガス入口より窒素中に4%希釈されたSiHガ
スとN40ガスとを流量化を変化しながら注入した。装
置の電極間距離を40m、ウェハ温度350℃、放電圧
力0.5Torr、放電パワー100Wとし、SiH4
ガスとN20ガスとを一定の流量で流し総流量を400
cc/分とした。
ットし、ガス入口より窒素中に4%希釈されたSiHガ
スとN40ガスとを流量化を変化しながら注入した。装
置の電極間距離を40m、ウェハ温度350℃、放電圧
力0.5Torr、放電パワー100Wとし、SiH4
ガスとN20ガスとを一定の流量で流し総流量を400
cc/分とした。
第1図はこのような条件におけるN20流蛍と絶縁膜の
屈折率R及び膜成長率Fの関係を示すもので市販のエリ
プソメータを用いて測定した。
屈折率R及び膜成長率Fの関係を示すもので市販のエリ
プソメータを用いて測定した。
図において屈折率Rが1.6以下の絶縁膜では水密性不
十分で素子特性に劣化を生じ、屈折率Rが2以上では次
工程のアニール処理時にクラックを発生することが認め
られた。
十分で素子特性に劣化を生じ、屈折率Rが2以上では次
工程のアニール処理時にクラックを発生することが認め
られた。
即ち、SiH4ガスとN20ガスの流量を一定とした場
合は絶縁膜の特性に欠陥を生ずることが認められたので
、次に両ガスの流量パターンを変えて測定した。
合は絶縁膜の特性に欠陥を生ずることが認められたので
、次に両ガスの流量パターンを変えて測定した。
CVD3t!21形成装置の各条件は上記と同一とし、
N20ガスを100CC/分の割合で10秒聞流し、そ
の後10CC/分で50秒間流すようにして流層を減少
させるとともに4%希釈S++4ガスを増加し、両ガス
の総流Mは400 cc/分として3分間放置した結果
、膜厚が1500人で特性が極めて安定な絶縁薄膜を得
ることができた。
N20ガスを100CC/分の割合で10秒聞流し、そ
の後10CC/分で50秒間流すようにして流層を減少
させるとともに4%希釈S++4ガスを増加し、両ガス
の総流Mは400 cc/分として3分間放置した結果
、膜厚が1500人で特性が極めて安定な絶縁薄膜を得
ることができた。
この場合の絶縁薄膜は厚さ約100人の3102膜と、
厚さ約400人の窒素の混入した5iON膜と、厚さ約
1000人の高窒素濃度の3iONとよりなる複合絶縁
薄膜を形成するものである。
厚さ約400人の窒素の混入した5iON膜と、厚さ約
1000人の高窒素濃度の3iONとよりなる複合絶縁
薄膜を形成するものである。
この複合絶縁iJ膜を水素ガスの雰囲気中で800℃、
20分間の熱処理を行い、注入不純物の活性化を行った
結果、シート抵抗1.8〜2にΩ/Dが得られた。これ
はCVD薄膜形成装置において窒素を混入せずにSiO
2膜を形成した場合の活性化率と略同じである。
20分間の熱処理を行い、注入不純物の活性化を行った
結果、シート抵抗1.8〜2にΩ/Dが得られた。これ
はCVD薄膜形成装置において窒素を混入せずにSiO
2膜を形成した場合の活性化率と略同じである。
尚、絶縁薄膜の組成比を変える場合は、原料ガスの組成
比を変化させる方式と、プラズマCVD薄膜形成装置の
電気的条件等を変化する方式とが用いられる。
比を変化させる方式と、プラズマCVD薄膜形成装置の
電気的条件等を変化する方式とが用いられる。
以上、本実施例を用いることにより次のような効果が得
られる。
られる。
(1)高温でアニールしても絶縁膜にクラックや剥離を
生ぜず、水密性が良好で浸水テストにおいても特性の劣
化が生じない。
生ぜず、水密性が良好で浸水テストにおいても特性の劣
化が生じない。
(2)不純物の活性化特性が安定するので素子特性も安
定となる。
定となる。
[発明の効果1
本発明によれば、耐湿性に優れ、高安定な特性を有する
化合物半導体基板を提供することができる。
化合物半導体基板を提供することができる。
第1図は本発明の化合物半導体基板の一実施例を示すN
20ガス流fpと絶縁薄膜の屈折率及び成長率の関係を
示す特性図である。
20ガス流fpと絶縁薄膜の屈折率及び成長率の関係を
示す特性図である。
Claims (3)
- (1)半導体基板の表面に絶縁性の薄膜を形成して表面
の保護及び安定化を行う化合物半導体基板において、前
記基板表面と接する境界面にシリコンと酸素との混合に
なる第1の絶縁薄膜を有し、その上層にシリコンと酸素
と窒素との混合になる第2の絶縁薄膜を具え、さらにそ
の上層に前記第2の絶縁膜と同成分で窒素の濃度を異に
する第3の絶縁薄膜が配してあることを特徴とする化合
物半導体基板。 - (2)前記第1の絶縁薄膜の厚さは50オングストロー
ム(Å)以上である特許請求の範囲第1項記載の化合物
半導体基板。 - (3)前記絶縁薄膜はプラズマCVD(気相成長)薄膜
形成装置を用い、モノシランガスと亜酸化窒素ガスとの
混合ガスを流入させ、両ガスの流量割合を変化して形成
するものである特許請求の範囲1項記載の化合物半導体
基板。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP26490887A JPH01107547A (ja) | 1987-10-20 | 1987-10-20 | 化合物半導体基板 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP26490887A JPH01107547A (ja) | 1987-10-20 | 1987-10-20 | 化合物半導体基板 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01107547A true JPH01107547A (ja) | 1989-04-25 |
Family
ID=17409884
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP26490887A Pending JPH01107547A (ja) | 1987-10-20 | 1987-10-20 | 化合物半導体基板 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01107547A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03173130A (ja) * | 1989-11-17 | 1991-07-26 | Internatl Business Mach Corp <Ibm> | 高品質二酸化シリコン層の付着方法 |
US5620910A (en) * | 1994-06-23 | 1997-04-15 | Semiconductor Energy Laboratory Co., Ltd. | Method for producing semiconductor device with a gate insulating film consisting of silicon oxynitride |
US6627545B2 (en) * | 1998-10-29 | 2003-09-30 | Lg.Philips Lcd Co., Ltd | Method of forming silicon oxide layer and method of manufacturing thin film transistor thereby |
-
1987
- 1987-10-20 JP JP26490887A patent/JPH01107547A/ja active Pending
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03173130A (ja) * | 1989-11-17 | 1991-07-26 | Internatl Business Mach Corp <Ibm> | 高品質二酸化シリコン層の付着方法 |
US5620910A (en) * | 1994-06-23 | 1997-04-15 | Semiconductor Energy Laboratory Co., Ltd. | Method for producing semiconductor device with a gate insulating film consisting of silicon oxynitride |
US6627545B2 (en) * | 1998-10-29 | 2003-09-30 | Lg.Philips Lcd Co., Ltd | Method of forming silicon oxide layer and method of manufacturing thin film transistor thereby |
US6716752B2 (en) | 1998-10-29 | 2004-04-06 | Lg.Philips Lcd Co., Ltd. | Method of forming silicon oxide layer and method of manufacturing thin film transistor thereby |
US7378304B2 (en) | 1998-10-29 | 2008-05-27 | Lg.Philips Lcd Co., Ltd. | Method of forming silicon oxide layer and method of manufacturing thin film transistor thereby |
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