JP7456674B2 - データパスの保護回路 - Google Patents

Description

関連出願の相互参照
本願は、２０２１年３月３１日に中国国家知的財産権局に提出された、出願番号が２０２１１０３５３２７１．５で、発明の名称が「データパスの保護回路、方法、装置及びコンピュータ可読記憶媒体」である中国特許出願の優先権を主張し、その内容の全ては援用により本願に組み込まれる。

本開示は、データ処理技術の分野に関し、特に、データパスの保護回路、方法、装置及びコンピュータ可読記憶媒体に関する。

技術の発展に伴い、従来のデータパス（ｄａｔａ ｐａｔｈ、例えば画像パス）は、すでに、システム機能の安全性要件を満たすことができず、画像パスを保護するには、対応する電気回路を増加する必要があり、現在採用されている保護案は、画像パスの内部で、キーモジュールの冗長設計、データパスレジスタのパリティ検査保護、及びメモリセルのエラー検査・訂正（Ｅｒｒｏｒ Ｃｈｅｃｋｉｎｇ ａｎｄ Ｃｏｒｒｅｃｔｉｎｇ，ＥＣＣ）保護が同時に行われるため、回路のハードウェアオーバーヘッドが過大になる。

上記の技術的問題を解決するために、本開示を提案した。本開示の実施例は、データパスの保護回路、方法、装置及びコンピュータ可読記憶媒体に提供する。

本開示の実施例の一態様によれば、入力処理回路、出力処理回路及び比較モジュールを含むデータパスの保護回路を提供し、
前記比較モジュールは、前記入力処理回路及び前記出力処理回路のそれぞれに電気的に接続され、
前記入力処理回路は、予め設定された検証方法（検査方式）にしたがって、入力データフレームに対して検証（検査）演算を行って、第１演算結果を得るために用いられ、
前記出力処理回路は、前記予め設定された検証方法にしたがって、前記入力データフレームに対応する出力データフレームに対して検証（検査）演算を行って、第２演算結果を得るために用いられ、
前記比較モジュールは、前記第１演算結果及び前記第２演算結果を取得し、前記第１演算結果及び前記第２演算結果に基づいて、前記データパスの第１エラー警報信号を生成するために用いられる。

本開示の実施例の別の一態様によれば、データパスの保護方法を提供し、前記保護方法は、
予め設定された検証方法にしたがって、入力データフレームに対して検証演算を行って、第１演算結果を得るステップと、
前記予め設定された検証方法にしたがって、前記入力データフレームに対応する出力データフレームに対して検証演算を行って、第２演算結果を得るステップと、
前記第１演算結果及び前記第２演算結果に基づいて、前記データパスの第１エラー警報信号を生成するステップと、を含む。

本開示の実施例の更なる一態様によれば、データパスの保護装置を提供し、前記保護装置は、
予め設定された検証方法にしたがって、入力データフレームに対して検証演算を行って、第１演算結果を得るための第１処理モジュールと、
前記予め設定された検証方法にしたがって、前記入力データフレームに対応する出力データフレームに対して検証演算を行って、第２演算結果を得るための第２処理モジュールと、
前記第１処理モジュールによって生成された前記第１演算結果及び前記第２処理モジュールによって生成された前記第２演算結果に基づいて、前記データパスの第１エラー警報信号を生成するための第１生成モジュールと、を含む。

本開示の実施例の又の一態様によれば、上記のデータパスの保護方法を実行するためのコンピュータプログラムが記憶されているコンピュータ可読記憶媒体を提供する。

本開示の実施例の又の一態様によれば、電子機器を提供し、当該電子機器は、
プロセッサーと、
前記プロセッサーが実行可能な命令を記憶するためのメモリーと、を含み、
前記プロセッサーは、前記メモリーから前記実行可能な命令を読み取り、前記命令を実行して、上記のデータパスの保護方法を実現するために用いられる。

本開示の上記の実施例にて提供されるデータパスの保護回路、方法、装置及びコンピュータ可読記憶媒体は、入力処理回路が入力データフレームに対して検証演算を行って、第１演算結果を取得し、出力処理回路が入力データフレームに対応する出力データフレームに対して検証演算を行って、第２演算結果を取得し、かつ、比較モジュールが第１演算結果及び第２演算結果に基づいて、データパスの第１エラー警報信号を生成することができ、こうなると、データパス内部にエラーが発生した状況をタイムリーに発見して、関係者にタイムリー通知して、データパスに対する保護を実現することができる。これから分かるように、本開示の実施例において、データパスの外部に入力処理回路、出力処理回路及び比較モジュールからなる、ハードウェア構造が簡単な保護回路を設置することにより、検証演算処理と演算結果の使用を組み合わせて、データパスの内部でデータパスの各構成部分をそれぞれ保護することを必要とせず、データパスの第１エラー警報信号を生成して、データパスに対する保護を効果的に実現することができ、そのため、本開示の実施例は、低いハードウェアオーバーヘッドでデータパスに対する保護を実現できる。

以下、図面及び実施例により、本開示の技術案をより一層詳細に説明する。
本開示の上記及び他の目的、特徴や利点は、本開示の実施例についての図面を併せてのより詳細な説明によって明らかになるであろう。図面は、本開示の実施例に対するさらなる理解を提供するために用いられるとともに、本明細書の一部を構成し、本開示の実施例と共に本開示を解釈するために用いられものであり、本開示を限定するものではない。図面において、同じ参照符号は一般的に同じ部材又はステップを示す。

画像パスの概略構造図である。 本開示の実施例に適用されるシーンの概略図である。 本開示の一例示的な実施例にて提供されるデータパスの保護回路の概略構造図である。 本開示の別の例示的な実施例にて提供されるデータパスの保護回路の概略構造図である。 本開示の一例示的な実施例にて提供されるデータパスの保護方法の概略フローチャートである。 本開示の別の例示的な実施例にて提供されるデータパスの保護方法の概略フローチャートである。 本開示の例示的な又別の実施例にて提供されるデータパスの保護方法の概略フローチャートである。 本開示の一例示的な実施例にて提供されるデータパスの保護装置の概略構造図である。 本開示の別の例示的な実施例にて提供されるデータパスの保護装置の概略構造図である。 本開示の一例示的な実施例にて提供される電子機器の構造図である。

以下、図面を参照しながら、本開示の例示的な実施例について詳細に説明する。明らかに、説明された実施例は、本開示のすべての実施例ではなく、本開示の実施例の一部にすぎず、本開示は、明細書に説明した例示的な実施例に限定されるものではないことを理解されたい。

なお、特に説明がない限り、これらの実施例に記載された部材及びステップの相対的な配置、数式及び値は本開示の範囲を限定するものではない。

当業者であれば、本開示の実施例における「第１」、「第２」などの用語は、異なるステップ、機器又はモジュールなどを区別するために用いられるだけで、いかなる特定の技術的意味を表すものでもなく、それらの間の必然的な論理的順序を表すものでもないことを理解できる。

また、本開示の実施例では、「複数」は、２つ以上を意味し、「少なくとも１つ」は、１つ、２つ又は２つ以上を意味することを理解されたい。

本開示の実施例に言及されるいずれか１つの部材、データ又は構造は、明確な限定がないか又は文脈上で逆の示唆が与えられない場合、一般的に、１つ又は複数と理解され得ることも理解されたい。

また、本開示において、「及び／又は」という用語は、関連オブジェクトの関連関係を説明するためのものにすぎず、３種類の関係が存在することを意味し、例えば、Ａ及び／又はＢは、Ａが単独で存在する場合、ＡとＢが同時に存在する場合、Ｂが単独で存在する場合の３つの場合を表すことができる。また、本開示において、符号「／」は、一般に、前後関連するオブジェクトが「又は」の関係であることを示す。

本開示の各実施例に対する説明は、各実施例間の相違点を強調し、その同一又は類似の点は互いに参照することができ、簡潔にするために、詳細な説明を省略したことも理解されたい。

また、図面に示されている各部分の寸法は、説明の便宜上、実際の比例関係に従って描かれたものではないことを理解されたい。

以下、少なくとも１つの例示的な実施例に対する説明は、実際には例示的なものに過ぎず、本開示及びその応用又は使用に対するいかなる限定ではない。

当業者に知られている技術、方法及び機器について詳細な説明を行わないが、適切な場合、当該技術、方法及び機器は明細書の一部とみなされるべきである。

なお、以下の図面では、類似の符号及び文字は同様の項目を表しており、ある項目が一度１つの図面において定義されると、それ以降の図面では更なる説明を要しない。

本開示の実施例は、端末機器、コンピュータシステム、サーバなどの電子機器に適用でき、それは、多くの他の汎用又は専用のコンピューティングシステム環境又は構成とともに操作できる。なお、電子機器は、システム・オン・チップ（Ｓｙｓｔｅｍ ｏｎ Ｃｈｉｐ，ＳＯＣ）を含んでもよく、ＳＯＣには、中央処理装置（Ｃｅｎｔｒａｌ Ｐｒｏｃｅｓｓｉｎｇ Ｕｎｉｔ，ＣＰＵ）、様々な他のタイプのプロセッサー、様々なデータ処理パス、メモリーなどが含まれてもよく、ＳＯＣ上でオペレーティングシステムを実行することができ、本開示の実施例は、具体的には、ＳＯＣの内部に適用でき、本開示の実施例に係る様々な電気的な接続は、いずれもＳＯＣ内部で実現でき、本開示の実施例に係る様々な電気的な接続は、具体的には、ＳＯＣ内部のシリコン基板上の金属配線接続であってもよく、本開示の実施例に係る全ての処理操作は、いずれもＳＯＣ内部で完了することができる。端末機器、コンピュータシステム、サーバなどの電子機器とともに使用するのに適する周知の端末機器、コンピューティングシステム、環境及び／又は構成の例として、自動車チップの機器或いはシステム、パーソナルコンピュータシステム、サーバコンピュータシステム、シンクライアント、シッククライアント、ハンドヘルド又はラップトップデバイス、マイクロプロセッサベースシステム、セットトップボックス、プログラマブル家電機器、ネットワークパソコン、小型コンピュータシステム、大型コンピュータシステム、及び上記いずれか１つのシステムを含む分散型クラウドコンピューティング技術環境などを含むが、これらに限定されない。

端末機器、コンピュータシステム、サーバなどの電子機器は、コンピュータシステムによって実行されるコンピュータシステム実行可能な命令（プログラムモジュールなど）の一般的なコンテキストで記述できる。一般に、プログラムモジュールは、特定のタスクを実行するか、又は特定の抽象データタイプを実現するルーチン、プログラム、目標プログラム、コンポーネント、論理、データ構造などを含んでもよい。コンピュータシステム／サーバは、分散型クラウドコンピューティング環境で実施でき、分散型クラウドコンピューティング環境において、タスクは通信ネットワークによってリンクされたリモート処理機器によって実行される。分散型クラウドコンピューティング環境において、プログラムモジュールは、記憶機器を含むローカル又はリモートコンピューティングシステムの記憶媒体上に位置してもよい。

出願の概要
本開示の実現中に、発明者らは、技術の発展に伴って、従来のデータパスは、すでに、システム機能の安全性要件を満たすことができず、例えばＡＳＩＬ Ｂの要件を満たすことができず、データパスを保護するためには、対応する電気回路を増加する必要があることを発見し、ここで、ＡＳＩＬ Ｂは、ＩＳＯ２６２６２の内容であり、ＩＳＯ２６２６２は、自動車業界の業界標準である。

具体的には、データパスは、画像パス、オーディオパスなどであり得る。データパスが画像パスである場合、図１Ａに示すように、画像パスには、メモリユニット１１、キー論理モジュール１２及び制御ユニット１３が含まれ得、メモリユニット１１は、キー論理モジュール１２のデータを記憶するために用いられることができ、制御ユニット１３は、キー論理モジュール１２の配置を制御することができる。画像パスに対する保護を実現するために、メモリユニット１１に対するＥＣＣ保護、キー論理モジュール１２に対する冗長設計保護、及び制御ユニット１３に対するレジスタパリティ検査保護を行うために、画像パスの内部に回路を増加する必要があるのが一般的であり、こうなると、画像パスを保護するための回路のハードウェアオーバーヘッドが大きい。

例示的なシステム
上記の出願の概要に言及された回路のハードウェアオーバーヘッドが大きいという問題を解決するために、図１Ｂに示すように、画像パスの外部に、本開示の実施例にて提供されるデータパスの保護回路を設置することができ、ハードウェアの初期化が完了した後、データパスの保護回路は自動的に動作することができ、それにより、低いハードウェアオーバーヘッドでデータパスに対する保護を実現できる。

例示的な回路
図２は、本開示の一例示的な実施例にて提供されるデータパスの保護回路の概略構造図である。図２に示すように、データパスの保護回路は、入力処理回路３１、出力処理回路３２及び比較モジュール３３を含む。

比較モジュール３３は、入力処理回路３１及び出力処理回路３２のそれぞれに電気的に接続される。

入力処理回路３１は、予め設定された検証方法にしたがって、入力データフレームに対して検証演算を行って、第１演算結果を得るために用いられる。

出力処理回路３２は、予め設定された検証方法にしたがって、入力データフレームに対応する出力データフレームに対して検証演算を行って、第２演算結果を得るために用いられる。

比較モジュール３３は、第１演算結果及び第２演算結果を取得し、第１演算結果及び第２演算結果に基づいて、データパスの第１エラー警報信号を生成するために用いられる。

理解を容易にするために、本開示の実施例はいずれもデータパスが画像パスである場合を例として説明し、これに対応して、本開示の実施例における入力データフレーム及び出力データフレームは、いずれも画像フレームである。

ここで、図２、図３に示すように、入力処理回路３１及び出力処理回路３２は、さらに、それぞれデータパス（ｄａｔａ ｐａｔｈ）のデータバス（ｄａｔａ ｂｕｓ）に電気的に接続されることができる。

本開示の実施例において、図３に示すように、データパスのデータバスは、入力データバス３４及び出力データバス３５を含み得、データパスの入力端（図３に示す左端）は、入力データバス３４に電気的に接続されてもよく、データパスの出力端（図３に示す右端）は出力データバス３５に電気的に接続されてもよく、こうなると、信号は、入力データバス３４経由でデータパスに流入し、出力データバス３５経由でデータパスから流出することができる。選択可能に、入力データバス３４は、制御信号入力データバス３４１及びデータ信号入力データバス３４２を含み得、出力データバス３５は、制御信号出力データバス３５１及びデータ信号出力データバス３５２を含み得、制御信号入力データバス３４１及び制御信号出力データバス３５１は、制御信号を伝送するために用いられることができ、データ信号入力データバス３４２及びデータ信号出力データバス３５２は、データ信号（ここで、具体的には画像信号である）を伝送するために用いられることができる。

なお、入力処理回路３１は、入力データバス３４に電気的に接続されることができ、こうなると、入力処理回路３１は、入力データバス３４から入力データフレームを取得できる。次に、入力処理回路３１は、予め設定された検証方法にしたがって、取得された入力データフレームに対して検証演算を行って、第１演算結果を取得し、例えば、予め設定された巡回冗長検査（Ｃｙｃｌｉｃ Ｒｅｄｕｎｄａｎｃｙ Ｃｈｅｃｋ、ＣＲＣ）の多項式にしたがって、取得された入力データフレームに対してＣＲＣ演算を行って、対応するＣＲＣ値を取得し、取得したＣＲＣ値を第１演算結果とする。

出力処理回路３２は、出力データバス３５に電気的に接続されることができ、こうなると、出力処理回路３２は、出力データバス３５から入力データフレームに対応する出力データフレームを取得できる。なお、本開示の実施例における入力データフレームと出力データフレームとは１対１の対応関係であり得、いずれの入力データフレームに対応する出力データフレームは、データパスが自分に入力された当該入力データフレームに基づいて出力するデータフレームであり得る。次に、出力処理回路３２は、予め設定された検証方法にしたがって、取得された出力データフレームに対して検証演算を行って、第２演算結果を得ることができ、例えば、予め設定されたＣＲＣの多項式にしたがって、取得された出力データフレームに対してＣＲＣ演算を行って、該当するＣＲＣ値を取得し、取得したＣＲＣ値を第２演算結果とする。

比較モジュール３３は、入力処理回路３１及び出力処理回路３２のそれぞれに電気的に接続されるため、入力処理回路３１によって得られた第１演算結果は、比較モジュール３３に提供されることができ、出力処理回路３２によって得られた第２演算結果も比較モジュール３３に提供されることができ、比較モジュール３３は、第１演算結果と第２演算結果とを比較し、比較結果が要件を満たさない場合、データパスの第１エラー警報信号を生成することができる。

具体的な実施形態において、比較モジュール３３は、入力データフレームの第１演算結果を取得し、当該入力データフレームに対応する出力データフレームの第２演算結果を取得して、取得された第１演算結果と第２演算結果とを比較することができる。取得された第１演算結果と第２演算結果とが異なる場合、比較結果が要求を満たさないと見なすことができ、すると、データパスの内部にエラーが発生したと判定することができ、このとき、比較モジュール３３は第１エラー警報信号を生成でき、関係者にデータパスの内部にエラーが発生したことを通知して、関係者が当該エラーをタイムリーに処理できるように、第１エラー警報信号をテキスト形態、音声形態、光形態等で出力することができる。

別の具体的な実施形態において、比較モジュール３３は、連続するＫ個（Ｋは２以上の整数）の入力データフレームのＫ個の第１演算結果を取得し、連続するＫ個の入力データフレームと１対１に対応するＫ個の出力データフレームのＫ個の第２演算結果を取得し、かつ、Ｋ個の第１演算結果とＫ個の第２演算結果とをペアリングしてＫ個の結果ペア（各結果ペアには、１つの入力データフレームの第１演算結果及び当該入力データフレームに対応する出力データフレームの第２演算結果が含まれる）にすることができ、比較モジュール３３は、さらに、結果ペアごとに、その中の第１演算結果と第２演算結果とが同じであるか否かを比較することができる。予め設定された比例（例えば２０％、３０％等）を超える結果ペア中の第１演算結果と第２演算結果とが異なる場合、比較結果が要求を満たさないと見なすことができ、すると、データパスの内部にエラーが発生したと判定することができ、このとき、比較モジュール３３は第１エラー警報信号を生成でき、関係者にデータパスの内部にエラーが発生したことを通知して、関係者が当該エラーをタイムリーに処理できるように、第１エラー警報信号をテキスト形態、音声形態、光形態等で出力することができる。

本開示の実施例にて提供されるデータパスの保護回路は、入力処理回路３１で入力データフレームに対して検証演算を行って、第１演算結果を取得し、出力処理回路３２で入力データフレームに対応する出力データフレームに対して検証演算を行って、第２演算結果を取得し、かつ、比較モジュール３３で第１演算結果及び第２演算結果に基づいて、データパスの第１エラー警報信号を生成することができ、こうなると、データパスの内部にエラーが発生した状況をタイムリーに発見して、この状況を関係者にタイムリーに通知することができ、データパスに対する保護を実現する。これから分かるように、本開示の実施例において、データパスの外部に、入力処理回路３１、出力処理回路３２及び比較モジュール３３からなる、ハードウェア構造が簡単な保護回路を設置することにより、検証演算処理と演算結果への使用とを組み合わせて、データパスの内部でデータパスの各構成部分をそれぞれ保護することを必要とせず、データパスの第１エラー警報信号を生成して、データパスに対する保護を効果的に実現することができ、そのため、本開示の実施例は、低いハードウェアオーバーヘッドでデータパスに対する保護を実現できる。

選択可能な一例示において、図３に示すように、入力処理回路３１は、第１信号生成モジュール３１１及び第１処理モジュール３１２を含む。

第１信号生成モジュール３１１は、第１処理モジュール３１２に電気的に接続され、第１処理モジュール３１２は、さらに、比較モジュール３３に電気的に接続される。

第１信号生成モジュール３１１は、入力制御信号に基づいて、第１処理モジュール３１２が完全な入力データフレームを取得したと決定した場合、入力フレームの末尾信号を生成して、入力フレームの末尾信号を送信するために用いられる。

第１処理モジュール３１２は、比較モジュール３３が第１演算結果を取得するように、第１信号生成モジュール３１１からの入力フレームの末尾信号に応じて、第１演算結果を得て出力するために用いられる。

ここで、第１信号生成モジュール３１１は、第１インターフェースＰ１及び第２インターフェースＰ２を有してもよく、第１処理モジュール３１２は、第３インターフェースＰ３、第４インターフェースＰ４及び第５インターフェースＰ５を有してもよく、比較モジュール３３は、第６インターフェースＰ６及び第７インターフェースＰ７を有してもよく、第１インターフェースＰ１は制御信号入力データバス３４１に電気的に接続されてもよく、第２インターフェースＰ２は第４インターフェースＰ４に電気的に接続されてもよく、第３インターフェースＰ３はデータ信号入力データバス３４２に電気的に接続されてもよく、第５インターフェースＰ５は第６インターフェースＰ６に電気的に接続されてもよい。

第３インターフェースＰ３がデータ信号入力データバス３４２に電気的に接続されるため、第１処理モジュール３１２はデータ信号入力データバス３４２から入力データ信号を取得でき、第１インターフェースＰ１が制御信号入力データバス３４１に電気的に接続されるため、第１信号生成モジュール３１１は制御信号入力データバス３４１から入力制御信号を取得できる。なお、入力制御信号は、入力データフレームに含まれる有効データ量、入力データフレームの伝送進行状況等を指示するための情報を携えることができ、こうなると、第１処理モジュール３１２がデータ信号入力データバス３４２から取得したデータ量と制御信号入力データバス３４１から取得した入力制御信号とを組み合わせて、第１処理モジュール３１２がデータ信号入力データバス３４２から完全な入力データフレームを取得したか否かを便利かつ確実に決定することができ、決定結果が「はい」である場合、第１信号生成モジュール３１１は入力フレームの末尾信号を生成して、第２インターフェースＰ２から入力フレームの末尾信号を出力することができ、対応して、第１処理モジュール３１２は第４インターフェースＰ４から入力フレームの末尾信号を取得することができる。次に、入力フレームの末尾信号に応じて、第１処理モジュール３１２は、ＣＲＣ演算に基づいて、第１演算結果を取得して、第５インターフェースＰ５から第１演算結果を出力し、対応して、比較モジュール３３は第６インターフェースＰ６から第１演算結果を取得し、第１演算結果に基づいて、比較処理を行い、かつ、第１エラー警報信号を生成することができ、比較モジュール３３は、さらに、第７インターフェースＰ７から第１エラー警報信号を出力することができる。

本開示の実施例において、入力処理回路３１中の第１信号生成モジュール３１１は、第１処理モジュール３１２が完全な入力データフレームを取得した状況を効果的に認識することができ、この状況では、入力フレームの末尾信号で入力処理回路３１中の第１処理モジュール３１２をトリガーして、第１演算結果を取得して出力し、これに基づいてデータパスに対する保護を実現し、入力処理回路３１のハードウェア構造が簡単で、ハードウェアオーバーヘッドを低減するのに役立つ。

選択可能な一例示において、図３に示すように、当該保護回路は、さらに、記憶モジュール３６を含む。

記憶モジュール３６は、第１信号生成モジュール３１１、第１処理モジュール３１２及び比較モジュール３３のそれぞれに電気的に接続される。

第１信号生成モジュール３１１は、さらに、入力制御信号に基づいて、第１処理モジュール３１２が完全な入力データフレームを取得したと決定した場合、データ書き込み信号を生成して、データ書き込み信号を送信するために用いられる。

第１処理モジュール３１２は、第１信号生成モジュール３１１からの入力フレームの末尾信号に応じて、第１演算結果を送信するために用いられる。

記憶モジュール３６は、第１信号生成モジュール３１１からのデータ書き込み信号に応じて、第１処理モジュール３１２からの第１演算結果を記憶するために用いられ、記憶モジュール３６は、さらに、第１演算結果を送信するために用いられる。

ここで、記憶モジュール３６は、先入れ先出し（Ｆｉｒｓｔ Ｉｎｐｕｔ Ｆｉｒｓｔ Ｏｕｔｐｕｔ，ＦＩＦＯ）メモリーであり得、記憶モジュール３６は、第８インターフェースＰ８、第９インターフェースＰ９及び第１０インターフェースＰ１０を有してもよく、第１信号生成モジュール３１１は、さらに、第１１インターフェースＰ１１を有してもよく、第８インターフェースＰ８は、第１１インターフェースＰ１１に電気的に接続されてもよく、第９インターフェースＰ９は、第５インターフェースＰ５に電気的に接続されてもよく、第１０インターフェースＰ１０は、第６インターフェースＰ６に電気的に接続されてもよい。

第１処理モジュール３１２がデータ信号入力データバス３４２から完全な入力データフレームを取得したと決定した場合、第１信号生成モジュール３１１は、データ書き込み信号を生成して、第１１インターフェースＰ１１からデータ書き込み信号を出力することができ、対応して、記憶モジュール３６は第８インターフェースＰ８からデータ書き込み信号を取得でき、ここで、記憶モジュール３６がＦＩＦＯメモリーである場合、データ書き込み信号はＦＩＦＯ書き信号とも呼ばれ得る。

また、第１処理モジュール３１２は、第１信号生成モジュール３１１からの入力フレームの末尾信号に応じて、第５インターフェースＰ５から第１演算結果を出力し、対応して、記憶モジュール３６は第９インターフェースＰ９から第１演算結果を取得でき、記憶モジュール３６はデータ書き込み信号に応じて、第１演算結果をラッチすることができ、記憶モジュール３６にラッチされた第１演算結果は、比較モジュール３３が第６インターフェースＰ６から第１演算結果を取得するように、後で第１０インターフェースＰ１０から出力されることができる。

本開示の実施例において、第１信号生成モジュール３１１は、第１処理モジュール３１２が完全な入力データフレームを取得した状況を効果的に認識することができ、当該状況では、データ書き込み信号で記憶モジュール３６をトリガーして、第１処理モジュール３１２からの第１演算結果をラッチし、記憶モジュール３６は、後で必要がある場合に、ラッチされた第１演算結果を比較モジュール３３に提供することができ、これに基づいてデータパスに対する保護を実現し、保護回路全体のハードウェア構造は簡単で、ハードウェアオーバーヘッドを低減するのに役立つ。

選択可能な一例示において、図３に示すように、当該保護回路は、さらに、重複検出モジュール３７を含む。

重複検出モジュール３７は、第１接続バス３８を介して、第１信号生成モジュール３１１及び記憶モジュール３６に電気的に接続され、重複検出モジュール３７は、さらに、第２接続バス３９を介して、第１処理モジュール３１２及び記憶モジュール３６に電気的に接続される。

重複検出モジュール３７は、第１接続バス３８から連続するＮ個のデータ書き込み信号を取得し、第２接続バス３９から連続するＮ個のデータ書き込み信号に対応するＮ個の第１演算結果を取得し、Ｎ個の第１演算結果のうち、同じ演算結果の数とＮが予め設定された関係を満たす場合、データパスの第２エラー警報信号を生成するために用いられ、Ｎは２以上の整数である。

ここで、重複検出モジュール３７は、第１２インターフェースＰ１２、第１３インターフェースＰ１３及び第１４インターフェースＰ１４を有してもよく、第１２インターフェースＰ１２は第１接続バス３８に電気的に接続され、第１３インターフェースＰ１３は第２接続バス３９に電気的に接続される。

ここで、Ｎは、２、３、４、５、又は５よりも大きい整数であってもよく、Ｎ個の第１演算結果のうち、同じ演算結果の数とＮが予め設定された関係を満たすということは、Ｎ個の第１演算結果のうち、同じ演算結果の数とＮとの差の絶対値が予め設定された差（例えば２、３等）以下であるか、又は、Ｎ個の第１演算結果のうち、同じ演算結果の数とＮとの比が予め設定された比（例えば０．６、０．７、０．８等）以上であることを指し得る。選択可能に、Ｎは、５であってもよく、５つの第１演算結果のうち、同じ演算結果の数が３つを越える場合、上記の予め設定された関係を満たすと決定できる。

第１２インターフェースＰ１２が第１接続バス３８に電気的に接続されるため、第１信号生成モジュール３１１から記憶モジュール３６に送信された各データ書き込み信号は、いずれも重複検出モジュール３７によって取得できる。第１３インターフェースＰ１３が第２接続バス３９に電気的に接続されるため、第１処理モジュール３１２から記憶モジュール３６に送信された各第１演算結果は、いずれも重複検出モジュール３７によって取得できる。重複検出モジュール３７は、取得されたデータ書き込み信号及び第１演算結果に対する統計及び分析処理を行うことができ、統計及び分析処理により、連続するＮ個のデータ書き込み信号及び連続するＮ個のデータ書き込み信号に対応するＮ個の第１演算結果を取得したと決定し、かつ、Ｎ個の第１演算結果のうち、同じ演算結果の数とＮが予め設定された関係を満たす場合、入力データフレームが重複するというエラーが発生したと判定することができ、このとき、重複検出モジュール３７は、第２エラー警報信号を生成して、第１４インターフェースＰ１４から第２エラー警報信号を出力することができ、第２エラー警報信号は、入力データフレームが重複するというエラーが発生したことを関係者に通知して、関係者が当該エラーをタイムリーに処理できるように、テキスト形態、音声形態、光形態で出力されることができる。

本開示の実施例において、重複検出モジュール３７の設置により、入力データフレームが重複するというエラーが発生した状況をタイムリーに発見して、当該状況を関係者にタイムリーに通知することができ、こうなると、データパスに対する保護を実現するのに役立つ。

選択可能な一例示において、図３に示すように、第１処理モジュール３１２は、第１信号処理ユニット３１２１及び第１検証ユニット３１２２を含む。

第１信号処理ユニット３１２１は、第１検証ユニット３１２２に電気的に接続され、第１検証ユニット３１２２は、さらに、第１信号生成モジュール３１１及び比較モジュール３３のそれぞれに電気的に接続される。

第１信号処理ユニット３１２１は、入力制御信号に基づいて、入力データ信号中の有効信号に対してサンプリング及びパッキング（パッケージング）処理を行って、第１サンプリング・パッキング結果を送信するために用いられる。

第１検証ユニット３１２２は、第１信号処理ユニット３１２１からの第１サンプリング・パッキング結果に基づいて、入力データフレームに対する検証演算の後に得られる第１演算結果を生成するために用いられる。

ここで、第１信号処理ユニット３１２１は、第３インターフェースＰ３、第１５インターフェースＰ１５及び第１６インターフェースＰ１６を有してもよく、第１検証ユニット３１２２は第４インターフェースＰ４、第５インターフェースＰ５及び第１７インターフェースＰ１７を有してもよく、第１５インターフェースＰ１５は制御信号入力データバス３４１に電気的に接続されてもよく、第１６インターフェースＰ１６は第１７インターフェースＰ１７に電気的に接続されてもよく、第５インターフェースＰ５は第６インターフェースＰ６に電気的に接続されてもよい。

第１５インターフェースＰ１５が制御信号入力データバス３４１に電気的に接続されるため、第１信号処理ユニット３１２１は第１５インターフェースＰ１５から入力制御信号を取得でき、第３インターフェースＰ３がデータ信号入力データバス３４２に電気的に接続されるため、第１信号処理ユニット３１２１は第３インターフェースＰ３から入力データ信号を取得できる。なお、入力制御信号は、入力データ信号のうち、どれらの信号が有効信号であり、どれらの信号が無効信号であるかを指示することができ、こうなると、入力制御信号により指示効果を果たし、第１信号処理ユニット３１２１は、入力データ信号中の有効信号のみをサンプリングして、サンプリングされた信号をパッキング処理することができ、例えば第１検証ユニット３１２２に必要なデータ構造にパッキングして、第１サンプリング・パッキング結果を得る。次に、第１信号処理ユニット３１２１は、第１６インターフェースＰ１６から第１サンプリング・パッキング結果を出力することができ、対応して、第１検証ユニット３１２２は第１７インターフェースＰ１７から第１サンプリング・パッキング結果を取得でき、第１サンプリング・パッキング結果に基づいて、第１検証ユニット３１２２は、完全な入力画像フレームを取得することができ、これに基づいて第１演算結果を取得し、かつ、比較モジュール３３が第６インターフェースＰ６から第１演算結果を取得するように、第５インターフェースＰ５から第１演算結果を出力する。

本開示の実施例において、第１処理モジュール３１２中の第１信号処理ユニット３１２１は、入力データ信号中の有効信号のみに対してサンプリング及びパッキング処理を行って、第１サンプリング・パッキング結果を第１処理モジュール３１２中の第１検証ユニット３１２２に提供することができ、第１検証ユニット３１２２は、これに基づいて第１演算結果を生成して、第１演算結果を比較モジュール３３に提供することができ、これに基づいてデータパスに対する保護を実現する。本開示の実施例では、無効信号を処理する必要がないため、無効信号による干渉を回避できるだけでなく、システムリソースや電力を節約することができ、かつ、第１処理モジュール３１２のハードウェア構造が簡単であるため、ハードウェアオーバーヘッドを低減するのに役立つ。

選択可能な一例示において、図３に示すように、当該保護回路は、さらに、制御信号検出モジュール４０を含む。

制御信号検出モジュール４０は、入力制御信号で運ばれる有効データ量と予め設定されたデータ量とが異なる、及び／又は、入力制御信号で運ばれるフレーム伝送占有時間が予め設定された時間を超える場合、データパスの第３エラー警報信号を生成するために用いられる。

ここで、制御信号検出モジュール４０は、第１８インターフェースＰ１８及び第１９インターフェースＰ１９を有してもよく、第１８インターフェースＰ１８は制御信号入力データバス３４１に電気的に接続される。

ここで、各入力制御信号は、いずれも有効データ量及びフレーム伝送占有時間などの情報を運ぶことができ、当該有効データ量は、単一の入力データフレームに含まれる有効データ量であり、当該フレーム伝送占有時間は、単一の入力データフレームの伝送に必要な時間の長さである。

第１８インターフェースＰ１８が制御信号入力データバス３４１に電気的に接続されるため、制御信号検出モジュール４０は、第１８インターフェースＰ１８から入力制御信号を取得でき、次に、制御信号検出モジュール４０は、取得された入力制御信号から有効データ量及びフレーム伝送占有時間を抽出することができ、抽出された有効データ量と予め設定されたデータ量とを比較し、かつ、抽出されたフレーム伝送占有時間の長さと予め設定された時間の長さとを比較する。抽出された有効データ量と予め設定されたデータ量とが異なる、及び／又は、抽出されたフレーム伝送占有時間の長さが予め設定された時間の長さを超える場合、データ量異常及び／又はデータフレームロスのエラーが発生したと判定することができ、このとき、制御信号検出モジュール４０は第３エラー警報信号を生成して、第１９インターフェースＰ１９から第３エラー警報信号を出力することができ、第３エラー警報信号は、データ量異常及び／又はデータフレームロスのエラーが発生したことを関係者に通知して、関係者が当該エラーをタイムリーに処理できるように、テキスト形態、音声形態、光形態等により出力されることができる。

本開示の実施例において、制御信号検出モジュール４０の設置により、データ量異常及び／又はデータフレームロスのエラーが発生した状況をタイムリーに発見して、当該状況を関係者にタイムリーに通知することができ、こうなると、データパスに対する保護を実現するのに役立つ。

選択可能な一例示において、図３に示すように、出力処理回路３２は、第２信号生成モジュール３２１及び第２処理モジュール３２２を含む。

第２信号生成モジュール３２１は、第２処理モジュール３２２及び比較モジュール３３のそれぞれに電気的に接続され、第２処理モジュール３２２は、さらに、比較モジュール３３に電気的に接続される。

第２信号生成モジュール３２１は、出力制御信号に基づいて、第２処理モジュール３２が完全な出力データフレームを取得したと決定した場合、出力フレームの末尾信号及び比較イネーブル信号を生成して、出力フレームの末尾信号を送信し、かつ、比較イネーブル信号を送信するために用いられる。

第２処理モジュール３２２は、第２信号生成モジュール３２１からの出力フレームの末尾信号に応じて、第２演算結果を得て送信するために用いられる。

比較モジュール３３は、第２信号生成モジュール３２１からの比較イネーブル信号に応じて、第１演算結果と第２演算結果とを比較し、かつ、第１演算結果と第２演算結果とがマッチングしない比較結果である場合、第１エラー警報信号を生成するために用いられる。

ここで、第２信号生成モジュール３２１は、第２０インターフェースＰ２０、第２１インターフェースＰ２１及び第２２インターフェースＰ２２を有してもよく、第２処理モジュール３２２は、第２３インターフェースＰ２３、第２４インターフェースＰ２４及び第２５インターフェースＰ２５を有してもよく、比較モジュール３３は、第７インターフェースＰ７、第２６インターフェースＰ２６及び第２７インターフェースＰ２７を有してもよく、第２０インターフェースＰ２０は制御信号出力データバス３５１に電気的に接続されてもよく、第２１インターフェースＰ２１は第２６インターフェースＰ２６に電気的に接続されてもよく、第２２インターフェースＰ２２は第２４インターフェースＰ２４に電気的に接続されてもよく、第２３インターフェースＰ２３はデータ信号出力データバス３５２に電気的に接続されてもよく、第２５インターフェースＰ２５は第２７インターフェースＰ２７に電気的に接続されてもよい。

第２３インターフェースＰ２３がデータ信号出力データバス３５２に電気的に接続されるため、第２処理モジュール３２２は、データ信号出力データバス３５２から出力データ信号を取得でき、第２０インターフェースＰ２０が制御信号出力データバス３５１に電気的に接続されるため、第２信号生成モジュール３２１は、制御信号出力データバス３５１から出力制御信号を取得できる。なお、出力制御信号は、出力データフレームに含まれている有効情報量や出力データフレームの伝送進行状況等を指示するための情報を運ぶことができ、こうなると、第２処理モジュール３２２がデータ信号出力データバス３５２から取得したデータ量と制御信号出力データバス３５１から取得した出力制御信号とを組み合わせて、第２処理モジュール３２２がデータ信号出力データバス３５２から完全な出力データフレームを取得したか否かを便利かつ確実に決定することができ、決定結果が「はい」である場合、第２信号生成モジュール３２１は、出力フレームの末尾信号及び比較イネーブル信号を生成して、第２１インターフェースＰ２１から比較イネーブル信号を出力し、かつ、第２２インターフェースＰ２２から出力フレームの末尾信号を出力することができ、対応して、比較モジュール３３は第２６インターフェースＰ２６から比較イネーブル信号を取得でき、第２処理モジュール３２２は第２４インターフェースＰ２４から出力フレームの末尾信号を取得できる。

次に、第２処理モジュール３２２は、出力フレームの末尾信号に応じて、第２演算結果を取得し、第２５インターフェースＰ２５から第２演算結果を出力し、対応して、比較モジュール３３は、第２７インターフェースＰ２７から第２演算結果を取得できる。また、比較モジュール３３は、さらに、比較イネーブル信号に応じて、第１演算結果と第２演算結果とを比較して、第１演算結果が第２演算結果とマッチングするか否かを決定することができ、なお、上記において、比較結果が要件を満たさない状況を第１演算結果と第２演算結果とがマッチングしない状況とすることが可能で、第１演算結果と第２演算結果とがマッチングしない比較結果である場合、比較モジュール３３は第１エラー警報信号を生成することができる。

本開示の実施例において、出力処理回路３２における第２信号生成モジュール３２１が、出力処理回路３２における第２処理モジュール３２２が完全な出力データフレームを取得した状況を効果的に認識することができ、当該状況で、出力フレームの末尾信号で第２処理モジュール３２２をトリガーして、第２演算結果を得て送信し、比較イネーブル信号で比較モジュール３３をトリガーして比較処理を行い、これに基づいて、データパスに対する保護を実現し、出力処理回路３２のハードウェア構造が簡単で、ハードウェアオーバーヘッドを低減するのに役立つ。

選択可能な一例示において、図３に示すように、当該保護回路は、さらに、記憶モジュール３６を含む。

記憶モジュール３６は、入力処理回路３１、比較モジュール３３及び第２信号生成モジュール３２１のそれぞれに電気的に接続される。

入力処理回路３１は、さらに、第１演算結果を送信するために用いられる。

記憶モジュール３６は、入力処理回路３１からの第１演算結果を記憶するために用いられる。

第２信号生成モジュール３２１は、さらに、出力制御信号に基づいて、第２処理モジュール３２２が完全な出力データフレームを取得したと決定した場合、データ読み取り信号を生成して、データ読み取り信号を送信するために用いられる。

記憶モジュール３６は、さらに、第２信号生成モジュール３２１からのデータ読み取り信号に応じて、記憶されている第１演算結果を読み取って、読み取られた第１演算結果を送信するために用いられる。

ここで、記憶モジュール３６は、ＦＩＦＯメモリーであってもよく、記憶モジュール３６は、第９インターフェースＰ９、第１０インターフェースＰ１０及び第２８インターフェースＰ２８を有してもよく、比較モジュール３３は、第６インターフェースＰ６を有してもよく、第２信号生成モジュール３２１は第２９インターフェースＰ２９を有してもよく、第９インターフェースＰ９は入力処理回路３１の第５インターフェースＰ５に電気的に接続されてもよく、第１０インターフェースＰ１０は第６インターフェースＰ６に電気的に接続されてもよく、第２８インターフェースＰ２８は第２９インターフェースＰ２９に電気的に接続されてもよい。

第９インターフェースＰ９が第５インターフェースＰ５に電気的に接続されるため、記憶モジュール３６は第９インターフェースＰ９から入力処理回路３１からの第１演算結果を取得でき、記憶モジュール３６は、受信した第１演算結果をラッチすることができる。また、第２処理モジュール３２２がデータ信号出力データバス３５２から完全な出力データフレームを取得したと決定した場合、第２信号生成モジュール３２１は、データ読み取り信号を生成して、第２９インターフェースＰ２９からデータ読み取り信号を出力することができ、対応して、記憶モジュール３６は第２８インターフェースＰ２８からデータ読み取り信号を取得でき、データ読み取り信号に応じて、記憶モジュール３６は、比較モジュール３３が第６インターフェースＰ６から第１演算結果を取得するように、記憶されている第１演算結果を読み取って、第１０インターフェースＰ１０から第１演算結果を出力する。

これから分かるように、本開示の実施例において、第２信号生成モジュール３２１は、第２処理モジュール３２が完全な出力データフレームを取得した状況を効果的に認識することができ、当該状況で、データ読み取り信号で記憶モジュール３６をトリガーしてラッチされた第１演算結果を読み取り、読み取られた第１演算結果を比較モジュール３３に提供し、これに基づいて、データパスに対する保護を実現し、保護回路全体のハードウェア構造は簡単で、ハードウェアオーバーヘッドを低減するのに役立つ。

選択可能な一例示において、図３に示すように、第２処理モジュール３２２は、第２信号処理ユニット３２２１及び第２検証ユニット３２２２を含む。

第２信号処理ユニット３２２１は、第２検証ユニット３２２２に電気的に接続され、第２検証ユニット３２２２は、さらに、第２信号生成モジュール３２１及び比較モジュール３３のそれぞれに電気的に接続される。

第２信号処理ユニット３２２１は、出力制御信号に基づいて、出力データ信号中の有効信号に対してサンプリング及びパッキング処理を行って、第２サンプリング・パッキング結果を送信するために用いられる。

第２検証ユニット３２２２は、第２信号処理ユニット３２２１からの第２サンプリング・パッキング結果に基づいて、出力データフレームに対する検証演算の後に得られる第２演算結果を生成するために用いられる。

ここで、第２信号処理ユニット３２２１は、第２３インターフェースＰ２３、第３０インターフェースＰ３０及び第３１インターフェースＰ３１を有してもよく、第２検証ユニット３２２２は第２４インターフェースＰ２４、第２５インターフェースＰ２５及び第３２インターフェースＰ３２を有してもよく、比較モジュール３３は第２７インターフェースＰ２７を有してもよく、第２３インターフェースＰ２３はデータ信号出力データバス３５２に電気的に接続されてもよく、第３０インターフェースＰ３０は制御信号出力データバス３５１に電気的に接続されてもよく、第３１インターフェースＰ３１は第３２インターフェースＰ３２に電気的に接続されてもよく、第２５インターフェースＰ２５は第２７インターフェースＰ２７に電気的に接続されてもよい。

第３０インターフェースＰ３０が制御信号出力データバス３５１に電気的に接続されるため、第２信号処理ユニット３２２１は、第３０インターフェースＰ３０から出力制御信号を取得でき、第２３インターフェースＰ２３がデータ信号出力データバス３５２に電気的に接続されるため、第２信号処理ユニット３２２１は第２３インターフェースＰ２３から出力データ信号を取得できる。なお、出力制御信号は、出力データ信号のうち、どれらの信号が有効信号であり、どれらの信号が無効信号であるかを指示することができ、こうなると、出力制御信号により指示効果を果たし、第２信号処理ユニット３２２１は、出力データ信号中の有効信号のみをサンプリングして、サンプリングされた信号をパッキング処理することができ、例えば、第２検証ユニット３２２２に必要なデータ構造にパッキングして、第２サンプリング・パッキング結果を得る。次に、第２信号処理ユニット３２２１は、第３１インターフェースＰ３１から第２サンプリング・パッキング結果を出力することができ、対応して、第２検証ユニット３２２２は第３２インターフェースＰ３２から第２サンプリング・パッキング結果を取得でき、第２サンプリング・パッキング結果に基づいて、第２検証ユニット３２２２は、完全な出力画像フレームを取得することができ、これに基づいて第２演算結果を取得し、かつ、第２５インターフェースＰ２５から第２演算結果を出力し、それにより、比較モジュール３３が第２７インターフェースＰ２７から第２演算結果を取得する。

本開示の実施例において、第２処理モジュール３２２中の第２信号処理ユニット３２２１は、出力データ信号中の有効信号のみに対してサンプリング及びパッキング処理を行って、第２サンプリング・パッキング結果を第２処理モジュール３２２中の第２検証ユニット３２２２に提供することができ、第２検証ユニット３２２２は、これに基づいて、第２演算結果を生成し、第２演算結果を比較モジュール３３に提供することができ、これに基づいて、データパスに対する保護を実現し、本開示の実施例では、無効信号の処理を行う必要がないため、無効信号によって引き起こされる可能性のある干渉を回避できるだけでなく、システムリソースおよび電力を節約することもでき、かつ、第２処理モジュール３２２のハードウェア構造は簡単で、ハードウェアオーバーヘッドを低減するのに役立つ。

以上をまとめると、本開示の実施例にて提供されるデータパスの保護回路を用いて、データパスの内部にエラーが発生した状況、入力データフレームが重複するというエラーが発生した状況、データ量異常が発生した状況、データフレームロスのエラーが発生した状況を便利かつ確実に認識して、これらの状況を関係者にタイムリーに通知することができ、それにより、ハードウェアオーバーヘッドをできるだけ低減して、データパスに対する保護を実現することができ、かつ、エラーの診断カバー率を効果的に向上させて、システム機能の安全性要件を満たすことができる。
例示的な方法

図４は、本開示の一例示的な実施例にて提供されるデータパスの保護方法の概略フローチャートである。図４に示す方法は、
予め設定された検証方法にしたがって、入力データフレームに対して検証演算を行って、第１演算結果を得るステップ４０１と、
予め設定された検証方法にしたがって、入力データフレームに対応する出力データフレームに対して検証演算を行って、第２演算結果を得るステップ４０２と、
第１演算結果及び第２演算結果に基づいて、データパスの第１エラー警報信号を生成するステップ４０３と、を含む。

選択可能な一例示において、図５に示すように、当該方法は、さらに、
連続するＮ個の入力データフレームに対応するＮ個の第１演算結果のうち、同じ演算結果の数とＮが予め設定された関係を満たす場合、データパスの第２エラー警報信号を生成するステップであって、Ｎは２以上の整数であるステップ４１１を含む。

選択可能な一例示において、図６に示すように、当該方法は、さらに、
入力制御信号で運ばれる有効データ量と予め設定されたデータ量とが異なる、及び／又は、入力制御信号で運ばれるフレーム伝送占有時間の長さが予め設定された時間の長さを超える場合、データパスの第３エラー警報信号を生成するステップ４１２を含む。

なお、本開示の実施例は、ステップ４１２及びステップ４０１～ステップ４０３のうちのいずれか１つの実行順序を限定しない。

本開示の実施例にて提供されるいずれのデータパスの保護方法は、任意の適切なデータ処理能力を有する機器によって実行されることができ、当該機器は、端末機器及びサーバなどを含むが、これらに限定されない。又は、本開示の実施例にて提供されるいずれのデータパスの保護方法は、プロセッサーによって実行されることができ、例えば、プロセッサーは、メモリーに記憶されている対応する命令を呼び出して、本開示の実施例に言及されたいずれのデータパスの保護方法を実行する。以下では詳細な説明を省略する。
例示的な装置

図７は、本開示の一例示的な実施例にて提供されるデータパスの保護装置の概略構造図である。図７に示す装置は、第１処理モジュール７０１、第２処理モジュール７０２及び第１生成モジュール７０３を含む。

第１処理モジュール７０１は、予め設定された検証方法にしたがって、入力データフレームに対して検証演算を行って、第１演算結果を得るために用いられる。

第２処理モジュール７０２は、予め設定された検証方法にしたがって、入力データフレームに対応する出力データフレームに対して検証演算を行って、第２演算結果を得るために用いられる。

第１生成モジュール７０３は、第１処理モジュール７０１によって生成された第１演算結果及び第２処理モジュール７０２によって生成された第２演算結果に基づいて、データパスの第１エラー警報信号を生成するために用いられる。

選択可能な一例示において、図８に示すように、当該装置は、さらに、
連続するＮ個の入力データフレームに対応するＮ個の第１演算結果のうち、同じ演算結果の数とＮが予め設定された関係を満たす場合、データパスの第２エラー警報信号を生成するために用いられるモジュールであって、Ｎは２以上の整数である第２生成モジュール７１１を含む。

選択可能な一例示において、図８に示すように、当該装置は、さらに、
入力制御信号で運ばれる有効データ量と予め設定されたデータ量とが異なる、及び／又は、入力制御信号で運ばれるフレーム伝送占有時間の長さが予め設定された時間の長さを超える場合、データパスの第３エラー警報信号を生成するための第３生成モジュール７１２を含む。
例示的な電子機器

以下、図９を参照しながら本開示の実施例に係る電子機器について説明する。図９は、本開示の実施例による電子機器のブロック図を示す。

図９に示すように、電子機器９００は、１つ又は複数のプロセッサー９０１と、メモリー９０２と、を含む。

プロセッサー９０１は、中央処理装置（Ｃｅｎｔｒａｌ Ｐｒｏｃｅｓｓｉｎｇ Ｕｎｉｔ，ＣＰＵ）又はデータ処理能力及び／又は命令実行能力を持っている他の形態の処理装置であってもよく、所望の機能を実行するように、電子機器９００内の他のコンポーネントを制御できる。

メモリー９０２は、揮発性メモリー及び／又は不揮発性メモリーなどの様々な形態のコンピュータ可読記憶媒体を含む１つ又は複数のコンピュータプログラム製品を含んでもよい。前記揮発性メモリーは、例えばランダムアクセスメモリー（（Ｒａｎｄｏｍ Ａｃｃｅｓｓ Ｍｅｍｏｒｙ、ＲＡＭ）及び／又はキャッシュメモリー（ｃａｃｈｅ）などを含んでもよい。前記不揮発性メモリーは、例えば読み取り専用メモリー（ＲＯＭ）、ハードディスク、フラッシュメモリーなどを含んでもよい。前記コンピュータ可読記憶媒体に１つ又は複数のコンピュータプログラム命令を記憶することができ、プロセッサー９０１は、前記プログラム命令を実行することで、上記した本開示の各実施例におけるデータパスの保護及び／又は他の所望の機能を実現できる。前記コンピュータ可読記憶媒体に、入力信号、信号成分、ノイズ成分等の様々なコンテンツも格納できる。

一例示では、電子機器９００は、さらに、バスシステム及び／又は他の形態の接続機構（図示せず）を介して互に接続されている入力装置９０３及び出力装置９０４を含んでもよい。

例えば、当該入力装置９０３は、マイクロフォン又はマイクロフォンアレイであってもよいし、当該入力装置９０３は通信ネットワークコネクタであってもよい。

また、当該入力装置９０３は、さらに、例えばキーボードやマウスなどを含んでもよい。

当該出力装置９０４は、決定されたエラー警報信号（例えば第１エラー警報信号、第２エラー警報信号及び／又は第３エラー警報信号）などを含む様々な情報を外部に出力することができる。当該出力装置９０４は、例えばディスプレイ、スピーカー、プリンター、通信ネットワーク及びそれらに接続されるリモート出力機器などを含んでもよい。

当然のことながら、説明の簡略化のために、図９には、当該電子機器９００内の本開示と関連するコンポーネントの一部のみが示されており、バスや入出力インターフェースなどのコンポーネントは省略された。このほか、具体的な応用状況に応じて、電子機器９００は適切な任意の他のコンポーネントをさらに含んでもよい。
例示的なコンピュータプログラム製品及びコンピュータ可読記憶媒体

本開示の実施例は、上記の方法及び機器に加え、コンピュータプログラム命令を含むコンピュータプログラム製品であってもよく、前記コンピュータプログラム命令がプロセッサーによって実行されると、プロセッサーが本明細書の上記「例示的な方法」に記載の本開示の様々な実施例によるデータパスの保護方法におけるステップを実行させる。

前記コンピュータプログラム製品は、１つ又は複数のプログラミング言語の任意の組み合わせで、本開示の実施例の操作を実行するためのプログラムコードを作成することができ、前記プログラミング言語は、Ｊａｖａ（登録商標）、Ｃ＋＋などのオブジェクト指向プログラミング言語、及び「Ｃ」言語又は類似のプログラミング言語などの従来の手続き型プログラミング言語を含む。プログラムコードは、完全にユーザコンピューティングデバイス上で実行されてもよいし、一部がユーザコンピューティングデバイス上で実行されてもよいし、スタンドアロンソフトウェアパッケージとして実行されてもよいし、一部はユーザコンピューティングデバイス上で、一部はリモートコンピューティングデバイス上で実行されてもよいし、完全にリモートコンピューティングデバイスもしくはサーバ上で実行されてもよい。

また、本開示の実施例は、コンピュータプログラム命令が記憶されているコンピュータ可読記憶媒体であってもよく、前記コンピュータプログラム命令がプロセッサーによって実行されると、プロセッサーが、本明細書の上記「例示的な方法」に記載の本開示の様々な実施例によるデータパスの保護方法におけるステップを実行する。

前記コンピュータ可読記憶媒体としては、１つ又は複数の可読媒体の任意の組み合わせを採用することができる。可読媒体は、可読信号媒体又は可読記憶媒体であり得る。可読記憶媒体は、電気、磁気、光学、電磁気、赤外線、又は半導体のシステム、装置、又はデバイス、あるいはそれらの任意の組み合わせを含み得るが、これらに限定されない。可読記憶媒体のより具体的な例（非網羅的なリスト）には、１つ又は複数のワイヤを有する電気的接続、ポータブルディスク、ハードディスク、ランダムアクセスメモリー（ＲＡＭ）、読み取り専用メモリ（ＲＯＭ）、消去可能プログラマブル読み取り専用メモリ（（Ｅｒａｓａｂｌｅ Ｐｒｏｇｒａｍｍａｂｌｅ Ｒｅａｄ－Ｏｎｌｙ Ｍｅｍｏｒｙ、ＥＰＲＯＭ）又はフラッシュメモリ）、光ファイバ、コンパクトディスク（Ｃｏｍｐａｃｔ Ｄｉｓｃ Ｒｅａｄ－Ｏｎｌｙ Ｍｅｍｏｒｙ、ＣＤ－ＲＯＭ）、光記憶デバイス、磁気記憶デバイス、又は上記の任意の適切な組み合わせが含まれる。

以上、具体的な実施例と併せて本開示の基本原理を説明したが、本開示に言及された利点、長所、効果などは、例示に過ぎず、限定的なものではないことを理解されたい。本開示のそれぞれの実施例がそれらの利点、長所、効果を備えなければならないと考えるべきではない。また、上記開示の具体的な詳細は、例示的な機能及び理解を容易にするための機能を果たすためのものにすぎず、限定的なものではなく、上記詳細は、本開示の実現には必ずしも上記の詳細が必要であることを限定するものではない。

本明細書において、各実施例は、逐次的な方法で説明されており、各実施例では、他の実施例との相違点を中心に説明し、各実施例間の同一又は類似の部分は、互に参照すればよい。システムの実施例については、基本的に方法の実施例に対応するため、比較的簡単に説明したが、関連部分は方法の実施例の説明の部分を参照すればよい。

本開示に係るデバイス、装置、機器、システムのブロック図は、単なる例示的なものに過ぎず、必ずしもブロック図に示すような方式で接続、配置、構成されることを要求又は暗示することを意図していない。当業者であれば、これらのデバイス、装置、機器、システムを任意の方法で接続、配置、構成してもよいことを分かるだろう。「含む」、「備える」、「有する」などの用語はオープン型語彙であり、「を含むが、それらに限定されない」ということを意味し、それと互換的に使用可能である。本明細書に使用される「又は」と「及び」という用語は、「及び／又は」という用語を指し、文脈上で明らかに別の意味を示さない限り、それらと互換的に使用可能である。本明細書に使用される「例えば」という用語は、「例えば…であるが、これに限定されない」というフレーズを意味し、それと互換的に使用可能である。

本開示の方法及び装置は、多くの形態で実現可能である。例えば本開示の方法及び装置は、ソフトウェア、ハードウェア、ファームウェア、又はソフトウェア、ハードウェア、ファームウェアの任意の組み合わせによって実現できる。前記方法のステップに用いられる上記の順序は、単に説明するためのものにすぎず、本開示の方法のステップは、特に明記されない限り、上記で具体的に説明した順序に限定されない。また、いくつかの実施例では、本開示は、記録媒体に記録されたプログラムとして実施されてもよく、これらのプログラムは、本開示による方法を実現するための機械可読命令を含む。したがって、本開示は、本開示による方法を実行するためのプログラムを格納した記録媒体も含む。

なお、本開示の装置、機器及び方法において、各部材又はステップは、分解及び／又は再組合せしてもよい。これらの分解及び／又は再組合せは、本開示の等価解決手段と見なすべきである。

開示された態様についての上記の説明は、当業者が本開示を作成又は使用することを可能にするために提供される。当業者にとって、これらの態様に対する様々な修正は明らかであり、本明細書に定義された一般原理は、本開示の範囲から逸脱することなく他の態様に適用され得る。したがって、本開示は、本明細書に示された態様に制限されることを意図しておらず、本明細書に開示された原理及び新規特徴と一致する最も広い範囲に従う。

例示及び説明の目的のために、上記の説明を提示した。さらに、この説明は、本開示の実施例を本明細書に開示されている形態に制限することを意図していない。以上、複数の例示的な態様及び実施例を説明したが、当業者であれば、それらの特定の変形、修正、変更、追加、及びサブセットを認識できるであろう。

Claims (6)

1. データパスの外部に設置されるデータパスの保護回路であって、入力処理回路、出力処理回路及び比較モジュールを含み、
   前記比較モジュールは、前記入力処理回路及び前記出力処理回路のそれぞれに電気的に接続され、
   前記入力処理回路は、予め設定された検証方法にしたがって、入力データフレームに対して検証演算を行って、第１演算結果を得るために用いられ、
   前記出力処理回路は、前記予め設定された検証方法にしたがって、前記入力データフレームに対応する出力データフレームに対して検証演算を行って、第２演算結果を得るために用いられ、
   前記比較モジュールは、前記第１演算結果及び前記第２演算結果を取得し、前記第１演算結果及び前記第２演算結果に基づいて、前記データパスの第１エラー警報信号を生成するために用いられ、
   前記入力処理回路は、第１信号生成モジュール及び第１処理モジュールを含み、
   前記第１信号生成モジュールは、前記第１処理モジュールに電気的に接続され、前記第１処理モジュールは、さらに、前記比較モジュールに電気的に接続され、
   前記第１信号生成モジュールは、入力制御信号に基づいて、前記第１処理モジュールが完全な前記入力データフレームを取得したと決定した場合、入力フレームの末尾信号を生成して、前記入力フレームの末尾信号を送信するために用いられ、
   前記第１処理モジュールは、前記比較モジュールが前記第１演算結果を取得するように、前記第１信号生成モジュールからの前記入力フレームの末尾信号に応じて、前記第１演算結果を得て出力するために用いられる、
   データパスの保護回路。
2. 記憶モジュールをさらに含み、
   前記記憶モジュールは、前記第１信号生成モジュール、前記第１処理モジュール及び前記比較モジュールのそれぞれに電気的に接続され、
   前記第１信号生成モジュールは、さらに、入力制御信号に基づいて、前記第１処理モジュールが完全な前記入力データフレームを取得したと決定した場合、データ書き込み信号を生成して、前記データ書き込み信号を送信するために用いられ、
   前記第１処理モジュールは、前記第１信号生成モジュールからの前記入力フレームの末尾信号に応じて、前記第１演算結果を送信するために用いられ、
   前記記憶モジュールは、前記第１信号生成モジュールからの前記データ書き込み信号に応じて、前記第１処理モジュールからの前記第１演算結果を記憶するために用いられ、前記記憶モジュールはさらに、前記第１演算結果を送信するために用いられる、
   請求項１に記載の保護回路。
3. 前記第１処理モジュールは、第１信号処理ユニット及び第１検証ユニットを含み、
   前記第１信号処理ユニットは、前記第１検証ユニットに電気的に接続され、前記第１検証ユニットは、さらに、前記第１信号生成モジュール及び前記比較モジュールのそれぞれに電気的に接続され、
   前記第１信号処理ユニットは、入力制御信号に基づいて、入力データ信号中の有効信号に対してサンプリング及びパッキング処理を行って、第１サンプリング・パッキング結果を送信するために用いられ、
   前記第１検証ユニットは、前記第１信号処理ユニットからの前記第１サンプリング・パッキング結果に基づいて、前記入力データフレームに対する検証演算の後に得られる前記第１演算結果を生成するために用いられる、
   請求項１に記載の保護回路。
4. 入力制御信号で運ばれる有効データ量と予め設定されたデータ量とが異なる、及び／又は、入力制御信号で運ばれるフレーム伝送占有時間の長さが予め設定された時間の長さを超える場合、前記データパスの第３エラー警報信号を生成するための制御信号検出モジュールをさらに含む、
   請求項１に記載の保護回路。
5. 前記出力処理回路は、第２信号生成モジュール及び第２処理モジュールを含み、
   前記第２信号生成モジュールは、前記第２処理モジュール及び前記比較モジュールのそれぞれに電気的に接続され、前記第２処理モジュールは、さらに、前記比較モジュールに電気的に接続され、
   前記第２信号生成モジュールは、出力制御信号に基づいて、前記第２処理モジュールが完全な前記出力データフレームを取得したと決定した場合、出力フレームの末尾信号及び比較イネーブル信号を生成して、前記出力フレームの末尾信号を送信し、かつ、前記比較イネーブル信号を送信するために用いられ、
   前記第２処理モジュールは、前記第２信号生成モジュールからの前記出力フレームの末尾信号に応じて、前記第２演算結果を得て送信するために用いられ、
   前記比較モジュールは、前記第２信号生成モジュールからの前記比較イネーブル信号に応じて、前記第１演算結果と前記第２演算結果とを比較し、前記第１演算結果と前記第２演算結果とがマッチングしないという比較結果である場合、前記第１エラー警報信号を生成するために用いられる、
   請求項１に記載の保護回路。
6. 記憶モジュールをさらに含み、
   前記記憶モジュールは、前記入力処理回路、前記比較モジュール及び前記第２信号生成モジュールのそれぞれに電気的に接続され、
   前記入力処理回路は、さらに、前記第１演算結果を送信するために用いられ、
   前記記憶モジュールは、前記入力処理回路からの前記第１演算結果を記憶するために用いられ、
   前記第２信号生成モジュールは、さらに、出力制御信号に基づいて、前記第２処理モジュールが完全な前記出力データフレームを取得したと決定した場合、データ読み取り信号を生成して、前記データ読み取り信号を送信するために用いられ、
   前記記憶モジュールは、さらに、前記第２信号生成モジュールからの前記データ読み取り信号に応じて、記憶されている前記第１演算結果を読み取り、読み取られた前記第１演算結果を送信するために用いられる、
   請求項５に記載の保護回路。