JP7354513B2 - Electronic circuit device and its manufacturing method - Google Patents
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Description
本発明は、電子部品が実装基板に実装されている電子回路装置およびその製造方法に関し、特に気密状態の実装が求められる電子部品が実装される電子回路装置およびその製造方法に関する。 The present invention relates to an electronic circuit device in which electronic components are mounted on a mounting board and a method for manufacturing the same, and more particularly to an electronic circuit device in which electronic components that are required to be mounted in an airtight manner are mounted and a method for manufacturing the same.
スマートフォンやタブレット端末などのモバイル機器、腕時計型歩数計などのウェアラブル機器等では高機能化と小型化の要請が強く、これらの機器に搭載される電子回路装置は、小型化が求められている。 There is a strong demand for higher functionality and smaller size in mobile devices such as smartphones and tablet terminals, and wearable devices such as wristwatch-type pedometers, and the electronic circuit devices installed in these devices are required to be smaller.
電子回路装置を小型化するためには、実装基板に電子部品を高密度実装するのが好ましい。高密度実装された電子回路装置は種々提案されている(例えば、特許文献1等)。 In order to downsize electronic circuit devices, it is preferable to mount electronic components on a mounting board with high density. Various high-density-packed electronic circuit devices have been proposed (for example, Patent Document 1).
一方、実装基板に実装される電子部品の中には、大気中の水分等により特性が劣化するため、気密状態で実装する必要があることが知られている。例えば、全固体電池では、ガラス封止により気密状態を保つ方法が採用されている。(特許文献2)。 On the other hand, it is known that some electronic components mounted on a mounting board need to be mounted in an airtight state because their characteristics deteriorate due to moisture in the atmosphere. For example, all-solid-state batteries employ a method of maintaining an airtight state by glass sealing. (Patent Document 2).
従来の高密度実装構造では、電子部品を気密状態に実装することができなかった。そのため、電子部品自体を気密構造とする複雑な製造工程を付加しなければならなかった。本発明はこのような実状に鑑み、簡便に高密度実装、気密構造を実現することができる電子回路装置およびその製造方法を提供することを目的とする。 With conventional high-density mounting structures, electronic components cannot be mounted in an airtight manner. Therefore, it was necessary to add a complicated manufacturing process to make the electronic component itself airtight. SUMMARY OF THE INVENTION In view of these circumstances, an object of the present invention is to provide an electronic circuit device that can easily realize high-density packaging and an airtight structure, and a method for manufacturing the same.
上記目的を達成するため、本願請求項1に係る電子回路装置は、実装面と、該実装面に連続し断面形状をコの字型とする壁部とを備えた実装基板と、該実装基板の前記壁部の間の一方の表面に実装された第1の電子部品と、前記壁部間に充填され、前記第1の電子部品を被覆する封止樹脂と、前記実装基板の他方の表面に実装された第2の電子部品とを備え、前記壁部に直交する側面は、一部あるいは全部が前記封止樹脂で構成されていることと、前記壁部の表面に前記第1の電子部品あるいは前記第2の電子部品に接続する電極が露出していることと、前記第1の電子部品が全固体電池であることを特徴とする。
In order to achieve the above object, an electronic circuit device according to
本願請求項2に係る電子回路装置の製造方法は、列状に配置される電子回路装置の形成予定領域に凹部を備えた集合基板を用意する工程と、前記集合基板上に外部引出電極と該外部引出電極に連続する内部配線を形成する工程と、前記凹部の底部に、第1の電子部品を実装する工程と、前記凹部内に樹脂を注入し、前記第1の電子部品を樹脂封止する工程と、前記集合基板の他方の面に、第2の電子部品を実装する工程と、樹脂封止された前記第1の電子部品および前記第2の電子部品を含み、前記集合基板の表面に外部引出電極が露出する各電子回路装置に個片化する工程と、を含むことを特徴とする。
A method for manufacturing an electronic circuit device according to
本願請求項3に係る電子回路装置の製造方法は、請求項2記載の電子回路装置の製造方法において、前記集合基板に凹部を形成する際、前記凹部の壁部に直交し、一部に切欠を有する別の壁部を形成する工程と、前記個片化の際、前記別の壁部の一部あるいは全部を切削除去する工程と、を含むことを特徴とする。
In the method for manufacturing an electronic circuit device according to
本願請求項4に係る電子回路装置の製造方法は、請求項2または3いずれか記載の電子回路装置の製造方法において、前記第1の電子部品として全固体電池を実装することを特徴とする。
A method of manufacturing an electronic circuit device according to
本発明は、高密度実装が可能で、かつ電子部品を簡便に気密状態で実装することができる電子回路装置を提供することができ、また複雑な製造工程を経ることなく簡便に製造することができる。 INDUSTRIAL APPLICABILITY The present invention can provide an electronic circuit device that is capable of high-density mounting and that allows electronic components to be easily and airtightly mounted, and that can be easily manufactured without going through a complicated manufacturing process. can.
特に本発明は、気密状態の実装が要求される電子部品、例えば全固体電池を封止樹脂による封止を行うのみで気密性良く封止でき、非常に簡便に全固体電池を備えた電子回路装置を形成することが可能となる。一方気密状態の実装が要求されない電子部品は、実装基板上に露出して実装された構造とすることができ、部品の交換等が容易となるという利点がある。 In particular, the present invention enables electronic components that require airtight mounting, such as all-solid-state batteries, to be hermetically sealed by simply sealing them with a sealing resin, making it possible to very easily and easily encapsulate electronic circuits equipped with all-solid-state batteries. It becomes possible to form a device. On the other hand, electronic components that do not require airtight mounting can be mounted exposed on the mounting board, which has the advantage that parts can be easily replaced.
本発明は、実装基板に連続する壁部を備える構成とすることで、外部引出電極の形成が容易となる。さらに、電子回路装置が実装されるマザー基板等と熱膨張率が等しく、あるいは近い材料を選択することで、信頼性の向上も図ることが可能となる。 In the present invention, the external lead electrode can be easily formed by providing a wall portion that is continuous with the mounting board. Furthermore, by selecting a material that has a coefficient of thermal expansion equal to or close to that of the motherboard or the like on which the electronic circuit device is mounted, reliability can also be improved.
また両端の壁部に直交する位置に、一方から他方側に突出する別の壁部を形成する構成とすると、凹部間の間隔を狭くすることができるので集合基板上に多数の電子回路装置を形成することが可能となる。この別の壁部は、一部に切り欠きを有するため、製造工程で注入される樹脂厚のばらつきを抑えることができるという利点がある。 Furthermore, if another wall part is formed that protrudes from one side to the other side at a position perpendicular to the wall parts at both ends, the interval between the recesses can be narrowed, so that a large number of electronic circuit devices can be mounted on the collective board. It becomes possible to form. Since this separate wall part has a notch in part, it has the advantage of being able to suppress variations in the thickness of the resin injected during the manufacturing process.
本発明の電子回路装置およびその製造方法は、気密状態の実装が求められる電子部品と、気密状態の実装が求められない電子部品とを高密度に実装することができる発明に関する。以下、本発明の実施例について詳細に説明する。 The electronic circuit device and the manufacturing method thereof of the present invention relate to an invention that allows electronic components that are required to be mounted in an airtight state and electronic components that are not required to be mounted in an airtight state to be mounted with high density. Examples of the present invention will be described in detail below.
本発明の第1の実施例について、その製造工程に従い説明する。まず、エポキシ樹脂等からなる集合基板1を用意する。この種の集合基板1は、通常の半導体装置の製造工程で使用されている樹脂基板(有機基板)を使用することができる。集合基板は、完成する電子回路装置が実装されるマザー基板の材質に応じて、適宜選択するのが好ましく、例えば熱膨張率の等しいあるいは近い材質を選択すると、実装信頼性の向上を図ることができる。
A first embodiment of the present invention will be described according to its manufacturing process. First, a
図1は、凹部2が形成された集合基板の説明図で、図1(a)に断面図を、図1(b)に平面図を示している。図1には、後述する工程に従い、4個の電子回路装置が形成されるものとする。図1に示す凹部2を備えた集合基板1は、絶縁層の両面に導電膜を備えた両面板1aと、凹部2に相当する貫通孔を備えた枠板1bとを貼り合せ、周知の方法により貫通孔4、電極5、電極5に接続する図示しない内部配線を形成して用意することができる。
FIG. 1 is an explanatory diagram of a collective substrate in which a
図1(a)に示すように、凹部2の両端には、壁部3が形成される。貫通孔4は、円形あるいは横長の楕円形状とする。貫通孔4の径は200μm程度、凹部2と貫通孔4との間に集合基板1(壁部3の厚さ)は0.5mm~1.0mm程度とすると、集合基板1の強度を保つことができる。
As shown in FIG. 1(a),
次に図2に示すように、凹部2内に電子部品6aを実装する。凹部2の底面には、電子部品6aに接続する配線が形成されており、電子部品6aは所望の方法により接続される。このとき凹部2内には、隣接する電子回路装置の形成予定領域との間に壁部等が無いので、実装のために凹部2の底部への接着部材の滴下や、電子部品の搬送を容易に行うことができる。特に接着部材を滴下する際、ディスペンサーを用いて半田を凹部2の底面に塗布する方法を採用することで、深い凹部2の底面に、確実にはんだ等の接着部材を供給することができ、実装信頼性が確保でき好ましい。また、凹部2内に複数の電子部品を容易に実装することが可能となる。
Next, as shown in FIG. 2, the
凹部2内に実装される電子部品6aは、実装される電子部品のうち、気密状態の実装が求められるものを選択することができる。例えば、全固体電池を選択することができる。一般的に全固体電池は、大気中の水分等により特性が劣化してしまう。そこで、このような特性劣化を防止するため、図3に示すようにエポキシ樹脂等の封止樹脂7を凹部2内に充填して樹脂封止する。十分な気密性を保つためは、電子部品6aの表面を封止樹脂7で十分に覆う必要がある。そのため凹部2の深さ(換言すると、壁部3の高さ)は、集合基板1上に実装される電子部品6aの高さより深く(高く)するのが好ましい。具体的には、電子部品5aの高さが0.6mmのとき、凹部2の壁部3の高さを0.8mm程度とすることで、電子部品6aを凹部2の底部に実装するための接着部材の高さ等のばらつき等が発生しても、水分の侵入等のない気密構造を形成することができる。気密構造の形成するためさらに厚く封止樹脂7を形成する必要がある場合には、その厚さや、電子部品6aの高さ等を考慮し、枠板1bの厚さを適宜選択すればよい。
The
なお図2では、気密状態の実装が求められる電子部品6aを2個実装した例を示しているが、気密状態の実装が求められない別の種類の電子部品を組み合わせて実装しても良い。
Although FIG. 2 shows an example in which two
このように集合基板1の表面は封止樹脂7により平坦化される(図3)。使用される封止樹脂7は、ディスペンサーから滴下して平坦化できるように、粘度100Pa・s程度以下が好ましい。また耐薬品性、耐リフロー性等を考慮し、例えばエポキシ系樹脂を選択するのが好ましい。二酸化シリコン等のフィラーの充填量を多くし(例えば60wt%程度以上)、吸水量を0.3wt%程度以下の樹脂を用いることで、気密状態の実装が可能となる。電子部品6aを実装する際、半田を用いた場合にはフラックス除去の工程を追加しても良い。なお、この平坦化は、実装される電子部品のいずれも気密封止が求められない場合であっても、後述する製造工程を進めるために好適となる。
In this way, the surface of the
その後、集合基板1の裏面(他方の面に相当)に別の電子部品を実装する。図4に示す例では、3個の電子部品6b、6c、6dを実装している。
After that, another electronic component is mounted on the back surface (corresponding to the other surface) of the
図4に示すようにこの種の電子回路装置では、集合基板1上に様々な大きさの電子部品が実装される。このような場合、裏面側の電子部品6b~6dを実装した後、表面側の電子部品6aを実装して樹脂封止する工程とすると、電子部品6b~6dが脱落する可能性がある。そのため、上述のように表面側に電子部品6aを実装し、樹脂封止する工程を先に行うのが好ましい。当然ながら、電子部品の脱落等が無ければ、工程を逆にすることは可能である。
As shown in FIG. 4, in this type of electronic circuit device, electronic components of various sizes are mounted on a
次に、集合基板を個片化する。この個片化は、電極5が電子回路装置の外周に露出するように行う。具体的には図5に示すように、貫通孔4の中央を通る格子状に、例えばダイシングソーを走行させて行う。その結果、図面左右方向の両端には、集合基板1の壁部3が残ることになる。一方図面上下方向の両端には、凹部2の側壁は残らない。図5に示す例では、4個の電子回路装置に個片化される。一般的に個片化工程は、集合基板を固定するためのシートに貼り付けて行うため、集合基板の裏面が平坦化されていることで、集合基板あるいは個片化後の電子回路装置をシートに確実に接着できる点で好ましい。また壁部3と電子部品6aとの隙間に切削屑が入り込むこともないので、集合基板の裏面が平坦化されていることは好ましい。
Next, the assembled substrate is separated into individual pieces. This singulation is performed so that the
図6は、個片化後の電子回路装置の斜視図を示す。図6に示すように個片化された電子回路装置は、集合基板が個片化された実装基板8上に複数の電子部品6b、6c、6dが実装され、実装基板8の逆の面には、電子部品6aが封止樹脂7で被覆されている。また壁部3には、電子回路装置の外部引出用の電極5(外部引出電極に相当)が露出している。
FIG. 6 shows a perspective view of the electronic circuit device after being singulated. As shown in FIG. 6, in the singulated electronic circuit device, a plurality of
本実施例の電子回路装置は、複数の電子部品6a~6dを高密度実装することができ、さらに電子部品6aが、気密状態の実装が求められる場合には、封止樹脂によって被覆することで気密封止することが可能となっている。また、電極5が電子回路装置の側壁に露出する構造となっているため、電子回路装置を実装する際、はんだ等の接続部材が電極5の側壁を這い上がり、確実な接続を形成するができ、目視検査等も容易となる。
The electronic circuit device of this embodiment can mount a plurality of
次に第2の実施例について説明する。上記第1の実施例では、電子回路装置の側壁に電極5が露出する構造としたが、電極構造を変更することも可能である。
Next, a second embodiment will be described. Although the first embodiment has a structure in which the
具体的には、集合基板1の形状を変更する。図7は、第1の実施例で説明した図1に相当する図である。図1と比較して電極5aの形状が異なることがわかる。本実施例では凹部2が形成された集合基板1に、例えばドリル加工またはルーター加工等により円形の貫通孔4aを形成する。本実施例の貫通孔4aは、第1の実施例で説明した貫通孔4より小さい径となるように形成する。その後、導電性ペースト等を充填させ、集合基板の表面および裏面に表面電極を形成することで、電極5aを形成することができる。
Specifically, the shape of the
以下、上記第1の実施例同様、凹部2内に電子部品6aを実装し、封止樹脂7を凹部2内に充填して樹脂封止する。その後、集合基板1の裏面(図8の表面側)に別の電子部品6b、6c、6dを実装し、個片化する。この個片化工程は、図8に示す貫通孔5aのない位置を通る格子状に、例えばダイシングソーを走行させて行う。
Thereafter, as in the first embodiment, the
その結果、図9に斜視図を示す電子回路装置が完成する。このような形状の電子回路装置では、電極5aが外周部に露出せず、実装基板8の表面および裏面のみに露出するため、より高密度実装が可能となる。
As a result, an electronic circuit device whose perspective view is shown in FIG. 9 is completed. In the electronic circuit device having such a shape, the
次に第3の実施例について説明する。上記第1および第2の実施例では、集合基板1に形成される凹部2は、縦長の形状となっている。ここで、集合基板1から形成できる電子回路装置の数を多くするため、隣接する凹部2間の間隔を狭くすると、凹部2間に残る壁部を構成する集合基板1の一部が変形してしまうおそれがある。そこで、凹部2の形状を変形することも可能である。
Next, a third embodiment will be described. In the first and second embodiments described above, the
図10は、上記第1の実施例で説明した図1に相当する図である。図10に示すように、凹部2内に突出部9(別の壁部に相当)を形成することができる。この突出部9は、個片化の際、切断領域となる位置に配置することで、電子部品を実装する領域に影響を及ぼすことはない。なお、突出部9は一方の壁部3から延出し、その先端は対向する壁部3との間に隙間を設けている。これは、例えば図3で説明したように凹部2内に封止樹脂を滴下した際、凹部2内の封止樹脂の厚さを均一にするためである。
FIG. 10 is a diagram corresponding to FIG. 1 described in the first embodiment. As shown in FIG. 10, a protrusion 9 (corresponding to another wall) can be formed within the
この突出部9の形成は、凹部2を形成する際、例えばルーター加工により突出部9を残すように形成すれば良い。
The
以下、上記第1の実施例同様、凹部2内に電子部品6aを実装し、封止樹脂7を凹部2内に充填して封止する。その後、集合基板1の裏面(図7の表面側)に別の電子部品6b、6c、6dを実装し個片化する。この個片化は、図5に示す貫通孔5の中央と通る格子状に、例えばダイシングソーを走行させて行う。
Thereafter, as in the first embodiment, the
突出部9の幅をダイシングソーにより切削除去される幅より狭い幅とすると、個片化の際、突出部9が切削除去され、図6に示す形状の電子回路装置が完成する。この場合、実装基板は実装面に連続したコの字型の壁面を有し、これに直交する側面は実装面に連続する壁部の全部が切り欠かれた構造となる。また突出部9の幅を切削除去される幅より広くし、突出部9の一部を残す形状とすると、図11に示す形状の電子回路装置が完成する。この場合、実装基板は実装面に連続したコの字型の側面を有し、これに直交する側面は、実装面に連続する壁部の一部が切り欠かれた構造となる。
If the width of the
この突出部9の配置は、図10に示す場合に限定されない。例えば、凹部2の長さが長く、突出部9を複数形成する必要がある場合には、一方の壁部から対向する壁部に向かって突出する配置としたり、両方の壁部から交互に対向する壁部に向かって突出する配置(千鳥構造)としたり、隣接する凹部内に配置される突出部の配置を変えたり、種々変更可能である。特に個片化の際、突出部9を全て除去する場合には、完成される電子回路装置に突出部9が残らないため、種々変更可能である。一方、突出部9の一部が残る場合には、完成される電子回路装置のどの位置に突出部9が残るかを考慮し、突出部9の配置を決定する必要がある。
The arrangement of the
この突出部9の高さも適宜変更可能で、凹部2内への接着部材の滴下を行う際にディスペンサーに接触する等の不具合があれば、突出部9の高さを低くすることも可能である。この突出部9の幅を切削除去される幅より狭い幅とすると、個片化の際、突出部9が切削除去され、図6に示す形状の電子回路装置を完成させることが可能である。この場合、実装基板は実装面に連続したコの字型の壁面を有し、これに直交する側面は実装面に連続する壁部の全部が切り欠かれた構造となる。また突出部9の幅を切削除去される幅より広くし、突出部9の一部を残す形状とすると、図12に示す形状の電子回路装置が完成する。この場合、実装基板は実装面に連続したコの字型の側面を有し、これに直交する側面は、実装面に連続する壁部の一部が切り欠かれた構造となる。
The height of the
以上の説明は、上記第1の実施例で説明した電子回路装置の変更例として説明したが、電極構造の異なる上記第2の実施例に適用可能であることは言うまでもない。 The above description has been made as a modification of the electronic circuit device described in the first embodiment, but it goes without saying that it is applicable to the second embodiment, which has a different electrode structure.
以上本発明の実施例について説明したが、本発明はこれら実施例に限定されるものでないことは言うまでもない。例えば、電極5の形状は、電子回路装置が実装されるマザー基板との接続構造に応じて適宜変更可能である。また電極5の数は、電子回路装置上に実装される電子部品や回路構成に応じて適宜変更可能である。また電子回路装置に実装される電子部品の数も適宜変更可能である。
Although the embodiments of the present invention have been described above, it goes without saying that the present invention is not limited to these embodiments. For example, the shape of the
1: 集合基板、1a:両面板、1b:枠板、2:凹部、3:壁部、4、4a:貫通孔、5:電極、6a~6d:電子部品、7:封止樹脂、8:実装基板、9:突出部 1: Collective board, 1a: Double-sided board, 1b: Frame board, 2: Recess, 3: Wall, 4, 4a: Through hole, 5: Electrode, 6a to 6d: Electronic component, 7: Sealing resin, 8: Mounting board, 9: Protrusion part
Claims (4)
該実装基板の前記壁部の間の一方の表面に実装された第1の電子部品と、
前記壁部間に充填され、前記第1の電子部品を被覆する封止樹脂と、
前記実装基板の他方の表面に実装された第2の電子部品とを備え、
前記壁部に直交する側面は、一部あるいは全部が前記封止樹脂で構成されていることと、
前記壁部の表面に前記第1の電子部品あるいは前記第2の電子部品に接続する電極が露出していることと、
前記第1の電子部品が全固体電池であることを特徴とする電子回路装置。 a mounting board comprising a mounting surface and a wall portion continuous with the mounting surface and having a U-shaped cross section;
a first electronic component mounted on one surface between the walls of the mounting board;
a sealing resin filled between the wall portions and covering the first electronic component;
a second electronic component mounted on the other surface of the mounting board,
A side surface perpendicular to the wall portion is partially or entirely composed of the sealing resin;
an electrode connected to the first electronic component or the second electronic component is exposed on the surface of the wall ;
An electronic circuit device , wherein the first electronic component is an all-solid-state battery .
前記集合基板上に外部引出電極と該外部引出電極に連続する内部配線を形成する工程と、forming an external lead electrode and an internal wiring continuous to the external lead electrode on the collective substrate;
前記凹部の底部に、第1の電子部品を実装する工程と、mounting a first electronic component on the bottom of the recess;
前記凹部内に樹脂を注入し、前記第1の電子部品を樹脂封止する工程と、Injecting a resin into the recess and sealing the first electronic component with the resin;
前記集合基板の他方の面に、第2の電子部品を実装する工程と、mounting a second electronic component on the other surface of the collective substrate;
樹脂封止された前記第1の電子部品および前記第2の電子部品を含み、前記集合基板の表面に外部引出電極が露出する各電子回路装置に個片化する工程と、を含むことを特徴とする電子回路装置の製造方法。A step of separating into individual electronic circuit devices each including the first electronic component and the second electronic component sealed with resin and having external extraction electrodes exposed on the surface of the collective substrate. A method for manufacturing an electronic circuit device.
前記集合基板に凹部を形成する際、前記凹部の壁部に直交し、一部に切欠を有する別の壁部を形成する工程と、
前記個片化の際、前記別の壁部の一部あるいは全部を切削除去する工程と、を含むことを特徴とする電子回路装置の製造方法。 The method for manufacturing an electronic circuit device according to claim 2,
When forming a recess in the collective substrate, forming another wall that is perpendicular to the wall of the recess and has a notch in a part;
A method for manufacturing an electronic circuit device, comprising the step of cutting and removing part or all of the other wall portion during the individualization .
前記第1の電子部品として全固体電池を実装することを特徴とする電子回路装置の製造方法。 The method for manufacturing an electronic circuit device according to claim 2 or 3 ,
A method of manufacturing an electronic circuit device, characterized in that an all-solid-state battery is mounted as the first electronic component .
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2019071980A JP7354513B2 (en) | 2019-04-04 | 2019-04-04 | Electronic circuit device and its manufacturing method |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
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Publications (2)
Publication Number | Publication Date |
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JP2020170803A JP2020170803A (en) | 2020-10-15 |
JP7354513B2 true JP7354513B2 (en) | 2023-10-03 |
Family
ID=72746828
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
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Country Status (1)
Country | Link |
---|---|
JP (1) | JP7354513B2 (en) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP7332094B2 (en) * | 2019-05-29 | 2023-08-23 | 日清紡マイクロデバイス株式会社 | electronic circuit device |
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JP2020170803A (en) | 2020-10-15 |
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Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
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|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20230228 |
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A131 | Notification of reasons for refusal |
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A521 | Request for written amendment filed |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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R150 | Certificate of patent or registration of utility model |
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