JP7250375B2 - 駆動制御電気回路、駆動制御チップ、集積封止デバイス、表示システム及びスパース駆動の方法 - Google Patents
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Description
1≦M1<N1で、M1とN1ともに整数である。
図1を参照し、図1は、本発明実施例に係る駆動制御電気回路の電気回路構造模式図であり、駆動制御電気回路は、データ入力端SDIと、クロック入力端DCLKと、デコード及び制御ユニット101と、M個のデコードゲーティングユニット102と、N+1個の駆動源103と、N+1個の駆動シグナル出力端(OUT0、OUT1、…OUTN)とを含み、例示的に、Mの数は、1から4の間の整数でもよく、Nは、0から111の間の整数でもよい。
駆動制御電気回路がプリセット情報に基づいてM1個の駆動シグナル出力端を駆動して駆動シグナルを出力させて、対応するM1個の発光構造が発光するように制御するステップ71、を含み、
1≦M1<N1で、M1とN1ともに整数である。
密集表示デバイスは、長期間の動作時に放熱などの問題による輝度の低下が観覧効果に大きく影響するが、表示デバイスの輝度の低下の程度に応じて、駆動制御電気回路の電流ゲインを1より大きい値に設定することで、表示輝度を向上させ、使用寿命を延ばすことができる。
且つ密集表示デバイスは、暗いまたは明るい環境にある場合、電流ゲインを1より大きくまたは1より小さくなるようにそれぞれ調整し、最適の観覧効果を達成する。
Claims (15)
- データ入力端(SDI)と、クロック入力端(DCLK)と、デコード及び制御ユニット(101)と、デコードゲーティングユニット(102)と、少なくとも2つの駆動源(103)とを含み、
前記デコード及び制御ユニット(101)は、第1入力端(C1)と、第2入力端(C2)と、制御出力端と、アドレス出力端とを含み、前記デコード及び制御ユニット(101)の第1入力端(C1)は、前記データ入力端(SDI)に電気的に接続され、前記デコード及び制御ユニット(101)の第2入力端(C2)は、前記クロック入力端(DCLK)に電気的に接続され、
前記デコードゲーティングユニット(102)は、アドレス入力端(A2)と、制御入力端(A1)と、少なくとも2つの出力端とを含み、前記デコードゲーティングユニット(102)の制御入力端(A1)は、前記制御出力端に電気的に接続され、前記デコードゲーティングユニット(102)のアドレス入力端(A2)は、前記アドレス出力端に電気的に接続され、
前記少なくとも2つの駆動源(103)は、前記デコードゲーティングユニットの少なくとも2つの出力端に1対1で電気的に接続され、各前記駆動源(103)は、当該駆動源(103)の第1端のシグナルに基づいて当該駆動源(103)の第2端から駆動シグナルを出力するように構成され、
前記駆動源(103)の前記第2端からの前記駆動シグナルは、発光ユニットを駆動して発光させるために用いられるものであり、
前記データ入力端(SDI)は、出力する画像情報および人の両眼に関連する位置情報の解析情報を入力するために使用され、
前記デコードゲーティングユニット(102)の前記制御入力端(A1)の入力信号は、前記デコードゲーティングユニット(102)の開始を制御する開始制御信号であり、
前記デコードゲーティングユニット(102)の前記アドレス入力端(A2)の入力信号は、前記人の両眼に関連する位置情報の前記解析情報に基づいて駆動される前記発光ユニットのアドレス情報である、
駆動制御電気回路。 - 前記デコードゲーティングユニット(102)は、デコードバッファメモリ(1021)と、少なくとも2つの第1のスイッチと、1つの第2のスイッチとを含み、
前記デコードバッファメモリ(1021)の第1入力端は、前記デコードゲーティングユニット(102)のアドレス入力端(A2)に電気的に接続され、前記デコードバッファメモリ(1021)の第2入力端は、前記デコードゲーティングユニット(102)の制御入力端(A1)に電気的に接続され、前記デコードバッファメモリ(1021)の第1出力端は、前記少なくとも2つの第1のスイッチのオンまたはオフを制御するように構成され、前記デコードバッファメモリ(1021)の第2出力端は、前記第2のスイッチの第1端にいずれも電気的に接続され、第2のスイッチの第2端は、第1のスイッチの第1端に電気的に接続され、前記少なくとも2つの第1のスイッチの第2端は、前記デコードゲーティングユニット(102)の前記少なくとも2つの出力端に1対1で対応して電気的に接続される、
ことを特徴とする請求項1に記載の駆動制御電気回路。 - 制御指令端(LE)と、カウンタ(202)と、同期制御器(203)とを更に含み、前記デコードゲーティングユニット(102)は、比較器(1022)を更に含み、
前記カウンタ(202)の第1入力端は、前記クロック入力端(DCLK)に電気的に接続され、前記カウンタ(202)の第2入力端は、前記同期制御器(203)の第1出力端に電気的に接続され、前記カウンタ(202)の出力端は、前記比較器(1022)の第1入力端に電気的に接続され、
前記同期制御器(203)の第1入力端は、前記制御指令端(LE)に電気的に接続され、
前記比較器(1022)の第2入力端は、前記デコードバッファメモリ(1021)の第2出力端に電気的に接続され、前記比較器(1022)の出力端は、各前記スイッチの第1端にいずれも電気的に接続される、
ことを特徴とする請求項2に記載の駆動制御電気回路。 - ブロックセレクト端(DR)と、ブロック電流調節ユニット(301)と、ブロック電流調節端(R)と、状態バッファ(302)とを更に含み、
前記ブロック電流調節ユニット(301)の第1入力端は、前記ブロック電流調節端(R)に電気的に接続され、前記ブロック電流調節ユニット(301)の第2入力端は、前記状態バッファ(302)の第1出力端に電気的に接続され、前記ブロック電流調節ユニット(301)の出力端は、各前記駆動源(103)の制御端にいずれも電気的に接続され、
前記状態バッファ(302)の入力端は、前記同期制御器(203)の第2出力端に電気的に接続され、前記状態バッファ(302)の第2出力端は、前記デコード及び制御ユニット(101)の第3入力端に電気的に接続され、
前記同期制御器(203)の第2入力端は、前記ブロックセレクト端(DR)に電気的に接続される、
ことを特徴とする請求項3に記載の駆動制御電気回路。 - 第1シュミットトリガ(401)と、第2シュミットトリガ(402)と、第3シュミットトリガ(403)と、第4シュミットトリガ(404)とを更に含み、
前記カウンタ(202)の第1入力端は、前記第1シュミットトリガ(401)によって前記クロック入力端(DCLK)に電気的に接続され、前記カウンタ(202)の第1入力端は、前記第1シュミットトリガ(401)の出力端に電気的に接続され、前記クロック入力端(DCLK)は、前記第1シュミットトリガ(401)の入力端に電気的に接続され、
前記同期制御器(203)の第1入力端は、前記第2シュミットトリガ(402)によって前記制御指令端(LE)に電気的に接続され、前記同期制御器(203)の第1入力端は、前記第2シュミットトリガ(402)の出力端に電気的に接続され、前記制御指令端(LE)は、前記第2シュミットトリガ(402)の入力端に電気的に接続され、
前記デコード及び制御ユニット(101)の第1入力端は、前記第3シュミットトリガ(403)によって前記データ入力端(SDI)に電気的に接続され、前記デコード及び制御ユニット(101)の第1入力端(C1)は、前記第3シュミットトリガ(403)の出力端に電気的に接続され、前記データ入力端(SDI)は、前記第3シュミットトリガ(403)の入力端に電気的に接続され、
前記デコード及び制御ユニット(101)の第2入力端(C2)は、前記第4シュミットトリガ(404)によって前記クロック入力端(DCLK)に電気的に接続され、前記デコード及び制御ユニット(101)の第2入力端(C2)は、前記第4シュミットトリガ(404)の出力端に電気的に接続され、前記クロック入力端(DCLK)は、前記第4シュミットトリガ(404)の入力端に電気的に接続される、
ことを特徴とする請求項4に記載の駆動制御電気回路。 - 前記デコード及び制御ユニット(101)の制御出力端は、少なくとも2つが設けられ、前記デコード及び制御ユニット(101)のアドレス出力端は、少なくとも2つが設けられ、前記少なくとも2つの制御出力端は、前記少なくとも2つのアドレス出力端に1対1で対応し、
前記デコードゲーティングユニット(102)は、少なくとも2つが設けられ、前記少なくとも2つのデコードゲーティングユニット(102)は、前記少なくとも2つの制御出力端に1対1で対応する、
ことを特徴とする請求項1に記載の駆動制御電気回路。 - スパース駆動の方法であって、
請求項1~6のいずれか1項に記載の駆動制御電気回路(11)に適用され、前記駆動制御電気回路(11)のN1個の駆動シグナル出力端は、N1個の発光構造に1対1で対応して電気的に接続され、
前記スパース駆動の方法は、前記駆動制御電気回路(11)がプリセット情報に基づいてM1個の駆動シグナル出力端を駆動して駆動シグナルを出力させて、対応するM1個の前記発光構造が発光するように制御することを含み、
1≦M1<N1で、M1とN1ともに整数である、
スパース駆動の方法。 - 前記プリセット情報は、人の両眼の位置情報を含む、
ことを特徴とする請求項7に記載のスパース駆動の方法。 - 少なくとも2つのユニットブロックと、クロック端(DCLK_1)と、データ端(SDI_1)と、少なくとも2つの駆動出力端と、デコード及びバッファメモリ(501)と、行ゲーティング電気回路(505)と、列ゲーティング電気回路(506)と、比較制御器(502)とを含み、各前記ユニットブロックとも、請求項3~5のいずれか1項に記載の駆動制御電気回路(11)を含み、前記少なくとも2つのユニットブロックは、M2行N2列のように配列され、M2とN2ともに正整数であり、
前記デコード及びバッファメモリ(501)の第1入力端は、前記クロック端(DCLK_1)に電気的に接続され、前記デコード及びバッファメモリ(501)の第2入力端は、前記データ端(SDI_1)に電気的に接続され、前記デコード及びバッファメモリ(501)の第1出力端は、前記行ゲーティング電気回路(505)の入力端に電気的に接続され、前記デコード及びバッファメモリ(501)の第2出力端は、前記列ゲーティング電気回路(506)の入力端に電気的に接続され、前記行ゲーティング電気回路(505)のM2個の出力端は、前記M2行の駆動制御電気回路(11)のブロックセレクト端に対応して電気的に接続され、前記列ゲーティング電気回路(506)のN2個の出力端は、前記N2列の駆動制御電気回路(11)のデータ入力端(SDI)に対応して電気的に接続され、
前記クロック端(DCLK_1)は、前記駆動制御電気回路(11)のクロック入力端(DCLK)に電気的に接続され、
前記比較制御器(502)の第1入力端は、前記クロック端(DCLK_1)に電気的に接続され、前記比較制御器(502)の第2入力端は、前記データ端(SDI_1)に電気的に接続され、前記比較制御器(502)の出力端は、各前記駆動制御電気回路(11)の制御指令端にいずれも電気的に接続され、前記比較制御器(502)は、入力されるクロックシグナル及びデータシグナルに基づいて制御指令を各前記駆動制御電気回路(11)に出力するように構成され、
前記少なくとも2つの駆動源の第2端は、前記少なくとも2つの駆動出力端に1対1で対応して電気的に接続される、
駆動制御チップ。 - 直列並列駆動ゲーティング電気回路(801)を更に含み、前記直列並列駆動ゲーティング電気回路(801)は、1つの第1並列データ入力端(SDI_31)と、N2-1個の第2並列データ入力端(SDI_3)と、N2-1個のANDゲート(802)と、N2-1個の並列ゲーティング端と、N2個の並列データ出力端とを含み、前記N2-1個のANDゲート(802)の第1入力端は、それぞれ前記N2-1個の第2並列データ入力端(SDI_3)に電気的に接続され、前記N2-1個のANDゲート(802)の第2入力端は、それぞれ前記N2-1個の並列ゲーティング端に電気的に接続され、前記列ゲーティング電気回路のN2個の出力端は、1つの第1出力端とN2-1個の第2出力端とを含み、前記第1並列データ入力端は、前記列ゲーティング電気回路の第1出力端に電気的に接続され、前記N2-1個の並列ゲーティング端は、それぞれ前記列ゲーティング電気回路のN2-1個の第2出力端に電気的に接続され、前記N2個の並列データ出力端は、N2列の前記ユニットブロックに対応し、前記第1並列データ入力端と前記N2-1個の第2並列データ入力端とは、並列データを入力するために用いられ、前記N2-1個のANDゲートの出力端は、それぞれ前記N2個の並列データ出力端におけるN2-1個の並列データ出力端に対応し、前記第1並列データ入力端から入力される並列データは、前記デコード及びバッファメモリによって出力され、且つ前記第1並列データ入力端と前記N2-1個のANDゲートの第2入力端とは、直列データ入力端に多重利用され、M2とN2ともに、2以上の整数である、
ことを特徴とする請求項9に記載の駆動制御チップ。 - 第5シュミットトリガ(503)と第6シュミットトリガ(504)とをさらに含み、
前記デコード及びバッファメモリ(501)の第1入力端は、前記第5シュミットトリガ(503)によって前記クロック端(DCLK_1)に電気的に接続され、前記デコード及びバッファメモリ(501)の第1入力端は、前記第5シュミットトリガ(503)の出力端に電気的に接続され、前記クロック端(DCLK_1)は、前記第5シュミットトリガ(503)の入力端に電気的に接続され、
前記デコード及びバッファメモリ(501)の第2入力端は、前記第6シュミットトリガ(504)によって前記データ端(SDI_1)に電気的に接続され、前記デコード及びバッファメモリ(501)の第2入力端は、前記第6シュミットトリガ(504)の出力端に電気的に接続され、前記データ端(SDI_1)は、前記第6シュミットトリガ(504)の入力端に電気的に接続される、
ことを特徴とする請求項9に記載の駆動制御チップ。 - 集積封止デバイスであって、
請求項9~11のいずれか1項に記載の駆動制御チップ(51)と、集積データ入力端(SDI_2)と、集積クロック入力端(DCLK_2)と、電源端(VDD)と、接地端(GND)と、密集表示デバイス(52)とを含み、
前記集積データ入力端(SDI_2)は、前記駆動制御チップ(51)のデータ端(SDI_1)に電気的に接続され、前記集積クロック入力端(DCLK_2)は、前記駆動制御チップ(51)のクロック端(DCLK_1)に電気的に接続され、前記電源端(VDD)は、前記集積封止デバイス(601)に電力を提供するように構成され、前記接地端(GND)は、接地するように構成され、
前記密集表示デバイス(52)は、少なくとも2つの発光ユニットを含み、前記駆動制御チップ(51)の駆動出力端は、前記発光ユニットに1対1で対応して電気的に接続される、
集積封止デバイス。 - 前記集積データ入力端の入力シグナルのデータフォーマットは、フレーム同期ビットと、駆動電気回路数量ビットと、M3個の駆動電気回路アドレスビットと、M3個の起動ビットと、M3個の電流ゲインビットと、M3個のブロック内視点数ビットと、M3×N3個の駆動制御電気回路内アドレスビットと、M3×N3個のグレースケールデータビットを含み、M3は、1から64の範囲の整数であり、N3は、1から4の範囲の整数である、
ことを特徴とする請求項12に記載の集積封止デバイス。 - 前記発光ユニットは、MicroLED(1016)を含む、
ことを特徴とする請求項12に記載の集積封止デバイス。 - 少なくとも2つの請求項12に記載の集積封止デバイス(601)と、フィードバックモジュール(603)と、処理モジュール(602)とを含み、
前記処理モジュール(602)は、前記少なくとも2つの集積封止デバイス(601)の集積データ入力端(SDI_2)及び集積クロック入力端(DCLK_2)に電気的に接続され、前記処理モジュール(602)は、前記フィードバックモジュール(603)に電気的に接続され、
前記処理モジュール(602)は、サーバ(604)から送信されたプリセット情報を受信し、前記フィードバックモジュール(603)のフィードバック情報に基づいて前記プリセット情報を解析して前記集積封止デバイス(601)に送信し、前記集積封止デバイス(601)を駆動して表示させるように構成され、前記フィードバックモジュール(603)は、人の目の位置情報をトラッキングし、人の目の位置情報を前記処理モジュール(602)にフィードバックするように構成される、
表示システム。
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