JP7136888B2 - 例外マスク更新命令後のトランザクションの非アボート処理の許可 - Google Patents
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- 238000012545 processing Methods 0.000 title claims description 137
- 238000011084 recovery Methods 0.000 claims description 34
- 230000004044 response Effects 0.000 claims description 34
- 238000001514 detection method Methods 0.000 claims description 13
- 238000004590 computer program Methods 0.000 claims description 12
- 238000000034 method Methods 0.000 claims description 12
- 230000001960 triggered effect Effects 0.000 claims description 11
- 230000006870 function Effects 0.000 claims description 5
- 230000000694 effects Effects 0.000 claims description 2
- 230000008569 process Effects 0.000 claims description 2
- 238000013459 approach Methods 0.000 description 14
- 206010000210 abortion Diseases 0.000 description 10
- 230000007246 mechanism Effects 0.000 description 6
- 230000009471 action Effects 0.000 description 4
- 230000008859 change Effects 0.000 description 4
- 238000010586 diagram Methods 0.000 description 4
- 238000005516 engineering process Methods 0.000 description 4
- 238000004088 simulation Methods 0.000 description 4
- 230000008901 benefit Effects 0.000 description 3
- 230000000644 propagated effect Effects 0.000 description 2
- 230000006399 behavior Effects 0.000 description 1
- 230000015556 catabolic process Effects 0.000 description 1
- 230000000052 comparative effect Effects 0.000 description 1
- 238000006731 degradation reaction Methods 0.000 description 1
- 230000001934 delay Effects 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 230000001627 detrimental effect Effects 0.000 description 1
- 238000007667 floating Methods 0.000 description 1
- 230000000977 initiatory effect Effects 0.000 description 1
- 238000013507 mapping Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 230000004224 protection Effects 0.000 description 1
- 230000000717 retained effect Effects 0.000 description 1
- 238000012360 testing method Methods 0.000 description 1
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/46—Multiprogramming arrangements
- G06F9/466—Transaction processing
- G06F9/467—Transactional memory
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- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/46—Multiprogramming arrangements
- G06F9/466—Transaction processing
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- G06—COMPUTING; CALCULATING OR COUNTING
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- G06F11/00—Error detection; Error correction; Monitoring
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- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/14—Error detection or correction of the data by redundancy in operation
- G06F11/1402—Saving, restoring, recovering or retrying
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- G06—COMPUTING; CALCULATING OR COUNTING
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- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/14—Error detection or correction of the data by redundancy in operation
- G06F11/1402—Saving, restoring, recovering or retrying
- G06F11/1474—Saving, restoring, recovering or retrying in transactions
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- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/30003—Arrangements for executing specific machine instructions
- G06F9/30076—Arrangements for executing specific machine instructions to perform miscellaneous control operations, e.g. NOP
- G06F9/3009—Thread control instructions
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- G06—COMPUTING; CALCULATING OR COUNTING
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- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
- G06F9/3836—Instruction issuing, e.g. dynamic instruction scheduling or out of order instruction execution
- G06F9/3842—Speculative instruction execution
-
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- G06—COMPUTING; CALCULATING OR COUNTING
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- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
- G06F9/3836—Instruction issuing, e.g. dynamic instruction scheduling or out of order instruction execution
- G06F9/3851—Instruction issuing, e.g. dynamic instruction scheduling or out of order instruction execution from multiple instruction streams, e.g. multistreaming
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- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
- G06F9/38—Concurrent instruction execution, e.g. pipeline or look ahead
- G06F9/3861—Recovery, e.g. branch miss-prediction, exception handling
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
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- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/46—Multiprogramming arrangements
- G06F9/48—Program initiating; Program switching, e.g. by interrupt
- G06F9/4806—Task transfer initiation or dispatching
- G06F9/4812—Task transfer initiation or dispatching by interrupt, e.g. masked
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- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/46—Multiprogramming arrangements
- G06F9/48—Program initiating; Program switching, e.g. by interrupt
- G06F9/4806—Task transfer initiation or dispatching
- G06F9/4812—Task transfer initiation or dispatching by interrupt, e.g. masked
- G06F9/4818—Priority circuits therefor
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- G06—COMPUTING; CALCULATING OR COUNTING
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- G06F9/00—Arrangements for program control, e.g. control units
- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
- G06F9/46—Multiprogramming arrangements
- G06F9/48—Program initiating; Program switching, e.g. by interrupt
- G06F9/4806—Task transfer initiation or dispatching
- G06F9/4812—Task transfer initiation or dispatching by interrupt, e.g. masked
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- G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
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Claims (15)
- 命令に応答してデータ処理を実施する処理回路であって、前記処理回路が、前記処理回路によるデータ処理のスレッド内でのトランザクションの実行をサポートするための、トランザクショナル・メモリ・サポート回路を含み、前記トランザクションが、トランザクション開始命令とトランザクション終了命令との間で投機的に実行される前記スレッドの命令を含み、それについて、前記処理回路が、前記トランザクション終了命令に到達するまで、前記投機的に実行される命令の結果のコミットを回避し、且つ、前記トランザクション終了命令に到達する前にアボート・イベントが発生すると、前記トランザクションの処理をアボートするよう構成される、処理回路と、
例外の1つ又は複数のサブセットが有効であるか、又は無効であるかを指定する例外マスク情報に応じて、例外をマスクするかどうかを判定するための例外処理回路とを含み、
前記例外マスク情報を更新して、前記トランザクションの処理の開始時に無効化された例外の少なくとも1つのサブセットを有効化するための、トランザクション内で実行される例外マスク更新命令に応答して、前記処理回路が、前記例外マスク更新命令に続く前記トランザクションの1つ又は複数の後続の命令のアボートされてない処理を許可するよう構成される、装置。 - 前記トランザクショナル・メモリ・サポート回路が、前記トランザクション開始命令に応答して取得された、トランザクション回復状態データを格納するための回復状態ストレージ回路を含む、請求項1に記載の装置。
- 前記処理回路が、前記アボート・イベントに応答して、前記トランザクション回復状態データを復元するよう構成される、請求項2に記載の装置。
- 前記トランザクション回復状態データが、前記例外マスク情報を含む、請求項2又は3に記載の装置。
- 前記処理回路が、トランザクションの処理中の有効な例外の発生に応答して、前記アボート・イベントをトリガするよう構成される、請求項1から4までのいずれかに記載の装置。
- 前記トランザクション回復状態データが前記例外マスク情報を含み、
トランザクションの処理中の有効な例外の発生に応答して、前記処理回路が、前記アボート・イベントをトリガし、前記トランザクション回復状態データが復元されるまで、例外の提供を保留するよう構成される、請求項3に記載の装置。 - トランザクションの処理中の有効な例外の発生に応答して、前記有効な例外が前記トランザクションの処理の開始時に無効化されていた場合に、前記処理回路がアボート状態情報を所定の値に設定するよう構成される、請求項5又は6に記載の装置。
- トランザクションのアボート・イベントが発生したことに応答して、前記アボート・イベントが、有効な例外の発生以外のイベントによってトリガされるか、又は、トランザクションの処理の開始時に有効化されていた有効な例外の発生によってトリガされる場合に、前記処理回路が、前記アボート状態情報を前記所定の値以外の値に設定するよう構成される、請求項7に記載の装置。
- 前記例外マスク情報が、例外の複数の種別に対して別々に、例外の各種別が有効であるか、又は無効であるかを指定する、請求項1から8までのいずれかに記載の装置。
- 前記例外マスク情報が、例外優先閾値を指定し、前記例外処理回路が、例外の優先度と前記例外優先閾値との比較に応じて、前記例外をマスクするかどうかを判定するよう構成される、請求項1から9までのいずれかに記載の装置。
- 前記トランザクショナル・メモリ・サポート回路が、
前記投機的に実行された命令の前記結果を格納するための投機的実行結果ストレージ回路、及び、
トランザクション内の命令によってアクセスされるアドレスをトラッキングするためのアドレス・トラッキング回路のうちの、
少なくとも1つを含む、請求項1から10までのいずれかに記載の装置。 - 前記トランザクショナル・メモリ・サポート回路が、第1のスレッドのトランザクション内で実行される所与のアドレスへのデータ・アクセスと、別のスレッドによって実行される同一アドレスへのデータ・アクセスとの競合を検出するための競合検出回路を含む、請求項1から11までのいずれかに記載の装置。
- 前記競合検出回路が、前記競合の検出に応答して、前記アボート・イベントをトリガするよう構成される、請求項12に記載の装置。
- 命令に応答して、処理回路を用いてデータ処理を実施するステップであって、前記処理回路が、前記処理回路によるデータ処理のスレッド内でのトランザクションの実行をサポートするためのトランザクショナル・メモリ・サポート回路を含み、前記トランザクションが、トランザクション開始命令とトランザクション終了命令との間で投機的に実行される前記スレッドの命令を含み、それについて、前記処理回路が、前記トランザクション終了命令に到達するまで、前記投機的に実行される命令の結果のコミットを回避し、且つ、前記トランザクション終了命令に到達する前にアボート・イベントが発生すると、前記トランザクションの処理をアボートするよう構成される、ステップと、
例外に応答して、例外の1つ又は複数のサブセットが有効であるか、又は無効であるかを指定する例外マスク情報に応じて、前記例外をマスクするかどうかを判定するステップと、
前記例外マスク情報を更新して、前記トランザクションの処理の開始時に無効化された例外の少なくとも1つのサブセットを有効化するための、トランザクション内で実行される例外マスク更新命令に応答して、前記例外マスク情報を更新し、前記例外マスク更新命令に続く前記トランザクションの1つ又は複数の後続の命令のアボートされていない処理を許可する、ステップとを含む、データ処理方法。 - ホスト・データ処理装置を制御して、命令を実行するための命令実行環境を提供するためのコンピュータ・プログラムであって、
データ処理のスレッド内でのトランザクションの実行をサポートする処理プログラム・ロジックであって、前記トランザクションが、トンランザクション開始命令とトランザクション終了命令との間で投機的に実行されるスレッドの命令を含み、それについて、前記処理プログラム・ロジックが、前記トランザクション終了命令に到達するまで、前記投機的に実行される命令の結果のコミットを回避し、且つ、前記トランザクション終了命令に到達する前にアボート・イベントが発生すると、前記トランザクションの処理をアボートするよう構成される、処理プログラム・ロジックと、
例外の1つ又は複数のサブセットが有効であるか、又は無効化であるかを指定する例外マスク情報に応じて、例外をマスクするかどうかを判定するための例外処理プログラム・ロジックとを含み、
前記例外マスク情報を更新して、前記トランザクションの処理の開始時に無効化された例外の少なくとも1つのサブセットを有効化するための、トランザクション内で実行される例外マスク更新命令に応答して、前記処理プログラム・ロジックが、前記例外マスク情報を更新し、前記例外マスク更新命令に続く前記トランザクションの1つ又は複数の後続の命令のアボートされていない処理を許可するよう構成される、コンピュータ・プログラム。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
EP17386031.3A EP3462312B1 (en) | 2017-09-29 | 2017-09-29 | Permitting unaborted processing of transaction after exception mask update instruction |
EP17386031.3 | 2017-09-29 | ||
PCT/EP2018/072495 WO2019063200A1 (en) | 2017-09-29 | 2018-08-21 | NON-INTERRUPTED TRANSACTION PROCESSING AUTHORIZATION AFTER EXCEPTION MASK UPDATE INSTRUCTION |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2020535512A JP2020535512A (ja) | 2020-12-03 |
JP7136888B2 true JP7136888B2 (ja) | 2022-09-13 |
Family
ID=60143663
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2020516676A Active JP7136888B2 (ja) | 2017-09-29 | 2018-08-21 | 例外マスク更新命令後のトランザクションの非アボート処理の許可 |
Country Status (8)
Country | Link |
---|---|
US (1) | US11663034B2 (ja) |
EP (1) | EP3462312B1 (ja) |
JP (1) | JP7136888B2 (ja) |
KR (1) | KR102599689B1 (ja) |
CN (1) | CN111133418B (ja) |
IL (1) | IL273129B2 (ja) |
TW (1) | TWI786181B (ja) |
WO (1) | WO2019063200A1 (ja) |
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JPWO2022239515A1 (ja) | 2021-05-10 | 2022-11-17 | ||
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2017
- 2017-09-29 EP EP17386031.3A patent/EP3462312B1/en active Active
-
2018
- 2018-08-21 KR KR1020207010275A patent/KR102599689B1/ko active IP Right Grant
- 2018-08-21 JP JP2020516676A patent/JP7136888B2/ja active Active
- 2018-08-21 WO PCT/EP2018/072495 patent/WO2019063200A1/en active Application Filing
- 2018-08-21 US US16/651,017 patent/US11663034B2/en active Active
- 2018-08-21 IL IL273129A patent/IL273129B2/en unknown
- 2018-08-21 CN CN201880060737.9A patent/CN111133418B/zh active Active
- 2018-09-11 TW TW107131812A patent/TWI786181B/zh active
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Also Published As
Publication number | Publication date |
---|---|
TW201915761A (zh) | 2019-04-16 |
WO2019063200A1 (en) | 2019-04-04 |
US11663034B2 (en) | 2023-05-30 |
IL273129B2 (en) | 2024-04-01 |
CN111133418A (zh) | 2020-05-08 |
IL273129A (en) | 2020-04-30 |
US20200278882A1 (en) | 2020-09-03 |
CN111133418B (zh) | 2023-12-22 |
EP3462312B1 (en) | 2022-08-17 |
JP2020535512A (ja) | 2020-12-03 |
TWI786181B (zh) | 2022-12-11 |
IL273129B1 (en) | 2023-12-01 |
KR102599689B1 (ko) | 2023-11-08 |
KR20200061361A (ko) | 2020-06-02 |
EP3462312A1 (en) | 2019-04-03 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20210816 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20220713 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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|
A61 | First payment of annual fees (during grant procedure) |
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|
R150 | Certificate of patent or registration of utility model |
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