JP6883777B2 - Semiconductor devices and methods for manufacturing semiconductor devices - Google Patents

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Description

本発明は、半導体装置及び半導体装置の製造方法に関するものである。 The present invention relates to a semiconductor device and a method for manufacturing the semiconductor device.

半導体装置として、不純物が混入した水や生体液等の液体、粘土、土、砂等の半固形物や、粉体等の電気伝導度を計測するセンサが知られている。 As a semiconductor device, a sensor that measures the electrical conductivity of a liquid such as water or a biological liquid mixed with impurities, a semi-solid substance such as clay, soil, or sand, or a powder is known.

例えば、特許文献1には、土壌中に一対の電極を接触させて、その間の電気抵抗を測定することにより電気伝導度を計測し、計測された電気伝導度から土壌中のイオン濃度を特定することにより、土壌の水分量を特定するセンサとしての機能を有する半導体装置が記載されている。 For example, in Patent Document 1, a pair of electrodes are brought into contact with each other in soil, the electrical resistance between them is measured to measure the electrical conductivity, and the ion concentration in the soil is specified from the measured electrical conductivity. Thereby, a semiconductor device having a function as a sensor for identifying the water content of soil is described.

国際公開第2011/158812号International Publication No. 2011/158812

特許文献1に記載の半導体装置120のセンサ電極132は、図9の第9工程に示すように半導体基板122、絶縁層124、第1導電層126、結合層127、白金膜である第2導電層128、及び上層保護膜130を備える。 As shown in the ninth step of FIG. 9, the sensor electrode 132 of the semiconductor device 120 described in Patent Document 1 has a semiconductor substrate 122, an insulating layer 124, a first conductive layer 126, a bonding layer 127, and a second conductive film which is a platinum film. A layer 128 and an upper protective film 130 are provided.

特許文献1に記載の半導体装置120の実現性を発明者らが検討した結果、半導体装置120の製造方法は、まず、図9の第1工程に示すように、シリコンの半導体基板122上に、酸素雰囲気下で熱処理を行うことで、所望の厚さの酸化シリコン等の絶縁層124を形成する。その後、絶縁層124上にスパッタによりアルミニウムの第1導電層126を成膜する。 As a result of examining the feasibility of the semiconductor device 120 described in Patent Document 1, the manufacturing method of the semiconductor device 120 is first described on a silicon semiconductor substrate 122 as shown in the first step of FIG. By performing the heat treatment in an oxygen atmosphere, an insulating layer 124 such as silicon oxide having a desired thickness is formed. Then, the first conductive layer 126 of aluminum is formed on the insulating layer 124 by sputtering.

次に、図9の第2工程に示すように、センサ電極132に対応する領域の第1導電層126上にリソグラフィ技術を用いてレジストマスク(図示省略)を形成し、当該レジストマスクをマスクにしてエッチングを行った後、レジストマスクを除去することで、センサ電極132の最下層となる第1導電層126を形成する。 Next, as shown in the second step of FIG. 9, a resist mask (not shown) is formed on the first conductive layer 126 in the region corresponding to the sensor electrode 132 by using a lithography technique, and the resist mask is used as a mask. After etching, the resist mask is removed to form the first conductive layer 126 which is the lowermost layer of the sensor electrode 132.

次に、図9の第3工程に示すように、絶縁層124と第1導電層126とを被覆するレジストマスク膜(図示省略)を形成し、露光工程及び現像工程を経ることで開口部151を備えたレジストマスク150を形成する。この際、第1導電層126の最外周部には重ね合わせマージンL101を確保した状態で開口部151を形成する。当該重ね合わせマージンL101は、露光機の下層(第1導電層126)と上層(レジストマスク150)との合わせ精度に応じた寸法を確保する必要がある。 Next, as shown in the third step of FIG. 9, a resist mask film (not shown) covering the insulating layer 124 and the first conductive layer 126 is formed, and the opening 151 is subjected to an exposure step and a developing step. The resist mask 150 provided with the above is formed. At this time, an opening 151 is formed in the outermost peripheral portion of the first conductive layer 126 with the overlapping margin L101 secured. It is necessary to secure the dimensions of the overlapping margin L101 according to the alignment accuracy of the lower layer (first conductive layer 126) and the upper layer (resist mask 150) of the exposure machine.

次に、図9の第4工程に示すように、レジストマスク150の表面と開口部151から露出する第1導電層126の表面とに、Ti膜である結合層127及び白金膜である第2導電層128を順次スパッタにより形成する。具体例として、結合層127の厚さとしては0.02μm、第2導電層128の厚さとしては0.1μmが挙げられる。 Next, as shown in the fourth step of FIG. 9, the surface of the resist mask 150 and the surface of the first conductive layer 126 exposed from the opening 151 are a Ti film, a bonding layer 127, and a platinum film, a second. The conductive layer 128 is sequentially formed by sputtering. As a specific example, the thickness of the bonding layer 127 is 0.02 μm, and the thickness of the second conductive layer 128 is 0.1 μm.

また、結合層127をスパッタにより成膜するに先立ち、レジストマスク150の開口部151から露出する第1導電層126の表面に形成される自然酸化膜を除去するために、第1導電層126の表面にアルゴン(Ar)イオンをスパッタする逆スパッタを行う。当該逆スパッタも、結合層127及び第2導電層128のスパッタ処理と同様、同一装置内で行う。第1導電層126は大気中に放置されると表面が空気中の水分により酸化されるが、当該逆スパッタを行うことにより、形成された自然酸化膜によって第1導電層126と結合層127との電気的な接続を阻害するのが抑制される。 Further, prior to forming the bonding layer 127 by sputtering, in order to remove the natural oxide film formed on the surface of the first conductive layer 126 exposed from the opening 151 of the resist mask 150, the first conductive layer 126 is formed. Reverse sputtering is performed to sputter argon (Ar) ions on the surface. The reverse sputtering is also performed in the same apparatus as the sputtering treatment of the bonding layer 127 and the second conductive layer 128. When the first conductive layer 126 is left in the air, its surface is oxidized by the moisture in the air. However, by performing the reverse sputtering, the first conductive layer 126 and the bonding layer 127 are formed by the natural oxide film formed. It is suppressed from obstructing the electrical connection of the.

次に、図9の第5工程に示すように、結合層127及び第2導電層128のパターニングを実施する。レジストマスク150を薬液中で除去することで、レジストマスク150の上に形成された結合層127及び第2導電層128の積層膜をリフトオフ法により除去する。これにより、第1導電層126の表面の所望の領域に結合層127及び第2導電層128の積層膜を形成する。 Next, as shown in the fifth step of FIG. 9, patterning of the bonding layer 127 and the second conductive layer 128 is performed. By removing the resist mask 150 in the chemical solution, the laminated film of the bonding layer 127 and the second conductive layer 128 formed on the resist mask 150 is removed by the lift-off method. As a result, a laminated film of the bonding layer 127 and the second conductive layer 128 is formed in a desired region on the surface of the first conductive layer 126.

次に、図9の第6工程に示すように、絶縁層124の表面、重ね合わせマージンL101としてレジストマスクが被覆されていた第1導電層126の表面、及び第2導電層128の表面を被覆する上層保護膜130を形成する。 Next, as shown in the sixth step of FIG. 9, the surface of the insulating layer 124, the surface of the first conductive layer 126 coated with the resist mask as the overlapping margin L101, and the surface of the second conductive layer 128 are covered. The upper protective film 130 is formed.

次に、図9の第7工程に示すように、第2導電層128の電極の露出が必要となる領域に対応する上層保護膜130の領域に開口部153を備えたレジストマスク152を上層保護膜130上に形成する。この際、第2導電層128の最外周部に重ね合わせマージンL102を確保した状態で開口部153を形成する。当該重ね合わせマージンL102は、下層となる第2導電層128と上層であるレジストマスク153とに対する露光機の合わせ精度と、下層である第2導電層128の加工精度の両方に応じた寸法を確保する必要がある。 Next, as shown in the seventh step of FIG. 9, the resist mask 152 having the opening 153 in the region of the upper protective film 130 corresponding to the region where the electrodes of the second conductive layer 128 need to be exposed is protected in the upper layer. It is formed on the film 130. At this time, the opening 153 is formed in a state where the overlapping margin L102 is secured on the outermost peripheral portion of the second conductive layer 128. The overlapping margin L102 secures dimensions corresponding to both the alignment accuracy of the exposure machine with respect to the second conductive layer 128 as the lower layer and the resist mask 153 as the upper layer and the processing accuracy of the second conductive layer 128 as the lower layer. There is a need to.

次に、図9の第8工程に示すように、上層保護膜130上に形成されたレジストマスク152をマスクとしてエッチングを行うことで、第2導電層128のセンサ電極132の所望の領域を露出させる。 Next, as shown in the eighth step of FIG. 9, the desired region of the sensor electrode 132 of the second conductive layer 128 is exposed by performing etching using the resist mask 152 formed on the upper protective film 130 as a mask. Let me.

次に、図9の第9工程に示すように、レジストマスク152の除去を行う工程を経て半導体装置120のセンサ電極132が製造される。 Next, as shown in the ninth step of FIG. 9, the sensor electrode 132 of the semiconductor device 120 is manufactured through the step of removing the resist mask 152.

発明者らによる検討の結果、このようにして製造される特許文献1に記載の半導体装置120は大量生産による製品の供給を行う場合には以下の課題があることが判明した。 As a result of the examination by the inventors, it has been found that the semiconductor device 120 described in Patent Document 1 manufactured in this way has the following problems when the product is supplied by mass production.

1つ目の課題として、特許文献1に記載の半導体装置120では、第2導電層128全体の大きさ(面積)に比べ、上層保護膜130から露出する第2導電層128の大きさが小さくなり、センサ電極132として機能する領域のサイズが縮小することが判明した。 As the first problem, in the semiconductor device 120 described in Patent Document 1, the size of the second conductive layer 128 exposed from the upper protective film 130 is smaller than the size (area) of the entire second conductive layer 128. It was found that the size of the region functioning as the sensor electrode 132 was reduced.

一般的に、多数のマスクを使用して形成されたパターンを積層するウェハプロセスでは、リソグラフィ工程の露光ステップにおいて下層に形成されたパターンと上層に形成するパターンとの重ね合わせを考慮する必要が生じる。 In general, in a wafer process in which patterns formed by using a large number of masks are laminated, it is necessary to consider the superposition of the pattern formed in the lower layer and the pattern formed in the upper layer in the exposure step of the lithography process. ..

特許文献1に記載の半導体装置120の製造方法(図9参照)では、第3工程及び第7工程においてパターンの重ね合わせの考慮が必要となる。 In the manufacturing method of the semiconductor device 120 described in Patent Document 1 (see FIG. 9), it is necessary to consider the superposition of patterns in the third step and the seventh step.

上述したように第3工程では、図10に示すように、露光機の重ね合わせ精度に応じた重ね合わせマージンとして重ね合わせマージンL101を考慮したレジストマスクパターンの形成が必要となる。 As described above, in the third step, as shown in FIG. 10, it is necessary to form a resist mask pattern in consideration of the superposition margin L101 as the superposition margin according to the superposition accuracy of the exposure machine.

一方、第7工程では、図10に示すように、露光機の重ね合わせ精度に応じた重ね合わせマージンと結合層127及び第2導電層128の積層膜の端部のバラツキ160に応じた重ね合わせマージンとの2乗和を重ね合わせマージンL102として考慮したレジストマスク152の形成が必要となる。 On the other hand, in the seventh step, as shown in FIG. 10, the superposition margin according to the superposition accuracy of the exposure machine and the superposition according to the variation 160 of the end portion of the laminated film of the bonding layer 127 and the second conductive layer 128. It is necessary to form the resist mask 152 in consideration of the sum of squares with the margin as the superposition margin L102.

ここで、半導体装置120のセンサ電極132は、土壌の水分に含まれるイオン濃度と水分量を測定する環境下に配置される。そのため、上層保護膜130の開口部135内に第1導電層126の表面が露出すると、アルミを材料とする第1導電層126が容易に腐食し、センサの機能が損なわれる。そのため、上層保護膜130と第1導電層126とが完全にオーバーラップすることが要求される。 Here, the sensor electrode 132 of the semiconductor device 120 is arranged in an environment for measuring the ion concentration and the amount of water contained in the water content of the soil. Therefore, when the surface of the first conductive layer 126 is exposed in the opening 135 of the upper protective film 130, the first conductive layer 126 made of aluminum is easily corroded, and the function of the sensor is impaired. Therefore, it is required that the upper protective film 130 and the first conductive layer 126 completely overlap.

上述の理由により、第7工程では、上層保護膜130により結合層127及び第2導電層128の積層膜の端面(端部)が完全に被覆されるようにレジストマスク152の開口部153を形成することが必要となる。特に、上述の第5工程のとおり、結合層127及び第2導電層128はリフトオフ法により形成されるため、結合層127及び第2導電層128の積層膜の端部160はレジストマスク150の開口部に依存しない制御が極めて困難なバラツキを生じることとなる。そのため、重ね合わせマージンL102の寸法は通常のウェハプロセスで使用される重ね合わせマージン(例えば、上記重ね合わせマージンL101)と比して極めて大きな寸法を確保する必要がある。 For the above reason, in the seventh step, the opening 153 of the resist mask 152 is formed so that the end face (end portion) of the laminated film of the bonding layer 127 and the second conductive layer 128 is completely covered by the upper protective film 130. It is necessary to do. In particular, since the bonding layer 127 and the second conductive layer 128 are formed by the lift-off method as in the fifth step described above, the end 160 of the laminated film of the bonding layer 127 and the second conductive layer 128 is an opening of the resist mask 150. There will be variations that are extremely difficult to control depending on the part. Therefore, it is necessary to secure an extremely large dimension of the overlap margin L102 as compared with the overlap margin used in a normal wafer process (for example, the overlap margin L101).

このため、図10に示すように、半導体装置120は、第1導電層126の端部から開口部135まで重ね合わせマージンL103として、重ね合わせマージンL101と重ね合わせマージンL102とを加算した分が必要となる。第1導電層126の大きさが規定されている場合には、第2導電層128が上層保護膜130の開口部135から露出する面積は、第1導電層126の端部から重ね合わせマージンL101と重ね合わせマージンL102との2乗和とを合わせた面積に相当する大きさが縮小することとなる。このようにセンサ電極132として機能する第2導電層128が上層保護膜130の開口部135から露出する面積が縮小することにより、センサの感度が低下する。 Therefore, as shown in FIG. 10, the semiconductor device 120 requires an overlap margin L103 from the end of the first conductive layer 126 to the opening 135, which is the sum of the overlap margin L101 and the overlap margin L102. It becomes. When the size of the first conductive layer 126 is specified, the area where the second conductive layer 128 is exposed from the opening 135 of the upper protective film 130 is the overlapping margin L101 from the end of the first conductive layer 126. And the sum of squares of the overlapping margin L102 are reduced in size corresponding to the combined area. As described above, the area where the second conductive layer 128 that functions as the sensor electrode 132 is exposed from the opening 135 of the upper protective film 130 is reduced, so that the sensitivity of the sensor is lowered.

また、2つ目の課題として、発明者らの検討の結果、特許文献1に記載の半導体装置120では、結合層127及び第2導電層128の積層膜と第1導電層126との界面に不純物が存在することが判明した。さらに、不純物が存在することにより、製品として大量生産する場合は、測定精度が低下した不良品が発生することにより不良率が上昇し、また、長期間の使用で結合層127及び第2導電層128の積層膜と第1導電層126との界面で剥離する不具合が生じることにより信頼性の不足が生じることが判明した。 As a second issue, as a result of the examination by the inventors, in the semiconductor device 120 described in Patent Document 1, the interface between the laminated film of the bonding layer 127 and the second conductive layer 128 and the first conductive layer 126 is formed. It turned out that impurities were present. Further, in the case of mass production as a product due to the presence of impurities, the defective rate increases due to the occurrence of defective products with reduced measurement accuracy, and the bonding layer 127 and the second conductive layer are used for a long period of time. It has been found that the reliability is insufficient due to the problem of peeling at the interface between the 128 laminated film and the first conductive layer 126.

白金はドライエッチングによる除去が極めて困難な物質のため、パターニングには一般的にリフトオフ法が使用される。一般的に、リフトオフ法では、下地膜を露出するレジストマスクの開口部を設け、レジストマスクの表面と開口部から露出する下地膜の表面とに薄膜を形成した後、レジストマスクと共にレジストマスクの表面に形成された薄膜を除去することで下地膜の表面に所望の形状の薄膜のパターンを形成する。 Since platinum is a substance that is extremely difficult to remove by dry etching, the lift-off method is generally used for patterning. Generally, in the lift-off method, an opening of a resist mask that exposes the base film is provided, a thin film is formed on the surface of the resist mask and the surface of the base film exposed from the opening, and then the surface of the resist mask is formed together with the resist mask. By removing the thin film formed in, a thin film pattern having a desired shape is formed on the surface of the undercoat film.

特許文献1に記載の半導体装置120では、第4工程において上述したように、レジストマスク150から露出する第1導電層126とレジストマスク150の表面に結合層127と第2導電層128の積層膜をスパッタにより形成した後、第5工程においてレジストマスク150を除去することで第1導電層126上に結合層127及び第2導電層128の積層膜をパターニングする。 In the semiconductor device 120 described in Patent Document 1, as described above in the fourth step, a laminated film of the bonding layer 127 and the second conductive layer 128 is provided on the surfaces of the first conductive layer 126 and the resist mask 150 exposed from the resist mask 150. Is formed by sputtering, and then the resist mask 150 is removed in the fifth step to pattern the laminated film of the bonding layer 127 and the second conductive layer 128 on the first conductive layer 126.

この際、上述したように、第1導電層126の表面に形成された自然酸化膜を除去するために逆スパッタを行う。図11(a)に示すように、イオン(スパッタ成分170)によるスパッタで第1導電層126の表面に形成された自然酸化膜を除去する際、レジストマスク150の表面からカーボン成分171が叩き出されるため、第1導電層126の表面にカーボン成分172が再付着する。 At this time, as described above, reverse sputtering is performed in order to remove the natural oxide film formed on the surface of the first conductive layer 126. As shown in FIG. 11A, when the natural oxide film formed on the surface of the first conductive layer 126 is removed by sputtering with ions (sputtering component 170), the carbon component 171 is knocked out from the surface of the resist mask 150. Therefore, the carbon component 172 reattaches to the surface of the first conductive layer 126.

続いて、図11(b)に示すように、第1導電層126の表面にカーボン成分172が付着した状態で、結合層127が形成される。結合層127が形成されるため、第1導電層126と結合層127との界面にはカーボン成分172が存在する状態となる。 Subsequently, as shown in FIG. 11B, the bonding layer 127 is formed with the carbon component 172 adhering to the surface of the first conductive layer 126. Since the bond layer 127 is formed, the carbon component 172 is present at the interface between the first conductive layer 126 and the bond layer 127.

さらに、図11(c)に示すように、結合層127の上に、白金膜である第2導電層128が成膜される。そのため、第2導電層128が成膜された後も、第1導電層126と結合層127との界面にはカーボン成分172が残留した状態のままとなる。 Further, as shown in FIG. 11C, a second conductive layer 128, which is a platinum film, is formed on the bonding layer 127. Therefore, even after the second conductive layer 128 is formed, the carbon component 172 remains at the interface between the first conductive layer 126 and the bonding layer 127.

従って、図11(d)に示すように、特許文献1に記載された半導体装置120では、第1導電層126と結合層127との間にカーボン成分172が存在することとなる。 Therefore, as shown in FIG. 11D, in the semiconductor device 120 described in Patent Document 1, the carbon component 172 is present between the first conductive layer 126 and the bonding layer 127.

すなわち、特許文献1に記載の半導体装置120の製造を行う場合、逆スパッタを行った場合にはカーボンが、逆スパッタを行わない場合には自然酸化膜が第1導電層126と結合層127との界面に不純物として存在することとなる。 That is, when manufacturing the semiconductor device 120 described in Patent Document 1, carbon is formed when reverse sputtering is performed, and a natural oxide film is formed between the first conductive layer 126 and the bonding layer 127 when reverse sputtering is not performed. It will be present as an impurity at the interface of.

第1導電層126と結合層127との界面に不純物が存在すると、第1導電層126と結合層127との電気的な接続の阻害を生じると共に、第1導電層126と結合層127との密着性が低下する。電気的な接続の阻害により、半導体装置120の製造においては歩留まりの低下、すなわち、センサとして所望の性能が得られない半導体装置120が製造されてしまうことによる不良率の上昇が生じる。また、密着性の低下により、半導体装置120を長期間にわたり使用した際には第1導電層126と結合層127との剥離が生じてしまう結果、第1導電層126と第2導電層128との電気的接続不良が生じ、信頼性の不足を招く。 If impurities are present at the interface between the first conductive layer 126 and the bond layer 127, the electrical connection between the first conductive layer 126 and the bond layer 127 is hindered, and the first conductive layer 126 and the bond layer 127 are combined. Adhesion is reduced. Inhibition of electrical connection causes a decrease in yield in the manufacture of the semiconductor device 120, that is, an increase in the defect rate due to the manufacture of the semiconductor device 120 in which the desired performance as a sensor cannot be obtained. Further, due to the decrease in adhesion, when the semiconductor device 120 is used for a long period of time, the first conductive layer 126 and the bonding layer 127 are peeled off, and as a result, the first conductive layer 126 and the second conductive layer 128 are separated from each other. Electrical connection failure occurs, leading to lack of reliability.

このように、特許文献1に記載された半導体装置では、土壌に接触する電極の面積が小さくなる等の理由から、センサの感度が低下するという1つ目の課題があった。また、特許文献1に記載された半導体装置では、電極として、アルミニウムからなる第1層上にチタンからなる結合層を介して積層された白金層を用いているが、第1層と白金層との電気的接続不良を生じる場合があり、信頼性が低下するという2つ目の課題があった。 As described above, the semiconductor device described in Patent Document 1 has the first problem that the sensitivity of the sensor is lowered because the area of the electrode in contact with the soil is reduced. Further, in the semiconductor device described in Patent Document 1, a platinum layer laminated on a first layer made of aluminum via a bonding layer made of titanium is used as an electrode. There is a second problem that the reliability may be lowered because the electrical connection may be poor.

本発明は、センサの感度低下を抑制すると共に、信頼性を向上させることができる半導体装置を提供することを目的とする。 An object of the present invention is to provide a semiconductor device capable of suppressing a decrease in sensitivity of a sensor and improving reliability.

上記目的を達成するために、本発明の半導体装置は、半導体基板と、前記半導体基板の主面上に形成され、第1センサ電極用第1導電層と、前記第1センサ電極用第1導電層の上に形成されると共に端面が前記第1センサ電極用第1導電層の端面と面一である第1センサ電極用第2導電層とを備え、入力信号を出力する第1センサ電極と、前記半導体基板の主面上に形成され、第2センサ電極用第1導電層と、前記第2センサ電極用第1導電層の上に形成されると共に端面が前記第2センサ電極用第1導電層の端面と面一である第2センサ電極用第2導電層とを備え、前記第1センサ電極から出力された入力信号が出力信号として入力される第2センサ電極と、前記第1センサ電極用第1導電層の側面と前記第1センサ電極用第2導電層の側面及び表面の外周と、前記第2センサ電極用第1導電層の側面と前記第2センサ電極用第2導電層の側面及び表面の外周と、を被覆すると共に前記第1センサ電極用第2導電層の前記第1センサ電極に応じた定められた領域の表面を露出する上層保護膜と、前記第1センサ電極に対応すると共に、前記第1センサ電極に電気的に接続され、第1電極用第1導電層及び前記第1電極用第1導電層の上に形成されると共に端面が前記第1電極用第1導電層の端面と面一である第1電極用第2導電層とを備える第1電極と、前記第2センサ電極に対応すると共に前記第2センサ電極に電気的に接続され、第2電極用第1導電層及び前記第2電極用第1導電層の上に形成されると共に端面が前記第2電極用第1導電層の端面と面一である第2電極用第2導電層とを備える第2電極と、を備え、前記上層保護膜は、前記第1電極と前記第2電極との上面を各々露出する開口部をさらに備え、前記開口部に対応する前記第1電極の上面には前記第1電極用第2導電層が設けられておらず前記第1電極用第1導電層が露出しており、前記開口部に対応する前記第2電極の上面には前記第2電極用第2導電層が設けられておらず前記第2電極用第1導電層が露出しているIn order to achieve the above object, the semiconductor device of the present invention is formed on a semiconductor substrate and a main surface of the semiconductor substrate, and has a first conductive layer for a first sensor electrode and a first conductive layer for the first sensor electrode. A first sensor electrode that is formed on the layer and has a second conductive layer for the first sensor electrode that is flush with the end face of the first conductive layer for the first sensor electrode and outputs an input signal. , Formed on the main surface of the semiconductor substrate, formed on the first conductive layer for the second sensor electrode and the first conductive layer for the second sensor electrode, and the end surface is the first for the second sensor electrode. A second sensor electrode provided with a second conductive layer for a second sensor electrode that is flush with the end face of the conductive layer, and an input signal output from the first sensor electrode is input as an output signal, and the first sensor. The side surface of the first conductive layer for the electrode, the side surface and the outer periphery of the surface of the second conductive layer for the first sensor electrode, the side surface of the first conductive layer for the second sensor electrode, and the second conductive layer for the second sensor electrode. An upper protective film that covers the side surface and the outer periphery of the surface of the surface and exposes the surface of a region of the second conductive layer for the first sensor electrode that corresponds to the first sensor electrode, and the first sensor electrode. It is electrically connected to the first sensor electrode and is formed on the first conductive layer for the first electrode and the first conductive layer for the first electrode, and the end face is the first electrode for the first electrode. A first electrode having a second conductive layer for the first electrode that is flush with the end face of the first conductive layer, and a second electrode that corresponds to the second sensor electrode and is electrically connected to the second sensor electrode. The second conductive layer for the second electrode, which is formed on the first conductive layer for the second electrode and the first conductive layer for the second electrode and whose end face is flush with the end face of the first conductive layer for the second electrode. The upper protective film is further provided with an opening that exposes the upper surfaces of the first electrode and the second electrode, respectively, and is provided on the upper surface of the first electrode corresponding to the opening. Is not provided with the second conductive layer for the first electrode, the first conductive layer for the first electrode is exposed, and the upper surface of the second electrode corresponding to the opening is for the second electrode. The second conductive layer is not provided, and the first conductive layer for the second electrode is exposed .

また、上記目的を達成するために、本発明の半導体装置の製造方法は、主面上にセンサ電極形成領域と前記センサ電極形成領域に隣接する実装電極形成領域とを備えた半導体基板を準備する工程と、半導体基板の主面上に、第1導電層と第2導電層とが順に連続して積層された積層膜を形成する積層膜形成工程と、前記積層膜をドライエッチングによりパターニングして、センサ電極を前記センサ電極形成領域に形成すると共に、実装電極を前記実装電極形成領域に形成する電極形成工程と、前記主面と、前記センサ電極と前記実装電極との表面の外周と、を被覆すると共に、前記センサ電極の前記第2導電層を露出する開口部と前記実装電極の前記第2導電層を露出する開口部を有する上層保護膜を形成する上層保護膜形成工程と、前記センサ電極の前記第2導電層を露出する開口部を被覆すると共に前記実装電極の前記第2導電層を露出する開口部を内包する領域を露出するマスクレイヤを形成するマスクレイヤ形成工程と、前記マスクレイヤに応じた領域をエッチングすることで、前記実装電極の前記第2導電層を除去する第2導電層除去工程と、を含む。 Further, in order to achieve the above object, in the method for manufacturing a semiconductor device of the present invention, a semiconductor substrate having a sensor electrode forming region and a mounting electrode forming region adjacent to the sensor electrode forming region is prepared on the main surface. The step, a laminated film forming step of forming a laminated film in which the first conductive layer and the second conductive layer are continuously laminated in order on the main surface of the semiconductor substrate, and the patterning of the laminated film by dry etching. The electrode forming step of forming the sensor electrode in the sensor electrode forming region and forming the mounting electrode in the mounting electrode forming region, the main surface, and the outer periphery of the surface of the sensor electrode and the mounting electrode. An upper layer protective film forming step of forming an upper layer protective film having an opening for exposing the second conductive layer of the sensor electrode and an opening for exposing the second conductive layer of the mounting electrode while covering the sensor electrode, and the sensor. A mask layer forming step of covering an opening that exposes the second conductive layer of the electrode and forming a mask layer that exposes a region including an opening that exposes the second conductive layer of the mounting electrode, and the mask. A second conductive layer removing step of removing the second conductive layer of the mounting electrode by etching a region corresponding to the layer is included.

本発明によれば、センサの感度低下を抑制すると共に、信頼性を向上させることができる、という効果を奏する。 According to the present invention, it is possible to suppress a decrease in the sensitivity of the sensor and improve the reliability.

本実施形態のセンサ機能を有する半導体装置を実装する半導体装置の概略構成図(平面図)である。It is a schematic block diagram (plan view) of the semiconductor device which mounts the semiconductor device which has a sensor function of this embodiment. 図1に示した半導体装置のA-A線断面図である。FIG. 5 is a cross-sectional view taken along the line AA of the semiconductor device shown in FIG. 本実施形態の半導体装置の製造方法を説明する図である。It is a figure explaining the manufacturing method of the semiconductor device of this embodiment. 被測定物の測定を行う場合の半導体装置及び制御部の構成を表す概略図である。It is the schematic which shows the structure of the semiconductor device and the control part at the time of measuring an object to be measured. 本実施形態の半導体装置により、特許文献1に記載の半導体装置が有する1つ目の課題を解決していることを説明する説明図である。It is explanatory drawing explaining that the semiconductor device of this embodiment solves the 1st problem which the semiconductor device described in Patent Document 1 has. 本実施形態の半導体装置により、特許文献1に記載の半導体装置が有する2つ目の課題を解決していることを説明する説明図である。It is explanatory drawing explaining that the semiconductor device of this embodiment solves the second problem which the semiconductor device described in Patent Document 1 has. 本実施形態の半導体装置により測定した土壌の電気伝導度の周波数特性を示すグラフである。It is a graph which shows the frequency characteristic of the electric conductivity of the soil measured by the semiconductor device of this embodiment. 比較例の半導体装置により測定した土壌の電気伝導度の周波数特性を示すグラフである。It is a graph which shows the frequency characteristic of the electric conductivity of the soil measured by the semiconductor device of the comparative example. 本実施形態のセンサ機能を有する半導体装置のその他の構成例を表す概略構成図(断面図)である。It is a schematic block diagram (cross-sectional view) which shows the other structural example of the semiconductor device which has a sensor function of this embodiment. 特許文献1に記載の半導体装置の製造方法を説明する図である。It is a figure explaining the manufacturing method of the semiconductor device described in Patent Document 1. 特許文献1に記載の半導体装置が有する1つ目の課題を説明するための説明図である。It is explanatory drawing for demonstrating the first problem which the semiconductor device described in Patent Document 1 has. 特許文献1に記載の半導体装置が有する2つ目の課題を説明するための説明図である。It is explanatory drawing for demonstrating the second problem which the semiconductor device described in Patent Document 1 has.

以下では、図面を参照して、本発明の実施形態を詳細に説明する。なお、以下の説明において「厚さ」とは、半導体装置20の積層方向の厚さのことをいう。また、「大きさ」とは、基板の表面(積層方向と交差する面)の面積の大きさのことをいう。 Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. In the following description, the "thickness" means the thickness of the semiconductor device 20 in the stacking direction. Further, the "size" refers to the size of the area of the surface of the substrate (the surface intersecting the stacking direction).

まず、本実施形態の半導体装置の構成について説明する。本実施形態の半導体装置20は、EC(Electric Conductivity)センサの機能を有する。図1には、本実施形態の半導体装置20をプリント基板12上に実装した半導体装置10を、プリント基板12の主面側から見た概略構成図(平面図)を示す。また、図2には、図1に示した半導体装置10のA−A線断面図を示す。 First, the configuration of the semiconductor device of this embodiment will be described. The semiconductor device 20 of this embodiment has a function of an EC (Electric Conductivity) sensor. FIG. 1 shows a schematic configuration diagram (plan view) of the semiconductor device 10 in which the semiconductor device 20 of the present embodiment is mounted on the printed circuit board 12 as viewed from the main surface side of the printed circuit board 12. Further, FIG. 2 shows a sectional view taken along line AA of the semiconductor device 10 shown in FIG.

図1に示すように、本実施形態の半導体装置20は、センサ電極形成領域40に形成された一対のセンサ電極32_1、32_2、及び実装用パッド(実装電極)形成領域41に形成された一対の実装用パッド34_1、34_2を備える。センサ電極32_1と実装用パッド34_1とは、配線29_1により電気的に接続されている。また、センサ電極32_2と実装用パッド34_2とは、配線29_2により電気的に接続されている。本実施形態の実装用パッド34_1は、本発明の第1電極の一例であり、実装用パッド34_2は、本発明の第2電極の一例である。 As shown in FIG. 1, the semiconductor device 20 of the present embodiment has a pair of sensor electrodes 32_1 and 32_2 formed in a sensor electrode forming region 40, and a pair of sensor electrodes 32_1 and 32_2 formed in a mounting pad (mounting electrode) forming region 41. It is provided with mounting pads 34_1 and 34_2. The sensor electrode 32_1 and the mounting pad 34_1 are electrically connected by wiring 29_1. Further, the sensor electrode 32_2 and the mounting pad 34_2 are electrically connected by wiring 29_2. The mounting pad 34_1 of the present embodiment is an example of the first electrode of the present invention, and the mounting pad 34_1 is an example of the second electrode of the present invention.

なお、センサ電極32_1とセンサ電極32_2とは同様の構成であり、また、実装用パッド34_1と実装用パッド34_2とは同様の構成であるため、図2及び以下の説明において個々を区別せずに総称する場合は、個々を区別するための符号「_1」、「_2」の記載を省略する。また、図1において、センサ電極32_1及び実装用パッド34_1に関連する構成を表す符号に付与している「_1」と、センサ電極32_2及び実装用パッド34_2に関連する構成を表す符号に付与している「_2」についても、個々を区別せずに総称する場合は、その記載を省略する。 Since the sensor electrode 32_1 and the sensor electrode 32_2 have the same configuration, and the mounting pad 34_1 and the mounting pad 34_2 have the same configuration, they are not distinguished in FIG. 2 and the following description. When generically referred to, the description of the codes "_1" and "_2" for distinguishing the individual is omitted. Further, in FIG. 1, "_1" assigned to the reference numerals representing the configurations related to the sensor electrode 32_1 and the mounting pad 34_1 and the reference numerals representing the configurations related to the sensor electrode 32_1 and the mounting pad 34_1 are added to the reference numerals. If "_2" is also collectively referred to without distinguishing between them, the description thereof will be omitted.

なお、本実施形態の半導体装置20は、一対のセンサ電極32を1つ備えているが、センサ電極を複数対備えていてもよい。 Although the semiconductor device 20 of the present embodiment includes one pair of sensor electrodes 32, a plurality of pairs of sensor electrodes may be provided.

図2に示すように半導体装置20は、半導体基板22の主面上に絶縁層24が積層されている。半導体基板22には、一例としてシリコン(Si)製の基板(ウエハ)を用いている。絶縁層24の例としては、一般的な絶縁層が挙げられ、具体例としては、酸化珪素(SiO)を材料とした酸化膜等が挙げられる。 As shown in FIG. 2, in the semiconductor device 20, the insulating layer 24 is laminated on the main surface of the semiconductor substrate 22. As an example, a silicon (Si) substrate (wafer) is used for the semiconductor substrate 22. Examples of the insulating layer 24 include a general insulating layer, and specific examples thereof include an oxide film made of silicon oxide (SiO 2).

絶縁層24上には、センサ電極32と、実装用パッド34と、開口部35及び開口部36が形成された上層保護膜30が積層されている。図1、2に示すように、センサ電極32は、絶縁層24上に、順次積層された第1導電層26A及び第2導電層28Aを備える。センサ電極32の大きさは、電気信号が検知できる大きさであればよく、センサの感度や、例えば土壌等である測定対象の環境に応じて定めればよいが、具体例としては、1mmが挙げられる。 On the insulating layer 24, a sensor electrode 32, a mounting pad 34, and an upper layer protective film 30 on which an opening 35 and an opening 36 are formed are laminated. As shown in FIGS. 1 and 2, the sensor electrode 32 includes a first conductive layer 26A and a second conductive layer 28A that are sequentially laminated on the insulating layer 24. The size of the sensor electrode 32 may be a size that can detect an electric signal, and may be determined according to the sensitivity of the sensor and the environment of the measurement target such as soil. As a specific example, 1 mm 2 Can be mentioned.

また、実装用パッド34は、センサ電極32と同様に、絶縁層24上に、順次積層された、第1導電層26B及び第2導電層28Bを備えるが、図1、2に示すように、開口部36には第2導電層28Bが設けられていない。 Further, the mounting pad 34 includes the first conductive layer 26B and the second conductive layer 28B which are sequentially laminated on the insulating layer 24 like the sensor electrode 32, but as shown in FIGS. 1 and 2, the mounting pad 34 includes the first conductive layer 26B and the second conductive layer 28B. The opening 36 is not provided with the second conductive layer 28B.

第1導電層26A、26Bの材料は、用途や目的等に応じて適宜選択可能であり、具体例としては、アルミ(Al)が挙げられる。第1導電層26A、26Bの厚さの具体例としては、1μmが挙げられる。 The materials of the first conductive layers 26A and 26B can be appropriately selected depending on the application, purpose and the like, and specific examples thereof include aluminum (Al). Specific examples of the thickness of the first conductive layers 26A and 26B include 1 μm.

第2導電層28A、28BとしてはTi含有膜が用いられ、材料の具体例としては、窒化チタン(TiN)が挙げられる。第2導電層28A、28Bの厚さの具体例としては、0.1μmが挙げられる。 Ti-containing films are used as the second conductive layers 28A and 28B, and specific examples of the materials include titanium nitride (TiN). Specific examples of the thickness of the second conductive layers 28A and 28B include 0.1 μm.

上層保護膜30は、外的要因により腐食等が生じ易い第1導電層26A、26Bの側面を保護する機能を有しており、センサ電極32に対応する開口部35、及び実装用パッド34に対応する開口部36を備える。上層保護膜30として単層の窒化膜や、酸化膜と窒化膜との積層膜が用いられる。上層保護膜30の厚さの具体例としては、0.8μmが挙げられる。 The upper protective film 30 has a function of protecting the side surfaces of the first conductive layers 26A and 26B, which are easily corroded by external factors, and is provided in the opening 35 corresponding to the sensor electrode 32 and the mounting pad 34. A corresponding opening 36 is provided. As the upper protective film 30, a single-layer nitride film or a laminated film of an oxide film and a nitride film is used. Specific examples of the thickness of the upper protective film 30 include 0.8 μm.

プリント基板12上にはパッド14が配置されており、実装用パッド34の第1導電層26Bとパッド14とは、ワイヤ19及びワイヤ19のボール16により接続されている。また、実装用パッド34(実装用パッド形成領域41)、ボール16、ワイヤ19、及びパッド14は、封止樹脂18により封止されている。 A pad 14 is arranged on the printed circuit board 12, and the first conductive layer 26B of the mounting pad 34 and the pad 14 are connected by a wire 19 and a ball 16 of the wire 19. Further, the mounting pad 34 (mounting pad forming region 41), the ball 16, the wire 19, and the pad 14 are sealed with the sealing resin 18.

次に、図3を参照して本実施形態の半導体装置20の製造方法の一例について説明する。 Next, an example of the manufacturing method of the semiconductor device 20 of the present embodiment will be described with reference to FIG.

本実施形態の半導体装置20の製造方法では、まず、センサ電極32用の第2導電層28を形成する第1工程を実施する。図3の第1工程に示すように、まず、主面上に、センサ電極形成領域40と、実装用パッド形成領域41とを備えた半導体装置22を準備する。そして、半導体基板22の主面上に絶縁層24を形成する。絶縁層24の形成方法の具体例としては、熱酸化法やCVD(Chemical Vapor Deposition)法が挙げられる。さらに、第1工程では、絶縁層24上に順次、第1導電層26及び第2導電層28を形成する。第1導電層26及び第2導電層28の形成方法の具体例としては、スパッタが挙げられる。本実施形態では、同一装置内においてスパッタにより第1導電層26及び第2導電層28を順次、形成する。このように、第1導電層26及び第2導電層28を同一装置内で形成することで第1導電層26と第2導電層28との密着性が確保される。第2導電層28の形成方法の具体例としては、NガスでTiターゲットをスパッタリングすることにより、TiNの導電膜を形成する方法が挙げられる。 In the method for manufacturing the semiconductor device 20 of the present embodiment, first, the first step of forming the second conductive layer 28 for the sensor electrode 32 is carried out. As shown in the first step of FIG. 3, first, a semiconductor device 22 having a sensor electrode forming region 40 and a mounting pad forming region 41 is prepared on the main surface. Then, the insulating layer 24 is formed on the main surface of the semiconductor substrate 22. Specific examples of the method for forming the insulating layer 24 include a thermal oxidation method and a CVD (Chemical Vapor Deposition) method. Further, in the first step, the first conductive layer 26 and the second conductive layer 28 are sequentially formed on the insulating layer 24. Specific examples of the method for forming the first conductive layer 26 and the second conductive layer 28 include sputtering. In the present embodiment, the first conductive layer 26 and the second conductive layer 28 are sequentially formed by sputtering in the same apparatus. By forming the first conductive layer 26 and the second conductive layer 28 in the same apparatus in this way, the adhesion between the first conductive layer 26 and the second conductive layer 28 is ensured. Specific examples of the method for forming the second conductive layer 28 include a method for forming a conductive film of TiN by sputtering a Ti target with N 2 gas.

次に、レジストマスク50A、50Bを形成する第2工程を実施する。図3の第2工程に示すように、第2導電層28上のセンサ電極形成領域40に、センサ電極32のパターンに応じた領域を被覆するレジストマスク50Aを形成し、また同時に、実装用パッド形成領域41に、実装用パッド34のパターンに応じた領域を被覆するレジストマスク50Bを形成する。また、記載を省略したが、本第2工程において、レジストマスク50A、50Bと同時に、配線29(図1参照)を形成する領域を被覆するレジストマスクも形成する。 Next, the second step of forming the resist masks 50A and 50B is carried out. As shown in the second step of FIG. 3, a resist mask 50A covering a region corresponding to the pattern of the sensor electrode 32 is formed in the sensor electrode forming region 40 on the second conductive layer 28, and at the same time, a mounting pad is formed. A resist mask 50B that covers a region corresponding to the pattern of the mounting pad 34 is formed in the formation region 41. Further, although the description is omitted, in the second step, at the same time as the resist masks 50A and 50B, a resist mask covering the region forming the wiring 29 (see FIG. 1) is also formed.

レジストマスク50A、50Bの形成方法としては、既知のリソグラフィ技術を適用することが可能である。リソグラフィ技術としては、第2導電層28上にレジストマスクを塗布するレジストマスク塗布ステップ、当該レジストマスクに所望のパターンを露光する露光ステップ、及び露光されたパターンに応じてレジストマスクを形成する現像ステップを含む。 As a method for forming the resist masks 50A and 50B, a known lithography technique can be applied. As a lithography technique, a resist mask coating step of applying a resist mask on the second conductive layer 28, an exposure step of exposing a desired pattern to the resist mask, and a developing step of forming a resist mask according to the exposed pattern. including.

次に、第1導電層26及び第2導電層28をエッチングする第3工程を実施する。図3の第3工程に示すように、レジストマスク50A、50Bをマスクとして、第2導電層28及び第1導電層26をドライエッチング法等によりエッチングすることで、センサ電極32のパターンに応じた第1導電層26A及び第2導電層28Aと、実装用パッド34のパターンに応じた第1導電層26B及び第2導電層28Bと、配線29(図1参照)とを形成する。第3工程により形成された第2導電層28Aがセンサ電極32の電極層として機能する。また、第3工程により形成された第1導電層26Bが実装電極として機能する。 Next, a third step of etching the first conductive layer 26 and the second conductive layer 28 is carried out. As shown in the third step of FIG. 3, the second conductive layer 28 and the first conductive layer 26 were etched by a dry etching method or the like using the resist masks 50A and 50B as masks, so that the pattern of the sensor electrode 32 was adjusted. The first conductive layer 26A and the second conductive layer 28A, the first conductive layer 26B and the second conductive layer 28B corresponding to the pattern of the mounting pad 34, and the wiring 29 (see FIG. 1) are formed. The second conductive layer 28A formed in the third step functions as an electrode layer of the sensor electrode 32. Further, the first conductive layer 26B formed in the third step functions as a mounting electrode.

本第3工程では、エッチングを行う際に、第1導電層26Aの端面と第2導電層28Aの端面とが面一となり、第1導電層26Bの端面と第2導電層28Bの端面とが面一となるようにしている。なお、本実施形態において「端面」とは、積層方向の面、例えば、主面の周囲の側面のことをいう。また、本実施形態で「面一」とは、誤差も含み、面一と見なせることをいう。 In the third step, when etching is performed, the end face of the first conductive layer 26A and the end face of the second conductive layer 28A are flush with each other, and the end face of the first conductive layer 26B and the end face of the second conductive layer 28B are flush with each other. I try to be flush. In the present embodiment, the "end surface" refers to a surface in the stacking direction, for example, a side surface around the main surface. Further, in the present embodiment, "facial" means that it can be regarded as flush, including an error.

次に、レジストマスク50A、50Bを除去する第4工程を実施する。図3の第4工程に示すように、例えば、酸素プラズマ等でアッシング後、残滓を薬液洗浄等により除去することにより、レジストマスク50A、50Bを除去する。 Next, a fourth step of removing the resist masks 50A and 50B is carried out. As shown in the fourth step of FIG. 3, the resist masks 50A and 50B are removed by, for example, ashing with oxygen plasma or the like and then removing the residue by chemical washing or the like.

次に、上層保護膜30を形成する第5工程を実施する。図3の第5工程に示すように、プラズマCVD法等により、絶縁層24の表面、センサ電極32及び実装用パッド34を被覆する上層保護膜30を形成する。 Next, the fifth step of forming the upper protective film 30 is carried out. As shown in the fifth step of FIG. 3, the upper protective film 30 that covers the surface of the insulating layer 24, the sensor electrode 32, and the mounting pad 34 is formed by a plasma CVD method or the like.

次に、レジストマスク52を形成する第6工程を実施する。図3の第6工程に示すように、センサ電極32の第2導電層28Aを露出させる領域に対応する開口部53Aと、実装用パッド34の第1導電層26Bを露出させる領域に対応する開口部53Bとを有するレジストマスク52を、上層保護膜30上に形成する。レジストマスク52の形成方法は特に限定されないが、例えば、上述した第2工程におけるレジストマスク50A、50Bと同様に、既知のリソグラフィ技術を適用することが可能である。 Next, the sixth step of forming the resist mask 52 is carried out. As shown in the sixth step of FIG. 3, the opening 53A corresponding to the region where the second conductive layer 28A of the sensor electrode 32 is exposed and the opening corresponding to the region where the first conductive layer 26B of the mounting pad 34 is exposed. A resist mask 52 having a portion 53B is formed on the upper protective film 30. The method for forming the resist mask 52 is not particularly limited, but for example, a known lithography technique can be applied as in the resist masks 50A and 50B in the second step described above.

ここで、第6工程の露光ステップでは下層のセンサ電極32及び実装用パッド34と上層のレジストマスクの開口部53A、53Bとを重ね合わせることで、センサ電極32及び実装用パッド34の所望の位置に上層保護膜30の開口部35と開口部36とを形成する。上層のレジストマスク53A、53Bと下層のセンサ電極32、実装用パッド34との過剰なずれにより、センサ電極32及び実装用パッド34と上層保護膜30の開口部35及び開口部36がずれを生じ、半導体装置20が所望の機能を満たさないという不具合が生じないために、上層のレジストマスク53A、53Bと下層のセンサ電極32及び実装用パッド34とを重ね合わせるための重ね合わせマージンを必要とする。当該重ね合わせマージンは、露光機自身の重ね合わせ精度に加え、センサ電極32及び実装用パッド34の加工バラツキに応じた寸法を必要とする。 Here, in the exposure step of the sixth step, the lower layer sensor electrode 32 and the mounting pad 34 and the upper layer resist mask openings 53A and 53B are overlapped with each other to obtain a desired position of the sensor electrode 32 and the mounting pad 34. The opening 35 and the opening 36 of the upper protective film 30 are formed in the upper layer protective film 30. Excessive displacement between the upper resist masks 53A and 53B and the lower sensor electrodes 32 and mounting pads 34 causes displacement between the sensor electrodes 32 and the mounting pads 34 and the openings 35 and 36 of the upper protective film 30. In order not to cause a problem that the semiconductor device 20 does not satisfy the desired function, a superposition margin for superimposing the upper layer resist masks 53A and 53B on the lower layer sensor electrode 32 and the mounting pad 34 is required. .. The superposition margin requires dimensions according to the processing variation of the sensor electrode 32 and the mounting pad 34, in addition to the superposition accuracy of the exposure machine itself.

ここで、次の第7工程において形成される上層保護膜30の開口部35内に第1導電層26Aが露出すると、半導体装置20をセンサとして使用時に第1導電層26Aが使用環境により腐食を生じ、センサの機能に不具合を生じるため、センサ電極形成領域40の開口部53Aは露光ステップで用いられる露光機の重ね合わせ精度を考慮した重ね合わせマージンを考慮する必要がある。言い換えれば、必要な開口部35(第2導電層28Aの露出サイズ)に重ね合わせマージンを加えた領域をセンサ電極32のサイズとする必要がある。 Here, when the first conductive layer 26A is exposed in the opening 35 of the upper layer protective film 30 formed in the next seventh step, the first conductive layer 26A is corroded by the usage environment when the semiconductor device 20 is used as a sensor. The opening 53A of the sensor electrode forming region 40 needs to consider a superposition margin in consideration of the superposition accuracy of the exposure machine used in the exposure step. In other words, the size of the sensor electrode 32 needs to be a region obtained by adding the overlapping margin to the required opening 35 (exposed size of the second conductive layer 28A).

次に、上層保護膜30をエッチングする第7工程を実施する。図3の第7工程に示すように、レジストマスク52をマスクとして、上層保護膜30をエッチングし、開口部35、36を形成する。なお、この際、上層保護膜30のエッチングレートと、第2導電層28A、28Bのエッチングレートとの選択比が高く、開口部35の底面の第2導電層28A、及び開口部36の底面の第2導電層28Bが除去されないエッチングプロセスでエッチングを行う。 Next, a seventh step of etching the upper protective film 30 is carried out. As shown in the seventh step of FIG. 3, the upper protective film 30 is etched using the resist mask 52 as a mask to form the openings 35 and 36. At this time, the selection ratio between the etching rate of the upper protective film 30 and the etching rates of the second conductive layers 28A and 28B is high, and the second conductive layer 28A on the bottom surface of the opening 35 and the bottom surface of the opening 36 have a high selection ratio. Etching is performed in an etching process in which the second conductive layer 28B is not removed.

次に、レジストマスク52を除去する第8工程を実施する。図3の第8工程に示すように、例えば、第4工程で上述したのと同様に、酸素プラズマ等でアッシング後、残滓を薬液洗浄等により除去することによりレジストマスク52を除去する。 Next, the eighth step of removing the resist mask 52 is carried out. As shown in the eighth step of FIG. 3, for example, as described above in the fourth step, the resist mask 52 is removed by ashing with oxygen plasma or the like and then removing the residue by washing with a chemical solution or the like.

次に、レジストマスク56を形成する第9工程を実施する。図3の第9工程に示すように、実装用パッド形成領域41の第1導電層26Bを露出する開口部36を内包する領域に対応する開口部57を備えたレジストマスク56を形成する。なお、本第9工程では、センサ電極32上の上層保護膜30の開口部35から露出した第2導電層28Aは、レジストマスク56により被覆された状態である。 Next, the ninth step of forming the resist mask 56 is carried out. As shown in the ninth step of FIG. 3, a resist mask 56 having an opening 57 corresponding to a region including an opening 36 that exposes the first conductive layer 26B of the mounting pad forming region 41 is formed. In the ninth step, the second conductive layer 28A exposed from the opening 35 of the upper protective film 30 on the sensor electrode 32 is in a state of being covered with the resist mask 56.

次に、上層保護膜30の開口部36から露出する第2導電層28Bを除去する第10工程を実施する。図3の第10工程に示すように、レジストマスク56及び上層保護膜30をマスクとしてセルフアラインによりエッチングを行う。なお、本第10工程では、センサ電極32の第2導電層28Aは、レジストマスク56により被覆された状態であるためエッチングされない。このように、レジストマスク56及び上層保護膜30をマスクとしてセルフアラインによりエッチングを行うことにより、第2導電層28Bを有した状態とし、開口部36の大きさを最小限とすることができる。そのため、半導体装置20では、チップサイズの縮小を可能とすると共に、製造コストを低減することが可能となる。 Next, the tenth step of removing the second conductive layer 28B exposed from the opening 36 of the upper layer protective film 30 is carried out. As shown in the tenth step of FIG. 3, etching is performed by self-alignment using the resist mask 56 and the upper protective film 30 as masks. In the tenth step, the second conductive layer 28A of the sensor electrode 32 is not etched because it is covered with the resist mask 56. By performing etching by self-alignment using the resist mask 56 and the upper layer protective film 30 as masks in this way, the second conductive layer 28B can be provided and the size of the opening 36 can be minimized. Therefore, in the semiconductor device 20, the chip size can be reduced and the manufacturing cost can be reduced.

また、レジストマスク56から露出している上層保護膜30表面は第2導電層28Bと同時にエッチングされるため、開口部36を内包する領域の境界、すなわちレジストマスク56の開口部57のエッジに対応した開口部36の周囲に段差31が生じる。 Further, since the surface of the upper protective film 30 exposed from the resist mask 56 is etched at the same time as the second conductive layer 28B, it corresponds to the boundary of the region including the opening 36, that is, the edge of the opening 57 of the resist mask 56. A step 31 is formed around the formed opening 36.

次に、レジストマスク56を除去する第11工程を実施する。図3の第11工程に示すように、例えば、第4工程で上述したのと同様に、酸素プラズマ等でアッシング後、残滓を薬液洗浄等により除去することによりレジストマスク56を除去する。 Next, the eleventh step of removing the resist mask 56 is carried out. As shown in the eleventh step of FIG. 3, for example, in the same manner as described above in the fourth step, the resist mask 56 is removed by ashing with oxygen plasma or the like and then removing the residue by washing with a chemical solution or the like.

本実施形態では、このように図3に示した第1〜第11工程により、図1、2に示した半導体装置20が製造される。 In the present embodiment, the semiconductor device 20 shown in FIGS. 1 and 2 is manufactured by the first to eleventh steps shown in FIG.

本実施形態の半導体装置20をECセンサとして用いて分散系の一例である土壌中の水分量を特定する方法は特に限定されない。一例として、電気信号の位相変化θを検出することにより水分量を特定する方法について説明する。 The method of specifying the water content in the soil, which is an example of the dispersion system, using the semiconductor device 20 of the present embodiment as an EC sensor is not particularly limited. As an example, a method of specifying the water content by detecting the phase change θ of the electric signal will be described.

半導体装置20の出力は、水分量及びイオン濃度に比例し、イオン濃度が特定されれば、EC(電気伝導度)により土壌中の水分量を特定することができる。 The output of the semiconductor device 20 is proportional to the water content and the ion concentration, and if the ion concentration is specified, the water content in the soil can be specified by EC (electrical conductivity).

測定を行う場合、図4に示すように、半導体装置20の実装用パッド34は、パッド14を介して制御部1に接続される。 When performing measurement, as shown in FIG. 4, the mounting pad 34 of the semiconductor device 20 is connected to the control unit 1 via the pad 14.

まず、半導体装置20のセンサ電極32(より具体的には第2導電層28A)を測定対象の土壌に接触させる。測定を行う場合、一方のセンサ電極32_1に、制御部1から所定の任意の周波数の交流電気信号を入力信号として印加する。センサ電極32_1は、当該入力信号を出力する。センサ電極32_2は、センサ電極32_1から出力された入力信号が、測定対象を介して出力信号として入力される。制御部1は、その位相と他方のセンサ電極32_2から出力される電気信号の位相とを比較する。比較結果の具体例としては、両者の位相差(位相変化θ)を検出することが挙げられる。位相変化θを検出した場合、検出した位相変化θによりイオン濃度を特定する。なお、位相変化θと、イオン濃度とは予め対応付けられている。さらに、特定されたイオン濃度を基準にして、測定されたECにより土壌の水分量を特定することができる。なお、本実施形態の半導体装置20では、時分割方式でセンサ電極32を用いて位相変化θを検出することができるため、位相変化θの検出用の電極(例えば、従来技術(国際公開第2011/158812号)の半導体装置における移動測定用の電極)を設けずとも、ECを測定することができる。 First, the sensor electrode 32 (more specifically, the second conductive layer 28A) of the semiconductor device 20 is brought into contact with the soil to be measured. When performing measurement, an AC electric signal having a predetermined frequency is applied as an input signal from the control unit 1 to one of the sensor electrodes 32_1. The sensor electrode 32_1 outputs the input signal. In the sensor electrode 32_2, the input signal output from the sensor electrode 32_1 is input as an output signal via the measurement target. The control unit 1 compares the phase with the phase of the electric signal output from the other sensor electrode 32_2. A specific example of the comparison result is to detect the phase difference (phase change θ) between the two. When the phase change θ is detected, the ion concentration is specified by the detected phase change θ. The phase change θ and the ion concentration are associated with each other in advance. Furthermore, the water content of the soil can be specified by the measured EC based on the specified ion concentration. In the semiconductor device 20 of the present embodiment, since the phase change θ can be detected by using the sensor electrode 32 in the time division method, the electrode for detecting the phase change θ (for example, the prior art (International Publication No. 2011)). EC can be measured without providing the electrode for movement measurement in the semiconductor device of / 158812)).

なお、その他の方法としては、2点間の電磁波の伝播速度から、その間の水分量を求めるTDR(Time Domain Reflectometry)法(例えば、特開平10−62368号公報参照)や、土壌の静電容量を測定する方法(例えば、特開2001−21517号公報参照)等が挙げられる。 Other methods include the TDR (Time Domain Reflectometry) method (see, for example, Japanese Patent Application Laid-Open No. 10-62368) in which the amount of water between two points is determined from the propagation velocity of electromagnetic waves between the two points, and the capacitance of soil. (For example, see Japanese Patent Application Laid-Open No. 2001-21517) and the like.

以上説明したように本実施形態の半導体装置20は、半導体基板22と、半導体基板22の主面上に形成され、第1導電層26Aと、第1導電層26Aの上に形成されると共に端面が第1導電層26Aの端面と面一である第2導電層28Aとを備え、入力信号を出力するセンサ電極32_1と、半導体基板22の主面上に形成され、第1導電層26Bと、第1導電層26Bの上に形成されると共に端面が第1導電層26Bの端面と面一である第2導電層28Bとを備え、センサ電極32_1から出力された入力信号が出力信号として入力されるセンサ電極32_2と、第1導電層26Aの側面と第2導電層28Aの側面及び表面の外周と、第1導電層26Bの側面と第2導電層28Bの側面及び表面の外周と、を被覆すると共に第1導電層26Aの開口部35(センサ電極32)に応じた定められた領域の表面を露出する上層保護膜30と、を備える。 As described above, the semiconductor device 20 of the present embodiment is formed on the semiconductor substrate 22 and the main surface of the semiconductor substrate 22, is formed on the first conductive layer 26A and the first conductive layer 26A, and has an end surface. Is provided with a second conductive layer 28A that is flush with the end surface of the first conductive layer 26A, and is formed on the main surface of the semiconductor substrate 22 and the sensor electrode 32_1 that outputs an input signal. The second conductive layer 28B, which is formed on the first conductive layer 26B and whose end face is flush with the end face of the first conductive layer 26B, is provided, and the input signal output from the sensor electrode 32_1 is input as an output signal. Covers the sensor electrode 32_2, the side surface of the first conductive layer 26A, the outer periphery of the side surface and the surface of the second conductive layer 28A, and the outer periphery of the side surface of the first conductive layer 26B and the side surface and the surface of the second conductive layer 28B. In addition, an upper protective film 30 that exposes the surface of a predetermined region corresponding to the opening 35 (sensor electrode 32) of the first conductive layer 26A is provided.

特許文献1に記載の半導体装置120において生じる1つ目の課題に対する本実施形態の半導体装置20の作用について、図5を参照して説明する。 The operation of the semiconductor device 20 of the present embodiment on the first problem that occurs in the semiconductor device 120 described in Patent Document 1 will be described with reference to FIG.

本実施形態の半導体装置20では、センサ電極32の第2導電層28Aに、Ti含有膜であるTiN膜を用いており、第1導電層26Aと第2導電層28Aとを、第3工程において説明したように、同一のレジストマスク50A、50Bを用いて加工する。 In the semiconductor device 20 of the present embodiment, a TiN film which is a Ti-containing film is used for the second conductive layer 28A of the sensor electrode 32, and the first conductive layer 26A and the second conductive layer 28A are combined in the third step. As described, the same resist masks 50A and 50B are used for processing.

このため、ドライエッチングで加工された第1導電層26Aの端部と第2導電層28Aの端部とは同一の加工面で形成されるため、特許文献1に記載の半導体装置120を製造する際に必要であった重ね合わせマージンL101(図9及び図10参照)が、図5に示すように不要(重ね合わせマージンL1=0)となる。 Therefore, since the end portion of the first conductive layer 26A and the end portion of the second conductive layer 28A processed by dry etching are formed on the same processed surface, the semiconductor device 120 described in Patent Document 1 is manufactured. The superposition margin L101 (see FIGS. 9 and 10) required at this time becomes unnecessary (superimposition margin L1 = 0) as shown in FIG.

さらに、一般的に、ドライエッチングで加工されたパターンの端部はレジストマスクに依存するため、特許文献1に記載の半導体装置120を製造する場合に用いていたリフトオフ法で加工された場合にパターンの端部に生じるバラツキ160(図10参照)が生じず、パターン端部60の形成精度が高い。そのため、本実施形態の半導体装置20を製造する場合、上述したように、特許文献1に記載の半導体装置120を製造する際にリフトオフ法を用いることにより生じる結合層127及び第2導電層128の積層膜の端部160のバラツキを考慮する必要がなく、図5に示すように、露光機の重ね合わせ精度に応じた重ね合わせマージンL2、すなわち最小の重ね合わせマージンとすることができる。そのため、本実施形態の半導体装置20の製造工程の第6工程における重ね合わせマージンL2は、特許文献1に記載の半導体装置120を製造する際に必要であった重ね合わせマージンL102に比して極めて小さくなる。 Further, in general, since the end portion of the pattern processed by dry etching depends on the resist mask, the pattern is processed by the lift-off method used in manufacturing the semiconductor device 120 described in Patent Document 1. The variation 160 (see FIG. 10) that occurs at the end portion of the pattern does not occur, and the forming accuracy of the pattern end portion 60 is high. Therefore, when manufacturing the semiconductor device 20 of the present embodiment, as described above, the bonding layer 127 and the second conductive layer 128 generated by using the lift-off method when manufacturing the semiconductor device 120 described in Patent Document 1. It is not necessary to consider the variation of the end portion 160 of the laminated film, and as shown in FIG. 5, the overlay margin L2 according to the overlay accuracy of the exposure machine, that is, the minimum overlay margin can be set. Therefore, the overlap margin L2 in the sixth step of the manufacturing process of the semiconductor device 20 of the present embodiment is extremely larger than the overlap margin L102 required when manufacturing the semiconductor device 120 described in Patent Document 1. It becomes smaller.

すなわち、特許文献1に記載の半導体装置120では、重ね合わせマージンL101及び重ね合わせマージンL102が必要であったが、図5に示すように、本実施形態の半導体装置20において必要となる重ね合わせマージンL3は、重ね合わせマージンL1と等しくなり、かつ、重ね合わせマージンL102よりも小さくなる。 That is, in the semiconductor device 120 described in Patent Document 1, the superposition margin L101 and the superposition margin L102 were required, but as shown in FIG. 5, the superposition margin required in the semiconductor device 20 of the present embodiment is required. L3 is equal to the overlap margin L1 and smaller than the overlap margin L102.

従って、本実施形態の半導体装置20のセンサ電極32は、上層保護膜30によりセンサ電極32の端部(側面)を完全に被覆すると共に、第6工程における重ね合わせマージンL2のみを考慮すればよく、第1導電層26Aの面積に対して最大の大きさの第2導電層28Aを上層保護膜30から露出させることが可能となる。 Therefore, the sensor electrode 32 of the semiconductor device 20 of the present embodiment completely covers the end portion (side surface) of the sensor electrode 32 with the upper layer protective film 30, and only the overlap margin L2 in the sixth step needs to be considered. The second conductive layer 28A, which has the maximum size with respect to the area of the first conductive layer 26A, can be exposed from the upper protective film 30.

このため、本実施形態の半導体装置20では、特許文献1に記載の半導体装置120に比べてセンサの感度を高くすることができ、さらに、チップサイズの縮小等によるコストダウンを行った際にもセンサの感度を維持することが可能になる。 Therefore, in the semiconductor device 20 of the present embodiment, the sensitivity of the sensor can be increased as compared with the semiconductor device 120 described in Patent Document 1, and even when the cost is reduced by reducing the chip size or the like. It becomes possible to maintain the sensitivity of the sensor.

次に、特許文献1に記載の半導体装置120において生じる2つ目の課題に対する本実施形態の半導体装置20の作用について、図6を参照して説明する。 Next, the operation of the semiconductor device 20 of the present embodiment on the second problem that occurs in the semiconductor device 120 described in Patent Document 1 will be described with reference to FIG.

本実施形態の半導体装置20では、センサ電極32の第2導電層28Aに、Ti含有膜であるTiN膜を用いているため、図6に示すように第1導電層26Aと第2導電層28Aとを、上述の第1工程において同一装置内で連続して成膜し、さらに上述の第3工程において第1導電層26Aと第2導電層28Aとを同時にパターニングする。そのため、第1導電層26Aと第2導電層28Aの密着性を阻害する要因が存在しない。 In the semiconductor device 20 of the present embodiment, since the TiN film which is a Ti-containing film is used for the second conductive layer 28A of the sensor electrode 32, the first conductive layer 26A and the second conductive layer 28A are shown in FIG. Are continuously formed in the same apparatus in the above-mentioned first step, and the first conductive layer 26A and the second conductive layer 28A are simultaneously patterned in the above-mentioned third step. Therefore, there is no factor that hinders the adhesion between the first conductive layer 26A and the second conductive layer 28A.

また、図6に示すように、上述の第4工程においてレジストマス50Aを除去する際に、第2導電層28Aの表面が清浄になる。 Further, as shown in FIG. 6, when the resist mass 50A is removed in the above-mentioned fourth step, the surface of the second conductive layer 28A becomes clean.

その後、図6に示すように、上述の第5工程により、上層保護膜30を形成し、さらに第8工程では、上層保護膜30上に形成されたレジストマスク52を除去し、また、第11工程では、レジストマスク56を除去する。レジストマスク52を除去する際、及びレジストマスク56を除去する際、第2導電層28Aの表面が清浄になる。 After that, as shown in FIG. 6, the upper layer protective film 30 is formed by the above-mentioned fifth step, and further, in the eighth step, the resist mask 52 formed on the upper layer protective film 30 is removed, and the eleventh step is performed. In the process, the resist mask 56 is removed. When the resist mask 52 is removed and when the resist mask 56 is removed, the surface of the second conductive layer 28A becomes clean.

即ち、本実施形態の半導体装置20の製造方法においては、第1導電層26A及び第2導電層28Aの加工にリフトオフ法を使用する必要がなく、特許文献1に記載の半導体装置120の製造方法のように、第1導電層26が露出した状態で、レジストマスクの表面が逆スパッタされる工程が存在しない。 That is, in the method for manufacturing the semiconductor device 20 of the present embodiment, it is not necessary to use the lift-off method for processing the first conductive layer 26A and the second conductive layer 28A, and the method for manufacturing the semiconductor device 120 described in Patent Document 1 As described above, there is no step of reverse sputtering the surface of the resist mask with the first conductive layer 26 exposed.

従って、本実施形態の半導体装置20では、第1導電層26Aと第2導電層28Aとの界面に存在する不純物を抑制するため、当該界面を不純物が存在しない理想的な状態に近づけることが可能となる。 Therefore, in the semiconductor device 20 of the present embodiment, since impurities existing at the interface between the first conductive layer 26A and the second conductive layer 28A are suppressed, it is possible to bring the interface closer to an ideal state in which impurities do not exist. It becomes.

不純物の存在を抑制するため、本実施形態の半導体装置20では、第1導電層26Aと第2導電層28Aとの電気的な接続を安定した状態とすることが可能となり、製造における歩留まりを向上させることが可能となる。また、本実施形態の半導体装置20では、第1導電層26Aと第2導電層28Aとの密着性を高めることが可能となり、長期間にわたる使用においても第1導電層26Aと第2導電層28Aとの電気的な接続不良が生じないため、信頼性を向上させることが可能となる。 In order to suppress the presence of impurities, in the semiconductor device 20 of the present embodiment, the electrical connection between the first conductive layer 26A and the second conductive layer 28A can be made stable, and the yield in manufacturing is improved. It becomes possible to make it. Further, in the semiconductor device 20 of the present embodiment, it is possible to improve the adhesion between the first conductive layer 26A and the second conductive layer 28A, and the first conductive layer 26A and the second conductive layer 28A can be used for a long period of time. It is possible to improve the reliability because the electrical connection failure with the device does not occur.

本実施形態の半導体装置20により測定した土壌の電気伝導度の周波数特性として、測定周波数に対するインピーダンスZ及び位相差Θを示すグラフを図7Aに示す。また、特許文献1に記載の半導体装置120により測定した土壌の電気伝導度の周波数特性として、測定周波数に対するインピーダンスZ及び位相差Θを示すグラフを図7Bに示す。図7A、6Bに示すように、本実施形態の半導体装置20のセンサ電極32、具体的には第2導電層28Aと、特許文献1に記載の半導体装置120のセンサ電極132、具体的には第2導電層128とが異なっていても、周波数特性に大きな差(測定上問題となる程度の差)は生じていない。 FIG. 7A shows a graph showing the impedance Z and the phase difference Θ with respect to the measurement frequency as the frequency characteristics of the electrical conductivity of the soil measured by the semiconductor device 20 of the present embodiment. Further, FIG. 7B shows a graph showing the impedance Z and the phase difference Θ with respect to the measurement frequency as the frequency characteristics of the electrical conductivity of the soil measured by the semiconductor device 120 described in Patent Document 1. As shown in FIGS. 7A and 6B, the sensor electrode 32 of the semiconductor device 20 of the present embodiment, specifically, the second conductive layer 28A, and the sensor electrode 132 of the semiconductor device 120 described in Patent Document 1, specifically, Even if it is different from the second conductive layer 128, there is no large difference in frequency characteristics (difference to the extent that it causes a problem in measurement).

このように、本実施形態の半導体装置20では、センサ電極32を特許文献1に記載の半導体装置120のセンサ電極132と異ならせても、周波数特性を維持しつつ、センサの感度低下を抑制すると共に、信頼性を向上させることができる。 As described above, in the semiconductor device 20 of the present embodiment, even if the sensor electrode 32 is different from the sensor electrode 132 of the semiconductor device 120 described in Patent Document 1, the frequency characteristic is maintained and the decrease in the sensitivity of the sensor is suppressed. At the same time, reliability can be improved.

また、本実施形態の半導体装置20では、第2導電層28A、28BとしてTi含有膜(TiN)を用いており、レアメタルかつ貴金属である高価な白金を用いていないため、半導体装置20の製造コストを抑制することができる。また、一般的にTiNは、白金に比べて機械的な強度が高いため、本実施形態の半導体装置20では、粘土、土、砂等の半固形物である被測定物との接触により生じる摩擦等により、第2導電層28Aの表面あれや削れ等が抑制されるため、電気伝導度の劣化を抑制することができる。 Further, in the semiconductor device 20 of the present embodiment, Ti-containing films (TiN) are used as the second conductive layers 28A and 28B, and expensive platinum, which is a rare metal and a precious metal, is not used. Therefore, the manufacturing cost of the semiconductor device 20 is high. Can be suppressed. Further, since TiN generally has higher mechanical strength than platinum, in the semiconductor device 20 of the present embodiment, friction caused by contact with a semi-solid object such as clay, soil, and sand is generated. As a result, surface roughness and scraping of the second conductive layer 28A are suppressed, so that deterioration of electrical conductivity can be suppressed.

また、本実施形態の半導体装置20の製造方法では、リフトオフ法を用いておらずリフトオフ法を用いたことに起因とする不純物が生じないため、上述の効果の他、スパッタ装置や有機溶剤の剥離設備が不純物により汚染されることがなく、設備メンテナンスの費用及び時間等を抑制することができる。 Further, in the manufacturing method of the semiconductor device 20 of the present embodiment, since the lift-off method is not used and impurities due to the use of the lift-off method are not generated, in addition to the above-mentioned effects, the sputtering device and the organic solvent are peeled off. The equipment is not contaminated by impurities, and the cost and time for equipment maintenance can be suppressed.

なお、本実施形態の半導体装置20は、センサ電極32から出力された電気信号を増幅する処理や、電気信号に含まれるノイズを除去する処理等、当該電気信号の処理を行う演算回路を備えていてもよい。演算回路を備える場合、図示を省略するが例えば、半導体基板22上に、一般的なICの製造プロセスを実施し、MOSトランジスタ、バイポーラ、抵抗素子、及び容量素子等、所望の素子等を備える演算回路を製造し、演算回路上を平坦化するように絶縁層24を形成すればよい。 The semiconductor device 20 of the present embodiment includes an arithmetic circuit that processes the electric signal, such as a process of amplifying the electric signal output from the sensor electrode 32 and a process of removing noise contained in the electric signal. You may. When an arithmetic circuit is provided, although not shown, for example, an arithmetic in which a general IC manufacturing process is carried out on a semiconductor substrate 22 and a desired element such as a MOS transistor, a bipolar, a resistance element, and a capacitive element is provided. The circuit may be manufactured and the insulating layer 24 may be formed so as to flatten the arithmetic circuit.

また、半導体装置20のセンサ電極32及び実装用パッド34の構成は、上述のものに限らない。例えば、図8に示すように、半導体装置20は、第1導電層26A、第3導電層27A、及び第2導電層28Aが順次積層されたセンサ電極32、及び第1導電層26B、第3導電層27B、及び第2導電層28Bが順次積層された実装用パッド34を備えていてもよい。第3導電層27A、27Bは、Ti膜であり、厚さの具体例としては0.1μmである。 Further, the configurations of the sensor electrode 32 and the mounting pad 34 of the semiconductor device 20 are not limited to those described above. For example, as shown in FIG. 8, the semiconductor device 20 includes a sensor electrode 32 in which a first conductive layer 26A, a third conductive layer 27A, and a second conductive layer 28A are sequentially laminated, and a first conductive layer 26B, a third. A mounting pad 34 in which the conductive layer 27B and the second conductive layer 28B are sequentially laminated may be provided. The third conductive layers 27A and 27B are Ti films, and the thickness is 0.1 μm as a specific example.

図8に示した半導体装置20を製造する場合、上述した半導体装置20の製造方法における第1工程(図3参照)において、絶縁層24上に順次、第1導電層26、第3導電層27A、27Bを形成するための第3導電層(図示省略)、及び第2導電層28を形成する。第3導電層の形成方法の具体例としては、ArガスでTiターゲットをスパッタリングすることにより、Ti膜を形成する方法が挙げられる。なお、第1導電層26及び第2導電層28の形成方法は、上述した半導体装置20の製造方法における第1工程で説明した方法と同様にすればよい。また、その他の製造方法における各工程も図3を参照して上述した工程と同様にすればよい。 When the semiconductor device 20 shown in FIG. 8 is manufactured, in the first step (see FIG. 3) in the method for manufacturing the semiconductor device 20 described above, the first conductive layer 26 and the third conductive layer 27A are sequentially placed on the insulating layer 24. , A third conductive layer (not shown) for forming 27B, and a second conductive layer 28 are formed. Specific examples of the method for forming the third conductive layer include a method for forming a Ti film by sputtering a Ti target with Ar gas. The method for forming the first conductive layer 26 and the second conductive layer 28 may be the same as the method described in the first step in the method for manufacturing the semiconductor device 20 described above. Further, each step in the other manufacturing methods may be the same as the above-described step with reference to FIG.

第3導電層27AはTi膜であり、一般的にTi膜はTiN膜よりも結晶粒の大きさが小さい。そのため、図8に示した半導体装置20のように第3導電層27Aを設ける場合、被測定物中に含まれる不純物が第1導電層26Aに拡散するのを抑制することができる。また、図8に示した半導体装置20では、Tiが例えば、液体中の酸素と結合することにより、酸化チタン(TiO)が形成されるが、TiO膜は拡散防止膜としての機能を有するため、センサ電極32の劣化を抑制する効果がより高くなる。 The third conductive layer 27A is a Ti film, and the Ti film generally has a smaller crystal grain size than the TiN film. Therefore, when the third conductive layer 27A is provided as in the semiconductor device 20 shown in FIG. 8, it is possible to prevent impurities contained in the object to be measured from diffusing into the first conductive layer 26A. Further, in the semiconductor device 20 shown in FIG. 8, for example, titanium oxide (TIO) is formed by binding Ti with oxygen in a liquid, but the TiO film has a function as a diffusion prevention film. The effect of suppressing deterioration of the sensor electrode 32 becomes higher.

なお、その他の上記各実施の形態で説明した半導体装置10及び半導体装置20の構成、動作、及び測定方法等は一例であり、本発明の主旨を逸脱しない範囲内において状況に応じて変更可能であることはいうまでもない。 The configurations, operations, measurement methods, etc. of the semiconductor device 10 and the semiconductor device 20 described in each of the above embodiments are examples, and can be changed according to the situation within a range not deviating from the gist of the present invention. Needless to say, there is.

10 半導体装置
20 半導体装置
22 半導体基板
24 絶縁層
26、26A、26B 第1導電層
28、28A、28B 第2導電層
30 上層保護膜
31 段差
32 センサ電極
34 実装用パッド
35、36 開口部
10 Semiconductor device 20 Semiconductor device 22 Semiconductor substrate 24 Insulation layer 26, 26A, 26B First conductive layer 28, 28A, 28B Second conductive layer 30 Upper layer protective film 31 Step 32 Sensor electrode 34 Mounting pad 35, 36 Opening

Claims (10)

半導体基板と、
前記半導体基板の主面上に形成され、第1センサ電極用第1導電層と、前記第1センサ電極用第1導電層の上に形成されると共に端面が前記第1センサ電極用第1導電層の端面と面一である第1センサ電極用第2導電層とを備え、入力信号を出力する第1センサ電極と、
前記半導体基板の主面上に形成され、第2センサ電極用第1導電層と、前記第2センサ電極用第1導電層の上に形成されると共に端面が前記第2センサ電極用第1導電層の端面と面一である第2センサ電極用第2導電層とを備え、前記第1センサ電極から出力された入力信号が出力信号として入力される第2センサ電極と、
前記第1センサ電極用第1導電層の側面と前記第1センサ電極用第2導電層の側面及び表面の外周と、前記第2センサ電極用第1導電層の側面と前記第2センサ電極用第2導電層の側面及び表面の外周と、を被覆すると共に前記第1センサ電極用第2導電層の前記第1センサ電極に応じた定められた領域の表面を露出する上層保護膜と、
前記第1センサ電極に対応すると共に、前記第1センサ電極に電気的に接続され、第1電極用第1導電層及び前記第1電極用第1導電層の上に形成されると共に端面が前記第1電極用第1導電層の端面と面一である第1電極用第2導電層とを備える第1電極と、
前記第2センサ電極に対応すると共に前記第2センサ電極に電気的に接続され、第2電極用第1導電層及び前記第2電極用第1導電層の上に形成されると共に端面が前記第2電極用第1導電層の端面と面一である第2電極用第2導電層とを備える第2電極と、
を備え、
前記上層保護膜は、前記第1電極と前記第2電極との上面を各々露出する開口部をさらに備え、前記開口部に対応する前記第1電極の上面には前記第1電極用第2導電層が設けられておらず前記第1電極用第1導電層が露出しており、前記開口部に対応する前記第2電極の上面には前記第2電極用第2導電層が設けられておらず前記第2電極用第1導電層が露出している、
半導体装置。
With a semiconductor substrate
It is formed on the main surface of the semiconductor substrate and is formed on the first conductive layer for the first sensor electrode and the first conductive layer for the first sensor electrode, and the end face is the first conductive layer for the first sensor electrode. A first sensor electrode having a second conductive layer for the first sensor electrode that is flush with the end face of the layer and outputting an input signal,
It is formed on the main surface of the semiconductor substrate and is formed on the first conductive layer for the second sensor electrode and the first conductive layer for the second sensor electrode, and the end face is the first conductive layer for the second sensor electrode. A second sensor electrode provided with a second conductive layer for the second sensor electrode that is flush with the end face of the layer, and an input signal output from the first sensor electrode is input as an output signal.
The side surface of the first conductive layer for the first sensor electrode, the side surface and the outer periphery of the surface of the second conductive layer for the first sensor electrode, the side surface of the first conductive layer for the second sensor electrode, and the second sensor electrode. An upper protective film that covers the side surface and the outer periphery of the surface of the second conductive layer and exposes the surface of a region defined according to the first sensor electrode of the second conductive layer for the first sensor electrode.
Corresponding to the first sensor electrode, it is electrically connected to the first sensor electrode and is formed on the first conductive layer for the first electrode and the first conductive layer for the first electrode, and the end face is said. A first electrode having a second conductive layer for the first electrode that is flush with the end face of the first conductive layer for the first electrode,
Corresponding to the second sensor electrode and electrically connected to the second sensor electrode, it is formed on the first conductive layer for the second electrode and the first conductive layer for the second electrode, and the end face is the first. A second electrode having a second conductive layer for a second electrode that is flush with the end face of the first conductive layer for two electrodes,
With
The upper protective film further includes an opening that exposes the upper surfaces of the first electrode and the second electrode, and the upper surface of the first electrode corresponding to the opening is provided with a second conductive material for the first electrode. The layer is not provided and the first conductive layer for the first electrode is exposed, and the second conductive layer for the second electrode is provided on the upper surface of the second electrode corresponding to the opening. The first conductive layer for the second electrode is exposed.
Semiconductor device.
前記第1センサ電極から出力された入力信号は土壌を介して出力信号として前記第2センサ電極に入力される、
請求項1に記載の半導体装置。
The input signal output from the first sensor electrode is input to the second sensor electrode as an output signal via the soil.
The semiconductor device according to claim 1.
前記第1センサ電極用第2導電層及び前記第2センサ電極用第2導電層がTiを含む物質で構成されている、
請求項1または請求項2に記載の半導体装置。
The second conductive layer for the first sensor electrode and the second conductive layer for the second sensor electrode are made of a substance containing Ti.
The semiconductor device according to claim 1 or 2.
前記第1電極並びに前記第2電極に対応する前記上層保護膜の開口部は、周囲に段差を備える、
請求項1から請求項3のいずれか1項に記載の半導体装置。
The opening of the upper protective film corresponding to the first electrode and the second electrode has a step on the periphery.
The semiconductor device according to any one of claims 1 to 3.
前記第1電極の上面の外周部は、前記第1電極用第2導電層を介して前記上層保護膜と接しており、前記第2電極の上面の外周部は、前記第2電極用第2導電層を介して前記上層保護膜と接している、
請求項1から請求項4のいずれか1項に記載の半導体装置。
The outer peripheral portion of the upper surface of the first electrode is in contact with the upper protective film via the second conductive layer for the first electrode, and the outer peripheral portion of the upper surface of the second electrode is the second electrode for the second electrode. It is in contact with the upper protective film via a conductive layer.
The semiconductor device according to any one of claims 1 to 4.
前記第1センサ電極と前記第2センサ電極と前記第1電極と前記第2電極とは、絶縁層を介して前記半導体基板の主面上に形成されている、
請求項から請求項のいずれか1項に記載の半導体装置。
The first sensor electrode, the second sensor electrode, the first electrode, and the second electrode are formed on the main surface of the semiconductor substrate via an insulating layer.
The semiconductor device according to any one of claims 1 to 5.
前記第1センサ電極と前記第2センサ電極とは制御部に接続され、
前記制御部は交流信号である前記入力信号を前記第1センサ電極に出力し、前記第2センサ電極から入力される前記出力信号と前記入力信号との位相差並びにインピーダンスの変化量により、土壌中の水分量を算出する、
請求項2に記載の半導体装置。
The first sensor electrode and the second sensor electrode are connected to the control unit, and the first sensor electrode and the second sensor electrode are connected to the control unit.
The control unit outputs the input signal, which is an AC signal, to the first sensor electrode, and the phase difference between the output signal and the input signal input from the second sensor electrode and the amount of change in impedance are determined in the soil. Calculate the amount of water in
The semiconductor device according to claim 2.
主面上にセンサ電極形成領域と前記センサ電極形成領域に隣接する実装電極形成領域とを備えた半導体基板を準備する工程と、
半導体基板の主面上に、第1導電層と第2導電層とが順に連続して積層された積層膜を形成する積層膜形成工程と、
前記積層膜をドライエッチングによりパターニングして、センサ電極を前記センサ電極形成領域に形成すると共に、実装電極を前記実装電極形成領域に形成する電極形成工程と、
前記主面と、前記センサ電極と前記実装電極との表面の外周と、を被覆すると共に、前記センサ電極の前記第2導電層を露出する開口部と前記実装電極の前記第2導電層を露出する開口部を有する上層保護膜を形成する上層保護膜形成工程と、
前記センサ電極の前記第2導電層を露出する開口部を被覆すると共に前記実装電極の前記第2導電層を露出する開口部を内包する領域を露出するマスクレイヤを形成するマスクレイヤ形成工程と、
前記マスクレイヤに応じた領域をエッチングすることで、前記実装電極の前記第2導電層を除去する第2導電層除去工程と、
を含む半導体装置の製造方法。
A step of preparing a semiconductor substrate having a sensor electrode forming region and a mounting electrode forming region adjacent to the sensor electrode forming region on the main surface, and
A laminated film forming step of forming a laminated film in which a first conductive layer and a second conductive layer are continuously laminated in this order on a main surface of a semiconductor substrate.
An electrode forming step of patterning the laminated film by dry etching to form a sensor electrode in the sensor electrode forming region and forming a mounting electrode in the mounting electrode forming region.
The main surface and the outer periphery of the surface of the sensor electrode and the mounting electrode are covered, and the opening for exposing the second conductive layer of the sensor electrode and the second conductive layer of the mounting electrode are exposed. An upper layer protective film forming step of forming an upper layer protective film having an opening to be formed,
A mask layer forming step of covering an opening that exposes the second conductive layer of the sensor electrode and forming a mask layer that exposes a region including an opening that exposes the second conductive layer of the mounting electrode.
A second conductive layer removing step of removing the second conductive layer of the mounting electrode by etching a region corresponding to the mask layer.
A method for manufacturing a semiconductor device including.
前記電極形成工程は、前記センサ電極の前記第1導電層の端面と前記第2導電層の端面とを面一に形成することを特徴とする請求項に記載の半導体装置の製造方法。 The method for manufacturing a semiconductor device according to claim 8 , wherein the electrode forming step forms the end face of the first conductive layer and the end face of the second conductive layer of the sensor electrode flush with each other. 前記第2導電層除去工程は、前記実装電極の前記第2導電層を露出する開口部を内包する領域の境界に応じた段差を形成することを特徴とする請求項またはに記載の半導体装置の製造方法。 The semiconductor according to claim 8 or 9 , wherein the second conductive layer removing step forms a step according to a boundary of a region including an opening that exposes the second conductive layer of the mounting electrode. Manufacturing method of the device.
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