JP6564375B2 - 高スループットのキーバリューストアの実現のためのメモリ構成 - Google Patents
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Description
1つ以上の実現化例は一般に集積回路に関し、より特定的にはデータを処理するための回路およびデータを処理する方法に関する。
集積回路は、データを処理するための装置において実現されてもよい。また、データは、データ伝送規格に準拠する公的プロトコルまたは専用プロトコルであり得る異なるプロトコルに従って処理されてもよい。しかしながら、所与のプロトコルに依存して、異なるハードウェア要素が必要とされる場合がある。さまざまなハードウェア要素の実現は、たとえばスループット、待ち時間および消費電力といった装置の性能に影響を与える場合がある。これらの性能基準の各々は、装置の評価において引き続き有意である。すなわち、回路開発者らは、装置によって消費される電力を減少させつつ、装置の速度を改良し続けている。
データを処理するための回路が説明される。回路は、キーバリューストアデータトランザクションを実現するための要求を受信するための入力部と、キーバリューストアに関連付けられた複数のメモリ装置へのアクセスを可能にする異なるメモリタイプに関連付けられた複数のメモリインターフェイスと、データ転送基準に基づいて、複数のメモリインターフェイスを介したデータのルーティングを制御するメモリ管理回路とを含む。
キーバリューストア(KVS)は、大抵のデータセンターにおいて根本的に重要なミドルウェア層である。キーバリューストアの機能は、通信インターフェイスまたはネットワークインターフェイスを通して(アドレスでインデックス化されるのではなく)キーに関連付けられた値を格納し、検索することである。近年、キーバリューストアは、最も頻繁にアクセスされたオブジェクトをキャッシュすることを介して、それらのウェブでの存在感の性能を加速するために、データセンターにおいて広範に導入されている。KVSサーバは典型的には大規模データベースの内容をキャッシュするために使用されるため、そのようなKVSサーバの重要な局面はその記憶密度であり、キャッシュが大きいほど、KVSはより効果的になる。さらに、KVSサーバのスループットおよび待ち時間は、ウェブサイトが組立てられ得る速度を本質的に決定するため、重要な特性である。最後に、サーバの(そのエネルギー消費によって支配される)運営経費がその資本化経費よりも高くなり始めるにつれて、消費電力はますます重要になる。
Claims (14)
- データを処理するための回路であって、前記回路は、
キーに関連付けられたストアへのアクセスを可能にするキーバリューストアデータトランザクションを実現するための要求を受信するための入力部と、
キーバリューストアに関連付けられた複数のメモリ装置へのアクセスを可能にする異なるメモリタイプに関連付けられた複数のメモリインターフェイスと、
前記キーバリューストアデータトランザクションに関連付けられたストアの値の第1の部分を格納する第1のタイプの第1のメモリ装置と、
前記キーバリューストアデータトランザクションに関連付けられた前記ストアの前記値の第2の部分を格納する第2のタイプの第2のメモリ装置と、
データ転送基準に基づいて、前記複数のメモリインターフェイスを介したデータのルーティングを制御するメモリ管理回路とを含み、
前記メモリ管理回路は、前記キーバリューストアデータトランザクションに関連付けられた前記ストアの前記値の前記第1の部分、および前記キーバリューストアデータトランザクションに関連付けられた前記ストアの前記値の前記第2の部分にアクセスすることを可能にする、回路。 - 前記メモリ管理回路は、データブロックの、第1のデータ部分および第2のデータ部分へのルーティングを制御する、請求項1に記載の回路。
- 前記メモリ管理回路は、第1のメモリインターフェイスを介してデータブロックの第1のデータ部分をルーティングすること、および第2のメモリインターフェイスを介して前記データブロックの第2のデータ部分をルーティングすることを可能にする、請求項1または請求項2に記載の回路。
- 前記メモリ管理回路は、アクセス基準に基づいて、前記データブロックの前記第1のデータ部分および前記第2のデータ部分の各々を選択されたメモリタイプにルーティングする、請求項3に記載の回路。
- 前記アクセス基準は、データブロックのデータのサイズに基づく、請求項4に記載の回路。
- 前記アクセス基準は、データブロックのデータのアクセス頻度に基づく、請求項4に記載の回路。
- 前記複数のメモリインターフェイスのうちのあるメモリインターフェイスは、データをDRAMメモリにルーティングすることを可能にし、第2のメモリインターフェイスは、データをSSDメモリにルーティングすることを可能にする、請求項1〜6のいずれか1項に記載の回路。
- 第2のメモリインターフェイスを介してルーティングされたデータは、複数のメモリ装置に格納される、請求項1〜7のいずれか1項に記載の回路。
- データを処理する方法であって、前記方法は、
キーに関連付けられたストアへのアクセスを可能にするキーバリューストアに関連付けられたデータトランザクションを実現するための要求を受信するステップと、
データ転送基準に基づいて、複数のメモリインターフェイスを介したデータのルーティングを制御するステップとを含み、第1のタイプのメモリの第1のメモリ装置が、前記データトランザクションに関連付けられたストアの値の第1の部分を格納し、第2のタイプのメモリの第2のメモリ装置が、前記データトランザクションに関連付けられた前記ストアの前記値の第2の部分を格納し、前記方法はさらに、
第1のメモリインターフェイスを介して前記キーバリューストアに関連付けられた前記第1のメモリ装置のメモリ位置にアクセスすることを可能にするステップと、
第2のメモリインターフェイスを介して前記キーバリューストアに関連付けられた前記第2のメモリ装置のメモリ位置にアクセスすることを可能にするステップとを含み、
メモリ管理回路が、前記データトランザクションに関連付けられた前記ストアの前記値の前記第1の部分、および前記データトランザクションに関連付けられた前記ストアの前記値の前記第2の部分にアクセスすることを可能にする、方法。 - データ転送基準に基づいて、前記複数のメモリインターフェイスを介したデータのルーティングを制御するステップは、前記第1のメモリインターフェイスを介してデータブロックの第1の部分をルーティングし、前記第2のメモリインターフェイスを介して前記データブロックの第2の部分をルーティングするステップを含む、請求項9に記載の方法。
- データ転送基準に基づいて、前記複数のメモリインターフェイスを介したデータのルーティングを制御するステップは、データブロックのサイズに基づいて、前記第1のメモリインターフェイスまたは前記第2のメモリインターフェイスのいずれかを介してデータをルーティングするステップを含む、請求項9または請求項10に記載の方法。
- データ転送基準に基づいて、前記複数のメモリインターフェイスを介したデータのルーティングを制御するステップは、データブロックのアクセス頻度に基づいて、前記第1のメモリインターフェイスまたは前記第2のメモリインターフェイスのいずれかを介してデータをルーティングするステップを含む、請求項9〜11のいずれか1項に記載の方法。
- 第1のメモリインターフェイスを介して前記キーバリューストアに関連付けられた前記第1のメモリ装置のメモリ位置にアクセスすることを可能にするステップは、データをSSDメモリにルーティングするステップを含む、請求項9〜12のいずれか1項に記載の方法。
- 第2のメモリインターフェイスを介して前記キーバリューストアに関連付けられた前記第2のメモリ装置のメモリ位置にアクセスすることを可能にするステップは、データをDRAMにルーティングするステップを含む、請求項13に記載の方法。
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