JP6558976B2 - 撮像装置、その制御方法及びプログラム並びに撮像素子 - Google Patents
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Description
以下、本発明の例示的な実施形態について、図面を参照して詳細に説明する。なお、以下では撮像装置の一例として、撮影中の画像の一部の領域に対する処理が可能な任意のデジタルカメラに本発明を適用した例を説明する。しかし、本発明は、デジタルカメラに限らず、当該処理を行うことが可能な任意の機器にも適用可能である。これらの機器には、例えば携帯電話機、ゲーム機、タブレット端末、パーソナルコンピュータ、時計型や眼鏡型の情報端末などが含まれてよい。
図1は、本実施形態の撮像装置の一例としてデジタルカメラ100の機能構成例を示すブロック図である。なお、図1に示す機能ブロックの1つ以上は、ASICやプログラマブルロジックアレイ(PLA)などのハードウェアによって実現されてもよいし、CPUやMPU等のプログラマブルプロセッサがソフトウェアを実行することによって実現されてもよい。また、ソフトウェアとハードウェアの組み合わせによって実現されてもよい。従って、以下の説明において、異なる機能ブロックが動作主体として記載されている場合であっても、同じハードウェアが主体として実現されうる。
撮像センサ102における画素領域の一例について、図2を参照して説明する。有効画素領域201には、被写体からの光を光電変換して入射光量に応じた信号を出力する有効画素が配置されている。撮像センサ102には、有効画素のほか、被写体からの光を遮光されたオプティカルブラック画素(OB画素)が配置されており、このOB画素は有効画素の出力を補正するための基準となる信号を出力する。水平OB画素領域202および垂直OB画素領域203は、それぞれOB画素が配置されている領域である。水平OB画素領域202は、その垂直方向(列に沿った方向)の画素数が有効画素領域201の垂直方向の画素数と等しい領域であり、例えば有効画素領域201の水平方向(行に沿った方向)の端部(例えば左側)に隣接して配置されている。垂直OB画素領域203は、その水平方向の画素数が、有効画素領域201と水平OB画素領域202の水平方向の画素数の和と等しく、有効画素領域201の垂直方向の端部(例えば上側)に接して配置されている。そして、有効画素領域201、水平OB画素領域202、垂直OB画素領域203から画素領域200が構成される。
上述した伝送方法により画像データを送信するための、撮像センサ102の機能構成例とパケットの生成処理について図6(a)を参照して説明する。
次に、上述した伝送方法により画像データを受信するとともに信号処理を施すための、信号処理部103の機能構成例とパケットの処理について図6(a)を参照して説明する。
次に、図7を参照して、画像データの伝送および表示処理に係る一連の動作を説明する。なお、デジタルカメラ100がライブビュー表示を行っている状態で、例えば不図示の操作部に対するユーザ操作が検出された場合に本処理が開始される。
次に実施形態2について説明する。実施形態2に係るデジタルカメラ100は、信号処理部103内部の構成が実施形態1と異なる。即ち、実施形態1の補正部は、図6(a)で示した記録媒体104および表示部105のそれぞれに対応する補正部を備えるが、実施形態2では、図6(b)に示すように単一の補正部103gのみを備える。実施形態2に係るデジタルカメラは、補正部以外の構成は同一であるため、同一の構成については同一の符号を付して重複する説明は省略し、相違点について重点的に説明する。
次に実施形態3について説明する。実施形態3に係るデジタルカメラ500は、基本的な構成は、実施形態1と同様であるが、AFE(Analog Front End)501を備える点が実施形態1と異なる。
次に実施形態4について説明する。実施形態4に係るデジタルカメラ600は、基本的な構成は、実施形態1と同様であるが、DFE(Digital Front End)601を備える点が異なる。
また、本発明は、以下に示す他の実施形態に対しても適用可能である。例えば、図12に示す積層型の撮像センサ1200に対して本発明を適用できる。図12に示す様に、本実施形態の撮像センサ1200は、第1の半導体チップ1201と第2の半導体チップ1202がチップレベルで互いに積層されている。図12(a)は斜投影図、図12(b)は各チップの上面図を示している。第1の半導体チップ1201には、例えば実施形態1における撮像部102aの画素領域200に対応する画素部1203を含む領域が含まれ、高速ロジックプロセス用の第2の半導体チップ1202には、例えば実施形態1におけるA/D変換部102bに対応する列A/D変換回路や水平走査回路などデジタルデータを含む高速処理が可能な部分1204および1205が含まれる。上述の図1の構成において、例えば、撮像センサ102に含まれる撮像部102aが第1の半導体チップ1201に対応する。また、撮像センサ102に含まれるA/D変換部102b、画像データ生成部102c、ヘッダ生成部102d、パケット生成部102e、出力部102fの各機能ブロックが第2の半導体チップ1202に配置されるように構成すれば良い。なお、第1の半導体チップ1201と第2の半導体チップへの各機能ブロックの配置は、上記した構成に限定されるものではない。また、積層される半導体チップも2つに限らず、3つ以上の半導体チップを積層する構成でもかまわない。
Claims (13)
- 被写体の画像データを生成する撮像手段と、
記録される領域を示す記録領域情報と、表示される領域を示す表示領域情報とを、ヘッダ情報として前記画像データに付加する情報付加手段と、
前記記録領域情報と前記表示領域情報とが付加された前記画像データを出力する出力手段と、
記録のために前記記録領域情報によって特定される記録領域を前記画像データから抽出し、表示のために前記表示領域情報によって特定される表示領域を前記画像データから抽出する画像処理手段と、を有することを特徴とする撮像装置。 - 前記画像処理手段は、前記抽出した画像データの前記記録領域又は前記表示領域に対して所定の補正処理を行う、ことを特徴とする請求項1に記載の撮像装置。
- 前記表示領域に対して領域を変更する指示を入力する入力手段をさらに有し、
前記情報付加手段は、前記領域を変更する指示に基づく制御情報を取得し、該制御情報に基づいて、前記表示領域情報を付加することを特徴とする請求項1に記載の撮像装置。 - 前記入力手段は、前記表示領域に対する前記領域を変更する指示となるユーザ操作を入力し、
前記情報付加手段は、前記ユーザ操作に基づく制御情報を取得し、該制御情報に基づいて前記表示領域情報を付加することを特徴とする請求項3に記載の撮像装置。 - 前記画像処理手段は、前記補正された画像データの前記記録領域を記録媒体に対して出力するか、前記補正された画像データの前記表示領域を表示手段に対して出力する、ことを特徴とする請求項2に記載の撮像装置。
- 前記記録領域情報と前記表示領域情報のそれぞれは、列に沿った方向の開始位置、列に沿った方向の終了位置、行に沿った方向の開始位置、行に沿った方向の終了位置の少なくとも1つを含むことを特徴とする請求項1ないし5のいずれか1項に記載の撮像装置。
- 前記ユーザ操作は、ライブビューにおける拡大表示に関する操作を含むことを特徴とする請求項4に記載の撮像装置。
- 画像処理手段に画像データを提供する撮像素子であって、
被写体の画像データを生成する撮像手段と、
記録される領域を示す記録領域情報と、表示される領域示す表示領域情報とを、ヘッダ情報として前記画像データに付加する情報付加手段と、
前記記録領域情報と前記表示領域情報とが付加された前記画像データを出力する出力手段と、を有し、
前記画像処理手段は、記録のために前記記録領域情報によって特定される記録領域を前記画像データから抽出し、表示のために前記表示領域情報によって特定される表示領域を前記画像データから抽出することを特徴とする撮像素子。 - 前記情報付加手段は、記録領域と表示領域とを取得するための制御情報を取得し、前記取得した制御情報に基づいて、前記記録領域情報と前記表示領域情報を付加する、ことを特徴とする請求項8に記載の撮像素子。
- 前記記録領域情報と前記表示領域情報のそれぞれは、列に沿った方向の開始位置、列に沿った方向の終了位置、行に沿った方向の開始位置、行に沿った方向の終了位置の少なくとも1つを含むことを特徴とする請求項8または9に記載の撮像素子。
- 前記撮像素子は、複数の半導体チップが積層された積層型の撮像素子である、ことを特徴とする請求項8ないし10のいずれか1項に記載の撮像素子。
- 撮像手段が、被写体の画像データを生成する撮像工程と、
情報付加手段が、記録される領域を示す記録領域情報と、表示される領域を示す表示領域情報とを、ヘッダ情報として前記画像データに付加する情報付加工程と、
出力手段が、前記記録領域情報と前記表示領域情報とが付加された前記画像データを出力する出力工程と、
画像処理手段が、記録のために前記記録領域情報によって特定される記録領域を前記画像データから抽出し、表示のために前記表示領域情報によって特定される表示領域を前記画像データから抽出する画像処理工程と、を有することを特徴とする撮像装置の制御方法。 - コンピュータを、請求項1乃至7のいずれか1項に記載の撮像装置の各手段として機能させるためのプログラム。
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