JP6394823B2 - Power converter - Google Patents

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    • H02M3/00Conversion of dc power input into dc power output
    • H02M3/22Conversion of dc power input into dc power output with intermediate conversion into ac
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Description

本発明は、スナバ回路を備えた電力変換装置に関する。   The present invention relates to a power conversion device including a snubber circuit.

特許文献1には、スパイク電圧を抑制するスナバ回路が開示されている。特許文献1に記載のスナバ回路は、スイッチングレギュレータのトランスの2次側に設けられたダイオード及びコンデンサの直列回路と、コンデンサの充電電圧を放電するスイッチ素子とを備えている。このスナバ回路は、発生するスパイク電圧をコンデンサに充電し、直後にスイッチ素子をオンすることで、充電電圧を出力電圧の一部として放電する。コンデンサに蓄えられたスパイク電圧をスナバ回路で消費することなく回生することで、電力変換効率は向上する。   Patent Document 1 discloses a snubber circuit that suppresses spike voltage. The snubber circuit described in Patent Document 1 includes a series circuit of a diode and a capacitor provided on the secondary side of the transformer of the switching regulator, and a switch element that discharges the charging voltage of the capacitor. The snubber circuit charges the generated spike voltage to the capacitor and immediately turns on the switch element to discharge the charge voltage as part of the output voltage. The power conversion efficiency is improved by regenerating the spike voltage stored in the capacitor without being consumed by the snubber circuit.

ところで、トランスを用いたスイッチングレギュレータとして、例えばDC−DCコンバータがある。このDC−DCコンバータにおいて、トランスの一次側の回路方式によっては、トランスから出力される電流を全波整流する方式が採用される場合がある。例えば、トランスの一次側に、フルブリッジ、ハーフブリッジ、プッシュプルなどの回路方式を採用した場合等である。また、全波整流方式としては、ブリッジ整流方式や中間タップ方式があるが、求められる特性(例えば導通損失の低減等)によっては、トランスから出力される電流を中間タップ方式によって全波整流する方式が採用される場合がある。なお、中間タップ方式を採用する例としては、特許文献2等があげられる。   Incidentally, as a switching regulator using a transformer, for example, there is a DC-DC converter. In this DC-DC converter, depending on the circuit system on the primary side of the transformer, a system that full-wave rectifies the current output from the transformer may be employed. For example, this is a case where a circuit system such as a full bridge, a half bridge, or a push-pull is adopted on the primary side of the transformer. In addition, as a full-wave rectification method, there are a bridge rectification method and an intermediate tap method, but depending on the required characteristics (for example, reduction of conduction loss), a method of full-wave rectifying the current output from the transformer by the intermediate tap method May be adopted. An example in which the intermediate tap method is employed is Patent Document 2 and the like.

特開平1−202161号公報JP-A-1-202161 特開昭58−175972号公報JP 58-175972 A

特許文献1に記載のスナバ回路、及び、特許文献2に記載のDC−DCコンバータは、電力変換効率の低下を防ぐことができる。しかしながら、特許文献2に記載のDC−DCコンバータに、特許文献1に記載のスナバ回路を適用させた場合、以下のような課題が発生する。センタータップ方式の整流回路では、2次側の電圧周期は1次側のスイッチング周期の1/2となる。このため、単純に、特許文献2に記載のDC−DCコンバータに、特許文献1に記載のスナバ回路を適用させてしまうと、保護対象の整流用スイッチのオン期間でもスナバ回路のスイッチ素子がオンする期間が生じてしまい、スナバ回路に過大な電力ストレスがかかってしまう。その結果、スナバ回路が破損したり、過熱を引き起こしたりするおそれがある。   The snubber circuit described in Patent Document 1 and the DC-DC converter described in Patent Document 2 can prevent a decrease in power conversion efficiency. However, when the snubber circuit described in Patent Document 1 is applied to the DC-DC converter described in Patent Document 2, the following problems occur. In the center tap type rectifier circuit, the voltage cycle on the secondary side is ½ of the switching cycle on the primary side. For this reason, if the snubber circuit described in Patent Document 1 is simply applied to the DC-DC converter described in Patent Document 2, the switch element of the snubber circuit is turned on even during the ON period of the rectifying switch to be protected. Period occurs, and excessive power stress is applied to the snubber circuit. As a result, the snubber circuit may be damaged or overheating may occur.

そこで、本発明の目的は、スナバ回路と、センタータップ方式の整流回路を備えた電力変換装置において、整流用スイッチ素子に接続されたスナバ回路の電力ストレスを抑制した電力変換装置を提供することにある。   Accordingly, an object of the present invention is to provide a power conversion device including a snubber circuit and a center tap type rectifier circuit, in which the power stress of the snubber circuit connected to the rectifying switch element is suppressed. is there.

本発明に係る電力変換装置は、交流電圧が印加される1次巻線と、第1端、第2端及びセンタータップを備える2次巻線とを有するトランスと、前記第1端と第1出力部との間に接続された第1スイッチ素子と、前記第2端と前記第1出力部との間に接続された第2スイッチ素子と、前記センタータップと第2出力部との間に接続されたチョークコイルと、直列接続される第3スイッチ素子とキャパシタとを有し、前記第1スイッチ素子又は前記第2スイッチ素子の少なくとも一方に並列接続されたスナバ回路と、前記第3スイッチ素子をオンオフする制御回路と、を備え、前記制御回路は、前記トランスの前記1次巻線と磁気結合するトランス補助巻線と、前記チョークコイルと磁気結合するコイル結合巻線との直列回路を有し、前記直列回路は、前記第3スイッチ素子の制御端子と前記2次巻線の前記第1端との間に接続され、前記1次巻線と、前記2次巻線のうち、前記センタータップと前記第1端との間の巻線部分、又は前記センタータップと前記第2端との間の巻線部分の一方と、前記トランス補助巻線との巻き数比を、N1:N2:N3で表し、前記チョークコイルと前記コイル結合巻線との巻き数比を、N4:N5で表し、m=N5/N4、n=N2/N1、n1=N3/N1とすると、mn−n1=0を満たすことを特徴とする。   The power conversion device according to the present invention includes a transformer having a primary winding to which an AC voltage is applied, a secondary winding including a first end, a second end, and a center tap, the first end, and the first end. A first switch element connected between the output section, a second switch element connected between the second end and the first output section, and between the center tap and the second output section. A snubber circuit having a connected choke coil, a third switch element and a capacitor connected in series, and connected in parallel to at least one of the first switch element and the second switch element; and the third switch element A control circuit for turning on and off, the control circuit having a series circuit of a transformer auxiliary winding magnetically coupled to the primary winding of the transformer and a coil coupling winding magnetically coupled to the choke coil. And the series A path is connected between the control terminal of the third switch element and the first end of the secondary winding, and the center tap and the second of the secondary winding and the secondary winding. A winding ratio between one end of the winding portion between one end or the winding portion between the center tap and the second end and the transformer auxiliary winding is represented by N1: N2: N3, When the turns ratio of the choke coil and the coil coupling winding is expressed as N4: N5, and m = N5 / N4, n = N2 / N1, and n1 = N3 / N1, mn−n1 = 0 is satisfied. It is characterized by.

この構成によれば、第3スイッチ素子は保護対象の整流用スイッチ素子である第1スイッチ素子又は第2スイッチ素子のオフ時にのみオンする。そのため、スナバ回路、特に第3スイッチ素子へ過大な電力ストレスがかかるのを抑制できる。そして、第3スイッチ素子の破損を抑えて、スナバ回路により、保護対象の整流用スイッチ素子に発生するスパイク電圧を低減することも可能となる。   According to this configuration, the third switch element is turned on only when the first switch element or the second switch element that is the rectifying switch element to be protected is turned off. Therefore, it is possible to suppress an excessive power stress from being applied to the snubber circuit, particularly the third switch element. Further, it is possible to reduce the spike voltage generated in the rectifying switch element to be protected by the snubber circuit while preventing the third switch element from being damaged.

前記直列回路はさらに第2キャパシタを含み、前記電力変換装置は、前記第3スイッチ素子の前記制御端子と前記2次巻線の前記第1端との間に接続された抵抗素子を、さらに備え、前記第2キャパシタと前記抵抗素子とで微分回路が形成されてもよい。   The series circuit further includes a second capacitor, and the power converter further includes a resistance element connected between the control terminal of the third switch element and the first end of the secondary winding. A differential circuit may be formed by the second capacitor and the resistance element.

この構成では、微分回路により、第3スイッチ素子のオン期間を調整できる。これにより、スナバ回路を設ける第1スイッチ素子又は第2スイッチ素子のオン期間に、第3スイッチ素子がオンすることを防止できる。その結果、第1スイッチ素子又は第2スイッチ素子のオン期間でのキャパシタからの放電電流を防止できる。   In this configuration, the ON period of the third switch element can be adjusted by the differentiating circuit. Thereby, it is possible to prevent the third switch element from being turned on during the on period of the first switch element or the second switch element provided with the snubber circuit. As a result, the discharge current from the capacitor during the ON period of the first switch element or the second switch element can be prevented.

前記電力変換装置は、カソードが前記第3スイッチ素子の前記制御端子に接続され、アノードが前記第3スイッチ素子の基準電位端子に接続されたダイオード、を備えていてもよい。   The power converter may include a diode having a cathode connected to the control terminal of the third switch element and an anode connected to a reference potential terminal of the third switch element.

この構成では、第3スイッチ素子の制御端子に、過大な逆電圧が印加されることを防止できる。   With this configuration, it is possible to prevent an excessive reverse voltage from being applied to the control terminal of the third switch element.

前記電力変換装置は、前記第3スイッチ素子の制御端子と基準電位端子との間に接続された第4スイッチ素子と、前記第3スイッチ素子のオン時に、設定された時定数で前記第4スイッチ素子のオンする時定数回路とを備え、前記第4スイッチ素子がオンすることにより、前記第3スイッチ素子がオフする構成でもよい。   The power converter includes: a fourth switch element connected between a control terminal of the third switch element and a reference potential terminal; and the fourth switch with a set time constant when the third switch element is turned on. And a time constant circuit for turning on the element, and the third switch element may be turned off when the fourth switch element is turned on.

この構成では、第4スイッチ素子をオンすることで、第3スイッチ素子の制御端子の電荷を抜き、第3スイッチ素子をより高速にオフできる。その結果、スナバ回路を設ける第1スイッチ素子又は第2スイッチ素子のオン期間に第3スイッチ素子がオンすることによるキャパシタからの放電電流を防止できる。   In this configuration, by turning on the fourth switch element, the charge of the control terminal of the third switch element can be extracted, and the third switch element can be turned off at higher speed. As a result, it is possible to prevent a discharge current from the capacitor due to the third switch element being turned on during the on period of the first switch element or the second switch element provided with the snubber circuit.

本発明によれば、センタータップ方式のトランスを用いても、スナバ回路へ過大な電力ストレスがかかるのを抑制できる。その結果、スナバ回路が破損したり、過熱を引き起こしたりすることを抑制できる。   According to the present invention, it is possible to prevent an excessive power stress from being applied to the snubber circuit even when a center tap type transformer is used. As a result, it is possible to suppress the snubber circuit from being damaged or causing overheating.

図1は、実施形態1に係る電力変換装置の回路図である。FIG. 1 is a circuit diagram of the power conversion apparatus according to the first embodiment. 図2は、コイルの両端電圧、補助巻線の両端電圧、及びこれらの合計電圧の波形を示す図である。FIG. 2 is a diagram illustrating waveforms of the voltage across the coil, the voltage across the auxiliary winding, and the total voltage thereof. 図3は、補助巻線の両端電圧、キャパシタの充電電圧、スイッチング素子のドレイン−ソース間電圧、及びスナバ用スイッチのゲート電圧の波形を示す図である。FIG. 3 is a diagram illustrating waveforms of the voltage across the auxiliary winding, the charging voltage of the capacitor, the drain-source voltage of the switching element, and the gate voltage of the snubber switch. 図4は、実施形態2に係る電力変換装置の回路図である。FIG. 4 is a circuit diagram of the power conversion apparatus according to the second embodiment. 図5は、スナバ用スイッチのゲート電圧、キャパシタの充電電圧、スイッチング素子のドレイン−ソース間電圧、合計電圧及び補助巻線の両端電圧の波形を示す図である。FIG. 5 is a diagram showing waveforms of the gate voltage of the snubber switch, the charging voltage of the capacitor, the drain-source voltage of the switching element, the total voltage, and the voltage across the auxiliary winding. 図6は、実施形態3に係る電力変換装置の回路図である。FIG. 6 is a circuit diagram of the power conversion apparatus according to the third embodiment. 図7は、補助巻線の両端電圧、キャパシタの充電電圧、及びスナバ用スイッチのゲート電圧の波形を示す図である。FIG. 7 is a diagram illustrating waveforms of the voltage across the auxiliary winding, the charging voltage of the capacitor, and the gate voltage of the snubber switch. 図8(A)及び図8(B)は、放電回路を示す図である。FIG. 8A and FIG. 8B are diagrams illustrating a discharge circuit. 図9(A)及び図9(B)は、放電回路を示す図である。9A and 9B are diagrams illustrating a discharge circuit. 図10は、補助巻線の両端電圧、キャパシタの充電電圧、及びスナバ用スイッチのゲート電圧の波形を示す図である。FIG. 10 is a diagram showing waveforms of the voltage across the auxiliary winding, the charging voltage of the capacitor, and the gate voltage of the snubber switch. 図11は、実施形態5に係る電力変換装置の回路図である。FIG. 11 is a circuit diagram of the power conversion apparatus according to the fifth embodiment.

(実施形態1)
図1は、実施形態1に係る電力変換装置1の回路図である。電力変換装置1は、センタータップ方式の整流回路を備えたDC−DCコンバータである。電力変換装置1は、直流電圧Vinを入力する入力部IN1,IN2と、直流電圧Voutを出力する出力部OUT1,OUT2とを備えている。出力部OUT1は本発明に係る「第1出力部」に相当し、出力部OUT2は本発明に係る「第2出力部」に相当する。
(Embodiment 1)
FIG. 1 is a circuit diagram of a power conversion device 1 according to the first embodiment. The power converter 1 is a DC-DC converter provided with a center tap type rectifier circuit. The power conversion apparatus 1 includes input units IN1 and IN2 that input a DC voltage Vin and output units OUT1 and OUT2 that output a DC voltage Vout. The output unit OUT1 corresponds to a “first output unit” according to the present invention, and the output unit OUT2 corresponds to a “second output unit” according to the present invention.

入力部IN1,IN2にはスイッチング回路が接続されている。スイッチング回路は、スイッチング素子Q11,Q12の直列回路と、スイッチング素子Q21,Q22の直列回路とが並列接続されて構成されている。このスイッチング回路は不図示のドライバによりスイッチング制御され、スイッチング素子Q11,Q22と、スイッチング素子Q12,Q21とが交互にオンオフされる。図1では、スイッチング素子Q11,Q12,Q21,Q22はMOSFETとしているが、IGBT等、他の構造の素子であってもよい。   A switching circuit is connected to the input sections IN1 and IN2. The switching circuit is configured by connecting a series circuit of switching elements Q11 and Q12 and a series circuit of switching elements Q21 and Q22 in parallel. This switching circuit is switching-controlled by a driver (not shown), and switching elements Q11 and Q22 and switching elements Q12 and Q21 are alternately turned on and off. In FIG. 1, the switching elements Q11, Q12, Q21, and Q22 are MOSFETs, but may be elements having other structures such as IGBTs.

スイッチング素子Q11,Q12の接続点と、スイッチング素子Q21,Q22の接続点との間には、トランスT1の1次巻線n11が接続されている。トランスT1の2次巻線は、第1巻線n21と第2巻線n22とが直列接続されて構成されている。第1巻線n21と第2巻線n22との接続点Pは、2次巻線のセンタータップである。   The primary winding n11 of the transformer T1 is connected between the connection point of the switching elements Q11 and Q12 and the connection point of the switching elements Q21 and Q22. The secondary winding of the transformer T1 is configured by connecting a first winding n21 and a second winding n22 in series. A connection point P between the first winding n21 and the second winding n22 is a center tap of the secondary winding.

接続点PはチョークコイルL1を介して出力部OUT2に接続されている。チョークコイルL1は、トランスT2の1次巻線である。接続点Pと反対側の第1巻線n21の一端(本発明の「第1端」に相当)は、スイッチング素子Q31を介して、出力部OUT1に接続されている。接続点Pと反対側の第2巻線n22の一端(本発明の「第2端」に相当)は、スイッチング素子Q32を介して、出力部OUT1に接続されている。出力部OUT1,OUT2間には、平滑コンデンサCoが接続されている。   The connection point P is connected to the output part OUT2 via the choke coil L1. The choke coil L1 is a primary winding of the transformer T2. One end of the first winding n21 opposite to the connection point P (corresponding to the “first end” in the present invention) is connected to the output part OUT1 via the switching element Q31. One end of the second winding n22 opposite to the connection point P (corresponding to the “second end” in the present invention) is connected to the output part OUT1 via the switching element Q32. A smoothing capacitor Co is connected between the output parts OUT1 and OUT2.

スイッチング素子Q31,Q32はMOSFETである。スイッチング素子Q31は、スイッチング素子Q12、Q21のオンオフに同期して、オンオフされる。スイッチング素子Q32は、スイッチング素子Q11、Q22のオンオフに同期して、オンオフされる。スイッチング素子Q31は、本発明に係る「第1スイッチ素子」に相当する。スイッチング素子Q32は、本発明に係る「第2スイッチ素子」に相当する。   Switching elements Q31 and Q32 are MOSFETs. Switching element Q31 is turned on / off in synchronization with on / off of switching elements Q12, Q21. Switching element Q32 is turned on / off in synchronization with on / off of switching elements Q11, Q22. The switching element Q31 corresponds to a “first switch element” according to the present invention. The switching element Q32 corresponds to a “second switch element” according to the present invention.

スイッチング素子Q11,Q22,Q32がオン、スイッチング素子Q12,Q21,Q31がオフの場合(以下、この状態を第1の状態という)、電力変換装置1には、図1に示す実線矢印の経路で電流が流れる。また、スイッチング素子Q11,Q22,Q32がオフ、スイッチング素子Q12,Q21,Q31がオンの場合(以下、この状態を第2の状態という)、電力変換装置1には、図1に示す破線矢印の経路で電流が流れる。   When the switching elements Q11, Q22, and Q32 are on and the switching elements Q12, Q21, and Q31 are off (hereinafter, this state is referred to as a first state), the power conversion device 1 has a path indicated by a solid arrow shown in FIG. Current flows. When the switching elements Q11, Q22, and Q32 are off and the switching elements Q12, Q21, and Q31 are on (hereinafter, this state is referred to as a second state), the power conversion device 1 has a broken-line arrow shown in FIG. Current flows through the path.

スイッチング素子Q31にはスナバ回路10が並列接続されている。スナバ回路10は、スイッチング素子Q31のオフ時に生じるスパイク電圧を吸収し、スイッチング素子Q31及び周囲部品を保護する保護回路である。スナバ回路10はスナバ用スイッチ11とキャパシタ12との直列回路である。   A snubber circuit 10 is connected in parallel to the switching element Q31. The snubber circuit 10 is a protection circuit that absorbs a spike voltage generated when the switching element Q31 is turned off and protects the switching element Q31 and surrounding components. The snubber circuit 10 is a series circuit of a snubber switch 11 and a capacitor 12.

スナバ用スイッチ11はMOSFETであり、スナバ用スイッチ11のソースはスイッチング素子Q31のドレインに接続され、スナバ用スイッチ11のドレインは、キャパシタ12を介してスイッチング素子Q31のソースに接続されている。スナバ用スイッチ11は、本発明に係る「第3スイッチ素子」に相当する。   The snubber switch 11 is a MOSFET, the source of the snubber switch 11 is connected to the drain of the switching element Q31, and the drain of the snubber switch 11 is connected to the source of the switching element Q31 via the capacitor 12. The snubber switch 11 corresponds to a “third switch element” according to the present invention.

スナバ用スイッチ11のゲート(制御端子)には、後述の制御回路が接続され、その制御回路によりオンオフされる。スナバ用スイッチ11は、スイッチング素子Q31のオフ期間にオンとなり、スイッチング素子Q31のオン期間にオフとなる。スイッチング素子Q31がオフされると、スイッチング素子Q31の両端電圧が急上昇する。すなわち、スパイク電圧が生じる。このとき、スナバ用スイッチ11がオンされることで、そのスパイク電圧はキャパシタ12に吸収(充電)される。これにより、スパイク電圧によるスイッチング素子Q31及びその周囲部品の破損を防止できる。   A control circuit, which will be described later, is connected to the gate (control terminal) of the snubber switch 11 and is turned on and off by the control circuit. The snubber switch 11 is turned on during the off period of the switching element Q31 and is turned off during the on period of the switching element Q31. When the switching element Q31 is turned off, the voltage across the switching element Q31 rises rapidly. That is, a spike voltage is generated. At this time, when the snubber switch 11 is turned on, the spike voltage is absorbed (charged) in the capacitor 12. As a result, the switching element Q31 and its peripheral components can be prevented from being damaged by the spike voltage.

制御回路は、コイルL2及び補助巻線n23の直列回路である。この直列回路は、スナバ用スイッチ11のゲート−ソース間に接続されている。本実施形態における制御回路が、本発明に係る「制御回路」に相当する。なお、キャパシタC1は、スナバ用スイッチ11のゲート−ソース間の電圧調整用のキャパシタである。   The control circuit is a series circuit of the coil L2 and the auxiliary winding n23. This series circuit is connected between the gate and source of the snubber switch 11. The control circuit in the present embodiment corresponds to a “control circuit” according to the present invention. The capacitor C1 is a capacitor for adjusting the voltage between the gate and the source of the snubber switch 11.

コイルL2はトランスT2の2次巻線であり、1次巻線のチョークコイルL1と磁気結合する。第1の状態と第2の状態の何れの場合でも、チョークコイルL1に流れる電流は同方向である。このため、チョークコイルL1と磁気結合するコイルL2に誘起される電圧の極性は同じである。コイルL2は、本発明に係る「コイル結合巻線」に相当する。   The coil L2 is a secondary winding of the transformer T2, and is magnetically coupled to the choke coil L1 of the primary winding. In either case of the first state or the second state, the current flowing through the choke coil L1 is in the same direction. For this reason, the polarity of the voltage induced in the coil L2 magnetically coupled to the choke coil L1 is the same. The coil L2 corresponds to a “coil coupling winding” according to the present invention.

制御回路の補助巻線n23は、トランスT1の1次巻線n11と磁気結合する。1次巻線n11には、スイッチング回路のスイッチングにより交流電圧が印加される。このため、補助巻線n23に誘起される電圧の極性は交互に反転する。第1の状態の場合、補助巻線n23に誘起される電圧の極性は、コイルL2に誘起される電圧の極性と同じである。第2の状態の場合、補助巻線n23に誘起される電圧の極性は、コイルL2に誘起される電圧の極性と反対である。補助巻線n23は、本発明に係る「トランス補助巻線」に相当する。   The auxiliary winding n23 of the control circuit is magnetically coupled to the primary winding n11 of the transformer T1. An AC voltage is applied to the primary winding n11 by switching of the switching circuit. For this reason, the polarity of the voltage induced in the auxiliary winding n23 is alternately inverted. In the case of the first state, the polarity of the voltage induced in the auxiliary winding n23 is the same as the polarity of the voltage induced in the coil L2. In the second state, the polarity of the voltage induced in the auxiliary winding n23 is opposite to the polarity of the voltage induced in the coil L2. The auxiliary winding n23 corresponds to a “transformer auxiliary winding” according to the present invention.

制御回路は、コイルL2に誘起される電圧V1と、補助巻線n23に誘起される電圧V2との合計電圧(V1+V2)を出力する。この合計電圧(V1+V2)は、スナバ用スイッチ11のゲートに印加される。   The control circuit outputs a total voltage (V1 + V2) of the voltage V1 induced in the coil L2 and the voltage V2 induced in the auxiliary winding n23. This total voltage (V1 + V2) is applied to the gate of the snubber switch 11.

制御回路から出力される合計電圧(V1+V2)は、スイッチング素子Q31がオフのときにスナバ用スイッチ11をオンし、スイッチング素子Q31がオンのときにスナバ用スイッチ11をオフする矩形波状となるよう、電力変換装置1の各素子は定数設定されている。   The total voltage (V1 + V2) output from the control circuit has a rectangular wave shape that turns on the snubber switch 11 when the switching element Q31 is off and turns off the snubber switch 11 when the switching element Q31 is on. Each element of the power converter 1 is set to a constant.

ここで、1次巻線n11、第1巻線n21、補助巻線n23の巻き数比をN1:N2:N3で表し、チョークコイルL1とコイルL2との巻き数比を、N4:N5で表す。また、m=N5/N4、n=N2/N1、n1=N3/N1とする。この場合において、mn−n1=0の条件を満たすと、スナバ用スイッチ11は、スイッチング素子Q31がオンのときオフされ、スイッチング素子Q31がオフのときオンされる。以下、その理由について説明する。   Here, the turns ratio of the primary winding n11, the first winding n21, and the auxiliary winding n23 is represented by N1: N2: N3, and the turns ratio of the choke coil L1 and the coil L2 is represented by N4: N5. . Further, m = N5 / N4, n = N2 / N1, and n1 = N3 / N1. In this case, when the condition of mn−n1 = 0 is satisfied, the snubber switch 11 is turned off when the switching element Q31 is turned on and turned on when the switching element Q31 is turned off. The reason will be described below.

図2は、コイルL2の両端電圧V1、補助巻線n23の両端電圧V2、及びこれらの合計電圧(V1+V2)の波形を示す図である。   FIG. 2 is a diagram showing waveforms of the voltage V1 across the coil L2, the voltage V2 across the auxiliary winding n23, and the total voltage (V1 + V2) thereof.

チョークコイルL1の両端電圧をVL1で表すと、VL1=n*Vin−Voutである。このチョークコイルL1と磁気結合するコイルL2の両端電圧V1は、V1=m*VL1=m(n*Vin−Vout)である。トランスT1の1次側のスイッチング回路のスイッチング周期をTで表すと、V1の繰り返し周期はT/2となる。また、補助巻線n23の両端電圧V2は、V2=n1*Vinである。V2の繰り返し周期は、スイッチング周期Tである。   When the voltage across the choke coil L1 is represented by VL1, VL1 = n * Vin−Vout. The voltage V1 across the coil L2 magnetically coupled to the choke coil L1 is V1 = m * VL1 = m (n * Vin−Vout). If the switching period of the switching circuit on the primary side of the transformer T1 is represented by T, the repetition period of V1 is T / 2. The voltage V2 across the auxiliary winding n23 is V2 = n1 * Vin. The repetition period of V2 is a switching period T.

合計電圧(V1+V2)は、以下の式(1)で表せられる。   The total voltage (V1 + V2) is expressed by the following formula (1).

V1+V2=m(n*Vin−Vout)+(−n1*Vin)
=(mn−n1)Vin−m*Vout … (1)
図2に示す期間(A)、(C)では、V2=0である。すなわち、Vin=0である。この場合、V1=−m*Voutである。そして、式(1)より、V1+V2=−m*Voutである。
V1 + V2 = m (n * Vin−Vout) + (− n1 * Vin)
= (Mn-n1) Vin-m * Vout (1)
In the periods (A) and (C) shown in FIG. 2, V2 = 0. That is, Vin = 0. In this case, V1 = −m * Vout. From the formula (1), V1 + V2 = −m * Vout.

図2の期間(B)において、合計電圧(V1+V2)が、期間(A)、(C)での合計電圧(V1+V2)と同電位となることで、合計電圧(V1+V2)は、スイッチング周期Tのパルス状の電圧となる。式(1)において、上述の通り本発明ではmn−n1=0としているため、V1+V2=−m*Voutである。すなわち、期間(A)、(B)、(C)での合計電圧(V1+V2)は何れも−m*Voutであり、同電位となる。この合計電圧(V1+V2)がスナバ用スイッチ11のゲートに印加されることで、スナバ用スイッチ11は周期Tでオンオフされる。   In the period (B) of FIG. 2, the total voltage (V1 + V2) becomes the same potential as the total voltage (V1 + V2) in the periods (A) and (C). It becomes a pulse voltage. In the formula (1), as described above, mn−n1 = 0 in the present invention, so that V1 + V2 = −m * Vout. That is, the total voltage (V1 + V2) in the periods (A), (B), and (C) is −m * Vout, which is the same potential. The total voltage (V1 + V2) is applied to the gate of the snubber switch 11, so that the snubber switch 11 is turned on / off in a cycle T.

ここで、仮に図1の補助巻線n23が設けられていないとする。この場合、制御回路から出力される電圧は、コイルL2の両端電圧V1のみである。スナバ用スイッチ11のゲートには電圧V1が印加される。電圧V1の周期はT/2であるため、スナバ用スイッチ11は、T/2の周期でオンオフされる。スイッチング素子Q31の周期はTであるため、スイッチング素子Q31がオンのときに、スナバ用スイッチ11がオンするタイミングが生じる。この場合、キャパシタ12の電荷がスイッチング素子Q31を介して放電し、スナバ用スイッチ11及びキャパシタ12に電力ストレスがかかる。   Here, it is assumed that the auxiliary winding n23 of FIG. 1 is not provided. In this case, the voltage output from the control circuit is only the voltage V1 across the coil L2. A voltage V 1 is applied to the gate of the snubber switch 11. Since the cycle of the voltage V1 is T / 2, the snubber switch 11 is turned on / off at a cycle of T / 2. Since the cycle of the switching element Q31 is T, the timing when the snubber switch 11 is turned on occurs when the switching element Q31 is turned on. In this case, the electric charge of the capacitor 12 is discharged through the switching element Q31, and power stress is applied to the snubber switch 11 and the capacitor 12.

本実施形態は、補助巻線n23を設ける等、上記の構成とすることで、スナバ回路10、特に、スナバ用スイッチ11にかかる電力ストレスを抑え、スナバ回路10の破損、過熱を防止できる。   In the present embodiment, by providing the above-described configuration such as providing the auxiliary winding n23, power stress applied to the snubber circuit 10, particularly the snubber switch 11, can be suppressed, and the snubber circuit 10 can be prevented from being damaged and overheated.

なお、本発明において、「mn−n1=0」としているが、例えば、製造誤差や部品ばらつきに起因する誤差、ばらつき等を有している場合には、mn−n1が完全にゼロとなるわけではなく、その場合には、mn−n1≒0であればよい。すなわち、実質的に「mn−n1=0」を満たしていればよい。   In the present invention, “mn−n1 = 0” is set. However, for example, when there is an error or variation due to a manufacturing error or component variation, mn−n1 is completely zero. In this case, mn−n1≈0 is sufficient. That is, it is only necessary to substantially satisfy “mn−n1 = 0”.

図3は、補助巻線n23の両端電圧V2、キャパシタ12の充電電圧V12、スイッチング素子Q31のドレイン−ソース間電圧Vds、及びスナバ用スイッチ11のゲート電圧Vgsの波形を示す図である。図3に示す期間(A)、(B)、(C)は、図2に示す期間(A)、(B)、(C)と同じである。   FIG. 3 is a diagram illustrating waveforms of the voltage V2 across the auxiliary winding n23, the charging voltage V12 of the capacitor 12, the drain-source voltage Vds of the switching element Q31, and the gate voltage Vgs of the snubber switch 11. The periods (A), (B), and (C) shown in FIG. 3 are the same as the periods (A), (B), and (C) shown in FIG.

図3に示すように、スイッチング素子Q31のオフのタイミングで、スナバ用スイッチ11にはゲート電圧Vgsが印加され、キャパシタ12にはスパイク電圧が充電される。そして、スイッチング素子Q31のターンオン時にスナバ用スイッチ11がターンオフされることで、キャパシタ12の電荷の抜け(放電)を低減できる。なお、本実施形態においては、スイッチング素子Q31のターンオンとスナバ用スイッチ11のターンオフには多少の遅延が発生するため、図3に示すキャパシタ12の充電電圧V12は低下している。   As shown in FIG. 3, the gate voltage Vgs is applied to the snubber switch 11 and the capacitor 12 is charged with a spike voltage at the timing when the switching element Q31 is turned off. Then, when the snubber switch 11 is turned off when the switching element Q31 is turned on, the loss of electric charge (discharge) of the capacitor 12 can be reduced. In the present embodiment, since a slight delay occurs between the turn-on of the switching element Q31 and the turn-off of the snubber switch 11, the charging voltage V12 of the capacitor 12 shown in FIG.

このように、本実施形態では、スナバ用スイッチ11のオンオフ周期を、トランスT1の1次側のスイッチング周期と同じにすることで、スナバ用スイッチ11の破損を防止できる。   Thus, in this embodiment, the snubber switch 11 can be prevented from being damaged by making the on / off cycle of the snubber switch 11 the same as the switching cycle on the primary side of the transformer T1.

(実施形態2)
図4は、実施形態2に係る電力変換装置2の回路図である。この例では、電力変換装置2は、微分回路を備えている点で、実施形態1と相違する。
(Embodiment 2)
FIG. 4 is a circuit diagram of the power conversion device 2 according to the second embodiment. In this example, the power conversion device 2 is different from the first embodiment in that it includes a differentiation circuit.

スナバ用スイッチ11のゲート−ソース間に、抵抗R1が接続されている。抵抗R1と、キャパシタC1とで微分回路が構成されている。この微分回路は、スナバ用スイッチ11に印加されるパルス状のゲート電圧を変化させて、スナバ用スイッチ11のオン期間を調整する。微分回路は、スナバ用スイッチ11のオン期間がスイッチング素子Q31のオフ期間よりも短くなるよう、定数設定されている。   A resistor R <b> 1 is connected between the gate and source of the snubber switch 11. A differential circuit is configured by the resistor R1 and the capacitor C1. This differentiation circuit adjusts the on period of the snubber switch 11 by changing the pulsed gate voltage applied to the snubber switch 11. The differentiation circuit is set to a constant so that the on period of the snubber switch 11 is shorter than the off period of the switching element Q31.

図5は、スナバ用スイッチ11のゲート電圧Vgs、キャパシタ12の充電電圧V12、スイッチング素子Q31のドレイン−ソース間電圧Vds、合計電圧(V1+V2)及び補助巻線n23の両端電圧V2の波形を示す図である。   FIG. 5 is a diagram showing waveforms of the gate voltage Vgs of the snubber switch 11, the charging voltage V12 of the capacitor 12, the drain-source voltage Vds of the switching element Q31, the total voltage (V1 + V2), and the voltage V2 across the auxiliary winding n23. It is.

スナバ用スイッチ11の制御端子(ゲート)の入力側に微分回路を設けることで、スナバ用スイッチ11に印加されるゲート電圧Vgsの波形は、立ち上がった後、徐々に低くなる。このため、パルス状のゲート電圧Vgsが印加される場合と比べて、スナバ用スイッチ11のオン期間は短い。この結果、スナバ用スイッチ11のオン期間は、スイッチング素子Q31のオフ期間よりも短くなる。これにより、スイッチング素子Q31のオン期間にスナバ用スイッチ11がオンして、キャパシタ12の充電電圧が放電されるといった期間が生じることを確実に防止できる。そのため、図5に示すように、キャパシタ12の充電電圧V12は略一定である。   By providing a differential circuit on the input side of the control terminal (gate) of the snubber switch 11, the waveform of the gate voltage Vgs applied to the snubber switch 11 gradually decreases after rising. For this reason, the on period of the snubber switch 11 is shorter than when the pulsed gate voltage Vgs is applied. As a result, the on period of the snubber switch 11 is shorter than the off period of the switching element Q31. Thus, it is possible to reliably prevent a period in which the snubber switch 11 is turned on during the on period of the switching element Q31 and the charging voltage of the capacitor 12 is discharged. Therefore, as shown in FIG. 5, the charging voltage V12 of the capacitor 12 is substantially constant.

このように、本実施形態では、キャパシタ12が放電して大電流が流れることを防止して、スナバ回路10を適切に保護できる。   Thus, in the present embodiment, the snubber circuit 10 can be appropriately protected by preventing the capacitor 12 from discharging and flowing a large current.

(実施形態3)
図6は、実施形態3に係る電力変換装置3の回路図である。
(Embodiment 3)
FIG. 6 is a circuit diagram of the power conversion device 3 according to the third embodiment.

この例では、実施形態2に係る電力変換装置2の抵抗R1に、ダイオードD1を並列接続している点で、実施形態2と相違する。ダイオードD1のアノードはスナバ用スイッチ11のソース(基準電位端子)に接続され、カソードはスナバ用スイッチ11のゲートに接続されている。   This example is different from the second embodiment in that a diode D1 is connected in parallel to the resistor R1 of the power conversion device 2 according to the second embodiment. The anode of the diode D1 is connected to the source (reference potential terminal) of the snubber switch 11, and the cathode is connected to the gate of the snubber switch 11.

実施形態2の図5に示すように、微分回路を設けることでゲート電圧Vgsは、負電圧となるタイミングがある。MOSFETであるスナバ用スイッチ11に、負のゲート電圧が印加されると、ドレイン−ソース間の耐圧(ドレイン−ソース間に印加できる最大電圧)が低下する。本実施形態では、ダイオードD1を設けることで、負のゲート電圧Vgsは、ダイオードD1の順方向電圧以下に抑えられる。   As shown in FIG. 5 of the second embodiment, there is a timing when the gate voltage Vgs becomes a negative voltage by providing a differentiating circuit. When a negative gate voltage is applied to the snubber switch 11 that is a MOSFET, the breakdown voltage between the drain and the source (the maximum voltage that can be applied between the drain and the source) decreases. In the present embodiment, by providing the diode D1, the negative gate voltage Vgs is suppressed to be equal to or lower than the forward voltage of the diode D1.

図7は、補助巻線n23の両端電圧V2、キャパシタ12の充電電圧V12、及びスナバ用スイッチ11のゲート電圧Vgsの波形を示す図である。   FIG. 7 is a diagram showing waveforms of the voltage V2 across the auxiliary winding n23, the charging voltage V12 of the capacitor 12, and the gate voltage Vgs of the snubber switch 11.

図5に示したゲート電圧Vgsは、正負の絶対値がほぼ同じであった。これに対し、本実施形態では、負のゲート電圧Vgsの絶対値は、正のゲート電圧Vgsよりも低く、負のゲート電圧Vgsは、ほぼ順方向電圧(−Vf)までしか低下しない。   The gate voltage Vgs shown in FIG. 5 has almost the same positive and negative absolute values. On the other hand, in the present embodiment, the absolute value of the negative gate voltage Vgs is lower than the positive gate voltage Vgs, and the negative gate voltage Vgs decreases almost only to the forward voltage (−Vf).

このように、スナバ用スイッチ11のゲート−ソース間にダイオードD1を設けることで、過大な負のゲート電圧がスナバ用スイッチ11に印加されることを防止できる。   Thus, by providing the diode D1 between the gate and the source of the snubber switch 11, it is possible to prevent an excessively negative gate voltage from being applied to the snubber switch 11.

(実施形態4)
本実施形態では、スナバ用スイッチ11のゲート電荷を放電し、スナバ用スイッチ11をより高速にオフする放電回路を設けた点で、実施形態3と相違する。
(Embodiment 4)
This embodiment is different from the third embodiment in that a discharge circuit for discharging the gate charge of the snubber switch 11 and turning off the snubber switch 11 at higher speed is provided.

図8(A)、図8(B)、図9(A)及び図9(B)は、放電回路を示す図である。   8A, 8B, 9A, and 9B are diagrams illustrating a discharge circuit.

図8(A)に示す放電回路は、抵抗R2、キャパシタC2、スイッチング素子Q4を備えている。スイッチング素子Q4は、MOSFETであり、ドレインがスナバ用スイッチ11のゲートに接続され、ソースがスナバ用スイッチ11のソースに接続されている。抵抗R1とキャパシタC2との回路は時定数回路であり、その接続点は、スイッチング素子Q4のゲートに接続されている。抵抗R2は、キャパシタC2の放電用抵抗である。スイッチング素子Q4は、本発明に係る「第4スイッチ素子」に相当する。   The discharge circuit shown in FIG. 8A includes a resistor R2, a capacitor C2, and a switching element Q4. The switching element Q4 is a MOSFET having a drain connected to the gate of the snubber switch 11 and a source connected to the source of the snubber switch 11. The circuit of the resistor R1 and the capacitor C2 is a time constant circuit, and its connection point is connected to the gate of the switching element Q4. The resistor R2 is a discharging resistor for the capacitor C2. The switching element Q4 corresponds to a “fourth switch element” according to the present invention.

図8(B)に示す放電回路は、抵抗R2とキャパシタC2との直列回路、スイッチング素子Q5、及びダイオードD2を備えている。スイッチング素子Q5はトランジスタであり、コレクタがスナバ用スイッチ11のゲートに接続され、エミッタがスナバ用スイッチ11のソースに接続されている。ダイオードD2は、スイッチング素子Q5のコレクタ−エミッタ間に接続されている。抵抗R2とキャパシタC2との直列回路は時定数回路であって、スナバ用スイッチ11のゲート−ソース間に接続されている。また、抵抗R2とキャパシタC2との接続点はスイッチング素子Q5のベースに接続されている。スイッチング素子Q5は、本発明に係る「第4スイッチ素子」に相当する。   The discharge circuit shown in FIG. 8B includes a series circuit of a resistor R2 and a capacitor C2, a switching element Q5, and a diode D2. The switching element Q5 is a transistor, the collector is connected to the gate of the snubber switch 11, and the emitter is connected to the source of the snubber switch 11. The diode D2 is connected between the collector and the emitter of the switching element Q5. The series circuit of the resistor R2 and the capacitor C2 is a time constant circuit, and is connected between the gate and source of the snubber switch 11. The connection point between the resistor R2 and the capacitor C2 is connected to the base of the switching element Q5. The switching element Q5 corresponds to a “fourth switching element” according to the present invention.

図9(A)に示す放電回路は、抵抗R2とキャパシタC2との直列回路、スイッチング素子Q5、ダイオードD2及び抵抗R4を備えている。抵抗R4は、スイッチング素子Q5のエミッタとスナバ用スイッチ11のソースとの間に接続されている。   The discharge circuit shown in FIG. 9A includes a series circuit of a resistor R2 and a capacitor C2, a switching element Q5, a diode D2, and a resistor R4. The resistor R4 is connected between the emitter of the switching element Q5 and the source of the snubber switch 11.

図9(B)に示す放電回路は、抵抗R5、スイッチング素子Q5及びダイオードD2を備えている。抵抗R5は、スナバ用スイッチ11のゲートと、スイッチング素子Q5のベースとの間に接続されている。   The discharge circuit shown in FIG. 9B includes a resistor R5, a switching element Q5, and a diode D2. The resistor R5 is connected between the gate of the snubber switch 11 and the base of the switching element Q5.

図8(A)に示す放電回路のスイッチング素子Q4はボディーダイオードを有し、図8(B)、図9(A)、(B)に示すスイッチング素子Q5にはダイオードD2が接続されている。これらボディーダイオード及びダイオードD2は、実施形態3で説明したダイオードD1(図6参照)と同様に機能し、スナバ用スイッチ11に負のゲート電圧が印加されることを防止できる。   A switching element Q4 of the discharge circuit shown in FIG. 8A has a body diode, and a diode D2 is connected to the switching element Q5 shown in FIGS. 8B, 9A, and 9B. The body diode and the diode D2 function in the same manner as the diode D1 (see FIG. 6) described in the third embodiment, and can prevent a negative gate voltage from being applied to the snubber switch 11.

また、スイッチング素子Q4、Q5を設け、スイッチング素子Q4、Q5をオンする時間を時定数回路で短くすることで、スナバ用スイッチ11のゲート電荷を引き抜く時間を短くできる。すなわち、ゲート電圧Vgsを実施形態3の場合よりも高速に低下させて、スナバ用スイッチ11をオフできる。   Further, by providing the switching elements Q4 and Q5 and shortening the time for which the switching elements Q4 and Q5 are turned on by the time constant circuit, the time for extracting the gate charge of the snubber switch 11 can be shortened. That is, the snubber switch 11 can be turned off by lowering the gate voltage Vgs faster than in the third embodiment.

図10は、補助巻線n23の両端電圧V2、キャパシタ12の充電電圧V12、及びスナバ用スイッチ11のゲート電圧Vgsの波形を示す図である。前記のように、ゲート電圧Vgsを高速に低下させることができるため、実施形態3の場合よりも、高速にスナバ用スイッチ11はオフされる。   FIG. 10 is a diagram showing waveforms of the voltage V2 across the auxiliary winding n23, the charging voltage V12 of the capacitor 12, and the gate voltage Vgs of the snubber switch 11. As described above, since the gate voltage Vgs can be reduced at a high speed, the snubber switch 11 is turned off at a higher speed than in the third embodiment.

(実施形態5)
図11は、実施形態5に係る電力変換装置5の回路図である。この例では、スイッチング素子Q32にもスナバ回路20が設けられている点で、実施形態1と相違する。この例では、トランスT2に変えて、チョークコイルL1と、コイルL2,L3とが磁気結合するトランスT3を設けている。
(Embodiment 5)
FIG. 11 is a circuit diagram of the power converter 5 according to the fifth embodiment. This example is different from the first embodiment in that the snubber circuit 20 is also provided in the switching element Q32. In this example, a transformer T3 in which the choke coil L1 and the coils L2 and L3 are magnetically coupled is provided instead of the transformer T2.

スナバ回路20はスナバ用スイッチ21とキャパシタ22との直列回路である。スナバ用スイッチ21はMOSFETであり、本発明に係る「第3スイッチ素子」に相当する。スナバ用スイッチ21のゲートには、後述の制御回路が接続され、その制御回路によりオンオフされる。スナバ用スイッチ21は、スイッチング素子Q32のオフ時にオンされ、スイッチング素子Q32のオン時にオフされる。   The snubber circuit 20 is a series circuit of a snubber switch 21 and a capacitor 22. The snubber switch 21 is a MOSFET and corresponds to a “third switch element” according to the present invention. A control circuit, which will be described later, is connected to the gate of the snubber switch 21 and is turned on and off by the control circuit. The snubber switch 21 is turned on when the switching element Q32 is turned off and turned off when the switching element Q32 is turned on.

制御回路は、コイルL3及び補助巻線n24が順に直列接続された直列回路である。この直列回路は、コイルL3側がトランスT1の第2巻線n22の一端側に接続され、キャパシタC3側がスナバ用スイッチ21のゲートに接続されている。なお、キャパシタC3は、スナバ用スイッチ21のゲート−ソース間の電圧調整用のキャパシタである。   The control circuit is a series circuit in which the coil L3 and the auxiliary winding n24 are sequentially connected in series. In this series circuit, the coil L3 side is connected to one end side of the second winding n22 of the transformer T1, and the capacitor C3 side is connected to the gate of the snubber switch 21. The capacitor C3 is a capacitor for adjusting the voltage between the gate and the source of the snubber switch 21.

コイルL3はチョークコイルL1と磁気結合する。コイルL3は、本発明に係る「コイル結合巻線」に相当する。制御回路の補助巻線n24は、トランスT1の1次巻線n11と磁気結合する。補助巻線n24は、補助巻線n23と巻線方向が反対である。補助巻線n23は、本発明に係る「トランス補助巻線」に相当する。   Coil L3 is magnetically coupled to choke coil L1. The coil L3 corresponds to a “coil coupling winding” according to the present invention. The auxiliary winding n24 of the control circuit is magnetically coupled to the primary winding n11 of the transformer T1. The auxiliary winding n24 has a winding direction opposite to that of the auxiliary winding n23. The auxiliary winding n23 corresponds to a “transformer auxiliary winding” according to the present invention.

本実施形態においては、チョークコイルL1は、その巻き始め側(図中ではチョークコイルL1の黒丸がある側)が、センタータップ(接続点P)に接続されている。コイルL2は、その巻き始め側(図中ではコイルL2の黒丸がある側)が補助巻線n23と接続され、巻き終わり側がスナバ用スイッチ11のソース側に接続されている。また、コイルL3は、その巻き始め側(図中ではコイルL3の黒丸がある側)が補助巻線n24と接続され、巻き終わり側がスナバ用スイッチ21のソース側に接続されている。なお、チョークコイルL1の巻き始め側が出力部OUT2に接続されている場合は、コイルL2,L3の巻き終わり側が補助巻線n23,n24に接続されるようにし、コイルL2,L3の巻き始め側は、スナバ用スイッチ11,21のソース側に接続されるようにすればよい。   In the present embodiment, the choke coil L1 has its winding start side (the side with the black circle of the choke coil L1 in the drawing) connected to the center tap (connection point P). The coil L2 is connected to the auxiliary winding n23 at the winding start side (the side with the black circle of the coil L2 in the drawing) and is connected to the source side of the snubber switch 11 at the winding end side. The coil L3 has its winding start side (the side with the black circle of the coil L3 in the drawing) connected to the auxiliary winding n24 and its winding end side connected to the source side of the snubber switch 21. When the winding start side of the choke coil L1 is connected to the output part OUT2, the winding end side of the coils L2, L3 is connected to the auxiliary windings n23, n24, and the winding start side of the coils L2, L3 is The snubber switches 11 and 21 may be connected to the source side.

スナバ回路20のスナバ用スイッチ21をスイッチング制御する制御回路は、実施形態1で説明した、スナバ回路10用の制御回路と同じであるため、説明は省略する。   The control circuit for controlling the switching of the snubber switch 21 of the snubber circuit 20 is the same as the control circuit for the snubber circuit 10 described in the first embodiment, and a description thereof will be omitted.

スナバ回路20を設けることで、スイッチング素子Q32のオフ時に生じるスパイク電圧をキャパシタ22により吸収し、スイッチング素子Q32及びその周囲部品の損傷を防ぐことができる。また、補助巻線n24を設ける等、上述の構成を採用することで、スナバ用スイッチ21にかかる電力ストレスを抑え、スナバ用スイッチ21の破損を防ぐことができる。   By providing the snubber circuit 20, a spike voltage generated when the switching element Q32 is turned off is absorbed by the capacitor 22, and damage to the switching element Q32 and its peripheral components can be prevented. Further, by adopting the above-described configuration such as providing the auxiliary winding n24, the power stress applied to the snubber switch 21 can be suppressed, and the snubber switch 21 can be prevented from being damaged.

このように、スイッチング素子Q31,Q32の両方にスナバ回路10,20を設けることで、スイッチング素子Q31,Q32それぞれのオフ時に生じるスパイク電圧を吸収できる。また、上述の通り、スイッチング素子Q31,Q32及びその周辺回路を適切に保護できる。   Thus, by providing the snubber circuits 10 and 20 in both the switching elements Q31 and Q32, the spike voltage generated when the switching elements Q31 and Q32 are turned off can be absorbed. Further, as described above, the switching elements Q31 and Q32 and their peripheral circuits can be appropriately protected.

なお、スナバ回路及びそれに対応する制御回路は、スイッチング素子Q32に対してのみ設けるようにしてもよい。また、実施形態5の電力変換装置5に、実施形態2〜4の構成を組み合わせるようにしてもよい。その他、各実施形態の構成を適宜任意に組み合わせてもよい。   Note that the snubber circuit and the corresponding control circuit may be provided only for the switching element Q32. Moreover, you may make it combine the structure of Embodiment 2-4 with the power converter device 5 of Embodiment 5. FIG. In addition, the configurations of the respective embodiments may be arbitrarily combined as appropriate.

C1,C2,C3…キャパシタ
Co…平滑コンデンサ
D1,D2…ダイオード
IN1,IN2…入力部
L1…チョークコイル
L2,L3…コイル
n11…1次巻線
n21…第1巻線
n22…第2巻線
n23,n24…補助巻線
OUT1,OUT2…出力部
P…接続点(センタータップ)
Q11,Q12,Q21,Q22…スイッチング素子
Q31,Q32…スイッチング素子
Q4,Q5…スイッチング素子
R1,R2,R4,R5…抵抗
T1,T2,T3…トランス
1,2,3,5…電力変換装置
10,20…スナバ回路
11,21…スナバ用スイッチ
12,22…キャパシタ
C1, C2, C3 ... Capacitor Co ... Smoothing capacitors D1, D2 ... Diodes IN1, IN2 ... Input section L1 ... Choke coil L2, L3 ... Coil n11 ... Primary winding n21 ... First winding n22 ... Second winding n23 , N24 ... auxiliary windings OUT1, OUT2 ... output part P ... connection point (center tap)
Q11, Q12, Q21, Q22 ... switching elements Q31, Q32 ... switching elements Q4, Q5 ... switching elements R1, R2, R4, R5 ... resistors T1, T2, T3 ... transformers 1, 2, 3, 5 ... power converter 10 , 20 ... Snubber circuits 11, 21 ... Snubber switches 12, 22 ... Capacitors

Claims (4)

交流電圧が印加される1次巻線と、第1端、第2端及びセンタータップを備える2次巻線とを有するトランスと、
前記第1端と第1出力部との間に接続された第1スイッチ素子と、
前記第2端と前記第1出力部との間に接続された第2スイッチ素子と、
前記センタータップと第2出力部との間に接続されたチョークコイルと、
直列接続された第3スイッチ素子と第1キャパシタとを有し、前記第1スイッチ素子又は前記第2スイッチ素子の少なくとも一方に並列接続されたスナバ回路と、
前記第3スイッチ素子をオンオフする制御回路と、
を備え、
前記制御回路は、前記トランスの前記1次巻線と磁気結合するトランス補助巻線と、前記チョークコイルと磁気結合するコイル結合巻線との直列回路を有し、
前記直列回路は、前記第3スイッチ素子の制御端子と前記2次巻線の前記第1端との間に接続され、
前記1次巻線と、前記2次巻線のうち、前記センタータップと前記第1端との間の巻線部分、又は前記センタータップと前記第2端との間の巻線部分の一方と、前記トランス補助巻線との巻き数比を、N1:N2:N3で表し、前記チョークコイルと前記コイル結合巻線との巻き数比を、N4:N5で表し、m=N5/N4、n=N2/N1、n1=N3/N1とすると、
mn−n1=0を満たす、
電力変換装置。
A transformer having a primary winding to which an alternating voltage is applied, and a secondary winding having a first end, a second end, and a center tap;
A first switch element connected between the first end and the first output unit;
A second switch element connected between the second end and the first output unit;
A choke coil connected between the center tap and the second output unit;
A snubber circuit having a third switch element and a first capacitor connected in series, and connected in parallel to at least one of the first switch element or the second switch element;
A control circuit for turning on and off the third switch element;
With
The control circuit has a series circuit of a transformer auxiliary winding magnetically coupled to the primary winding of the transformer and a coil coupling winding magnetically coupled to the choke coil,
The series circuit is connected between a control terminal of the third switch element and the first end of the secondary winding;
Of the primary winding and the secondary winding, one of a winding portion between the center tap and the first end, or one of a winding portion between the center tap and the second end, , The turns ratio of the auxiliary transformer winding is represented by N1: N2: N3, and the turns ratio of the choke coil and the coil coupling winding is represented by N4: N5, m = N5 / N4, n = N2 / N1, and n1 = N3 / N1,
mn−n1 = 0 is satisfied,
Power conversion device.
前記直列回路はさらに第2キャパシタを含み、
前記第3スイッチ素子の前記制御端子と前記2次巻線の前記第1端との間に接続された抵抗素子を、さらに備え、
前記第2キャパシタと前記抵抗素子とで微分回路が形成された、
請求項1に記載の電力変換装置。
The series circuit further includes a second capacitor;
A resistance element connected between the control terminal of the third switch element and the first end of the secondary winding;
A differentiation circuit is formed by the second capacitor and the resistance element.
The power conversion device according to claim 1.
カソードが前記第3スイッチ素子の前記制御端子に接続され、アノードが前記第3スイッチ素子の基準電位端子に接続されたダイオード、
を備える請求項1又は2に記載の電力変換装置。
A diode having a cathode connected to the control terminal of the third switch element and an anode connected to a reference potential terminal of the third switch element;
The power converter according to claim 1 or 2 provided with.
前記第3スイッチ素子の制御端子と基準電位端子との間に接続された第4スイッチ素子と、
前記第3スイッチ素子のオン時に、設定された時定数で前記第4スイッチ素子をオンする時定数回路と、
を備え、
前記第4スイッチ素子がオンすることにより、前記第3スイッチ素子がオフする、
請求項1から3の何れかに記載の電力変換装置。
A fourth switch element connected between a control terminal of the third switch element and a reference potential terminal;
A time constant circuit for turning on the fourth switch element with a set time constant when the third switch element is turned on;
With
When the fourth switch element is turned on, the third switch element is turned off.
The power converter device in any one of Claim 1 to 3.
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