JP6377510B2 - Semiconductor device and manufacturing method of semiconductor device - Google Patents

Semiconductor device and manufacturing method of semiconductor device Download PDF

Info

Publication number
JP6377510B2
JP6377510B2 JP2014249278A JP2014249278A JP6377510B2 JP 6377510 B2 JP6377510 B2 JP 6377510B2 JP 2014249278 A JP2014249278 A JP 2014249278A JP 2014249278 A JP2014249278 A JP 2014249278A JP 6377510 B2 JP6377510 B2 JP 6377510B2
Authority
JP
Japan
Prior art keywords
package
substrate
solder
semiconductor device
connection terminal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2014249278A
Other languages
Japanese (ja)
Other versions
JP2016111270A (en
Inventor
高志 安留
高志 安留
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sharp Corp
Original Assignee
Sharp Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sharp Corp filed Critical Sharp Corp
Priority to JP2014249278A priority Critical patent/JP6377510B2/en
Publication of JP2016111270A publication Critical patent/JP2016111270A/en
Application granted granted Critical
Publication of JP6377510B2 publication Critical patent/JP6377510B2/en
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Landscapes

  • Solid State Image Pick-Up Elements (AREA)

Description

本発明は、パッケージに固体撮像素子を搭載する半導体装置に関する。   The present invention relates to a semiconductor device in which a solid-state image sensor is mounted on a package.

一般に、CCDイメージセンサ等が搭載される半導体装置は、デジタルカメラの本体内部等に配置されており、例えば、図12の(a)および図12の(b)に示す従来の半導体装置200が挙げられる。   In general, a semiconductor device on which a CCD image sensor or the like is mounted is disposed inside a main body of a digital camera or the like. For example, the conventional semiconductor device 200 shown in FIGS. It is done.

半導体装置200は、凹形状を有するパッケージ202が基板210に実装されたものである。パッケージ202の底面202aには固体撮像素子201(CCDチップ等)が固定材206により固定(接着)されている。固体撮像素子201の接続端子(図示なし)とパッケージ2内部の接続端子(図示なし)とはワイヤ205により接続されている。パッケージ202の、基板210に対向する面202cにはパッケージ側接続端子207が設けられている。基板210の主面210aにおけるパッケージ側接続端子207に対向する位置には、基板側接続端子211が設けられている。パッケージ側接続端子207と基板側接続端子211とは半田212を介して電気的に接続されている。   The semiconductor device 200 is obtained by mounting a package 202 having a concave shape on a substrate 210. A solid-state imaging device 201 (CCD chip or the like) is fixed (adhered) to a bottom surface 202 a of the package 202 by a fixing material 206. A connection terminal (not shown) of the solid-state image sensor 201 and a connection terminal (not shown) inside the package 2 are connected by a wire 205. Package side connection terminals 207 are provided on a surface 202 c of the package 202 facing the substrate 210. A substrate-side connection terminal 211 is provided at a position facing the package-side connection terminal 207 on the main surface 210 a of the substrate 210. The package side connection terminal 207 and the board side connection terminal 211 are electrically connected via solder 212.

さらに、パッケージ202には、パッケージ202の開口部202bを塞ぐように、シールガラス等の透光性のある覆部203が接着材204により接着されている。これにより、パッケージ202および覆部203により封止された中空部213が形成され、固体撮像素子201は中空部213に気密封止されている。   Further, a transparent cover 203 such as a seal glass is bonded to the package 202 with an adhesive 204 so as to close the opening 202 b of the package 202. Thereby, the hollow part 213 sealed by the package 202 and the cover part 203 is formed, and the solid-state imaging device 201 is hermetically sealed in the hollow part 213.

しかし、上述した半導体装置200のような従来の構造では、半導体装置200の製造過程における中空部213の内部圧力の増加により、覆部203の剥がれ、またはズレが生じてしまうなどの問題があった。そこで、覆部203の剥がれ、またはズレを防止するための様々な試みがなされている。   However, the conventional structure such as the semiconductor device 200 described above has a problem that the cover 203 is peeled off or displaced due to an increase in the internal pressure of the hollow portion 213 in the manufacturing process of the semiconductor device 200. . Accordingly, various attempts have been made to prevent the cover 203 from peeling or shifting.

例えば、特許文献1には、中空部と外部とを連通する通気孔を備える半導体装置について記載されている。特許文献1に記載されている半導体装置では、通気孔を備えることにより中空部を封止体にて閉塞した後も中空部が通気性を有しているので、封止体を中空部に取着の際に中空部内の内圧が高まることがなく、封止体の位置ズレや剥がれなどを防止することができる。   For example, Patent Document 1 describes a semiconductor device including a vent hole that communicates a hollow portion with the outside. In the semiconductor device described in Patent Document 1, since the hollow portion has air permeability even after the hollow portion is closed with the sealing body by providing the vent hole, the sealing body is attached to the hollow portion. The inner pressure in the hollow portion does not increase during wearing, and the positional deviation or peeling of the sealing body can be prevented.

特許文献2には、シールガラスを接合する前に、凹部に連通する状態でパッケージに貫通穴を形成しておき、その後、パッケージにシールガラスを接合したのち、貫通穴を塞ぐ固体撮像装置の製造方法について記載されている。特許文献2に記載されている固体撮像装置の製造方法によれば、パッケージにシールガラスを接合する際には、貫通穴を通して凹部内のエアを外部に逃がすことができる。また、シールガラスを接合した後は、貫通穴を塞ぐことによって凹部内を気密状態に保持することができる。   In Patent Literature 2, a through-hole is formed in a package in a state communicating with a recess before the seal glass is joined, and then a solid-state imaging device is formed that seals the through-hole after the seal glass is joined to the package. The method is described. According to the manufacturing method of the solid-state imaging device described in Patent Document 2, when the seal glass is joined to the package, the air in the recess can be released to the outside through the through hole. Further, after the sealing glass is bonded, the inside of the recess can be kept airtight by closing the through hole.

また、特許文献3には、パッケージの中を不活性ガスで気密封止する際に用いられパッケージの底部に形成されている封止孔と、封止孔を塞ぐ封止剤を備える固体撮像装置について記載されている。   Patent Document 3 discloses a solid-state imaging device including a sealing hole that is used when the inside of a package is hermetically sealed with an inert gas and is formed at the bottom of the package, and a sealing agent that closes the sealing hole. Is described.

特開2003−152123号公報(2003年5月23日公開)JP 2003-152123 A (published May 23, 2003) 特開2000−150844号公報(2000年5月30日公開)JP 2000-150844 A (published on May 30, 2000) 特開2008−108809号公報(2008年5月8日公開)JP 2008-108809 A (published May 8, 2008)

しかしながら、特許文献1に記載されている半導体装置は、製品として流通する際も通気孔により通気性を有したままであり、中空部は気密封止状態になっていない。したがって、劣悪な環境下、例えば高温、高湿度環境下で上記半導体装置を使用すると、中空部に設けられている固体撮像素子も周辺環境と同じく高温、高湿度環境下にさらされてしまう。このため、固体撮像素子の接続端子等の金属部の腐食が加速され、半導体装置の性能が損なわれる可能性があるという問題がある。   However, the semiconductor device described in Patent Document 1 remains air permeable due to the air holes even when it is distributed as a product, and the hollow portion is not in an airtight sealed state. Therefore, when the semiconductor device is used in a poor environment, for example, in a high temperature and high humidity environment, the solid-state imaging device provided in the hollow portion is exposed to a high temperature and high humidity environment as in the surrounding environment. For this reason, there is a problem that the corrosion of the metal part such as the connection terminal of the solid-state imaging device is accelerated and the performance of the semiconductor device may be impaired.

また、特許文献2に記載されている固体撮像装置の製造方法では、シールガラスを接合した後に貫通穴を塞ぎ、凹部内を気密状態に保持する。そのため、パッケージを基板に加熱実装する際における凹部内の熱膨張したエアを外部に排出することができず、シールガラスの剥がれ、または、シールガラスのズレが生じる可能性があるという問題がある。特許文献3に記載されている固体撮像装置についても、パッケージが基板に実装される前に封止孔が封止剤により塞がれているため、特許文献2に記載されている固体撮像装置の製造方法と同様の問題がある。   Moreover, in the manufacturing method of the solid-state imaging device described in Patent Document 2, after the sealing glass is joined, the through hole is closed and the inside of the recess is kept airtight. Therefore, there is a problem in that the thermally expanded air in the concave portion when the package is heated and mounted on the substrate cannot be discharged to the outside, and the sealing glass may be peeled off or the sealing glass may be displaced. Also for the solid-state imaging device described in Patent Document 3, since the sealing hole is closed by the sealant before the package is mounted on the substrate, the solid-state imaging device described in Patent Document 2 There is a problem similar to the manufacturing method.

本発明は、上記の問題点に鑑みてなされたものであり、その目的は、容易に製造でき、気密封止状態が保たれた製品信頼性の高い半導体装置を提供することにある。   The present invention has been made in view of the above-described problems, and an object of the present invention is to provide a semiconductor device with high product reliability that can be easily manufactured and kept in an airtight sealed state.

上記の課題を解決するために、本発明の一態様に係る半導体装置は、基板と、上記基板の主面上に半田により実装される凹形状のパッケージと、上記パッケージの開口部を封止して中空部を形成している覆部と、上記パッケージの底面部に形成され、上記中空部と外部とを連通する貫通部と、上記基板の主面と対向する上記パッケージの面において上記貫通部の開口部の周囲に設けられている第1電極と、上記基板の主面において上記第1電極に対向する位置に設けられている第2電極と、上記基板と上記パッケージとを電気的に接続する接続部と、上記パッケージの上記基板に対向する面において上記第1電極と上記接続部との間に設けられる第1飛散防止接続部と、上記基板の主面において上記第1飛散防止接続部に対向する位置に設けられる第2飛散防止接続部と、を備え、上記貫通部の開口部は、上記第1電極と上記第2電極とを接続する半田により塞がれており、上記第1飛散防止接続部と上記第2飛散防止接続部とは半田により接続されていることを特徴とする。 In order to solve the above problems, a semiconductor device according to one embodiment of the present invention seals a substrate, a concave package that is mounted on the main surface of the substrate by solder, and an opening of the package. A cover portion that forms a hollow portion, a through portion that is formed on the bottom surface portion of the package and communicates the hollow portion with the outside, and the through portion on the surface of the package that faces the main surface of the substrate Electrically connecting the first electrode provided around the opening, the second electrode provided at a position facing the first electrode on the main surface of the substrate, and the substrate and the package The first scattering prevention connecting portion provided between the first electrode and the connecting portion on the surface of the package facing the substrate, and the first scattering preventing connecting portion on the main surface of the substrate. Provided at a position opposite to Is a second scatter preventing connection portion, provided with a an opening of the through portion is closed by soldering for connecting the first electrode and the second electrode, the first scatter preventing connection portion and the The second scattering prevention connecting portion is connected by solder .

また、本発明の一態様に係る半導体装置の製造方法は、底面部に貫通部を有した凹形状のパッケージの開口部を覆部により封止して中空部を形成する中空部形成工程と、半田により基板の主面上に上記パッケージを実装する際に、上記基板の主面と対向する上記パッケージの面において上記貫通部の開口部の周囲に設けられている第1電極と、上記基板の主面において上記第1電極に対向する位置に設けられている第2電極と、を半田により接続し、上記貫通部の開口部を半田で塞ぎ、上記パッケージの上記基板に対向する面において(i)上記第1電極と(ii)上記基板と上記パッケージとを電気的に接続する接続部との間に設けられる第1飛散防止接続部と、上記基板の主面において上記第1飛散防止接続部に対向する位置に設けられる第2飛散防止接続部と、を半田により接続する実装工程と、を含むことを特徴とする。 In addition, a method for manufacturing a semiconductor device according to one embodiment of the present invention includes a hollow part forming step in which a hollow part is formed by sealing an opening of a concave package having a through part on a bottom part with a cover part; When the package is mounted on the main surface of the substrate by solder, a first electrode provided around the opening of the through portion on the surface of the package facing the main surface of the substrate; a second electrode provided at a position opposed to the first electrode on the main surface, were connected by soldering, busy technique the opening of the through portion by soldering, in the surface facing the substrate of the package ( i) a first scattering prevention connecting portion provided between the first electrode and (ii) a connecting portion for electrically connecting the substrate and the package; and the first scattering prevention connection on a main surface of the substrate. Provided at a position facing the A mounting step of connecting a second scatter preventing connections, a by soldering, characterized in that it comprises a.

本発明の一態様によれば、容易に製造でき、気密封止状態が保たれた製品信頼性の高い半導体装置を提供できる効果を奏する。   According to one embodiment of the present invention, it is possible to provide a highly reliable semiconductor device that can be easily manufactured and has a hermetically sealed state.

(a)は実施形態1に係る半導体装置の構成を表す断面図であり、(b)は上記半導体装置におけるパッケージの平面図である。(A) is sectional drawing showing the structure of the semiconductor device which concerns on Embodiment 1, (b) is a top view of the package in the said semiconductor device. (a)および(b)は上記半導体装置の効果を説明する断面図である。(A) And (b) is sectional drawing explaining the effect of the said semiconductor device. 上記半導体装置の他の効果を説明する断面図である。It is sectional drawing explaining the other effect of the said semiconductor device. (a)〜(c)は上記半導体装置のさらに他の効果を説明する断面図である。(A)-(c) is sectional drawing explaining the further another effect of the said semiconductor device. (a)〜(f)は上記半導体装置におけるパッケージの製造方法を説明する模式図である。(A)-(f) is a schematic diagram explaining the manufacturing method of the package in the said semiconductor device. (a)は上記パッケージにおける通気孔付接続端子の例を示す平面図であり、(b)は上記通気孔付接続端子の他の例を示す平面図である。(A) is a top view which shows the example of the connection terminal with a vent hole in the said package, (b) is a top view which shows the other example of the said connection terminal with a vent hole. (a)〜(d)は上記半導体装置におけるパッケージの他の製造方法を説明する模式図である。(A)-(d) is a schematic diagram explaining the other manufacturing method of the package in the said semiconductor device. (a)は上記パッケージにおける通気孔付接続端子の例を示す平面図であり、(b)は上記通気孔付接続端子の他の例を示す平面図である。(A) is a top view which shows the example of the connection terminal with a vent hole in the said package, (b) is a top view which shows the other example of the said connection terminal with a vent hole. (a)は実施形態2に係る半導体装置の構成を表す断面図であり、(b)および(c)は上記半導体装置におけるパッケージの平面図である。(A) is sectional drawing showing the structure of the semiconductor device which concerns on Embodiment 2, (b) and (c) are the top views of the package in the said semiconductor device. (a)〜(c)は上記半導体装置の通気路を説明する平面図である。(A)-(c) is a top view explaining the ventilation path of the said semiconductor device. (a)は実施形態3に係る半導体装置の構成を表す断面図であり、(b)は(a)の一部を拡大して示す断面図であり、(c)は上記半導体装置におけるパッケージの平面図である。(A) is sectional drawing showing the structure of the semiconductor device which concerns on Embodiment 3, (b) is sectional drawing which expands and shows a part of (a), (c) is a package of the said semiconductor device. It is a top view. (a)は従来の半導体装置の構成を表す断面図であり、(b)は上記半導体装置におけるパッケージの平面図である。(A) is sectional drawing showing the structure of the conventional semiconductor device, (b) is a top view of the package in the said semiconductor device.

以下、本発明の実施形態について、詳細に説明する。なお、説明の便宜上、各実施形態に示した部材と同一の機能を有する部材については、同一の符号を付記し、適宜その説明を省略する。   Hereinafter, embodiments of the present invention will be described in detail. For convenience of explanation, members having the same functions as those shown in the embodiments are denoted by the same reference numerals, and description thereof is omitted as appropriate.

〔実施形態1〕
本発明の実施形態1について、図1〜図8および図12を参照して説明する。
Embodiment 1
Embodiment 1 of the present invention will be described with reference to FIGS. 1 to 8 and FIG.

〔半導体装置の構成〕
図1の(a)は、本実施形態に係る半導体装置50の構成を示す断面図であり、図1の(b)は、半導体装置50におけるパッケージ2を方向Aから見た平面図である。
[Configuration of semiconductor device]
1A is a cross-sectional view showing the configuration of the semiconductor device 50 according to the present embodiment, and FIG. 1B is a plan view of the package 2 in the semiconductor device 50 as viewed from the direction A. FIG.

半導体装置50は、撮像のために用いれ、例えば、携帯電話機、デジタルカメラ等に組み込まれる。半導体装置50は、図1の(a)に示すように、固体撮像素子1、パッケージ2、覆部3、ワイヤ5(ボンディングワイヤ)、固定材6、基板10、中空部13、通気孔封止部14、および導通接続部17(接続部)を備えている。   The semiconductor device 50 is used for imaging, and is incorporated in, for example, a mobile phone, a digital camera, or the like. As shown in FIG. 1A, the semiconductor device 50 includes a solid-state imaging device 1, a package 2, a cover 3, a wire 5 (bonding wire), a fixing material 6, a substrate 10, a hollow portion 13, and a vent hole seal. Part 14 and conduction connection part 17 (connection part).

固体撮像素子1は、対象物(被写体)の入射光を受光するために用いられる。固体撮像素子1は、例えば、CCD(Charge Coupled Device)などである。   The solid-state imaging device 1 is used for receiving incident light of an object (subject). The solid-state imaging device 1 is, for example, a CCD (Charge Coupled Device).

基板10は、複数の配線が形成された板状の部材であり、パッケージ2が実装されている。   The substrate 10 is a plate-like member on which a plurality of wirings are formed, and the package 2 is mounted thereon.

パッケージ2は、底面2aに固体撮像素子1を搭載している。パッケージ2は基板10の主面10a上に半田により実装される。パッケージ2の底面部2fには通気孔8(貫通部)が設けられている。通気孔8について、詳しくは後述する。   The package 2 has the solid-state imaging device 1 mounted on the bottom surface 2a. The package 2 is mounted on the main surface 10a of the substrate 10 by solder. The bottom surface portion 2f of the package 2 is provided with a vent hole 8 (through portion). Details of the vent hole 8 will be described later.

パッケージ2は筐体であり、底面部2fに対向する面は開口されている。言い換えると、パッケージ2は凹形状であり、開口部2bを有する。パッケージ2の底面2aの周囲には、外周に沿って凸部2dが形成されており、凸部2dの上面には、ワイヤ接続端子18(図5の(a)参照)が形成されている。パッケージ2は、導通接続部17により基板10の主面10aに実装されている。パッケージ2は、例えば、セラミックパッケージ20(図5参照)、もしくは、プリント基板パッケージ21(図7参照)を用いることができる。どちらを用いるかにより、後述する通気孔付接続端子9の製造方法が異なる。詳しくは後述する。   The package 2 is a housing, and a surface facing the bottom surface portion 2f is opened. In other words, the package 2 has a concave shape and has an opening 2b. A convex portion 2d is formed around the bottom surface 2a of the package 2 along the outer periphery, and a wire connection terminal 18 (see FIG. 5A) is formed on the upper surface of the convex portion 2d. The package 2 is mounted on the main surface 10 a of the substrate 10 by the conductive connection portion 17. As the package 2, for example, a ceramic package 20 (see FIG. 5) or a printed circuit board package 21 (see FIG. 7) can be used. Depending on which one is used, the manufacturing method of the connection terminal 9 with a vent hole to be described later differs. Details will be described later.

固定材6は、底面2aに固体撮像素子1を固定(接着)する。言い換えると、パッケージ2の底面部2fの中空部13側には、固定材6を介して固体撮像素子1が固定されている。固体撮像素子1における接続端子(図示なし)とワイヤ接続端子18(図5の(a)参照)とは、ワイヤ5により電気的に接続されている。   The fixing material 6 fixes (adheres) the solid-state imaging device 1 to the bottom surface 2a. In other words, the solid-state imaging device 1 is fixed to the hollow portion 13 side of the bottom surface portion 2 f of the package 2 via the fixing material 6. The connection terminal (not shown) and the wire connection terminal 18 (see FIG. 5A) in the solid-state imaging device 1 are electrically connected by the wire 5.

一般的な固定材6の材料としては、ペースト状のエポキシ系樹脂が主流であり、導電性タイプとして銀等のフィラーを用いたものや、絶縁性タイプとしてアルミナ等のフィラーを用いたものがある。その他、固体撮像素子1がシリコンウェハ状態時に貼付け可能なフィルム状の固定材6を用いてもよい。   As a material for the general fixing material 6, a paste-type epoxy resin is mainly used, and there are a material using a filler such as silver as a conductive type and a material using a filler such as alumina as an insulating type. . In addition, a film-like fixing material 6 that can be attached when the solid-state imaging device 1 is in a silicon wafer state may be used.

導通接続部17は、パッケージ2と基板10とを電気的に接続させる。パッケージ2は導通接続部17を介して基板10に実装される。導通接続部17は、パッケージ側接続端子7、半田12、基板側接続端子11を有する。   The conductive connection portion 17 electrically connects the package 2 and the substrate 10. The package 2 is mounted on the substrate 10 via the conductive connection portion 17. The conductive connection portion 17 includes a package side connection terminal 7, solder 12, and a substrate side connection terminal 11.

パッケージ側接続端子7は、パッケージ2の基板10に対向する面2cに設けられ、半田により基板側接続端子11と接続されることにより、固体撮像素子1と基板10との電気信号を送受可能とする。パッケージ側接続端子7は、例えば、パッケージ2の内部配線パターン(図示なし)と電気的に接続されることにより、固体撮像素子1と電気的に接続されている。   The package-side connection terminal 7 is provided on the surface 2c of the package 2 facing the substrate 10 and is connected to the substrate-side connection terminal 11 with solder, so that electrical signals between the solid-state imaging device 1 and the substrate 10 can be transmitted and received. To do. The package side connection terminal 7 is electrically connected to the solid-state imaging device 1 by being electrically connected to, for example, an internal wiring pattern (not shown) of the package 2.

基板側接続端子11は、基板10の主面10aにおけるパッケージ側接続端子7に対向する位置に設けられている。基板側接続端子11は、例えば、基板10の主面10a上のパターニングされた配線(図示なし)に接続されている。   The substrate side connection terminal 11 is provided at a position facing the package side connection terminal 7 on the main surface 10 a of the substrate 10. The substrate side connection terminal 11 is connected to, for example, a patterned wiring (not shown) on the main surface 10a of the substrate 10.

パッケージ側接続端子7と基板側接続端子11とを半田12を介して接触させた状態で、半田12を加熱することにより、パッケージ2が基板10に実装される。また、これにより、パッケージ側接続端子7と基板側接続端子11とが電気的に接続される。   The package 2 is mounted on the substrate 10 by heating the solder 12 in a state where the package side connection terminal 7 and the substrate side connection terminal 11 are in contact with each other via the solder 12. Thereby, the package side connection terminal 7 and the board side connection terminal 11 are electrically connected.

覆部3は、パッケージ2に搭載された固体撮像素子1を外部(例えば、塵や異物など)から保護するために用いられる。また、覆部3は、パッケージ2の開口部2bを封止して中空部13を形成している。詳しくは、覆部3は、開口部2bを覆い、固体撮像素子1と向き合うように、パッケージ2の上端部2eに接着材4にて固定されている。覆部3は透光性を有する。覆部3の材料としては、一般的にガラス(硼珪酸ガラス)が用いられる。   The cover 3 is used to protect the solid-state imaging device 1 mounted on the package 2 from the outside (for example, dust or foreign matter). Further, the cover 3 forms a hollow portion 13 by sealing the opening 2 b of the package 2. Specifically, the cover 3 is fixed to the upper end 2 e of the package 2 with an adhesive 4 so as to cover the opening 2 b and face the solid-state imaging device 1. The cover part 3 has translucency. As a material for the cover 3, glass (borosilicate glass) is generally used.

〔通気孔および通気孔封止部の構成〕
通気孔8は、中空部13を外部と連通させる。詳しくは、通気孔8は、パッケージ2の底面部2fの固体撮像素子1が搭載されていない箇所において、底面部2fを中空部13側からパッケージ2の裏面側に円柱状に貫通する。言い換えると、通気孔8はパッケージ2の底面部2fの固体撮像素子1の周辺において、底面部2fを中空部13側から基板10側の外部に向かって貫通する。
[Configuration of vent hole and vent hole sealing part]
The vent hole 8 allows the hollow portion 13 to communicate with the outside. Specifically, the vent hole 8 penetrates the bottom surface portion 2f from the hollow portion 13 side to the back surface side of the package 2 in a columnar shape at a location where the solid-state imaging device 1 of the bottom surface portion 2f of the package 2 is not mounted. In other words, the vent hole 8 penetrates the bottom surface portion 2 f from the hollow portion 13 side toward the outside on the substrate 10 side in the periphery of the solid-state imaging device 1 of the bottom surface portion 2 f of the package 2.

通気孔8の基板10側の開口部8aは、後述する通気孔封止部14、具体的には、硬化した半田12aにより塞がれている(閉塞されている)。なお、通気孔8の形状は円柱状に限らず、中空部13と外部とを連通するものであればよい。また、通気孔8はごく小さいサイズでも十分な効果が得られるため、例えば、通気孔8の直径を0.1mm程度とすることができる。   The opening 8a on the substrate 10 side of the vent hole 8 is closed (closed) by a vent hole sealing portion 14 described later, specifically, a hardened solder 12a. In addition, the shape of the vent hole 8 is not limited to a columnar shape, and any shape may be used as long as the hollow portion 13 communicates with the outside. Moreover, since the sufficient effect is acquired even if the ventilation hole 8 is very small size, the diameter of the ventilation hole 8 can be made into about 0.1 mm, for example.

通気孔封止部14は、通気孔8の開口部8aを塞ぐ。通気孔封止部14は、通気孔付接続端子9(第1電極)、半田12a、基板側接続端子11a(第2電極)を有する。   The vent hole sealing portion 14 closes the opening 8 a of the vent hole 8. The vent hole sealing portion 14 includes a vented connection terminal 9 (first electrode), solder 12a, and substrate side connection terminal 11a (second electrode).

通気孔付接続端子9および基板側接続端子11aは、パッケージ2を基板10に実装する処理中および実装後において、通気孔付接続端子9と基板側接続端子11aとの間に半田12aを配置させるためのものである。   The connection terminals 9 with vent holes and the board-side connection terminals 11a are arranged with solder 12a between the connection terminals 9 with vent holes and the board-side connection terminals 11a during and after the process of mounting the package 2 on the board 10. Is for.

通気孔付接続端子9は、パッケージ2裏面において通気孔8の周囲に設けられている。これにより、半導体装置50の製造過程において、膨張した中空部の気体が通気孔8を介して外部へ排出される。   The connection terminal 9 with a vent hole is provided around the vent hole 8 on the back surface of the package 2. Thereby, in the process of manufacturing the semiconductor device 50, the expanded gas in the hollow portion is discharged to the outside through the vent hole 8.

基板側接続端子11aは、基板10の主面10aの通気孔付接続端子9に対向する位置に設けられている。基板側接続端子11と基板側接続端子11aとは、同一平面上に設けられている。   The board-side connection terminal 11 a is provided at a position facing the connection terminal 9 with a vent on the main surface 10 a of the board 10. The board side connection terminal 11 and the board side connection terminal 11a are provided on the same plane.

また、通気孔付接続端子9は、基板側接続端子11aと半田接合できるように設けられている。通気孔付接続端子9は、例えば、パッケージ2の内部配線パターン(図示なし)と電気的に接続され、固体撮像素子1と電気的に接続されている。同様に基板側接続端子11aは、例えば、基板10の主面10a上のパターニングされた配線(図示なし)に接続されている。   Further, the connection terminal 9 with a vent hole is provided so that it can be soldered to the board side connection terminal 11a. The connection terminal 9 with a vent hole is electrically connected to, for example, an internal wiring pattern (not shown) of the package 2 and is electrically connected to the solid-state imaging device 1. Similarly, the substrate-side connection terminal 11a is connected to a patterned wiring (not shown) on the main surface 10a of the substrate 10, for example.

なお、通気孔付接続端子9は、パッケージ側接続端子7のように、必ずしも固体撮像素子1と電気的に接続されている必要はない。通気孔付接続端子9および基板側接続端子11aは、上述した、通気孔8の基板10側の開口部8aを塞ぐことを目的とする、いわゆるダミー端子であってもよい。   Note that the vented connection terminal 9 does not necessarily need to be electrically connected to the solid-state imaging device 1 unlike the package side connection terminal 7. The connection terminal 9 with vent hole and the board side connection terminal 11a may be so-called dummy terminals for the purpose of closing the opening 8a on the board 10 side of the vent hole 8 described above.

〔通気孔付接続端子と基板側接続端子との接続〕
ここで、半導体装置50の製造方法の特徴について説明しておく。半導体装置50の製造方法の特徴は、底面部2fに通気孔8を有した凹形状のパッケージ2の開口部2bに、覆部3を接着して中空部13を形成する中空部形成工程と、半田12により基板10の主面10a上に上記パッケージ2を実装する際に、基板10の主面10aと対向するパッケージ2の面2cにおいて通気孔8の開口部8aの周囲に設けられている通気孔付接続端子9と、基板10の主面10aにおいて通気孔付接続端子9に対向する位置に設けられている基板側接続端子11aと、を半田12aにより接続し、通気孔8の開口部8aを半田12aで塞ぐ実装工程と、を含み、実装工程は、半田12aが溶解状態であるときは、通気孔8から中空部13内の気体を排出し、半田12aが硬化することにより、上記半田12aが通気孔8の開口部8aを塞ぐ点である。
(Connection between vented connection terminal and board side connection terminal)
Here, features of the method for manufacturing the semiconductor device 50 will be described. A feature of the manufacturing method of the semiconductor device 50 is that a hollow part forming step is performed in which the cover part 3 is bonded to the opening 2b of the concave package 2 having the vent hole 8 in the bottom face part 2f to form the hollow part 13. When the package 2 is mounted on the main surface 10a of the substrate 10 with the solder 12, the surface 2c of the package 2 facing the main surface 10a of the substrate 10 is provided around the opening 8a of the vent hole 8. The connection terminal 9 with pores and the board-side connection terminal 11a provided at a position facing the connection terminal 9 with vent holes on the main surface 10a of the substrate 10 are connected by solder 12a, and the opening 8a of the vent hole 8 is connected. A mounting step of closing the solder 12a with the solder 12a, and when the solder 12a is in a dissolved state, the solder 12a is cured by discharging the gas in the hollow portion 13 from the vent hole 8 and hardening the solder 12a. 12a is ventilated 8 in that close the opening 8a of.

実装工程において、通気孔付接続端子9および基板側接続端子11aは、パッケージ側接続端子7と基板側接続端子11とが半田12を介して接触させた状態となるのと同様に、通気孔付接続端子9と基板側接続端子11aとが半田12aを介して接触させた状態となる。その状態で、パッケージ2を基板10に実装する際、半田12aも半田12と同時に加熱される。これにより、通気孔付接続端子9と基板側接続端子11aとは、半田12aにより接続される。   In the mounting process, the connection terminals 9 with vent holes and the board-side connection terminals 11a are provided with vent holes in the same manner as the package-side connection terminals 7 and the board-side connection terminals 11 are brought into contact with each other through the solder 12. The connection terminal 9 and the board side connection terminal 11a are brought into contact with each other through the solder 12a. In this state, when the package 2 is mounted on the substrate 10, the solder 12 a is also heated simultaneously with the solder 12. Thereby, the connection terminal 9 with a vent hole and the board | substrate side connection terminal 11a are connected by the solder 12a.

半田12aが溶融状態であると、中空部13内の膨張した気体を排出することが可能である。また、半田12aが硬化することで開口部8aは完全に塞がれ、中空部13は気密封止状態となる。つまり、パッケージ2を基板10に実装する処理中、半田12aが加熱され溶融状態である場合、半田12aは開口部8aを塞ぎつつ中空部13内の膨張した気体を排出することができる。言い換えると、本実施形態では、膨張した中空部13内の気体を通気孔8より溶解状態の半田12aを介して外部に排出しながら開口部8aを塞ぎつつ、パッケージ2を基板10に実装することができる。   When the solder 12a is in a molten state, the expanded gas in the hollow portion 13 can be discharged. Further, the hardening of the solder 12a completely closes the opening 8a, and the hollow portion 13 is hermetically sealed. That is, when the solder 12a is heated and melted during the process of mounting the package 2 on the substrate 10, the solder 12a can discharge the expanded gas in the hollow portion 13 while closing the opening 8a. In other words, in this embodiment, the package 2 is mounted on the substrate 10 while closing the opening 8a while discharging the gas in the expanded hollow portion 13 from the vent hole 8 through the melted solder 12a to the outside. Can do.

本実施形態に係る半導体装置50は、通気孔8を有するため、実装処理以外の半導体装置50の製造過程におけて増加した中空部13の内部圧力を容易に降下させることができ、覆部3の剥がれ、またはズレは生じない。   Since the semiconductor device 50 according to the present embodiment has the vent hole 8, the internal pressure of the hollow portion 13 increased in the manufacturing process of the semiconductor device 50 other than the mounting process can be easily lowered, and the cover portion 3 There is no peeling or misalignment.

しかし、パッケージ2に通気孔8を設けるのみでは中空部13が気密封止されていない半導体装置50となる。中空部13が気密封止されていないと、半導体装置50が劣悪な環境下、例えば高温、高湿度環境下で使用された場合、中空部13に設けられている固体撮像素子1も周辺環境と同じ劣悪な環境下にさらされるため、半導体装置50の性能が損なわれる可能性がある。中空部13が気密封止状態となる半導体装置50を実現するためには、組立完了(製造完了)時に通気孔8が閉塞されている必要がある。   However, the semiconductor device 50 in which the hollow portion 13 is not hermetically sealed simply by providing the vent hole 8 in the package 2. If the hollow part 13 is not hermetically sealed, when the semiconductor device 50 is used in a poor environment, for example, in a high temperature and high humidity environment, the solid-state imaging device 1 provided in the hollow part 13 also has a surrounding environment. Since it is exposed to the same poor environment, the performance of the semiconductor device 50 may be impaired. In order to realize the semiconductor device 50 in which the hollow portion 13 is hermetically sealed, the vent hole 8 needs to be closed when the assembly is completed (manufacture completed).

そこで本実施形態では、基板側接続端子11aとの接続端子も兼ねた通気孔付接続端子9を通気孔8の開口部8aの周辺に設け、パッケージ2を基板10に実装する際、通気孔付接続端子9と基板側接続端子11aとを半田12aにより接続する。これにより、パッケージ2を基板10に実装する処理中、例えば、リフローによる実装処理中、において、リフローの熱により膨張した中空部13内の気体を、通気孔8および溶解状態の半田12aから容易に排出可能である。また、実装完了時、通気孔8の開口部8aを半田12aにより自動的に塞ぐことができ、さらに、高温・乾燥状態において、中空部13内の膨張した気体の排出および通気孔8の閉塞が可能となるため、中空部13は極めて湿度の低い状態での気密封止状態を実現できる。   Therefore, in the present embodiment, when the package 2 is mounted on the substrate 10, the connection terminal 9 with the vent hole that also serves as the connection terminal with the board-side connection terminal 11 a is provided around the opening 8 a of the vent hole 8. The connection terminal 9 and the board side connection terminal 11a are connected by solder 12a. Thereby, during the process of mounting the package 2 on the substrate 10, for example, during the mounting process by reflow, the gas in the hollow portion 13 expanded by the heat of reflow can be easily transferred from the vent hole 8 and the solder 12a in the melted state. It can be discharged. Further, when the mounting is completed, the opening 8a of the vent hole 8 can be automatically closed by the solder 12a, and further, the expanded gas in the hollow portion 13 is discharged and the vent hole 8 is blocked in a high temperature / dry state. Therefore, the hollow portion 13 can realize an airtight sealed state with extremely low humidity.

〔効果〕
半導体装置50は、パッケージ2に覆部3を搭載する前、および覆部3をパッケージ2に搭載後、接着材4の硬化処理が完了し、パッケージ2を基板10に実装する処理までは、通気孔8により中空部13と外部との通気状態が維持されている。
〔effect〕
The semiconductor device 50 passes through the process before the cover 3 is mounted on the package 2 and after the cover 3 is mounted on the package 2 until the curing process of the adhesive 4 is completed and the package 2 is mounted on the substrate 10. The air vent state between the hollow portion 13 and the outside is maintained by the pores 8.

また、パッケージ2を基板10に実装する際においても、半田12aが溶融状態時には通気孔8を介して中空部13内の膨張した気体を排出することができ、通気状態が維持される。しかし、半田12aが硬化した後、つまり、パッケージ2を基板10に実装した後には、通気孔8は半田12aにより塞がれる。これにより中空部13が気密封止状態になる。言い換えると、半導体装置50は、製造過程では中空部13に通気機能があり、製造完了後は、中空部13は気密封止構造となる。   Also, when the package 2 is mounted on the substrate 10, when the solder 12a is in a molten state, the expanded gas in the hollow portion 13 can be discharged through the vent hole 8, and the vented state is maintained. However, after the solder 12a is cured, that is, after the package 2 is mounted on the substrate 10, the vent hole 8 is blocked by the solder 12a. Thereby, the hollow part 13 will be in an airtight sealing state. In other words, in the semiconductor device 50, the hollow portion 13 has a ventilation function in the manufacturing process, and the hollow portion 13 has an airtight sealing structure after the manufacturing is completed.

下記に本実施形態の効果について、図2〜4、および図12に基づき具体的に説明する。図12の(a)は従来の半導体装置200の構成を表す断面図であり、図12の(b)は図12の(a)の方向Dから平面図である。半導体装置200の構成については、背景技術において記載した通りである。   The effect of this embodiment will be specifically described below with reference to FIGS. 12A is a cross-sectional view showing a configuration of a conventional semiconductor device 200, and FIG. 12B is a plan view from a direction D in FIG. The configuration of the semiconductor device 200 is as described in the background art.

半導体装置200で示されるような構造では、半導体装置200が基板210に実装されるまでの製造過程において、接着材204に対して、中空部213の内部圧力増加により、パッケージ202から覆部203が引きはがされる方向に力が加わり、覆部203の剥がれ、またはズレが生じてしまい、気密状態が損なわれるなどの問題があった。   In the structure shown by the semiconductor device 200, the cover 203 extends from the package 202 to the adhesive 204 due to an increase in internal pressure of the hollow portion 213 in the manufacturing process until the semiconductor device 200 is mounted on the substrate 210. A force is applied in the direction of peeling, and the cover 203 is peeled off or displaced, resulting in a problem that the airtight state is impaired.

具体的には、接着材204において、次の(1)〜(3)に記載する力が、接着材204から覆部203を引き剥がす方向に加わることが原因となり、覆部203の剥がれ、またはズレが生じる。(1)パッケージ202へ覆部203を貼り付ける際に覆部203が中空部213側に押し込まれ、中空部213の体積が圧縮されることにより増加した中空部213の内部圧力が覆部203を外側へ押し出す力。(2)覆部203を接着材204により接着した後、接着材204をオーブン等で熱硬化させる過程で、熱硬化の熱により中空部213内の気体が熱膨張し、覆部203を外側へ押し出す力。(3)気密封止されたパッケージ202を基板210へ、例えばリフローにより実装する際、リフローによる高温状態において中空部213内の気体が熱膨張し、覆部203を外側へ押し出す力。   Specifically, in the adhesive 204, the force described in the following (1) to (3) is applied in the direction of peeling the cover 203 from the adhesive 204, and the cover 203 is peeled off, or Deviation occurs. (1) When the cover part 203 is attached to the package 202, the cover part 203 is pushed into the hollow part 213 side, and the internal pressure of the hollow part 213 increased by compressing the volume of the hollow part 213 causes the cover part 203 to be pressed. Force to push outward. (2) After bonding the cover 203 with the adhesive 204, in the process of thermally curing the adhesive 204 in an oven or the like, the gas in the hollow portion 213 is thermally expanded by the heat of thermosetting, and the cover 203 is moved outward. Force to push. (3) When the hermetically sealed package 202 is mounted on the substrate 210 by, for example, reflow, a force in which the gas in the hollow portion 213 is thermally expanded in a high temperature state due to reflow and pushes the cover 203 outward.

また(2)および(3)に記載されている中空部213内の気体の熱膨張量は、中空部213に存在する水分量が多いほどより顕著になる。中空部213の水分は、基板210へ実装する前の湿度環境下にさられる時間が長いほど接着材204を介して浸入する量が多くなる。さらに、一度中空部213に入り込んだ水分はオーブン等で加熱しても安易に排出され難い特性がある。このため、パッケージ202を基板210へ実装するまでの時間が制限されてしまうという問題があり、制限された時間内に実装することができなかった場合には撮像装置を廃棄しなければならない場合もある。したがって従来の半導体装置200で示されるような構造では、中空部213が気密封止状態となる半導体装置200を実現するための製造条件の設定が難しい。   Further, the thermal expansion amount of the gas in the hollow portion 213 described in (2) and (3) becomes more remarkable as the amount of moisture present in the hollow portion 213 increases. The amount of moisture in the hollow portion 213 penetrates through the adhesive 204 increases as the time for which the moisture is placed in the humidity environment before mounting on the substrate 210 is longer. Furthermore, once the moisture has entered the hollow portion 213, it has a characteristic that it is not easily discharged even when heated in an oven or the like. For this reason, there is a problem that the time until the package 202 is mounted on the substrate 210 is limited, and if the mounting cannot be performed within the limited time, the imaging apparatus may have to be discarded. is there. Therefore, in the structure as shown by the conventional semiconductor device 200, it is difficult to set the manufacturing conditions for realizing the semiconductor device 200 in which the hollow portion 213 is hermetically sealed.

図2の(a)・(b)は半導体装置50の効果を説明する断面図である。より詳しくは、図2の(a)は、固体撮像素子1をパッケージ2に固定材6にて固定し、次に固体撮像素子1の接続端子(図示なし)とパッケージ2内部のワイヤ接続端子18(図5の(a)参照)とをワイヤ5にて接続し、次に接着材4をパッケージ2の上端部2eへ塗布した状態において、覆部3が接着材4に接触する瞬間の図であり、図2の(b)は、覆部3が中空部13側に押し込まれた後の状態を示す。   2A and 2B are cross-sectional views for explaining the effects of the semiconductor device 50. FIG. More specifically, in FIG. 2A, the solid-state imaging device 1 is fixed to the package 2 with a fixing material 6, and then a connection terminal (not shown) of the solid-state imaging device 1 and a wire connection terminal 18 inside the package 2. (Refer to (a) of FIG. 5) is connected to the upper end 2e of the package 2 with the wire 5 and is then applied to the upper end 2e of the package 2. FIG. 2B shows a state after the cover 3 is pushed into the hollow portion 13 side.

覆部3とパッケージ2とを貼り付けるために、覆部3は、図2の(a)で示す接着材4に接触した直後の状態から、図2の(b)の状態まで覆部3を中空部13側に押し込む必要がある。この覆部3を中空部13側に押し込んだ、覆部押し込み量Tによって中空部13内の気体の体積は圧縮される。しかし、パッケージ2は通気孔8を有しているため、図2の(b)の破線矢印に示すように、圧縮されて増加した中空部13の内部圧力を、通気孔8より容易に降下させることが可能である。このため、接着材4には、中空部13の内部圧力増加による力、すなわち、パッケージ2から覆部3が引きはがされる方向への力、が加わらない。その結果、上述したパッケージ2へ覆部3を貼り付ける際の、覆部3の剥がれ、またはズレが発生する問題を回避することができる。   In order to affix the cover 3 and the package 2, the cover 3 covers the cover 3 from the state immediately after contacting the adhesive 4 shown in FIG. 2A to the state shown in FIG. 2B. It is necessary to push into the hollow portion 13 side. The volume of the gas in the hollow portion 13 is compressed by the amount T of pushing the cover portion 3 toward the hollow portion 13 side. However, since the package 2 has the vent hole 8, the internal pressure of the hollow portion 13 that has been compressed and increased can be easily lowered from the vent hole 8, as indicated by the dashed arrow in FIG. It is possible. For this reason, the adhesive 4 is not applied with a force due to an increase in the internal pressure of the hollow portion 13, that is, a force in a direction in which the cover 3 is peeled off from the package 2. As a result, it is possible to avoid the problem that the cover 3 is peeled off or displaced when the cover 3 is attached to the package 2 described above.

図3は半導体装置50の他の効果を説明する断面図である。より詳しくは、図3は、覆部3を貼り付けた状態で接着材4を熱硬化させるために、例えばオーブン等の接着材硬化装置30に、パッケージ2を入れた状態の示す図である。接着材硬化装置30の熱により、中空部13内の気体が熱膨張する。しかし、パッケージ2には通気孔8があるため、図3の破線矢印に示すように、熱膨張して増加した中空部13の内部圧力を、通気孔8より容易に降下させることが可能である。このため、接着材4には、中空部13の内部圧力増加による力が加わらない。その結果、上述した接着材4をオーブン等で熱硬化させる際の、覆部3の剥がれ、またはズレが発生する問題を回避することができる。   FIG. 3 is a cross-sectional view for explaining another effect of the semiconductor device 50. More specifically, FIG. 3 is a diagram showing a state in which the package 2 is put in an adhesive curing device 30 such as an oven in order to thermally cure the adhesive 4 with the cover 3 attached. The gas in the hollow portion 13 is thermally expanded by the heat of the adhesive curing device 30. However, since the package 2 has the vent hole 8, the internal pressure of the hollow portion 13 increased by thermal expansion can be easily lowered from the vent hole 8, as indicated by the broken arrow in FIG. 3. . For this reason, a force due to an increase in the internal pressure of the hollow portion 13 is not applied to the adhesive 4. As a result, it is possible to avoid the problem that the cover 3 is peeled off or displaced when the adhesive 4 described above is thermally cured in an oven or the like.

図4の(a)〜図4の(c)は半導体装置50のさらに他の効果を説明する断面図である。より詳しくは、図4の(a)は、接着材4の熱硬化が完了したパッケージ2を、例えばリフロー実装装置等の実装装置31に入れた状態において、実装処理中の半導体装置50の状態を示す図であり、図4の(b)は、図4の(a)の破線円部を拡大して、半田12aが溶解状態にある場合を示し、図4の(c)は、図4の(a)の破線円部を拡大して、半田12aが硬化した状態を示す。   4A to 4C are cross-sectional views for explaining still another effect of the semiconductor device 50. FIG. More specifically, FIG. 4A shows the state of the semiconductor device 50 during the mounting process in a state where the package 2 in which the adhesive 4 has been thermally cured is placed in a mounting device 31 such as a reflow mounting device. 4 (b) is an enlarged view of the broken-line circle in FIG. 4 (a), and shows a case where the solder 12a is in a dissolved state. FIG. 4 (c) is a diagram of FIG. The broken-line circle part in (a) is enlarged to show a state where the solder 12a is cured.

パッケージ2を基板10に実装する際、パッケージ2および基板10は通気孔付接続端子9と基板側接続端子11aとの間に半田12aが配置された状態で、実装装置31により加熱される。パッケージ2および基板10が実装装置31により加熱された際、その熱により中空部13内の気体が熱膨張する。しかし、パッケージ2には通気孔8があり、さらに半田12aは加熱により溶融状態にある。このため、熱膨張した中空部13内の気体は、図4の(b)の矢印P1に示すように、通気孔8から溶融した半田12aの内部を突き抜け外部に排出される。その結果、熱膨張して増加した中空部13の内部圧力により加わる接着材4への力は極めて低くなるので、上述したパッケージ2を基板10に実装させる際の、覆部3の剥がれ、またはズレが発生する問題を回避することができる。   When the package 2 is mounted on the substrate 10, the package 2 and the substrate 10 are heated by the mounting device 31 in a state where the solder 12 a is disposed between the connection terminal 9 with vent hole and the substrate-side connection terminal 11 a. When the package 2 and the substrate 10 are heated by the mounting device 31, the gas in the hollow portion 13 is thermally expanded by the heat. However, the package 2 has a vent hole 8 and the solder 12a is in a molten state by heating. For this reason, the gas in the thermally expanded hollow portion 13 penetrates the melted solder 12a through the vent hole 8 and is discharged to the outside as indicated by an arrow P1 in FIG. As a result, the force applied to the adhesive 4 due to the internal pressure of the hollow portion 13 increased due to thermal expansion becomes extremely low. Therefore, the cover 3 is peeled off or displaced when the package 2 is mounted on the substrate 10. The problem that occurs can be avoided.

また、実装装置31の加熱終了後は、半田12aは硬化され、図4の(c)に示すように、通気孔8の開口部8aは半田12aにより閉塞された状態になる。これにより、中空部13が気密封止状態となる半導体装置50が完成する。   Further, after the heating of the mounting apparatus 31 is finished, the solder 12a is cured, and the opening 8a of the vent hole 8 is closed by the solder 12a as shown in FIG. Thereby, the semiconductor device 50 in which the hollow portion 13 is hermetically sealed is completed.

本実施形態に係る半導体装置50は、パッケージ2が基板10に実装される直前まで、中空部13が通気性を有する。そのため、接着材4をオーブン等で熱硬化させる過程とは別に、実装直前に再度加熱処理するパッケージベーキング処理においても、中空部13の水分、接着材4の吸湿水分、および固定材6の吸湿水分を、容易に外部に排出することができる。これにより、接着材4をオーブン等で熱硬化させた後、パッケージ2を基板10へ実装するまでに、接着材4および固定材6が吸湿しても、容易に水分を排出することができる。その結果、上述したパッケージ2を基板10へ実装するまでの時間が制限されてしまう問題も回避することができる。   In the semiconductor device 50 according to the present embodiment, the hollow portion 13 has air permeability until just before the package 2 is mounted on the substrate 10. Therefore, apart from the process of thermosetting the adhesive 4 in an oven or the like, the moisture in the hollow portion 13, the moisture absorption moisture in the adhesive 4, and the moisture absorption moisture in the fixing material 6 also in the package baking process in which the heat treatment is performed again immediately before mounting. Can be easily discharged to the outside. Thus, after the adhesive 4 is thermally cured in an oven or the like, the moisture can be easily discharged even if the adhesive 4 and the fixing material 6 absorb moisture before the package 2 is mounted on the substrate 10. As a result, it is possible to avoid the problem that the time until the package 2 is mounted on the substrate 10 is limited.

以上説明した通り、本実施形態では、特別な設備を要さずに、接着材4に、中空部13の内部圧力増加による力を加えることなく、気密封止状態が保たれた半導体装置50を製造することができる。そのため、気密封止状態が保たれた製品信頼性の高い半導体装置50を容易かつ安価に製造するこができる。   As described above, in the present embodiment, the semiconductor device 50 in which the hermetically sealed state is maintained without applying special equipment and applying a force due to the increase in the internal pressure of the hollow portion 13 to the adhesive 4 is provided. Can be manufactured. Therefore, it is possible to easily and inexpensively manufacture the semiconductor device 50 with high product reliability in which the hermetically sealed state is maintained.

言い換えると、本実施形態に係る半導体装置50は、製造過程おいて接着材4に中空部13の膨張圧ストレスが無い状態で製造可能であるため、覆部3の接着信頼性が高くなる。そのため、信頼性の要求が高い半導体装置50を容易かつ安価に製造し、提供することが可能となる。   In other words, since the semiconductor device 50 according to the present embodiment can be manufactured without the expansion pressure stress of the hollow portion 13 in the adhesive material 4 in the manufacturing process, the bonding reliability of the cover portion 3 is increased. Therefore, it is possible to easily and inexpensively manufacture and provide the semiconductor device 50 with high reliability requirements.

〔通気孔付接続端子の形成方法〕
上述したように、パッケージ2において、セラミックパッケージ20(図5参照)、およびプリント基板パッケージ21(図7参照)のどちらを採用するかにより、通気孔付接続端子9の製造方法が異なる。詳しくは図5〜図8に基づき以下に説明する。
[Method of forming connection terminals with vents]
As described above, in the package 2, the manufacturing method of the connection terminal 9 with the vent hole differs depending on whether the ceramic package 20 (see FIG. 5) or the printed circuit board package 21 (see FIG. 7) is adopted. Details will be described below with reference to FIGS.

〔セラミックパッケージの場合〕
まず、パッケージ2がセラミックパッケージ20である場合の通気孔付接続端子9の形成方法について以下に説明する。
[Ceramic package]
First, a method for forming the vented connection terminal 9 when the package 2 is the ceramic package 20 will be described below.

図5の(a)〜図5の(f)は半導体装置50のおけるパッケージ2の製造方法を説明する模式図である。詳しくは、図5の(a)・(b)・(c)は、セラミックパッケージ20の製造方法を説明する断面図であり、図5の(d)・(e)・(f)は、図5の(a)・(b)・(c)における、通気孔付接続端子9の平面図である。   FIG. 5A to FIG. 5F are schematic views illustrating a method for manufacturing the package 2 in the semiconductor device 50. Specifically, FIGS. 5A, 5B, and 5C are cross-sectional views illustrating a method of manufacturing the ceramic package 20, and FIGS. 5D, 5E, and 5F are diagrams. It is a top view of the connection terminal 9 with a vent in 5 (a), (b), (c).

セラミックパッケージ20は、各層分かれており、まず、図5の(a)に示すように、それぞれの層に必要な処理を行う。   The ceramic package 20 is divided into layers. First, as shown in FIG. 5A, necessary processing is performed on each layer.

パッケージ層20aは、セラミックパッケージ20の側壁の役割の層である。パッケージ層20bは、固体撮像素子1とワイヤ5により接続されるワイヤ接続端子18を有した層である。パッケージ層20cは、ワイヤ接続端子18からの電気信号を外部の任意の位置へ送受するための配線レイアウトを行う層である。   The package layer 20 a is a layer serving as a side wall of the ceramic package 20. The package layer 20 b is a layer having wire connection terminals 18 connected to the solid-state imaging device 1 by wires 5. The package layer 20c is a layer that performs wiring layout for transmitting and receiving an electrical signal from the wire connection terminal 18 to an arbitrary external position.

パッケージ層20dは、基板10との接続端子であるパッケージ側接続端子7を配置する層であり、このパッケージ層20dを形成する段階で、通気孔付接続端子9を成す接続端子パターン20eをパッケージ側接続端子7と同一平面上に配置する。また、この接続端子パターン20eには、後の工程で形成する通気孔8のための開口部91を設ける。   The package layer 20d is a layer on which the package-side connection terminals 7 that are connection terminals to the substrate 10 are arranged. At the stage of forming the package layer 20d, the connection terminal pattern 20e that forms the connection terminals 9 with vent holes is arranged on the package side. It is arranged on the same plane as the connection terminal 7. Further, the connection terminal pattern 20e is provided with an opening 91 for the vent hole 8 to be formed in a later step.

図5の(a)の段階で通気孔8も形成することは可能であるが、次の図5の(c)に示すように、パッケージ層20a〜パッケージ層20dを貼り合わせた際の貼り合わせのズレにより通気孔8が塞がる可能性があるので、図5の(a)の段階では通気孔8は形成しない方がよい。   Although it is possible to form the air holes 8 at the stage of FIG. 5A, bonding is performed when the package layers 20a to 20d are bonded as shown in FIG. 5C. Since there is a possibility that the vent hole 8 is blocked by the deviation, it is better not to form the vent hole 8 at the stage of FIG.

次に、図5の(b)に示すように、各層を貼り合わせる。その後、図5の(c)に示すように、開口部91内においてセラミックパッケージ20を貫通するように通気孔8を設ける。また、図5の(a)〜図5の(c)の工程ではセラミックパッケージ20の材料はまだ焼成工程前の段階であり、柔らかい状態なので容易に形状加工が可能となる。   Next, as shown in FIG. 5B, the layers are bonded together. Thereafter, as shown in FIG. 5C, the vent hole 8 is provided so as to penetrate the ceramic package 20 in the opening 91. Further, in the processes of FIGS. 5A to 5C, the material of the ceramic package 20 is still in the stage before the firing process, and since it is in a soft state, the shape processing can be easily performed.

〔通気孔付接続端子の設計例〕
図6の(a)はセラミックパッケージ20における通気孔付接続端子9の例を示す平面図であり、図6の(b)は通気孔付接続端子9の他の例を示す平面図である。
[Design example of connection terminal with vent hole]
6A is a plan view showing an example of the connection terminal 9 with a vent hole in the ceramic package 20, and FIG. 6B is a plan view showing another example of the connection terminal 9 with a vent hole.

図6の(a)に示すように、通気孔付接続端子9の外径は四角形を有する。また、通気孔8の直径を0.1mm程度とし、通気孔8を形成する際の位置ズレを考慮して通気孔8の外周から開口部91までの距離を0.1mm程度確保しているが、上記に限らない。通気孔8の外周から開口部91までの距離は、接続端子パターン20e、開口部91、および通気孔8を形成する装置の加工精度によって適宜設計すればよい。接続端子パターン20eの外形は0.6mm程度あれば、本実施形態の通気孔付接続端子9の機能が得られる。   As shown to (a) of FIG. 6, the outer diameter of the connecting terminal 9 with a vent hole has a square shape. In addition, the diameter of the vent hole 8 is set to about 0.1 mm, and the distance from the outer periphery of the vent hole 8 to the opening 91 is secured about 0.1 mm in consideration of the positional deviation when the vent hole 8 is formed. Not limited to the above. What is necessary is just to design the distance from the outer periphery of the vent hole 8 to the opening part 91 suitably according to the processing accuracy of the apparatus which forms the connection terminal pattern 20e, the opening part 91, and the vent hole 8. FIG. If the external shape of the connection terminal pattern 20e is about 0.6 mm, the function of the connection terminal 9 with a vent of this embodiment can be obtained.

また、通気孔付接続端子9の変形例として、図6の(b)に示すように、円形状の接続端子パターン20eを用いて、通気孔付接続端子9としてもよい。通気孔付接続端子9が円形状の場合は、BGA(Ball Grid Array)パッケージ(図9の(c)参照)の端子の1つとして使用しやすくなる。   As a modification of the connection terminal 9 with vent hole, as shown in FIG. 6B, a connection terminal 9 with vent hole may be used by using a circular connection terminal pattern 20e. When the connection terminal 9 with a vent hole is circular, it can be easily used as one of terminals of a BGA (Ball Grid Array) package (see FIG. 9C).

〔プリント基板パッケージの場合〕
次に、パッケージ2がプリント基板パッケージ21である場合の通気孔付接続端子9aの形成方法について以下に説明する。なお、通気孔付接続端子9aは、通気孔付接続端子9と同じ機能を有する。
[For printed circuit board package]
Next, a method for forming the vented connection terminal 9a when the package 2 is the printed circuit board package 21 will be described below. In addition, the connection terminal 9a with a vent has the same function as the connection terminal 9 with a vent.

図7の(a)〜図7の(d)は半導体装置50におけるパッケージ2の他の製造方法を説明する模式図である。詳しくは、図7の(a)は、プリント基板パッケージ21の製造方法を説明する断面図であり、図7の(c)は、図7の(a)の破線円部を拡大して示す断面図である。図7の(b)・(d)は、図7の(a)・(c)における、通気孔付接続端子9aの平面図である。   FIG. 7A to FIG. 7D are schematic views for explaining another method for manufacturing the package 2 in the semiconductor device 50. Specifically, FIG. 7A is a cross-sectional view illustrating a method of manufacturing the printed circuit board package 21, and FIG. 7C is a cross-sectional view showing an enlarged broken-line circle in FIG. 7A. FIG. 7B and 7D are plan views of the vented connection terminal 9a in FIGS. 7A and 7C.

プリント基板パッケージ21は、プリント基板基材21aにパッケージ外壁材21bが貼付けられたものである。また、プリント基板基材21aの表面(パッケージ外壁材21bが貼付けられている面)にはワイヤ接続端子18aが配置されており、プリント基板基材21aの裏面(基板10に対向する面)にはパッケージ側接続端子7aが配置されている。ワイヤ接続端子18aおよびパッケージ側接続端子7aは、ワイヤ接続端子18およびパッケージ側接続端子7と同じ機能を有する。ワイヤ接続端子18aとパッケージ側接続端子7aとは、プリント基板基材21a上の配線パターンと、プリント基板基材21aの表面と裏面を繋ぐスルーホール21fを介して電気的に接続されている。   The printed circuit board package 21 is obtained by attaching a package outer wall material 21b to a printed circuit board base 21a. In addition, wire connection terminals 18a are arranged on the surface of the printed circuit board substrate 21a (the surface on which the package outer wall material 21b is attached), and on the back surface (the surface facing the substrate 10) of the printed circuit board substrate 21a. Package side connection terminals 7a are arranged. The wire connection terminal 18 a and the package side connection terminal 7 a have the same functions as the wire connection terminal 18 and the package side connection terminal 7. The wire connection terminal 18a and the package side connection terminal 7a are electrically connected to each other through a wiring pattern on the printed circuit board substrate 21a and a through hole 21f that connects the front surface and the back surface of the printed circuit board substrate 21a.

プリント基板基材21aの表面と裏面を繋ぐスルーホール21fの工法は一般的工法である。プリント基板基材21aの表面および裏面は、ソルダレジスト21dにより配線パターンが保護されている。電気的接続端子であるワイヤ接続端子18aおよびパッケージ側接続端子7aが配置されている部分はソルダレジスト21dが開口されており、プリント基板パッケージ21以外との電気的接続が可能となっている。   The construction method of the through hole 21f that connects the front surface and the back surface of the printed circuit board base 21a is a general construction method. The wiring pattern is protected by the solder resist 21d on the front surface and the back surface of the printed circuit board base 21a. A solder resist 21d is opened in a portion where the wire connection terminal 18a and the package side connection terminal 7a, which are electrical connection terminals, are arranged, and electrical connection with other than the printed circuit board package 21 is possible.

一般的に、スルーホール部は、スルーホール21fのようにソルダレジスト21dにより覆われている場合が多い。しかし、プリント基板パッケージ21では、スルーホール21eで示すようなソルダレジスト21dにより覆われていないスルーホール部を利用し、通気孔8とする。   Generally, the through hole portion is often covered with a solder resist 21d like the through hole 21f. However, the printed circuit board package 21 uses the through hole portion not covered with the solder resist 21d as shown by the through hole 21e to form the vent hole 8.

詳しくは、まずスルーホール21eの真下に位置する部分へ半田接続可能な接続端子パターン21i(通気孔付接続端子9a)を形成する。このスルーホール21eは通気性を有するようにしなければならないため、ワイヤ接続端子18aやパッケージ側接続端子7aの部分と同様に、スルーホール21eの表面および裏面のソルダレジスト21dを開口させ、ソルダレジスト開口部21cおよびソルダレジスト開口部21gを形成する。   Specifically, first, a connection terminal pattern 21i (a connection terminal 9a with a vent hole) that can be solder-connected to a portion located directly below the through hole 21e is formed. Since the through hole 21e must be air permeable, the solder resist 21d on the front and back surfaces of the through hole 21e is opened in the same manner as the wire connection terminal 18a and the package side connection terminal 7a. The part 21c and the solder resist opening 21g are formed.

〔通気孔付接続端子の設計例〕
図8の(a)はプリント基板パッケージ21の通気孔付接続端子9aの例を示す平面図であり、図8の(b)は通気孔付接続端子9aの他の例を示す平面図である。
[Design example of connection terminal with vent hole]
FIG. 8A is a plan view showing an example of the connection terminal 9a with vent hole of the printed circuit board package 21, and FIG. 8B is a plan view showing another example of the connection terminal 9a with vent hole. .

図8の(a)に示すように、接続端子パターン21i(通気孔付接続端子9a)の外径は四角形を有する。また、スルーホール21e(通気孔8)の直径を0.1mm程度とし、接続端子パターン21i(通気孔付接続端子9a)の外形は0.6mm程度とし、ソルダレジスト開口部21g外径は0.8mm程度とすることにより、本実施形態の通気孔付接続端子9と同じ機能が得られる。また、通気孔付接続端子9aの変形例として、図8の(b)に示すように、円形状の接続端子パターン21iを用いて、通気孔付接続端子9aとしてもよい。   As shown to (a) of FIG. 8, the outer diameter of the connection terminal pattern 21i (connection terminal 9a with a vent hole) has a square shape. The diameter of the through hole 21e (vent hole 8) is about 0.1 mm, the outer shape of the connection terminal pattern 21i (connect terminal 9a with vent hole) is about 0.6 mm, and the outer diameter of the solder resist opening 21g is about 0.1 mm. By setting the thickness to about 8 mm, the same function as that of the connection terminal with vent hole 9 of the present embodiment can be obtained. Further, as a modified example of the connection terminal 9a with vent hole, as shown in FIG. 8B, a connection terminal 9a with vent hole may be used by using a circular connection terminal pattern 21i.

〔実施形態2〕
近年、固体撮像素子1を搭載したパッケージ2は小型化が進んでおり、実施形態1のように、パッケージ2の底面部2fの底面2aにおいて、固体撮像素子1の周辺に通気孔8を設けるためのスペースが無い場合がある。そこで、本実施形態では、底面部2fの底面2aにおいて固体撮像素子1と対向する位置に通気孔8を設けることで、パッケージ2の小型化を実現する。
[Embodiment 2]
In recent years, the package 2 on which the solid-state imaging device 1 is mounted has been miniaturized, and the vent hole 8 is provided around the solid-state imaging device 1 on the bottom surface 2a of the bottom surface portion 2f of the package 2 as in the first embodiment. There may be no space. Therefore, in the present embodiment, the package 2 is downsized by providing the vent hole 8 at a position facing the solid-state imaging device 1 on the bottom surface 2a of the bottom surface portion 2f.

本発明の実施形態2について、図9および図10を参照して説明する。図9の(a)は本実施形態に係る半導体装置50aの構成を表す断面図であり、図9の(b)・(c)は上記半導体装置50aを方向Bから見た平面図である。図9に示す半導体装置50aは、図1に示す半導体装置50に比べて、固定材6に代えて、固定材6aが設けられている点、および、通気孔8が底面部2fにおいて固体撮像素子1と対向する位置に形成されている点が異なり、その他の構成は同様である。   A second embodiment of the present invention will be described with reference to FIG. 9 and FIG. 9A is a cross-sectional view showing the configuration of the semiconductor device 50a according to this embodiment, and FIGS. 9B and 9C are plan views of the semiconductor device 50a viewed from the direction B. FIG. A semiconductor device 50a shown in FIG. 9 is different from the semiconductor device 50 shown in FIG. 1 in that a fixing material 6a is provided in place of the fixing material 6, and that the air hole 8 has a solid-state imaging device in the bottom surface portion 2f. 1 is different in that it is formed at a position opposite to 1, and the other configurations are the same.

〔半導体装置〕
本実施形態の半導体装置50aでは、通気孔8は、底面部2fにおいて固体撮像素子1に対向する位置に形成されている。言い換えると、通気孔8および通気孔付接続端子9が固体撮像素子1の真下、つまり、通気孔8および通気孔付接続端子9が固体撮像素子1と基板10とに挟まれる位置に形成されている。
[Semiconductor device]
In the semiconductor device 50a of the present embodiment, the vent hole 8 is formed at a position facing the solid-state imaging device 1 in the bottom surface portion 2f. In other words, the ventilation hole 8 and the connection terminal 9 with ventilation hole are formed directly below the solid-state imaging device 1, that is, at a position where the ventilation hole 8 and the connection terminal 9 with ventilation hole are sandwiched between the solid-state imaging device 1 and the substrate 10. Yes.

また、固定材6aは、通気孔8と中空部13とをつなぐ通気路16を備える。   In addition, the fixing member 6 a includes a ventilation path 16 that connects the ventilation hole 8 and the hollow portion 13.

〔通気路〕
通気路16について、図10に基づき下記に説明する。図10の(a)〜図10の(c)は半導体装置50aの通気路16を説明する平面図である。通気路16は、通気孔8と中空部13とをつなぐ。言い換えると、固定材6aが通気路16を備えることで、中空部13と外部とが、通気孔8および通気路16を介してつながり、通気性を有する。
[Ventilation path]
The ventilation path 16 will be described below with reference to FIG. FIG. 10A to FIG. 10C are plan views for explaining the air passage 16 of the semiconductor device 50a. The air passage 16 connects the air hole 8 and the hollow portion 13. In other words, since the fixing member 6a includes the air passage 16, the hollow portion 13 and the outside are connected via the air hole 8 and the air passage 16 and have air permeability.

より詳しくは、通気孔8に重ならないように、かつ、固定材6a同士が複数個所重ならないように、固定材6aを底面2aに配置する。つまり、通気路16が2箇所以上の場合、底面2aの固体撮像素子1が搭載される位置において全面一様に固定材6aを塗布するのではなく、固定材6aを塗布する位置を複数に箇所に分け、固定材6aがお互いに接触しないように塗布することで通気路16を形成する。すなわち、通気路16は、固定材6aの底面2aへの塗布方法により決定される。   More specifically, the fixing material 6a is arranged on the bottom surface 2a so as not to overlap the vent hole 8 and so that a plurality of the fixing materials 6a do not overlap each other. That is, when there are two or more air passages 16, the fixing material 6 a is not applied uniformly over the entire surface at the position where the solid-state imaging device 1 on the bottom surface 2 a is mounted, but a plurality of positions where the fixing material 6 a is applied. The air passage 16 is formed by coating the fixing material 6a so as not to contact each other. That is, the air passage 16 is determined by a method of applying to the bottom surface 2a of the fixing material 6a.

具体的には、例えば、図10の(a)に示すように、固定材6aを底面2aに均等に4箇所塗布し、固体撮像素子1を固定することで、隣接する固定材6a間において通気孔8と中空部13とを通気可能な通気路16が4箇所形成される。   Specifically, for example, as shown in FIG. 10 (a), the fixing material 6a is evenly applied to the bottom surface 2a at four locations, and the solid-state imaging device 1 is fixed, thereby allowing the fixing material 6a to pass between adjacent fixing materials 6a. Four ventilation paths 16 are formed through which the air holes 8 and the hollow portion 13 can be ventilated.

通気路16の形成箇所数は上記に限らず、少なくとも1箇所以上あればよく、図10の(b)に示すように、固定材6aを凹形状に塗布することで、通気路16を1箇所とすることができる。また、図10の(c)に示すように固定材6aを底面2aに無数に分散して塗布し、通気路16を形成してもよい。固定材6aを介して、固体撮像素子1の発熱を外部へ放熱させること等を目的とした場合は、最も接着面積の広い、図10の(b)で示す固定材6aの塗布方法が好ましく、発熱を考慮しなくともよい場合、使用材料の量が少なくなるので、図10の(c)で示す固定材6aの塗布方法が好ましい。使用する固体撮像素子1の性質の合わせ、固定材6aの塗布方法を決定すればよい。   The number of locations where the air passages 16 are formed is not limited to the above, and it is sufficient that there are at least one or more. As shown in FIG. 10B, the air passages 16 are provided at one location by applying the fixing material 6a in a concave shape. It can be. Further, as shown in FIG. 10C, the fixing material 6a may be dispersed and applied innumerably to the bottom surface 2a to form the air passage 16. For the purpose of dissipating the heat generated by the solid-state imaging device 1 to the outside via the fixing material 6a, the application method of the fixing material 6a shown in FIG. When it is not necessary to consider heat generation, the amount of material used is reduced, and therefore, the method of applying the fixing material 6a shown in FIG. What is necessary is just to determine the application | coating method of the matching of the property of the solid-state image sensor 1 to be used, and the fixing material 6a.

上述した実施形態2の半導体装置50aであれば、固体撮像素子1を収納するパッケージ2の底面部2fの任意の位置に自由に通気孔8を配置することができる。したがって、底面部2fの固体撮像素子1の周辺にスペースを設ける必要がなくなり、パッケージ2を小型化することができる。さらに、面2cにおける、通気孔付接続端子9の設置位置の自由度が増し、図9の(c)に示すような、BGAパッケージにも対応しやすくなる。   In the semiconductor device 50a of the second embodiment described above, the vent hole 8 can be freely arranged at an arbitrary position on the bottom surface portion 2f of the package 2 that houses the solid-state imaging element 1. Therefore, it is not necessary to provide a space around the solid-state imaging device 1 on the bottom surface portion 2f, and the package 2 can be reduced in size. Further, the degree of freedom of the installation position of the vented connection terminal 9 on the surface 2c increases, and it becomes easy to deal with a BGA package as shown in FIG. 9C.

また、本実施形態の固定材6aのように通気路16を構成する場合、装置等により、任意の形状に固定材6aをパッケージ2と固体撮像素子1との間に塗布することが可能であることから、ペースト状の固定材6aが有効である。固定材6aにおいて導電性タイプもしくは絶縁性タイプのどちらを採用するかは、固体撮像素子1の性能を考慮して選定すればよい。フィルム状の固定材も使用可能であるが、固体撮像素子1の底面全面が固定材6aとなり、通気路16を構成することができない可能性がある。   Further, when the ventilation path 16 is configured like the fixing material 6a of the present embodiment, the fixing material 6a can be applied between the package 2 and the solid-state imaging device 1 in an arbitrary shape by an apparatus or the like. For this reason, the paste-like fixing material 6a is effective. Whether the conductive material or the insulating type is adopted for the fixing material 6a may be selected in consideration of the performance of the solid-state imaging device 1. Although a film-like fixing material can also be used, there is a possibility that the entire bottom surface of the solid-state imaging device 1 becomes the fixing material 6a and the air passage 16 cannot be formed.

〔実施形態3〕
実施形態1および実施形態2に係る半導体装置50・50aにおいて、パッケージ2を基板10に実装する処理中において、通気孔8および溶融状態の半田12aを介して中空部13内の熱膨した気体を外部に排出する際、気体排出時に、半田12aも合わせて飛び出し、周囲に飛散してしまうことが考えられる。飛散した半田12a(以降、飛散半田12cと称する)が、電気的機能を有した接続端子(導通接続部17)と、隣接する他の電気的機能を有した接続端子(隣接する他の導通接続部17)との間に位置した場合、導通接続部17同士をショートさせてしまう可能性が考えられる。そこで、この本実施形態では、通気孔封止部14と導通接続部17との間に飛散防止部40をさらに備えることで、半田12aの飛散により生じる不具合を解消する。
[Embodiment 3]
In the semiconductor devices 50 and 50a according to the first and second embodiments, during the process of mounting the package 2 on the substrate 10, the thermally expanded gas in the hollow portion 13 is passed through the vent hole 8 and the molten solder 12a. When discharging to the outside, it is considered that when the gas is discharged, the solder 12a also jumps out and scatters around. The scattered solder 12a (hereinafter referred to as the scattered solder 12c) is connected to the connection terminal (conductive connection portion 17) having an electrical function and the connection terminal (adjacent other conductive connection adjacent) having another electrical function. In the case where it is located between the connection portions 17), there is a possibility that the conductive connection portions 17 are short-circuited. Therefore, in the present embodiment, the scattering prevention unit 40 is further provided between the vent hole sealing unit 14 and the conductive connection unit 17, thereby eliminating the problem caused by the scattering of the solder 12a.

本発明の実施形態3について、図11を参照して説明する。図11の(a)は実施形態3に係る半導体装置50bの構成を表す断面図であり、図11の(b)は図11の(a)の破線円部を拡大して示す断面図であり、図11の(c)は半導体装置50bにおけるパッケージ2を方向Cから見た平面図である。図11に示す半導体装置50bは、図9に示す半導体装置50aに比べて、飛散防止部40をさらに備える点が異なり、その他の構成は同様である。   Embodiment 3 of the present invention will be described with reference to FIG. FIG. 11A is a cross-sectional view illustrating a configuration of a semiconductor device 50b according to the third embodiment, and FIG. 11B is a cross-sectional view illustrating an enlarged broken-line circle in FIG. 11A. FIG. 11C is a plan view of the package 2 in the semiconductor device 50b as viewed from the direction C. FIG. The semiconductor device 50b shown in FIG. 11 is different from the semiconductor device 50a shown in FIG. 9 in that the semiconductor device 50b further includes a scattering prevention unit 40, and the other configurations are the same.

〔半導体装置の構成〕
本実施形態の半導体装置50bは、通気孔封止部14の周囲に飛散防止部40を備えている。言い換えると、半導体装置50bは、通気孔封止部14と導通接続部17との間に飛散防止部40を備えている。
[Configuration of semiconductor device]
The semiconductor device 50 b according to the present embodiment includes a scattering prevention unit 40 around the vent hole sealing unit 14. In other words, the semiconductor device 50 b includes the scattering prevention unit 40 between the vent hole sealing unit 14 and the conductive connection unit 17.

飛散防止部40は、パッケージ2を基板10に実装する処理中において、中空部13内の膨張した気体を排出する際に、飛散半田12cが導通接続部17に飛散してしまうことを防止する。飛散防止部40は、飛散防止パッケージ側接続部41、半田12b、および飛散防止基板側接続部42を有する。   The scattering prevention unit 40 prevents the scattering solder 12 c from scattering to the conductive connection portion 17 when discharging the expanded gas in the hollow portion 13 during the process of mounting the package 2 on the substrate 10. The scattering prevention unit 40 includes a scattering prevention package side connection part 41, solder 12 b, and a scattering prevention board side connection part 42.

飛散防止パッケージ側接続部41(第1飛散防止接続部)は、面2cにおいて通気孔付接続端子9の周囲に設けられている。言い換えると、飛散防止パッケージ側接続部41は、通気孔付接続端子9とパッケージ側接続端子7との間に設けられている。   The anti-scattering package side connection portion 41 (first anti-scattering connection portion) is provided around the connection terminal 9 with a vent hole on the surface 2c. In other words, the anti-scattering package side connection portion 41 is provided between the connection terminal 9 with vent hole and the package side connection terminal 7.

飛散防止基板側接続部42(第2飛散防止接続部)は、基板10の主面10aの飛散防止パッケージ側接続部41に対向する位置に設けられている。   The anti-scattering substrate side connection portion 42 (second anti-scattering connection portion) is provided at a position facing the anti-scattering package side connection portion 41 on the main surface 10a of the substrate 10.

パッケージ2を基板10に実装する処理において、飛散防止パッケージ側接続部41および飛散防止基板側接続部42は、パッケージ側接続端子7と基板側接続端子11とが半田12を介して接触させた状態となるのと同様に、飛散防止パッケージ側接続部41と飛散防止基板側接続部42とが半田12bを介して接触させた状態となる。その状態で、パッケージ2を基板10に実装する際、半田12bも半田12と同時に加熱される。これにより、飛散防止パッケージ側接続部41と飛散防止基板側接続部42とは、半田12bにより接続され、飛散防止部40が形成される。   In the process of mounting the package 2 on the substrate 10, the scattering prevention package side connection portion 41 and the scattering prevention substrate side connection portion 42 are in a state in which the package side connection terminal 7 and the substrate side connection terminal 11 are in contact via the solder 12. In the same manner as described above, the scattering prevention package side connection portion 41 and the scattering prevention substrate side connection portion 42 are brought into contact with each other via the solder 12b. In this state, when the package 2 is mounted on the substrate 10, the solder 12 b is also heated simultaneously with the solder 12. Thereby, the scattering prevention package side connection part 41 and the scattering prevention board side connection part 42 are connected by the solder 12b, and the scattering prevention part 40 is formed.

ここで、飛散防止パッケージ側接続部41は、例えば、パッケージ2の内部配線パターン(図示なし)とは電気的に接続されておらず、また、飛散防止基板側接続部42は、例えば、基板10の主面10a上のパターニングされた配線(図示なし)に接続されていない。そのため、飛散防止部40において、半田12bが飛散半田12cを吸着しても、半導体装置50bには不具合が生じない。したがって、飛散防止部40は、半導体装置50bに不具合を生じさせることなく、飛散半田12cが導通接続部17に飛散することを防止することができる。   Here, the scattering prevention package side connection part 41 is not electrically connected to, for example, an internal wiring pattern (not shown) of the package 2, and the scattering prevention board side connection part 42 is, for example, the board 10. It is not connected to the patterned wiring (not shown) on the main surface 10a. Therefore, even if the solder 12b attracts the scattered solder 12c in the scattering prevention unit 40, the semiconductor device 50b does not malfunction. Therefore, the scattering prevention unit 40 can prevent the scattering solder 12c from scattering to the conductive connection portion 17 without causing a problem in the semiconductor device 50b.

本実施形態に係る半導体装置50bによれば、飛散半田12cが発生しても、飛散防止部40の半田12bに飛散半田12cが付着し吸収されるので、飛散半田12cが異なる導通接続部17間に付着してショートさせてしまうような不具合を回避できる。   According to the semiconductor device 50b according to the present embodiment, even if the scattered solder 12c is generated, the scattered solder 12c adheres to and is absorbed by the solder 12b of the scattering prevention unit 40. It is possible to avoid problems such as short-circuiting due to adhesion.

また、飛散防止部40により通気孔封止部14の周囲を完全に囲んでしまうと、パッケージ2と基板10と飛散防止部40とで形成される空間が密閉されてしまい、上記空間内の気体が加熱により膨張した場合、半田12b自体が導通接続部17へ飛散してしまう可能性がある。そこで、飛散防止パッケージ側接続部41を面2cにおける通気孔付接続端子9とパッケージ側接続端子7との間に設ける際、一部を開口し、開口部41aを設ける。これにより、上記空間内の増加した気体が、開口部41aより排出されるため、半田12b自体が周囲に飛散することを回避する事ができる。   Moreover, if the periphery of the vent hole sealing part 14 is completely surrounded by the scattering prevention part 40, the space formed by the package 2, the substrate 10 and the scattering prevention part 40 is sealed, and the gas in the above space is sealed. When the solder expands due to heating, the solder 12b itself may be scattered to the conductive connection portion 17. Therefore, when the anti-scattering package side connection part 41 is provided between the connection terminal 9 with vent hole and the package side connection terminal 7 on the surface 2c, a part is opened to provide the opening part 41a. Thereby, since the increased gas in the space is discharged from the opening 41a, it is possible to avoid the solder 12b itself from being scattered around.

異なる導通接続部17間に飛散半田12cが付着した場合、製品(半導体装置50b)の動作不良の原因となる。半導体装置50bの製品出荷前に隣接する導通接続部17間に飛散半田12cが付着した場合、電気的動作試験実施前により不良品として上記製品の流出防止は可能である。   If the scattered solder 12c adheres between the different conductive connection portions 17, it causes a malfunction of the product (semiconductor device 50b). When the scattered solder 12c adheres between the adjacent conductive connection portions 17 before the product shipment of the semiconductor device 50b, it is possible to prevent the product from flowing out as a defective product before the electrical operation test is performed.

一方、飛散防止部40がない状態で、異なる導通接続部17間以外の部分(例えば、通気孔封止部14と導通接続部17との間)に飛散半田12cが付着し残留していた場合、出荷前の動作試験では問題無く動作する。しかし、その後、出荷された後に発生する外部衝撃や振動により飛散半田12cが移動し、異なる導通接続部17間に付着した場合、出荷後に動作不良となる(市場不良)可能性がある。   On the other hand, when the scattered solder 12c adheres and remains in a portion other than between the different conductive connection portions 17 (for example, between the vent hole sealing portion 14 and the conductive connection portion 17) without the scattering prevention portion 40. In the operation test before shipment, it works without problems. However, if the scattered solder 12c moves and adheres between different conductive connecting portions 17 due to an external impact or vibration generated after shipment, there is a possibility of malfunction (market failure) after shipment.

本実施形態は、飛散防止部40を設けることにより、製品出荷後においても飛散半田12cが異なる導通接続部17間へ移動することを防止することができるので、市場不良を防止することができる。   In the present embodiment, by providing the scattering prevention part 40, it is possible to prevent the scattering solder 12c from moving between different conductive connection parts 17 even after product shipment, and thus it is possible to prevent a market failure.

〔まとめ〕
本発明の態様1に係る半導体装置50・50a・50bは、基板10と、上記基板10の主面10a上に半田12により実装される凹形状のパッケージ2と、上記パッケージ2の開口部2bを封止して中空部13を形成している覆部3と、上記パッケージ2の底面部2fに形成され、上記中空部13と外部とを連通する貫通部(通気孔8)と、上記基板10の主面10aと対向する上記パッケージ2の面2cにおいて上記貫通部(通気孔8)の開口部8aの周囲に設けられている第1電極(通気孔付接続端子9)と、上記基板10の主面10aにおいて上記第1電極に対向する位置に設けられている第2電極(基板側接続端子11a)と、を備え、上記貫通部(通気孔8)の開口部8aは、上記第1電極と上記第2電極とを接続する半田12aにより塞がれている。
[Summary]
A semiconductor device 50, 50 a, 50 b according to aspect 1 of the present invention includes a substrate 10, a concave package 2 that is mounted on the main surface 10 a of the substrate 10 with solder 12, and an opening 2 b of the package 2. The cover 3 that is sealed to form the hollow portion 13, the through-portion (vent hole 8) that is formed on the bottom surface portion 2 f of the package 2 and communicates the hollow portion 13 with the outside, and the substrate 10. A first electrode (a connecting terminal 9 with a vent hole) provided around the opening 8a of the through-hole (the vent hole 8) on the surface 2c of the package 2 facing the main surface 10a; A second electrode (substrate-side connection terminal 11a) provided at a position facing the first electrode on the main surface 10a, and the opening 8a of the penetrating portion (ventilation hole 8) has the first electrode And solder 12 for connecting the second electrode to the second electrode It has been closed by.

上記の構成によれば、パッケージは凹形状であり、覆部はパッケージの開口部を封止し、パッケージと覆部とにより中空部が形成されている。また、パッケージの底面部には中空部と外部とを連通する貫通部が備えられている。これにより、実装処理以外の製造過程において、中空部の膨張した気体を容易に外部へ排出することができる。その結果、実装処理以外の製造過程で発生する中空部の内部圧力の増加による覆部の剥がれ、またはズレを防ぐことができる。   According to said structure, a package is concave shape, a cover part seals the opening part of a package, and the hollow part is formed of the package and the cover part. In addition, a bottom portion of the package is provided with a through portion that communicates the hollow portion with the outside. Thereby, in the manufacturing process other than the mounting process, the expanded gas in the hollow portion can be easily discharged to the outside. As a result, it is possible to prevent peeling or displacement of the cover due to an increase in the internal pressure of the hollow portion that occurs in the manufacturing process other than the mounting process.

また、基板の主面と対向するパッケージの面における貫通部の開口部の周囲には、第1電極が設けられている。基板の主面における第1電極と対向する位置には、第2電極が設けられている。さらに、貫通部の開口部は、第1電極および第2電極を接続する半田により塞がれている。第1電極および第2電極を接続する半田は、第1電極と第2電極とを接続する処理中、すなわち、パッケージを基板に実装する処理中には溶解状態であるため、処理中の加熱により膨張した中空部の気体を溶解状態の半田を介して貫通部より容易に外部に排出しながら、第1電極と第2電極とを接続することができる。そのため、パッケージを基板に実装する処理中であっても、発生する中空部の内部圧力の増加による覆部の剥がれ、ズレを防ぐことができる。   A first electrode is provided around the opening of the penetrating portion on the surface of the package facing the main surface of the substrate. A second electrode is provided at a position facing the first electrode on the main surface of the substrate. Further, the opening of the penetrating portion is closed with solder connecting the first electrode and the second electrode. The solder connecting the first electrode and the second electrode is in a dissolved state during the process of connecting the first electrode and the second electrode, that is, during the process of mounting the package on the substrate. The first electrode and the second electrode can be connected while the expanded hollow portion gas is easily discharged from the through portion through the solder in a dissolved state. Therefore, even during the process of mounting the package on the substrate, it is possible to prevent the cover portion from being peeled off and displaced due to the increase in the internal pressure of the generated hollow portion.

また、接続完了後には、貫通部の開口部は硬化した上記半田により自動的に塞がれるため、中空部の気密性が保たれた半導体装置を製造することができる。   Further, after the connection is completed, the opening of the penetrating portion is automatically closed by the hardened solder, so that a semiconductor device in which the airtightness of the hollow portion is maintained can be manufactured.

さらに、高温・乾燥状態において、中空部内の膨張した気体の排出および貫通部の開口部を塞ぐことができるため、中空部は極めて湿度の低い状態での気密封止状態を実現できる。その結果、容易に気密封止状態が保たれた製品信頼性の高い半導体装置を製造することができる。   Further, in the high temperature / dry state, the expanded gas can be discharged from the hollow portion and the opening of the penetrating portion can be closed, so that the hollow portion can realize a hermetically sealed state with extremely low humidity. As a result, a semiconductor device with high product reliability in which the hermetic sealing state is easily maintained can be manufactured.

本発明の態様2に係る半導体装置50aは、上記態様1において、上記貫通部(通気孔8)と対向する固体撮像素子1と、上記固体撮像素子1を上記底面部2fの上記中空部13側に固定させる固定材6aと、をさらに備え、上記固定材6aは、上記貫通部(通気孔8)と上記中空部13とをつなぐ通気路16を有していてもよい。   The semiconductor device 50a according to aspect 2 of the present invention is the same as the aspect 1, wherein the solid-state imaging device 1 that faces the penetrating portion (ventilation hole 8) and the solid-state imaging device 1 on the hollow portion 13 side of the bottom surface portion 2f are provided. A fixing member 6a to be fixed to the fixing member 6a, and the fixing member 6a may have a ventilation path 16 that connects the through portion (vent hole 8) and the hollow portion 13.

上記構成によれば、貫通部と中空部とをつなぐ通気路を有する固定材により固体撮像素子がパッケージの底面部の中空部側に固定されている。そのため、パッケージにおいて固体撮像素子周辺に貫通部を設けるスペースがない場合であっても、底面部において固体撮像素子に対向する位置に貫通部を設け、中空部と外部とを貫通部および通気路により連通することができる。その結果、省スペースを実現できる。   According to the said structure, the solid-state image sensor is being fixed to the hollow part side of the bottom face part of a package with the fixing material which has a ventilation path which connects a penetration part and a hollow part. For this reason, even if there is no space for providing a penetrating part around the solid-state image sensor in the package, a penetrating part is provided at a position facing the solid-state image sensor on the bottom surface part, and the hollow part and the outside are connected by the penetrating part and the air passage. You can communicate. As a result, space saving can be realized.

本発明の態様3に係る半導体装置50bは、上記態様1または2において、上記基板10と上記パッケージ2とを電気的に接続する接続部(導通接続部17)と、上記パッケージ2の上記基板10に対向する面2cにおいて上記第1電極(通気孔付接続端子9)と上記接続部(導通接続部17)との間に設けられる第1飛散防止接続部(飛散防止パッケージ側接続部41)と、上記基板10の主面10aにおいて上記第1飛散防止接続部(飛散防止パッケージ側接続部41)に対向する位置に設けられる第2飛散防止接続部(飛散防止基板側接続部42)と、をさらに備え、上記第1飛散防止接続部(飛散防止パッケージ側接続部41)と上記第2飛散防止接続部(飛散防止基板側接続部42)とは半田12bにより接続されていてもよい。   The semiconductor device 50b according to aspect 3 of the present invention is the semiconductor device 50b according to aspect 1 or 2, in which the connection part (conductive connection part 17) for electrically connecting the substrate 10 and the package 2 and the substrate 10 of the package 2 are provided. A first scattering prevention connecting portion (scattering prevention package side connecting portion 41) provided between the first electrode (connecting terminal with vent hole 9) and the connecting portion (conduction connecting portion 17) on the surface 2c facing A second anti-scattering connection portion (anti-scattering substrate side connection portion 42) provided at a position facing the first anti-scattering connection portion (anti-scattering package side connection portion 41) on the main surface 10a of the substrate 10. In addition, the first scattering prevention connection part (scattering prevention package side connection part 41) and the second scattering prevention connection part (scattering prevention board side connection part 42) may be connected by solder 12b.

上記構成によれば、半導体装置は基板とパッケージとを電気的に接続する接続部をさらに備え、パッケージの基板の主面に対向する面において第1電極と接続部との間に設けられる第1飛散防止接続部、および基板の主面において第1飛散防止接続部に対向する位置に設けられる第2飛散防止接続部は、半田により接続されている。そのため、第1電極と第2電極とが半田により接続されている箇所と接続部との間に、第1飛散防止接続部と第2飛散防止接続部とが半田により接続されている箇所(以降、飛散防止部と称する)が配置されている。これにより、実装処理中に膨張した中空部内の気体を溶解状態の半田を介して貫通部より排出する際に飛散する半田が発生しても、飛散した半田は飛散防止部により飛散防止部外部への飛散が防止される。その結果、飛散した半田が接続部に付着してショートさせてしまう等の不具合を回避することができる。   According to the above configuration, the semiconductor device further includes a connection portion that electrically connects the substrate and the package, and the first surface provided between the first electrode and the connection portion on the surface of the package that faces the main surface of the substrate. The anti-scattering connection portion and the second anti-scattering connection portion provided at a position facing the first anti-scattering connection portion on the main surface of the substrate are connected by solder. Therefore, the location where the first scattering prevention connection portion and the second scattering prevention connection portion are connected by solder between the location where the first electrode and the second electrode are connected by solder and the connection portion (hereinafter referred to as “the soldering”). , Referred to as a scattering prevention unit). As a result, even if the solder that scatters when the gas in the hollow part that has expanded during the mounting process is discharged from the penetration part through the solder in the dissolved state, the scattered solder is transferred to the outside by the scatter prevention part. Is prevented from scattering. As a result, it is possible to avoid problems such as the scattered solder adhering to the connecting portion and causing a short circuit.

本発明の態様4に係る半導体装置50・50a・50bの製造方法は、底面部2fに貫通部(通気孔8)を有した凹形状のパッケージ2の開口部2bを覆部3により封止して中空部13を形成する中空部形成工程と、半田12により基板10の主面10a上に上記パッケージ2を実装する際に、上記基板10の主面10aと対向する上記パッケージ2の面2cにおいて上記貫通部(通気孔8)の開口部8aの周囲に設けられている第1電極(通気孔付接続端子9)と、上記基板10の主面10aにおいて上記第1電極(通気孔付接続端子9)に対向する位置に設けられている第2電極(基板側接続端子11a)と、を半田により接続し、上記貫通部(通気孔8)の開口部8aを半田12aで塞ぐ実装工程と、を含む。   In the manufacturing method of the semiconductor devices 50, 50a, and 50b according to the aspect 4 of the present invention, the opening 2b of the concave package 2 having the through portion (vent hole 8) in the bottom surface 2f is sealed by the cover 3. A step of forming the hollow portion 13 and the surface 2c of the package 2 facing the main surface 10a of the substrate 10 when the package 2 is mounted on the main surface 10a of the substrate 10 by the solder 12. The first electrode (connecting terminal with vent hole 9) provided around the opening 8a of the penetrating part (venting hole 8) and the first electrode (connecting terminal with vent hole) on the main surface 10a of the substrate 10 9) a mounting step of connecting the second electrode (substrate-side connection terminal 11a) provided at a position opposite to 9) with solder, and closing the opening 8a of the through-hole (ventilation hole 8) with the solder 12a; including.

上記構成によれば、態様1と同様の効果を奏する。   According to the said structure, there exists an effect similar to the aspect 1. FIG.

本発明の態様5に係る半導体装置50の製造方法は、上記態様4において、上記実装工程は、上記半田12aが溶解状態であるときは、上記貫通部(通気孔8)から上記中空部13内の気体を排出し、上記半田12aが硬化することにより、上記半田が上記貫通部の開口部8aを塞いでもよい。   In the manufacturing method of the semiconductor device 50 according to Aspect 5 of the present invention, in the Aspect 4, when the solder 12a is in a dissolved state, the mounting step is performed in the hollow portion 13 from the through portion (vent hole 8). This solder may block the opening 8a of the penetrating portion by discharging the gas and hardening the solder 12a.

上記構成によれば、態様1と同様の効果を奏する。   According to the said structure, there exists an effect similar to the aspect 1. FIG.

本発明は上述した各実施形態に限定されるものではなく、請求項に示した範囲で種々の変更が可能であり、異なる実施形態にそれぞれ開示された技術的手段を適宜組み合わせて得られる実施形態についても本発明の技術的範囲に含まれる。さらに、各実施形態にそれぞれ開示された技術的手段を組み合わせることにより、新しい技術的特徴を形成することができる。   The present invention is not limited to the above-described embodiments, and various modifications are possible within the scope shown in the claims, and embodiments obtained by appropriately combining technical means disclosed in different embodiments. Is also included in the technical scope of the present invention. Furthermore, a new technical feature can be formed by combining the technical means disclosed in each embodiment.

本発明は、気密封止中空構造を有する半導体装置に利用することができる。   The present invention can be used for a semiconductor device having a hermetically sealed hollow structure.

1 固体撮像素子
2 パッケージ
2b 開口部
2c 面
2f 底面部
3 覆部
6、6a 固定材
8 通気孔(貫通部)
8a 開口部
9 通気孔付接続端子(第1電極)
10 基板
10a 主面
11a 基板側接続端子(第2電極)
12、12a、12b 半田
13 中空部
16 通気路
17 導通接続部(接続部)
41 飛散防止パッケージ側接続部(第1飛散防止接続部)
42 飛散防止基板側接続部(第2飛散防止接続部)
50、50a、50b 半導体装置
DESCRIPTION OF SYMBOLS 1 Solid-state image sensor 2 Package 2b Opening part 2c Surface 2f Bottom face part 3 Cover part 6, 6a Fixing material 8 Ventilation hole (penetration part)
8a Opening 9 Connection terminal with vent (first electrode)
10 Substrate 10a Main surface 11a Substrate side connection terminal (second electrode)
12, 12a, 12b Solder 13 Hollow part 16 Ventilation path 17 Conduction connection part (connection part)
41 Splash prevention package side connection (first splash prevention connection)
42 Spattering prevention board side connection part (second scattering prevention connection part)
50, 50a, 50b Semiconductor device

Claims (4)

基板と、
上記基板の主面上に半田により実装される凹形状のパッケージと、
上記パッケージの開口部を封止して中空部を形成している覆部と、
上記パッケージの底面部に形成され、上記中空部と外部とを連通する貫通部と、
上記基板の主面と対向する上記パッケージの面において上記貫通部の開口部の周囲に設けられている第1電極と、
上記基板の主面において上記第1電極に対向する位置に設けられている第2電極と、
上記基板と上記パッケージとを電気的に接続する接続部と、
上記パッケージの上記基板に対向する面において上記第1電極と上記接続部との間に設けられる第1飛散防止接続部と、
上記基板の主面において上記第1飛散防止接続部に対向する位置に設けられる第2飛散防止接続部と、を備え、
上記貫通部の開口部は、上記第1電極と上記第2電極とを接続する半田により塞がれており、
上記第1飛散防止接続部と上記第2飛散防止接続部とは半田により接続されていることを特徴とする半導体装置。
A substrate,
A concave package mounted by solder on the main surface of the substrate;
A cover that seals the opening of the package to form a hollow portion;
A through-hole formed on the bottom surface of the package and communicating the hollow portion with the outside;
A first electrode provided around the opening of the through portion on the surface of the package facing the main surface of the substrate;
A second electrode provided at a position facing the first electrode on the main surface of the substrate;
A connection part for electrically connecting the substrate and the package;
A first anti-scattering connection provided between the first electrode and the connection on the surface of the package facing the substrate;
A second anti-scattering connection portion provided at a position facing the first anti-scattering connection portion on the main surface of the substrate ,
The opening of the penetrating portion is closed with solder connecting the first electrode and the second electrode ,
The semiconductor device, wherein the first scattering prevention connecting portion and the second scattering prevention connecting portion are connected by solder .
上記貫通部と対向する固体撮像素子と、
上記固体撮像素子を上記底面部の上記中空部側に固定させる固定材と、をさらに備え、
上記固定材は、上記貫通部と上記中空部とをつなぐ通気路を有することを特徴とする請求項1に記載の半導体装置。
A solid-state imaging device facing the penetrating portion;
A fixing material for fixing the solid-state imaging device to the hollow portion side of the bottom surface portion, and
The semiconductor device according to claim 1, wherein the fixing member has a ventilation path that connects the through portion and the hollow portion.
底面部に貫通部を有した凹形状のパッケージの開口部を覆部により封止して中空部を形成する中空部形成工程と、
半田により基板の主面上に上記パッケージを実装する際に、
上記基板の主面と対向する上記パッケージの面において上記貫通部の開口部の周囲に設けられている第1電極と、
上記基板の主面において上記第1電極に対向する位置に設けられている第2電極と、を半田により接続し、上記貫通部の開口部を半田で塞ぎ、
上記パッケージの上記基板に対向する面において(i)上記第1電極と(ii)上記基板と上記パッケージとを電気的に接続する接続部との間に設けられる第1飛散防止接続部と、
上記基板の主面において上記第1飛散防止接続部に対向する位置に設けられる第2飛散防止接続部と、を半田により接続する実装工程と、
を含むことを特徴とする半導体装置の製造方法。
A hollow part forming step of forming a hollow part by sealing an opening of a concave package having a through part on the bottom part with a cover part,
When mounting the above package on the main surface of the board with solder,
A first electrode provided around the opening of the through portion on the surface of the package facing the main surface of the substrate;
A second electrode provided at a position opposed to the first electrode in the main surface of the substrate, were connected by soldering, busy technique the opening of the through portion by soldering,
A first anti-scattering connection provided between (i) the first electrode and (ii) a connection for electrically connecting the substrate and the package on the surface of the package facing the substrate;
A mounting step of connecting, by solder, a second anti-scattering connection portion provided at a position facing the first anti-scattering connection portion on the main surface of the substrate ;
A method for manufacturing a semiconductor device, comprising:
上記実装工程は、
上記半田が溶解状態であるときは、上記貫通部から上記中空部内の気体を排出し、
上記半田が硬化することにより、上記半田が上記貫通部の開口部を塞ぐ
ことを特徴とする請求項に記載の半導体装置の製造方法。
The mounting process is
When the solder is in a dissolved state, the gas in the hollow part is discharged from the through part,
4. The method of manufacturing a semiconductor device according to claim 3 , wherein the solder is hardened to block the opening of the through portion.
JP2014249278A 2014-12-09 2014-12-09 Semiconductor device and manufacturing method of semiconductor device Expired - Fee Related JP6377510B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2014249278A JP6377510B2 (en) 2014-12-09 2014-12-09 Semiconductor device and manufacturing method of semiconductor device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2014249278A JP6377510B2 (en) 2014-12-09 2014-12-09 Semiconductor device and manufacturing method of semiconductor device

Publications (2)

Publication Number Publication Date
JP2016111270A JP2016111270A (en) 2016-06-20
JP6377510B2 true JP6377510B2 (en) 2018-08-22

Family

ID=56124798

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2014249278A Expired - Fee Related JP6377510B2 (en) 2014-12-09 2014-12-09 Semiconductor device and manufacturing method of semiconductor device

Country Status (1)

Country Link
JP (1) JP6377510B2 (en)

Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP6884595B2 (en) 2017-02-28 2021-06-09 キヤノン株式会社 Manufacturing methods for electronic components, electronic devices and electronic components
JP2019125643A (en) * 2018-01-15 2019-07-25 ソニーセミコンダクタソリューションズ株式会社 Semiconductor element, mounting substrate, semiconductor device and method of manufacturing the semiconductor device
JP6703029B2 (en) 2018-03-26 2020-06-03 キヤノン株式会社 Electronic module and imaging system
CN109326620A (en) * 2018-10-11 2019-02-12 北京工业大学 A kind of embedded packaging structure and production method of image sensing chip

Family Cites Families (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3214638B2 (en) * 1993-02-05 2001-10-02 日本特殊陶業株式会社 Ceramic lid for semiconductor package and method of manufacturing the same
JP2000150844A (en) * 1998-11-10 2000-05-30 Sony Corp Manufacture of solid state image sensor
JP4667076B2 (en) * 2005-03-04 2011-04-06 ソニーケミカル&インフォメーションデバイス株式会社 Mounting method of functional element mounting module
JP2008108809A (en) * 2006-10-24 2008-05-08 Epson Toyocom Corp Solid-state imaging device
JP5082542B2 (en) * 2007-03-29 2012-11-28 ソニー株式会社 Solid-state imaging device
JP2009141455A (en) * 2007-12-04 2009-06-25 Nippon Dempa Kogyo Co Ltd Crystal device for surface mounting
JP2013093637A (en) * 2010-02-24 2013-05-16 Panasonic Corp Semiconductor device and manufacturing method of the same
WO2013052676A1 (en) * 2011-10-07 2013-04-11 Analog Devices, Inc. Systems and methods for air release in cavity packages
JP2013168467A (en) * 2012-02-15 2013-08-29 Seiko Epson Corp Package, vibration device and electronic apparatus

Also Published As

Publication number Publication date
JP2016111270A (en) 2016-06-20

Similar Documents

Publication Publication Date Title
US9162871B1 (en) Metal mesh lid MEMS package and method
JP2991172B2 (en) Semiconductor device
JP4858541B2 (en) Relay board and electronic circuit mounting structure
JP5045769B2 (en) Manufacturing method of sensor device
JP4830120B2 (en) Electronic package and manufacturing method thereof
JP6377510B2 (en) Semiconductor device and manufacturing method of semiconductor device
JP5135835B2 (en) Semiconductor device and manufacturing method thereof
WO2016042819A1 (en) Substrate for mounting electronic element, and electronic device
JPH02342A (en) Attachment of integrated circuit chip and package assembly
JP5751079B2 (en) Semiconductor device and manufacturing method thereof
US10580711B2 (en) Electronic device mounting board and electronic package
US7362038B1 (en) Surface acoustic wave (SAW) device package and method for packaging a SAW device
JP2005167129A (en) Electronic element package and method for manufacturing the same
JP4725817B2 (en) Manufacturing method of composite substrate
JP5353153B2 (en) Mounting structure
JP6439046B2 (en) Semiconductor device
US8274125B2 (en) Semiconductor device and semiconductor device manufacturing method
JPH08139129A (en) Semiconductor device and production thereof
WO2011142059A1 (en) Semiconductor device and method for producing same
JP2009176955A (en) Semiconductor device and method of manufacturing same
JP4471015B2 (en) Electronic device package
JP6940373B2 (en) Receiver
JP2004047897A (en) Electronic part and manufacture thereof
US20210297615A1 (en) Solid-state image capturing device and manufacturing method of solid-state image capturing device
JP4070452B2 (en) Electronic components

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20171002

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20180226

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20180306

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20180405

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20180626

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20180725

R150 Certificate of patent or registration of utility model

Ref document number: 6377510

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

LAPS Cancellation because of no payment of annual fees