JP6345781B2 - 最適化されたコードテーブル信号伝達 - Google Patents
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- 230000011664 signaling Effects 0.000 title description 20
- 238000000034 method Methods 0.000 claims description 353
- 239000013598 vector Substances 0.000 claims description 337
- 230000005540 biological transmission Effects 0.000 claims description 248
- 239000002131 composite material Substances 0.000 claims description 203
- 238000012546 transfer Methods 0.000 claims description 31
- 238000012937 correction Methods 0.000 claims description 26
- 230000006854 communication Effects 0.000 description 208
- 238000004891 communication Methods 0.000 description 208
- 230000008569 process Effects 0.000 description 126
- 238000000638 solvent extraction Methods 0.000 description 90
- 238000005259 measurement Methods 0.000 description 78
- 238000005192 partition Methods 0.000 description 67
- 230000006870 function Effects 0.000 description 51
- 238000013507 mapping Methods 0.000 description 37
- 230000004044 response Effects 0.000 description 30
- 238000012545 processing Methods 0.000 description 29
- 230000000670 limiting effect Effects 0.000 description 19
- 238000003860 storage Methods 0.000 description 19
- 238000004422 calculation algorithm Methods 0.000 description 12
- 230000008859 change Effects 0.000 description 12
- 238000010586 diagram Methods 0.000 description 12
- 230000000875 corresponding effect Effects 0.000 description 11
- 238000012986 modification Methods 0.000 description 10
- 230000004048 modification Effects 0.000 description 10
- 238000011156 evaluation Methods 0.000 description 9
- 230000001965 increasing effect Effects 0.000 description 7
- 238000006243 chemical reaction Methods 0.000 description 6
- 238000004590 computer program Methods 0.000 description 6
- 230000007717 exclusion Effects 0.000 description 6
- 230000003287 optical effect Effects 0.000 description 6
- 238000012163 sequencing technique Methods 0.000 description 6
- 230000001131 transforming effect Effects 0.000 description 6
- 238000007726 management method Methods 0.000 description 5
- 239000011159 matrix material Substances 0.000 description 5
- 230000001105 regulatory effect Effects 0.000 description 5
- 238000009826 distribution Methods 0.000 description 4
- 230000000873 masking effect Effects 0.000 description 4
- 238000012544 monitoring process Methods 0.000 description 4
- 230000009471 action Effects 0.000 description 3
- 230000008901 benefit Effects 0.000 description 3
- 238000004364 calculation method Methods 0.000 description 3
- 230000001276 controlling effect Effects 0.000 description 3
- 238000013461 design Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 238000005516 engineering process Methods 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 3
- 230000007246 mechanism Effects 0.000 description 3
- 230000010363 phase shift Effects 0.000 description 3
- 230000002829 reductive effect Effects 0.000 description 3
- 238000000926 separation method Methods 0.000 description 3
- 238000012795 verification Methods 0.000 description 3
- 238000013479 data entry Methods 0.000 description 2
- 238000001514 detection method Methods 0.000 description 2
- 238000011161 development Methods 0.000 description 2
- 239000000463 material Substances 0.000 description 2
- 229920000642 polymer Polymers 0.000 description 2
- 230000002441 reversible effect Effects 0.000 description 2
- 238000010845 search algorithm Methods 0.000 description 2
- 230000008054 signal transmission Effects 0.000 description 2
- 230000001052 transient effect Effects 0.000 description 2
- 238000013519 translation Methods 0.000 description 2
- 241000406668 Loxodonta cyclotis Species 0.000 description 1
- 230000004913 activation Effects 0.000 description 1
- 238000004458 analytical method Methods 0.000 description 1
- 238000003491 array Methods 0.000 description 1
- 230000007175 bidirectional communication Effects 0.000 description 1
- 230000002457 bidirectional effect Effects 0.000 description 1
- 239000003990 capacitor Substances 0.000 description 1
- 239000000969 carrier Substances 0.000 description 1
- 230000002596 correlated effect Effects 0.000 description 1
- 238000009795 derivation Methods 0.000 description 1
- 238000012938 design process Methods 0.000 description 1
- 230000002708 enhancing effect Effects 0.000 description 1
- 239000000835 fiber Substances 0.000 description 1
- 230000006872 improvement Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 230000003993 interaction Effects 0.000 description 1
- 239000004973 liquid crystal related substance Substances 0.000 description 1
- 230000003137 locomotive effect Effects 0.000 description 1
- 230000005055 memory storage Effects 0.000 description 1
- 239000003607 modifier Substances 0.000 description 1
- 230000006855 networking Effects 0.000 description 1
- 230000008520 organization Effects 0.000 description 1
- 238000012913 prioritisation Methods 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
- 238000001228 spectrum Methods 0.000 description 1
- 230000003068 static effect Effects 0.000 description 1
- 238000006467 substitution reaction Methods 0.000 description 1
- 239000013589 supplement Substances 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
- 239000010409 thin film Substances 0.000 description 1
- 230000009466 transformation Effects 0.000 description 1
- 230000000007 visual effect Effects 0.000 description 1
- 238000005406 washing Methods 0.000 description 1
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M7/00—Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
- H03M7/30—Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
- H03M7/3082—Vector coding
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- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
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- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/03—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words
- H03M13/05—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits
- H03M13/11—Error detection or forward error correction by redundancy in data representation, i.e. code words containing more digits than the source words using block codes, i.e. a predetermined number of check bits joined to a predetermined number of information bits using multiple parity bits
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- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/25—Error detection or forward error correction by signal space coding, i.e. adding redundancy in the signal constellation, e.g. Trellis Coded Modulation [TCM]
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- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/25—Error detection or forward error correction by signal space coding, i.e. adding redundancy in the signal constellation, e.g. Trellis Coded Modulation [TCM]
- H03M13/251—Error detection or forward error correction by signal space coding, i.e. adding redundancy in the signal constellation, e.g. Trellis Coded Modulation [TCM] with block coding
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- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/35—Unequal or adaptive error protection, e.g. by providing a different level of protection according to significance of source information or by adapting the coding according to the change of transmission channel characteristics
- H03M13/353—Adaptation to the channel
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- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/61—Aspects and characteristics of methods and arrangements for error correction or error detection, not provided for otherwise
- H03M13/611—Specific encoding aspects, e.g. encoding by means of decoding
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- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M7/00—Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
- H03M7/30—Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
- H03M7/40—Conversion to or from variable length codes, e.g. Shannon-Fano code, Huffman code, Morse code
- H03M7/42—Conversion to or from variable length codes, e.g. Shannon-Fano code, Huffman code, Morse code using table look-up for the coding or decoding process, e.g. using read-only memory
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- H03M7/00—Conversion of a code where information is represented by a given sequence or number of digits to a code where the same, similar or subset of information is represented by a different sequence or number of digits
- H03M7/30—Compression; Expansion; Suppression of unnecessary data, e.g. redundancy reduction
- H03M7/60—General implementation details not specific to a particular type of compression
- H03M7/6052—Synchronisation of encoder and decoder
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
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- H04L1/00—Arrangements for detecting or preventing errors in the information received
- H04L1/0001—Systems modifying transmission characteristics according to link quality, e.g. power backoff
- H04L1/0009—Systems modifying transmission characteristics according to link quality, e.g. power backoff by adapting the channel coding
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- H04L1/00—Arrangements for detecting or preventing errors in the information received
- H04L1/004—Arrangements for detecting or preventing errors in the information received by using forward error control
- H04L1/0041—Arrangements at the transmitter end
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- H04L1/004—Arrangements for detecting or preventing errors in the information received by using forward error control
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- H04L1/0043—Realisations of complexity reduction techniques, e.g. use of look-up tables
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- H04L1/004—Arrangements for detecting or preventing errors in the information received by using forward error control
- H04L1/0056—Systems characterized by the type of code used
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- H04L1/004—Arrangements for detecting or preventing errors in the information received by using forward error control
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- H04L25/00—Baseband systems
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- H04L25/49—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
- H04L25/4906—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using binary codes
- H04L25/4915—Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using binary codes using pattern inversion or substitution
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- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L27/00—Modulated-carrier systems
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- H04L27/3405—Modifications of the signal space to increase the efficiency of transmission, e.g. reduction of the bit error rate, bandwidth, or average power
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Description
本願は、2013年8月6日に出願され、OPTIMIZED CODE TABLE SIGNALINGと題された、米国仮出願第61/862,745号の35 U.S.C. § 119(e)のもとでの利益を主張するものであり、該仮出願の開示の全体は、参照により本明細書中に援用される。
本発明は、例えば、以下を提供する。
(項1)
コンピュータ実装方法であって、
プロセッサによって、デジタルビットストリームを受信するステップと、
上記プロセッサによって、上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換するステップであって、上記エンコードされたデジタルビットストリームは、ゲートウェイパーティション、複合パーティション、データパーティション、およびそれらの任意の組み合わせのうちの少なくとも1つを備え、上記ゲートウェイパーティションは、信号完全性機能を提供し、上記複合パーティションに対する構成を識別し、上記ゲートウェイパーティションは、信号完全性を提供する第1のパートと、現在の複合パーティションの構成を識別する第2のパートとを含むマルチパートメッセージを提供する、ステップと、
上記プロセッサによって、伝送のために、上記エンコードされたデジタルビットストリームを伝送システムに提供するステップと
を含む、方法。
(項2)
上記デジタルビットストリームを変換するステップは、上記プロセッサによって、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項1に記載のコンピュータ実装方法。
(項3)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、上記プロセッサによって、上記デジタルビットストリームに関してテーブルルックアップを行うステップを含む、項2に記載のコンピュータ実装方法。
(項4)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、マッピング機能に従って、上記プロセッサによって、上記m−要素テーブルを上記デジタルビットストリームにマッピングするステップを含む、項2または3に記載のコンピュータ実装方法。
(項5)
上記プロセッサによって、上記m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するステップを含む、項1から3のいずれかに記載のコンピュータ実装方法。
(項6)
上記プロセッサによって、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するステップを含む、項1から3のいずれかに記載のコンピュータ実装方法。
(項7)
上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、上記プロセッサによって、データベクトルおよび上記複合チャネルをインタリーブするステップを含む、項1から3のいずれかに記載のコンピュータ実装方法。
(項8)
上記プロセッサによって、複数の付加的ビットを生成するステップであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ステップと、上記プロセッサによって、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加するステップとを含む、項1から3のいずれかに記載のコンピュータ実装方法。
(項9)
上記プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、上記m−要素ベクトルテーブルのための混合型パーティショニングを生成し、データ転送を最適化するステップを含む、項1から3のいずれかに記載のコンピュータ実装方法。
(項10)
システムであって、
通信インターフェースと、
プロセッサと、
上記プロセッサに動作可能に連結される、非一過性メモリ媒体であって、
デジタルビットストリームを受信することと、
上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、上記エンコードされたデジタルビットストリームは、ゲートウェイパーティション、複合パーティション、データパーティション、およびそれらの任意の組み合わせのうちの少なくとも1つを備え、上記ゲートウェイパーティションは、信号完全性機能を提供し、上記複合パーティションに対する構成を識別し、上記ゲートウェイパーティションは、信号完全性を提供する第1のパートと、現在の複合パーティションの構成を識別する第2のパートとを含むマルチパートメッセージを提供する、ことと、
伝送のために、上記エンコードされたデジタルビットストリームを上記通信インターフェースに提供することと
を行うように、上記プロセッサをプログラムするように構成される複数の命令を記憶するように構成される、メモリ媒体と
を備える、システム。
(項11)
上記デジタルビットストリームを変換するステップは、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項10に記載のシステム。
(項12)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、上記デジタルビットストリームに関するテーブルルックアップを行うステップを含む、項11に記載のシステム。
(項13)
上記プロセッサはさらに、上記m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するように構成される、項10または11に記載のシステム。
(項14)
上記プロセッサはさらに、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するように構成される、項10から12のいずれかに記載のシステム。
(項15)
上記プロセッサはさらに、上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、データベクトルおよび上記複合チャネルをインタリーブするように構成される、項10から12のいずれかに記載のシステム。
(項16)
上記プロセッサはさらに、複数の付加的ビットを生成することであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ことと、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加することとを行うように構成される、項10から12のいずれかに記載のシステム。
(項17)
上記通信インターフェースは、無線周波数(RF)通信システムを備える、項10から12のいずれかに記載のシステム。
(項18)
非一過性コンピュータ可読メモリ媒体であって、プロセッサによってロードされると、上記プロセッサに、
デジタルビットストリームを受信することと、
上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、上記エンコードされたデジタルビットストリームは、ゲートウェイパーティション、複合パーティション、データパーティション、およびそれらの任意の組み合わせのうちの少なくとも1つを備え、上記ゲートウェイパーティションは、信号完全性機能を提供し、上記複合パーティションに対する構成を識別し、上記ゲートウェイパーティションは、信号完全性を提供する第1のパートと、現在の複合パーティションの構成を識別する第2のパートとを含むマルチパートメッセージを提供する、ことと、
伝送のために、上記エンコードされたデジタルビットストリームを上記通信インターフェースに提供することと
を行わせる命令をその上に記憶するように構成される、非一過性コンピュータ可読メモリ媒体。
(項19)
上記デジタルビットストリームを変換するステップは、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項18に記載の非一過性コンピュータ可読メモリ媒体。
(項20)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、上記デジタルビットストリームに関するテーブルルックアップを行うステップを含む、項19に記載の非一過性コンピュータ可読メモリ媒体。
(項21)
上記その上に記憶された命令はさらに、上記プロセッサに、上記m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供させる、項19から20のいずれかに記載の非一過性コンピュータ可読メモリ媒体。
(項22)
事前協調かつ事前配信された情報を利用して、上記伝送を意図された送信機−受信機対に限定することによって、上記プロセッサによって、信号完全性を確立するステップをさらに含み、上記意図された送信機−受信機対は、上記事前協調かつ事前配信された情報を備える、項1に記載のコンピュータ実装方法。
(項23)
上記事前協調かつ事前配信された情報を利用することによって、上記プロセッサによって、上記信号完全性を維持するステップを含む、項22に記載のコンピュータ実装方法。
(項24)
伝送に先立って、上記エンコードされるデジタルビットストリームを一意にフォーマットすることによって、上記プロセッサによって、上記伝送を上記意図された送信機および受信機に限定するステップを含む、項22または23に記載のコンピュータ実装方法。
(項25)
上記デジタルビットストリームを変換するステップは、上記プロセッサによって、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項22または23に記載のコンピュータ実装方法。
(項26)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、上記プロセッサによって、上記デジタルビットストリームに関してテーブルルックアップを行うステップを含む、項25に記載のコンピュータ実装方法。
(項27)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、マッピング機能に従って、上記プロセッサによって、上記m−要素テーブルを上記デジタルビットストリームにマッピングするステップを含む、項25に記載のコンピュータ実装方法。
(項28)
上記プロセッサによって、上記m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、向上された信号完全性および通信を提供するステップを含む、項22または23に記載のコンピュータ実装方法。
(項29)
上記プロセッサによって、1つまたはそれを上回るタスクを管理し、信号完全性および通信を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するステップを含む、項22または23に記載のコンピュータ実装方法。
(項30)
上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、上記プロセッサによって、データベクトルおよび上記複合チャネルをインタリーブするステップを含む、項22または23に記載のコンピュータ実装方法。
(項31)
上記プロセッサによって、複数の付加的ビットを生成するステップであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ステップと、
上記プロセッサによって、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加するステップと
を含む、項22または23に記載のコンピュータ実装方法。
(項32)
上記プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、上記m−要素ベクトルテーブルのための混合型パーティショニングを生成し、信号完全性および通信を向上させるステップを含む、項22または23に記載のコンピュータ実装方法。
(項33)
上記プロセッサはさらに、事前協調かつ事前配信された情報を利用し、上記伝送を意図された送信機−受信機対に限定することによって、信号完全性を確立するように構成され、上記意図された送信機−受信機対は、上記事前協調かつ事前配信された情報を備える、項10に記載のシステム。
(項34)
上記プロセッサはさらに、上記事前協調かつ事前配信された情報を利用することによって、上記信号完全性を維持するように構成される、項33に記載のコンピュータ実装方法。
(項35)
上記プロセッサはさらに、伝送に先立って、上記エンコードされるデジタルビットストリームを一意にフォーマットすることによって、上記伝送を上記意図された送信機および受信機に限定するように構成される、項33または34に記載のコンピュータ実装方法。
(項36)
上記デジタルビットストリームを変換するステップは、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項33または34に記載のシステム。
(項37)
上記プロセッサはさらに、上記m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、向上された信号完全性および通信を提供するように構成される、項33または34に記載のシステム。
(項38)
上記プロセッサはさらに、1つまたはそれを上回るタスクを管理し、信号完全性および通信を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するように構成される、項33または34に記載のシステム。
(項39)
上記プロセッサはさらに、複数の付加的ビットを生成することであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ことと、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加することとを行うように構成される、項33または34に記載のシステム。
(項40)
上記通信インターフェースは、結合された通信システムを備える、項33または34に記載のシステム。
(項41)
上記通信インターフェースは、非結合通信システムを備える、項33または34に記載のシステム。
(項42)
上記プロセッサに、
事前協調かつ事前配信された情報を利用し、上記伝送を意図された送信機−受信機対に限定することによって、信号完全性を確立することであって、上記意図された送信機−受信機対は、上記事前協調かつ事前配信された情報を備える、ことと、
上記事前協調かつ事前配信された情報を利用することによって、上記信号完全性を維持することと、
伝送に先立って、上記エンコードされるデジタルビットストリームを一意にフォーマットすることによって、上記伝送を上記意図された送信機および受信機に限定することと
を行わせる命令をその上に記憶するようにさらに構成される、項18に記載の非一過性コンピュータ可読メモリ媒体。
(項43)
導出されたQOS測定値の使用を通して、上記プロセッサによって、サービスの質(QOS)の動的制御を可能にし、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすステップをさらに含み、上記意図された送信機−受信機対は、通信のために必要なQOSを伴うデジタルビットの継続伝送および受信をもたらすように情報を一意に協調かつ配信可能である、項1に記載のコンピュータ実装方法。
(項44)
上記プロセッサによって、導出されたQOS測定値の使用を通して、QOSの動的制御を維持し、協調された変更を事前協調かつ事前配信された情報にもたらすステップを含む、項43に記載のコンピュータ実装方法。
(項45)
伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記プロセッサによって、上記伝送を上記意図された送信機および受信機に限定する、導出されたQOS測定値の使用を通したQOSの動的制御を含む、項43または44に記載のコンピュータ実装方法。
(項46)
上記デジタルビットストリームを変換するステップは、上記プロセッサによって、上記デジタルビットストリームに適用されるべきm−要素ベクトルテーブルを変更するステップを含む、項43または44に記載のコンピュータ実装方法。
(項47)
上記m−要素ベクトルテーブルを変更し、上記デジタルビットストリームに適用するステップは、上記プロセッサによって、上記デジタルビットストリームに関してテーブルルックアップを行うステップを含む、項46に記載のコンピュータ実装方法。
(項48)
上記m−要素ベクトルテーブルを変更し、上記デジタルビットストリームに適用するステップは、マッピング機能に従って、上記プロセッサによって、上記m−要素テーブルを上記デジタルビットストリームにマッピングするステップを含む、項46に記載のコンピュータ実装方法。
(項49)
上記プロセッサによって、上記m−要素ベクトルテーブルへの変更を採用し、サービス応答時間、損失、信号対雑音比、クロストーク、エコー、中断、周波数応答、ラウドネスレベル、要求されるビットレート、遅延、ジッタ、パケットドロップ確率および/またはビットエラーレート、データレート、および遅延のうちの少なくとも1つを管理し、導出されたQOS測定値の使用を通したQOSの動的制御に対して、スケジューリング優先度、当業者に公知の他のQOS測定値、およびそれらの任意の組み合わせを動的に制御するステップを含む、項43または44に記載のコンピュータ実装方法。
(項50)
上記プロセッサによって、1つまたはそれを上回るタスクを管理し、導出されたQOS測定値の使用を通して、QOSを動的に向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するステップを含む、項43または44に記載のコンピュータ実装方法。
(項51)
上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、上記プロセッサによって、データベクトルおよび上記複合チャネルをインタリーブするステップに対する動的変更を含む、項43または44に記載のコンピュータ実装方法。
(項52)
上記プロセッサによって、複数の付加的ビットを生成するステップであって、上記複数の付加的ビットは、QOSの導出された測定値を評価することによって生成される、ステップと、上記プロセッサによって、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加するステップと、必要に応じて、上記プロセッサによって、上記付加的ビットを変更し、上記エンコードされたデジタルビットストリームのための所望のQOSを維持するステップとを含む、項43または44に記載のコンピュータ実装方法。
(項53)
上記プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、導出されたQOS測定値の使用を通したQOSの動的制御に対して、上記m−要素ベクトルテーブルのための混合型パーティショニングを生成するステップを含む、項43または44に記載のコンピュータ実装方法。
(項54)
上記プロセッサはさらに、導出されたQOS測定値の使用を通して、サービスの質(QOS)の動的制御を可能にし、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすように構成され、上記意図された送信機−受信機対は、通信のために必要なQOSを伴うデジタルビットの継続伝送および受信をもたらすように情報を一意に協調かつ配信可能である、項10に記載のシステム。
(項55)
上記プロセッサはさらに、導出されたQOS測定値の使用を通したQOSの動的制御に対して、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすように構成される、項54に記載のシステム。
(項56)
上記プロセッサはさらに、伝送に先立って、上記エンコードされるデジタルビットストリームを一意にフォーマットすることによって、上記協調された変更の通信を上記意図された送信機および受信機に限定するように構成される、項54または55に記載のシステム。
(項57)
上記デジタルビットストリームを変換するステップは、変更を上記デジタルビットストリームに適用されるべきm−要素ベクトルテーブルに通信するステップを含む、項54または55に記載のシステム。
(項58)
上記プロセッサはさらに、上記m−要素ベクトルテーブルを採用し、サービス応答時間、損失、信号対雑音比、クロストーク、エコー、中断、周波数応答、ラウドネスレベル、要求されるビットレート、遅延、ジッタ、パケットドロップ確率および/またはビットエラーレート、データレート、および遅延のうちの少なくとも1つを管理し、導出されたQOS測定値の使用を通したQOSの動的制御に対して、スケジューリング優先度、当業者に公知の他のQOS測定値、およびそれらの任意の組み合わせを動的に制御するように構成される、項54または55に記載のシステム。
(項59)
上記プロセッサはさらに、1つまたはそれを上回るタスクを管理し、導出されたQOS測定値の使用を通して、QOSを動的に向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するように構成される、項54または55に記載のシステム。
(項60)
上記プロセッサはさらに、
複数の付加的ビットを生成することであって、上記複数の付加的ビットは、QOSの導出された測定値を評価することによって生成される、ことと、
上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加することと、
必要に応じて、上記付加的ビットを変更し、上記エンコードされたデジタルビットストリームのための所望のQOSを維持することと
を行うように構成される、項54または55に記載のシステム。
(項61)
上記通信インターフェースは、結合された通信システムを備える、項54または55に記載のシステム。
(項62)
上記通信インターフェースは、非結合通信システムを備える、項54または55に記載のシステム。
(項63)
上記プロセッサに、
事前協調かつ事前配信された情報を利用し、上記伝送を意図された送信機−受信機対に限定することによって、サービスの質(QOS)を確立することであって、上記意図された送信機−受信機対は、上記事前協調かつ事前配信された情報を備える、ことと、
協調かつ配信された情報を変更および通信することによって、導出されたQOS測定値の使用を通して、QOSの動的制御を維持することと、
伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記伝送を上記意図された送信機および受信機に限定することと
を行わせる命令をその上に記憶するようにさらに構成される、項18に記載の非一過性コンピュータ可読メモリ媒体。
(項64)
上記プロセッサによって、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報の使用を通して、認証を可能にするステップをさらに含み、上記意図された送信機−受信機対は、通信のためにデジタルビットの継続伝送および受信をもたらすように、情報を一意に協調かつ配信可能である、項1に記載のコンピュータ実装方法。
(項65)
協調された変更を事前協調かつ事前配信された情報にもたらすことによって、上記プロセッサによって、認証を維持するステップを含む、項64に記載のコンピュータ実装方法。
(項66)
上記プロセッサによって、上記事前協調かつ事前配信された情報の使用を通して、認証を可能にするステップは、伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記伝送を上記意図された送信機および受信機に限定するステップを含む、項64または65に記載のコンピュータ実装方法。
(項67)
上記デジタルビットストリームを変換するステップは、上記プロセッサによって、上記デジタルビットストリームに適用されるべきm−要素ベクトルテーブルを変更するステップを含む、項64または65に記載のコンピュータ実装方法。
(項68)
上記m−要素ベクトルテーブルを変更し、上記デジタルビットストリームに適用するステップは、上記プロセッサによって、上記デジタルビットストリームに関してテーブルルックアップを行うステップを含む、項67に記載のコンピュータ実装方法。
(項69)
上記m−要素ベクトルテーブルを変更し、上記デジタルビットストリームに適用するステップは、マッピング機能に従って、上記プロセッサによって、上記m−要素テーブルを上記デジタルビットストリームにマッピングするステップを含む、項67に記載のコンピュータ実装方法。
(項70)
伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記プロセッサによって、上記意図された送信機および受信機への伝送、すなわち、上記送信機−受信機対の認証を含む、項64または65に記載のコンピュータ実装方法。
(項71)
上記プロセッサによって、1つまたはそれを上回るタスクを管理し、伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記送信機−受信機対を認証するステップを含む、項64または65に記載のコンピュータ実装方法。
(項72)
上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、上記プロセッサによって、データベクトルおよび上記複合チャネルをインタリーブするステップに対する動的変更を含む、項64または65に記載のコンピュータ実装方法。
(項73)
上記プロセッサによって、複数の付加的ビットを生成するステップであって、上記複数の付加的ビットは、上記送信機−受信機対の認証を向上および継続するように生成される、ステップと、
上記プロセッサによって、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加するステップと、
必要に応じて、上記プロセッサによって、上記付加的ビットを変更し、上記送信機−受信機対の所望の認証を維持するステップと
を含む、項64または65に記載のコンピュータ実装方法。
(項74)
上記プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、上記m−要素ベクトルテーブルのための混合型パーティショニングを生成し、上記送信機−受信機対を認証するステップを含む、項64または65に記載のコンピュータ実装方法。
(項75)
上記プロセッサはさらに、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報の使用を通して、認証を可能にするように構成され、上記意図された送信機−受信機対は、通信のためにデジタルビットの継続伝送および受信をもたらすように、情報を一意に協調かつ配信可能である、項10に記載のシステム。
(項76)
上記プロセッサはさらに、上記送信機−受信機対を認証し、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすように構成される、項75に記載のシステム。
(項77)
上記プロセッサはさらに、伝送に先立って、上記エンコードされるデジタルビットストリームを一意にフォーマットすることによって、上記協調された変更の通信を上記意図された送信機および受信機に限定するように構成される、項75または76に記載のシステム。
(項78)
上記デジタルビットストリームを変換するステップは、変更を上記デジタルビットストリームに適用されるべきm−要素ベクトルテーブルに通信するステップを含む、項75または76に記載のシステム。
(項79)
上記プロセッサはさらに、上記m−要素ベクトルテーブルを採用し、伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記プロセッサによって、上記意図された送信機および受信機への伝送、すなわち、上記送信機−受信機対の認証を管理するように構成される、項75または76に記載のシステム。
(項80)
上記プロセッサはさらに、上記プロセッサによって、1つまたはそれを上回るタスクを管理し、伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記送信機−受信機対を認証するように構成される、項75または76に記載のシステム。
(項81)
上記プロセッサはさらに、
複数の付加的ビットを生成することであって、上記複数の付加的ビットは、上記送信機−受信機対を認証するために生成される、ことと、
上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加し、必要に応じて、上記付加的ビットを変更し、上記送信機−受信機対の認証を維持することと
を行うように構成される、項75または76に記載のシステム。
(項82)
上記通信インターフェースは、結合された通信システムを備える、項75または76に記載のシステム。
(項83)
上記通信インターフェースは、非結合通信システムを備える、項75または76に記載のシステム。
(項84)
上記プロセッサに、
事前協調かつ事前配信された情報を利用し、上記伝送を意図された送信機−受信機対に限定することによって、上記送信機−受信機対の認証を確立することであって、上記意図された送信機−受信機対は、上記事前協調かつ事前配信された情報を備える、ことと、
協調かつ配信された情報を変更および通信することによって、上記送信機−受信機対の認証の動的制御を維持することと、
伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記伝送を上記意図された送信機および受信機に限定することと
を行わせるようにさらに構成される、項18に記載の非一過性コンピュータ可読メモリ媒体。
(項85)
システムであって、
ネットワークインターフェースと、
プロセッサと、
上記プロセッサに動作可能に連結される、非一過性メモリ媒体であって、
デジタルビットストリームを受信することと、
上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、上記エンコードされたデジタルビットストリームは、ゲートウェイパーティション、複合パーティション、データパーティション、およびそれらの任意の組み合わせのうちの少なくとも1つを備え、上記ゲートウェイパーティションは、信号完全性機能を提供し、上記複合パーティションに対する構成を識別し、上記ゲートウェイパーティションは、信号完全性を提供する第1のパートと、現在の複合パーティションの構成を識別する第2のパートとを含むマルチパートメッセージを提供する、ことと、
伝送のために、上記エンコードされたデジタルビットストリームを上記ネットワークインターフェースに提供することと
を行うように上記プロセッサをプログラムするように構成される複数の命令を記憶するように構成される、メモリ媒体と
を備える、システム。
(項86)
上記プロセッサは、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するように構成される、項85に記載のシステム。
(項87)
上記プロセッサは、上記デジタルビットストリームに関するテーブルルックアップを行うように構成される、項85または86に記載のシステム。
(項88)
上記プロセッサはさらに、上記m−要素ベクトルテーブルを採用し、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するように構成される、項85または86に記載のシステム。
(項89)
上記プロセッサはさらに、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させ、業界標準非依存インターフェースを既存の情報システムに提供するように構成される、項85または86に記載のシステム。
(項90)
上記プロセッサはさらに、上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、データベクトルおよび上記複合チャネルをインタリーブするように構成される、項85または86に記載のシステム。
(項91)
上記プロセッサはさらに、
複数の付加的ビットを生成することであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ことと、
上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加することと
を行うように構成される、項85または86に記載のシステム。
(項92)
上記ネットワークインターフェースは、情報システムを備える、項85または86に記載のシステム。
(項93)
上記情報システムは、結合された情報システムである、項92に記載のシステム。
(項94)
上記情報システムは、非結合情報システムである、項92に記載のシステム。
(項95)
非一過性コンピュータ可読メモリ媒体であって、プロセッサによってロードされると、上記プロセッサに、
デジタルビットストリームを受信することと、
上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、上記エンコードされたデジタルビットストリームは、ゲートウェイパーティション、複合パーティション、データパーティション、およびそれらの任意の組み合わせのうちの少なくとも1つを備え、上記ゲートウェイパーティションは、信号完全性機能を提供し、上記複合パーティションに対する構成を識別し、上記ゲートウェイパーティションは、信号完全性を提供する第1のパートと、現在の複合パーティションの構成を識別する第2のパートとを含むマルチパートメッセージを提供する、ことと、
伝送のために、上記エンコードされたデジタルビットストリームを上記ネットワークインターフェースに提供することと
を行わせる命令をその上に記憶するように構成される、非一過性コンピュータ可読メモリ媒体。
(項96)
上記その上に記憶された命令はさらに、上記プロセッサに、m−要素ベクトルテーブルを上記デジタルビットストリームに適用させる、項95に記載の非一過性コンピュータ可読メモリ媒体。
(項97)
上記その上に記憶された命令はさらに、上記プロセッサに、上記デジタルビットストリームに関するテーブルルックアップを行わせる、項95または96に記載の非一過性コンピュータ可読メモリ媒体。
(項98)
上記その上に記憶された命令はさらに、上記プロセッサに、上記m−要素ベクトルテーブルを採用し、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供させる、項95または96に記載の非一過性コンピュータ可読メモリ媒体。
(項99)
ネットワーク環境内で実行可能なコンピュータ実装方法であって、上記ネットワーク環境は、ネットワークインターフェース、プロセッサ、および上記プロセッサに動作可能に連結される非一過性メモリ媒体を備え、上記メモリ媒体は、上記プロセッサをプログラムするように構成される複数の命令を記憶するように構成され、
上記プロセッサによって、デジタルビットストリームを受信するステップと、
上記プロセッサによって、上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換するステップであって、上記エンコードされたデジタルビットストリームは、ゲートウェイパーティション、複合パーティション、データパーティション、およびそれらの任意の組み合わせのうちの少なくとも1つを備え、上記ゲートウェイパーティションは、信号完全性機能を提供し、上記複合パーティションに対する構成を識別し、上記ゲートウェイパーティションは、信号完全性を提供する第1のパートと、現在の複合パーティションの構成を識別する第2のパートとを含むマルチパートメッセージを提供する、ステップと、
伝送のために、上記プロセッサによって、上記エンコードされたデジタルビットストリームを上記ネットワークインターフェースに提供するステップと
を含む、方法。
(項100)
上記プロセッサによって、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項99に記載の方法。
(項101)
上記プロセッサによって、上記デジタルビットストリームに関してテーブルルックアップを行うステップを含む、項99または100に記載の方法。
(項102)
上記プロセッサによって、上記m−要素ベクトルテーブルを採用し、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するステップを含む、項99または100に記載の方法。
(項103)
上記プロセッサによって、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させるステップと、
上記プロセッサによって、業界標準非依存インターフェースを既存の情報システムに提供するステップと
を含む、項99または100に記載の方法。
(項104)
上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、上記プロセッサによって、データベクトルおよび上記複合チャネルをインタリーブするステップを含む、項99または100に記載の方法。
(項105)
上記プロセッサによって、複数の付加的ビットを生成するステップであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ステップと、
上記プロセッサによって、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加するステップと
を含む、項99または100に記載の方法。
(項106)
上記プロセッサによって、上記エンコードされたデジタルビットストリームを情報システムに提供するステップを含む、項99または100に記載の方法。
図1は、最適化されたコードテーブル信号伝達(OCTS)プロセスの一実施形態を図示する。OCTSプロセスは、変調器および送信機に提示される多値ベクトルへのバイナリ入力のエンコーディングを提供し、受信された多値ベクトルをバイナリ出力ベクトルにコンバートする逆プロセスを提供する。OCTSテーブルの賢明な選択によって、ビットエラーレート(BER)のパラメータ、実現されるデータスループット、ビットエネルギー、信号範囲、および信号完全性が、動的に管理され、最適化された性能および/または向上された信号完全性および通信を提供し得る。種々の側面では、これは、初期同期、テーブル管理、信号ドロップアウトの後の同期再取得、および基本OCTSプロセス定義外で管理されるべきネットワークへの進入のタスクを残す。OCTSは、2012年11月27日発行の米国特許第8,320,473号「DATA COMMUNICATION SYSTEM UTILIZING OPTIMIZED CODE TABLE SIGNALING」に説明され、参照することによって全体として本明細書に組み込まれる。OCTSの拡張は、2013年10月24日出願の米国特許出願第14/062,535号「OPTIMIZED DATA TRANSFER UTILIZING OPTIMIZED CODE TABLE SIGNALING」に説明され、参照することによって全体として本明細書に組み込まれる。
さらなる実施形態は、コードテーブル、ビット位置決め、テーブルパーティショニング、インタリーブ、またはそれらの組み合わせの選択肢のいずれかによって、OCTSの要素の変更を提供し、QOSの導出された定量的測定値に基づいて、所望のレベルのQOSを維持する。QOSの導出された測定値は、限定ではないが、サービス応答時間、損失、信号対雑音比、クロストーク、エコー、中断、周波数応答、ラウドネスレベル、要求されるビットレート、遅延、ジッタ、パケットドロップ確率および/またはビットエラーレート、データレートおよび遅延、動的に制御スケジューリング優先度、組込制御の検証、メッセージエコー、および当業者によって導出され得るQOSの任意の他の測定値を含んでもよい。
さらなる実施形態は、ユーザの認証をネットワークまたは別の具体的ユーザに提供し、送信機と受信機との間の通信に、より高いレベルの保証およびプライバシーを提供する。認証は、OCTSの要素内で提供されてもよく、内蔵ゲートウェイチャネルエンコードビットストリームの受信およびデコーディングによって実装されてもよい。本デコーディングは、ゲートウェイチャネル初期化パラメータを識別し、具体的OCTSテーブル、ゲートウェイチャネルメッセージフォーマットアルゴリズム、ゲートウェイチャネル双方向マップ、およびゲートウェイチャネルビットストリームと複合チャネルをインタリーブするためのインタリーブマップを含む、事前に配信された情報を要求する。ゲートウェイチャネルメッセージ−フォーマットアルゴリズムは、エンコードされたビットストリームの有効デコーディングが、検証機能導出値が有効であるときのみ認証されるように、検証機能(例えば、チェックサム、CRC等)とともに設計される。これは、送信機が有効であることの受信機における一方向認証を提供する。これらの技法の利用は、限定ではないが、前述のような技法を含んでもよく、当業者によって導出され得るものに拡張されてもよい。
図18は、最適化されたコードテーブル信号伝達(OCTS)プロセスの一実施形態を図示する。OCTSプロセスは、バイナリ入力のエンコーダおよびネットワークに提示される多値ベクトルへのエンコーディングを提供し、受信された多値ベクトルをバイナリ出力ベクトルにコンバートする逆プロセスを提供する。OCTSテーブルの賢明な選択によって、実現されるデータスループットおよび信号完全性のパラメータは、動的に管理され、最適化された性能および/または向上された信号完全性および通信を提供し得る。OCTSは、2012年11月27日発行の米国特許第8,320,473号「DATA COMMUNICATION SYSTEM UTILIZING OPTIMIZED CODE TABLE SIGNALING」に説明され、参照することによって全体として本明細書に組み込まれる。OCTSの拡張は、2013年10月24日出願の米国特許出願第14/062,535号「OPTIMIZED DATA TRANSFER UTILIZING OPTIMIZED CODE TABLE SIGNALING」に説明され、参照することによって全体として本明細書に組み込まれる。
図31は、OCTS拡張通信のためのシステムおよび方法の一実施形態において使用され得る、コンピューティングデバイス900の一実施形態を図示する。明確目的のために、コンピューティングデバイス900は、本明細書では、単一コンピューティングデバイスの文脈において図示および説明される。しかしながら、任意の数の好適に構成されるコンピューティングデバイスが、説明される実施形態のいずれかを実装するために使用されることができることを認識および理解されたい。例えば、少なくともいくつかの実装では、複数の通信可能にリンクされたコンピューティングデバイスが、使用される。これらのデバイスのうちの1つまたはそれを上回るものは、1つまたはそれを上回るネットワーク(LAN)、1つまたはそれを上回る広域ネットワーク(WAN)、ワイヤレス接続、またはそれらの任意の組み合わせ等を介して、任意の好適な方法で通信可能にリンクされることができる。
I.最適化されたコードテーブル信号伝達を利用した最適化されたデータ転送
1.コンピュータ実装方法であって、プロセッサによって、デジタルビットストリームを受信するステップと、プロセッサによって、デジタルビットストリームをエンコードされたデジタルビットストリームに変換するステップであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ステップと、プロセッサによって、伝送のために、エンコードされたデジタルビットストリームを伝送システムに提供するステップとを含む、方法。
2.デジタルビットストリームを変換するステップは、プロセッサによって、m−要素ベクトルテーブルをデジタルビットストリームに適用するステップを含む、付記1に記載のコンピュータ実装方法。
3.m−要素ベクトルテーブルをデジタルビットストリームに適用するステップは、プロセッサによって、デジタルビットストリームに関してテーブルルックアップを行うステップを含む、付記2に記載のコンピュータ実装方法。
4.m−要素ベクトルテーブルをデジタルビットストリームに適用するステップは、マッピング機能に従って、プロセッサによって、m−要素テーブルをデジタルビットストリームにマッピングするステップを含む、付記2に記載のコンピュータ実装方法。
5.プロセッサによって、m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するステップを含む、付記1に記載のコンピュータ実装方法。
6.プロセッサによって、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するステップを含む、付記1に記載のコンピュータ実装方法。
7.ゲートウェイチャネルおよびゲートウェイマスクを利用して、プロセッサによって、データベクトルおよび複合チャネルをインタリーブするステップを含む、付記1に記載のコンピュータ実装方法。
8.プロセッサによって、複数の付加的ビットを生成するステップであって、複数の付加的ビットは、エラー補正コードによって生成される、ステップと、プロセッサによって、複数の付加的ビットをエンコードされたデジタルビットストリームに追加するステップとを含む、付記1に記載のコンピュータ実装方法。
9.プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、m−要素ベクトルテーブルのための混合型パーティショニングを生成し、データ転送を最適化するステップを含む、付記1に記載のコンピュータ実装方法。
10.システムであって、通信インターフェースと、プロセッサと、プロセッサに動作可能に連結される、非一過性メモリ媒体であって、メモリ媒体は、デジタルビットストリームを受信することと、デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、伝送のために、エンコードされたデジタルビットストリームを通信インターフェースに提供することとを行うようにプロセッサをプログラムするように構成される複数の命令を記憶するように構成される、メモリ媒体とを備える、システム。
11.デジタルビットストリームを変換するステップは、m−要素ベクトルテーブルをデジタルビットストリームに適用するステップを含む、付記10に記載のシステム。
12.m−要素ベクトルテーブルをデジタルビットストリームに適用するステップは、デジタルビットストリームに関するテーブルルックアップを行うステップを含む、付記11に記載のシステム。
13.プロセッサはさらに、m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するように構成される、付記10に記載のシステム。
14.プロセッサはさらに、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するように構成される、付記10に記載のシステム。
15.プロセッサはさらに、ゲートウェイチャネルおよびゲートウェイマスクを利用して、データベクトルおよび複合チャネルをインタリーブするように構成される、付記10に記載のシステム。
16.プロセッサはさらに、複数の付加的ビットを生成することであって、複数の付加的ビットは、エラー補正コードによって生成される、ことと、複数の付加的ビットをエンコードされたデジタルビットストリームに追加することとを行うように構成される、付記10に記載のシステム。
17.通信インターフェースは、無線周波数(RF)通信システムを備える、付記10に記載のシステム。
18.非一過性コンピュータ可読メモリ媒体であって、プロセッサによってロードされると、プロセッサに、デジタルビットストリームを受信することと、デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、伝送のために、エンコードされたデジタルビットストリームを通信インターフェースに提供することとを行わせる命令をその上に記憶するように構成される、非一過性コンピュータ可読メモリ媒体。
19.デジタルビットストリームを変換するステップは、m−要素ベクトルテーブルをデジタルビットストリームに適用するステップを含む、付記18に記載の非一過性コンピュータ可読メモリ媒体。
20.m−要素ベクトルテーブルをデジタルビットストリームに適用するステップは、デジタルビットストリームに関するテーブルルックアップを行うステップを含む、付記19に記載の非一過性コンピュータ可読メモリ媒体。
21.その上に記憶された命令はさらに、プロセッサに、m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供させる、付記18に記載の非一過性コンピュータ可読メモリ媒体。
1.コンピュータ実装方法であって、プロセッサによって、デジタルビットストリームを受信するステップと、プロセッサによって、デジタルビットストリームをエンコードされたデジタルビットストリームに変換するステップであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ステップと、プロセッサによって、伝送のために、エンコードされたデジタルビットストリームを伝送システムに提供するステップと、事前協調かつ事前配信された情報を利用して、伝送を意図された送信機−受信機対に限定することによって、プロセッサによって、信号完全性を確立するステップであって、意図された送信機−受信機対は、事前協調かつ事前配信された情報を備える、ステップとを含む、方法。
2.事前協調かつ事前配信された情報を利用することによって、プロセッサによって、信号完全性を維持するステップを含む、付記1に記載のコンピュータ実装方法。
3.伝送に先立って、エンコードされるデジタルビットストリームを一意にフォーマットすることによって、プロセッサによって、伝送を意図された送信機および受信機に限定するステップを含む、付記1に記載のコンピュータ実装方法。
4.デジタルビットストリームを変換するステップは、プロセッサによって、m−要素ベクトルテーブルをデジタルビットストリームに適用するステップを含む、付記1に記載のコンピュータ実装方法。
5.m−要素ベクトルテーブルをデジタルビットストリームに適用するステップは、プロセッサによって、デジタルビットストリームに関してテーブルルックアップを行うステップを含む、付記4に記載のコンピュータ実装方法。
6.m−要素ベクトルテーブルをデジタルビットストリームに適用するステップは、マッピング機能に従って、プロセッサによって、m−要素テーブルをデジタルビットストリームにマッピングするステップを含む、付記4に記載のコンピュータ実装方法。
7.プロセッサによって、m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、向上された信号完全性および通信を提供するステップを含む、付記1に記載のコンピュータ実装方法。
8.プロセッサによって、1つまたはそれを上回るタスクを管理し、信号完全性および通信を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するステップを含む、付記1に記載のコンピュータ実装方法。
9.ゲートウェイチャネルおよびゲートウェイマスクを利用して、プロセッサによって、データベクトルおよび複合チャネルをインタリーブするステップを含む、付記1に記載のコンピュータ実装方法。
10.プロセッサによって、複数の付加的ビットを生成するステップであって、複数の付加的ビットは、エラー補正コードによって生成される、ステップと、プロセッサによって、複数の付加的ビットをエンコードされたデジタルビットストリームに追加するステップとを含む、付記1に記載のコンピュータ実装方法。
11.プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、m−要素ベクトルテーブルのための混合型パーティショニングを生成し、信号完全性および通信を向上させるステップを含む、付記1に記載のコンピュータ実装方法。
12.システムであって、通信インターフェースと、プロセッサと、プロセッサに動作可能に連結される、非一過性メモリ媒体であって、デジタルビットストリームを受信することと、デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、伝送のために、エンコードされたデジタルビットストリームを通信インターフェースに提供することと、事前協調かつ事前配信された情報を利用し、伝送を意図された送信機−受信機対に限定することによって、信号完全性を確立することであって、意図された送信機−受信機対は、事前協調かつ事前配信された情報を備える、こととを行うようにプロセッサをプログラムするように構成される複数の命令を記憶するように構成される、メモリ媒体とを備える、システム。
13.プロセッサはさらに、事前協調かつ事前配信された情報を利用することによって、信号完全性を維持するように構成される、付記12に記載のコンピュータ実装方法。
14.プロセッサはさらに、伝送に先立って、エンコードされるデジタルビットストリームを一意にフォーマットすることによって、伝送を意図された送信機および受信機に限定するように構成される、付記12に記載のコンピュータ実装方法。
15.デジタルビットストリームを変換するステップは、m−要素ベクトルテーブルをデジタルビットストリームに適用するステップを含む、付記12に記載のシステム。
16.プロセッサはさらに、m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、向上された信号完全性および通信を提供するように構成される、付記12に記載のシステム。
17.プロセッサはさらに、1つまたはそれを上回るタスクを管理し、信号完全性および通信を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するように構成される、付記12に記載のシステム。
18.プロセッサはさらに、複数の付加的ビットを生成することであって、複数の付加的ビットは、エラー補正コードによって生成される、ことと、複数の付加的ビットをエンコードされたデジタルビットストリームに追加することとを行うように構成される、付記12に記載のシステム。
19.通信インターフェースは、結合された通信システムを備える、付記12に記載のシステム。
20.通信インターフェースは、非結合通信システムを備える、付記12に記載のシステム。
21.非一過性コンピュータ可読メモリ媒体であって、プロセッサによってロードされると、プロセッサに、デジタルビットストリームを受信することと、デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、伝送のために、エンコードされたデジタルビットストリームを通信インターフェースに提供することと、事前協調かつ事前配信された情報を利用し、伝送を意図された送信機−受信機対に限定することによって、信号完全性を確立することであって、意図された送信機−受信機対は、事前協調かつ事前配信された情報を備える、ことと、事前協調かつ事前配信された情報を利用することによって、信号完全性を維持することと、伝送に先立って、エンコードされるデジタルビットストリームを一意にフォーマットすることによって、伝送を意図された送信機および受信機に限定させる命令をその上に記憶することとを行うように構成される、非一過性コンピュータ可読メモリ媒体。
1.コンピュータ実装方法であって、プロセッサによって、デジタルビットストリームを受信するステップと、プロセッサによって、デジタルビットストリームをエンコードされたデジタルビットストリームに変換するステップであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ステップと、プロセッサによって、伝送のために、エンコードされたデジタルビットストリームを伝送システムに提供するステップと、プロセッサによって、導出されたQOS測定値の使用を通して、QOSの動的制御を可能にし、伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすステップであって、意図された送信機−受信機対は、通信のために必要なQOSを伴うデジタルビットの継続伝送および受信をもたらすように情報を一意に協調かつ配信可能である、ステップとを含む、方法。
2.プロセッサによって、導出されたQOS測定値の使用を通して、QOSの動的制御を維持し、協調された変更を事前協調かつ事前配信された情報にもたらすステップを含む、付記1に記載のコンピュータ実装方法。
3.導出されたQOS測定値の使用を通して、QOSの動的制御、プロセッサによって、伝送に先立って、エンコードされたデジタルビットストリームへの変更を一意に協調することによって、伝送を意図された送信機および受信機に限定するステップを含む、付記1に記載のコンピュータ実装方法。
4.デジタルビットストリームを変換するステップは、プロセッサによって、デジタルビットストリームに適用されるべきm−要素ベクトルテーブルを変更するステップを含む、付記1に記載のコンピュータ実装方法。
5.m−要素ベクトルテーブルを変更し、デジタルビットストリームに適用するステップは、プロセッサによって、デジタルビットストリームに関してテーブルルックアップを行うステップを含む、付記4に記載のコンピュータ実装方法。
6.m−要素ベクトルテーブルを変更し、デジタルビットストリームに適用するステップは、マッピング機能に従って、プロセッサによって、m−要素テーブルをデジタルビットストリームにマッピングするステップを含む、付記4に記載のコンピュータ実装方法。
7.プロセッサによって、m−要素ベクトルテーブルへの変更を採用し、サービス応答時間、損失、信号対雑音比、クロストーク、エコー、中断、周波数応答、ラウドネスレベル、要求されるビットレート、遅延、ジッタ、パケットドロップ確率および/またはビットエラーレート、データレート、および遅延のうちの少なくとも1つを管理し、導出されたQOS測定値の使用を通したQOSの動的制御に対して、スケジューリング優先度、当業者に公知の他のQOS測定値、およびそれらの任意の組み合わせを動的に制御するステップを含む、付記1に記載のコンピュータ実装方法。
8.プロセッサによって、1つまたはそれを上回るタスクを管理し、導出されたQOS測定値の使用を通して、QOSを動的に向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するステップを含む、付記1に記載のコンピュータ実装方法。
9.ゲートウェイチャネルおよびゲートウェイマスクを利用して、プロセッサによって、データベクトルおよび複合チャネルをインタリーブするステップに対する動的変更を含む、付記1に記載のコンピュータ実装方法。
10.プロセッサによって、複数の付加的ビットを生成するステップであって、複数の付加的ビットは、QOSの導出された測定値を評価することによって生成される、ステップと、プロセッサによって、複数の付加的ビットをエンコードされたデジタルビットストリームに追加するステップと、必要に応じて、プロセッサによって、付加的ビットを変更し、エンコードされたデジタルビットストリームのための所望のQOSを維持するステップとを含む、付記1に記載のコンピュータ実装方法。
11.プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、導出されたQOS測定値の使用を通したQOSの動的制御に対して、m−要素ベクトルテーブルのための混合型パーティショニングを生成するステップを含む、付記1に記載のコンピュータ実装方法。
12.システムであって、通信インターフェースと、プロセッサと、プロセッサに動作可能に連結される、非一過性メモリ媒体であって、メモリ媒体は、デジタルビットストリームを受信することと、デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、伝送のために、エンコードされたデジタルビットストリームを通信インターフェースに提供することと、プロセッサによって、導出されたQOS測定値の使用を通して、QOSの動的制御を可能にし、伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすことであって、意図された送信機−受信機対は、通信のために必要なQOSを伴うデジタルビットの継続伝送および受信をもたらすように情報を一意に協調かつ配信可能である、こととを行うようにプロセッサをプログラムするように構成される複数の命令を記憶するように構成される、メモリ媒体とを備える、システム。
13.プロセッサはさらに、導出されたQOS測定値の使用を通したQOSの動的制御に対して、伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすように構成される、付記12に記載のシステム。
14.プロセッサはさらに、伝送に先立って、エンコードされるデジタルビットストリームを一意にフォーマットすることによって、協調された変更の通信を意図された送信機および受信機に限定するように構成される、付記12に記載のシステム。
15.デジタルビットストリームを変換するステップは、変更をデジタルビットストリームに適用されるべきm−要素ベクトルテーブルに通信するステップを含む、付記12に記載のシステム。
16.プロセッサはさらに、m−要素ベクトルテーブルを採用し、サービス応答時間、損失、信号対雑音比、クロストーク、エコー、中断、周波数応答、ラウドネスレベル、要求されるビットレート、遅延、ジッタ、パケットドロップ確率および/またはビットエラーレート、データレート、および遅延のうちの少なくとも1つを管理し、導出されたQOS測定値の使用を通したQOSの動的制御に対して、スケジューリング優先度、当業者に公知の他のQOS測定値、およびそれらの任意の組み合わせを動的に制御するように構成される、付記12に記載のシステム。
17.プロセッサはさらに、1つまたはそれを上回るタスクを管理し、導出されたQOS測定値の使用を通して、QOSを動的に向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するように構成される、付記12に記載のシステム。
18.プロセッサはさらに、複数の付加的ビットを生成することであって、複数の付加的ビットは、QOSの導出された測定値を評価することによって生成される、ことと、複数の付加的ビットをエンコードされたデジタルビットストリームに追加することと、必要に応じて、付加的ビットを変更し、エンコードされたデジタルビットストリームのための所望のQOSを維持することとを行うように構成される、付記12に記載のシステム。
19.通信インターフェースは、結合された通信システムを備える、付記12に記載のシステム。
20.通信インターフェースは、非結合通信システムを備える、付記12に記載のシステム。
21.非一過性コンピュータ可読メモリ媒体であって、プロセッサによってロードされると、プロセッサに、デジタルビットストリームを受信することと、デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、伝送のために、エンコードされたデジタルビットストリームを通信インターフェースに提供することと、事前協調かつ事前配信された情報を利用し、伝送を意図された送信機−受信機対に限定することによって、QOSを確立することであって、意図された送信機−受信機対は、事前協調かつ事前配信された情報を備える、ことと、協調かつ配信された情報を変更および通信することによって、導出されたQOS測定値の使用を通して、QOSの動的制御を維持することと、伝送に先立って、エンコードされたデジタルビットストリームへの変更を一意に協調することによって、伝送を意図された送信機および受信機に限定することとを行わせる命令をその上に記憶するように構成される、非一過性コンピュータ可読メモリ媒体。
1.コンピュータ実装方法であって、プロセッサによって、デジタルビットストリームを受信するステップと、プロセッサによって、デジタルビットストリームをエンコードされたデジタルビットストリームに変換するステップであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ステップと、プロセッサによって、伝送のために、エンコードされたデジタルビットストリームを伝送システムに提供するステップと、伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報の使用を通して、プロセッサによって、認証を可能にするステップであって、意図された送信機−受信機対は、通信のためにデジタルビットの継続伝送および受信をもたらすように、情報を一意に協調かつ配信可能である、ステップとを含む、方法。
2.協調された変更を事前協調かつ事前配信された情報にもたらすことによって、プロセッサによって、認証を維持するステップを含む、付記1に記載のコンピュータ実装方法。
3.プロセッサによる、事前協調かつ事前配信された情報の使用を通した認証、すなわち、伝送に先立って、エンコードされたデジタルビットストリームへの変更を一意に協調することによって、伝送を意図された送信機および受信機に限定する、付記1に記載のコンピュータ実装方法。
4.デジタルビットストリームを変換するステップは、プロセッサによって、デジタルビットストリームに適用されるべきm−要素ベクトルテーブルを変更するステップを含む、付記1に記載のコンピュータ実装方法。
5.m−要素ベクトルテーブルを変更し、デジタルビットストリームに適用するステップは、プロセッサによって、デジタルビットストリームに関してテーブルルックアップを行うステップを含む、付記4に記載のコンピュータ実装方法。
6.m−要素ベクトルテーブルを変更し、デジタルビットストリームに適用するステップは、マッピング機能に従って、プロセッサによって、m−要素テーブルをデジタルビットストリームにマッピングするステップを含む、付記4に記載のコンピュータ実装方法。
7.伝送に先立って、エンコードされたデジタルビットストリームへの変更を一意に協調することによって、プロセッサによって、意図された送信機および受信機への伝送、すなわち、送信機−受信機対の認証を含む、付記1に記載のコンピュータ実装方法。
8.プロセッサによって、1つまたはそれを上回るタスクを管理し、伝送に先立って、エンコードされたデジタルビットストリームへの変更を一意に協調することによって、送信機−受信機対を認証するステップを含む、付記1に記載のコンピュータ実装方法。
9.ゲートウェイチャネルおよびゲートウェイマスクを利用して、プロセッサによって、データベクトルおよび複合チャネルをインタリーブするステップに対する動的変更を含む、付記1に記載のコンピュータ実装方法。
10.プロセッサによって、複数の付加的ビットを生成するステップであって、複数の付加的ビットは、送信機−受信機対の認証を向上および継続するように生成される、ステップと、プロセッサによって、複数の付加的ビットをエンコードされたデジタルビットストリームに追加するステップと、必要に応じて、プロセッサによって、付加的ビットを変更し、送信機−受信機対の所望の認証を維持するステップとを含む、付記1に記載のコンピュータ実装方法。
11.プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、m−要素ベクトルテーブルのための混合型パーティショニングを生成し、送信機-受信機対を認証するステップを含む、付記1に記載のコンピュータ実装方法。
12.システムであって、通信インターフェースと、プロセッサと、プロセッサに動作可能に連結される、非一過性メモリ媒体であって、メモリ媒体は、デジタルビットストリームを受信することと、デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、伝送のために、エンコードされたデジタルビットストリームを通信インターフェースに提供することと、伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報の使用を通して、認証を可能にすることであって、意図された送信機−受信機対は、通信のためにデジタルビットの継続伝送および受信をもたらすように、情報を一意に協調かつ配信可能であるようにプロセッサをプログラムすることとを行わせるように構成される複数の命令を記憶するように構成される、メモリ媒体とを備える、システム。
13.プロセッサはさらに、送信機−受信機対を認証し、伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすように構成される、付記12に記載のシステム。
14.プロセッサはさらに、伝送に先立って、エンコードされるデジタルビットストリームを一意にフォーマットすることによって、協調された変更の通信を意図された送信機および受信機に限定するように構成される、付記12に記載のシステム。
15.デジタルビットストリームを変換するステップは、変更をデジタルビットストリームに適用されるべきm−要素ベクトルテーブルに通信するステップを含む、付記12に記載のシステム。
16.プロセッサはさらに、m−要素ベクトルテーブルを採用し、伝送に先立って、エンコードされたデジタルビットストリームへの変更を一意に協調することによって、プロセッサによって、意図された送信機および受信機への伝送、すなわち、送信機−受信機対の認証を管理するように構成される、付記12に記載のシステム。
17.プロセッサはさらに、プロセッサによって、1つまたはそれを上回るタスクを管理し、伝送に先立って、エンコードされたデジタルビットストリームへの変更を一意に協調することによって、送信機−受信機対を認証するように構成される、付記12に記載のシステム。
18.プロセッサはさらに、複数の付加的ビットを生成することであって、複数の付加的ビットは、送信機−受信機対を認証するように生成される、ことと、複数の付加的ビットをエンコードされたデジタルビットストリームに追加することと、必要に応じて、付加的ビットを変更し、送信機−受信機対の認証を維持することとを行うように構成される、付記12に記載のシステム。
19.通信インターフェースは、結合された通信システムを備える、付記12に記載のシステム。
20.通信インターフェースは、非結合通信システムを備える、付記12に記載のシステム。
21.非一過性コンピュータ可読メモリ媒体であって、プロセッサによってロードされると、プロセッサに、デジタルビットストリームを受信することと、デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、伝送のために、エンコードされたデジタルビットストリームを通信インターフェースに提供することと、事前協調かつ事前配信された情報を利用し、伝送を意図された送信機−受信機対に限定することによって、送信機-受信機対の認証を確立することであって、意図された送信機−受信機対は、事前協調かつ事前配信された情報を備える、ことと、協調かつ配信された情報を変更および通信することによって、送信機−受信機対の認証の動的制御を維持することと、伝送に先立って、エンコードされたデジタルビットストリームへの変更を一意に協調することによって、伝送を意図された送信機および受信機に限定することとを行わせる命令をその上に記憶するように構成される、非一過性コンピュータ可読メモリ媒体。
1.システムであって、ネットワークインターフェースと、プロセッサと、プロセッサに動作可能に連結される、非一過性メモリ媒体であって、メモリ媒体は、デジタルビットストリームを受信することと、デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、伝送のために、エンコードされたデジタルビットストリームをネットワークインターフェースに提供することとを行うようにプロセッサをプログラムするように構成される複数の命令を記憶するように構成される、メモリ媒体とを備える、システム。
2.プロセッサは、m−要素ベクトルテーブルをデジタルビットストリームに適用するように構成される、付記1に記載のシステム。
3.プロセッサは、デジタルビットストリームに関するテーブルルックアップを行うように構成される、付記2に記載のシステム。
4.プロセッサはさらに、m−要素ベクトルテーブルを採用し、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するように構成される、付記1に記載のシステム。
5.プロセッサはさらに、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させ、業界標準非依存インターフェースを既存の情報システムに提供するように構成される、付記1に記載のシステム。
6.プロセッサはさらに、ゲートウェイチャネルおよびゲートウェイマスクを利用して、データベクトルおよび複合チャネルをインタリーブするように構成される、付記1に記載のシステム。
7.プロセッサはさらに、複数の付加的ビットを生成することであって、複数の付加的ビットは、エラー補正コードによって生成される、ことと、複数の付加的ビットをエンコードされたデジタルビットストリームに追加することとを行うように構成される、付記1に記載のシステム。
8.ネットワークインターフェースは、情報システムを備える、付記1に記載のシステム。
9.情報システムは、結合された情報システムである、付記8に記載のシステム。
10.情報システムは、非結合情報システムである、付記8に記載のシステム。
11.非一過性コンピュータ可読メモリ媒体であって、プロセッサによってロードされると、プロセッサに、デジタルビットストリームを受信することと、デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、伝送のために、エンコードされたデジタルビットストリームをネットワークインターフェースに提供することとを行わせるさせる命令をその上に記憶するように構成される、非一過性コンピュータ可読メモリ媒体。
12.その上に記憶された命令はさらに、プロセッサに、m−要素ベクトルテーブルをデジタルビットストリームに適用させる、付記11に記載の非一過性コンピュータ可読メモリ媒体。
13.その上に記憶された命令はさらに、プロセッサに、デジタルビットストリームに関するテーブルルックアップを行わせる、付記12に記載の非一過性コンピュータ可読メモリ媒体。
14.その上に記憶された命令はさらに、プロセッサに、m−要素ベクトルテーブルを採用し、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供させる、付記12に記載の非一過性コンピュータ可読メモリ媒体。
15.ネットワーク環境内で実行可能なコンピュータ実装方法であって、ネットワーク環境は、ネットワークインターフェース、プロセッサ、およびプロセッサに動作可能に連結される非一過性メモリ媒体を備え、メモリ媒体は、プロセッサをプログラムするように構成される複数の命令を記憶するように構成され、方法は、プロセッサによって、デジタルビットストリームを受信するステップと、プロセッサによって、デジタルビットストリームをエンコードされたデジタルビットストリームに変換するステップであって、エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ステップと、伝送のために、プロセッサによって、エンコードされたデジタルビットストリームをネットワークインターフェースに提供するステップとを含む、方法。
16.プロセッサによって、m−要素ベクトルテーブルをデジタルビットストリームに適用するステップを含む、付記15に記載のコンピュータ実装方法。
17.プロセッサによって、デジタルビットストリームに関してテーブルルックアップを行うステップを含む、付記16に記載のコンピュータ実装方法。
18.プロセッサによって、m−要素ベクトルテーブルを採用し、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するステップを含む、付記15に記載のコンピュータ実装方法。
19.プロセッサによって、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させるステップと、およびプロセッサによって、業界標準非依存インターフェースを既存の情報システムに提供するステップとを含む、付記15に記載のコンピュータ実装方法。
20.ゲートウェイチャネルおよびゲートウェイマスクを利用して、プロセッサによって、データベクトルおよび複合チャネルをインタリーブするステップを含む、付記15に記載のコンピュータ実装方法。
21.プロセッサによって、複数の付加的ビットを生成するステップであって、複数の付加的ビットは、エラー補正コードによって生成される、ステップと、プロセッサによって、複数の付加的ビットをエンコードされたデジタルビットストリームに追加するステップとを含む、付記15に記載のコンピュータ実装方法。
22.プロセッサによって、エンコードされたデジタルビットストリームを情報システムに提供するステップを含む、付記15に記載のコンピュータ実装方法。
(項目1)
コンピュータ実装方法であって、
プロセッサによって、デジタルビットストリームを受信するステップと、
上記プロセッサによって、上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換するステップであって、上記エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ステップと、
上記プロセッサによって、伝送のために、上記エンコードされたデジタルビットストリームを伝送システムに提供するステップと
を含む、方法。
(項目2)
上記デジタルビットストリームを変換するステップは、上記プロセッサによって、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項目1に記載のコンピュータ実装方法。
(項目3)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、上記プロセッサによって、上記デジタルビットストリームに関してテーブルルックアップを行うステップを含む、項目2に記載のコンピュータ実装方法。
(項目4)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、マッピング機能に従って、上記プロセッサによって、上記m−要素テーブルを上記デジタルビットストリームにマッピングするステップを含む、項目2または3に記載のコンピュータ実装方法。
(項目5)
上記プロセッサによって、上記m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するステップを含む、項目1から3のいずれかに記載のコンピュータ実装方法。
(項目6)
上記プロセッサによって、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するステップを含む、項目1から3のいずれかに記載のコンピュータ実装方法。
(項目7)
上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、上記プロセッサによって、データベクトルおよび上記複合チャネルをインタリーブするステップを含む、項目1から3のいずれかに記載のコンピュータ実装方法。
(項目8)
上記プロセッサによって、複数の付加的ビットを生成するステップであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ステップと、上記プロセッサによって、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加するステップとを含む、項目1から3のいずれかに記載のコンピュータ実装方法。
(項目9)
上記プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、上記m−要素ベクトルテーブルのための混合型パーティショニングを生成し、データ転送を最適化するステップを含む、項目1から3のいずれかに記載のコンピュータ実装方法。
(項目10)
システムであって、
通信インターフェースと、
プロセッサと、
上記プロセッサに動作可能に連結される、非一過性メモリ媒体であって、
デジタルビットストリームを受信することと、
上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、上記エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、
伝送のために、上記エンコードされたデジタルビットストリームを上記通信インターフェースに提供することと
を行うように、上記プロセッサをプログラムするように構成される複数の命令を記憶するように構成される、メモリ媒体と
を備える、システム。
(項目11)
上記デジタルビットストリームを変換するステップは、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項目10に記載のシステム。
(項目12)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、上記デジタルビットストリームに関するテーブルルックアップを行うステップを含む、項目11に記載のシステム。
(項目13)
上記プロセッサはさらに、上記m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するように構成される、項目10または11に記載のシステム。
(項目14)
上記プロセッサはさらに、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するように構成される、項目10から12のいずれかに記載のシステム。
(項目15)
上記プロセッサはさらに、上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、データベクトルおよび上記複合チャネルをインタリーブするように構成される、項目10から12のいずれかに記載のシステム。
(項目16)
上記プロセッサはさらに、複数の付加的ビットを生成することであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ことと、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加することとを行うように構成される、項目10から12のいずれかに記載のシステム。
(項目17)
上記通信インターフェースは、無線周波数(RF)通信システムを備える、項目10から12のいずれかに記載のシステム。
(項目18)
非一過性コンピュータ可読メモリ媒体であって、プロセッサによってロードされると、上記プロセッサに、
デジタルビットストリームを受信することと、
上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、上記エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、
伝送のために、上記エンコードされたデジタルビットストリームを上記通信インターフェースに提供することと
を行わせる命令をその上に記憶するように構成される、非一過性コンピュータ可読メモリ媒体。
(項目19)
上記デジタルビットストリームを変換するステップは、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項目18に記載の非一過性コンピュータ可読メモリ媒体。
(項目20)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、上記デジタルビットストリームに関するテーブルルックアップを行うステップを含む、項目19に記載の非一過性コンピュータ可読メモリ媒体。
(項目21)
上記その上に記憶された命令はさらに、上記プロセッサに、上記m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供させる、項目19から20のいずれかに記載の非一過性コンピュータ可読メモリ媒体。
(項目22)
事前協調かつ事前配信された情報を利用して、上記伝送を意図された送信機−受信機対に限定することによって、上記プロセッサによって、信号完全性を確立するステップをさらに含み、上記意図された送信機−受信機対は、上記事前協調かつ事前配信された情報を備える、項目1に記載のコンピュータ実装方法。
(項目23)
上記事前協調かつ事前配信された情報を利用することによって、上記プロセッサによって、上記信号完全性を維持するステップを含む、項目22に記載のコンピュータ実装方法。
(項目24)
伝送に先立って、上記エンコードされるデジタルビットストリームを一意にフォーマットすることによって、上記プロセッサによって、上記伝送を上記意図された送信機および受信機に限定するステップを含む、項目22または23に記載のコンピュータ実装方法。
(項目25)
上記デジタルビットストリームを変換するステップは、上記プロセッサによって、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項目22または23に記載のコンピュータ実装方法。
(項目26)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、上記プロセッサによって、上記デジタルビットストリームに関してテーブルルックアップを行うステップを含む、項目25に記載のコンピュータ実装方法。
(項目27)
上記m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップは、マッピング機能に従って、上記プロセッサによって、上記m−要素テーブルを上記デジタルビットストリームにマッピングするステップを含む、項目25に記載のコンピュータ実装方法。
(項目28)
上記プロセッサによって、上記m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、向上された信号完全性および通信を提供するステップを含む、項目22または23に記載のコンピュータ実装方法。
(項目29)
上記プロセッサによって、1つまたはそれを上回るタスクを管理し、信号完全性および通信を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するステップを含む、項目22または23に記載のコンピュータ実装方法。
(項目30)
上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、上記プロセッサによって、データベクトルおよび上記複合チャネルをインタリーブするステップを含む、項目22または23に記載のコンピュータ実装方法。
(項目31)
上記プロセッサによって、複数の付加的ビットを生成するステップであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ステップと、
上記プロセッサによって、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加するステップと
を含む、項目22または23に記載のコンピュータ実装方法。
(項目32)
上記プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、上記m−要素ベクトルテーブルのための混合型パーティショニングを生成し、信号完全性および通信を向上させるステップを含む、項目22または23に記載のコンピュータ実装方法。
(項目33)
上記プロセッサはさらに、事前協調かつ事前配信された情報を利用し、上記伝送を意図された送信機−受信機対に限定することによって、信号完全性を確立するように構成され、上記意図された送信機−受信機対は、上記事前協調かつ事前配信された情報を備える、項目10に記載のシステム。
(項目34)
上記プロセッサはさらに、上記事前協調かつ事前配信された情報を利用することによって、上記信号完全性を維持するように構成される、項目33に記載のコンピュータ実装方法。
(項目35)
上記プロセッサはさらに、伝送に先立って、上記エンコードされるデジタルビットストリームを一意にフォーマットすることによって、上記伝送を上記意図された送信機および受信機に限定するように構成される、項目33または34に記載のコンピュータ実装方法。
(項目36)
上記デジタルビットストリームを変換するステップは、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項目33または34に記載のシステム。
(項目37)
上記プロセッサはさらに、上記m−要素ベクトルテーブルを採用し、ビットエラーレート(BER)、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、向上された信号完全性および通信を提供するように構成される、項目33または34に記載のシステム。
(項目38)
上記プロセッサはさらに、1つまたはそれを上回るタスクを管理し、信号完全性および通信を向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するように構成される、項目33または34に記載のシステム。
(項目39)
上記プロセッサはさらに、複数の付加的ビットを生成することであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ことと、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加することとを行うように構成される、項目33または34に記載のシステム。
(項目40)
上記通信インターフェースは、結合された通信システムを備える、項目33または34に記載のシステム。
(項目41)
上記通信インターフェースは、非結合通信システムを備える、項目33または34に記載のシステム。
(項目42)
上記プロセッサに、
事前協調かつ事前配信された情報を利用し、上記伝送を意図された送信機−受信機対に限定することによって、信号完全性を確立することであって、上記意図された送信機−受信機対は、上記事前協調かつ事前配信された情報を備える、ことと、
上記事前協調かつ事前配信された情報を利用することによって、上記信号完全性を維持することと、
伝送に先立って、上記エンコードされるデジタルビットストリームを一意にフォーマットすることによって、上記伝送を上記意図された送信機および受信機に限定することと
を行わせる命令をその上に記憶するようにさらに構成される、項目18に記載の非一過性コンピュータ可読メモリ媒体、。
(項目43)
導出されたQOS測定値の使用を通して、上記プロセッサによって、サービスの質(QOS)の動的制御を可能にし、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすステップをさらに含み、上記意図された送信機−受信機対は、通信のために必要なQOSを伴うデジタルビットの継続伝送および受信をもたらすように情報を一意に協調かつ配信可能である、項目1に記載のコンピュータ実装方法。
(項目44)
上記プロセッサによって、導出されたQOS測定値の使用を通して、QOSの動的制御を維持し、協調された変更を事前協調かつ事前配信された情報にもたらすステップを含む、項目43に記載のコンピュータ実装方法。
(項目45)
伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記プロセッサによって、上記伝送を上記意図された送信機および受信機に限定する、導出されたQOS測定値の使用を通したQOSの動的制御を含む、項目43または44に記載のコンピュータ実装方法。
(項目46)
上記デジタルビットストリームを変換するステップは、上記プロセッサによって、上記デジタルビットストリームに適用されるべきm−要素ベクトルテーブルを変更するステップを含む、項目43または44に記載のコンピュータ実装方法。
(項目47)
上記m−要素ベクトルテーブルを変更し、上記デジタルビットストリームに適用するステップは、上記プロセッサによって、上記デジタルビットストリームに関してテーブルルックアップを行うステップを含む、項目46に記載のコンピュータ実装方法。
(項目48)
上記m−要素ベクトルテーブルを変更し、上記デジタルビットストリームに適用するステップは、マッピング機能に従って、上記プロセッサによって、上記m−要素テーブルを上記デジタルビットストリームにマッピングするステップを含む、項目46に記載のコンピュータ実装方法。
(項目49)
上記プロセッサによって、上記m−要素ベクトルテーブルへの変更を採用し、サービス応答時間、損失、信号対雑音比、クロストーク、エコー、中断、周波数応答、ラウドネスレベル、要求されるビットレート、遅延、ジッタ、パケットドロップ確率および/またはビットエラーレート、データレート、および遅延のうちの少なくとも1つを管理し、導出されたQOS測定値の使用を通したQOSの動的制御に対して、スケジューリング優先度、当業者に公知の他のQOS測定値、およびそれらの任意の組み合わせを動的に制御するステップを含む、項目43または44に記載のコンピュータ実装方法。
(項目50)
上記プロセッサによって、1つまたはそれを上回るタスクを管理し、導出されたQOS測定値の使用を通して、QOSを動的に向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するステップを含む、項目43または44に記載のコンピュータ実装方法。
(項目51)
上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、上記プロセッサによって、データベクトルおよび上記複合チャネルをインタリーブするステップに対する動的変更を含む、項目43または44に記載のコンピュータ実装方法。
(項目52)
上記プロセッサによって、複数の付加的ビットを生成するステップであって、上記複数の付加的ビットは、QOSの導出された測定値を評価することによって生成される、ステップと、上記プロセッサによって、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加するステップと、必要に応じて、上記プロセッサによって、上記付加的ビットを変更し、上記エンコードされたデジタルビットストリームのための所望のQOSを維持するステップとを含む、項目43または44に記載のコンピュータ実装方法。
(項目53)
上記プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、導出されたQOS測定値の使用を通したQOSの動的制御に対して、上記m−要素ベクトルテーブルのための混合型パーティショニングを生成するステップを含む、項目43または44に記載のコンピュータ実装方法。
(項目54)
上記プロセッサはさらに、導出されたQOS測定値の使用を通して、サービスの質(QOS)の動的制御を可能にし、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすように構成され、上記意図された送信機−受信機対は、通信のために必要なQOSを伴うデジタルビットの継続伝送および受信をもたらすように情報を一意に協調かつ配信可能である、項目10に記載のシステム。
(項目55)
上記プロセッサはさらに、導出されたQOS測定値の使用を通したQOSの動的制御に対して、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすように構成される、項目54に記載のシステム。
(項目56)
上記プロセッサはさらに、伝送に先立って、上記エンコードされるデジタルビットストリームを一意にフォーマットすることによって、上記協調された変更の通信を上記意図された送信機および受信機に限定するように構成される、項目54または55に記載のシステム。
(項目57)
上記デジタルビットストリームを変換するステップは、変更を上記デジタルビットストリームに適用されるべきm−要素ベクトルテーブルに通信するステップを含む、項目54または55に記載のシステム。
(項目58)
上記プロセッサはさらに、上記m−要素ベクトルテーブルを採用し、サービス応答時間、損失、信号対雑音比、クロストーク、エコー、中断、周波数応答、ラウドネスレベル、要求されるビットレート、遅延、ジッタ、パケットドロップ確率および/またはビットエラーレート、データレート、および遅延のうちの少なくとも1つを管理し、導出されたQOS測定値の使用を通したQOSの動的制御に対して、スケジューリング優先度、当業者に公知の他のQOS測定値、およびそれらの任意の組み合わせを動的に制御するように構成される、項目54または55に記載のシステム。
(項目59)
上記プロセッサはさらに、1つまたはそれを上回るタスクを管理し、導出されたQOS測定値の使用を通して、QOSを動的に向上させ、業界標準非依存インターフェースを既存のデジタル通信システムに提供するように構成される、項目54または55に記載のシステム。
(項目60)
上記プロセッサはさらに、
複数の付加的ビットを生成することであって、上記複数の付加的ビットは、QOSの導出された測定値を評価することによって生成される、ことと、
上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加することと、
必要に応じて、上記付加的ビットを変更し、上記エンコードされたデジタルビットストリームのための所望のQOSを維持することと
を行うように構成される、項目54または55に記載のシステム。
(項目61)
上記通信インターフェースは、結合された通信システムを備える、項目54または55に記載のシステム。
(項目62)
上記通信インターフェースは、非結合通信システムを備える、項目54または55に記載のシステム。
(項目63)
上記プロセッサに、
事前協調かつ事前配信された情報を利用し、上記伝送を意図された送信機−受信機対に限定することによって、サービスの質(QOS)を確立することであって、上記意図された送信機−受信機対は、上記事前協調かつ事前配信された情報を備える、ことと、
協調かつ配信された情報を変更および通信することによって、導出されたQOS測定値の使用を通して、QOSの動的制御を維持することと、
伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記伝送を上記意図された送信機および受信機に限定することと
を行わせる命令をその上に記憶するようにさらに構成される、項目18に記載の非一過性コンピュータ可読メモリ媒体。
(項目64)
上記プロセッサによって、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報の使用を通して、認証を可能にするステップをさらに含み、上記意図された送信機−受信機対は、通信のためにデジタルビットの継続伝送および受信をもたらすように、情報を一意に協調かつ配信可能である、項目1に記載のコンピュータ実装方法。
(項目65)
協調された変更を事前協調かつ事前配信された情報にもたらすことによって、上記プロセッサによって、認証を維持するステップを含む、項目64に記載のコンピュータ実装方法。
(項目66)
上記プロセッサによって、上記事前協調かつ事前配信された情報の使用を通して、認証を可能にするステップは、伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記伝送を上記意図された送信機および受信機に限定するステップを含む、項目64または65に記載のコンピュータ実装方法。
(項目67)
上記デジタルビットストリームを変換するステップは、上記プロセッサによって、上記デジタルビットストリームに適用されるべきm−要素ベクトルテーブルを変更するステップを含む、項目64または65に記載のコンピュータ実装方法。
(項目68)
上記m−要素ベクトルテーブルを変更し、上記デジタルビットストリームに適用するステップは、上記プロセッサによって、上記デジタルビットストリームに関してテーブルルックアップを行うステップを含む、項目67に記載のコンピュータ実装方法。
(項目69)
上記m−要素ベクトルテーブルを変更し、上記デジタルビットストリームに適用するステップは、マッピング機能に従って、上記プロセッサによって、上記m−要素テーブルを上記デジタルビットストリームにマッピングするステップを含む、項目67に記載のコンピュータ実装方法。
(項目70)
伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記プロセッサによって、上記意図された送信機および受信機への伝送、すなわち、上記送信機−受信機対の認証を含む、項目64または65に記載のコンピュータ実装方法。
(項目71)
上記プロセッサによって、1つまたはそれを上回るタスクを管理し、伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記送信機−受信機対を認証するステップを含む、項目64または65に記載のコンピュータ実装方法。
(項目72)
上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、上記プロセッサによって、データベクトルおよび上記複合チャネルをインタリーブするステップに対する動的変更を含む、項目64または65に記載のコンピュータ実装方法。
(項目73)
上記プロセッサによって、複数の付加的ビットを生成するステップであって、上記複数の付加的ビットは、上記送信機−受信機対の認証を向上および継続するように生成される、ステップと、
上記プロセッサによって、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加するステップと、
必要に応じて、上記プロセッサによって、上記付加的ビットを変更し、上記送信機−受信機対の所望の認証を維持するステップと
を含む、項目64または65に記載のコンピュータ実装方法。
(項目74)
上記プロセッサによって、ビット位置パーティショニング、テーブルパーティショニング、またはそれらの組み合わせのうちの少なくとも1つを実装し、上記m−要素ベクトルテーブルのための混合型パーティショニングを生成し、上記送信機−受信機対を認証するステップを含む、項目64または65に記載のコンピュータ実装方法。
(項目75)
上記プロセッサはさらに、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報の使用を通して、認証を可能にするように構成され、上記意図された送信機−受信機対は、通信のためにデジタルビットの継続伝送および受信をもたらすように、情報を一意に協調かつ配信可能である、項目10に記載のシステム。
(項目76)
上記プロセッサはさらに、上記送信機−受信機対を認証し、上記伝送を意図された送信機−受信機対に限定するように意図された事前協調かつ事前配信された情報に協調された変更をもたらすように構成される、項目75に記載のシステム。
(項目77)
上記プロセッサはさらに、伝送に先立って、上記エンコードされるデジタルビットストリームを一意にフォーマットすることによって、上記協調された変更の通信を上記意図された送信機および受信機に限定するように構成される、項目75または76に記載のシステム。
(項目78)
上記デジタルビットストリームを変換するステップは、変更を上記デジタルビットストリームに適用されるべきm−要素ベクトルテーブルに通信するステップを含む、項目75または76に記載のシステム。
(項目79)
上記プロセッサはさらに、上記m−要素ベクトルテーブルを採用し、伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記プロセッサによって、上記意図された送信機および受信機への伝送、すなわち、上記送信機−受信機対の認証を管理するように構成される、項目75または76に記載のシステム。
(項目80)
上記プロセッサはさらに、上記プロセッサによって、1つまたはそれを上回るタスクを管理し、伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記送信機−受信機対を認証するように構成される、項目75または76に記載のシステム。
(項目81)
上記プロセッサはさらに、
複数の付加的ビットを生成することであって、上記複数の付加的ビットは、上記送信機−受信機対を認証するために生成される、ことと、
上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加し、必要に応じて、上記付加的ビットを変更し、上記送信機−受信機対の認証を維持することと
を行うように構成される、項目75または76に記載のシステム。
(項目82)
上記通信インターフェースは、結合された通信システムを備える、項目75または76に記載のシステム。
(項目83)
上記通信インターフェースは、非結合通信システムを備える、項目75または76に記載のシステム。
(項目84)
上記プロセッサに、
事前協調かつ事前配信された情報を利用し、上記伝送を意図された送信機−受信機対に限定することによって、上記送信機−受信機対の認証を確立することであって、上記意図された送信機−受信機対は、上記事前協調かつ事前配信された情報を備える、ことと、
協調かつ配信された情報を変更および通信することによって、上記送信機−受信機対の認証の動的制御を維持することと、
伝送に先立って、上記エンコードされたデジタルビットストリームへの変更を一意に協調することによって、上記伝送を上記意図された送信機および受信機に限定することと
を行わせるようにさらに構成される、項目18に記載の非一過性コンピュータ可読メモリ媒体。
(項目85)
システムであって、
ネットワークインターフェースと、
プロセッサと、
上記プロセッサに動作可能に連結される、非一過性メモリ媒体であって、
デジタルビットストリームを受信することと、
上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、上記エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、
伝送のために、上記エンコードされたデジタルビットストリームを上記ネットワークインターフェースに提供することと
を行うように上記プロセッサをプログラムするように構成される複数の命令を記憶するように構成される、メモリ媒体と
を備える、システム。
(項目86)
上記プロセッサは、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するように構成される、項目85に記載のシステム。
(項目87)
上記プロセッサは、上記デジタルビットストリームに関するテーブルルックアップを行うように構成される、項目85または86に記載のシステム。
(項目88)
上記プロセッサはさらに、上記m−要素ベクトルテーブルを採用し、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するように構成される、項目85または86に記載のシステム。
(項目89)
上記プロセッサはさらに、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させ、業界標準非依存インターフェースを既存の情報システムに提供するように構成される、項目85または86に記載のシステム。
(項目90)
上記プロセッサはさらに、上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、データベクトルおよび上記複合チャネルをインタリーブするように構成される、項目85または86に記載のシステム。
(項目91)
上記プロセッサはさらに、
複数の付加的ビットを生成することであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ことと、
上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加することと
を行うように構成される、項目85または86に記載のシステム。
(項目92)
上記ネットワークインターフェースは、情報システムを備える、項目85または86に記載のシステム。
(項目93)
上記情報システムは、結合された情報システムである、項目92に記載のシステム。
(項目94)
上記情報システムは、非結合情報システムである、項目92に記載のシステム。
(項目95)
非一過性コンピュータ可読メモリ媒体であって、プロセッサによってロードされると、上記プロセッサに、
デジタルビットストリームを受信することと、
上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、上記エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ことと、
伝送のために、上記エンコードされたデジタルビットストリームを上記ネットワークインターフェースに提供することと
を行わせる命令をその上に記憶するように構成される、非一過性コンピュータ可読メモリ媒体。
(項目96)
上記その上に記憶された命令はさらに、上記プロセッサに、m−要素ベクトルテーブルを上記デジタルビットストリームに適用させる、項目95に記載の非一過性コンピュータ可読メモリ媒体。
(項目97)
上記その上に記憶された命令はさらに、上記プロセッサに、上記デジタルビットストリームに関するテーブルルックアップを行わせる、項目95または96に記載の非一過性コンピュータ可読メモリ媒体。
(項目98)
上記その上に記憶された命令はさらに、上記プロセッサに、上記m−要素ベクトルテーブルを採用し、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供させる、項目95または96に記載の非一過性コンピュータ可読メモリ媒体。
(項目99)
ネットワーク環境内で実行可能なコンピュータ実装方法であって、上記ネットワーク環境は、ネットワークインターフェース、プロセッサ、および上記プロセッサに動作可能に連結される非一過性メモリ媒体を備え、上記メモリ媒体は、上記プロセッサをプログラムするように構成される複数の命令を記憶するように構成され、
上記プロセッサによって、デジタルビットストリームを受信するステップと、
上記プロセッサによって、上記デジタルビットストリームをエンコードされたデジタルビットストリームに変換するステップであって、上記エンコードされたデジタルビットストリームは、ゲートウェイチャネル、複合チャネル、またはデータチャネル、およびそれらの任意の組み合わせのうちの少なくとも1つを備える、ステップと、
伝送のために、上記プロセッサによって、上記エンコードされたデジタルビットストリームを上記ネットワークインターフェースに提供するステップと
を含む、方法。
(項目100)
上記プロセッサによって、m−要素ベクトルテーブルを上記デジタルビットストリームに適用するステップを含む、項目99に記載の方法。
(項目101)
上記プロセッサによって、上記デジタルビットストリームに関してテーブルルックアップを行うステップを含む、項目99または100に記載の方法。
(項目102)
上記プロセッサによって、上記m−要素ベクトルテーブルを採用し、実現されるデータスループット、ビットエネルギー、または信号範囲、およびそれらの任意の組み合わせのうちの少なくとも1つを管理し、最適化された性能を提供するステップを含む、項目99または100に記載の方法。
(項目103)
上記プロセッサによって、1つまたはそれを上回るタスクを管理し、データ転送性能を向上させるステップと、
上記プロセッサによって、業界標準非依存インターフェースを既存の情報システムに提供するステップと
を含む、項目99または100に記載の方法。
(項目104)
上記ゲートウェイチャネルおよびゲートウェイマスクを利用して、上記プロセッサによって、データベクトルおよび上記複合チャネルをインタリーブするステップを含む、項目99または100に記載の方法。
(項目105)
上記プロセッサによって、複数の付加的ビットを生成するステップであって、上記複数の付加的ビットは、エラー補正コードによって生成される、ステップと、
上記プロセッサによって、上記複数の付加的ビットを上記エンコードされたデジタルビットストリームに追加するステップと
を含む、項目99または100に記載の方法。
(項目106)
上記プロセッサによって、上記エンコードされたデジタルビットストリームを情報システムに提供するステップを含む、項目99または100に記載の方法。
Claims (20)
- システムであって、
ネットワークインターフェースと、
プロセッサと、
前記プロセッサに動作可能に連結された非一過性メモリ媒体と
を備え、
前記非一過性メモリ媒体は、複数の命令を記憶するように構成されており、前記複数の命令は、
デジタルビットストリームを受信することと、
初期ゲートウェイ部分および初期複合部分を生成することと、
前記初期ゲートウェイ部分に基づいてゲートウェイマスクを生成することと、
前記ゲートウェイマスクを前記初期ゲートウェイ部分に適用することにより、最終ゲートウェイ部分を生成することと、
前記ゲートウェイマスクを前記初期複合部分に適用することにより、最終複合部分を生成することと、
前記最終ゲートウェイ部分および前記最終複合部分を用いてデータベクトルをインタリーブすることにより、ヘッダー部分を生成することと、
前記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、前記エンコードされたデジタルビットストリームは、前記ヘッダー部分およびデータ部分を含む、ことと、
伝送のために、前記エンコードされたデジタルビットストリームを前記ネットワークインターフェースに提供することと
を行うように前記プロセッサをプログラムするように構成されている、システム。 - 前記プロセッサは、m−要素ベクトルテーブルを前記デジタルビットストリームに適用するようにさらに構成されている、請求項1に記載のシステム。
- 前記プロセッサは、前記デジタルビットストリームに関してテーブルルックアップを行うようにさらに構成されている、請求項1に記載のシステム。
- 前記プロセッサは、前記m−要素ベクトルテーブルを適用し、実現されるデータスループット、ビットエネルギー、または信号範囲のうちの少なくとも1つを管理するようにさらに構成されている、請求項2に記載のシステム。
- 前記プロセッサは、1つ以上のタスクを管理し、既存の情報システム内においてデータ転送性能を修正するようにさらに構成されている、請求項1に記載のシステム。
- 前記プロセッサは、
複数の付加的ビットを生成することであって、前記複数の付加的ビットは、エラー補正コードによって生成される、ことと、
前記複数の付加的ビットを前記エンコードされたデジタルビットストリームに追加することと
を行うようにさらに構成されている、請求項1に記載のシステム。 - 前記ネットワークインターフェースは、情報システムを含む、請求項1に記載のシステム。
- 前記情報システムは、結合された情報システムである、請求項7に記載のシステム。
- 前記情報システムは、非結合情報システムである、請求項7に記載のシステム。
- 非一過性コンピュータ可読メモリ媒体であって、前記非一過性コンピュータ可読メモリ媒体は、命令をその上に記憶するように構成されており、前記命令は、プロセッサによってロードされると、前記プロセッサに、
デジタルビットストリームを受信することと、
初期ゲートウェイ部分および初期複合部分を生成することと、
前記初期ゲートウェイ部分に基づいてゲートウェイマスクを生成することと、
前記ゲートウェイマスクを前記初期ゲートウェイ部分に適用することにより、最終ゲートウェイ部分を生成することと、
前記ゲートウェイマスクを前記初期複合部分に適用することにより、最終複合部分を生成することと、
前記最終ゲートウェイ部分および前記最終複合部分を用いてデータベクトルをインタリーブすることにより、ヘッダー部分を生成することと、
前記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、前記エンコードされたデジタルビットストリームは、前記ヘッダー部分およびデータ部分を含む、ことと、
伝送のために、前記エンコードされたデジタルビットストリームをネットワークインターフェースに提供することと
を行わせる、非一過性コンピュータ可読メモリ媒体。 - 前記非一過性コンピュータ可読メモリ媒体上に記憶された命令はさらに、前記プロセッサに、m−要素ベクトルテーブルを前記デジタルビットストリームに適用させる、請求項10に記載の非一過性コンピュータ可読メモリ媒体。
- 前記非一過性コンピュータ可読メモリ媒体上に記憶された命令はさらに、前記プロセッサに、前記デジタルビットストリームに関してテーブルルックアップを行わせる、請求項10に記載の非一過性コンピュータ可読メモリ媒体。
- 前記非一過性コンピュータ可読メモリ媒体上に記憶された命令はさらに、前記プロセッサに、前記m−要素ベクトルテーブルを適用し、実現されるデータスループット、ビットエネルギー、または信号範囲のうちの少なくとも1つを管理させる、請求項11に記載の非一過性コンピュータ可読メモリ媒体。
- ネットワーク環境内において実行可能なコンピュータ実装方法であって、前記ネットワーク環境は、ネットワークインターフェース、プロセッサ、および前記プロセッサに動作可能に連結された非一過性メモリ媒体を備え、前記非一過性メモリ媒体は、前記プロセッサをプログラムするように構成された複数の命令を記憶するように構成されており、
前記方法は、
前記プロセッサによって、デジタルビットストリームを受信することと、
前記プロセッサによって、初期ゲートウェイ部分および初期複合部分を生成することと、
前記プロセッサによって、前記初期ゲートウェイ部分に基づいてゲートウェイマスクを生成することと、
前記プロセッサによって、前記ゲートウェイマスクを前記初期ゲートウェイ部分に適用することにより、最終ゲートウェイ部分を生成することと、
前記プロセッサによって、前記ゲートウェイマスクを前記初期複合部分に適用することにより、最終複合部分を生成することと、
前記プロセッサによって、前記最終ゲートウェイ部分および前記最終複合部分を用いてデータベクトルをインタリーブすることにより、ヘッダー部分を生成することと、
前記プロセッサによって、前記デジタルビットストリームをエンコードされたデジタルビットストリームに変換することであって、前記エンコードされたデジタルビットストリームは、前記ヘッダー部分およびデータ部分を含む、ことと、
前記プロセッサによって、伝送のために、前記エンコードされたデジタルビットストリームを前記ネットワークインターフェースに提供することと
を含む、方法。 - 前記プロセッサによって、m−要素ベクトルテーブルを前記デジタルビットストリームに適用することをさらに含む、請求項14に記載の方法。
- 前記プロセッサによって、前記デジタルビットストリームに関してテーブルルックアップを行うことをさらに含む、請求項14に記載の方法。
- 前記プロセッサによって、前記m−要素ベクトルテーブルを適用し、実現されるデータスループット、ビットエネルギー、または信号範囲のうちの少なくとも1つを管理することをさらに含む、請求項15に記載の方法。
- 前記プロセッサによって、1つ以上のタスクを管理し、データ転送性能を修正することと、
前記プロセッサによって、業界標準非依存インターフェースを既存の情報システムに提供することと
をさらに含む、請求項14に記載の方法。 - 前記プロセッサによって、複数の付加的ビットを生成することであって、前記複数の付加的ビットは、エラー補正コードによって生成される、ことと、
前記プロセッサによって、前記複数の付加的ビットを前記エンコードされたデジタルビットストリームに追加することと
をさらに含む、請求項14に記載の方法。 - 前記プロセッサによって、前記エンコードされたデジタルビットストリームを情報システムに提供することをさらに含む、請求項14に記載の方法。
Applications Claiming Priority (13)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US201361862745P | 2013-08-06 | 2013-08-06 | |
US61/862,745 | 2013-08-06 | ||
US14/062,535 US9444580B2 (en) | 2013-08-06 | 2013-10-24 | Optimized data transfer utilizing optimized code table signaling |
US14/062,535 | 2013-10-24 | ||
US14/099,180 US9031156B2 (en) | 2013-08-06 | 2013-12-06 | Enhanced signal integrity and communication utilizing optimized code table signaling |
US14/099,180 | 2013-12-06 | ||
US14/243,426 US9455799B2 (en) | 2013-08-06 | 2014-04-02 | Dynamic control of quality of service (QOS) using derived QOS measures |
US14/243,426 | 2014-04-02 | ||
US14/243,438 US10523490B2 (en) | 2013-08-06 | 2014-04-02 | Authentication of a subscribed code table user utilizing optimized code table signaling |
US14/243,438 | 2014-04-02 | ||
US14/310,652 | 2014-06-20 | ||
US14/310,652 US9203556B2 (en) | 2013-08-06 | 2014-06-20 | Optimized code table signaling for authentication to a network and information system |
PCT/US2014/044661 WO2015020737A1 (en) | 2013-08-06 | 2014-06-27 | Optimized code table signaling |
Publications (3)
Publication Number | Publication Date |
---|---|
JP2016533677A JP2016533677A (ja) | 2016-10-27 |
JP2016533677A5 JP2016533677A5 (ja) | 2017-08-03 |
JP6345781B2 true JP6345781B2 (ja) | 2018-06-20 |
Family
ID=52448654
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2016533298A Expired - Fee Related JP6345781B2 (ja) | 2013-08-06 | 2014-06-27 | 最適化されたコードテーブル信号伝達 |
Country Status (10)
Country | Link |
---|---|
US (8) | US9444580B2 (ja) |
EP (1) | EP3031139A1 (ja) |
JP (1) | JP6345781B2 (ja) |
KR (1) | KR101769974B1 (ja) |
CN (1) | CN105637768B (ja) |
AU (1) | AU2014304793B2 (ja) |
CA (1) | CA2919805C (ja) |
IL (1) | IL243931B (ja) |
TW (1) | TWI602398B (ja) |
WO (1) | WO2015020737A1 (ja) |
Families Citing this family (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10523490B2 (en) | 2013-08-06 | 2019-12-31 | Agilepq, Inc. | Authentication of a subscribed code table user utilizing optimized code table signaling |
US9444580B2 (en) | 2013-08-06 | 2016-09-13 | OptCTS, Inc. | Optimized data transfer utilizing optimized code table signaling |
US9455799B2 (en) | 2013-08-06 | 2016-09-27 | OptCTS, Inc. | Dynamic control of quality of service (QOS) using derived QOS measures |
US10056919B2 (en) | 2014-07-02 | 2018-08-21 | Agilepq, Inc. | Data recovery utilizing optimized code table signaling |
US20170223060A1 (en) * | 2014-08-28 | 2017-08-03 | Hewlett Packard Enterprise Development Lp | Security control |
JP2019518397A (ja) | 2016-06-06 | 2019-06-27 | アジャイルピーキュー, インコーポレイテッド | データ変換システムおよび方法 |
US10235138B2 (en) * | 2016-09-30 | 2019-03-19 | International Business Machines Corporation | Instruction to provide true random numbers |
US10355821B2 (en) * | 2017-06-14 | 2019-07-16 | Nokia Solutions And Networks Oy | Probabilistic signal shaping using a self-referencing sequence |
RU2704499C1 (ru) * | 2018-11-22 | 2019-10-29 | Федеральное государственное автономное образовательное учреждение высшего образования "Санкт-Петербургский государственный университет аэрокосмического приборостроения" | Декодер кода Боуза-Чоудхури-Хоквингема с каноническим декодером Хэмминга |
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US20230325372A1 (en) * | 2022-04-11 | 2023-10-12 | United Parcel Service Of America, Inc. | Hierarchical to matrix data management |
Family Cites Families (106)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US725605A (en) | 1900-07-16 | 1903-04-14 | Nikola Tesla | System of signaling. |
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-
2013
- 2013-10-24 US US14/062,535 patent/US9444580B2/en not_active Expired - Fee Related
- 2013-12-06 US US14/099,180 patent/US9031156B2/en not_active Expired - Fee Related
-
2014
- 2014-06-20 US US14/310,652 patent/US9203556B2/en not_active Expired - Fee Related
- 2014-06-27 EP EP14750383.3A patent/EP3031139A1/en not_active Withdrawn
- 2014-06-27 KR KR1020167005255A patent/KR101769974B1/ko active IP Right Grant
- 2014-06-27 CA CA2919805A patent/CA2919805C/en not_active Expired - Fee Related
- 2014-06-27 JP JP2016533298A patent/JP6345781B2/ja not_active Expired - Fee Related
- 2014-06-27 WO PCT/US2014/044661 patent/WO2015020737A1/en active Application Filing
- 2014-06-27 CN CN201480045400.2A patent/CN105637768B/zh not_active Expired - Fee Related
- 2014-06-27 AU AU2014304793A patent/AU2014304793B2/en not_active Ceased
- 2014-07-16 TW TW103124421A patent/TWI602398B/zh not_active IP Right Cessation
-
2015
- 2015-05-06 US US14/705,626 patent/US9698940B2/en active Active
- 2015-09-23 US US14/863,075 patent/US9774349B2/en active Active
-
2016
- 2016-02-03 IL IL243931A patent/IL243931B/en not_active IP Right Cessation
- 2016-09-12 US US15/262,966 patent/US9900126B2/en active Active
-
2018
- 2018-02-17 US US15/898,546 patent/US10200062B2/en active Active
-
2019
- 2019-02-04 US US16/267,344 patent/US20190173488A1/en not_active Abandoned
Also Published As
Publication number | Publication date |
---|---|
US20150349921A1 (en) | 2015-12-03 |
US20160254877A1 (en) | 2016-09-01 |
IL243931B (en) | 2019-09-26 |
US9444580B2 (en) | 2016-09-13 |
CA2919805A1 (en) | 2015-02-12 |
WO2015020737A1 (en) | 2015-02-12 |
EP3031139A1 (en) | 2016-06-15 |
KR20160040247A (ko) | 2016-04-12 |
JP2016533677A (ja) | 2016-10-27 |
US9774349B2 (en) | 2017-09-26 |
CA2919805C (en) | 2016-11-29 |
US9031156B2 (en) | 2015-05-12 |
IL243931A0 (en) | 2016-04-21 |
US20150043621A1 (en) | 2015-02-12 |
CN105637768B (zh) | 2019-06-11 |
TWI602398B (zh) | 2017-10-11 |
US9698940B2 (en) | 2017-07-04 |
US9203556B2 (en) | 2015-12-01 |
US20190173488A1 (en) | 2019-06-06 |
US9900126B2 (en) | 2018-02-20 |
WO2015020737A4 (en) | 2015-05-14 |
CN105637768A (zh) | 2016-06-01 |
US20160380648A1 (en) | 2016-12-29 |
US20180175881A1 (en) | 2018-06-21 |
US20150195060A1 (en) | 2015-07-09 |
US20150043677A1 (en) | 2015-02-12 |
AU2014304793A1 (en) | 2016-03-03 |
KR101769974B1 (ko) | 2017-08-21 |
US10200062B2 (en) | 2019-02-05 |
TW201517525A (zh) | 2015-05-01 |
AU2014304793B2 (en) | 2018-11-29 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20170626 |
|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20170626 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20180419 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20180501 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20180523 |
|
R150 | Certificate of patent or registration of utility model |
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|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
LAPS | Cancellation because of no payment of annual fees |