JP6288812B2 - 誤り訂正符号を有する不揮発性メモリシステムの消去 - Google Patents
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Description
さらに、本明細書において使用される場合、「1つ(“a” or “an”)」という用語は、1つまたは2つ以上として定義される。さらに、特許請求の範囲における「少なくとも1つの」および「1つ以上」のような前置きの語句の使用は、不定冠詞「1つの (“a” or “an”)」による別の請求項要素の導入が、このように導入された請求項要素を含む任意の特定の請求項を、たとえ同じ請求項が前置きの語句「1つ以上」または「少なくとも1つの」および「1つの (“a” or “an”)」のような不定冠詞を含む場合であっても、1つだけのこのような要素を含む発明に限定することを暗示するように解釈されるべきではない。同じことが、定冠詞の使用についても当てはまる。
Claims (18)
- 半導体メモリ記憶デバイスにおいて、
複数の不揮発性メモリビットセルを含む不揮発性メモリビットセルのアレイであって、1つ以上のブロックに分割されている、不揮発性メモリビットセルのアレイと、
前記アレイに結合されているメモリコントローラと、
前記アレイと前記メモリコントローラとに結合されている誤り訂正符号ユニットとを備え、
前記メモリコントローラは、前記1つ以上のブロックのうちの1つのブロックに対する消去動作の際、
通常消去検証電圧レベルによる第1の検証動作を実行する工程と、
前記1つのブロックの不揮発性メモリビットセルのうち前記第1の検証動作に不合格であったビットの数が1であるか否かを判定する工程と、
前記1つのブロックの不揮発性メモリビットセルのうち前記第1の検証動作に不合格であったビットの数が1である場合、前記通常消去検証電圧レベルよりも高い緩和消去検証電圧レベルによる第2の検証動作を実行する工程と、
前記1つのブロックの不揮発性メモリビットセルのうち前記第2の検証動作に不合格であったビットの数が1であるか否かを判定する工程と、
前記1つのブロックの不揮発性メモリビットセルのうち前記第2の検証動作に不合格であったビットの数が1である場合、前記消去動作に成功したと判断する工程と、を行うように構成されている、半導体メモリ記憶デバイス。 - 前記メモリコントローラは、
前記1つのブロックの不揮発性メモリビットセルのうち前記第2の検証動作に不合格であったビットの数が1である場合、前記1つのブロックに対して前記誤り訂正符号ユニットが以前に訂正を実行しているか否かを判定する工程と、
前記1つのブロックに対して前記誤り訂正符号ユニットが以前に訂正を実行していない場合、前記消去動作は成功したと判断する工程と、を行うようにさらに構成されている、請求項1に記載の半導体メモリ記憶デバイス。 - 前記消去動作の際、前記第1の検証動作および前記第2の検証動作は各消去パルスの後または複数の消去パルスを含む消去パルスのグループの後に実行される、請求項1に記載の半導体メモリ記憶デバイス。
- 前記緩和消去検証電圧レベルによる消去検証に不合格であった前記1つの不揮発性メモリビットセルを含む誤り訂正符号セグメントに対して前記誤り訂正符号ユニットが以前に訂正を実行していない場合、前記消去動作は成功したと判断される、請求項1に記載の半導体メモリ記憶デバイス。
- 前記メモリコントローラは、前記1つのブロックに対する前記消去動作の際、前記第1の検証動作によって、前記複数の不揮発性メモリビットセルのうちの1つのメモリビットセルのみが前記通常消去検証電圧レベルによる消去検証に不合格であるとして検出され、前記第2の検証動作によって、前記複数の不揮発性メモリビットセルのすべてが前記緩和消去検証電圧レベルによる消去に成功したとして検出された場合、消去パルスの最大数に達したときに前記消去動作に成功したと判断するように構成されている、請求項1に記載の半導体メモリ記憶デバイス。
- 前記通常消去検証電圧レベルによる消去検証に不合格であった前記1つの不揮発性メモリビットセルを含む誤り訂正符号セグメントに対して前記誤り訂正符号ユニットが以前に訂正を実行していない場合、前記消去動作は成功したと前記メモリコントローラによって判断される、請求項5に記載の半導体メモリ記憶デバイス。
- 前記通常消去検証電圧レベルによる消去検証に不合格であった前記1つの不揮発性メモリビットセルを含む前記1つのブロックに対して前記誤り訂正符号ユニットが以前に訂正を実行していない場合、前記消去動作は成功したと判断される、請求項5に記載の半導体メモリ記憶デバイス。
- 前記第1の検証動作に不合格であった不揮発性メモリビットセルの数をカウントする前に、所定数の消去パルスが前記メモリコントローラによって実行される、請求項1に記載の半導体メモリ記憶デバイス。
- 前記所定数の消去パルスは5〜10個の消去パルスである、請求項8に記載の半導体メモリ記憶デバイス。
- 不揮発性メモリに記憶される1つ以上の誤り訂正符号インジケータを含む誤り訂正符号記録部をさらに備え、前記誤り訂正符号インジケータの各々は前記複数の不揮発性メモリビットセルの前記複数のブロックのうちの対応するブロックに割り当てられており、誤り訂正符号による訂正が前記対応するブロックに対して実行されたか否かを示す、請求項1に記載の半導体メモリ記憶デバイス。
- 不揮発性メモリに記憶される1つ以上の誤り訂正符号インジケータを含む誤り訂正符号記録部をさらに備え、前記誤り訂正符号インジケータの各々は前記複数の不揮発性メモリビットセルの対応する誤り訂正符号セグメントに割り当てられており、誤り訂正符号による訂正が前記対応する誤り訂正符号セグメントに対して実行されたか否かを示す、請求項1に記載の半導体メモリ記憶デバイス。
- 半導体メモリ記憶デバイスを消去する方法であって、
メモリコントローラが、複数の不揮発性メモリビットセルを含む不揮発性メモリビットセルのアレイであって、1つ以上のブロックに分割されている、不揮発性メモリビットセルのアレイの1つのブロックに対して消去動作を実行する工程と、
前記メモリコントローラが、通常消去検証電圧レベルによる第1の検証動作を実行する工程と、
前記メモリコントローラが、前記1つのブロックの不揮発性メモリビットセルのうち前記第1の検証動作に不合格であったビットの数が1であるか否かを判定する工程と、
前記メモリコントローラが、前記1つのブロックの不揮発性メモリビットセルのうち前記第1の検証動作に不合格であったビットの数が1である場合、前記通常消去検証電圧レベルよりも高い緩和消去検証電圧レベルによる第2の検証動作を実行する工程と、
前記メモリコントローラが、前記1つのブロックの不揮発性メモリビットセルのうち前記第2の検証動作に不合格であったビットの数が1であるか否かを判定する工程と、
前記メモリコントローラが、前記1つのブロックの不揮発性メモリビットセルのうち前記第2の検証動作に不合格であったビットの数が1である場合、前記消去動作に成功したと判断する工程と、
を備える方法。 - 前記メモリコントローラが、前記1つのブロックに対する消去動作の際、前記第1の検証動作によって、前記複数の不揮発性メモリビットセルのうちの1つの不揮発性メモリビットセルのみが前記通常消去検証電圧レベルによる消去検証に不合格であるとして検出され、前記第2の検証動作によって、前記複数の不揮発性メモリビットセルのすべてが前記緩和消去検証電圧レベルによる消去に成功したとして検出された場合、消去パルスの最大数に達したときに前記消去動作を成功したと判断する工程をさらに備える、請求項12に記載の方法。
- 消去されている前記1つのブロックの不揮発性メモリビットセルに対して誤り訂正符号による訂正が以前に実行されていない場合、前記消去動作を成功とする工程をさらに備える、請求項12に記載の方法。
- 前記緩和消去検証電圧レベルによる消去検証に不合格であった前記1つの不揮発性メモリビットセルを含む誤り訂正符号セグメントに対して誤り訂正符号ユニットが以前に訂正を実行していない場合、前記消去動作は成功したと判断される、請求項12に記載の方法。
- 前記消去動作の際、前記第1の検証動作および前記第2の検証動作は各消去パルスの後または複数の消去パルスを含む消去パルスのグループの後に実行される、請求項13に記載の方法。
- 前記通常消去検証電圧レベルによる消去検証に不合格であった前記不揮発性メモリビットセルを含む前記1つのブロックの不揮発性メモリビットセルの誤り訂正符号セグメントに対して誤り訂正符号による訂正が以前に実行されていない場合、前記消去動作を成功とする工程をさらに備える、請求項13に記載の方法。
- 前記通常消去検証電圧レベルによる消去検証に不合格であった前記1つの不揮発性メモリビットセルを含む前記1つのブロックの不揮発性メモリビットセルに対して誤り訂正符号ユニットが以前に訂正を実行していない場合、前記消去動作を成功とする工程をさらに備える、請求項13に記載の方法。
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