JP6263340B2 - 液晶表示装置 - Google Patents
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Description
前記複数のゲート配線の一部である予め定める複数の検出用のゲート配線が接続され、前記複数のゲート配線のいずれにもゲート電圧が印加されていない非ゲート電圧印加期間に、前記予め定める複数の検出用のゲート配線に、前記予め定める電圧未満の検出用電圧を順次印加する検出駆動回路と、
前記複数のソース配線の一部である予め定める複数の検出用のソース配線が接続され、前記検出駆動回路によって前記検出用電圧が検出用のゲート配線に与えられている期間に、前記予め定める複数の検出用のソース配線の各電圧を検出する検出回路と、
前記検出回路によって検出された電圧と、接触または近接状態を検出するために予め設定された閾値とを比較し、接触または近接位置の座標を取得する座標取得部とを備えることを特徴とする液晶表示装置である。
前記検出駆動回路は、前記ゲート駆動回路によって前記ゲート電圧がゲート配線に与えられている期間に、前記検出用のゲート配線が接続される各接続端をハイインピーダンス状態に設定することを特徴とする。
前記検出駆動回路は、前記複数の検出用のゲート配線のうちの一の検出用のゲート配線に前記検出用電圧を印加しているとき、前記複数の検出用のゲート配線のうちの前記一の検出用のゲート配線を除く残余の検出用のゲート配線には、前記検出用電圧未満の第2オフ電圧を印加し、
前記検出用電圧および前記第2オフ電圧は、それらの平均値が前記第1オフ電圧に略等しくなるように設定されていることを特徴とする。
11 液晶パネル
12 ゲートドライバ
13 ソースドライバ
14 タッチ検出用ドライブ回路
15 タッチ検出用センス回路
16 タッチ位置検出回路
18 タイミングコントローラ
31 TFT
32 画素電極
GL1〜GLm ゲート配線
SL1〜SLn ソース配線
G1〜Gm 出力バッファ
S1〜Sn 出力バッファ
DGL1〜DGLp 検出用ゲート配線
SSL1〜SSLq 検出用ソース配線
D1〜Dp 出力バッファ
SE1〜SEq 入力バッファ
Claims (9)
- 一方の基板と、他方の基板と、一方の基板と他方の基板との間に設けられる液晶層とを含み、前記一方の基板に、複数のゲート配線と、前記複数のゲート配線に交差して設けられる複数のソース配線と、ゲート配線とソース配線との交差部ごとに設けられる画素電極と、前記交差部ごとに設けられ、該交差部を成すゲート配線に予め定める電圧以上のゲート電圧が印加されると、該交差部を成すソース配線と該交差部の画素電極とを導通するアクティブ素子と、前記複数のゲート配線が接続され、各ゲート配線に前記ゲート電圧を順次印加するゲート駆動回路と、前記複数のソース配線が接続され、各ソース配線に画像データに応じた電圧を印加するソース駆動回路と備える液晶表示装置であって、
前記複数のゲート配線の一部である予め定める複数の検出用のゲート配線が接続され、前記複数のゲート配線のいずれにもゲート電圧が印加されていない非ゲート電圧印加期間に、前記予め定める複数の検出用のゲート配線に、前記予め定める電圧未満の検出用電圧を順次印加する検出駆動回路と、
前記複数のソース配線の一部である予め定める複数の検出用のソース配線が接続され、前記検出駆動回路によって前記検出用電圧が検出用のゲート配線に与えられている期間に、前記予め定める複数の検出用のソース配線の各電圧を検出する検出回路と、
前記検出回路によって検出された電圧と、接触または近接状態を検出するために予め設定された閾値とを比較し、接触または近接位置の座標を取得する座標取得部とを備えることを特徴とする液晶表示装置。 - 前記検出駆動回路は、前記非ゲート電圧印加期間のうちの垂直ブランキング期間に、前記予め定める複数の検出用のゲート配線に、前記予め定める電圧未満の検出用電圧を順次印加することを特徴とする請求項1に記載の液晶表示装置。
- 隣接する前記検出用のゲート配線間の間隔、および、隣接する前記検出用のソース配線間の間隔が、指を接触させたときに接触状態を検出可能な接触領域の寸法以下に設定されていることを特徴とする請求項1または2に記載の液晶表示装置。
- 隣接する前記検出用のゲート配線間の間隔が互いに等しく、隣接する前記検出用のソース配線間の間隔が互いに等しいことを特徴とする請求項3に記載の液晶表示装置。
- 前記検出駆動回路および前記検出回路が、前記一方の基板に設けられていることを特徴とする請求項1〜4のいずれか1つに記載の液晶表示装置。
- 前記ゲート駆動回路および前記検出駆動回路がいずれも、前記複数のゲート配線の延在方向の一方側に設けられていることを特徴とする請求項5に記載の液晶表示装置。
- 前記ソース駆動回路および前記検出回路がいずれも、前記複数のソース配線の延在方向の一方側に設けられていることを特徴とする請求項5に記載の液晶表示装置。
- 前記ゲート駆動回路は、前記検出駆動回路によって前記検出用電圧が検出用のゲート配線に与えられている期間に、前記検出用のゲート配線が接続される各接続端をハイインピーダンス状態に設定し、
前記検出駆動回路は、前記ゲート駆動回路によって前記ゲート電圧がゲート配線に与えられている期間に、前記検出用のゲート配線が接続される各接続端をハイインピーダンス状態に設定することを特徴とする請求項1〜7のいずれか1つに記載の液晶表示装置。 - 前記ゲート駆動回路は、前記複数のゲート配線のうちの一のゲート配線に前記ゲート電圧を印加しているとき、前記複数のゲート配線のうちの前記一のゲート配線を除く残余のゲート配線には、前記予め定める電圧未満の第1オフ電圧を印加し、
前記検出駆動回路は、前記複数の検出用のゲート配線のうちの一の検出用のゲート配線に前記検出用電圧を印加しているとき、前記複数の検出用のゲート配線のうちの前記一の検出用のゲート配線を除く残余の検出用のゲート配線には、前記検出用電圧未満の第2オフ電圧を印加し、
前記検出用電圧および前記第2オフ電圧は、それらの平均値が前記第1オフ電圧に略等しくなるように設定されていることを特徴とする請求項1〜8のいずれか1つに記載の液晶表示装置。
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JP2013140946A JP6263340B2 (ja) | 2013-07-04 | 2013-07-04 | 液晶表示装置 |
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JP2013140946A JP6263340B2 (ja) | 2013-07-04 | 2013-07-04 | 液晶表示装置 |
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JP2015014886A JP2015014886A (ja) | 2015-01-22 |
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Family
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Family Applications (1)
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JP2013140946A Active JP6263340B2 (ja) | 2013-07-04 | 2013-07-04 | 液晶表示装置 |
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