JP5498266B2

JP5498266B2 - Wireless communication device

Info

Publication number: JP5498266B2
Application number: JP2010129195A
Authority: JP
Inventors: 雅裕長田
Original assignee: Panasonic Corp; Matsushita Electric Industrial Co Ltd
Current assignee: Panasonic Corp; Panasonic Holdings Corp
Priority date: 2010-06-04
Filing date: 2010-06-04
Publication date: 2014-05-21
Anticipated expiration: 2030-06-04
Also published as: JP2011259029A

Description

本発明は、無線通信装置に関する。 The present invention relates to a wireless communication apparatus.

従来の無線通信装置として、特許文献１に記載されたものがある。この従来例は、図６に示すようにアンテナ100、ＲＦ部110、インタフェース部120、マイコン部130で構成されている。ＲＦ部110は、アンテナ100で受信した無線信号から受信データ(復調信号)を復調する復調部111と、復調信号の同期ビット列からサンプリングクロックを生成するサンプリングクロック生成部112とを備えている。 As a conventional wireless communication device, there is one described in Patent Document 1. This conventional example includes an antenna 100, an RF unit 110, an interface unit 120, and a microcomputer unit 130 as shown in FIG. The RF unit 110 includes a demodulator 111 that demodulates received data (demodulated signal) from a radio signal received by the antenna 100, and a sampling clock generator 112 that generates a sampling clock from a synchronization bit string of the demodulated signal.

インタフェース部120は、フレーム同期部(ユニークワード)を記憶するフレームコードレジスタ121と、復調部111で復調された受信データをサンプリングクロックに同期して順次記憶するフレーム同期シフトレジスタ122と、フレームコードレジスタ121とフレーム同期シフトレジスタ122のビット列が一致した場合にフレーム同期検出信号を出力するフレーム同期検出部123と、フレーム同期検出部123でフレーム同期が検出された場合にサンプリングクロックに同期して受信データを記憶する受信バッファ124とを備えている。 The interface unit 120 includes a frame code register 121 that stores a frame synchronization unit (unique word), a frame synchronization shift register 122 that sequentially stores reception data demodulated by the demodulation unit 111 in synchronization with a sampling clock, and a frame code register A frame synchronization detection unit 123 that outputs a frame synchronization detection signal when the bit string of 121 and the frame synchronization shift register 122 match, and when frame synchronization is detected by the frame synchronization detection unit 123, the received data is synchronized with the sampling clock. And a reception buffer 124 for storing.

マイコン部130は、受信データを記憶するＲＡＭ131と、ＲＡＭ131に記憶した受信データから元のメッセージをデコード(復号化)する制御部132と、受信バッファ124に記憶された受信データを制御部132から指定された回数だけＲＡＭ131に転送し、転送終了後に制御部132に転送終了信号を出力する転送部133とを備えている。 The microcomputer unit 130 designates the RAM 131 for storing received data, the control unit 132 for decoding (decoding) the original message from the received data stored in the RAM 131, and the received data stored in the reception buffer 124 from the control unit 132. A transfer unit 133 that transfers the number of times to the RAM 131 and outputs a transfer end signal to the control unit 132 after the transfer ends.

次に、図７のタイムチャートを参照して、従来例の受信動作を説明する。なお、この従来例で授受される通信フレームは、ビット同期を取るための同期ビット列(プリアンブル)、フレーム同期を取るためのフレーム同期ビット列(ユニークワード)、通信メッセージを示すデータ、誤り検出用のチェックコード(例えば、ＣＲＣ)などで構成されている。 Next, the reception operation of the conventional example will be described with reference to the time chart of FIG. The communication frame exchanged in this conventional example includes a synchronization bit string (preamble) for bit synchronization, a frame synchronization bit string (unique word) for frame synchronization, data indicating a communication message, and a check for error detection. It is composed of a code (for example, CRC).

まず、マイコン部130はインタフェース部120のフレーム同期検出部123からフレーム同期検出信号が出力されるまではスリープモードで待機している。そして、ＲＦ部110で無線信号を受信してインタフェース部120のフレーム同期検出部123からフレーム同期検出信号が出力されると、マイコン部130は、フレーム同期検出信号の立ち上がりに同期して立上りエッジ割込処理を開始する。立上りエッジ割込処理を開始したマイコン部130は、制御部132からインタフェース部120に対して受信バッファ124に記憶されている受信データの出力を指示する。マイコン部130では、受信バッファ124から出力される受信データを転送部133によってＲＡＭ131に転送し、制御部132が元のメッセージを復号化する。さらに制御部132は受信バッファ124から規定の長さのビット列を受け取ると、ＲＦ部110並びにインタフェース部120に対してリセット信号を出力する。ＲＦ部110並びにインタフェース部120では、制御部132からリセット信号を受け取るとサンプリングクロック生成部112及びフレーム同期検出部123をそれぞれリセットする。 First, the microcomputer unit 130 waits in the sleep mode until the frame synchronization detection signal is output from the frame synchronization detection unit 123 of the interface unit 120. When the RF unit 110 receives the radio signal and the frame synchronization detection signal is output from the frame synchronization detection unit 123 of the interface unit 120, the microcomputer unit 130 synchronizes with the rising edge of the frame synchronization detection signal. Start processing. The microcomputer unit 130 which has started the rising edge interrupt process instructs the control unit 132 to output the reception data stored in the reception buffer 124 to the interface unit 120. In the microcomputer unit 130, the reception data output from the reception buffer 124 is transferred to the RAM 131 by the transfer unit 133, and the control unit 132 decodes the original message. Further, when receiving a bit string having a specified length from the reception buffer 124, the control unit 132 outputs a reset signal to the RF unit 110 and the interface unit 120. When receiving the reset signal from the control unit 132, the RF unit 110 and the interface unit 120 reset the sampling clock generation unit 112 and the frame synchronization detection unit 123, respectively.

上記従来例では、常時はＲＦ部110並びにインタフェース部120のみを動作させてマイコン部130はスリープモードにして消費電力を低減したり、あるいは、待機状態におけるマイコン部130の処理負荷を軽くすることで低コスト(低性能)のマイコンが使用できるという利点がある。 In the above conventional example, only the RF unit 110 and the interface unit 120 are operated at all times, and the microcomputer unit 130 is set in the sleep mode to reduce power consumption, or the processing load of the microcomputer unit 130 in the standby state is reduced. There is an advantage that a low-cost (low performance) microcomputer can be used.

ところで、アンテナ100に無線信号を受信していなくても、熱雑音や電波ノイズの影響でＲＦ部110の復調部111がランダムなビット列からなる信号を出力してしまうことがある。そして、このようなランダムなビット列の中には、フレーム同期部のビット列(ユニークワード)と同じビット列が一定の確率で含まれているため、フレーム同期検出部123がフレーム同期を誤検出してフレーム同期検出信号を出力してしまう場合がある。この場合においても、マイコン部130は、フレーム同期検出信号の立ち上がりに同期して立上りエッジ割込処理を開始し、制御部132からインタフェース部120に対して受信バッファ124に記憶されている受信データの出力を指示する。さらにマイコン部130では、受信バッファ124から出力される受信データを転送部133によってＲＡＭ131に転送し、制御部132が元のメッセージを復号化する(図８参照)。 By the way, even if the antenna 100 does not receive a radio signal, the demodulation unit 111 of the RF unit 110 may output a signal composed of a random bit string due to the influence of thermal noise or radio noise. In such a random bit string, since the same bit string as the bit string (unique word) of the frame synchronization unit is included with a certain probability, the frame synchronization detection unit 123 erroneously detects frame synchronization and detects the frame. A synchronization detection signal may be output. Also in this case, the microcomputer unit 130 starts the rising edge interrupt process in synchronization with the rising edge of the frame synchronization detection signal, and the received data stored in the reception buffer 124 from the control unit 132 to the interface unit 120 is received. Direct output. Further, in the microcomputer unit 130, the reception data output from the reception buffer 124 is transferred to the RAM 131 by the transfer unit 133, and the control unit 132 decodes the original message (see FIG. 8).

しかしながら、ＲＦ部110のサンプリングクロック生成部112が復調部111で復調された復調信号のビット列を監視し続けており、ランダムなビット列のビット幅(パルス幅)が一定でないためにやがては同期外れと判断してサンプリングクロックの出力を停止する。サンプリングクロックの出力が停止すると、フレーム同期検出部123もフレーム同期検出信号の出力を停止する。そして、マイコン部130では受信バッファ124から規定の長さのビット列を受け取る前にフレーム同期検出信号が立ち下がると、立下りエッジ割込処理を開始して受信バッファ124から受け取ったデータ(ビット列)を破棄するとともにＲＦ部110並びにインタフェース部120に対してリセット信号を出力した後に待機状態となる(図８参照)。 However, since the sampling clock generation unit 112 of the RF unit 110 continues to monitor the bit string of the demodulated signal demodulated by the demodulation unit 111, the bit width (pulse width) of the random bit string is not constant, and eventually the synchronization is lost. Judgment is made and sampling clock output is stopped. When the output of the sampling clock stops, the frame synchronization detection unit 123 also stops outputting the frame synchronization detection signal. Then, when the frame synchronization detection signal falls before receiving the bit string of the specified length from the reception buffer 124, the microcomputer unit 130 starts the falling edge interrupt process and receives the data (bit string) received from the reception buffer 124. After being discarded, a reset signal is output to the RF unit 110 and the interface unit 120, and then a standby state is entered (see FIG. 8).

特開２００６−２３７９３１号公報JP 2006-237931 A

ところで、上記従来例では熱雑音や電波ノイズの影響で誤同期が発生した直後に正規の無線信号を受信した場合、当該無線信号を正常に受信できない虞がある。このような現象が発生する場合について、図９のタイムチャートを参照して説明する。なお、図９におけるＮは熱雑音を復調したランダム値、Ｐはプリアンブル、Ｕはユニークワード、１，２，３…はデータである。 By the way, in the above conventional example, when a normal wireless signal is received immediately after the occurrence of erroneous synchronization due to the influence of thermal noise or radio wave noise, the wireless signal may not be received normally. A case where such a phenomenon occurs will be described with reference to a time chart of FIG. 9, N is a random value obtained by demodulating thermal noise, P is a preamble, U is a unique word, 1, 2, 3,... Are data.

時刻t=t1に誤検出が発生してフレーム同期検出信号が立ち上がると、マイコン部130が立上りエッジ割込処理を開始するが、その直後に正規の無線信号が入力されたとする。正規の無線信号が入力されたタイミング(時刻t=t9)で復調信号のビット列のパルス幅が乱れるため、サンプリングクロック生成部112は同期外れと判断する場合が多い。この場合、制御部132からインタフェース部120に対して受信バッファ124に記憶されている受信データの出力を指示する制御信号が出力される時点(時刻t=t3)よりも前に(時刻t=t2)、同期外れとなってフレーム同期検出信号が立ち下がってしまうことがある。フレーム同期検出信号の立ち下がり後にマイコン部130から制御信号が出力されているため、同期が外れてフレーム同期検出信号が立ち下がったにもかかわらず、制御信号の立ち下がりに同期して受信バッファ124からマイコン部130へ受信データが出力される(時刻t=t4 )。 When an erroneous detection occurs at time t = t1 and the frame synchronization detection signal rises, the microcomputer unit 130 starts the rising edge interrupt process, and it is assumed that a regular radio signal is input immediately thereafter. Since the pulse width of the bit string of the demodulated signal is disturbed at the timing when the regular wireless signal is input (time t = t9), the sampling clock generator 112 often determines that the synchronization is lost. In this case, before the time (time t = t3) when the control signal instructing the interface unit 120 to output the received data stored in the reception buffer 124 is output (time t = t2). ), Out of synchronization, and the frame synchronization detection signal may fall. Since the control signal is output from the microcomputer unit 130 after the fall of the frame synchronization detection signal, the reception buffer 124 is synchronized with the fall of the control signal even though the synchronization is lost and the frame synchronization detection signal falls. Is received data to the microcomputer unit 130 (time t = t4).

同時に、マイコン部130は、立上りエッジ割込み処理が終わったので、フレーム同期検出信号の立下りを検出して、立下りエッジ割込処理を開始し、蓄積した受信データを破棄する(時刻t=t6)。 At the same time, since the rising edge interrupt processing has ended, the microcomputer unit 130 detects the falling edge of the frame synchronization detection signal, starts the falling edge interrupt processing, and discards the accumulated received data (time t = t6 ).

そして、同期外れとなった時点(時刻t=t2)から後に正規の無線信号の復調信号からフレーム同期検出部123がユニークワードを検出してフレーム同期検出信号が立ち上がるが(時刻t=t5)、マイコン部130はその時点(時刻t=t5)では立下りエッジ割込処理を実行している。立下りエッジ割込処理が終了すると(時刻t=t6)、マイコン部130はフレーム同期検出信号の立ち上がりを検出して立上りエッジ割込処理を開始し、制御部132からインタフェース部120に対して受信バッファ124に記憶されている受信データの出力を指示する制御信号を出力して(時刻t=t8)、時刻t=t8以降から受信データの蓄積を開始する。ところが、誤同期に対する出力指示(時刻t=t4)から受信データは出力され続けてしまっている。 Then, the frame synchronization detection signal rises when the frame synchronization detection unit 123 detects the unique word from the demodulated signal of the regular radio signal after the time of synchronization loss (time t = t2) (time t = t5), The microcomputer unit 130 executes the falling edge interrupt process at that time (time t = t5). When the falling edge interrupt processing ends (time t = t6), the microcomputer unit 130 detects the rising edge of the frame synchronization detection signal, starts the rising edge interrupt processing, and receives it from the control unit 132 to the interface unit 120. A control signal for instructing output of received data stored in the buffer 124 is output (time t = t8), and accumulation of received data is started after time t = t8. However, the received data continues to be output from the output instruction (time t = t4) for erroneous synchronization.

その結果、マイコン部130から制御信号が出力された時点(時刻t=t8)で既に正規の無線信号の受信データが受信バッファ124から出力され始めているため、制御信号の立ち下がり時点(時刻t=t7)からマイコン部130がデータの受信を開始しても、既に出力されてしまっている先頭の３ビット分のデータを受信できないという事態が生じる。また、マイコン部130が受信データを破棄するタイミングでインタフェース部120に対して受信バッファ124の内容を破棄して、次のフレーム同期検出以降から受信データを蓄積することを指示する制御信号を出力したとしても、フレーム同期検出信号の立上り(時刻t=t5)以降であるため、受信バッファ124に受信データが蓄積されないという事態が生じる。 As a result, since the reception data of the regular radio signal has already started to be output from the reception buffer 124 at the time when the control signal is output from the microcomputer unit 130 (time t = t8), the control signal falls (time t = Even if the microcomputer unit 130 starts receiving data from t7), a situation occurs in which the data for the first three bits that have already been output cannot be received. In addition, the microcomputer unit 130 discards the content of the reception buffer 124 to the interface unit 120 at the timing of discarding the received data, and outputs a control signal instructing to accumulate the received data after the next frame synchronization detection However, since it is after the rising edge of the frame synchronization detection signal (time t = t5), a situation occurs in which the reception data is not accumulated in the reception buffer 124.

本発明は、上記課題に鑑みて為されたものであり、誤同期の直後であっても正規の無線信号を正しく受信することができる無線通信装置の提供を目的とする。 The present invention has been made in view of the above problems, and an object of the present invention is to provide a wireless communication apparatus that can correctly receive a regular wireless signal even immediately after erroneous synchronization.

本発明の無線通信装置は、アンテナで受信する無線信号を信号処理してパルス信号のビット列に変換する無線通信ブロックと、当該無線通信ブロックから出力される前記ビット列から前記無線信号に含まれる情報を取得する演算処理ブロックとを備え、前記無線信号の通信フレームは、ビット同期を取るための同期ビット列、フレーム同期を取るためのフレーム同期ビット列、前記情報に対応するデータなどを含み、前記無線通信ブロックは、前記無線信号をパルス信号のビット列からなる復調信号に復調する復調部と、前記復調信号のビット列から前記フレーム同期ビット列を検出してフレーム同期検出信号を出力するフレーム同期検出部と、当該フレーム同期検出信号が出力された場合に前記復調部から出力される復調信号を一時的に蓄積する受信データバッファと、前記演算処理ブロックから出力される受信データ出力命令を受け取ったときに前記受信データバッファに蓄積されている受信データを前記演算処理ブロックに出力させる命令処理部とを具備し、前記演算処理ブロックは、前記無線通信ブロックとの間で信号を授受するインタフェース部と、前記無線通信ブロックから出力される前記ビット列から前記無線信号に含まれる情報を取得する処理や前記フレーム同期検出信号が出力されている場合に前記受信データ出力命令を前記無線通信ブロックに出力する処理を実行する中央演算処理部とを具備し、前記命令処理部は、前記中央演算処理部から前記受信データ出力命令を受け取っていても、前記フレーム同期検出信号の出力が既に停止していた場合には、前記受信データバッファに蓄積されている受信データを出力させないことを特徴とする。 The wireless communication device of the present invention includes a wireless communication block that performs signal processing on a wireless signal received by an antenna and converts the signal into a bit string of a pulse signal, and information included in the wireless signal from the bit string output from the wireless communication block. The wireless signal communication frame includes a synchronization bit string for bit synchronization, a frame synchronization bit string for frame synchronization, data corresponding to the information, and the like, and the wireless communication block A demodulator that demodulates the radio signal into a demodulated signal composed of a bit string of a pulse signal, a frame sync detector that detects the frame sync bit string from the bit string of the demodulated signal and outputs a frame sync detection signal, and the frame When a synchronization detection signal is output, the demodulated signal output from the demodulator is temporarily stored. A reception data buffer, and a command processing unit for outputting the reception data stored in the reception data buffer to the arithmetic processing block when receiving a reception data output command output from the arithmetic processing block, The arithmetic processing block includes: an interface unit that exchanges signals with the wireless communication block; a process of acquiring information included in the wireless signal from the bit string output from the wireless communication block; and the frame synchronization detection signal A central processing unit that executes processing for outputting the received data output command to the wireless communication block when the received data output command is output from the central processing unit. even if received, when the output of said frame synchronization detection signal has already stopped, the receiving Wherein the not output the reception data stored in the data buffer.

この無線通信装置において、前記命令処理部は、前記フレーム同期検出信号と前記受信データ出力命令とが同時に入力されている場合にのみ、前記受信データバッファに蓄積されている受信データを前記演算処理ブロックに出力させることが好ましい。 In this wireless communication apparatus, the command processing unit may receive the received data stored in the received data buffer only when the frame synchronization detection signal and the received data output command are input simultaneously. Is preferably output.

この無線通信装置において、前記中央演算処理部は、前記フレーム同期検出信号に基づいて前記受信データ出力命令を出力する直前に前記フレーム同期検出信号の出力を確認し、当該フレーム同期検出信号の出力が停止している場合は前記受信データ出力命令を出力しないことが好ましい。 In this wireless communication apparatus, the central processing unit confirms the output of the frame synchronization detection signal immediately before outputting the received data output command based on the frame synchronization detection signal, and the output of the frame synchronization detection signal is It is preferable not to output the received data output command when the operation is stopped.

この無線通信装置において、前記無線通信ブロックは、前記アンテナで受信する無線信号を当該無線周波数よりも低い中間周波数の信号に変換する周波数変換部を具備し、当該周波数変換部は、前記無線周波数と前記中間周波数との差分の周波数に等しい局部発振周波数の信号を発振する局部発振器と、当該局部発振器における周波数ずれを調整する周波数調整回路とを有し、当該周波数調整回路は、前記フレーム同期検出信号の出力が停止された場合、前記周波数ずれの調整を初期化することが好ましい。 In this wireless communication apparatus, the wireless communication block includes a frequency conversion unit that converts a radio signal received by the antenna into a signal having an intermediate frequency lower than the radio frequency, and the frequency conversion unit includes the radio frequency and A local oscillator that oscillates a signal having a local oscillation frequency equal to a difference frequency from the intermediate frequency, and a frequency adjustment circuit that adjusts a frequency shift in the local oscillator, the frequency adjustment circuit including the frame synchronization detection signal It is preferable to initialize the adjustment of the frequency deviation when the output is stopped.

この無線通信装置において、前記無線通信ブロックは、前記アンテナで受信する無線信号を当該無線周波数よりも低い中間周波数の信号に変換する周波数変換部を具備し、当該周波数変換部は、前記無線周波数と前記中間周波数との差分の周波数に等しい局部発振周波数の信号を発振する局部発振器と、当該局部発振器における周波数ずれを調整する周波数調整回路とを有し、前記中央演算処理部は、前記受信データ出力命令を出力する時点で前記フレーム同期検出信号の出力が停止している場合、前記周波数調整回路による前記周波数ずれの調整を初期化する命令を出力することが好ましい。 In this wireless communication apparatus, the wireless communication block includes a frequency conversion unit that converts a radio signal received by the antenna into a signal having an intermediate frequency lower than the radio frequency, and the frequency conversion unit includes the radio frequency and A local oscillator that oscillates a signal having a local oscillation frequency equal to a difference frequency from the intermediate frequency, and a frequency adjustment circuit that adjusts a frequency shift in the local oscillator, wherein the central processing unit outputs the received data output When the output of the frame synchronization detection signal is stopped at the time of outputting the command, it is preferable to output a command for initializing the adjustment of the frequency shift by the frequency adjustment circuit.

本発明の無線通信装置は、誤同期の直後であっても正規の無線信号を正しく受信することができるという効果がある。 The wireless communication device of the present invention has an effect that it can correctly receive a regular wireless signal even immediately after a false synchronization.

本発明の実施形態の動作を説明するためのタイムチャートである。It is a time chart for demonstrating operation | movement of embodiment of this invention. 同上のブロック図である。It is a block diagram same as the above. 同上の動作を説明するためのタイムチャートである。It is a time chart for demonstrating operation | movement same as the above. 同上の動作を説明するためのタイムチャートである。It is a time chart for demonstrating operation | movement same as the above. 同上の動作を説明するためのタイムチャートである。It is a time chart for demonstrating operation | movement same as the above. 従来例を示すブロック図である。It is a block diagram which shows a prior art example. 同上の動作を説明するためのタイムチャートである。It is a time chart for demonstrating operation | movement same as the above. 同上の動作を説明するためのタイムチャートである。It is a time chart for demonstrating operation | movement same as the above. 同上の動作を説明するためのタイムチャートである。It is a time chart for demonstrating operation | movement same as the above.

以下、図面を参照して本発明の実施形態を詳細に説明する。本実施形態の無線通信装置は、図２に示すようにアンテナ３で受信する無線信号を信号処理してパルス信号のビット列に変換する無線通信ブロック２と、無線通信ブロック２から出力されるビット列から無線信号に含まれる情報(データ)を取得する演算処理ブロック１とを備えている。なお、無線信号の通信フレームは、従来例と同様に、ビット同期を取るための同期ビット列(プリアンブル)、フレーム同期を取るためのフレーム同期ビット列(ユニークワード)、前記情報に対応するデータ、誤り検出用のチェックコード(例えば、ＣＲＣ)などで構成されている。 Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. As shown in FIG. 2, the wireless communication device of the present embodiment includes a wireless communication block 2 that performs signal processing on a wireless signal received by an antenna 3 and converts it into a bit string of a pulse signal, and a bit string output from the wireless communication block 2. And an arithmetic processing block 1 for acquiring information (data) included in the radio signal. As in the conventional example, the radio signal communication frame includes a synchronization bit string (preamble) for bit synchronization, a frame synchronization bit string (unique word) for frame synchronization, data corresponding to the information, and error detection. For example, a check code (for example, CRC).

無線通信ブロック２は、増幅部20、周波数変換部21、周波数選択部22、復調部23、サンプリングクロック生成部24、受信データバッファ25、シフトレジスタ26、フレーム同期検出部(以下、「同期検出部」と略す。)27、ユニークワード(UW)レジスタ28、命令処理(命令デコード)部29を具備している。但し、本実施形態における無線通信ブロック２は、これらの各部が１つのチップに集積化されたＬＳＩ(大規模集積回路)として構成されている。 The wireless communication block 2 includes an amplifying unit 20, a frequency converting unit 21, a frequency selecting unit 22, a demodulating unit 23, a sampling clock generating unit 24, a reception data buffer 25, a shift register 26, a frame synchronization detecting unit (hereinafter referred to as “synchronizing detecting unit”). ”27, a unique word (UW) register 28, and an instruction processing (instruction decode) unit 29. However, the wireless communication block 2 in the present embodiment is configured as an LSI (Large Scale Integrated Circuit) in which these units are integrated on one chip.

アンテナ３で受信された無線信号は、増幅部20で増幅された後に周波数変換部21で無線周波数よりも低い中間周波数に変換される。この周波数変換部21は、無線周波数と中間周波数との差分の周波数に等しい局部発振周波数の信号を発振する局部発振器(図示せず)と、局部発振器における周波数ずれを調整する周波数調整回路(図示せず)とを有している。一般的な無線通信装置においては、局部発振器に周波数偏差が生じた場合、その周波数偏差に起因する残留周波数誤差により基準周波数が定まらず、周波数変調されている無線信号を復調する際にこの周波数誤差が誤復調の原因となる虞がある。このため、周波数偏差の影響を自動的にキャンセルするように局部発振器の周波数ずれを補正する機能、いわゆる自動周波数調整(Auto Frequency Control)と呼ばれる機能が搭載されている。そして、本実施形態においても自動周波数調整機能を実現するために周波数調整回路が周波数変換部21に設けられている。このような周波数調整回路は、局部発振器が具備している周波数シンセサイザ（例えば、フラクショナルＰＬＬ回路を用いた周波数シンセサイザ）を制御することによって周波数を調整している。なお、このような周波数変換部21については従来周知であるから詳細な構成及び動作の説明は省略する。 The radio signal received by the antenna 3 is amplified by the amplifying unit 20 and then converted to an intermediate frequency lower than the radio frequency by the frequency converting unit 21. The frequency converter 21 includes a local oscillator (not shown) that oscillates a signal having a local oscillation frequency equal to the difference between the radio frequency and the intermediate frequency, and a frequency adjustment circuit (not shown) that adjusts a frequency shift in the local oscillator. Z)). In a general wireless communication device, when a frequency deviation occurs in a local oscillator, the reference frequency is not determined due to a residual frequency error caused by the frequency deviation, and this frequency error is generated when demodulating a frequency-modulated radio signal. May cause erroneous demodulation. For this reason, a function for correcting the frequency deviation of the local oscillator so as to automatically cancel the influence of the frequency deviation, that is, a function called automatic frequency adjustment (Auto Frequency Control) is installed. Also in this embodiment, a frequency adjustment circuit is provided in the frequency conversion unit 21 in order to realize the automatic frequency adjustment function. Such a frequency adjustment circuit adjusts the frequency by controlling a frequency synthesizer (for example, a frequency synthesizer using a fractional PLL circuit) provided in the local oscillator. Since such a frequency converter 21 is well known in the art, a detailed description of the configuration and operation is omitted.

周波数選択部22はバンドパスフィルタからなり、周波数変換部21で周波数変換された中間周波数信号から必要な周波数帯域の信号成分(受信信号)のみを選択して出力する。この受信信号は、復調部23によって復調信号(ベースバンド信号)に復調される。サンプリングクロック生成部24は、サンプリングクロックを生成するとともに復調信号がその立ち上がりと立ち下がりの中間でサンプリングされるようにサンプリングクロックの位相を調整して出力する。また復調信号は、サンプリングクロックに同期してサンプリングされるとともに、サンプリングされたビット列(受信データ)がシフトレジスタ26に格納される。このシフトレジスタ26は、ユニークワードのビット数と同じビット数の容量を持っている。 The frequency selection unit 22 includes a band pass filter, and selects and outputs only a signal component (reception signal) in a necessary frequency band from the intermediate frequency signal frequency-converted by the frequency conversion unit 21. This received signal is demodulated into a demodulated signal (baseband signal) by the demodulator 23. The sampling clock generation unit 24 generates a sampling clock and adjusts and outputs the phase of the sampling clock so that the demodulated signal is sampled between the rising and falling edges. The demodulated signal is sampled in synchronization with the sampling clock, and the sampled bit string (received data) is stored in the shift register 26. The shift register 26 has a capacity with the same number of bits as the number of unique words.

同期検出部27は、シフトレジスタ26に格納された受信データと、UWレジスタ28に格納されているユニークワードとを比較し、両者のビット列が一致したときにフレーム同期が取れたとみなしてフレーム同期検出信号を出力する(Ｈレベルとする)。なお、UWレジスタ28には、予め演算処理ブロック１から指定されたユニークワードが格納されている。また、サンプリングクロック生成部24は復調信号の立ち上がり及び立ち下がりの監視を継続し、立ち上がり又は立ち下がりのタイミングが急激に変化したら、ビット同期が外れたとみなして同期外れ信号を同期検出部27に出力する。同期検出部27は、サンプリングクロック生成部24から同期外れ信号を受け取ると、フレーム同期検出信号の出力を停止する(Ｌレベルとする)。 The synchronization detection unit 27 compares the received data stored in the shift register 26 with the unique word stored in the UW register 28, and determines that frame synchronization has been achieved when the bit strings of the two match. A signal is output (set to H level). In the UW register 28, a unique word designated in advance from the arithmetic processing block 1 is stored. The sampling clock generator 24 continues to monitor the rise and fall of the demodulated signal, and if the rise or fall timing changes abruptly, it considers that bit synchronization has been lost and outputs an out-of-sync signal to the sync detector 27. To do. When receiving the out-of-synchronization signal from the sampling clock generation unit 24, the synchronization detection unit 27 stops outputting the frame synchronization detection signal (sets to L level).

受信データバッファ25は、同期検出部27からフレーム同期検出信号の出力が開始される(ＬレベルからＨレベルに立ち上がる)と、復調信号をサンプリングクロックに同期してサンプリングするとともにサンプリングしたビット列(受信データ)を蓄積する。 When the output of the frame synchronization detection signal is started from the synchronization detector 27 (rises from the L level to the H level), the reception data buffer 25 samples the demodulated signal in synchronization with the sampling clock and the sampled bit string (reception data ).

一方、演算処理ブロック１は、中央演算処理部(CPU)10、ＲＡＭ11、ＲＯＭ12、I/O部13、第１のシリアル通信部14、第２のシリアル通信部15、データバス16などを具備している。中央演算処理部10は、ＲＯＭ12に格納されているプログラムを実行することにより、後述する様々な処理を行っている。I/O部13は、無線通信ブロック２の同期検出部27から出力されるフレーム同期検出信号の立ち上がり及び立ち下がりを検出し、立ち上がり割込並びに立ち下がり割込をデータバス16を介して中央演算処理部10に通知する。I/O部13から立ち上がり割込が通知されると、中央演算処理部10は、立上りエッジ割込処理を開始し、受信データ出力命令をデータバス16を介して第２のシリアル通信部15に与える。そして、第２のシリアル通信部15は中央演算処理部10から与えられた受信データ出力命令を無線通信ブロック２の命令デコード部29に送信する。 On the other hand, the arithmetic processing block 1 includes a central processing unit (CPU) 10, a RAM 11, a ROM 12, an I / O unit 13, a first serial communication unit 14, a second serial communication unit 15, a data bus 16, and the like. ing. The central processing unit 10 performs various processes to be described later by executing programs stored in the ROM 12. The I / O unit 13 detects the rise and fall of the frame synchronization detection signal output from the synchronization detection unit 27 of the wireless communication block 2, and performs the centralized operation of the rising and falling interrupts via the data bus 16. Notify the processing unit 10. When the rising interrupt is notified from the I / O unit 13, the central processing unit 10 starts the rising edge interrupt process and sends the received data output command to the second serial communication unit 15 via the data bus 16. give. Then, the second serial communication unit 15 transmits the received data output command given from the central processing unit 10 to the command decoding unit 29 of the wireless communication block 2.

命令デコード部29は、第２のシリアル通信部15から受け取った受信データ出力命令をデコードして受信データバッファ25に出力する。受信データバッファ25は、命令デコード部29から受信データ出力命令を受け取ると、自己が蓄積している受信データ(ビット列)と、サンプリングクロック生成部24から入力されるサンプリングクロックとを演算処理ブロック１の第１のシリアル通信部14へ送信する。第１のシリアル通信部14は、無線通信ブロック２の受信データバッファ25から受信した受信データ及びサンプリングクロックを、データバス16を介して中央演算処理部10に転送する。中央演算処理部10は、第１のシリアル通信部14から転送される受信データをデコード(復号化)して無線信号に含まれている情報(メッセージ)を取得し、取得した情報に基づいて種々の処理を実行する。また、中央演算処理部10は、規定の長さ(１フレーム分)の情報(メッセージ)を受け取ると、リセット命令をデータバス16を介して第２のシリアル通信部15に与える。そして、第２のシリアル通信部15は中央演算処理部10から与えられたリセット命令を無線通信ブロック２の命令デコード部29に送信する。 The instruction decode unit 29 decodes the received data output command received from the second serial communication unit 15 and outputs it to the received data buffer 25. When the reception data buffer 25 receives the reception data output instruction from the instruction decoding unit 29, the reception data buffer 25 stores the reception data (bit string) stored therein and the sampling clock input from the sampling clock generation unit 24 in the arithmetic processing block 1. Transmit to the first serial communication unit 14. The first serial communication unit 14 transfers the reception data and sampling clock received from the reception data buffer 25 of the wireless communication block 2 to the central processing unit 10 via the data bus 16. The central processing unit 10 decodes the reception data transferred from the first serial communication unit 14 to acquire information (message) included in the radio signal, and performs various processing based on the acquired information. Execute the process. When the central processing unit 10 receives information (message) of a prescribed length (for one frame), it gives a reset command to the second serial communication unit 15 via the data bus 16. Then, the second serial communication unit 15 transmits the reset command given from the central processing unit 10 to the command decoding unit 29 of the wireless communication block 2.

命令デコード部29は、第２のシリアル通信部15から受け取ったリセット命令をデコードしてサンプリングクロック生成部24並びに同期検出部27に出力する。サンプリングクロック生成部24はリセット命令を受け取るとサンプリングクロックの生成を中止して初期状態に戻る。同じく、同期検出部27もリセット命令を受け取るとフレーム同期検出信号の出力を停止して初期状態に戻る。なお、本実施形態においては、I/O部13と第１及び第２のシリアル通信部14,15がインタフェース部に相当する。 The instruction decoding unit 29 decodes the reset instruction received from the second serial communication unit 15 and outputs it to the sampling clock generation unit 24 and the synchronization detection unit 27. When receiving the reset command, the sampling clock generator 24 stops generating the sampling clock and returns to the initial state. Similarly, when the synchronization detection unit 27 receives the reset command, it stops outputting the frame synchronization detection signal and returns to the initial state. In the present embodiment, the I / O unit 13 and the first and second serial communication units 14 and 15 correspond to an interface unit.

ところで、本実施形態の無線通信装置も従来例と同様に、アンテナ３に無線信号を受信していなくても、熱雑音や電波ノイズの影響で無線通信ブロック２の復調部23がランダムなビット列からなる信号を出力してしまうことがある。そして、このようなランダムなビット列の中には、ユニークワードと同じビット列が一定の確率で含まれているため、同期検出部27がフレーム同期を誤検出してフレーム同期検出信号を出力してしまう場合がある。この場合においても、演算処理ブロック１の中央演算処理部10がフレーム同期検出信号の立ち上がりに同期して立上りエッジ割込処理を開始し、受信データ出力命令を第２のシリアル通信部15から送信させてしまう。その結果、無線通信ブロック２の受信データバッファ25から受信データとサンプリングクロックが送信され、中央演算処理部10で受信データの復号化が行われてしまう。 By the way, similarly to the conventional example, the wireless communication device of the present embodiment does not receive a wireless signal to the antenna 3, and the demodulator 23 of the wireless communication block 2 is affected by a random bit string due to the influence of thermal noise and radio noise. May be output. In such a random bit string, since the same bit string as the unique word is included with a certain probability, the synchronization detection unit 27 erroneously detects frame synchronization and outputs a frame synchronization detection signal. There is a case. Even in this case, the central processing unit 10 of the processing block 1 starts the rising edge interrupt processing in synchronization with the rising edge of the frame synchronization detection signal, and transmits the received data output command from the second serial communication unit 15. End up. As a result, the reception data and the sampling clock are transmitted from the reception data buffer 25 of the wireless communication block 2, and the central processing unit 10 decodes the reception data.

ここで、無線通信ブロック２のサンプリングクロック生成部24が復調部23で復調された復調信号のビット列を監視し続けており、ランダムなビット列のビット幅(パルス幅)が一定でないためにやがては同期外れと判断してサンプリングクロックの出力を停止する。サンプリングクロックの出力が停止すると、同期検出部27もフレーム同期検出信号の出力を停止する。そして、演算処理ブロック１の中央演算処理部10では受信データバッファ25から規定の長さのビット列を受け取る前にフレーム同期検出信号が停止する(ＨレベルからＬレベルに立ち下がる)と、立下りエッジ割込処理を開始して受信データバッファ25から受け取ったデータ(ビット列)を破棄してリセット命令を出力する。 Here, the sampling clock generator 24 of the wireless communication block 2 continues to monitor the bit string of the demodulated signal demodulated by the demodulator 23, and the bit width (pulse width) of the random bit string is not constant. Sampling is judged to be off, and sampling clock output is stopped. When the output of the sampling clock stops, the synchronization detection unit 27 also stops outputting the frame synchronization detection signal. When the central processing unit 10 of the processing block 1 stops the frame synchronization detection signal (falls from the H level to the L level) before receiving the bit string of the specified length from the reception data buffer 25, the falling edge Interrupt processing is started, the data (bit string) received from the reception data buffer 25 is discarded, and a reset command is output.

既に説明したように、従来例では熱雑音や電波ノイズの影響で誤同期が発生した直後に正規の無線信号を受信した場合、当該無線信号を正常に受信できない虞があった。これに対して本実施形態の無線通信装置では、熱雑音や電波ノイズの影響で誤同期が発生した直後に正規の無線信号を受信した場合においても、当該正規の無線信号を確実に受信することができる。 As already described, in the conventional example, when a normal radio signal is received immediately after a false synchronization occurs due to the influence of thermal noise or radio wave noise, there is a possibility that the radio signal cannot be normally received. In contrast, in the wireless communication device according to the present embodiment, even when a normal wireless signal is received immediately after the occurrence of mis-synchronization due to the influence of thermal noise or radio wave noise, the normal wireless signal is reliably received. Can do.

以下、熱雑音や電波ノイズの影響で誤同期が発生し、さらに短時間で同期外れした直後に正規の無線信号を受信した場合において、本実施形態の無線通信装置の動作を、図１のタイムチャートを参照して詳細に説明する。但し、図１における「Ｎ」はノイズ、「Ｐ」はプリアンブル、「Ｕ」はユニークワード、「１」，「２」，…の数字はデータを示し、「出力」は受信データ出力命令を示している。 Hereinafter, the operation of the wireless communication apparatus according to the present embodiment will be described with reference to the time of FIG. 1 when a false wireless signal is generated due to thermal noise or radio wave noise and a regular wireless signal is received immediately after the synchronization is lost in a short time. This will be described in detail with reference to the chart. However, “N” in FIG. 1 is noise, “P” is a preamble, “U” is a unique word, “1”, “2”,... Indicate data, and “Output” indicates a received data output command. ing.

時刻t=t1に誤検出が発生してフレーム同期検出信号が立ち上がると、演算処理ブロック１の中央演算処理部10が立上りエッジ割込処理を開始するが、中央演算処理部10から第２のシリアル通信部15を介して無線通信ブロック２に受信データ出力命令が送信される時点(時刻t=t3)よりも前に(時刻t=t2)、同期外れとなってフレーム同期検出信号が立ち下がったとする。このとき、従来例においてはフレーム同期検出信号の立ち下がり前にマイコン部130から制御信号が出力されているため、同期が外れてフレーム同期検出信号が立ち下がったにもかかわらず、制御信号の立ち下がりに同期して受信バッファ124からマイコン部130へ受信データが出力されていた(図９の時刻t=t4参照 )。 When an erroneous detection occurs at time t = t1 and the frame synchronization detection signal rises, the central processing unit 10 of the processing block 1 starts the rising edge interrupt processing. When the received data output command is transmitted to the wireless communication block 2 via the communication unit 15 (time t = t3) (time t = t2), the frame synchronization detection signal falls due to loss of synchronization. To do. At this time, in the conventional example, since the control signal is output from the microcomputer unit 130 before the fall of the frame synchronization detection signal, the control signal rises even though the synchronization is lost and the frame synchronization detection signal falls. The received data was output from the reception buffer 124 to the microcomputer unit 130 in synchronization with the fall (see time t = t4 in FIG. 9).

しかしながら、本実施形態においては、図２に示すように同期検出部27が出力するフレーム同期検出信号が命令デコード部29にも入力され、命令デコード部29が受信データ出力命令(図１における出力信号)とフレーム同期検出信号との論理積を演算し、フレーム同期検出信号と受信データ出力命令とが同時に入力されている場合(両者がＨレベルの場合)にのみ、受信データバッファ25に対して受信データ出力命令を出力するようにしている。したがって、図１においては命令デコード部29が受信データ出力命令を受け取った時点(時刻t=t3)で同期外れとなり、フレーム同期検出信号が停止している(Ｌレベルになっている)ので、命令デコード部29から受信データ出力命令が出力されず、受信データバッファ25から受信データが出力されない。 However, in this embodiment, as shown in FIG. 2, the frame synchronization detection signal output from the synchronization detection unit 27 is also input to the instruction decoding unit 29, and the instruction decoding unit 29 receives the received data output command (the output signal in FIG. ) And the frame synchronization detection signal, and the frame is received by the reception data buffer 25 only when the frame synchronization detection signal and the received data output command are input simultaneously (when both are at the H level). A data output command is output. Therefore, in FIG. 1, since the instruction decode unit 29 receives the received data output instruction (time t = t3), the synchronization is lost and the frame synchronization detection signal is stopped (becomes L level). A reception data output command is not output from the decoding unit 29, and reception data is not output from the reception data buffer 25.

そして、受信データ出力命令の送信が完了すると(時刻t=t4)、中央演算処理部10はI/O部13の立ち下がり割込に応じて立下りエッジ割込処理を開始してリセット命令を出力する。なお、今の場合、受信データバッファ25から受信データが出力されていないので、中央演算処理部10は、立下りエッジ割込処理において受信データバッファ25から受け取ったデータを破棄する必要は無い。 When the transmission of the received data output command is completed (time t = t4), the central processing unit 10 starts the falling edge interrupt process in response to the falling interrupt of the I / O unit 13 and issues a reset command. Output. In this case, since the reception data is not output from the reception data buffer 25, the central processing unit 10 does not need to discard the data received from the reception data buffer 25 in the falling edge interrupt process.

そして、同期外れとなった時点(時刻t=t2)から後に正規の無線信号がアンテナ３で受信されてフレーム同期検出信号が立ち上がると(時刻t=t5)、中央演算処理部10はI/O部13の立ち上がり割込に応じて立上りエッジ割込処理を開始し(時刻t=t6)、受信データ出力命令を第２のシリアル通信部15から命令デコード部29へ送信させる(時刻t=t7〜t8)。命令デコード部29は、受信データ出力命令(ACT信号)を受け取った時点でフレーム同期検出信号がＨレベルであるので、受信データバッファ25に対して受信データ出力命令を出力する。そして、受信データ出力命令を受けた受信データバッファ25から受信データとサンプリングクロックが出力される(時刻t=t8)。受信データバッファ25は、受信データ出力命令を受け取った時点から受信データの出力を開始しており、図９に示した従来例のように受信データ出力命令を受け取る以前に受信データを出力していない。したがって、演算処理ブロック１の第１のシリアル通信部14では、受信データバッファ25に蓄積されていたデータを先頭(「１」のデータ)から順番に正しく受信することができる。 Then, when a normal radio signal is received by the antenna 3 after the point of synchronization loss (time t = t2) and the frame synchronization detection signal rises (time t = t5), the central processing unit 10 performs I / O The rising edge interrupt process is started in response to the rising interrupt of the unit 13 (time t = t6), and the received data output command is transmitted from the second serial communication unit 15 to the instruction decoding unit 29 (time t = t7 to t8). The instruction decode unit 29 outputs the received data output command to the received data buffer 25 because the frame synchronization detection signal is at the H level when the received data output command (ACT signal) is received. The received data and sampling clock are output from the received data buffer 25 that has received the received data output command (time t = t8). The reception data buffer 25 starts outputting the reception data from the time when the reception data output command is received, and does not output the reception data before receiving the reception data output command as in the conventional example shown in FIG. . Accordingly, the first serial communication unit 14 of the arithmetic processing block 1 can correctly receive the data stored in the reception data buffer 25 in order from the head (data “1”).

このように本実施形態の無線通信装置では、演算処理ブロック１の命令デコード部29が、同期検出部27がフレーム同期検出信号の出力を開始してから当該フレーム同期検出信号の出力を停止するまでの間に受信データ出力命令を受け取らなかった場合、同期検出部27が次回のフレーム同期検出信号の出力を開始するまでの間に演算処理ブロック１の中央演算処理部10から受信データ出力命令が出力されても、受信データバッファ25に蓄積されている受信データを出力させないようにしている。その結果、上述したように誤同期の直後であっても正規の無線信号を正しく受信することができる。また、本実施形態では、命令デコード部29が受信データ出力命令とフレーム同期検出信号との論理積を演算し、フレーム同期検出信号と受信データ出力命令とが同時に入力されていない場合(少なくとも何れか一方がＬレベルの場合)、受信データバッファ25に対して受信データ出力命令を出力しないという、比較的に簡単な構成で実現できる利点がある。 As described above, in the wireless communication apparatus according to the present embodiment, the instruction decoding unit 29 of the arithmetic processing block 1 until the synchronization detection unit 27 stops outputting the frame synchronization detection signal after the synchronization detection unit 27 starts outputting the frame synchronization detection signal. If the received data output command is not received during this period, the received data output command is output from the central processing unit 10 of the processing block 1 until the synchronization detection unit 27 starts outputting the next frame synchronization detection signal. However, the reception data stored in the reception data buffer 25 is not output. As a result, as described above, it is possible to correctly receive a regular radio signal even immediately after the erroneous synchronization. In this embodiment, the instruction decoding unit 29 calculates a logical product of the reception data output instruction and the frame synchronization detection signal, and the frame synchronization detection signal and the reception data output instruction are not input at the same time (at least one of them). When one is at the L level), there is an advantage that it can be realized with a relatively simple configuration in which a reception data output command is not output to the reception data buffer 25.

ところで、上述のように誤同期が短時間で解消する(同期外れとなる)のは、正規の無線信号が受信された場合が多いと考えられる。一方、熱雑音等による誤同期が発生している場合、周波数変換部21の周波数調整回路によって調整された局部発振周波数が、本来の無線信号に対応した局部発振周波数から大きく外れている可能性がある(図３における「AFC周波数」参照)。 By the way, as described above, it is considered that there are many cases in which a normal radio signal is received in order to eliminate erroneous synchronization in a short time (become out of synchronization). On the other hand, if mis-synchronization due to thermal noise or the like has occurred, there is a possibility that the local oscillation frequency adjusted by the frequency adjustment circuit of the frequency converter 21 is significantly different from the local oscillation frequency corresponding to the original radio signal. Yes (see “AFC frequency” in FIG. 3).

したがって、図３に示すように同期外れとなった時点(時刻t=t2)で、無線通信ブロック２の周波数変換部21における周波数調整回路の周波数ずれの調整(AFC周波数)を初期化すれば、正規の無線信号に対して周波数調整回路が周波数ずれの調整を完了するまでの時間を短縮することができる。 Therefore, as shown in FIG. 3, at the time of loss of synchronization (time t = t2), if the frequency shift adjustment (AFC frequency) of the frequency adjustment circuit in the frequency conversion unit 21 of the wireless communication block 2 is initialized, It is possible to shorten the time until the frequency adjustment circuit completes the adjustment of the frequency deviation with respect to the regular radio signal.

あるいは、図４に示すように受信データ出力命令を出力する時点(時刻t=t4)でフレーム同期検出信号の出力が停止している場合、中央演算処理部10が第２のシリアル通信部15を介して初期化命令を送信することで周波数調整回路による周波数ずれの調整を初期化してもよい。 Alternatively, as shown in FIG. 4, when the output of the frame synchronization detection signal is stopped when the reception data output command is output (time t = t4), the central processing unit 10 causes the second serial communication unit 15 to The adjustment of the frequency deviation by the frequency adjustment circuit may be initialized by transmitting an initialization command through the frequency adjustment circuit.

また、命令デコード部29が受信データ出力命令とフレーム同期検出信号との論理積を演算して受信データバッファ25に対する受信データ出力命令の出力可否を決定する構成に加えて、以下のようにしても構わない。すなわち、図５に示すようにフレーム同期検出信号に基づいて受信データ出力命令を出力する直前にフレーム同期検出信号の出力を確認し(時刻t=t３参照)、フレーム同期検出信号の出力が停止している場合、中央演算処理部10は、命令デコード部29から受信データ出力命令を出力しないようにすればよい。なお、図５における時刻t=t3〜t4の「出力」の破線は受信データ出力命令の出力を中止したことを表している。このようにすれば、図５に示すようにI/O部13からフレーム同期検出信号の立ち下がり割込を受けても立下りエッジ割込処理が実行されず、フレーム同期検出信号の立上りから直ちに立上りエッジ割込処理を実行できるので、図１に示した構成に比べて受信データバッファ25の最大長を短縮することができる。 In addition to the configuration in which the instruction decode unit 29 calculates the logical product of the reception data output instruction and the frame synchronization detection signal to determine whether or not the reception data output instruction can be output to the reception data buffer 25, the following is also possible. I do not care. That is, as shown in FIG. 5, the output of the frame synchronization detection signal is confirmed immediately before outputting the received data output command based on the frame synchronization detection signal (see time t = t3), and the output of the frame synchronization detection signal is stopped. The central processing unit 10 should not output the received data output command from the command decoding unit 29. Note that the broken line of “output” at time t = t3 to t4 in FIG. 5 indicates that the output of the received data output command is stopped. In this way, as shown in FIG. 5, the falling edge interrupt process is not executed even when the falling edge of the frame synchronization detection signal is received from the I / O unit 13, and immediately after the rising edge of the frame synchronization detection signal. Since the rising edge interrupt process can be executed, the maximum length of the reception data buffer 25 can be shortened compared to the configuration shown in FIG.

１演算処理ブロック
２無線通信ブロック
３アンテナ
10 中央演算処理部
23 復調部
25 受信データバッファ
27 フレーム同期検出部
29 命令デコード部(命令処理部) 1 Arithmetic processing block 2 Wireless communication block 3 Antenna
10 Central processing unit
23 Demodulator
25 Receive data buffer
27 Frame sync detector
29 Instruction decode section (instruction processing section)

Claims

A radio communication block that processes a radio signal received by an antenna and converts it into a bit string of a pulse signal, and an arithmetic processing block that acquires information contained in the radio signal from the bit string output from the radio communication block The wireless signal communication frame includes a synchronization bit string for bit synchronization, a frame synchronization bit string for frame synchronization, data corresponding to the information, and the like.
The radio communication block includes a demodulator that demodulates the radio signal into a demodulated signal composed of a bit string of a pulse signal, and a frame sync detector that detects the frame sync bit string from the bit string of the demodulated signal and outputs a frame sync detection signal A reception data buffer for temporarily storing the demodulated signal output from the demodulator when the frame synchronization detection signal is output, and a reception data output command output from the arithmetic processing block An instruction processing unit for outputting the reception data stored in the reception data buffer to the arithmetic processing block;
The arithmetic processing block includes: an interface unit that exchanges signals with the wireless communication block; a process of acquiring information included in the wireless signal from the bit string output from the wireless communication block; and the frame synchronization detection signal A central processing unit that executes a process of outputting the received data output command to the wireless communication block when
Even if the command processing unit has received the reception data output command from the central processing unit, but the output of the frame synchronization detection signal has already stopped, the reception stored in the reception data buffer A wireless communication apparatus characterized by not outputting data.

The command processing unit causes the arithmetic processing block to output received data stored in the received data buffer only when the frame synchronization detection signal and the received data output command are input simultaneously. The wireless communication apparatus according to claim 1.

The central processing unit confirms the output of the frame synchronization detection signal immediately before outputting the reception data output command based on the frame synchronization detection signal, and when the output of the frame synchronization detection signal is stopped 3. The wireless communication apparatus according to claim 1, wherein the reception data output command is not output.

The radio communication block includes a frequency converter that converts a radio signal received by the antenna into a signal having an intermediate frequency lower than the radio frequency, and the frequency converter includes a difference between the radio frequency and the intermediate frequency. A local oscillator that oscillates a signal having a local oscillation frequency equal to the frequency of the frequency, and a frequency adjustment circuit that adjusts a frequency shift in the local oscillator, and the frequency adjustment circuit stops output of the frame synchronization detection signal 3. The wireless communication apparatus according to claim 1, wherein adjustment of the frequency deviation is initialized.

The radio communication block includes a frequency converter that converts a radio signal received by the antenna into a signal having an intermediate frequency lower than the radio frequency, and the frequency converter includes a difference between the radio frequency and the intermediate frequency. A local oscillator that oscillates a signal having a local oscillation frequency equal to the frequency of the frequency, and a frequency adjustment circuit that adjusts a frequency shift in the local oscillator,
The central processing unit outputs a command for initializing the adjustment of the frequency shift by the frequency adjustment circuit when the output of the frame synchronization detection signal is stopped when the reception data output command is output. The wireless communication apparatus according to claim 1 or 2.