JP5491333B2 - 集積回路の設計のためのデバイスミスマッチのモデリングおよびシミュレーティング - Google Patents
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Description
に従って分散が減少する個々の相関係数をキャプチャする。
Claims (15)
- 集積回路を設計するためのデバイスマッチングを推定するコンピュータに実装される方法であって、
抵抗またはトランジスタを含むデバイスに対する複数のレイアウトスタイルを特定することであって、各レイアウトスタイルは、デバイスの配置に対する幾何学的制約および前記幾何学的制約に対応するデバイスマッチングを特徴付ける統計的シミュレーションパラメータに対する1つ以上の相関係数を特定する値を含むことと、
前記集積回路の対するスケマティックであって、デバイス、デバイス間の接続、および前記デバイスの電気特性を特定する電気的パラメータを含むスケマティックを特定することと、
前記デバイスのサイズおよび前記デバイスの配置を特定することによってスケマティックから前記集積回路に対するレイアウトを、前記回路スケマティック中の1つ以上のデバイスに対するレイアウトスタイルを選択するためにコンピュータを用いて画定することと、
前記レイアウトに対する1つ以上のパフォーマンス指標を、前記特定されたレイアウトスタイルに従って、統計的に相関するデバイスモデルを用いて回路パフォーマンスをシミュレーションするためにコンピュータを用いて評価すること、
を含む方法。 - さらに、
前記集積回路の設計においてより強いマッチングのためにデバイスの少なくとも1つのペアを特定することと、
前記デバイスの少なくとも1つのペアに対してより大きな相関係数を有する第1のレイアウトスタイルを選択することを含む、請求項1に記載の方法。 - 前記レイアウトスタイルは、少なくとも幾つかのデバイスのシミュレーションパラメータについてのミスマッチの異なる度合いに対する複数のレイアウトスタイルを含み、より小さな相関係数にはより弱いマッチングが対応し、より大きな相関係数にはより強いマッチングが対応する、請求項1に記載の方法。
- レイアウトスタイルを選択することは、前記コンピュータのグラフィカルユーザインターフェイス中の選択アイテムを選択することであって、前記グラフィカルユーザインターフェイスは、少なくとも幾つかのデバイスについてのミスマッチの異なる度合いに対する複数の選択を含み、より小さな相関係数にはより弱いマッチングが対応し、より大きな相関係数にはより強いマッチングが対応する、前記回路スケマティック中の選択されたデバイスに対応するレイアウトスタイルに対する選択を提示する、請求項1に記載の方法。
- 回路パフォーマンスをシミュレーションすることは、
対応するレイアウトスタイルの前記特定に従ってシミュレーションパラメータに対する相関された値を選択することによって、複数のシミュレーションされたレイアウトを画定することと、
前記集積回路の設計においてより強いマッチングのためにデバイスの少なくとも1つのペアを特定するために、前記シミュレーションされたレイアウトに対する1つ以上のパフォーマンス指標を評価すること、
を含む、請求項1に記載の方法。 - 前記レイアウトは第1のレイアウトであり、さらに、
前記回路に対する第2のレイアウトを、前記1つ以上のパフォーマンス指標の少なくとも1つを改善するために、1つ以上デバイスに対するレイアウトを変更することによって、画定することと、
前記第2のレイアウトに対する前記1つ以上のパフォーマンス指標を、前記特定されたレイアウトスタイルに従って、相関するデバイスモデルを用いて回路パフォーマンスをシミュレーションし、前記集積回路の設計においてより強いマッチングのためにデバイスの少なくとも1つのペアを特定するためにコンピュータを用いて評価すること、
を含む、請求項1に記載の方法。 - 前記レイアウトスタイルは、デバイスの配置に対する幾何学的制約およびデバイスのシミュレーションパラメータについて対応する相関係数を含み、
前記スケマティック中の1つ以上のデバイスに対する前記レイアウトスタイルを選択することは、前記コンピュータのグラフィカルユーザインターフェイス中の対応する選択アイテムを選択することを含み、
回路パフォーマンスをシミュレーションすることは、対応するレイアウトスタイルの前記特定に従ってシミュレーションパラメータに対する相関された値を選択することによって、複数のシミュレーションされたレイアウトを画定すること、および前記シミュレーションされたレイアウトに対する1つ以上のパフォーマンス指標を評価することを含む、請求項1に記載の方法。 - 請求項1乃至7の任意のステップを実行するためのコンピュータプログラムを記憶するコンピュータが読み取り可能な媒体。
- 集積回路を設計するためのデバイスマッチングを推定するための装置であって、前記装置はコンピュータ命令を実行するコンピュータを含み、前記コンピュータは、
抵抗またはトランジスタを含むデバイスに対する複数のレイアウトスタイルを特定することであって、各レイアウトスタイルは、デバイスの配置に対する幾何学的制約および前記幾何学的制約に対応するデバイスマッチングを特徴付ける統計的シミュレーションパラメータに対する1つ以上の相関係数を特定する値を含むことと、
前記集積回路の対するスケマティックであって、デバイス、デバイス間の接続、および前記デバイスの電気特性を特定する電気的パラメータを含むスケマティックを特定することと、
前記デバイスのサイズおよび前記デバイスの配置を特定することによってスケマティックから前記集積回路に対するレイアウトを、前記回路スケマティック中の1つ以上のデバイスに対するレイアウトスタイルを選択するためにコンピュータを用いて画定することと、
前記レイアウトに対する1つ以上のパフォーマンス指標を、前記特定されたレイアウトスタイルに従って、統計的に相関するデバイスモデルを用いて回路パフォーマンスをシミュレーションするためにコンピュータを用いて評価すること、
のためのコンピュータ命令を含む装置。 - 前記集積回路の設計においてより強いマッチングのためにデバイスの少なくとも1つのペアを特定することと、
前記デバイスの少なくとも1つのペアに対してより大きな相関係数を有する第1のレイアウトスタイルを選択することを含む、請求項1に記載の方法。 - 前記レイアウトスタイルは、少なくとも幾つかのデバイスのシミュレーションパラメータについてのミスマッチの異なる度合いに対する複数のレイアウトスタイルを含み、より小さな相関係数にはより弱いマッチングが対応し、より大きな相関係数にはより強いマッチングが対応する、請求項9に記載の装置。
- レイアウトスタイルを選択することは、前記コンピュータのグラフィカルユーザインターフェイス中の選択アイテムを選択することであって、前記グラフィカルユーザインターフェイスは、少なくとも幾つかのデバイスについてのミスマッチの異なる度合いに対する複数の選択を含み、より小さな相関係数にはより弱いマッチングが対応し、より大きな相関係数にはより強いマッチングが対応する、前記回路スケマティック中の選択されたデバイスに対応するレイアウトスタイルに対する選択を提示する、請求項9に記載の装置。
- 回路パフォーマンスをシミュレーションすることは、
対応するレイアウトスタイルの前記特定に従ってシミュレーションパラメータに対する相関された値を選択することによって、複数のシミュレーションされたレイアウトを画定することと、
前記集積回路の設計においてより強いマッチングのためにデバイスの少なくとも1つのペアを特定するために、前記シミュレーションされたレイアウトに対する1つ以上のパフォーマンス指標を評価すること、
を含む、請求項9に記載の装置。 - 前記レイアウトは第1のレイアウトであり、さらに、
前記回路に対する第2のレイアウトを、前記1つ以上のパフォーマンス指標の少なくとも1つを改善するために、1つ以上デバイスに対するレイアウトを変更することによって、画定することと、
前記第2のレイアウトに対する前記1つ以上のパフォーマンス指標を、前記特定されたレイアウトスタイルに従って、前記集積回路の設計においてより強いマッチングのためにデバイスの少なくとも1つのペアを特定するために、相関するデバイスモデルを用いて回路パフォーマンスをシミュレーションするためにコンピュータを用いて評価すること、
を含む、請求項9に記載の装置。 - 前記レイアウトスタイルは、デバイスの配置に対する幾何学的制約およびデバイスのシミュレーションパラメータについて対応する相関係数を含み、
前記スケマティック中の1つ以上のデバイスに対する前記レイアウトスタイルを選択することは、前記コンピュータのグラフィカルユーザインターフェイス中の対応する選択アイテムを選択することを含み、
回路パフォーマンスをシミュレーションすることは、対応するレイアウトスタイルの前記特定に従ってシミュレーションパラメータに対する相関された値を選択することによって、複数のシミュレーションされたレイアウトを画定すること、および前記シミュレーションされたレイアウトに対する1つ以上のパフォーマンス指標を評価することを含む、請求項9に記載の装置。
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