JP5357983B2 - 拡大の作業範囲を有するデジタルプリディストーション回路及びその方法 - Google Patents
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- 拡大の作業範囲を有するデジタルプリディストーション回路であって、プリディストーション関数、D/A変換器、周波数の変換を実施する乗算器、およびパワー増幅器を含み、前記デジタルプリディストーション回路は、
送信待ちシグナル及びゲイン校正要素を受信し、前記送信待ちシグナルを前記ゲイン校正要素に掛けさせて、且つ積の結果を前記プリディストーション関数にアウトプットするための乗算器と、
及び、予定の参考ゲイン及び前記パワー増幅器の推定ゲインを使用することによって、前記ゲイン校正要素を計算し、且つ計算した前記ゲイン校正要素を前記乗算器にアウトプットするための設備とをさらに含み、
これにより、前記パワー増幅器のゲインが快速的に校正され、
前記D/A変換器にインプットされたデータ、前記デジタルプリディストーション回路におけるA/D変換器からアウトプットしたデータ、及び、前記パワー増幅器の前記推定ゲインを受信し、デジタルプリディストーション自己適応アルゴリズムを実施することで新しいプリディストーション関数を計算し、且つ前記プリディストーション関数を、計算された前記新しいプリディストーション関数と等しくするように更新し、及び前記予定の参考ゲインを、受信した前記パワー増幅器の前記推定ゲインと等しくするように更新するためのゲイントラッキングデジタルプリディストーション自己適応モジュールをさらに含み、これにより更新された前記予定の参考ゲインが前記ゲイン校正要素を計算することに用いられるデジタルプリディストーション回路。 - 前記設備は、前記予定の参考ゲインを前記パワー増幅器の前記推定ゲインで割ることによって、前記ゲイン校正要素を計算するための除算器をさらに含む請求項1に記載のデジタルプリディストーション回路。
- 前記パワー増幅器の前記推定ゲインは前記D/A変換器にインプットしたデータ及び前記デジタルプリディストーション回路におけるA/D変換器からアウトプットしたデータによって得られる請求項1に記載のデジタルプリディストーション回路。
- 前記予定の参考ゲインが前記プリディストーション関数に対応する前記パワー増幅器のゲインである請求項1に記載のデジタルプリディストーション回路。
- 前記予定の参考ゲインは、前記パワー増幅器のメーカが指定した前記パワー増幅器のゲインであり、且つ前記プリディストーション関数は前記パワー増幅器の前記メーカが指定した対応のプリディストーション関数である請求項4に記載のデジタルプリディストーション回路。
- 前記プリディストーション関数が前記パワー増幅器のインプットとアウトプット応答によって導き出され、且つ前記予定の参考ゲインが前記パワー増幅器の対応のゲインである請求項4に記載のデジタルプリディストーション回路。
- 各のプリディストーション関数が1つの送信パワーレベルに適当する複数のプリディストーション関数と、
それぞれが送信待ちシグナル及び複数のゲイン校正要素の1つを受信し、前記送信待ちシグナルを前記複数のゲイン校正要素の1つに掛けさせて、且つ積の結果を前記複数のプリディストーション関数の1つにアウトプットするように配置された複数の乗算器と、
それぞれが複数の予定の参考ゲインの1つ及び前記パワー増幅器の前記推定ゲインを使用することによって前記複数のゲイン校正要素の1つを計算し、且つ対応の計算されたゲ
イン校正要素を前記複数の乗算器の1つにアウトプットするように設置された複数の設備と、
前記送信待ちシグナルを受信し且つ前記送信パワーレベルを推定し、これにより、推定された前記送信パワーレベルに対応する前記複数のプリディストーション関数の1つを選択するように配置されたパワー推定器とをさらに含む請求項1に記載のデジタルプリディストーション回路。 - 各の設備は、対応の前記複数の予定の参考ゲインの1つを前記パワー増幅器の前記推定ゲインで割ることによって対応の前記複数のゲイン校正要素の1つを計算するための除算器をさらに含む請求項7に記載のデジタルプリディストーション回路。
- 前記複数の予定の参考ゲインにおける1つ毎は、前記複数のプリディストーション関数の1つに対応する前記パワー増幅器のゲインである請求項7に記載のデジタルプリディストーション回路。
- 前記ゲイントラッキングデジタルプリディストーション自己適応モジュールは、前記複数のプリディストーション関数から選択されたプリディストーション関数を、計算した前記新しいプリディストーション関数と等しくするように更新し、及び前記複数のプリディストーション関数から選択されたプリディストーション関数に対応する前記予定の参考ゲインを前記パワー増幅器の前記推定ゲインに更新する請求項7に記載のデジタルプリディストーション回路。
- デジタルプリディストーション回路の作業範囲を拡大するための方法であって、
予定の参考ゲイン及び前記デジタルプリディストーション回路におけるパワー増幅器の推定ゲインを使用することによって、ゲイン校正要素を計算するステップと、
送信待ちシグナルを、計算した前記ゲイン校正要素に掛けさせて、且つ積の結果を前記デジタルプリディストーション回路におけるプリディストーション関数にアウトプットするステップとを含み、
これにより、前記パワー増幅器のゲインが快速に校正され、
前記デジタルプリディストーション回路におけるD/A変換器にインプットしたデータ、前記デジタルプリディストーション回路におけるA/D変換器からアウトプットしたデータ、及び前記パワー増幅器の前記推定ゲインを受信することと、
デジタルプリディストーション自己適応アルゴリズムを実施し、新しいプリディストーション関数を計算することと、
前記プリディストーション関数を、計算した前記新しいプリディストーション関数と等しくするように更新し、且つ前記予定の参考ゲインを前記パワー増幅器の前記推定ゲインに更新することとをさらに含み、
これにより、更新された前記予定の参考ゲインが前記ゲイン校正要素を計算することに用いられる方法。 - 前記計算するステップにおいて、前記予定の参考ゲインを前記パワー増幅器の前記推定ゲインで割ることによって、前記ゲイン校正要素を計算する請求項11に記載の方法。
- 前記パワー増幅器の前記推定ゲインが前記デジタルプリディストーション回路におけるD/A変換器にインプットしたデータ及び前記デジタルプリディストーション回路におけるA/D変換器からアウトプットしたデータによって得られる請求項11に記載の方法。
- 前記予定の参考ゲインは、前記プリディストーション関数に対応する前記パワー増幅器のゲインである請求項11に記載の方法。
- 前記予定の参考ゲインは、前記パワー増幅器のメーカが指定した前記パワー増幅器のゲインであり、且つ前記プリディストーション関数は前記パワー増幅器のメーカが指定した対応のプリディストーション関数である請求項14に記載の方法。
- 前記プリディストーション関数は、前記パワー増幅器のインプットとアウトプット応答によって導き出され、且つ前記予定の参考ゲインは前記パワー増幅器の対応のゲインである請求項14に記載の方法。
- 複数の予定の参考ゲイン及び前記パワー増幅器の前記推定ゲインを使用することによって、複数のゲイン校正要素を計算することと、
前記複数のゲイン校正要素における1つ毎を前記送信待ちシグナルに掛けさせることと、
積の結果の1つを前記デジタルプリディストーション回路における複数のプリディストーション関数の相応の1つにアウトプットし、そのうち、各のプリディストーション関数が1つの送信パワーレベルに適当することと、
前記送信待ちシグナルのパワーを推定し、且つ前記送信待ちシグナルの推定した前記パワーに相応する前記複数のプリディストーション関数の1つを選択することとをさらに含む請求項11に記載の方法。 - 前記計算するステップにおいて、対応の前記複数の予定の参考ゲインの1つを前記パワー増幅器の前記推定ゲインで割ることによって、前記複数のゲイン校正要素における1つ毎を計算する請求項17に記載の方法。
- 前記複数の予定の参考ゲインにおける1つ毎は、前記複数のプリディストーション関数の1つに相応する前記パワー増幅器のゲインである請求項17に記載の方法。
- 前記複数のプリディストーション関数から選択されたプリディストーション関数を、計算した前記新しいプリディストーション関数と等しくするように更新し、且つ前記複数のプリディストーション関数から選択されたプリディストーション関数に対応する前記予定の参考ゲインを、前記パワー増幅器の前記推定ゲインと等しくするように更新することをさらに含む請求項17に記載の方法。
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