JP5321343B2 - コネクタ検出回路 - Google Patents
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図6は、第1の実施の形態におけるコネクタ検出回路100を示すブロック図である。図1に示すコネクタ検出回路100との違いは、プルアップ抵抗R2に代えて、プルアップ抵抗回路6を有することにある。その他の同一又は対応する構成要素には同一符号を付している。本第1の実施の形態について、既述した説明を除き、以下に説明する。
図7は、第2の実施の形態におけるコネクタ検出回路100を示すブロック図である。図7のコネクタ検出回路100と図6の第1の実施の形態におけるコネクタ検出回路100との違いは、プルアップ抵抗回路6内の具体的構成およびタイマー回路7を有することにある。
図8は、第3の実施の形態におけるコネクタ検出回路100を示すブロック図である。図8のコネクタ検出回路100と図6の第1の実施の形態におけるコネクタ検出回路100との違いは、プルアップ抵抗回路6内の具体的構成並びにタイマー回路7とラッチ回路8を有することにある。
図9は、第4の実施の形態におけるコネクタ検出回路100を示すブロック図である。図9のコネクタ検出回路100は、図7の第2の実施の形態におけるコネクタ検出回路100の変形例である。その違いは、タイマー回路7が、前記第1の入力端子の電位レベルを検出することにある。
2 電源供給検出回路 6 プルアップ抵抗回路 7 タイマー回路 8 ラッチ回路
R1,R2 プルアップ抵抗 R3 プルダウン抵抗 C1 バイパスコンデンサ
21 USBケーブルジャック 22 ステレオヘッドホンジャック
23 モノラルヘッドホンジャック
Claims (4)
- 第1および第2のコネクタ端子を有する第1のコネクタに接続されるコネクタ検出回路であって、
前記第1のコネクタには、前記第1のコネクタ端子を電源端子に接続して前記第2のコネクタ端子を第1の状態にする第1種の第2のコネクタと、前記第1のコネクタ端子をグランドに接続またはオープン状態にして前記第2のコネクタ端子を第2の状態にする第2種の第2のコネクタとのいずれかが接続可能であり、前記第1のコネクタ端子とグランドとの間にはバイパスコンデンサが接続され、
前記第1のコネクタ端子に接続される第1の入力端子と、
前記第2のコネクタ端子に接続される第2の入力端子と、
前記第2の入力端子の前記第1および第2の状態を検出するコネクタ種類検出回路と、
前記コネクタ種類検出回路が前記第1の状態を検出した場合に前記第1の入力端子に接続されるプルダウン抵抗と、
前記コネクタ種類検出回路が前記第2の状態を検出した場合に前記第1の入力端子に接続されるプルアップ抵抗とを有し、
前記プルアップ抵抗の抵抗値は、前記コネクタ検出回路が前記第2の状態を検出してから規定期間は第1の抵抗値に設定され、前記規定期間経過後は前記第1の抵抗値より大きい第2の抵抗値に設定されるコネクタ検出回路。 - 前記プルアップ抵抗は、第1および第2のプルアップ抵抗を有し、前記規定期間、前記第1、第2のプルアップ抵抗が並列に前記第1の入力端子に接続され、前記規定期間経過後に前記第2のプルアップ抵抗が前記第1の入力端子と電気的に切断される請求項1記載のコネクタ検出回路。
- 前記プルアップ抵抗は、前記規定期間、前記第1の入力端子と前記電源端子との間に接続され、前記規定期間経過後に非接続にされ、
さらに、前記規定期間経過後に前記第1の入力端子の電位を記憶する記憶回路を有する請求項1記載のコネクタ検出回路。 - 前記規定期間は、前記コネクタ検出回路が前記第2の状態を検出した後、前記第1の入力端子がHレベルになるまでの期間である請求項1記載のコネクタ検出回路。
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