JP5166194B2 - アーキテクチャ検証装置 - Google Patents
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Description
複数のモジュールおよびバスを含むアーキテクチャの解析を支援するアーキテクチャ検証装置であって、
前記アーキテクチャの処理時間に関する制約情報を入力する入力部と、
前記モジュールが前記バスを利用するためのバストランザクションを監視して、バストランザクション情報を取得するバス監視部と、
前記モジュールがデータを受信するための受信トランザクション、前記モジュールが前記データに対して行う処理、および前記モジュールが前記データを送信するための送信トランザクションを監視して、前記受信トランザクションに関する受信トランザクション情報、前記モジュールの処理内容および処理時間を示す処理情報、ならびに前記送信トランザクションに関する送信トランザクション情報を取得するモジュール監視部と、
前記入力部によって入力された制約情報と、前記バス監視部によって取得されたバストランザクション情報と、前記モジュール監視部によって取得された受信トランザクション情報、処理情報、および送信トランザクション情報と、を関連付けて、アーキテクチャ情報を生成するアーキテクチャ情報生成部と、
前記アーキテクチャ情報生成部によって生成されたアーキテクチャ情報を出力する出力部と、を備えることを特徴とするアーキテクチャ検証装置が提供される。
11 入力部
12 バス監視部
13 モジュール監視部
14 アーキテクチャ情報生成部
141 アーキテクチャ再構築部
142 アーキテクチャ情報更新部
143 アーキテクチャ案作成部
144 解析部
145 評価部
15 記憶部
15a アーキテクチャ情報
15b 解析結果
15c 評価結果
16 出力部
20 入力装置
30 出力装置
40 システム実行装置
Claims (5)
- 複数のモジュールおよびバスを含むアーキテクチャの解析を支援するアーキテクチャ検証装置であって、
前記アーキテクチャの処理時間に関する制約情報を入力する入力部と、
前記モジュールが前記バスを利用するためのバストランザクションを監視して、バストランザクション情報を取得するバス監視部と、
前記モジュールがデータを受信するときのトランザクションであって、前記バストランザクションに含まれる受信トランザクションと、前記モジュールが前記データに対して行う処理と、前記モジュールが前記データを送信するときのトランザクションであって、前記バストランザクションに含まれる送信トランザクションとを監視して、前記受信トランザクションに関する受信トランザクション情報と、前記モジュールの処理内容および処理時間を示す処理情報と、前記送信トランザクションに関する送信トランザクション情報とを取得するモジュール監視部と、
前記入力部によって入力された制約情報と、前記バス監視部によって取得されたバストランザクション情報と、前記モジュール監視部によって取得された受信トランザクション情報、処理情報、および送信トランザクション情報と、を関連付けて、アーキテクチャ情報を生成するアーキテクチャ情報生成部と、
前記アーキテクチャ情報生成部によって生成されたアーキテクチャ情報を出力する出力部と、を備えることを特徴とするアーキテクチャ検証装置。 - 前記入力部は、前記アーキテクチャの処理時間に影響を与えるパラメータをさらに入力し、
前記アーキテクチャ情報生成部によって生成されたアーキテクチャ情報を記憶する記憶部と、
前記入力部によって入力されたパラメータを用いて前記記憶部に記憶されたアーキテクチャ情報に対応するアーキテクチャを再構築するアーキテクチャ再構築部と、
前記アーキテクチャ再構築部によって再構築されたアーキテクチャを解析して、前記記憶部に記憶されたアーキテクチャ情報を更新するアーキテクチャ情報更新部と、をさらに備え、
前記出力部は、前記アーキテクチャ情報更新部によって更新されたアーキテクチャ情報を出力する請求項1に記載のアーキテクチャ検証装置。 - 前記入力部は、前記アーキテクチャの処理時間に影響を与えるパラメータをさらに入力し、
前記アーキテクチャ情報生成部によって生成されたアーキテクチャ情報を記憶する記憶部と、
前記入力部によって入力された制約情報およびパラメータ、ならびに前記記憶部に記憶されたアーキテクチャ情報に基づいてアーキテクチャ案を作成するアーキテクチャ案作成部と、
前記アーキテクチャ案作成部によって作成されたアーキテクチャ案を解析する解析部と、をさらに備え、
前記出力部は、前記解析部の解析結果を出力する請求項1に記載のアーキテクチャ検証装置。 - 所定の評価基準に基づいて前記解析部の解析結果を評価する評価部をさらに備え、
前記出力部は、前記評価部の評価結果とともに、前記解析部の解析結果を出力する請求項3に記載のアーキテクチャ検証装置。 - 前記パラメータは、前記モジュールの処理時間、前記バスの優先度、および前記バスの構成条件の少なくとも1つを含む請求項2乃至4の何れか1項に記載のアーキテクチャ検証装置。
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