JP4861242B2 - Liquid crystal display - Google Patents

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Description

本発明は、液晶表示装置に関し、特に、表示パネルの表示性能向上に関するものである。   The present invention relates to a liquid crystal display device, and more particularly to an improvement in display performance of a display panel.

従来、一対の基板の間に液晶材料を封入した液晶表示パネルを有する液晶表示装置には、たとえば、IPS方式のような横電界駆動方式のものがある。前記横電界駆動方式の液晶表示装置で用いられる液晶表示パネルは、前記一対の基板のうちの一方の基板に画素電極および共通電極(対向電極とも呼ばれる)が設けられている。   2. Description of the Related Art Conventionally, a liquid crystal display device having a liquid crystal display panel in which a liquid crystal material is sealed between a pair of substrates includes, for example, a lateral electric field driving method such as an IPS method. In a liquid crystal display panel used in the horizontal electric field drive type liquid crystal display device, a pixel electrode and a common electrode (also referred to as a counter electrode) are provided on one of the pair of substrates.

このとき、共通電極は、たとえば、基板に設けられた複数本の走査信号線または複数本の映像信号線と立体的に交差するコモン給電配線に接続されている。またこのとき、基板の表示領域の外側には、たとえば、表示領域を囲む環状のコモンバスラインが設けられており、コモン給電配線はコモンバスラインに接続されている。   At this time, the common electrode is connected to, for example, a common power supply wiring that three-dimensionally intersects with a plurality of scanning signal lines or a plurality of video signal lines provided on the substrate. At this time, for example, an annular common bus line surrounding the display area is provided outside the display area of the substrate, and the common power supply wiring is connected to the common bus line.

前記コモン給電配線や対向電極に加えるコモン電位の電圧は、たとえば、タイミングコントローラー(T−CON)を有するプリント回路板に設けられたコモン電圧生成回路で生成される。そして、前記表示パネル(基板)に接続された複数個のプリント回路板から前記コモンバスラインに供給される。   The common potential voltage applied to the common power supply wiring and the counter electrode is generated by, for example, a common voltage generation circuit provided on a printed circuit board having a timing controller (T-CON). And it supplies to the said common bus line from the some printed circuit board connected to the said display panel (board | substrate).

また、前記コモン給電配線は、前記複数本の走査信号線や前記複数本の映像信号線と立体的に交差しているので、交差している領域に生じる交差容量がノイズとなり、コモン給電配線(共通電極)の電位にばらつきが生じることがある。そのため、近年の液晶表示パネルでは、コモン給電配線の電位を測定し、生成するコモン電位の電圧にフィードバックすることで、コモン給電配線(共通電極)の電位のばらつきを低減している(たとえば、特許文献1、特許文献2を参照。)。
特開2002−169138号公報 特開平9−218388号公報
Further, since the common power supply wiring three-dimensionally intersects with the plurality of scanning signal lines and the plurality of video signal lines, the cross capacitance generated in the intersecting region becomes noise, and the common power supply wiring ( The potential of the common electrode) may vary. Therefore, in recent liquid crystal display panels, the potential of the common power supply wiring (common electrode) is reduced by measuring the potential of the common power supply wiring and feeding back to the generated common potential voltage (for example, patents). (Refer to Literature 1 and Patent Literature 2).
JP 2002-169138 A JP-A-9-218388

しかしながら、従来のフィードバック方法では、たとえば、コモン電位の電圧が入力される位置に近い場所でのコモン給電配線の電位を測定することが多い。そのため、測定しているコモン電位は、たとえば、前記複数本の走査信号線や前記複数本の映像信号線と立体的に交差している領域に生じる交差容量などの影響が少なく、フィードバックにより電位を安定化させる際の精度が低いという問題があった。その結果、たとえば、表示領域において、コモン電位の電圧が入力される位置に近い場所と遠い場所で画質にむらが生じるなどの問題があった。   However, in the conventional feedback method, for example, the potential of the common power supply wiring is often measured near a position where the voltage of the common potential is input. For this reason, the common potential being measured is less affected by, for example, the cross capacitance generated in the three-dimensionally intersecting region with the plurality of scanning signal lines or the plurality of video signal lines, and the potential is determined by feedback. There was a problem that the accuracy when stabilizing was low. As a result, there has been a problem that, for example, in the display region, the image quality is uneven in a place near and far from the position where the common potential voltage is input.

また、コモン電位を検出してフィードバックするための配線は、基板上の表示領域外に配置することになる。このフィードバック用の配線が長ければ長いほど、配線を流れる電流が周辺の影響を受ける可能性があり、正確な検出電位をフィードバックできないという問題も生じる。   Also, the wiring for detecting and feeding back the common potential is arranged outside the display area on the substrate. The longer the feedback wiring is, the more likely the current flowing through the wiring is affected by the surroundings, and there is a problem that accurate detection potential cannot be fed back.

本発明の目的は、コモン給電配線に加えるコモン電位をフィードバックするときの精度を向上させることが可能な技術を提供することにある。   An object of the present invention is to provide a technique capable of improving accuracy when a common potential applied to a common power supply wiring is fed back.

本発明の前記ならびにその他の目的と新規な特徴は、本明細書の記述および添付図面によって明らかになるであろう。   The above and other objects and novel features of the present invention will be apparent from the description of this specification and the accompanying drawings.

上記目的を達成するための本発明の特徴は、複数の走査信号線と、複数の映像信号線と、前記走査信号線と前記映像信号線で定義される画素領域内に設けられる画素電極および共通電極とを有する表示パネルと、前記走査信号線に走査信号を供給する走査信号駆動回路と、前記映像信号線に映像信号を供給する映像信号駆動回路と、前記走査信号駆動回路および前記映像信号駆動回路への供給信号を制御する制御回路を有する制御基板と、を備える液晶表示装置であって、前記表示パネルは、前記共通電極に電気的に接続され、表示領域の周辺に環状に形成されたコモンバスラインと、当該コモンバスラインの電圧を前記制御基板にフィードバックするコモンセンシング配線と、前記走査信号駆動回路の駆動電力を供給するための走査信号駆動回路用電源配線と、前記コモンバスラインにコモン電位の電圧を供給するコモン電圧給電配線を有し、前記コモン電圧給電用配線と、前記コモンセンシング配線と、前記走査信号駆動回路用電源配線は、少なくとも前記走査信号駆動回路が接続される前記表示パネルの一辺において並走して形成され、かつ、前記コモンセンシング配線は、前記表示パネルの一辺上において、前記コモン電圧給電用配線と前記走査信号駆動回路用電源配線の間に形成されることである。 In order to achieve the above object, the present invention is characterized by a plurality of scanning signal lines, a plurality of video signal lines, a pixel electrode provided in a pixel region defined by the scanning signal lines and the video signal lines, and a common a display panel having an electrode, a scanning signal driving circuit for supplying scanning signals to the scanning signal line, a video signal driving circuit for supplying a video signal to the video signal lines, the scanning signal driving circuit and the video And a control board having a control circuit for controlling a supply signal to the signal drive circuit, wherein the display panel is electrically connected to the common electrode and formed in a ring shape around the display area Common bus line, common sensing wiring for feeding back the voltage of the common bus line to the control board, and a scanning signal driver for supplying driving power for the scanning signal driving circuit. A circuit power supply wiring has a common voltage power supply wiring for supplying the voltage of the common potential to the common bus line, and the common voltage power supply wire, said common sensing line, the scanning signal drive circuit for the power supply wiring And at least one side of the display panel to which the scanning signal driving circuit is connected, and the common sensing line is connected to the common voltage supply line and the scanning signal on one side of the display panel. It is formed between the power supply wirings for the drive circuit.

本発明によれば、コモン電位の検出精度を向上し、かつコモン電位供給の安定化を図ることが可能になる。   According to the present invention, it is possible to improve the detection accuracy of the common potential and stabilize the supply of the common potential.

以下、本発明について、図面を参照して実施の形態(実施例)とともに詳細に説明する。
なお、実施例を説明するための全図において、同一機能を有するものは、同一符号を付け、その繰り返しの説明は省略する。
Hereinafter, the present invention will be described in detail together with embodiments (examples) with reference to the drawings.
In all the drawings for explaining the embodiments, parts having the same function are given the same reference numerals and their repeated explanation is omitted.

図1乃至図5は、本発明が適用される表示パネルの一構成例を示す模式図である。
図1は、液晶表示パネルを観察者側からみた模式平面図である。図2は、図1のA−A’線における模式断面図である。図3は、液晶表示パネルのTFT基板における表示領域の1画素の構成例を示す模式平面図である。図4は、図3のB−B’線における模式断面図である。図5は、図3のC−C’線における模式断面図である。
FIG. 1 to FIG. 5 are schematic views showing a structural example of a display panel to which the present invention is applied.
FIG. 1 is a schematic plan view of a liquid crystal display panel as viewed from the observer side. FIG. 2 is a schematic cross-sectional view taken along line AA ′ of FIG. FIG. 3 is a schematic plan view showing a configuration example of one pixel in the display region on the TFT substrate of the liquid crystal display panel. 4 is a schematic cross-sectional view taken along line BB ′ of FIG. FIG. 5 is a schematic cross-sectional view taken along the line CC ′ of FIG.

本発明は、複数本の走査信号線および複数本の映像信号線が設けられた基板に、走査信号線または映像信号線と立体的に交差するコモン給電配線が設けられている表示パネルに関するものである。このような表示パネルには、たとえば、IPS方式のような横電界駆動型の液晶表示パネルがある。   The present invention relates to a display panel in which a common power supply wiring three-dimensionally intersecting with a scanning signal line or a video signal line is provided on a substrate provided with a plurality of scanning signal lines and a plurality of video signal lines. is there. An example of such a display panel is a horizontal electric field drive type liquid crystal display panel such as an IPS system.

液晶表示パネルは、たとえば、図1および図2に示すように、一対の基板1,2の間に液晶材料3を封入した表示パネルである。このとき、一対の基板1,2は、表示領域DAの外側に環状に配置されたシール材4で接着されており、液晶材料3は、一対の基板1,2およびシール材4で囲まれた空間に封入されている。   For example, as shown in FIGS. 1 and 2, the liquid crystal display panel is a display panel in which a liquid crystal material 3 is sealed between a pair of substrates 1 and 2. At this time, the pair of substrates 1 and 2 are bonded to each other with a sealing material 4 arranged in an annular shape outside the display area DA, and the liquid crystal material 3 is surrounded by the pair of substrates 1 and 2 and the sealing material 4. Enclosed in space.

一対の基板1,2のうち、観察者側からみた外形寸法が大きい方の基板1は、一般に、TFT基板と呼ばれる。図1および図2では省略しているが、TFT基板1は、ガラス基板などの透明な基板の表面の上に、複数本の走査信号線と、絶縁層を介して前記複数本の走査信号線と立体的に交差する複数本の映像信号線が形成されている。そして、2本の隣接する走査信号線と2本の隣接する映像信号線で囲まれた領域が1つの画素領域に相当し、各画素領域に対してTFT素子や画素電極などが配置されている。また、TFT基板1と対をなす他方の基板2は、一般に、対向基板と呼ばれる。また、表示領域DAは、x方向およびy方向にマトリクス状に配置された多数の画素領域の集合で構成されている。   Of the pair of substrates 1 and 2, the substrate 1 having a larger outer dimension as viewed from the observer side is generally called a TFT substrate. Although omitted in FIGS. 1 and 2, the TFT substrate 1 has a plurality of scanning signal lines on a surface of a transparent substrate such as a glass substrate, and the plurality of scanning signal lines via an insulating layer. A plurality of video signal lines intersecting three-dimensionally are formed. A region surrounded by two adjacent scanning signal lines and two adjacent video signal lines corresponds to one pixel region, and a TFT element, a pixel electrode, or the like is arranged in each pixel region. . The other substrate 2 that forms a pair with the TFT substrate 1 is generally called a counter substrate. The display area DA is composed of a set of a large number of pixel areas arranged in a matrix in the x and y directions.

また、前記液晶表示パネルが、たとえば、IPS方式のような横電界駆動方式の場合、TFT基板1の画素電極と対向する共通電極(対向電極とも呼ばれる)は、TFT基板1側に設けられる。   Further, when the liquid crystal display panel is a lateral electric field driving method such as an IPS method, a common electrode (also referred to as a counter electrode) facing the pixel electrode of the TFT substrate 1 is provided on the TFT substrate 1 side.

次に、横電界駆動方式の液晶表示パネルの表示領域DAの1画素の構成例について、図3乃至図5を参照して簡単に説明する。   Next, a configuration example of one pixel in the display area DA of the horizontal electric field drive type liquid crystal display panel will be briefly described with reference to FIGS.

横電界駆動方式の液晶表示パネルの場合、画素電極および共通電極は、TFT基板1側に設けられる。このとき、TFT基板1は、たとえば、図3乃至図5に示すように、ガラス基板SUBの表面に、x方向に延在する複数本の走査信号線GLが設けられており、走査信号線GLの上には、第1の絶縁層PAS1を介してy方向に延在し、複数本の走査信号線GLと立体的に交差する複数本の映像信号線DLが設けられている。そして、2本の隣接する走査信号線GLと2本の隣接する映像信号線DLによって囲まれた領域が1つの画素領域に相当する。   In the case of a horizontal electric field drive type liquid crystal display panel, the pixel electrode and the common electrode are provided on the TFT substrate 1 side. At this time, the TFT substrate 1 is provided with a plurality of scanning signal lines GL extending in the x direction on the surface of the glass substrate SUB as shown in FIGS. 3 to 5, for example. There are provided a plurality of video signal lines DL extending in the y direction via the first insulating layer PAS1 and three-dimensionally intersecting with the plurality of scanning signal lines GL. A region surrounded by two adjacent scanning signal lines GL and two adjacent video signal lines DL corresponds to one pixel region.

また、ガラス基板SUBの表面には、たとえば、画素領域毎に、平板状の共通電極CTが設けられている。このとき、x方向に並んだ各画素領域の共通電極CTは、走査信号線GLと並行した共通信号線CLによって電気的に接続されている。また、走査信号線GLからみて、共通信号線CLが設けられている方向と反対側には、共通電極CTと電気的に接続されている共通接続パッドCPが設けられている。   Further, on the surface of the glass substrate SUB, for example, a flat common electrode CT is provided for each pixel region. At this time, the common electrode CT of each pixel region arranged in the x direction is electrically connected by a common signal line CL parallel to the scanning signal line GL. A common connection pad CP electrically connected to the common electrode CT is provided on the side opposite to the direction in which the common signal line CL is provided when viewed from the scanning signal line GL.

また、第1の絶縁層PAS1の上には、映像信号線DLの他に、半導体層、ドレイン電極SD1、およびソース電極SD2が設けられている。このとき、半導体層は、たとえば、アモルファスシリコン(a−Si)を用いて形成されており、各画素領域に対して配置されるTFT素子のチャネル層SCとしての機能を持つものの他に、たとえば、走査信号線GLと映像信号線DLが立体的に交差する領域における走査信号線GLと映像信号線DLの短絡を防ぐもの(図示しない)がある。このとき、TFT素子のチャネル層SCとしての機能を持つ半導体層は、映像信号線DLに接続しているドレイン電極SD1とソース電極SD2の両方が接続されている。また、図示は省略しているが、チャネル層SCとドレイン電極SD1との接続界面、およびチャネル層SCとソース電極SD2との接続界面には、部分的に、たとえば、チャネル層SCとは不純物の種類または濃度が異なる半導体層からなるコンタクト層が介在している。   In addition to the video signal line DL, a semiconductor layer, a drain electrode SD1, and a source electrode SD2 are provided on the first insulating layer PAS1. At this time, the semiconductor layer is formed using, for example, amorphous silicon (a-Si), and has a function as the channel layer SC of the TFT element disposed for each pixel region. There is one (not shown) that prevents a short circuit between the scanning signal line GL and the video signal line DL in a region where the scanning signal line GL and the video signal line DL intersect three-dimensionally. At this time, in the semiconductor layer having a function as the channel layer SC of the TFT element, both the drain electrode SD1 and the source electrode SD2 connected to the video signal line DL are connected. Although not shown, the channel layer SC and the source electrode SD2 are partially connected to the connection interface between the channel layer SC and the drain electrode SD1 and the connection interface between the channel layer SC and the source electrode SD2. Contact layers made of semiconductor layers of different types or concentrations are interposed.

また、映像信号線DLなどが形成された面(層)の上には、第2の絶縁層PAS2を介して画素電極PXが設けられている。画素電極PXは、画素領域毎に独立した電極であり、第2の絶縁層PASに設けられた開口部(スルーホール)TH1においてソース電極SD2と電気的に接続されている。また、共通電極CTと画素電極PXが、図3乃至図5に示したように、第1の絶縁層PAS1および第2の絶縁層PAS2を介して積層配置されている場合、画素電極PXは、スリットSLが設けられたくし歯形状の電極になっている。   On the surface (layer) on which the video signal line DL and the like are formed, the pixel electrode PX is provided via the second insulating layer PAS2. The pixel electrode PX is an independent electrode for each pixel region, and is electrically connected to the source electrode SD2 in an opening (through hole) TH1 provided in the second insulating layer PAS. Further, when the common electrode CT and the pixel electrode PX are stacked via the first insulating layer PAS1 and the second insulating layer PAS2 as shown in FIGS. 3 to 5, the pixel electrode PX It is a comb-shaped electrode provided with a slit SL.

また、第2の絶縁層PAS2の上には、画素電極PXの他に、たとえば、走査信号線GLを挟んで上下に配置された2つの共通電極CTを電気的に接続するためのブリッジ配線BRが設けられている。このとき、ブリッジ配線BRは、走査信号線GLを挟んで配置された共通信号線CLおよび共通接続パッドCPとスルーホールTH2,TH3によって接続されている。   Further, on the second insulating layer PAS2, in addition to the pixel electrode PX, for example, a bridge wiring BR for electrically connecting two common electrodes CT arranged above and below the scanning signal line GL. Is provided. At this time, the bridge wiring BR is connected to the common signal line CL and the common connection pad CP arranged across the scanning signal line GL by the through holes TH2 and TH3.

また、第2の絶縁層PAS2の上には、画素電極PXおよびブリッジ配線BRを覆うように配向膜5が設けられている。なお、図示は省略するが、対向基板2は、TFT基板1の配向膜5が設けられた面に対向するように配置される。   An alignment film 5 is provided on the second insulating layer PAS2 so as to cover the pixel electrode PX and the bridge wiring BR. Although not shown, the counter substrate 2 is disposed so as to face the surface of the TFT substrate 1 on which the alignment film 5 is provided.

液晶表示装置は、1画素の構成が図3乃至図5に示したような構成の液晶表示パネルに、CCFLやEEFLなどの蛍光管、あるいはLEDからなる光源を備えたバックライトユニットを組み合わせることで構成される。   In the liquid crystal display device, a backlight unit having a light source composed of a fluorescent tube such as CCFL or EEFL or a LED is combined with a liquid crystal display panel having a configuration of one pixel as shown in FIGS. Composed.

以下、液晶表示装置に本発明を適用した場合の構成例および作用効果について説明する。   Hereinafter, a configuration example and an effect when the present invention is applied to a liquid crystal display device will be described.

図6は、本発明による一実施例の液晶表示装置の概略構成を示す模式図である。   FIG. 6 is a schematic diagram showing a schematic configuration of a liquid crystal display device according to an embodiment of the present invention.

本実施例の液晶表示装置において、液晶表示パネルのTFT基板1には、たとえば、図6に示すように、表示領域DAを縦断するコモン給電配線および横断するコモン給電配線が網目状に配置されている。このとき、表示領域DAを縦断するコモン給電配線は、たとえば、ブリッジ配線BRおよび共通電極CTで構成される。また、表示領域を横断するコモン給電配線は、走査信号線GLに並行した共通信号線CLで構成される。また、表示領域DAに網目状に配置されたコモン給電配線は、表示領域DAの外側に環状に設けられたコモンバスラインCBLに接続されている。   In the liquid crystal display device of this embodiment, the TFT substrate 1 of the liquid crystal display panel includes, for example, as shown in FIG. 6, common power supply lines that traverse the display area DA and common power supply lines that traverse the display area DA are arranged in a mesh pattern. Yes. At this time, the common power supply wiring that vertically traverses the display area DA includes, for example, a bridge wiring BR and a common electrode CT. Further, the common power supply wiring crossing the display area is configured by a common signal line CL parallel to the scanning signal line GL. Further, the common power supply wiring arranged in a mesh pattern in the display area DA is connected to a common bus line CBL provided in a ring shape outside the display area DA.

TFT基板1は、たとえば、1つの辺(たとえば、左端の辺)に、走査信号線GLに走査信号を供給する走査ドライバIC 16Aが実装されたCOFなどのフレキシブルプリント回路板6Aが複数個接続されている。また、前記1つの辺と接するもう1つの辺(たとえば、上端の辺)には、映像信号線DLに映像信号を供給するデータドライバIC 16Bが実装されたCOFなどのフレキシブルプリント回路板6Bが複数個接続されている。また、フレキシブルプリント回路板6Bは、別のプリント回路板7に接続されている。またさらに、プリント回路板7は、タイミングコントローラー(T−CON)18、および図示しないコモン電圧生成回路やフィードバック回路などを有する制御基板8に接続されている。   In the TFT substrate 1, for example, a plurality of flexible printed circuit boards 6A such as a COF on which a scanning driver IC 16A that supplies a scanning signal to the scanning signal line GL is mounted are connected to one side (for example, the leftmost side). ing. In addition, a plurality of flexible printed circuit boards 6B such as a COF on which a data driver IC 16B for supplying a video signal to the video signal line DL is mounted are provided on the other side (for example, the upper side) contacting the one side. Are connected. Further, the flexible printed circuit board 6 </ b> B is connected to another printed circuit board 7. Further, the printed circuit board 7 is connected to a timing controller (T-CON) 18 and a control board 8 having a common voltage generation circuit, a feedback circuit, etc. (not shown).

本実施例の液晶表示装置において、制御基板8内のコモン電圧生成回路で生成されたコモン電位の電圧は、コモン用給電配線Vcomによって、プリント回路板7およびフレキシブルプリント回路板6A,6Bを介してTFT基板1のコモンバスラインCBLに供給される。   In the liquid crystal display device of the present embodiment, the voltage of the common potential generated by the common voltage generation circuit in the control board 8 is passed through the printed circuit board 7 and the flexible printed circuit boards 6A and 6B by the common power supply wiring Vcom. It is supplied to the common bus line CBL of the TFT substrate 1.

また、コモンバスラインCBLには、コモンセンシング配線Csenが接続されている。コモンセンシング配線Csenは、コモンバスラインCBLおよびコモン給電配線の電位を測定し、制御基板8内のコモン電圧生成回路で生成するコモン電位の電圧を調整するためのものであり、フレキシブルプリント回路板6A,6Bおよびプリント回路板7を介して、制御基板8に至るように配線されている。   Further, the common sensing line Csen is connected to the common bus line CBL. The common sensing wiring Csen is for measuring the potential of the common bus line CBL and the common power supply wiring, and for adjusting the voltage of the common potential generated by the common voltage generation circuit in the control board 8, and the flexible printed circuit board 6A. , 6B and the printed circuit board 7 are wired so as to reach the control board 8.

また、制御基板8からは、プリント回路板7およびフレキシブルプリント回路板6Bを介して、フレキシブルプリント回路板6A上の走査ドライバIC 16Aの電源を供給するためのドライバ電源供給配線GVLが配線されている。   Further, a driver power supply wiring GVL for supplying power to the scanning driver IC 16A on the flexible printed circuit board 6A is wired from the control board 8 via the printed circuit board 7 and the flexible printed circuit board 6B. .

コモンセンシング配線Csenの検出端P1は、たとえば、図6に示すように、コモンバスラインCBLの4辺のうち、フレキシブルプリント回路板6Aあるいは6Bが接続されない辺に接続する。またこのとき、検出端P1は、フレキシブルプリント回路板6Aあるいは6Bが接続される辺の反対側に相当する領域AR1、またはAR2内に設けることが望ましい。これにより、より変化の激しいコモン電位を検出することが可能になる。   For example, as shown in FIG. 6, the detection end P1 of the common sensing wiring Csen is connected to a side to which the flexible printed circuit board 6A or 6B is not connected among the four sides of the common bus line CBL. At this time, the detection end P1 is preferably provided in the area AR1 or AR2 corresponding to the opposite side of the side to which the flexible printed circuit board 6A or 6B is connected. This makes it possible to detect a common potential that changes more drastically.

コモンセンシング配線Csenは、コモンバスラインCBLの外側に、コモンバスラインCBLから分岐させて設け、コモンバスラインCBLの外周に沿ってTFT基板1のフレキシブルプリント回路板6Aが接続される領域まで引き回す。このとき、コモンセンシング配線Csenは、TFT基板1に設けられた他の導電層と立体的に交差しないように引き回す。そのため、コモンセンシング配線Csenは、たとえば、図6に示したように、フレキシブルプリント回路板6Aを経由させて、フレキシブルプリント回路板6Bまで導き、プリント回路板7を介して制御基板8に接続させる。   The common sensing wiring Csen is provided outside the common bus line CBL so as to be branched from the common bus line CBL, and is routed to the region where the flexible printed circuit board 6A of the TFT substrate 1 is connected along the outer periphery of the common bus line CBL. At this time, the common sensing wiring Csen is routed so as not to three-dimensionally intersect with other conductive layers provided on the TFT substrate 1. Therefore, for example, as shown in FIG. 6, the common sensing wiring Csen is led to the flexible printed circuit board 6 </ b> B via the flexible printed circuit board 6 </ b> A and connected to the control board 8 via the printed circuit board 7.

制御基板8内の前記フィードバック回路は、コモンセンシング配線Csenにより取得したコモンバスラインCBLの電位と、制御基板8内のコモン電圧生成回路で生成した基準電位とを比較し、そのばらつきの度合いを算出する。そして、ばらつきが閾値以上である場合、たとえば、測定した電位と基準電位との差に基づき、コモン電圧生成回路に、測定されるコモンバスラインCBLおよびコモン給電配線の電位が基準電位になるようなコモン電位の電圧を生成させ、また、増幅回路を通してコモン用給電配線Vcomへ出力する。   The feedback circuit in the control board 8 compares the potential of the common bus line CBL acquired by the common sensing wiring Csen with the reference potential generated by the common voltage generation circuit in the control board 8, and calculates the degree of variation. To do. When the variation is greater than or equal to the threshold value, for example, based on the difference between the measured potential and the reference potential, the potential of the common bus line CBL and the common power supply wiring to be measured becomes the reference potential in the common voltage generation circuit. A common potential voltage is generated and output to the common power supply wiring Vcom through the amplifier circuit.

上記に示すように、本実施例においては、制御基板8からTFT基板1上までの間には、コモン用給電配線Vcom、コモンセンシング配線Csen、およびドライバ電源供給配線GVLが配されている。またこのとき、コモンセンシング配線Csenのうちの、フレキシブルプリント回路板6Aを経由してプリント回路板7に達するまでの部分経路は、コモン給電配線Vcomおよびドライバ電源供給配線GVLと並走している。   As described above, in this embodiment, the common power supply wiring Vcom, the common sensing wiring Csen, and the driver power supply wiring GVL are arranged between the control substrate 8 and the TFT substrate 1. At this time, a partial path of the common sensing wiring Csen that reaches the printed circuit board 7 via the flexible printed circuit board 6A is running in parallel with the common power supply wiring Vcom and the driver power supply wiring GVL.

なお、図6に示した構成では、フレキシブルプリント回路板6A上のドライバ電源供給配線GVLが、走査ドライバIC 16Aに接続されていないが、実際の液晶表示装置では、たとえば、フレキシブルプリント回路板6A上において、ドライバ電源供給配線GVLは、コモンセンシング配線Csen、およびコモン用給電配線Vcomと交差する分岐配線を有しており、ドライバ電源供給配線GVLと走査ドライバIC 16Aの電源端子とが接続されている。   In the configuration shown in FIG. 6, the driver power supply wiring GVL on the flexible printed circuit board 6A is not connected to the scanning driver IC 16A. However, in an actual liquid crystal display device, for example, on the flexible printed circuit board 6A. The driver power supply wiring GVL has a branch wiring crossing the common sensing wiring Csen and the common power supply wiring Vcom, and the driver power supply wiring GVL and the power supply terminal of the scanning driver IC 16A are connected. .

そして、本実施例では、これらの各配線は、TFT基板1の外側方向から、ドライバ電源供給配線GVL、コモンセンシング配線Csen、コモン用給電配線Vcomの順番で配置される。これは、コモンセンシング配線Csenに不要なノイズが入ることを低減するためであり、以下に、このような配置にしたときの作用効果を簡単に説明する。   In this embodiment, these wirings are arranged in the order of the driver power supply wiring GVL, the common sensing wiring Csen, and the common power supply wiring Vcom from the outside direction of the TFT substrate 1. This is to reduce unnecessary noise from entering the common sensing wiring Csen, and the following is a brief description of the effects of such an arrangement.

図7および図8は、本実施例の液晶表示装置の作用効果を説明するための模式図である。
図7は、図6に示した構成と類似した構成の液晶表示装置の一構成例を示す模式図である。図8は、図6に示した構成の液晶表示装置と図7に示した構成の液晶表示装置との違いを説明するための波形図である。なお、図7において、図6と異なる点は、ドライバ電源供給配線GVLとコモンセンシング配線Csenの配置の順番であり、図7に示した例では、コモンセンシング配線Csenが一番外側にくるように配置されている。
7 and 8 are schematic views for explaining the operational effects of the liquid crystal display device of this embodiment.
FIG. 7 is a schematic diagram showing a configuration example of a liquid crystal display device having a configuration similar to the configuration shown in FIG. FIG. 8 is a waveform diagram for explaining the difference between the liquid crystal display device having the configuration shown in FIG. 6 and the liquid crystal display device having the configuration shown in FIG. 7 is different from FIG. 6 in the order of arrangement of the driver power supply wiring GVL and the common sensing wiring Csen. In the example shown in FIG. 7, the common sensing wiring Csen is located on the outermost side. Has been placed.

図8に示した4つの波形図には、それぞれ3つの波形が示されており、左上および左下の波形図には、図7に示した制御基板8上の検出端S1およびS2で得られた波形、ならびに1フレームの開始タイミングを示すスタートパルスSPが示されている。なお、検出端S1ではコモン用給電配線Vcomの入力電圧を測定し、検出端S2ではコモンセンシング配線Csenの検出電圧を測定している。   The four waveform diagrams shown in FIG. 8 each show three waveforms, and the upper left and lower left waveform diagrams are obtained at the detection ends S1 and S2 on the control board 8 shown in FIG. A waveform and a start pulse SP indicating the start timing of one frame are shown. At the detection end S1, the input voltage of the common power supply wiring Vcom is measured, and at the detection end S2, the detection voltage of the common sensing wiring Csen is measured.

また、図8に示した4つの波形図のうちの、右上および右下の波形図には、本実施例である図6の構成における制御基板8上の検出端S1およびS2で得られた波形、ならびに1フレームの開始タイミングを示すスタートパルスSPが示されている。なお、図6に示した構成における検出端S1およびS2は、それぞれ、図7に示した構成における検出端S1およびS2に相当する位置にしている。   Of the four waveform diagrams shown in FIG. 8, the upper right and lower right waveform diagrams show the waveforms obtained at the detection ends S1 and S2 on the control board 8 in the configuration of FIG. In addition, a start pulse SP indicating the start timing of one frame is shown. Note that the detection ends S1 and S2 in the configuration shown in FIG. 6 are located at positions corresponding to the detection ends S1 and S2 in the configuration shown in FIG.

また、図8に示した4つの波形図のうちの、左上および右上の波形図は、それぞれ、バックライトを点灯して測定した波形であり、左下および右下の波形図は、それぞれ、バックライトを消灯して測定した波形である。また、図8に示した各波形図は、横軸が時間、縦軸が電圧値を示しており、各波形図の縦軸、横軸のスケールは全て同じである。   Of the four waveform diagrams shown in FIG. 8, the upper left and upper right waveform diagrams are waveforms measured by turning on the backlight, and the lower left and lower right waveform diagrams are the backlight. This is a waveform measured with the light turned off. In each waveform diagram shown in FIG. 8, the horizontal axis indicates time, and the vertical axis indicates the voltage value. The scales of the vertical axis and the horizontal axis of each waveform diagram are the same.

図8に示した各波形図を参照し、たとえば、検出端S2で得られるそれぞれの波形を比較すると、左側の図7に示した構成における波形よりも、右側の本実施例の構成における波形のほうが、振幅が小さいことが分かる。これは、バックライトが点灯している時でも消灯している時でも共通の結果である。このことから、コモンセンシング配線Csenを、一番外側に配置するよりも、ドライバ電源供給配線GVLとコモン用給電配線Vcomとの間に配置したほうが、コモンセンシング配線Csenにノイズが乗りにくいといえる。   Referring to the respective waveform diagrams shown in FIG. 8, for example, when the respective waveforms obtained at the detection end S2 are compared, the waveforms in the configuration of this embodiment on the right side of the waveform in the configuration shown in FIG. 7 on the left side are compared. It can be seen that the amplitude is smaller. This is a common result whether the backlight is on or off. From this, it can be said that it is more difficult for noise to ride on the common sensing wiring Csen when the common sensing wiring Csen is disposed between the driver power supply wiring GVL and the common power supply wiring Vcom than when the common sensing wiring Csen is disposed on the outermost side.

コモンセンシング配線Csenにノイズが乗ることの影響は、コモン用給電配線Vcomの入力電圧である検出端S1の波形を見ることで確認できる。すなわち、コモン用給電配線Vcomは、コモンセンシング配線Csenの結果を基に調整・増幅を行い、出力するものであるため、コモンセンシング配線Csenに乗ったノイズがより強調されて現れる。図8に示した各波形図の検出端S1における波形を見ると、左側の図7に示した構成における波形よりも、右側の本実施例の構成における波形のほうが、より振幅が小さく、きれいな波形で出力されていることが分かる。   The influence of noise on the common sensing wiring Csen can be confirmed by looking at the waveform of the detection end S1 that is the input voltage of the common power supply wiring Vcom. That is, since the common power supply wiring Vcom is adjusted and amplified based on the result of the common sensing wiring Csen and outputs, the noise on the common sensing wiring Csen appears more emphasized. When looking at the waveform at the detection end S1 of each waveform diagram shown in FIG. 8, the waveform in the configuration of the present embodiment on the right side has a smaller amplitude and is clearer than the waveform in the configuration shown in FIG. 7 on the left side. It can be seen that is output.

また、バックライトの点灯時と消灯時とを比較すると、図7に示した構成では、バックライトが点灯している時に、前記ノイズ以外にも特定の周期のうねり(ウェービングと呼ぶこともある)が、検出端S1およびS2のいずれの波形にも乗っていることが分かる。前記うねりの周期は、たとえば、図8の左上の波形図にWで示した時間間隔であり、具体的には120μsから130μs程度である。そのため、前記うねりは、バックライトの点灯周波数が、コモンセンシング配線Csenの信号に影響を与えたことにより生じていると考えられる。   Further, comparing the time when the backlight is turned on and the time when the backlight is turned off, in the configuration shown in FIG. 7, when the backlight is turned on, in addition to the noise, swells of a specific period (sometimes referred to as waving) However, it turns out that it is on any waveform of detection end S1 and S2. The period of the undulation is, for example, a time interval indicated by W in the upper left waveform diagram of FIG. 8, and is specifically about 120 μs to 130 μs. Therefore, the swell is considered to be caused by the lighting frequency of the backlight affecting the signal of the common sensing wiring Csen.

これに対して、本実施例の構成では、図8の右上の波形図を見ればわかるように、バックライトが点灯している時に、このようなウェービングは見られない。したがって、本実施例の液晶表示装置のように、コモンセンシング配線Csenをドライバ電源供給配線GVLとコモン用給電配線Vcomの間に形成することで、バックライトによるうねりの影響も防止することができるといえる。   On the other hand, in the configuration of this embodiment, as can be seen from the waveform diagram in the upper right of FIG. 8, such waving is not seen when the backlight is on. Therefore, as in the liquid crystal display device of this embodiment, by forming the common sensing line Csen between the driver power supply line GVL and the common power supply line Vcom, it is possible to prevent the influence of the swell due to the backlight. I can say that.

上記に示すように、本実施例では、コモンセンシング配線Csenをドライバ電源供給配線GVLとコモン用給電配線Vcomの間に形成することで、コモンセンシング配線Csenに重畳するノイズを軽減でき、ひいては、コモン用給電配線Vcomの電位を精度よく安定化させることができる。   As described above, in this embodiment, by forming the common sensing wiring Csen between the driver power supply wiring GVL and the common power supply wiring Vcom, noise superimposed on the common sensing wiring Csen can be reduced. The potential of the power supply wiring Vcom can be stabilized with high accuracy.

以上、本発明を、前記実施例に基づき具体的に説明したが、本発明は、前記実施例に限定されるものではなく、その要旨を逸脱しない範囲において、種々変更可能であることはもちろんである。   The present invention has been specifically described above based on the above-described embodiments. However, the present invention is not limited to the above-described embodiments, and various modifications can be made without departing from the scope of the present invention. is there.

たとえば、本発明は、コモンセンシング配線Csenを用いてコモン電位をフィードバックする構成を有する液晶表示装置であれば、液晶の駆動方式によらず適用可能である。すなわち、本発明は、1画素の構成が図3乃至図5に示したような構成の横電界駆動方式の液晶表示装置に限らず、たとえば、VAやTNなどの縦電界駆動方式の表示パネルを有する液晶表示装置にも適用可能である。   For example, the present invention can be applied to any liquid crystal display device having a configuration in which the common potential is fed back using the common sensing wiring Csen regardless of the liquid crystal driving method. That is, the present invention is not limited to the horizontal electric field drive type liquid crystal display device having the configuration of one pixel as shown in FIGS. 3 to 5, but includes, for example, a vertical electric field drive type display panel such as VA or TN. The present invention can also be applied to a liquid crystal display device having the same.

液晶表示パネルを観察者側からみた模式平面図である。It is the model top view which looked at the liquid crystal display panel from the observer side. 図1のA−A’線における模式断面図である。It is a schematic cross section in the A-A 'line of FIG. 液晶表示パネルのTFT基板における表示領域の1画素の構成例を示す模式平面図である。It is a schematic plan view which shows the structural example of 1 pixel of the display area in the TFT substrate of a liquid crystal display panel. 図3のB−B’線における模式断面図である。FIG. 4 is a schematic cross-sectional view taken along line B-B ′ of FIG. 3. 図3のC−C’線における模式断面図である。It is a schematic cross section in the C-C 'line of FIG. 本発明による一実施例の液晶表示装置の概略構成を示す模式図である。It is a schematic diagram which shows schematic structure of the liquid crystal display device of one Example by this invention. 図6に示した構成と類似した構成の液晶表示装置の一構成例を示す模式図である。It is a schematic diagram which shows one structural example of the liquid crystal display device of the structure similar to the structure shown in FIG. 図6に示した構成の液晶表示装置と図7に示した構成の液晶表示装置との違いを説明するための波形図である。FIG. 8 is a waveform diagram for explaining a difference between the liquid crystal display device having the configuration shown in FIG. 6 and the liquid crystal display device having the configuration shown in FIG. 7.

符号の説明Explanation of symbols

1…TFT基板
SUB…ガラス基板
GL…走査信号線
CL…共通信号線
CP…共通接続パッド
CT…共通電極
PAS1…第1の絶縁層
DL…映像信号線
SC…TFT素子のチャネル層(半導体層)
SD1…ドレイン電極
SD2…ソース電極
PAS2…第2の絶縁層
PX…画素電極
SL…スリット
BR…ブリッジ配線
TH1,TH2,TH3…スルーホール
2…対向基板
3…液晶材料
4…シール材
5…配向膜
6A,6B…フレキシブルプリント回路板
7…プリント回路板
8…制御基板
16A…走査ドライバIC
16B…データドライバIC
18…タイミングコントローラー(T−CON)
Vcom…コモン給電配線
Csen…コモンセンシング配線
GVL…ドライバ電源供給配線
S1,S2…検出端
DESCRIPTION OF SYMBOLS 1 ... TFT substrate SUB ... Glass substrate GL ... Scanning signal line CL ... Common signal line CP ... Common connection pad CT ... Common electrode PAS1 ... First insulation layer DL ... Video signal line SC ... Channel layer (semiconductor layer) of TFT element
SD1 ... Drain electrode SD2 ... Source electrode PAS2 ... Second insulating layer PX ... Pixel electrode SL ... Slit BR ... Bridge wiring TH1, TH2, TH3 ... Through hole 2 ... Counter substrate 3 ... Liquid crystal material 4 ... Seal material 5 ... Alignment film 6A, 6B ... Flexible printed circuit board 7 ... Printed circuit board 8 ... Control board 16A ... Scan driver IC
16B ... Data driver IC
18 ... Timing controller (T-CON)
Vcom: Common power supply wiring Csen: Common sensing wiring GVL: Driver power supply wiring S1, S2: Detection end

Claims (10)

複数の走査信号線と、複数の映像信号線と、前記走査信号線と前記映像信号線で定義される画素領域内に設けられる画素電極および共通電極とを有する表示パネルと、
前記走査信号線に走査信号を供給する走査信号駆動回路と、前記映像信号線に映像信号を供給する映像信号駆動回路と、前記走査信号駆動回路および前記映像信号駆動回路への供給信号を制御する制御回路を有する制御基板と、を備える液晶表示装置であって、
前記表示パネルは、前記共通電極に電気的に接続され、表示領域の周辺に環状に形成されたコモンバスラインと、当該コモンバスラインの電圧を前記制御基板にフィードバックするコモンセンシング配線と、前記走査信号駆動回路の駆動電力を供給するための走査信号駆動回路用電源配線と、前記コモンバスラインにコモン電位の電圧を供給するコモン電圧給電配線を有し、
前記コモン電圧給電用配線と、前記コモンセンシング配線と、前記走査信号駆動回路用電源配線は、少なくとも前記走査信号駆動回路が接続される前記表示パネルの一辺において並走して形成され、かつ、前記コモンセンシング配線は、前記表示パネルの一辺上において、前記コモン電圧給電用配線と前記走査信号駆動回路用電源配線の間に形成されることを特徴とする液晶表示装置。
A display panel having a plurality of scanning signal lines, a plurality of video signal lines, and a pixel electrode and a common electrode provided in a pixel region defined by the scanning signal lines and the video signal lines;
A scanning signal driving circuit for supplying scanning signals to the scanning signal line, a video signal driving circuit for supplying a video signal to the video signal line, a supply signal to the scanning signal drive circuit and the video signal driving circuit A control board having a control circuit to control, a liquid crystal display device comprising:
The display panel is electrically connected to the common electrode and is annularly formed around a display region, common sensing wiring for feeding back the voltage of the common bus line to the control board, and the scanning A scanning signal driving circuit power supply wiring for supplying driving power for the signal driving circuit, and a common voltage power supply wiring for supplying a common potential voltage to the common bus line,
The common voltage power supply wiring , the common sensing wiring, and the scanning signal drive circuit power supply wiring are formed to run in parallel on at least one side of the display panel to which the scan signal drive circuit is connected, and A common sensing line is formed on one side of the display panel between the common voltage power supply line and the scanning signal drive circuit power line.
前記表示パネルは、複数個のプリント回路板が接続されており、前記走査信号駆動回路は当該プリント回路板上に形成され、
前記コモン電圧給電用配線、前記コモンセンシング配線、および前記走査信号駆動回路用電源配線は、いずれも前記走査信号駆動回路が形成されたプリント回路板にも形成されることを特徴とする請求項1に記載の液晶表示装置。
The display panel is connected to a plurality of printed circuit boards, and the scanning signal driving circuit is formed on the printed circuit board,
The common voltage power supply wire, said common sensing line, and the scanning signal drive circuit power supply wiring claim 1, characterized in that both also formed on the printed circuit board in which the scanning signal drive circuit are formed A liquid crystal display device according to 1.
前記コモン電圧給電用配線、前記コモンセンシング配線、および前記走査信号駆動回路用電源配線は、前記表示パネル上にも形成されることを特徴とする請求項2に記載の液晶表示装置。The liquid crystal display device according to claim 2, wherein the common voltage power supply wiring, the common sensing wiring, and the power supply wiring for the scanning signal driving circuit are also formed on the display panel. 前記映像信号駆動回路は、前記プリント回路板上に形成され、The video signal driving circuit is formed on the printed circuit board,
前記映像信号駆動回路が形成されたプリント回路板は、前記走査信号駆動回路が形成されたプリント回路板が接続された前記表示パネルの一辺とは異なる一辺に接続されることを特徴とする請求項2に記載の液晶表示装置。The printed circuit board on which the video signal driving circuit is formed is connected to one side different from one side of the display panel to which the printed circuit board on which the scanning signal driving circuit is formed. 2. A liquid crystal display device according to 2.
前記コモン電圧給電用配線は、前記映像信号駆動回路が形成されたプリント回路板にも形成されることを特徴とする請求項4に記載の液晶表示装置。5. The liquid crystal display device according to claim 4, wherein the common voltage power supply wiring is also formed on a printed circuit board on which the video signal driving circuit is formed. 前記プリント回路板は、フレキシブルな材料で形成されていることを特徴とする請求項4に記載の液晶表示装置。The liquid crystal display device according to claim 4, wherein the printed circuit board is made of a flexible material. 前記制御基板は、前記コモン電圧給電用配線に供給するコモン電位の電圧を生成するコモン電圧生成回路を備え、The control board includes a common voltage generation circuit that generates a common potential voltage to be supplied to the common voltage power supply wiring.
前記コモン電圧生成回路は、当該コモン電圧生成回路で生成した前記電圧の前記コモン電位と、前記コモンセンシング配線によって得られた電位とを比較して、当該コモン電圧生成回路で生成する前記電圧の前記コモン電位を調整するフィードバック回路を有することを特徴とする請求項1に記載の液晶表示装置。The common voltage generation circuit compares the common potential of the voltage generated by the common voltage generation circuit with the potential obtained by the common sensing wiring, and the common voltage generation circuit generates the common voltage generation circuit. The liquid crystal display device according to claim 1, further comprising a feedback circuit for adjusting a common potential.
前記コモンセンシング配線と前記コモンバスラインとの接続箇所は、前記走査信号駆動回路あるいは前記映像信号駆動回路が接続されない前記表示パネルの一辺上に形成されることを特徴とする請求項1に記載の液晶表示装置。The connection part of the said common sensing wiring and the said common bus line is formed on the one side of the said display panel to which the said scanning signal drive circuit or the said video signal drive circuit is not connected. Liquid crystal display device. 前記コモンバスラインは、前記表示領域の外縁よりも前記表示パネルの周辺部に近い位置に形成されることを特徴とする請求項1に記載の液晶表示装置。The liquid crystal display device according to claim 1, wherein the common bus line is formed at a position closer to a peripheral portion of the display panel than an outer edge of the display area. 前記環状の前記コモンバスラインで囲まれた領域には、前記コモン電位の電圧を前記共通電極に供給するための配線が網目状に形成されることを特徴とする請求項1に記載の液晶表示装置。2. The liquid crystal display according to claim 1, wherein wiring for supplying the common potential voltage to the common electrode is formed in a mesh shape in a region surrounded by the annular common bus line. apparatus.
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