JP4449797B2 - Electronic components - Google Patents

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  • General Electrical Machinery Utilizing Piezoelectricity, Electrostriction Or Magnetostriction (AREA)

Description

本発明は、基体と、基体の表面に形成された端子電極とを備える電子部品に関する。   The present invention relates to an electronic component including a base and terminal electrodes formed on the surface of the base.

従来におけるこの種の電子部品として、例えば特許文献1に記載された積層型圧電素子がある。この積層型圧電素子では、複数の個別電極がパターン形成された圧電体層と、コモン電極がパターン形成された圧電体層とが交互に積層され、積層方向に整列した各個別電極が、圧電体層に形成されたスルーホールを介して導電部材により接続されている。   As a conventional electronic component of this type, for example, there is a multilayer piezoelectric element described in Patent Document 1. In this stacked piezoelectric element, piezoelectric layers in which a plurality of individual electrodes are patterned and piezoelectric layers in which common electrodes are patterned are alternately stacked, and each individual electrode aligned in the stacking direction is They are connected by conductive members through through holes formed in the layers.

このような積層型圧電素子においては、最上層の圧電体層に形成された各端子電極に、駆動電源に接続するためのリード線が半田付けされる。そして、リード線を介して所定の個別電極とコモン電極との間に電圧が印加されることで、圧電体層において当該所定の個別電極に対応する活性部(圧電効果により歪みが生じる部分)が選択的に変位させられる。
特開2002−254634号公報
In such a laminated piezoelectric element, lead wires for connecting to a driving power source are soldered to each terminal electrode formed on the uppermost piezoelectric layer. Then, by applying a voltage between the predetermined individual electrode and the common electrode via the lead wire, an active portion (a portion where distortion occurs due to the piezoelectric effect) corresponding to the predetermined individual electrode in the piezoelectric layer. Is selectively displaced.
JP 2002-254634 A

ところで、上述したような積層型圧電素子等の電子部品においては、端子電極とリード線等の外部端子との接続の確実性をより一層向上させることが望まれている。そのためには、端子電極に外部端子を半田付けするための半田量を増加させればよいが、半田量を増加させると、半田が端子電極上からはみ出すおそれがある。そして、最悪の場合には、例えば、隣り合う端子電極同士が、はみ出した半田によって互いに接合し、ショートしてしまうおそれがある。   By the way, in the electronic parts such as the laminated piezoelectric element as described above, it is desired to further improve the reliability of connection between the terminal electrode and an external terminal such as a lead wire. For this purpose, the amount of solder for soldering the external terminal to the terminal electrode may be increased. However, if the amount of solder is increased, the solder may protrude from the terminal electrode. In the worst case, for example, adjacent terminal electrodes may be joined to each other by the protruding solder and short-circuited.

そこで、本発明は、このような事情に鑑みてなされたものであり、半田が端子電極上からはみ出すのを防止しつつ、端子電極にリード線等の外部端子を確実に半田付けすることができる電子部品を提供することを目的とする。   Therefore, the present invention has been made in view of such circumstances, and it is possible to reliably solder an external terminal such as a lead wire to the terminal electrode while preventing the solder from protruding from the terminal electrode. The purpose is to provide electronic components.

上記目的を達成するために、本発明に係る電子部品は、基体と、基体の表面に形成された端子電極とを備える電子部品であって、端子電極は、基体の表面から第1の高さに位置する第1の領域と、基体の表面から第1の高さより高い第2の高さに位置する第2の領域とを有することを特徴とする。   In order to achieve the above object, an electronic component according to the present invention is an electronic component comprising a base and a terminal electrode formed on the surface of the base, the terminal electrode having a first height from the surface of the base. And a second region located at a second height higher than the first height from the surface of the substrate.

この電子部品においては、端子電極にリード線等の外部端子を半田付けするに際し、基体の表面からの高さが第1の領域より高い第2の領域に外部端子を半田付けすると、溶融した半田が第1の領域に向かって流れることになる。このため、端子電極と外部端子との接続の確実性を向上させるべく、端子電極に外部端子を半田付けするための半田量を増加させても、半田が端子電極上からはみ出すようなことが防止される。従って、半田が端子電極上からはみ出すのを防止しつつ、端子電極にリード線等の外部端子を確実に半田付けすることができる。   In this electronic component, when soldering an external terminal such as a lead wire to the terminal electrode, if the external terminal is soldered to a second region whose height from the surface of the substrate is higher than the first region, the molten solder Will flow toward the first region. For this reason, in order to improve the reliability of the connection between the terminal electrode and the external terminal, even if the amount of solder for soldering the external terminal to the terminal electrode is increased, the solder does not protrude from the terminal electrode. Is done. Accordingly, it is possible to reliably solder an external terminal such as a lead wire to the terminal electrode while preventing the solder from protruding from the terminal electrode.

また、上記電子部品においては、端子電極は、基体の表面に形成された第1の電極層と、第1の電極層の表面の所定部分に形成された第2の電極層とを有し、第1の電極層の表面の露出部分は、基体の表面から第1の高さに位置する第1の領域となり、第2の電極層の表面は、基体の表面から第1の高さより高い第2の高さに位置し且つ半田により接続される外部端子が配置される第2の領域となっている。このように第1の電極層と第2の電極層とを積層することで、基体の表面から第1の高さに位置する第1の領域と、基体の表面から第1の高さより高い第2の高さに位置する第2の領域とを端子電極に容易に設けることができる。 Further, in the electronic component, the terminal electrode has a first electrode layer formed on the surface of the substrate and a second electrode layer formed on a predetermined portion of the surface of the first electrode layer, The exposed portion of the surface of the first electrode layer is a first region located at a first height from the surface of the substrate, and the surface of the second electrode layer is a first region higher than the first height from the surface of the substrate. The second region is located at the height of 2 and in which external terminals connected by solder are arranged. Thus, by laminating the first electrode layer and the second electrode layer, the first region located at the first height from the surface of the substrate and the first region higher than the first height from the surface of the substrate. The second region located at the height of 2 can be easily provided in the terminal electrode.

また、上記電子部品においては、第1の電極層は、基体に形成されたスルーホール内の導電部材に接続されており、第2の電極層は、スルーホールの開口を覆うように第1の電極層上に積層されていることが好ましい。このように第2の電極層がスルーホールの開口を覆うことで、第2の領域である第2の電極層の表面に外部端子を半田付けする際に、溶融した半田にスルーホール内の導電部材が溶け込んで(いわゆる半田食われ)、スルーホール内おける電気的な接続が切断されるのを防止することができる。   In the electronic component, the first electrode layer is connected to a conductive member in a through hole formed in the base, and the second electrode layer covers the opening of the through hole. It is preferable to be laminated on the electrode layer. Thus, when the second electrode layer covers the opening of the through hole, when the external terminal is soldered to the surface of the second electrode layer, which is the second region, the conductive material in the through hole is transferred to the molten solder. It is possible to prevent the member from melting (so-called solder erosion) and disconnecting the electrical connection in the through hole.

また、上記電子部品においては、第2の電極層はガラスフリットを含む導電性材料からなることが好ましい。これにより、第1の電極層に対する第2の電極層の食い付き性を向上させることができる。しかも、第2の電極層の表面に外部端子を半田付けする際に、溶融した半田にスルーホール内の導電部材が溶け込むのをより確実に防止することができる。   In the electronic component, the second electrode layer is preferably made of a conductive material containing glass frit. Thereby, the biting property of the second electrode layer with respect to the first electrode layer can be improved. In addition, when the external terminal is soldered to the surface of the second electrode layer, it is possible to more reliably prevent the conductive member in the through hole from being melted into the molten solder.

また、上記電子部品においては、端子電極は、所定の方向に沿って基体の表面に複数配列されており、隣り合う端子電極のうち一方の端子電極は、所定の方向と直交する方向における一端側に第2の領域を有し、他方の端子電極は、所定の方向と直交する方向における他端側に第2の領域を有することが好ましい。これにより、隣り合う端子電極のうち一方の端子電極に対しては、所定の方向と直交する方向における一端側に外部端子を半田付けし、他方の端子電極に対しては、所定の方向と直交する方向における他端側に外部端子を半田付けすることができる。このため、各端子電極に接続すべき外部端子が所定の方向において隣り合うことが回避される。従って、各端子電極に対する外部端子の接続を容易化することができると共に、隣り合う端子電極同士が半田によって接合し、ショートするのを確実に防止することができる。   In the electronic component, a plurality of terminal electrodes are arranged on the surface of the base body along a predetermined direction, and one terminal electrode of adjacent terminal electrodes is one end side in a direction orthogonal to the predetermined direction. Preferably, the other terminal electrode has a second region on the other end side in a direction orthogonal to the predetermined direction. Thereby, an external terminal is soldered to one end side in a direction orthogonal to a predetermined direction for one terminal electrode of adjacent terminal electrodes, and orthogonal to a predetermined direction for the other terminal electrode. An external terminal can be soldered to the other end side in the direction to be performed. For this reason, it is avoided that the external terminal which should be connected to each terminal electrode adjoins in a predetermined direction. Therefore, the connection of the external terminal to each terminal electrode can be facilitated, and adjacent terminal electrodes can be reliably prevented from being joined and short-circuited by solder.

また、上記電子部品においては、端子電極には、半田により外部端子が接続されていることが好ましい。この電子部品においては、上述したように、端子電極と外部端子との接続の確実性を向上させるべく、端子電極に外部端子を半田付けするための半田量を増加させても、半田が端子電極上からはみ出すようなことが防止される。従って、端子電極上からの半田のはみ出しが防止されると共に、端子電極に外部端子が確実に半田付けされる。   In the electronic component, it is preferable that an external terminal is connected to the terminal electrode by solder. In this electronic component, as described above, even if the amount of solder for soldering the external terminal to the terminal electrode is increased in order to improve the reliability of connection between the terminal electrode and the external terminal, Protruding from the top is prevented. Therefore, the solder is prevented from protruding from the terminal electrode, and the external terminal is securely soldered to the terminal electrode.

本発明によれば、半田が端子電極上からはみ出すのを防止しつつ、端子電極にリード線等の外部端子を確実に半田付けすることができる。   According to the present invention, it is possible to reliably solder an external terminal such as a lead wire to the terminal electrode while preventing the solder from protruding from the terminal electrode.

以下、本発明に係る電子部品の好適な実施形態としての積層型圧電素子について、図面を参照して詳細に説明する。なお、図面の説明において同一又は相当部分には同一符号を付し、重複する説明を省略する。   Hereinafter, a multilayer piezoelectric element as a preferred embodiment of an electronic component according to the present invention will be described in detail with reference to the drawings. In the description of the drawings, the same or corresponding parts are denoted by the same reference numerals, and redundant description is omitted.

図1に示すように、積層型圧電素子(電子部品)1は、個別電極2が形成された圧電体層3と、コモン電極4が形成された圧電体層5とが交互に積層され、更に、端子電極17,18が形成された圧電体層7が最上層に積層されることで構成されている。   As shown in FIG. 1, a multilayer piezoelectric element (electronic component) 1 includes piezoelectric layers 3 on which individual electrodes 2 are formed and piezoelectric layers 5 on which common electrodes 4 are formed, and are stacked alternately. The piezoelectric layer 7 on which the terminal electrodes 17 and 18 are formed is formed by laminating the uppermost layer.

各圧電体層3,5,7は、チタン酸ジルコン酸鉛等のセラミックスを主成分とする材料からなり、例えば「10mm×30mm,厚さ30μm」の長方形薄板状に形成されている。また、個別電極2及びコモン電極4は、銀及びパラジウムを主成分とする導電性材料からなり、スクリーン印刷によりパターン形成されたものである。このことは、端子電極17,18を除き、以下に述べる各電極についても同様である。   Each of the piezoelectric layers 3, 5, and 7 is made of a material mainly composed of ceramics such as lead zirconate titanate, and is formed in a rectangular thin plate shape of, for example, “10 mm × 30 mm, thickness 30 μm”. The individual electrode 2 and the common electrode 4 are made of a conductive material mainly composed of silver and palladium, and are patterned by screen printing. The same applies to each electrode described below except for the terminal electrodes 17 and 18.

最上層の圧電体層7から数えて2層目、4層目、6層目、8層目の圧電体層3aの上面には、図2に示すように、複数の長方形状の個別電極2がマトリックス状に配置されている。各個別電極2は、その長手方向が圧電体層3aの長手方向と直交するように配置されており、隣り合う個別電極2,2は、所定の間隔をとることによって電気的な独立が達成され、且つ互いの振動による影響が防止されている。   As shown in FIG. 2, a plurality of rectangular individual electrodes 2 are formed on the upper surface of the second, fourth, sixth, and eighth piezoelectric layers 3a from the uppermost piezoelectric layer 7. Are arranged in a matrix. Each individual electrode 2 is arranged such that its longitudinal direction is orthogonal to the longitudinal direction of the piezoelectric layer 3a, and the individual electrodes 2 and 2 adjacent to each other are electrically isolated by taking a predetermined interval. And the influence by mutual vibration is prevented.

ここで、圧電体層3aの長手方向を行方向、当該長手方向と直交する方向を列方向とすると、個別電極2は、例えば4行75列というように配置される(明瞭化のため図面では4行20列とする)。このように、複数の個別電極2をマトリックス状に配置することで、圧電体層3aに対して効率の良い配置が可能となるため、圧電体層3aにおいて振動に寄与する活性部の面積を維持しつつ、積層型圧電素子1の小型化或いは個別電極2の高集積化を図ることができる。   Here, assuming that the longitudinal direction of the piezoelectric layer 3a is the row direction and the direction orthogonal to the longitudinal direction is the column direction, the individual electrodes 2 are arranged, for example, in 4 rows and 75 columns (in the drawing for the sake of clarity). 4 rows and 20 columns). As described above, since the plurality of individual electrodes 2 are arranged in a matrix shape, an efficient arrangement with respect to the piezoelectric layer 3a is possible, so that the area of the active portion contributing to vibration in the piezoelectric layer 3a is maintained. However, the stacked piezoelectric element 1 can be miniaturized or the individual electrodes 2 can be highly integrated.

1行目及び2行目の個別電極2は、1行目と2行目との間で対向する端部を接続端部2aとし、その接続端部2aの直下において圧電体層3aに形成されたスルーホール13内の導電部材に接続されている。同様に、3行目及び4行目の個別電極2は、3行目と4行目との間で対向する端部を接続端部2aとし、その接続端部2aの直下において圧電体層3aに形成されたスルーホール13内の導電部材に接続されている。   The individual electrodes 2 in the first and second rows are formed on the piezoelectric layer 3a immediately below the connection end 2a, with the end facing the first and second rows as the connection end 2a. The through-hole 13 is connected to a conductive member. Similarly, the individual electrodes 2 in the third row and the fourth row have end portions facing each other between the third and fourth rows as connection end portions 2a, and the piezoelectric layer 3a just below the connection end portion 2a. It is connected to the conductive member in the through hole 13 formed in.

更に、圧電体層3aの上面の縁部には、上下に位置する圧電体層5のコモン電極4同士を電気的に接続するための中継電極6が形成されている。この中継電極6は、その直下において圧電体層3aに形成されたスルーホール8内の導電部材に接続されている。   Further, a relay electrode 6 for electrically connecting the common electrodes 4 of the piezoelectric layer 5 positioned above and below is formed on the edge of the upper surface of the piezoelectric layer 3a. The relay electrode 6 is connected to a conductive member in the through hole 8 formed in the piezoelectric layer 3a immediately below.

なお、最下層の圧電体層3bの上面にも、上述した2層目、4層目、6層目、8層目の圧電体層3aと同様に個別電極2がマトリックス状に配置されている。ただし、図3に示すように、最下層の圧電体層3bは、中継電極6及びスルーホール8,13が形成されていない点で圧電体層3aと異なっている。   The individual electrodes 2 are arranged in a matrix on the upper surface of the lowermost piezoelectric layer 3b as in the second, fourth, sixth, and eighth piezoelectric layers 3a. . However, as shown in FIG. 3, the lowermost piezoelectric layer 3b is different from the piezoelectric layer 3a in that the relay electrode 6 and the through holes 8 and 13 are not formed.

また、最上層の圧電体層7から数えて3層目、5層目、7層目の圧電体層5aの上面には、図4に示すように、積層型圧電素子1の積層方向(換言すれば、積層型圧電素子1の厚さ方向、すなわち、圧電体層3,5の厚さ方向)において圧電体層3aの各接続端部2aに対向するように中継電極16が形成されている。各中継電極16は、その直下において圧電体層5に形成されたスルーホール13内の導電部材に接続されている。   Further, as shown in FIG. 4, on the upper surface of the third, fifth, and seventh piezoelectric layers 5a counted from the uppermost piezoelectric layer 7, as shown in FIG. In this case, the relay electrode 16 is formed so as to face each connection end 2a of the piezoelectric layer 3a in the thickness direction of the multilayer piezoelectric element 1, that is, in the thickness direction of the piezoelectric layers 3 and 5. . Each relay electrode 16 is connected to a conductive member in a through hole 13 formed in the piezoelectric layer 5 immediately below.

更に、圧電体層5aの上面にはコモン電極4が形成されている。このコモン電極4は、1行目及び2行目の中継電極16の集合と、3行目及び4行目の中継電極16の集合とのそれぞれを所定の間隔をとって包囲すると共に、積層方向から見て、各個別電極2の接続端部2aを除く部分と重なっている。これにより、圧電体層3,5において各個別電極2の接続端部2aを除く部分に対向する部分の全体を、振動に寄与する活性部として有効に用いることができる。また、コモン電極4は、圧電体層5aの外周部から所定の間隔をとって形成され、積層方向において圧電体層3aの中継電極6に対向するように圧電体層5に形成されたスルーホール8内の導電部材に接続されている。   Further, a common electrode 4 is formed on the upper surface of the piezoelectric layer 5a. The common electrode 4 surrounds the set of the relay electrodes 16 in the first row and the second row and the set of the relay electrodes 16 in the third row and the fourth row with a predetermined interval, and in the stacking direction. As seen from FIG. 1, the individual electrodes 2 overlap the portions excluding the connection end 2a. As a result, the entire portion of the piezoelectric layers 3 and 5 facing the portion excluding the connection end 2a of each individual electrode 2 can be effectively used as an active portion that contributes to vibration. The common electrode 4 is formed at a predetermined interval from the outer peripheral portion of the piezoelectric layer 5a, and is a through hole formed in the piezoelectric layer 5 so as to face the relay electrode 6 of the piezoelectric layer 3a in the stacking direction. It is connected to the conductive member in 8.

なお、9層目の圧電体層5bの上面にも、上述した3層目、5層目、7層目の圧電体層5aと同様に中継電極16及びコモン電極4が形成されている。ただし、図5に示すように、9層目の圧電体層5bは、スルーホール8が形成されていない点で圧電体層5aと異なっている。   Note that the relay electrode 16 and the common electrode 4 are also formed on the upper surface of the ninth piezoelectric layer 5b in the same manner as the third, fifth, and seventh piezoelectric layers 5a. However, as shown in FIG. 5, the ninth piezoelectric layer 5b is different from the piezoelectric layer 5a in that the through hole 8 is not formed.

また、最上層の圧電体層7の上面には、図6に示すように、積層方向において圧電体層3aの各個別電極2の接続端部2aに対向するように端子電極17が形成され、積層方向において圧電体層3aの中継電極6に対向するように端子電極18が形成されている。各端子電極17は、その直下において圧電体層7に形成されたスルーホール13内の導電部材に接続され、端子電極18は、その直下において圧電体層7に形成されたスルーホール8内の導電部材に接続されている。これらの端子電極17,18には、駆動電源に接続すべく、FPC(flexible printed circuit board)等のリード線が半田付けされる。   Further, as shown in FIG. 6, a terminal electrode 17 is formed on the upper surface of the uppermost piezoelectric layer 7 so as to face the connection end portion 2a of each individual electrode 2 of the piezoelectric layer 3a in the stacking direction. A terminal electrode 18 is formed so as to face the relay electrode 6 of the piezoelectric layer 3a in the stacking direction. Each terminal electrode 17 is connected to a conductive member in a through hole 13 formed in the piezoelectric layer 7 immediately below it, and the terminal electrode 18 is electrically connected in a through hole 8 formed in the piezoelectric layer 7 immediately below it. Connected to the member. These terminal electrodes 17 and 18 are soldered with lead wires such as an FPC (flexible printed circuit board) so as to be connected to a driving power source.

以上のように電極パターンが形成された圧電体層3,5,7の積層によって、最上層の各端子電極17に対しては、積層方向において5つの個別電極2が中継電極16を介在させて整列し、整列した各電極2,16,17は、図7に示すように、スルーホール13内の導電部材14により電気的に接続されることになる。一方、最上層の端子電極18に対しては、積層方向において4つのコモン電極4が中継電極6を介在させて整列し、整列した各電極4,6,18は、スルーホール8内の導電部材14により電気的に接続されることになる。   By stacking the piezoelectric layers 3, 5, and 7 with the electrode pattern formed as described above, the five individual electrodes 2 are interposed with the relay electrodes 16 in the stacking direction with respect to the uppermost terminal electrodes 17. As shown in FIG. 7, the aligned electrodes 2, 16, and 17 are electrically connected by the conductive member 14 in the through hole 13. On the other hand, with respect to the uppermost terminal electrode 18, four common electrodes 4 are aligned in the stacking direction with the relay electrode 6 interposed, and the aligned electrodes 4, 6, 18 are conductive members in the through hole 8. 14 to be electrically connected.

なお、積層方向において隣り合うスルーホール13,13を、互いの中心軸がずれるように各圧電体層3,5,7に形成することで、スルーホール13内の導電部材14による電気的な接続をより確実化することができる。このことは、積層方向において隣り合うスルーホール8,8についても同様である。   The through-holes 13 and 13 adjacent in the stacking direction are formed in the piezoelectric layers 3, 5 and 7 so that their center axes are shifted from each other, so that electrical connection by the conductive member 14 in the through-hole 13 is achieved. Can be made more reliable. The same applies to the through holes 8 and 8 adjacent in the stacking direction.

このような積層型圧電素子1における電気的接続により、所定の端子電極17と端子電極18との間に電圧を印加すると、当該所定の端子電極17下に整列する個別電極2とコモン電極4との間に電圧が印加されることになる。これにより、圧電体層3,5においては、図7に示すように、個別電極2とコモン電極4とで挟まれる部分に電界Eが生じ、当該部分が活性部Aとして変位することになる。従って、電圧を印加する端子電極17を選択することで、マトリックス状に配置された各個別電極2に対応する活性部Aのうち、選択した端子電極17下に整列する活性部Aを積層方向に変位させることができる。このような積層型圧電素子1は、マイクロポンプの弁制御等、微小変位を必要とする種々の装置の駆動源に適用される。   When a voltage is applied between the predetermined terminal electrode 17 and the terminal electrode 18 by such electrical connection in the multilayer piezoelectric element 1, the individual electrode 2 and the common electrode 4 aligned under the predetermined terminal electrode 17 A voltage is applied during the period. As a result, in the piezoelectric layers 3 and 5, as shown in FIG. 7, an electric field E is generated in a portion sandwiched between the individual electrode 2 and the common electrode 4, and the portion is displaced as the active portion A. Therefore, by selecting the terminal electrode 17 to which the voltage is applied, among the active parts A corresponding to the individual electrodes 2 arranged in a matrix, the active parts A aligned under the selected terminal electrode 17 are arranged in the stacking direction. Can be displaced. Such a laminated piezoelectric element 1 is applied to a drive source of various devices that require minute displacement, such as valve control of a micropump.

次に、上述した端子電極17について、図8及び図9を参照してより詳細に説明する。図8は、積層型圧電素子1の拡大部分平面図であり、図9は、図8に示すIX−IX線に沿っての拡大部分断面図である。   Next, the terminal electrode 17 mentioned above is demonstrated in detail with reference to FIG.8 and FIG.9. FIG. 8 is an enlarged partial plan view of the multilayer piezoelectric element 1, and FIG. 9 is an enlarged partial cross-sectional view along the line IX-IX shown in FIG.

図8及び図9に示すように、端子電極17は、圧電体層(基体)7の表面7aに形成された長方形状の第1の電極層21と、この第1の電極層21の表面21aの所定部分(積層方向においてスルーホール13と対向する部分)に形成された長方形状の第2の電極層23とを有している。第1の電極層21は、銀及びパラジウムを主成分とする導電性材料からなり、圧電体層7に形成されたスルーホール13内の導電部材14に接続されている。また、第2の電極層23は、銀を主成分とする導電性材料からなり、スルーホール13の開口を覆うように第1の電極層21上に積層されている。   As shown in FIGS. 8 and 9, the terminal electrode 17 includes a rectangular first electrode layer 21 formed on the surface 7 a of the piezoelectric layer (substrate) 7, and a surface 21 a of the first electrode layer 21. And a rectangular second electrode layer 23 formed in a predetermined portion (a portion facing the through hole 13 in the stacking direction). The first electrode layer 21 is made of a conductive material mainly composed of silver and palladium, and is connected to the conductive member 14 in the through hole 13 formed in the piezoelectric layer 7. The second electrode layer 23 is made of a conductive material mainly composed of silver, and is laminated on the first electrode layer 21 so as to cover the opening of the through hole 13.

これにより、端子電極17は、圧電体層7の表面7aから第1の高さに位置する第1の領域R1と、圧電体層7の表面7aから第1の高さより高い第2の高さに位置する第2の領域R2とを有することになる。つまり、第1の電極層21の表面21aの露出部分(表面21aのうち、第2の電極層23が形成された所定部分以外の部分)が第1の領域R1であり、第2の電極層23の表面23aが第2の領域R2である。   Accordingly, the terminal electrode 17 includes a first region R1 located at a first height from the surface 7a of the piezoelectric layer 7, and a second height higher than the first height from the surface 7a of the piezoelectric layer 7. And the second region R2 located in the region. That is, the exposed portion of the surface 21a of the first electrode layer 21 (the portion of the surface 21a other than the predetermined portion where the second electrode layer 23 is formed) is the first region R1, and the second electrode layer The surface 23a of 23 is the second region R2.

以上のように、積層型圧電素子1においては、図9に示すように、端子電極17にリード線(外部端子)24を半田付けするに際し、圧電体層7の表面7aからの高さが第1の領域R1より高い第2の領域R2にリード線24を配置することができる。こうすると、半田付けの際に溶融した半田25が第2の領域R2から第1の領域R1に向かって流れ易くなる。このため、端子電極17とリード線24との接続の確実性を向上させるべく、端子電極17にリード線24を半田付けするための半田量を増加させても、半田25が端子電極17上からはみ出すようなことが防止される。従って、半田25が端子電極17上からはみ出すのを防止しつつ、端子電極17にリード線24を確実に半田付けすることができる。   As described above, in the multilayer piezoelectric element 1, as shown in FIG. 9, when the lead wire (external terminal) 24 is soldered to the terminal electrode 17, the height from the surface 7 a of the piezoelectric layer 7 is the first. The lead wire 24 can be arranged in the second region R2 higher than the first region R1. This makes it easier for the solder 25 melted during soldering to flow from the second region R2 toward the first region R1. For this reason, even if the amount of solder for soldering the lead wire 24 to the terminal electrode 17 is increased in order to improve the connection reliability between the terminal electrode 17 and the lead wire 24, the solder 25 is removed from above the terminal electrode 17. Protruding is prevented. Accordingly, it is possible to reliably solder the lead wire 24 to the terminal electrode 17 while preventing the solder 25 from protruding from the terminal electrode 17.

なお、第1の電極層21は、銀及びパラジウムを主成分とする導電性材料からなるものであったが、第1の電極層21は、パラジウムを含有していれば、他の導電性材料からなるものであってもよい。第1の電極層21がパラジウムを含有していると、第1の電極層21が薄膜であっても、いわゆる半田食われが生じ難くなるからである。具体的には、第1の電極層21は、金属元素の合計重量を基準として、パラジウムを3重量%以上含有していることが好ましく、パラジウムを5重量%以上含有していることがより好ましい。パラジウムを3重量%以上含有していないと、いわゆる半田食われが生じ易くなり、溶融した半田25が第1の領域R1全体に的確に流れないおそれがあるからである。そして、上述したように、第2の電極層23が、銀を主成分とする導電性材料からなるものである場合には、第1の電極層21は、銀及びパラジウムを主成分とする導電性材料からなるものであることが好ましいが、第1の電極層21は、金及びパラジウムを主成分とする導電性材料からなるものや、金、白金及びパラジウムを主成分とする導電性材料からなるもの等であってもよい。   The first electrode layer 21 is made of a conductive material mainly composed of silver and palladium. However, the first electrode layer 21 is made of another conductive material as long as it contains palladium. It may consist of. This is because when the first electrode layer 21 contains palladium, so-called solder erosion hardly occurs even if the first electrode layer 21 is a thin film. Specifically, the first electrode layer 21 preferably contains 3% by weight or more of palladium, more preferably 5% by weight or more, based on the total weight of the metal elements. . If palladium is not contained in an amount of 3% by weight or more, so-called solder erosion is likely to occur, and the melted solder 25 may not flow accurately over the entire first region R1. As described above, when the second electrode layer 23 is made of a conductive material mainly containing silver, the first electrode layer 21 is made of a conductive material mainly containing silver and palladium. The first electrode layer 21 is preferably made of a conductive material mainly composed of gold and palladium or a conductive material mainly composed of gold, platinum and palladium. It may be.

また、第1の領域R1の第1の高さは3μm以下であることが好ましく、2μm以下であることがより好ましい。第1の高さが3μmを超えると、溶融した半田25が不必要な方向に流れ易くなるからである。更に、第1の領域R1の第1の高さと第2の領域R2の第2の高さとの差は、5μm〜20μmであることが好ましく、7μm〜15μmであることがより好ましい。第1の高さと第2の高さとの差が5μm未満になると、溶融した半田25が第2の領域R2から第1の領域R1に向かって流れ難くなるからであり、第1の高さと第2の高さとの差が20μmを超えると、溶融した半田25が流れる方向の制御が困難になるからである。ここで、第1の高さ及び第2の高さは、第1の領域R1内及び第2の領域R2内において最も高い点を基準とした場合(表面粗さも考慮)の高さである。   Further, the first height of the first region R1 is preferably 3 μm or less, and more preferably 2 μm or less. This is because when the first height exceeds 3 μm, the melted solder 25 easily flows in an unnecessary direction. Furthermore, the difference between the first height of the first region R1 and the second height of the second region R2 is preferably 5 μm to 20 μm, and more preferably 7 μm to 15 μm. This is because when the difference between the first height and the second height is less than 5 μm, the molten solder 25 is difficult to flow from the second region R2 toward the first region R1. This is because if the difference from the height of 2 exceeds 20 μm, it becomes difficult to control the direction in which the molten solder 25 flows. Here, the first height and the second height are heights based on the highest point in the first region R1 and the second region R2 (including the surface roughness).

また、積層型圧電素子1においては、第1の電極層21と第2の電極層23との積層により端子電極17を構成することで、圧電体層7の表面7aから第1の高さに位置する第1の領域R1と、圧電体層7の表面7aから第1の高さより高い第2の高さに位置する第2の領域R2とを端子電極17に容易に設けることができる。   In the multilayer piezoelectric element 1, the terminal electrode 17 is configured by stacking the first electrode layer 21 and the second electrode layer 23, so that the first height from the surface 7 a of the piezoelectric layer 7 is increased. The terminal region 17 can be easily provided with the first region R <b> 1 positioned and the second region R <b> 2 positioned at a second height higher than the first height from the surface 7 a of the piezoelectric layer 7.

更に、積層型圧電素子1においては、第1の電極層21上で第2の電極層23がスルーホール13の開口を覆っているため、第2の領域R2である第2の電極層23の表面23aにリード線24を半田付けする際に、溶融した半田にスルーホール13内の導電部材14が溶け込んで、スルーホール13内おける電気的な接続が切断されるのを防止することができる。   Furthermore, in the multilayer piezoelectric element 1, since the second electrode layer 23 covers the opening of the through hole 13 on the first electrode layer 21, the second electrode layer 23, which is the second region R2, of the second electrode layer 23 is covered. When the lead wire 24 is soldered to the surface 23a, it is possible to prevent the conductive member 14 in the through hole 13 from being melted into the melted solder and disconnecting the electrical connection in the through hole 13.

なお、第2の電極層23を構成する導電性材料には、ガラスフリットを含ませることが好ましい。これは、第1の電極層21に対する第2の電極層23の食い付き性を向上させることができると共に、第2の電極層23の表面23aにリード線24を半田付けする際に、溶融した半田にスルーホール13内の導電部材14が溶け込むのをより確実に防止することができるからである。   The conductive material constituting the second electrode layer 23 preferably contains glass frit. This can improve the biting property of the second electrode layer 23 with respect to the first electrode layer 21 and is melted when the lead wire 24 is soldered to the surface 23a of the second electrode layer 23. This is because it is possible to more reliably prevent the conductive member 14 in the through hole 13 from being melted into the solder.

また、第2の領域R2の幅は、第1の領域R1の幅と略同一であることが好ましいが、第1の領域R1の幅の1/4程度以上であれば、それであってもよい。更に、第2の領域R2の面積は、第1の領域R1の面積の15%〜60%であることが好ましく、20%〜50%であることがより好ましい。   Further, the width of the second region R2 is preferably substantially the same as the width of the first region R1, but may be as long as it is about 1/4 or more of the width of the first region R1. . Furthermore, the area of the second region R2 is preferably 15% to 60%, more preferably 20% to 50% of the area of the first region R1.

ところで、端子電極18にも、上述した端子電極17と同様の構成が採用されるため、端子電極18においても端子電極17と同様の作用効果が奏される。   By the way, since the same structure as the terminal electrode 17 mentioned above is employ | adopted also at the terminal electrode 18, the effect similar to the terminal electrode 17 is show | played also in the terminal electrode 18. FIG.

ここで、圧電体層7の長手方向を行方向、当該長手方向と直交する方向を列方向とすると、図6に示すように、端子電極17は、積層方向において圧電体層3aの各個別電極2の接続端部2aに対向するため、例えば4行75列というように圧電体層7の表面7aに配置されることになる(明瞭化のため図面では4行20列とする)。長方形状に形成された各端子電極17は、その長手方向が列方向と一致するように配置されている。   Here, assuming that the longitudinal direction of the piezoelectric layer 7 is the row direction and the direction orthogonal to the longitudinal direction is the column direction, as shown in FIG. 6, the terminal electrode 17 is connected to each individual electrode of the piezoelectric layer 3 a in the stacking direction. 2 is arranged on the surface 7a of the piezoelectric layer 7 so as to be, for example, 4 rows and 75 columns (for the sake of clarity, it is set to 4 rows and 20 columns). Each terminal electrode 17 formed in a rectangular shape is arranged such that its longitudinal direction coincides with the column direction.

行方向に沿って圧電体層7の表面7aに配列された各端子電極17の直下に形成されたスルーホール13は、行方向において千鳥状に配列されている。そして、第2の電極層23は、スルーホール13の開口を覆うように第1の電極層21上に積層される。これらにより、図8に示すように、1行目〜4行目の各行では、行方向において隣り合う端子電極17,17のうち一方の端子電極17は、その長手方向における一端側に第2の領域R2を有し、他方の端子電極17は、その長手方向における他端側に第2の領域R2を有することになる。   The through holes 13 formed immediately below the respective terminal electrodes 17 arranged on the surface 7a of the piezoelectric layer 7 along the row direction are arranged in a staggered manner in the row direction. Then, the second electrode layer 23 is stacked on the first electrode layer 21 so as to cover the opening of the through hole 13. Accordingly, as shown in FIG. 8, in each of the first to fourth rows, one of the terminal electrodes 17 and 17 adjacent in the row direction has one terminal electrode 17 on the one end side in the longitudinal direction. It has area | region R2, and the other terminal electrode 17 has 2nd area | region R2 in the other end side in the longitudinal direction.

従って、隣り合う端子電極17,17のうち一方の端子電極17に対しては、その長手方向における一端側にリード線24を半田付けし、他方の端子電極17に対しては、その長手方向における他端側にリード線24を半田付けすることができる。このため、各端子電極17に接続すべきリード線24が行方向において隣り合うことが回避される。よって、各端子電極17に対するリード線24の接続を容易化することができると共に、隣り合う端子電極17同士が半田によって接合し、ショートするのを確実に防止することができる。   Therefore, the lead wire 24 is soldered to one end side in the longitudinal direction of one of the adjacent terminal electrodes 17 and 17, and the other terminal electrode 17 in the longitudinal direction. The lead wire 24 can be soldered to the other end side. For this reason, it is avoided that the lead wires 24 to be connected to the terminal electrodes 17 are adjacent in the row direction. Therefore, the connection of the lead wire 24 to each terminal electrode 17 can be facilitated, and adjacent terminal electrodes 17 can be reliably prevented from being joined and short-circuited by solder.

なお、端子電極17は、その配列方向(すなわち、行方向)と直交する方向(すなわち、列方向)を長手方向とする長方形状に形成されていることから、列方向における第1の領域R1の長さを、列方向における第2の領域R2の長さ以上とすることができる。これにより、半田付けの際に溶融した半田25が流れる領域(すなわち、第1の領域R1)を広く確保することができ、半田25が端子電極17上からはみ出すのをより確実に防止することが可能になる。更に、隣り合う端子電極17,17の形成間隔を狭くしても、当該隣り合う端子電極17,17のそれぞれにおいてリード線24が半田付けされる第2の領域R2,R2間の距離が長くなるため、当該隣り合う端子電極17,17間における半田25の互いの接合をより確実に防止することが可能になる。   The terminal electrode 17 is formed in a rectangular shape whose longitudinal direction is the direction (that is, the column direction) orthogonal to the arrangement direction (that is, the row direction), and therefore the first region R1 in the column direction. The length can be greater than or equal to the length of the second region R2 in the column direction. As a result, it is possible to secure a wide region (that is, the first region R1) through which the molten solder 25 flows during soldering, and more reliably prevent the solder 25 from protruding from the terminal electrode 17. It becomes possible. Further, even if the interval between the adjacent terminal electrodes 17 and 17 is reduced, the distance between the second regions R2 and R2 to which the lead wires 24 are soldered is increased in each of the adjacent terminal electrodes 17 and 17. Therefore, it becomes possible to more reliably prevent the solder 25 from joining to each other between the adjacent terminal electrodes 17 and 17.

次に、上述した積層型圧電素子1の作製手順について説明する。まず、チタン酸ジルコン酸鉛等を主成分とする圧電セラミックス材料に有機バインダ・有機溶剤等を混合して基体ペーストを作製し、この基体ペーストを用いて各圧電体層3,5,7となるグリーンシートを成形する。また、所定比率の銀とパラジウムとからなる金属材料に有機バインダ・有機溶剤等を混合して導電ペーストを作製する。   Next, a manufacturing procedure of the multilayer piezoelectric element 1 described above will be described. First, a base paste is prepared by mixing a piezoelectric ceramic material mainly composed of lead zirconate titanate and the like with an organic binder, an organic solvent, and the like, and each of the piezoelectric layers 3, 5, and 7 is formed using the base paste. Form a green sheet. Moreover, an organic binder, an organic solvent, etc. are mixed with the metal material which consists of silver and palladium of a predetermined ratio, and an electrically conductive paste is produced.

続いて、各圧電体層3,5,7となるグリーンシートの所定の位置にレーザ光を照射してスルーホール8,13を形成する。そして、スルーホール8,13内に対して、導電ペーストを用いて充填スクリーン印刷を行い、導電部材14を形成する。その後、各圧電体層3,5となるグリーンシートに対しては、導電ペーストを用いてスクリーン印刷を行い、各電極2,4,6,16を形成する。また、最上層の圧電体層7となるグリーンシートに対しては、導電ペーストを用いてスクリーン印刷を行い、下地電極として第1の電極層21を形成する。   Subsequently, the through holes 8 and 13 are formed by irradiating a predetermined position on the green sheet to be the piezoelectric layers 3, 5 and 7 with laser light. Then, filling screen printing is performed on the through holes 8 and 13 using a conductive paste to form the conductive member 14. Thereafter, the green sheets to be the piezoelectric layers 3 and 5 are screen-printed using a conductive paste to form the electrodes 2, 4, 6 and 16. Further, the green sheet to be the uppermost piezoelectric layer 7 is screen-printed using a conductive paste to form the first electrode layer 21 as a base electrode.

続いて、電極パターンが形成されたグリーンシートを上述の順序で積層し、積層方向にプレスを行って積層体グリーンを作製する。この積層体グリーンを脱脂・焼成した後、圧電体層7となる焼結シートに対して銀の焼付電極を施し、第2の電極層23を形成する。その後、分極処理を行って積層型圧電素子1を完成させる。   Subsequently, the green sheets on which the electrode patterns are formed are laminated in the above-described order, and pressed in the laminating direction to produce a laminate green. After degreasing and firing the laminate green, a silver baking electrode is applied to the sintered sheet to be the piezoelectric layer 7 to form the second electrode layer 23. Thereafter, polarization processing is performed to complete the multilayer piezoelectric element 1.

なお、第2の電極層23の材料として銀を用いたのは、リード線24を半田付けするに際し半田25を乗せ易くするためである。また、第2の電極層23の材料として金や銅等を用いてもよい。更に、第2の電極層23の形成方法としてスパッタリングや無電界メッキ法等を採用してもよい。   The reason why silver is used as the material of the second electrode layer 23 is to make it easier to place the solder 25 when the lead wire 24 is soldered. Further, gold, copper, or the like may be used as the material of the second electrode layer 23. Furthermore, as a method for forming the second electrode layer 23, sputtering, electroless plating, or the like may be employed.

本発明は、上述した実施形態に限定されるものではない。例えば、上記実施形態では、第1の電極層21と第2の電極層23とが積層されて端子電極17が構成されていたが、端子電極17は、圧電体層7の表面7aから第1の高さに位置する第1の領域R1と、圧電体層7の表面7aから第1の高さより高い第2の高さに位置する第2の領域R2とを有するものであれば、一層の電極層から構成されていてもよい。なお、この場合にも、いわゆる半田食われ抑制の観点から、端子電極17は、パラジウムを含有する導電性材料からなるものであることが好ましい。   The present invention is not limited to the embodiment described above. For example, in the embodiment described above, the terminal electrode 17 is configured by laminating the first electrode layer 21 and the second electrode layer 23, but the terminal electrode 17 is formed from the surface 7 a of the piezoelectric layer 7 to the first. If there is a first region R1 located at a height of 2 mm and a second region R2 located at a second height higher than the first height from the surface 7a of the piezoelectric layer 7, one layer You may be comprised from the electrode layer. In this case, the terminal electrode 17 is preferably made of a conductive material containing palladium from the viewpoint of suppressing so-called solder erosion.

また、上記実施形態では、いわゆる半田食われを防止すべく、第2の電極層23がスルーホール13の開口を覆うように第1の電極層21上に積層されていたが、半田25が端子電極17上からはみ出すのを防止しつつ、端子電極17にリード線24を確実に半田付けするためには、必ずしも、第1の電極層21上において第2の電極層23がスルーホール13の開口を覆っていなくてもよい。   In the above embodiment, the second electrode layer 23 is laminated on the first electrode layer 21 so as to cover the opening of the through hole 13 in order to prevent so-called solder erosion. In order to surely solder the lead wire 24 to the terminal electrode 17 while preventing the electrode 17 from protruding from the electrode 17, the second electrode layer 23 is not necessarily formed on the first electrode layer 21. May not be covered.

また、上記実施形態では、端子電極17を形成するために、且つ個別電極2等の内部電極を保護するために、最上層に圧電体層7を設けていたが、端子電極17の形成においてスペース上及び機能上の問題がなければ、最上層に圧電体層7を設けることなく、個別電極2等の内部電極が形成された圧電体層3に、第1の領域R1及び第2の領域R2を有する端子電極17を形成してもよい。   In the above embodiment, the piezoelectric layer 7 is provided as the uppermost layer in order to form the terminal electrode 17 and protect the internal electrodes such as the individual electrodes 2. If there is no problem in terms of function and function, the first region R1 and the second region R2 are formed in the piezoelectric layer 3 on which the internal electrodes such as the individual electrodes 2 are formed without providing the piezoelectric layer 7 as the uppermost layer. You may form the terminal electrode 17 which has.

更に、本発明は、積層型圧電素子1に限らず、基体と、基体の表面に形成された端子電極とを備える種々の電子部品に適用可能である。   Further, the present invention is not limited to the multilayer piezoelectric element 1 and can be applied to various electronic components including a base and terminal electrodes formed on the surface of the base.

本発明に係る電子部品の一実施形態としての積層型圧電素子の分解斜視図である。1 is an exploded perspective view of a multilayer piezoelectric element as one embodiment of an electronic component according to the present invention. 図1に示す積層型圧電素子の2層目、4層目、6層目、8層目の圧電体層の平面図である。FIG. 2 is a plan view of second, fourth, sixth, and eighth piezoelectric layers of the multilayer piezoelectric element shown in FIG. 1. 図1に示す積層型圧電素子の最下層の圧電体層の平面図である。FIG. 2 is a plan view of the lowermost piezoelectric layer of the multilayer piezoelectric element shown in FIG. 1. 図1に示す積層型圧電素子の3層目、5層目、7層目の圧電体層の平面図である。FIG. 2 is a plan view of third, fifth, and seventh piezoelectric layers of the multilayer piezoelectric element shown in FIG. 1. 図1に示す積層型圧電素子の9層目の圧電体層の平面図である。FIG. 2 is a plan view of a ninth piezoelectric layer of the multilayer piezoelectric element shown in FIG. 1. 図1に示す積層型圧電素子の最上層の圧電体層の平面図である。FIG. 2 is a plan view of the uppermost piezoelectric layer of the multilayer piezoelectric element shown in FIG. 1. 図1に示す積層型圧電素子の長手方向に垂直な拡大部分断面図である。FIG. 2 is an enlarged partial cross-sectional view perpendicular to the longitudinal direction of the multilayer piezoelectric element shown in FIG. 1. 図1に示す積層型圧電素子の拡大部分平面図である。FIG. 2 is an enlarged partial plan view of the multilayer piezoelectric element shown in FIG. 1. 図8に示すIX−IX線に沿っての拡大部分断面図である。It is an expanded partial sectional view along the IX-IX line shown in FIG.

符号の説明Explanation of symbols

1…積層型圧電素子(電子部品)、7…圧電体層(基体)、13…スルーホール、14…導電部材、17…端子電極、21…第1の電極層、23…第2の電極層、24…リード線(外部端子)、25…半田、R1…第1の領域、R2…第2の領域。   DESCRIPTION OF SYMBOLS 1 ... Laminated piezoelectric element (electronic component), 7 ... Piezoelectric layer (base | substrate), 13 ... Through hole, 14 ... Conductive member, 17 ... Terminal electrode, 21 ... 1st electrode layer, 23 ... 2nd electrode layer , 24 ... lead wire (external terminal), 25 ... solder, R1 ... first region, R2 ... second region.

Claims (5)

基体と、前記基体の表面に形成された端子電極とを備える電子部品であって、
前記端子電極は、前記基体の表面に形成された第1の電極層と、前記第1の電極層の表面の所定部分に形成された第2の電極層とを有し、
前記第1の電極層の表面の露出部分は、前記基体の表面から第1の高さに位置する第1の領域となり、前記第2の電極層の表面は、前記基体の表面から前記第1の高さより高い第2の高さに位置し且つ半田により接続される外部端子が配置される第2の領域となっており、
前記端子電極は、所定の方向に沿って前記基体の表面に複数配列され、
前記第2の電極層は、前記所定の方向と直交する方向における前記第1の電極層の端部に位置しており、前記所定の方向における前記第2の電極層の幅は、前記所定の方向における前記第1の電極層の幅と略同一となっていることを特徴とする電子部品。
An electronic component comprising a base and a terminal electrode formed on the surface of the base,
The terminal electrode has a first electrode layer formed on the surface of the substrate and a second electrode layer formed on a predetermined portion of the surface of the first electrode layer,
The exposed portion of the surface of the first electrode layer becomes a first region located at a first height from the surface of the base, and the surface of the second electrode layer extends from the surface of the base. The second region is located at a second height higher than the height of the external terminal and is connected to the external terminals connected by solder.
A plurality of the terminal electrodes are arranged on the surface of the base body along a predetermined direction,
The second electrode layer is located at an end portion of the first electrode layer in a direction orthogonal to the predetermined direction, and the width of the second electrode layer in the predetermined direction is electronic component characterized that you have become substantially the same as the width of the first electrode layer in the direction.
前記第1の電極層は、前記基体に形成されたスルーホール内の導電部材に接続されており、
前記第2の電極層は、前記スルーホールの開口を覆うように前記第1の電極層上に積層されていることを特徴とする請求項記載の電子部品。
The first electrode layer is connected to a conductive member in a through hole formed in the base body,
The second electrode layer, the electronic component according to claim 1, characterized in that it is laminated on the first electrode layer so as to cover the opening of the through hole.
前記第2の電極層はガラスフリットを含む導電性材料からなることを特徴とする請求項又は記載の電子部品。 The second electrode layer electronic component according to claim 1 or 2, wherein the electrically conductive material including a glass frit. 隣り合う前記端子電極のうち一方の端子電極は、前記所定の方向と直交する方向における一端側に前記第2の領域を有し、他方の端子電極は、前記所定の方向と直交する方向における他端側に前記第2の領域を有することを特徴とする請求項1〜のうちのいずれか一項記載の電子部品。 Of the adjacent terminal electrodes, one terminal electrode has the second region on one end side in a direction perpendicular to the predetermined direction, and the other terminal electrode is the other in the direction orthogonal to the predetermined direction. The electronic component according to any one of claims 1 to 3 , wherein the second region is provided on an end side. 前記端子電極には、半田により前記外部端子が接続されていることを特徴とする請求項1〜のうちのいずれか一項記載の電子部品。
Wherein the terminal electrode, the one electronic component of one claim of claims 1-4 in which the external terminal is characterized in that it is connected by solder.
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