JP4417074B2 - A / D converter with phase adjustment function - Google Patents

A / D converter with phase adjustment function Download PDF

Info

Publication number
JP4417074B2
JP4417074B2 JP2003382578A JP2003382578A JP4417074B2 JP 4417074 B2 JP4417074 B2 JP 4417074B2 JP 2003382578 A JP2003382578 A JP 2003382578A JP 2003382578 A JP2003382578 A JP 2003382578A JP 4417074 B2 JP4417074 B2 JP 4417074B2
Authority
JP
Japan
Prior art keywords
phase
signal
converter
phase adjustment
selector
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2003382578A
Other languages
Japanese (ja)
Other versions
JP2005143640A (en
Inventor
誠二 竹内
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Asahi Kasei EMD Corp
Original Assignee
Asahi Kasei EMD Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Asahi Kasei EMD Corp filed Critical Asahi Kasei EMD Corp
Priority to JP2003382578A priority Critical patent/JP4417074B2/en
Publication of JP2005143640A publication Critical patent/JP2005143640A/en
Application granted granted Critical
Publication of JP4417074B2 publication Critical patent/JP4417074B2/en
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Images

Description

本発明は位相調整機能付きA/Dコンバーに関し、特に超音波診断装置に用いて好適な位相調整機能付きA/Dコンバーに関する。 The present invention relates to A / D converter with a phase adjustment function of a preferred phase adjustment function A / D converter used in particular to an ultrasonic diagnostic apparatus.

一般的な超音波診断装置について、図6を参照して説明する。同図に示されている超音波診断装置は、非特許文献1に開示されている。同図に示されている超音波診断装置において、送信器20から出力されるパルス波は、探触子を介して診断対象に向けて送出される。診断対象からのエコー信号は、同じ探触子によって受信され、受信器30に入力される。受信器30では、受信信号が増幅され、検波器40に送られる。検波器40では受信信号についてアナログ信号からディジタル信号への変換が行われる。この検波器40から出力されるディジタル信号は、ラインメモリ50に記憶される。ラインメモリ50に記憶されたデータは、読出されてスキャンコンバージョンメモリ60に記憶され、それが読出されてディスプレイ画面70等に表示される。   A general ultrasonic diagnostic apparatus will be described with reference to FIG. The ultrasonic diagnostic apparatus shown in the figure is disclosed in Non-Patent Document 1. In the ultrasonic diagnostic apparatus shown in the figure, the pulse wave output from the transmitter 20 is transmitted toward the diagnosis target via the probe. The echo signal from the diagnosis target is received by the same probe and input to the receiver 30. In the receiver 30, the received signal is amplified and sent to the detector 40. The detector 40 converts the received signal from an analog signal to a digital signal. The digital signal output from the detector 40 is stored in the line memory 50. The data stored in the line memory 50 is read out and stored in the scan conversion memory 60, which is read out and displayed on the display screen 70 or the like.

ところで、超音波診断装置においては、受信信号について整相加算が行われる。このことについて、図7を参照して説明する。同図に示されているように、複数個配列して設けられた受波素子11からなる探触子によって、診断対象からのエコーを受信する。診断対象からのエコーの伝搬距離は、その到来方向θにより、受波素子毎に異なる。したがって、各素子によって受信されるパルスを同じ位相で加算する必要がある。これは整相加算と呼ばれている。この整相加算を実現するには、N番目から−N番目までの受波素子のうち、最も初めに到達するN番目の受波素子でのパルスを最も遅延させ、順にこの遅延量を減らす必要がある。   By the way, in an ultrasonic diagnostic apparatus, phasing addition is performed about a received signal. This will be described with reference to FIG. As shown in the figure, an echo from a diagnosis target is received by a probe including a plurality of receiving elements 11 arranged in a plurality. The propagation distance of the echo from the diagnosis target differs for each wave receiving element depending on the arrival direction θ. It is therefore necessary to add the pulses received by each element with the same phase. This is called phasing addition. In order to realize this phasing addition, it is necessary to delay the pulse at the Nth receiving element that arrives first among the Nth to -Nth receiving elements, and to reduce the delay amount in order. There is.

つまり、同図に示されている三角形にあたる遅延量を設定する。この遅延量により、すべての受波素子で受信したパルスは同じ位相で加算することができる。いま、i番目の受波素子での遅延量をtとすると、幾何学的な関係から、
t={(N+i)psinθ}/c
となる。ただし、pは各素子の間隔、cは音速である。
That is, the delay amount corresponding to the triangle shown in FIG. With this delay amount, the pulses received by all the receiving elements can be added with the same phase. Now, assuming that the delay amount at the i-th receiving element is t, from the geometrical relationship,
t = {(N + i) psinθ} / c
It becomes. Here, p is an interval between elements, and c is the speed of sound.

このような整相加算を実現する方式として、アナログ方式と、ディジタル方式とがある。アナログ方式では、上記のように遅延量を設定した可変遅延素子を介して入力信号を入力しディジタル信号に変換する。例えば、図8に示されているように、各受波素子11で受波し得られた信号を増幅器2で増幅した後に、そのアナログ信号をそのまま遅延線(DL)3に入力する。各遅延線3の遅延量を、上記のように設定することにより、適切な遅延時間分、遅れたエコー信号がA/D変換器4でディジタル信号に変換されることになる。こうすることにより、同図中のD1、D2、D3の各方向から到来する超音波を、C1、C2、C3それぞれのカーブのように遅延させたディジタル信号に変換することができる。よって、任意の方向から到来する超音波について、整相加算を実現することができる。   As a method for realizing such phasing addition, there are an analog method and a digital method. In the analog system, an input signal is input through the variable delay element in which the delay amount is set as described above, and converted into a digital signal. For example, as shown in FIG. 8, after the signal received by each receiving element 11 is amplified by the amplifier 2, the analog signal is input to the delay line (DL) 3 as it is. By setting the delay amount of each delay line 3 as described above, an echo signal delayed by an appropriate delay time is converted into a digital signal by the A / D converter 4. By doing so, it is possible to convert ultrasonic waves arriving from directions D1, D2, and D3 in the figure into digital signals that are delayed as indicated by the curves of C1, C2, and C3. Therefore, phasing addition can be realized for ultrasonic waves coming from an arbitrary direction.

一方、ディジタル方式では、入力信号をディジタル信号に変換したディジタルデータを順次メモリに記憶しておき、メモリから読出す際に上記のように位相調整する。例えば、図9に示されているように、各受波素子で受信した信号を増幅器2で増幅し、A/D変換器4でディジタル信号に変換した後、各受波素子に対応するディジタルメモリ5に記憶する。そして、各メモリのうち、超音波の到来方向に対応する位置のメモリからデータを読出す。具体的には、同図中のC1のカーブに対応する位置のメモリからデータを読出し、それらを加算することにより、D1方向から到来する超音波について、整相加算を実現することができる。同様に、同図中のC2のカーブに対応する位置のメモリからデータを読出して加算すればD2方向から到来する超音波、C3のカーブに対応する位置のメモリからデータを読出して加算すればD3方向から到来する超音波、について整相加算を実現することができる。
伊東正安、望月剛共著「超音波診断装置」コロナ社 2002年8月、p.76〜80
On the other hand, in the digital method, digital data obtained by converting an input signal into a digital signal is sequentially stored in a memory, and phase adjustment is performed as described above when reading from the memory. For example, as shown in FIG. 9, after a signal received by each receiving element is amplified by an amplifier 2 and converted into a digital signal by an A / D converter 4, a digital memory corresponding to each receiving element is obtained. Store in 5. Then, data is read from the memory at a position corresponding to the direction of arrival of the ultrasonic wave in each memory. Specifically, phasing addition can be realized for ultrasonic waves coming from the D1 direction by reading data from a memory at a position corresponding to the curve of C1 in the figure and adding them. Similarly, if data is read from the memory at the position corresponding to the curve C2 in the figure and added, the ultrasonic wave coming from the direction D2, and if data is read from the memory at the position corresponding to the curve C3 and added is D3. The phasing addition can be realized for the ultrasonic wave coming from the direction.
Ito Masayasu and Mochizuki Tsuyoshi "Ultrasound Diagnostic Equipment" Corona Inc. August 2002, p. 76-80

上述した従来技術では、整相加算を実現する場合に、上述したアナログ方式やディジタル方式を採用している。しかしながら、上述した方式を採用すると、可変遅延素子やメモリが必要になり、超音波診断装置の部品点数が増えるという欠点がある。
本発明は上述した従来技術の欠点を解決するためになされたものであり、その目的は超音波診断装置に用いた場合に上記アナログ方式で用いる可変遅延素子を不要とし、かつ、上記ディジタル方式で用いるメモリを不要とすることで、ハードウェア量を削減することのできる位相調整機能付きA/Dコンバーを提供することである。
In the above-described conventional technology, the above-described analog method or digital method is employed when phasing addition is realized. However, if the above-described method is adopted, a variable delay element and a memory are required, and there is a disadvantage that the number of parts of the ultrasonic diagnostic apparatus increases.
The present invention has been made in order to solve the above-described drawbacks of the prior art, and an object of the present invention is to eliminate the need for the variable delay element used in the analog system when used in an ultrasonic diagnostic apparatus, and in the digital system. by eliminating the need for memory to be used, it is to provide a phase adjustment function a / D converter capable of reducing the hardware amount.

本発明の請求項1による位相調整機能付きA/Dコンバータは、超音波診断装置の探触子から入力されるアナログ信号をディジタル信号に変換するA/Dコンバータであって、互いに位相の異なる複数種類のパルス信号を生成するマルチフェーズジェネレータと、前記マルチフェーズジェネレータによって生成される前記複数種類のパルス信号を位相調整信号に応じて選択するセレクタと、前記複数種類のパルス信号のうち前記セレクタによって選択されたパルス信号を用いて前記アナログ信号をディジタル信号に変換するA/D変換回路と、が1チップに形成されてなり、前記マルチフェーズジェネレータは、互いに位相の異なる複数種類のパルス信号を出力する電圧制御発振器と、この電圧制御発振器の出力の1つと基準信号との位相差を検出する位相差検出回路とを含み、前記位相差検出回路によって検出される位相差に応じて前記電圧制御発振器の発振周波数を制御することを特徴とする。このように構成されたチップを用いることにより、超音波診断装置の部品点数を削減することができる。 The A / D converter with phase adjustment function according to claim 1 of the present invention is an A / D converter that converts an analog signal input from a probe of an ultrasonic diagnostic apparatus into a digital signal, and has a plurality of phases different from each other A multi-phase generator for generating different types of pulse signals; a selector for selecting the plurality of types of pulse signals generated by the multi-phase generator according to a phase adjustment signal; and the selector for selecting among the plurality of types of pulse signals. An A / D conversion circuit that converts the analog signal into a digital signal using the pulse signal thus formed is formed on one chip, and the multi-phase generator outputs a plurality of types of pulse signals having different phases from each other. The phase difference between the voltage controlled oscillator and one of the outputs of the voltage controlled oscillator and the reference signal And a phase difference detecting circuit for detecting, characterized that you control the oscillation frequency of the voltage controlled oscillator according to the phase difference detected by said phase difference detecting circuit. By using the chip configured as described above, the number of parts of the ultrasonic diagnostic apparatus can be reduced.

本発明の請求項2による位相調整機能付きA/Dコンバータは、請求項1において、前記セレクタと前記A/D変換回路との組を複数含むことを特徴とする。このように構成されたチップを用いることにより、超音波診断装置の部品点数をより削減することができる。 According to a second aspect of the present invention, the A / D converter with phase adjustment function according to the first aspect includes a plurality of sets of the selector and the A / D conversion circuit. By using the thus constructed tip, Ru can be further reduced the number of parts of the ultrasonic diagnostic apparatus.

本発明によれば、マルチフェーズジェネレータやセレクタを1チップ化したものを超音波診断装置に用いることにより、上記アナログ方式で用いる可変遅延素子や上記ディジタル方式で用いるメモリが不要になるのでハードウェア量を削減できるという効果が得られる。さらに、本発明によれば、位相調整が精度良く制御できるという、高精度なディジタル方式の利点を保つことができるので、高速に動作するA/Dコンバータを使用する必要もないという効果がある。   According to the present invention, by using a multi-phase generator and selector in a single chip for an ultrasonic diagnostic apparatus, the variable delay element used in the analog method and the memory used in the digital method are not required, so the amount of hardware is increased. Can be reduced. Furthermore, according to the present invention, it is possible to maintain the advantage of the high-precision digital system that the phase adjustment can be controlled with high accuracy, and there is an effect that it is not necessary to use an A / D converter that operates at high speed.

以下、本発明の実施の形態を、図面を参照して説明する。なお、以下の説明において参照する各図では、他の図と同等部分は同一符号によって示されている。
(チップ内の回路構成)
図1に示されているように、互いに位相の異なる複数のパルスを出力するマルチフェーズジェネレータ41と、このマルチフェーズジェネレータ41から出力される複数のパルスについて位相調整のための選択信号SELに応じて1つのパルスを選択して出力する位相セレクタ42と、位相セレクタ42において選択されて出力されたパルスによるタイミングでサンプリング動作し、アナログ信号をディジタル信号に変換するアナログディジタル変換回路(A/D)43とを含んで構成されている。そして、これらマルチフェーズジェネレータ41、位相セレクタ42、及び、アナログディジタル変換回路43が1つのチップに収容されている。
Hereinafter, embodiments of the present invention will be described with reference to the drawings. In the drawings referred to in the following description, the same parts as those in the other drawings are denoted by the same reference numerals.
(Circuit configuration in the chip)
As shown in FIG. 1, a multi-phase generator 41 that outputs a plurality of pulses having different phases from each other, and a plurality of pulses output from the multi-phase generator 41 according to a selection signal SEL for phase adjustment. A phase selector 42 that selects and outputs one pulse, and an analog-to-digital conversion circuit (A / D) 43 that performs a sampling operation at the timing of the pulse selected and output by the phase selector 42 and converts an analog signal into a digital signal. It is comprised including. The multi-phase generator 41, the phase selector 42, and the analog / digital conversion circuit 43 are accommodated in one chip.

マルチフェーズジェネレータ41については、その構成例を後述する。このマルチフェーズジェネレータ41の全ての出力は、位相セレクタ42に入力される。
位相セレクタ42は、周知のマルチプレクサを用いて構成することができる。位相セレクタ42では、マルチフェーズジェネレータ41から入力される複数のパルスについて、選択信号SELの内容に応じて選択して出力する。この選択されたパルスがアナログディジタル変換回路43に入力され、サンプリングのタイミングが決定される。
A configuration example of the multi-phase generator 41 will be described later. All outputs of the multi-phase generator 41 are input to the phase selector 42.
The phase selector 42 can be configured using a known multiplexer. The phase selector 42 selects and outputs a plurality of pulses input from the multiphase generator 41 according to the contents of the selection signal SEL. The selected pulse is input to the analog-digital conversion circuit 43, and the sampling timing is determined.

アナログディジタル変換回路43は、アナログ信号Ainを入力とし、その信号レベルに応じたディジタル信号Doutを出力する。
ここで、図1に示されている回路構成を有するチップは、探触子に含まれている受波素子に対応した数だけ、用意されることになる。そして、探触子の対応する受波素子が受信したアナログ信号を、チップ内のアナログディジタル変換回路43によってディジタル信号に変換することになる。
このチップを複数個用いた場合でも、各チップには同じ基準信号ADCKが入力されるので、各チップから出力されるパルスは所望の位相差を有していることになる。したがって、上記チップにおいて、位相セレクタ42に入力する選択信号SELによって適切なパルスを選択すれば、各受波素子によって得られるパルスを適切なタイミングでディジタル信号に変換することができる。
The analog-digital conversion circuit 43 receives an analog signal Ain and outputs a digital signal Dout corresponding to the signal level.
Here, the number of chips having the circuit configuration shown in FIG. 1 is prepared corresponding to the number of receiving elements included in the probe. The analog signal received by the wave receiving element corresponding to the probe is converted into a digital signal by the analog-digital conversion circuit 43 in the chip.
Even when a plurality of chips are used, since the same reference signal ADCK is input to each chip, pulses output from each chip have a desired phase difference. Therefore, in the above chip, if an appropriate pulse is selected by the selection signal SEL input to the phase selector 42, the pulse obtained by each receiving element can be converted into a digital signal at an appropriate timing.

(マルチフェーズジェネレータの構成例)
ここで、マルチフェーズジェネレータ41は、例えば、図2に示されているように構成すれば良い。同図において、マルチフェーズジェネレータ41は、入力信号と基準信号ADCKとの位相を比較して位相差を検出する位相比較器(PC)41aと、位相比較器41aによって検出される位相差に対応する電荷を充放電するチャージポンプ回路(CP)41bと、チャージポンプ回路41bの出力をフィルタリングするループフィルタ(LF)41cと、ループフィルタ41cの出力に応じて発振周波数が変わる電圧制御発振器(VCO)41dとを含んで構成されている。また、電圧制御発振器41dの出力の一部は、位相比較器41aに入力されている。
(Configuration example of multi-phase generator)
Here, the multiphase generator 41 may be configured as shown in FIG. 2, for example. In the figure, a multi-phase generator 41 corresponds to a phase comparator (PC) 41a that detects a phase difference by comparing phases of an input signal and a reference signal ADCK, and a phase difference detected by the phase comparator 41a. A charge pump circuit (CP) 41b that charges and discharges charge, a loop filter (LF) 41c that filters the output of the charge pump circuit 41b, and a voltage controlled oscillator (VCO) 41d that changes the oscillation frequency according to the output of the loop filter 41c It is comprised including. A part of the output of the voltage controlled oscillator 41d is input to the phase comparator 41a.

電圧制御発振器41dは、図3に示されているように、K段(Kは奇数)直列に接続したインバータINV−1〜INV−Kを、最終段(第K段目)の出力を第1段目の入力に接続した構成になっている。そして、各段からのK本の出力がマルチフェーズジェネレータ41の出力となり、位相セレクタ42に入力される。位相セレクタ42においては、上記各段の出力のうち1つのみが選択されて出力されることになる。
また、第1段目の出力は位相比較器41aに入力され、この位相比較器41aにおいて、第1段目の出力と基準信号ADCKとの位相が比較される。このため、マルチフェーズジェネレータ41の各出力は、互いに同期したものとなるので、上記チップを複数個用いた場合でも各チップ内のアナログディジタル変換回路43におけるサンプリング動作が正しいタイミングで行われる。
As shown in FIG. 3, the voltage-controlled oscillator 41d receives inverters INV-1 to INV-K connected in series in K stages (K is an odd number), and outputs the output of the final stage (Kth stage) to the first. It is configured to connect to the input of the stage. Then, K outputs from each stage become outputs of the multiphase generator 41 and are input to the phase selector 42. In the phase selector 42, only one of the outputs of the above stages is selected and output.
The output of the first stage is input to the phase comparator 41a, and the phase comparator 41a compares the phase of the output of the first stage with the reference signal ADCK. Therefore, since the outputs of the multiphase generator 41 are synchronized with each other, the sampling operation in the analog-to-digital conversion circuit 43 in each chip is performed at the correct timing even when a plurality of the chips are used.

(複数回路構成を1チップ化)
ところで、上記の回路構成を複数含んでいても良い。すなわち、図4に示されているように、M個(Mは自然数、以下同じ)の位相セレクタ42−1〜42−Mと、M個のアナログディジタル変換回路(A/D)43−1〜43−Mと、単一のマルチフェーズジェネレータ41とを1チップ化しても良い。この場合、位相セレクタ42−i(i=1〜M)とアナログディジタル変換回路43−i(i=1〜M)との組が複数個、1チップに含まれることになる。
そして、探触子を構成する受波素子の数に応じて、図4に示されているチップを複数個用意すれば良い。図4に示されている回路構成を有するチップを複数個用いた場合でも、各チップには同じ基準信号ADCKが入力されるので、各チップから出力されるパルスは所望の位相差を有していることになる。よって、このように構成した場合でも、各チップ内のアナログディジタル変換回路43におけるサンプリング動作が正しいタイミングで行われる。
(Multiple circuit configuration on one chip)
By the way, a plurality of the above circuit configurations may be included. That is, as shown in FIG. 4, M (M is a natural number, the same applies hereinafter) phase selectors 42-1 to 42-M and M analog-to-digital conversion circuits (A / D) 43-1 to 43-1. 43-M and the single multiphase generator 41 may be integrated into one chip. In this case, a plurality of sets of phase selectors 42-i (i = 1 to M) and analog-digital conversion circuits 43-i (i = 1 to M) are included in one chip.
Then, a plurality of chips shown in FIG. 4 may be prepared in accordance with the number of receiving elements constituting the probe. Even when a plurality of chips having the circuit configuration shown in FIG. 4 are used, since the same reference signal ADCK is input to each chip, pulses output from each chip have a desired phase difference. Will be. Therefore, even in such a configuration, the sampling operation in the analog-digital conversion circuit 43 in each chip is performed at the correct timing.

(送信時の位相調整)
以上は、受信信号についての位相調整を行う場合について説明したが、送信時に位相調整を行っても良い。すなわち、上記の位相調整を、送信する際に行った場合でも、遅延量を正しく設定できることになる。この場合、図5に示されているように、マルチフェーズジェネレータ41の出力を位相セレクタ42で選択し、この選択した出力を探触子10から送信する。一方、探触子10によって受信した信号をアナログディジタル変換回路43によってディジタル信号に変換すれば良い。アナログディジタル変換回路43は、基準信号ADCKによるタイミングで動作する。
(Phase adjustment during transmission)
Although the case where the phase adjustment is performed on the received signal has been described above, the phase adjustment may be performed at the time of transmission. That is, even when the above phase adjustment is performed at the time of transmission, the delay amount can be set correctly. In this case, as shown in FIG. 5, the output of the multi-phase generator 41 is selected by the phase selector 42, and the selected output is transmitted from the probe 10. On the other hand, the signal received by the probe 10 may be converted into a digital signal by the analog-digital conversion circuit 43. The analog-digital conversion circuit 43 operates at a timing based on the reference signal ADCK.

(超音波診断装置)
以上説明した位相調整機能付きA/Dコンバータは、超音波診断装置に用いることができる。このA/Dコンバータを用いた超音波診断装置は、探触子から入力されるアナログ信号をディジタル信号に変換するA/D変換回路を有する超音波診断装置であり、互いに位相の異なる複数種類のパルス信号を生成するマルチフェーズジェネレータと、上記マルチフェーズジェネレータによって生成される上記複数種類のパルス信号を位相調整信号に応じて選択するセレクタとを含み、上記複数種類のパルス信号のうち上記セレクタによって選択されたパルス信号を用いて、上記探触子から入力されるアナログ信号をディジタル信号に変換する超音波診断装置である。このように構成すれば、上記アナログ方式で用いる可変遅延素子や上記ディジタル方式で用いるメモリが不要になるのでハードウェア量を削減できるので、少ないハードウェア量で、超音波診断装置での整相加算を実現できる。さらに、上記構成によれば、位相調整が精度良く制御できるという、高精度なディジタル方式の利点を保つことができるので、高速に動作するA/Dコンバータを使用する必要はない。
(Ultrasonic diagnostic equipment)
The A / D converter with phase adjustment function described above can be used in an ultrasonic diagnostic apparatus. This ultrasonic diagnostic apparatus using an A / D converter is an ultrasonic diagnostic apparatus having an A / D conversion circuit that converts an analog signal input from a probe into a digital signal. A multi-phase generator that generates a pulse signal; and a selector that selects the plurality of types of pulse signals generated by the multi-phase generator according to a phase adjustment signal. The ultrasonic diagnostic apparatus converts an analog signal input from the probe into a digital signal using the pulse signal thus generated. With this configuration, the variable delay element used in the analog method and the memory used in the digital method are no longer necessary, so the amount of hardware can be reduced. Can be realized. Furthermore, according to the above configuration, it is possible to maintain the advantage of the high-precision digital system that the phase adjustment can be controlled with high accuracy, and therefore it is not necessary to use an A / D converter that operates at high speed.

以上説明したように本発明では、マルチフェーズジェネレータと位相セレクタとA/D変換回路とを1チップに形成しているので、位相調整のための可変遅延素子やメモリが不要となり、少ないハードウェア量で、超音波診断装置での整相加算を実現することができる。   As described above, in the present invention, since the multi-phase generator, the phase selector, and the A / D conversion circuit are formed on one chip, a variable delay element and a memory for phase adjustment are not necessary, and a small amount of hardware is required. Thus, phasing addition in the ultrasonic diagnostic apparatus can be realized.

本発明による実施の一形態による位相調整機能付きA/Dコンバータの構成を示すブロック図である。Is a block diagram showing a configuration of a phase adjustment function A / D converter according to an embodiment of implementation that by the present invention. マルチフェーズジェネレータの構成例を示すブロック図である。It is a block diagram which shows the structural example of a multiphase generator. 電圧制御発振器の構成例を示すブロック図である。It is a block diagram which shows the structural example of a voltage controlled oscillator. 図1の構成を複数設けた位相調整機能付きA/Dコンバータの構成を示すブロック図である。It is a block diagram which shows the structure of the A / D converter with a phase adjustment function which provided two or more structures of FIG. 本発明による位相調整機能付きA/Dコンバータにおいて送信時に位相調整する実施形態を示すブロック図である。It is a block diagram which shows embodiment which adjusts a phase at the time of transmission in the A / D converter with a phase adjustment function by this invention. 一般的な超音波診断装置の構成例を示すブロック図である。It is a block diagram which shows the structural example of a general ultrasonic diagnostic apparatus. 整相加算を説明するため図である。It is a figure for demonstrating phasing addition. 整相加算を実現するための従来の一構成例を示すブロック図である。It is a block diagram which shows one structural example for implement | achieving phasing addition. 整相加算を実現するための従来の他の構成例を示すブロック図である。It is a block diagram which shows the other example of a conventional structure for implement | achieving phasing addition.

符号の説明Explanation of symbols

2 増幅器
3 遅延線
4 A/D変換器
5 ディジタルメモリ
10 探触子
11 受波素子
20 送信器
30 受信器
40 検波器
41 マルチフェーズジェネレータ
41a 位相比較器
41b チャージポンプ回路
41c ループフィルタ
41d 電圧制御発振器
42、42−1〜42−M 位相セレクタ
43、43−1〜43−M アナログディジタル変換回路
50 ラインメモリ
60 スキャンコンバージョンメモリ
70 ディスプレイ画面
INV−1〜INV−K インバータ
2 Amplifier 3 Delay line 4 A / D converter 5 Digital memory 10 Probe 11 Receiver element 20 Transmitter 30 Receiver 40 Detector 41 Multiphase generator 41a Phase comparator 41b Charge pump circuit 41c Loop filter 41d Voltage controlled oscillator 42, 42-1 to 42-M Phase selectors 43, 43-1 to 43-M Analog-digital conversion circuit 50 Line memory 60 Scan conversion memory 70 Display screen INV-1 to INV-K Inverter

Claims (2)

超音波診断装置の探触子から入力されるアナログ信号をディジタル信号に変換するA/Dコンバータであって、
互いに位相の異なる複数種類のパルス信号を生成するマルチフェーズジェネレータと、
前記マルチフェーズジェネレータによって生成される前記複数種類のパルス信号を位相調整信号に応じて選択するセレクタと、
前記複数種類のパルス信号のうち前記セレクタによって選択されたパルス信号を用いて前記アナログ信号をディジタル信号に変換するA/D変換回路と、
が1チップに形成されてなり、
前記マルチフェーズジェネレータは、
互いに位相の異なる複数種類のパルス信号を出力する電圧制御発振器と、この電圧制御発振器の出力の1つと基準信号との位相差を検出する位相差検出回路とを含み、前記位相差検出回路によって検出される位相差に応じて前記電圧制御発振器の発振周波数を制御することを特徴とする位相調整機能付きA/Dコンバータ。
An A / D converter that converts an analog signal input from a probe of an ultrasonic diagnostic apparatus into a digital signal,
A multi-phase generator that generates multiple types of pulse signals with different phases,
A selector for selecting the plurality of types of pulse signals generated by the multi-phase generator according to a phase adjustment signal;
An A / D conversion circuit that converts the analog signal into a digital signal using a pulse signal selected by the selector from the plurality of types of pulse signals;
Is formed on one chip,
The multi-phase generator is
A voltage controlled oscillator that outputs a plurality of types of pulse signals having different phases, and a phase difference detection circuit that detects a phase difference between one of the outputs of the voltage controlled oscillator and a reference signal, and is detected by the phase difference detection circuit An A / D converter with a phase adjustment function, wherein an oscillation frequency of the voltage controlled oscillator is controlled according to a phase difference to be performed.
前記セレクタと前記A/D変換回路との組を複数含むことを特徴とする請求項1記載の位相調整機能付きA/Dコンバータ 2. The A / D converter with phase adjustment function according to claim 1, comprising a plurality of sets of the selector and the A / D conversion circuit .
JP2003382578A 2003-11-12 2003-11-12 A / D converter with phase adjustment function Expired - Fee Related JP4417074B2 (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2003382578A JP4417074B2 (en) 2003-11-12 2003-11-12 A / D converter with phase adjustment function

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2003382578A JP4417074B2 (en) 2003-11-12 2003-11-12 A / D converter with phase adjustment function

Publications (2)

Publication Number Publication Date
JP2005143640A JP2005143640A (en) 2005-06-09
JP4417074B2 true JP4417074B2 (en) 2010-02-17

Family

ID=34691614

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2003382578A Expired - Fee Related JP4417074B2 (en) 2003-11-12 2003-11-12 A / D converter with phase adjustment function

Country Status (1)

Country Link
JP (1) JP4417074B2 (en)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5275830B2 (en) * 2009-01-26 2013-08-28 富士フイルム株式会社 Optical ultrasonic tomographic imaging apparatus and optical ultrasonic tomographic imaging method
IT1403296B1 (en) 2010-12-28 2013-10-17 St Microelectronics Srl ULTRASOUND IMAGE SYSTEM WITH 4D DATA AND CORRESPONDING CONTROL PROCESS

Also Published As

Publication number Publication date
JP2005143640A (en) 2005-06-09

Similar Documents

Publication Publication Date Title
JP6043867B2 (en) Ultrasonic imaging device
EP1696244A2 (en) Wave receiving device and method of determining wave reception
JP2993463B2 (en) Synchronous circuit controller
KR100923212B1 (en) Method and apparatus for a digital-to-phase converter
JP6687392B2 (en) Serializer device
KR100826975B1 (en) A circuit of clock generator and the method of clock Generating
JP4417074B2 (en) A / D converter with phase adjustment function
JPH084588B2 (en) Ultrasonic receiver
JPH09224937A (en) Ultrasonic diagnostic device
KR101784963B1 (en) Method for collecting of synchronized streaming data in digital receiver
JP4980688B2 (en) Ultrasonic diagnostic equipment
JP2737703B2 (en) Ultrasonic receiver
JPH05184567A (en) Ultrasonic diagnostic device
JPH0515533A (en) Ultrasonic diagnosing apparatus
JPH10127629A (en) Ultrasonic diagnostic system
JP6737642B2 (en) Serial data receiving circuit, receiving method, transceiver circuit, electronic device
JP2006314436A (en) Ultrasonic diagnosing system
JP3013767B2 (en) Frame timing phase adjustment circuit
JP4143703B2 (en) Digital arithmetic processing method
CN116800367A (en) Multichannel ultrasonic pulse type synchronization method based on interpolation and autocorrelation detection
JPH11216138A (en) Beam former of device for ultrasonic diagnosis
JP2006303688A (en) Serial data transmitting device and serial data receiving device
JP2002143154A (en) Ultrasonic diagnostic device
JPH0771559B2 (en) Ultrasonic diagnostic equipment
JPH09189758A (en) Sonar receiver processor

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20060524

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A821

Effective date: 20070402

A711 Notification of change in applicant

Free format text: JAPANESE INTERMEDIATE CODE: A712

Effective date: 20070402

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20090401

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20090519

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20090717

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20090818

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20091014

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20091117

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20091125

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121204

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20121204

Year of fee payment: 3

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20131204

Year of fee payment: 4

LAPS Cancellation because of no payment of annual fees